JPH08264552A - シリコンウエーハの製造方法 - Google Patents

シリコンウエーハの製造方法

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JPH08264552A
JPH08264552A JP7090135A JP9013595A JPH08264552A JP H08264552 A JPH08264552 A JP H08264552A JP 7090135 A JP7090135 A JP 7090135A JP 9013595 A JP9013595 A JP 9013595A JP H08264552 A JPH08264552 A JP H08264552A
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JP
Japan
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roughness
silicon wafer
square frame
mirror
wafer
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JP7090135A
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Inventor
Hiroshi Shirai
宏 白井
Atsushi Yoshikawa
淳 吉川
Yukari Kamitari
由加里 神足
Norihiro Shimoi
規弘 下井
Masayuki Sanada
昌之 真田
Shiyuuji Torihashi
修治 鳥觜
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Coorstek KK
Niigata Toshiba Ceramics KK
Original Assignee
Toshiba Ceramics Co Ltd
Niigata Toshiba Ceramics KK
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Publication date
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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02002Preparing wafers
    • H01L21/02005Preparing bulk and homogeneous wafers
    • H01L21/02008Multistep processes
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/3003Hydrogenation or deuterisation, e.g. using atomic hydrogen from a plasma

Abstract

(57)【要約】 【目的】 低コストで高品質の表面仕上げが可能なシリ
コンウエーハの製造方法を提供する。 【構成】 90μmを一辺とする正方形の枠内の粗さで
Raが0.08〜0.70nm、rmsが0.10〜
0.90nm、P−Vが0.80〜5.80nmであ
り、500nmを一辺とする正方形の枠内の粗さでRa
が0.13〜0.40nm、rmsが0.18〜0.5
0nm、P−Vが1.30〜2.50nmであるシリコ
ンウエーハを、1100〜1300℃の温度範囲で30
分以上4時間以内水素ガス雰囲気中でアニール処理する
ことを特徴とするシリコンウエーハの製造方法。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】この発明は、半導体デバイス製造
に使用されるシリコンウエーハの製造方法に関し、特に
高集積メモリ、フラッシュメモリ素子等を形成するため
のシリコンウエーハの製造方法に関するものである。
【0002】
【従来の技術】シリコン単結晶インゴットをスライスし
て作成されたウエーハは、ラッピング(粗研磨)工程、
面取り工程、鏡面研磨工程、及び必要に応じ化学研磨工
程や洗浄工程を経て最終商品のシリコンウエーハとな
る。
【0003】鏡面研磨工程は、例えばコロイダルシリカ
等のシリコンに対してエッチング性を持つ研磨剤を用い
て行われる。鏡面研磨工程は、一般に前段(1次)鏡面
研磨工程と最終鏡面研磨工程から成り、前段鏡面研磨工
程ではマクロなフラットネス(flatness)及びラフネス(r
oughness) が確保され、最終鏡面研磨工程ではミクロな
ラフネス及びヘイズフリー(haze free) が得られる。こ
こで、ヘイズとは、15万ルックスの光源をウエーハ表
面に照射したとき、光が当たったスポットが全部白濁し
て見える現象である。
【0004】一般的に、前段鏡面研磨工程で達成される
表面粗さは、90μmを一辺とする正方形の枠内の粗さ
でRaが0.40〜0.70nm、rmsが0.60〜
0.90nm、P−Vが4.00〜6.00nm程度で
あり、500nmを一辺とする正方形の枠内の粗さでR
aが0.20〜0.30nm、rmsが0.20〜0.
30nm、P−Vが1.8〜2.0nm程度であった。
【0005】さらに、最終鏡面研磨工程を行うことによ
り得られる表面粗さは、90μmを一辺とする正方形の
枠内の粗さでRaが0.20〜0.30nm、rmsが
0.20〜0.30nm、P−Vが2.00〜3.00
nm程度であり、500nmを一辺とする正方形の枠内
の粗さでRaが0.08〜0.12nm、rmsが0.
10〜0.13nm、P−Vが0.9〜1.1nm程度
であった。
【0006】このような表面粗さからも分かるように、
前段及び最終の鏡面研磨工程(メカノケミカルポリッシ
ュ)によって、マクロな表面精度及びヘイズフリーは確
保可能であるが、原子的平坦面を実現することは難しか
った。
【0007】近年、高集積メモリやフラッシュメモリ素
子用のウエーハとして、原子的平坦面を有する高品質の
ウエーハが求められている。
【0008】そこで、従来は、前段鏡面研磨工程及び最
終鏡面研磨工程を施した後でH2 アニール処理を行っ
て、原子的平坦性を確保していた。
【0009】また、より高品質のウエーハを得るため、
水素ガス雰囲気中で高温熱処理を施すことにより、ウエ
ーハ表面に含まれる酸素を低減し、微小欠陥(BMD)
の少ない無欠陥層(DZ層)を形成することが提案され
ている。DZ層を形成することによって、テバイス工程
でのリークを防止し、より高品質のウエーハを得ること
ができるのである。
【0010】
【発明が解決しようとする課題】本出願人は、特願平6
−49983号で、水素ガスのエッチング効果を積極的
に利用し、特定範囲の表面状態を有するシリコンウエー
ハに適用することによって、ウエーハ表面の状態を改善
する方法を提案している。この方法によれば、最終の鏡
面研磨工程を行わなくとも、良好な表面仕上げを得るこ
とができ、同時にDZ層をウエーハ表面に形成すること
が可能である。
【0011】本発明は、前記提案の方法を更に改良し、
低コストでより高品質の表面仕上げが可能なシリコンウ
エーハの製造方法を提供することを目的としている。
【0012】
【課題を解決するための手段】本発明は、請求項1〜4
のいずれか1項に記載のシリコンウエーハの製造方法を
要旨としている。
【0013】
【作用】表面粗さが最終鏡面研磨状態よりも悪い状態の
シリコンウエーハに対して、1100〜1300℃の温
度範囲で30分以上4時間以内水素ガス雰囲気中でアニ
ール処理を施し、ウエーハ表面の再配列(reconstructi
on)によりシリコンウエーハの表面粗さを改善する。
【0014】
【実施例】以下、本発明の実施例を詳細に説明する。
【0015】本発明において使用されるシリコンウエー
ハは、通常のCZ法あるいはFZ法によって製造された
ものである。表面粗さは、90μmを一辺とする正方形
の枠内の粗さでRaが0.08〜0.70nm、rms
が0.10〜0.90nm、P−Vが0.80〜5.8
0nmであり、500nmを一辺とする正方形の枠内の
粗さでRaが0.13〜0.40nm、rmsが0.1
8〜0.50nm、P−Vが1.30〜2.50nmで
ある。
【0016】表面粗さが前記上限より粗い場合には、再
配列による表面粗さの改善効果が小さく、所望の表面粗
さを得ることはできない。その場合、良好な表面仕上げ
を得るためには、最終鏡面研磨工程を施さねばならな
い。
【0017】また、前記下限の表面粗さより優れた表面
粗さを確保するためには、最終研磨工程を省略できな
い。従って、その場合には、コスト高であるばかりか、
アニール処理による表面改善効果も少なく、工程的なロ
スが大きくなる。
【0018】本明細書において、表面粗さRaは、JI
SB0601で規定される中心線平均粗さを2次元に拡
張したものであり、表面上の粗さ曲面をZ=f(x,
y)で表わすと、次式で示される。
【0019】
【数1】 ここで、Sは測定領域面であり、たとえば、90μm
(あるいは500nm)を一辺とする正方形の領域(面
積)を示す。
【0020】また、rmsは、自乗平均粗さであり、次
式で示される。
【0021】
【数2】 また、P−Vは、測定領域面内での最高山頂から最低谷
底までの高さを示す。
【0022】前述したようなウエーハは、通常、単結晶
インゴットをスライスした後、ラッピング工程及び化学
研磨工程を経て、所定の表面粗さとなるまで前段鏡面研
磨を行って製造される。
【0023】前記シリコンウエーハに対して、1100
〜1300℃の温度範囲で30分以上4時間以内水素ガ
ス雰囲気中でアニール処理を行う。このアニール処理に
よって、ウエーハの表面粗さを、500nmを一辺とす
る正方形の枠内の粗さでRaが0.10nm未満、rm
sが0.12nm未満、P−Vが1.0nm未満となる
ようにする。
【0024】アニール処理温度が1100℃未満又は1
300℃を超える場合、また、処理時間が30分未満の
場合には、表面の改善効果が少なく、前記表面粗さを有
するシリコンウエーハを製造することが困難である。ま
た、4時間を超える熱処理工程を行っても、それ以上の
表面改善効果が少なく、コスト面及び生産性の面から好
ましくない。
【0025】アニール処理工程では、キャリアガスとし
て不活性ガス等を混入しても良いが、エッチングを効率
良く行うためには、実質的に水素ガス100%雰囲気で
行うことが好ましい。
【0026】前記条件でアニール処理を行うことによ
り、AFM(原子間力顕微鏡)により測定可能な1μm
を一辺とする正方形の枠内の以下のミクロな領域では、
テラス、ステップ等から構成される原子的平坦面が、ウ
エーハ表面の再配列(reconstruction)により生成され
る。その結果、1μmを一辺とする正方形の枠内の以下
のミクロな領域の粗さ(Ra、rms、P−V)も低減
する。
【0027】この表面粗さ低減効果により、ヘイズフリ
ーでない前段鏡面加工面の粗さを改善して、ヘイズフリ
ー面を得ることができる。しかし、よりマクロな粗さ
(例えば、〜90μmを一辺とする正方形の枠内の範囲
の粗さ)は、水素アニール処理によっては余り改善され
ない。このため、前段鏡面研磨の段階で、マクロな粗さ
を前述した程度まで改善しておくことが必要である。そ
の際、ヘイズフリーを達成する必要はなく、従って鏡面
研磨を短時間・低コストで終えることができる。
【0028】本発明方法では、このような表面粗さのシ
リコンウエーハに対して水素アニール処理を行うことに
よって、ミクロな平坦性(特に原子的平坦性)を実現で
き、同時にヘイズフリーにすることができるのである。
【0029】以下、本発明の実施例1〜2及び比較例1
〜2を詳細に説明するが、本発明は実施例1〜2に限定
されるものではない。図1〜図2は、比較例1と2、お
よび実施例1〜2の処理手順を示している。
【0030】まず、CZ法によって引き上げたシリコン
単結晶インゴットに対して、スライス工程、ラッピング
工程、化学研磨工程、前段鏡面研磨工程を行って、ある
程度表面研磨されたシリコンウエーハを得た。
【0031】前段鏡面研磨工程を行ったシリコンウエー
ハに、従来の最終鏡面研磨工程を施し、1200℃の温
度で1時間、水素ガス雰囲気中でアニール処理を行った
(実施例1)。
【0032】一方、熱処理(アニール処理)をしないサ
ンプルを比較例1とし、表面粗さを光学式粗さ計(商品
名“ZYGO”)及び原子間力顕微鏡(AFM)で測定
した。
【0033】前段鏡面研磨工程後のシリコンウエーハに
対して、1200℃の温度で1時間、水素ガス雰囲気中
でアニール処理を行った(実施例2)。
【0034】一方、熱処理(アニール処理)をしないサ
ンプルを比較例2とし、表面粗さを光学式粗さ計(商品
名“ZYGO”)及び原子間力顕微鏡(AFM)で測定
した。
【0035】これらの結果を、表1に示した。
【0036】
【表1】 表1を見ると、前段鏡面研磨を行ったウエーハに水素ガ
ス中で熱処理(アニール処理)を施すと、90μmを一
辺とする正方形の枠内の粗さは改善されないが、500
nmを一辺とする正方形の枠内の粗さを大きく改善でき
ることが分かる。
【0037】また、最終ミラー(鏡面研磨)加工によっ
て、90μmを一辺とする正方形の枠内の粗さを改善で
き、500nmを一辺とする正方形の枠内の粗さを前段
ミラー加工面の半分程度に改善できることが確認され
た。この際、前段ミラー加工面で観察されるヘイズも無
くすことができる。
【0038】さて、前段ミラー加工を最適化すれば、9
0μmを一辺とする正方形の枠内の粗さを最終ミラー加
工面のレベルまで改善することは可能である。従って、
前段ミラー加工によって、前記範囲の90μmを一辺と
する正方形の枠内の粗さ及び500nmを一辺とする正
方形の枠内の粗さを確保すれば、最終ミラー加工を水素
ガスアニールで置き替え可能であることが分かる。
【0039】ここで注目すべきは、最終ミラー加工を水
素ガスアニール処理で置き替えたウエーハにおいては、
ミクロな粗さ(500nmを一辺とする正方形の枠内
の)を従来のウエーハ(前段ミラー加工→最終ミラー加
工)よりも低減できるばかりでなく、テラスやステップ
により構成される原子的平坦面を得ることができること
である。なお、前述したように、通常の最終ミラー加工
面は、原子的平坦性を有さず、原子的にはランダム面と
なっている。
【0040】このような原子的平坦面は、フラッシュメ
モリー等の極薄な酸化膜の信頼性を向上させる上で重要
と考えられており、従って、本発明方法によれば非常に
有用なシリコンウエーハを製造することができるのであ
る。
【0041】
【発明の効果】本発明によれば、低コストで高品質の表
面仕上げが可能なシリコンウエーハを製造することがで
きる。特に、従来は必須であった仕上げ(最終)鏡面研
磨工程を行わなくとも、同程度以上の表面精度を実現で
き、しかも、仕上げ面を原子的に平坦化することが可能
である。
【図面の簡単な説明】
【図1】実施例1と比較例1の処理手順を示す説明図。
【図2】実施例2と比較例2の処理手順を示す説明図。
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成8年3月27日
【手続補正1】
【補正対象書類名】図面
【補正対象項目名】図1
【補正方法】変更
【補正内容】
【図1】
フロントページの続き (72)発明者 吉川 淳 神奈川県秦野市曽屋30番地 東芝セラミッ クス株式会社開発研究所内 (72)発明者 神足 由加里 新潟県北蒲原郡聖籠町東港六丁目861番5 号 新潟東芝セラミックス株式会社内 (72)発明者 下井 規弘 新潟県北蒲原郡聖籠町東港六丁目861番5 号 新潟東芝セラミックス株式会社内 (72)発明者 真田 昌之 新潟県北蒲原郡聖籠町東港六丁目861番5 号 新潟東芝セラミックス株式会社内 (72)発明者 鳥觜 修治 神奈川県秦野市曽屋30番地 東芝セラミッ クス株式会社開発研究所内

Claims (4)

    【特許請求の範囲】
  1. 【請求項1】 90μmを一辺とする正方形の枠内の粗
    さでRaが0.08〜0.70nm、rmsが0.10
    〜0.90nm、P−Vが0.80〜5.80nmであ
    り、500nmを一辺とする正方形の枠内の粗さでRa
    が0.13〜0.40nm、rmsが0.18〜0.5
    0nm、P−Vが1.30〜2.50nmであるシリコ
    ンウエーハを、1100〜1300℃の温度範囲で30
    分以上4時間以内水素ガス雰囲気中でアニール処理する
    ことを特徴とするシリコンウエーハの製造方法。
  2. 【請求項2】 アニール処理を施すシリコンウエーハ
    が、前段鏡面研磨工程を施したシリコンウエーハである
    ことを特徴とする請求項1に記載のシリコンウエーハの
    製造方法。
  3. 【請求項3】 アニール処理によって、500nmを一
    辺とする正方形の枠内の粗さでRaが0.10nm未
    満、rmsが0.12nm未満、P−Vが1.0nm未
    満であるシリコンウエーハを製造することを特徴とする
    請求項1に記載のシリコンウエーハの製造方法。
  4. 【請求項4】 アニール処理によって、ウエーハ表面を
    原子的に平坦化することを特徴とする請求項1に記載の
    シリコンウエーハの製造方法。
JP7090135A 1995-03-24 1995-03-24 シリコンウエーハの製造方法 Pending JPH08264552A (ja)

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