JPH07304201A - プリントヘッド駆動ｉｃ - Google Patents
プリントヘッド駆動ｉｃInfo
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- JPH07304201A JPH07304201A JP9594694A JP9594694A JPH07304201A JP H07304201 A JPH07304201 A JP H07304201A JP 9594694 A JP9594694 A JP 9594694A JP 9594694 A JP9594694 A JP 9594694A JP H07304201 A JPH07304201 A JP H07304201A
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- drive
- circuit
- input
- printhead
- driving
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Abstract
(57)【要約】
【目的】 複数の発熱素子を駆動する駆動ＩＣであっ
て、サージ電流による影響が少なく、放熱板の反りが生
じることがなく、また、素子の個数が異なるブロックご
とに駆動を行っても印字濃度の差が生じない駆動ＩＣを
提供する。 【構成】 ＮＯＲ回路部３０における各ＮＯＲ回路３０
−１〜３０−９６の入力端子間に、入力端子１４から入
力されるストローブ信号を順次遅延させるための遅延回
路としてのバッファ５０−１〜５０−９５を設ける。
て、サージ電流による影響が少なく、放熱板の反りが生
じることがなく、また、素子の個数が異なるブロックご
とに駆動を行っても印字濃度の差が生じない駆動ＩＣを
提供する。 【構成】 ＮＯＲ回路部３０における各ＮＯＲ回路３０
−１〜３０−９６の入力端子間に、入力端子１４から入
力されるストローブ信号を順次遅延させるための遅延回
路としてのバッファ５０−１〜５０−９５を設ける。
Description
【０００１】
【産業上の利用分野】本発明は、プリントヘッド特にサ
ーマルヘッドを駆動する駆動ＩＣに関するものである。
ーマルヘッドを駆動する駆動ＩＣに関するものである。
【０００２】
【従来の技術】従来より複数の発熱素子を有し、各発熱
素子を所定のパターンにて発熱させることにより感熱紙
等の印刷媒体に印字を行うためのサーマルヘッドが知ら
れている。
素子を所定のパターンにて発熱させることにより感熱紙
等の印刷媒体に印字を行うためのサーマルヘッドが知ら
れている。
【０００３】ここで、従来からサーマルヘッドを駆動す
る駆動ＩＣにおいては、ストローブ分割により各発熱素
子を駆動することが行われている。すなわち、１７２８
ドットのヘッドの場合に、これを４つのブロックに分け
て駆動制御を行う。１つの駆動ＩＣは通常６４ドットで
あるので、駆動ＩＣを７つ設け、１つのストローブ信号
により４４８ドットを処理できるようにし、４つのスト
ローブ信号によって上記１７２８ドットを処理するよう
にしている。
る駆動ＩＣにおいては、ストローブ分割により各発熱素
子を駆動することが行われている。すなわち、１７２８
ドットのヘッドの場合に、これを４つのブロックに分け
て駆動制御を行う。１つの駆動ＩＣは通常６４ドットで
あるので、駆動ＩＣを７つ設け、１つのストローブ信号
により４４８ドットを処理できるようにし、４つのスト
ローブ信号によって上記１７２８ドットを処理するよう
にしている。
【０００４】具体的な処理においては、まず図４（ａ）
に示すように、第１ブロックについてのストローブ信号
１を駆動ＩＣに入力する。このストローブ信号１におい
ては、１７２８ドットのうちの４４８ドットの印字処理
を行う。次に、ストローブ信号２が入力されて、他の第
２ブロックとしての４４８ドットの印字処理が行われ
る。次に、ストローブ信号３が入力されて、第３ブロッ
クとしての３８４ドットの印字処理が行われる。さら
に、ストローブ信号４が入力されて、第４ブロックとし
ての４４８ドットの印字処理が行われる。上記ストロー
ブ信号３における駆動制御においては、３８４ドットの
制御でよいので、７つの駆動ＩＣのうち６つの駆動ＩＣ
のみが使用される。
に示すように、第１ブロックについてのストローブ信号
１を駆動ＩＣに入力する。このストローブ信号１におい
ては、１７２８ドットのうちの４４８ドットの印字処理
を行う。次に、ストローブ信号２が入力されて、他の第
２ブロックとしての４４８ドットの印字処理が行われ
る。次に、ストローブ信号３が入力されて、第３ブロッ
クとしての３８４ドットの印字処理が行われる。さら
に、ストローブ信号４が入力されて、第４ブロックとし
ての４４８ドットの印字処理が行われる。上記ストロー
ブ信号３における駆動制御においては、３８４ドットの
制御でよいので、７つの駆動ＩＣのうち６つの駆動ＩＣ
のみが使用される。
【０００５】各ブロックにおける発熱素子は、上記各ス
トローブ信号が入力されるタイミングで駆動されるの
で、若干のスイッチング差があったとしても、あるブロ
ックにおいてはほぼ同時に発熱素子のオンオフ動作が行
われる。
トローブ信号が入力されるタイミングで駆動されるの
で、若干のスイッチング差があったとしても、あるブロ
ックにおいてはほぼ同時に発熱素子のオンオフ動作が行
われる。
【０００６】
【発明が解決しようとする課題】しかし、上記従来のサ
ーマルヘッドの駆動ＩＣにおいては、上記のように駆動
制御が行われるので、あるブロックが全ドットオン動作
されたり、特殊な縦罫線、縦帯パターン等を印字する場
合においては、発熱素子に流れる電流の変化が大きく変
化し電気系統に悪影響を及ぼす。つまり、例えば、スト
ローブ信号１が全ドットオンとされる場合に、図４
（ｂ）に示すように、発熱素子に流れる電流にサージ電
流が発生し、このサージ電流により５Ｖラインのストロ
ーブ信号がオフであるのに誤ってオン動作してしまうと
いう問題がある。ここで、ノイズやサージ対策用の部品
を設けることも考えられるが、コストアップになるとと
もに、該部品を設けるためのスペースが必要になってし
まいヘッドの小型化を図ることができない。
ーマルヘッドの駆動ＩＣにおいては、上記のように駆動
制御が行われるので、あるブロックが全ドットオン動作
されたり、特殊な縦罫線、縦帯パターン等を印字する場
合においては、発熱素子に流れる電流の変化が大きく変
化し電気系統に悪影響を及ぼす。つまり、例えば、スト
ローブ信号１が全ドットオンとされる場合に、図４
（ｂ）に示すように、発熱素子に流れる電流にサージ電
流が発生し、このサージ電流により５Ｖラインのストロ
ーブ信号がオフであるのに誤ってオン動作してしまうと
いう問題がある。ここで、ノイズやサージ対策用の部品
を設けることも考えられるが、コストアップになるとと
もに、該部品を設けるためのスペースが必要になってし
まいヘッドの小型化を図ることができない。
【０００７】また、例えば、発熱素子のあるブロックが
全ドットオン動作された場合に、複数の発熱素子のある
ブロックが発熱するために、発熱素子に設けられた放熱
板が熱膨脹し、放熱板に反りが生じて印字精度が低下す
る。この放熱板の反りを防ぐために、ヘッドをプラテン
に対して押すその押し圧を上げる方法が考えられるが、
プラテンを回転させる回転トルクを大きくする必要が生
じてしまう。
全ドットオン動作された場合に、複数の発熱素子のある
ブロックが発熱するために、発熱素子に設けられた放熱
板が熱膨脹し、放熱板に反りが生じて印字精度が低下す
る。この放熱板の反りを防ぐために、ヘッドをプラテン
に対して押すその押し圧を上げる方法が考えられるが、
プラテンを回転させる回転トルクを大きくする必要が生
じてしまう。
【０００８】さらに、上記従来例においては、ストロー
ブ信号１、ストローブ信号２及びストローブ信号４にお
いて、４４８ドットの印字処理を行い、一方、ストロー
ブ信号３においては、３８４ドットの印字処理を行うこ
とから、仮に全ドットオン動作した場合に、４４８ドッ
トの場合の方が並列接続された各発熱素子の数が多いた
めに発熱素子に流れる電流値が大きくなり、全ドットオ
ン動作した場合に、ストローブ信号１、２、４の場合の
方がストローブ信号３よりも印字濃度が濃くなってしま
って印字濃度にばらつきが生じてしまう。
ブ信号１、ストローブ信号２及びストローブ信号４にお
いて、４４８ドットの印字処理を行い、一方、ストロー
ブ信号３においては、３８４ドットの印字処理を行うこ
とから、仮に全ドットオン動作した場合に、４４８ドッ
トの場合の方が並列接続された各発熱素子の数が多いた
めに発熱素子に流れる電流値が大きくなり、全ドットオ
ン動作した場合に、ストローブ信号１、２、４の場合の
方がストローブ信号３よりも印字濃度が濃くなってしま
って印字濃度にばらつきが生じてしまう。
【０００９】そこで、本発明は、サージ電流による影響
が少なく、放熱板の反りが生じることがなく、また、印
字濃度の差が生じない駆動ＩＣを提供することを目的と
するものである。
が少なく、放熱板の反りが生じることがなく、また、印
字濃度の差が生じない駆動ＩＣを提供することを目的と
するものである。
【００１０】
【課題を解決するための手段】本発明におけるプリント
ヘッド駆動ＩＣは、上記問題点を解決するために創作さ
れたものであって、第１には、プリントヘッドに設けら
れる複数の素子を駆動するプリントヘッド駆動ＩＣであ
って、各素子に供給される駆動電流を順次遅延させなが
ら供給する遅延回路を有することを特徴とするものであ
る。
ヘッド駆動ＩＣは、上記問題点を解決するために創作さ
れたものであって、第１には、プリントヘッドに設けら
れる複数の素子を駆動するプリントヘッド駆動ＩＣであ
って、各素子に供給される駆動電流を順次遅延させなが
ら供給する遅延回路を有することを特徴とするものであ
る。
【００１１】また、第２には、上記第１の構成におい
て、プリントヘッドがサーマルプリントヘッドであっ
て、プリントヘッド駆動ＩＣが複数の発熱素子を駆動す
ることを特徴とするものである。
て、プリントヘッドがサーマルプリントヘッドであっ
て、プリントヘッド駆動ＩＣが複数の発熱素子を駆動す
ることを特徴とするものである。
【００１２】さらに、第３には、上記第１又は第２の構
成において、プリントヘッド駆動ＩＣが、ストローブ信
号と印字データ信号とに従い駆動電流を出力する複数の
ＮＯＲ回路を有し、各ＮＯＲ回路におけるストローブ信
号の入力端子間に遅延回路が設けられていることを特徴
とするものである。
成において、プリントヘッド駆動ＩＣが、ストローブ信
号と印字データ信号とに従い駆動電流を出力する複数の
ＮＯＲ回路を有し、各ＮＯＲ回路におけるストローブ信
号の入力端子間に遅延回路が設けられていることを特徴
とするものである。
【００１３】
【作用】本発明におけるプリントヘッド駆動ＩＣにおい
ては、各素子に供給される駆動電流を順次遅延させなが
ら供給する遅延回路を有しているので、各素子に対して
時系列的に順次駆動電流が供給される。よって、電流値
の急激な変化がないので、サージ電流が発生しない。ま
た、複数の素子を次々と駆動させていけば全体の駆動電
流の値は常に一定であるので、素子の個数が異なるブロ
ックごとに駆動を行っても印字濃度に差が生じることが
ない。
ては、各素子に供給される駆動電流を順次遅延させなが
ら供給する遅延回路を有しているので、各素子に対して
時系列的に順次駆動電流が供給される。よって、電流値
の急激な変化がないので、サージ電流が発生しない。ま
た、複数の素子を次々と駆動させていけば全体の駆動電
流の値は常に一定であるので、素子の個数が異なるブロ
ックごとに駆動を行っても印字濃度に差が生じることが
ない。
【００１４】また、プリントヘッドがサーマルプリント
ヘッドで、プリントヘッド駆動ＩＣが複数の発熱素子を
駆動する場合には、順次発熱素子を駆動させていくの
で、発熱素子に設けられる放熱板のある箇所が一度に加
熱されることがなく、放熱板の反りが生じることがな
い。
ヘッドで、プリントヘッド駆動ＩＣが複数の発熱素子を
駆動する場合には、順次発熱素子を駆動させていくの
で、発熱素子に設けられる放熱板のある箇所が一度に加
熱されることがなく、放熱板の反りが生じることがな
い。
【００１５】また、複数のＮＯＲ回路を有し、各ＮＯＲ
回路におけるストローブ信号の入力端子間に遅延回路が
設けられている場合には、駆動のタイミングを決めるス
トローブ信号が該入力端子間に設けられた遅延回路によ
って順次遅れて各ＮＯＲ回路に入力されるので、各素子
に対して時系列的に順次駆動電流を供給することができ
る。
回路におけるストローブ信号の入力端子間に遅延回路が
設けられている場合には、駆動のタイミングを決めるス
トローブ信号が該入力端子間に設けられた遅延回路によ
って順次遅れて各ＮＯＲ回路に入力されるので、各素子
に対して時系列的に順次駆動電流を供給することができ
る。
【００１６】
【実施例】本発明の実施例を図面を利用して説明する。
【００１７】本実施例におけるサーマルヘッド用駆動Ｉ
Ｃ１は、図１に示すように、入力端子１０〜１８と、シ
フトレジスタ部２０と、ＮＯＲ回路部３０と、バッファ
部４０とを有し、出力端子ＤＯ１〜ＤＯ９６を有してい
る。
Ｃ１は、図１に示すように、入力端子１０〜１８と、シ
フトレジスタ部２０と、ＮＯＲ回路部３０と、バッファ
部４０とを有し、出力端子ＤＯ１〜ＤＯ９６を有してい
る。
【００１８】ここで、入力端子１０は電源電圧ＶDDが印
加される電源ラインであり、入力端子１２はグランドラ
インである。入力端子１４はストローブ信号としてのＥ
ＮＡＢＬＥ信号が入力される端子である。また、入力端
子１６はシリアルインであり、印字データが入力される
端子である。また、入力端子１８にはクロック信号が入
力される。
加される電源ラインであり、入力端子１２はグランドラ
インである。入力端子１４はストローブ信号としてのＥ
ＮＡＢＬＥ信号が入力される端子である。また、入力端
子１６はシリアルインであり、印字データが入力される
端子である。また、入力端子１８にはクロック信号が入
力される。
【００１９】次に、シフトレジスタ部２０には、複数の
フリップフロップ回路２０−１〜２０−９６が設けら
れ、上記入力端子１８は２つのインバータを介して、各
フリップフロップ回路２０−１〜２０−９６のクリア端
子に接続され、入力端子１６はインバータ６６を介して
フリップフロップ回路２０−１におけるデータ端子に接
続されている。フリップフロップ回路２０−１〜２０−
９５の各フリップフロップ回路の出力端子は図中右隣り
のフリップフロップ回路のデータ端子に接続されてい
る。また、フリップフロップ回路２０−９６の出力端子
はインバータを介して出力端子７０に接続されている。
フリップフロップ回路２０−１〜２０−９６が設けら
れ、上記入力端子１８は２つのインバータを介して、各
フリップフロップ回路２０−１〜２０−９６のクリア端
子に接続され、入力端子１６はインバータ６６を介して
フリップフロップ回路２０−１におけるデータ端子に接
続されている。フリップフロップ回路２０−１〜２０−
９５の各フリップフロップ回路の出力端子は図中右隣り
のフリップフロップ回路のデータ端子に接続されてい
る。また、フリップフロップ回路２０−９６の出力端子
はインバータを介して出力端子７０に接続されている。
【００２０】次に、ＮＯＲ回路部３０には、複数のＮＯ
Ｒ回路３０−１〜３０−９６が設けられ、ＮＯＲ回路３
０−１〜３０−９６の一方の入力端子は、インバータ６
２を介してＮＡＮＤ回路６４の出力端子に接続されてい
る。なお、上記ＮＡＮＤ回路６４の一方の入力端子はイ
ンバータ６２に接続されているが、他方の入力端子は、
ＶDD低下保護回路６０に接続されている。また、ＮＯＲ
回路３０−１〜３０−９６の他方の入力端子は、上記フ
リップフロップ回路２０−１〜２０−９６における対応
するフリップフロップ回路の出力端子に接続されてい
る。
Ｒ回路３０−１〜３０−９６が設けられ、ＮＯＲ回路３
０−１〜３０−９６の一方の入力端子は、インバータ６
２を介してＮＡＮＤ回路６４の出力端子に接続されてい
る。なお、上記ＮＡＮＤ回路６４の一方の入力端子はイ
ンバータ６２に接続されているが、他方の入力端子は、
ＶDD低下保護回路６０に接続されている。また、ＮＯＲ
回路３０−１〜３０−９６の他方の入力端子は、上記フ
リップフロップ回路２０−１〜２０−９６における対応
するフリップフロップ回路の出力端子に接続されてい
る。
【００２１】ここで、本実施例においては、ＮＯＲ回路
３０−１〜３０−９６の一方の各入力端子は、図１に示
すように、ＮＡＮＤ回路６４からの出力信号を遅延させ
るための遅延回路としてのバッファ５０−１〜５０−９
５が設けられている。遅延時間は１ｂｉｔ当たり、数百
ｎｓから１０μｓ程度になるようにする。
３０−１〜３０−９６の一方の各入力端子は、図１に示
すように、ＮＡＮＤ回路６４からの出力信号を遅延させ
るための遅延回路としてのバッファ５０−１〜５０−９
５が設けられている。遅延時間は１ｂｉｔ当たり、数百
ｎｓから１０μｓ程度になるようにする。
【００２２】次に、バッファ部４０には、複数のバッフ
ァ４０−１〜４０−９６が設けられ、バッファ４０−１
〜４０−９６の上記各バッファのゲートは、上記ＮＯＲ
回路３０−１〜３０−９６における対応するＮＯＲ回路
の入力端子に接続されている。上記バッファ４０−１〜
４０−９６における各ソース端子は出力端子ＤＯ１〜Ｄ
Ｏ９６における対応する各出力端子に接続されている。
出力端子ＤＯ１〜ＤＯ９６はそれぞれ対応する発熱素子
に接続されている。上記バッファ４０−１〜４０−９６
は具体的にはＦＥＴにより構成される。
ァ４０−１〜４０−９６が設けられ、バッファ４０−１
〜４０−９６の上記各バッファのゲートは、上記ＮＯＲ
回路３０−１〜３０−９６における対応するＮＯＲ回路
の入力端子に接続されている。上記バッファ４０−１〜
４０−９６における各ソース端子は出力端子ＤＯ１〜Ｄ
Ｏ９６における対応する各出力端子に接続されている。
出力端子ＤＯ１〜ＤＯ９６はそれぞれ対応する発熱素子
に接続されている。上記バッファ４０−１〜４０−９６
は具体的にはＦＥＴにより構成される。
【００２３】上記構成の駆動ＩＣ１の動作について説明
する。入力端子１８から入力されるクロック信号は所定
周期のパルス信号であり、クロックのタイミングで入力
端子１６から入力される１ライン分の印字データがシフ
トレジスタ部２０に入力される。つまり、クロックのタ
イミングで印字データが順次フリップフロップ回路２０
−１〜２０−９６に入力されていく。具体的にはあるク
ロックのタイミングでインバータ６６からのある印字デ
ータがフリップフロップ２０−１のデータ端子から取り
込まれて、出力端子から出力されてＮＯＲ回路３０−１
に入力されるとともに、フリップフロップ回路２０−２
に入力される。次のクロックのタイミングでは、その印
字データはフリップフロップ回路２０−２の右隣りのフ
リップフロップ回路に入力される。ここで、インバータ
６６が設けられているので、印字データがＨｉｇｈの場
合にはフリップフロップ回路にはＬｏｗが入力され、逆
に、印字データがＬｏｗの場合にはフリップフロップ回
路にはＨｉｇｈが入力されることになる。
する。入力端子１８から入力されるクロック信号は所定
周期のパルス信号であり、クロックのタイミングで入力
端子１６から入力される１ライン分の印字データがシフ
トレジスタ部２０に入力される。つまり、クロックのタ
イミングで印字データが順次フリップフロップ回路２０
−１〜２０−９６に入力されていく。具体的にはあるク
ロックのタイミングでインバータ６６からのある印字デ
ータがフリップフロップ２０−１のデータ端子から取り
込まれて、出力端子から出力されてＮＯＲ回路３０−１
に入力されるとともに、フリップフロップ回路２０−２
に入力される。次のクロックのタイミングでは、その印
字データはフリップフロップ回路２０−２の右隣りのフ
リップフロップ回路に入力される。ここで、インバータ
６６が設けられているので、印字データがＨｉｇｈの場
合にはフリップフロップ回路にはＬｏｗが入力され、逆
に、印字データがＬｏｗの場合にはフリップフロップ回
路にはＨｉｇｈが入力されることになる。
【００２４】そして、入力端子１４からのＥＮＡＢＬＥ
信号がインバータ６２、ＮＡＮＤ回路６４を介してＮＯ
Ｒ回路３０−１〜３０−９６に入力される。ここで、上
記ＥＮＡＢＬＥ信号はＬｏｗ Ａｃｔｉｖｅであり、Ｎ
ＯＲ回路３０−１〜３０−９６における２つの入力端子
のいずれにもＬｏｗが入力された時にＮＯＲ回路３０−
１〜３０−９６はＨｉｇｈを出力する。ＮＯＲ回路３０
−１〜３０−９６のそれぞれがＨｉｇｈを出力すると、
対応するバッファ部４０における対応するバッファがオ
ン動作して、出力端子ＤＯ１〜ＤＯ９６における対応す
る出力端子から駆動電流としての出力信号が出力され
て、対応する発熱素子を駆動する。
信号がインバータ６２、ＮＡＮＤ回路６４を介してＮＯ
Ｒ回路３０−１〜３０−９６に入力される。ここで、上
記ＥＮＡＢＬＥ信号はＬｏｗ Ａｃｔｉｖｅであり、Ｎ
ＯＲ回路３０−１〜３０−９６における２つの入力端子
のいずれにもＬｏｗが入力された時にＮＯＲ回路３０−
１〜３０−９６はＨｉｇｈを出力する。ＮＯＲ回路３０
−１〜３０−９６のそれぞれがＨｉｇｈを出力すると、
対応するバッファ部４０における対応するバッファがオ
ン動作して、出力端子ＤＯ１〜ＤＯ９６における対応す
る出力端子から駆動電流としての出力信号が出力され
て、対応する発熱素子を駆動する。
【００２５】ここで、上記ＮＯＲ回路３０−１〜３０−
９６における各ＮＯＲ回路の入力端子間には遅延回路と
してのバッファ５０−１〜５０−９５が設けられている
ので、ＮＯＲ回路に入力されるＥＮＡＢＬＥ信号の入力
のタイミングが、図２に示すように少しずつ時間的にず
れることになる。すなわち、ＥＮＡＢＬＥ信号の入力の
タイミングは１０／１７２８ｍ／ｓの間隔になる。
９６における各ＮＯＲ回路の入力端子間には遅延回路と
してのバッファ５０−１〜５０−９５が設けられている
ので、ＮＯＲ回路に入力されるＥＮＡＢＬＥ信号の入力
のタイミングが、図２に示すように少しずつ時間的にず
れることになる。すなわち、ＥＮＡＢＬＥ信号の入力の
タイミングは１０／１７２８ｍ／ｓの間隔になる。
【００２６】なお、ＶDD低下保護回路６０は、電源ＶDD
の値が低下した場合には、Ｌｏｗを出力して、ＮＡＮＤ
回路６４からＬｏｗが出力せず、各発熱素子に駆動電流
が供給されないようにする。
の値が低下した場合には、Ｌｏｗを出力して、ＮＡＮＤ
回路６４からＬｏｗが出力せず、各発熱素子に駆動電流
が供給されないようにする。
【００２７】複数の発熱素子を複数のブロックに分割し
て、各ブロックの発熱素子に対して複数の駆動ＩＣが駆
動を行う場合も、あるブロックについて順次駆動電流を
発熱素子に供給した後に、同じ時間間隔で次のブロック
の発熱素子を駆動する。例えば、１７２８ドットの１ラ
インを４４８ドットのブロックと３８４ドットのブロッ
クからなる４つのブロックに分けて７つの駆動ＩＣで駆
動する場合にも、最初の４４８ドットの第１のブロック
に対して、７つの駆動ＩＣが順次駆動電流を供給し、次
の４４８ドットのブロックの最初の発熱素子をある駆動
ＩＣが駆動させて、以下第１のブロックと同様に駆動さ
せていく。３８４ドットのブロックを駆動する場合に
は、そのブロックの最後の発熱素子を駆動するのは６番
目の駆動ＩＣが駆動を行うことになる。以上のようにし
て、１ラインの印字制御を行う。
て、各ブロックの発熱素子に対して複数の駆動ＩＣが駆
動を行う場合も、あるブロックについて順次駆動電流を
発熱素子に供給した後に、同じ時間間隔で次のブロック
の発熱素子を駆動する。例えば、１７２８ドットの１ラ
インを４４８ドットのブロックと３８４ドットのブロッ
クからなる４つのブロックに分けて７つの駆動ＩＣで駆
動する場合にも、最初の４４８ドットの第１のブロック
に対して、７つの駆動ＩＣが順次駆動電流を供給し、次
の４４８ドットのブロックの最初の発熱素子をある駆動
ＩＣが駆動させて、以下第１のブロックと同様に駆動さ
せていく。３８４ドットのブロックを駆動する場合に
は、そのブロックの最後の発熱素子を駆動するのは６番
目の駆動ＩＣが駆動を行うことになる。以上のようにし
て、１ラインの印字制御を行う。
【００２８】各駆動ＩＣ間の駆動電流の時系列的な制御
は、ＥＮＡＢＬＥ信号が順次ＮＯＲ回路に入力されてい
くので、単に駆動ＩＣをカスケード接続することにより
簡単に行うことができる。
は、ＥＮＡＢＬＥ信号が順次ＮＯＲ回路に入力されてい
くので、単に駆動ＩＣをカスケード接続することにより
簡単に行うことができる。
【００２９】すると、発熱素子に流れる全電流の変化は
図３のようになり、従来例のように急激な電流変化では
ないので、サージ電流が発生せず、電気系統に悪影響を
及ぼすことがない。
図３のようになり、従来例のように急激な電流変化では
ないので、サージ電流が発生せず、電気系統に悪影響を
及ぼすことがない。
【００３０】また、発熱素子のあるブロックが全ドット
オン動作される場合でも、あるブロックにおける発熱素
子がすべて一度に発熱することはなく、放熱板の加熱箇
所も徐々に移動していくのみであるので、放熱板が撓む
ことがない。
オン動作される場合でも、あるブロックにおける発熱素
子がすべて一度に発熱することはなく、放熱板の加熱箇
所も徐々に移動していくのみであるので、放熱板が撓む
ことがない。
【００３１】さらに、複数の発熱素子に対して順次駆動
電流を供給させていくので、発熱素子に流れる電流は一
定であり、上記従来例におけるように、印字濃度の差が
生じることがない。
電流を供給させていくので、発熱素子に流れる電流は一
定であり、上記従来例におけるように、印字濃度の差が
生じることがない。
【００３２】なお、上記実施例において、遅延回路とし
てバッファを設ける構成としたが、ＲとＣからなる遅延
回路を設けるようにしてもよく、また、インバータを偶
数個設ける構成としてもよい。また、本実施例をコピー
に使用する場合等に、例えば、あるブロックにおける発
熱素子の駆動を行った後に、所定間隔をおいて次のブロ
ックの発熱素子を駆動するようにし、その間隔におい
て、例えば、イメージセンサのプラテンを作動させるよ
うに制御すれば、小型の電源によって装置全体の動作を
行うことができる。
てバッファを設ける構成としたが、ＲとＣからなる遅延
回路を設けるようにしてもよく、また、インバータを偶
数個設ける構成としてもよい。また、本実施例をコピー
に使用する場合等に、例えば、あるブロックにおける発
熱素子の駆動を行った後に、所定間隔をおいて次のブロ
ックの発熱素子を駆動するようにし、その間隔におい
て、例えば、イメージセンサのプラテンを作動させるよ
うに制御すれば、小型の電源によって装置全体の動作を
行うことができる。
【００３３】上記実施例においては、サーマルヘッドに
ついて説明したが、ＬＥＤヘッドに使用した場合も、サ
ージ電流による電気系統への影響や、印字濃度を差の発
生をを防止することができる。
ついて説明したが、ＬＥＤヘッドに使用した場合も、サ
ージ電流による電気系統への影響や、印字濃度を差の発
生をを防止することができる。
【００３４】
【発明の効果】本発明におけるプリントヘッド駆動ＩＣ
によれば、各素子に供給される駆動電流を順次遅延させ
ながら供給する遅延回路を有しているので、各素子に対
して時系列的に順次駆動電流が供給され、よって、電源
から各素子に供給される全体の電流値に急激な変化がな
いので、サージ電流が発生せず、電気系統に悪影響を及
ぼすことがなく、ノイズやサージ対策用の部品が必要な
いので、コストダウン及びヘッドの小型化を図ることが
できる。また、複数の素子を次々と駆動させていけば全
体の駆動電流の値は常に一定であるので、素子の個数が
異なるブロックごとに駆動を行っても印字濃度に差が生
じることがない。
によれば、各素子に供給される駆動電流を順次遅延させ
ながら供給する遅延回路を有しているので、各素子に対
して時系列的に順次駆動電流が供給され、よって、電源
から各素子に供給される全体の電流値に急激な変化がな
いので、サージ電流が発生せず、電気系統に悪影響を及
ぼすことがなく、ノイズやサージ対策用の部品が必要な
いので、コストダウン及びヘッドの小型化を図ることが
できる。また、複数の素子を次々と駆動させていけば全
体の駆動電流の値は常に一定であるので、素子の個数が
異なるブロックごとに駆動を行っても印字濃度に差が生
じることがない。
【００３５】また、プリントヘッドがサーマルプリント
ヘッドで、プリントヘッド駆動ＩＣが複数の発熱素子を
駆動する場合には、順次発熱素子を駆動させていくの
で、発熱素子に設けられる放熱板のある箇所が一度に加
熱されることがなく、放熱板の反りが生じることがな
く、ヘッドをプラテンに対して押すその押し圧を上げる
等の対策も必要ない。
ヘッドで、プリントヘッド駆動ＩＣが複数の発熱素子を
駆動する場合には、順次発熱素子を駆動させていくの
で、発熱素子に設けられる放熱板のある箇所が一度に加
熱されることがなく、放熱板の反りが生じることがな
く、ヘッドをプラテンに対して押すその押し圧を上げる
等の対策も必要ない。
【図１】本発明の実施例における駆動ＩＣの回路構成を
示す回路図である。
示す回路図である。
【図２】本発明の実施例における駆動ＩＣの動作を説明
する説明図である。
する説明図である。
【図３】本発明の実施例及び従来における駆動ＩＣに流
れる駆動電流の値の変化を示す説明図である。
れる駆動電流の値の変化を示す説明図である。
【図４】従来における駆動ＩＣの動作を説明する説明図
であり、（ａ）はストローブ信号の供給の仕方を説明す
る説明図であり、（ｂ）は駆動ＩＣに流れる電流の値の
変化を示す説明図である。
であり、（ａ）はストローブ信号の供給の仕方を説明す
る説明図であり、（ｂ）は駆動ＩＣに流れる電流の値の
変化を示す説明図である。
１ 駆動ＩＣ １０、１２・・・１８ 入力端子 ２０ シフトレジスタ部 ２０−１、２０−２・・・、２０−９６ フリップフロ
ップ回路 ３０ ＮＯＲ回路部 ３０−１、３０−２・・・３０−９６ ＮＯＲ回路 ４０ バッファ部 ４０−１、４０−２・・・４０−９６ バッファ ５０−１、５０−２・・・５０−９５ バッファ ６０ ＶDD低下保護回路
ップ回路 ３０ ＮＯＲ回路部 ３０−１、３０−２・・・３０−９６ ＮＯＲ回路 ４０ バッファ部 ４０−１、４０−２・・・４０−９６ バッファ ５０−１、５０−２・・・５０−９５ バッファ ６０ ＶDD低下保護回路
Claims (3)
- 【請求項１】 プリントヘッドに設けられる複数の素子
を駆動するプリントヘッド駆動ＩＣであって、 各素子に供給される駆動電流を順次遅延させながら供給
する遅延回路を有することを特徴とするプリントヘッド
駆動ＩＣ。 - 【請求項２】 プリントヘッドがサーマルプリントヘッ
ドであって、プリントヘッド駆動ＩＣが複数の発熱素子
を駆動することを特徴とする請求項１に記載のプリント
ヘッド駆動ＩＣ。 - 【請求項３】 プリントヘッド駆動ＩＣが、ストローブ
信号と印字データ信号とに従い駆動電流を出力する複数
のＮＯＲ回路を有し、各ＮＯＲ回路におけるストローブ
信号の入力端子間に遅延回路が設けられていることを特
徴とする請求項１又は２に記載のプリントヘッド駆動Ｉ
Ｃ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9594694A JPH07304201A (ja) | 1994-05-10 | 1994-05-10 | プリントヘッド駆動ｉｃ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9594694A JPH07304201A (ja) | 1994-05-10 | 1994-05-10 | プリントヘッド駆動ｉｃ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07304201A true JPH07304201A (ja) | 1995-11-21 |
Family
ID=14151435
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9594694A Pending JPH07304201A (ja) | 1994-05-10 | 1994-05-10 | プリントヘッド駆動ｉｃ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07304201A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN100427310C (zh) * | 2004-12-09 | 2008-10-22 | 佳能株式会社 | 喷墨记录头基板和驱动控制方法、喷墨记录头及墨盒、喷墨记录设备 |
| JP2009101585A (ja) * | 2007-10-23 | 2009-05-14 | Seiko Epson Corp | サーマルヘッドドライバ、サーマルヘッド、電子機器及び印刷システム、並びにサーマルヘッドドライバ及びサーマルヘッドのレイアウト方法 |
-
1994
- 1994-05-10 JP JP9594694A patent/JPH07304201A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN100427310C (zh) * | 2004-12-09 | 2008-10-22 | 佳能株式会社 | 喷墨记录头基板和驱动控制方法、喷墨记录头及墨盒、喷墨记录设备 |
| JP2009101585A (ja) * | 2007-10-23 | 2009-05-14 | Seiko Epson Corp | サーマルヘッドドライバ、サーマルヘッド、電子機器及び印刷システム、並びにサーマルヘッドドライバ及びサーマルヘッドのレイアウト方法 |
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