JPH0334710A - Static induction transistor circuit - Google Patents

Static induction transistor circuit

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JPH0334710A
JPH0334710A JP1169063A JP16906389A JPH0334710A JP H0334710 A JPH0334710 A JP H0334710A JP 1169063 A JP1169063 A JP 1169063A JP 16906389 A JP16906389 A JP 16906389A JP H0334710 A JPH0334710 A JP H0334710A
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JP
Japan
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voltage
circuit
sit
turned
drive
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JP1169063A
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Japanese (ja)
Inventor
Haruhiko Yura
晴彦 由良
Tsutomu Sato
務 佐藤
Kiyomi Kawamura
清美 河村
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Toshiba Corp
Original Assignee
Toshiba Corp
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Publication of JPH0334710A publication Critical patent/JPH0334710A/en
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Abstract

PURPOSE:To reduce the effective on-resistance and to set an optimum power efficiency by connecting a constant voltage circuit to a prestage of static induction transistor(TR) connecting to a drive element. CONSTITUTION:It is assumed that a sufficiently small impedance is selected when suspective drive element 21, 22 are turned on. In this case, while the drive element 21 is turned on and the other drive element 22 is turned off, a voltage nearly equal to a negative voltage of a drive source 1 is applied between a gate 31 and a source 32 of a static induction TR SIT 3 and the SIT 3 is turned off. Moreover, while the drive element 21 is turned off and the other drive element 22 is turned on, the SIT 3 is turned on. The gate voltage of the SIT 3 shows a waveform where the voltage level at turn-on is constant depending on the constant voltage characteristic of a diode 4a. Thus, the effective on-characteristic of the SIT 3 is lowered more, small voltage loss is enough and the power efficiency is improved.

Description

【発明の詳細な説明】 [発明の目的] (産業上の利用分野) この発明は、例えば中波あるいは短波放送機の電力増幅
段または変調増幅段等に使用される静電誘導トランジス
タ回路の改良に関する。
[Detailed Description of the Invention] [Objective of the Invention] (Industrial Application Field) The present invention is directed to improvements in electrostatic induction transistor circuits used, for example, in power amplification stages or modulation amplification stages of medium-wave or short-wave broadcasters. Regarding.

(従来の技術) 一般に、静電誘導トランジスタ(stailclndu
ction translstor  以下SITと略
称する)を高周波スイッチング素子として使用する場合
、SITをオフ(opp)にするにはゲート端子に数十
ボルト(V)の負のバイアス電圧を与え、またオン(O
N)にするにはゲート電圧を負電圧から零V近くまで上
げる必要がある。
(Prior Art) Generally, a static induction transistor
When using a translator (hereinafter abbreviated as SIT) as a high-frequency switching element, to turn the SIT off (opp), apply a negative bias voltage of several tens of volts (V) to the gate terminal, and then turn it on (opp).
N), it is necessary to raise the gate voltage from a negative voltage to close to zero V.

IITをオンさせるときのゲート電圧に対する抵抗(オ
ン抵抗[1)特性は、第7図に示すようになり、負電圧
から零Vに近づくに従いオン抵抗(値)が低下し、零V
を越え正電圧に移行しても引続きその抵抗値が下降する
傾向を示す。
The resistance (on-resistance [1)] characteristics with respect to the gate voltage when turning on the IIT are as shown in Figure 7, and as the voltage approaches zero V from a negative voltage, the on-resistance (value) decreases, and as the voltage approaches zero V, the on-resistance (value) decreases.
Even if the voltage exceeds 1, the resistance value continues to decrease.

このため、SITのオン抵抗による電力損失を低減する
ために、オンのときにゲート電圧が零(V)から若干正
電圧となる範囲で使用されることが多い。
Therefore, in order to reduce power loss due to the on-resistance of the SIT, the gate voltage is often used in a range from zero (V) to a slightly positive voltage when the SIT is on.

一方、スイッチング周波数が比較的低い場合には、SI
Tの駆動動作上特に問題はないが、高い周波数領域でス
イッチング動作を行わせようとすると、SITの入力静
電容量値が問題となりこれを無視できなくなる。通常、
そのSITの入力静電容量をスイッチング動作によって
充放電するのに、相当大きな駆動電力が要求される。一
方、SITの入力静電容量値は、第8図にゲート電圧に
対する容量値の変化を縦軸方向に対数表示して示したよ
うに、ゲート電圧が高くなるにつれて大となる。従って
、上記のように、一方ではスイッチング動作でのオン抵
抗による電力損失を低減させるために、ゲート電圧を高
くすればするほど人力静電容量を充放電するために大き
な駆動電力を必要とする。このことから、SITの駆動
電力は、スイッチング周波数が高くなると、出力電力の
数分の1にもなる大電力を必要とし、SITをスイッチ
ング増幅器として構成した場合、電力効率上の面から問
題となった。
On the other hand, when the switching frequency is relatively low, the SI
Although there is no particular problem in the driving operation of the T, when trying to perform a switching operation in a high frequency region, the input capacitance value of the SIT becomes a problem and cannot be ignored. usually,
Considerable driving power is required to charge and discharge the input capacitance of the SIT through switching operations. On the other hand, the input capacitance value of the SIT increases as the gate voltage increases, as shown in FIG. 8, where the change in capacitance value with respect to the gate voltage is expressed logarithmically in the vertical axis direction. Therefore, as described above, on the one hand, in order to reduce power loss due to on-resistance in switching operation, the higher the gate voltage is, the more driving power is required to charge and discharge the human capacitance. Therefore, when the switching frequency becomes high, the SIT drive power requires a large amount of power, which is a fraction of the output power, and when the SIT is configured as a switching amplifier, it becomes a problem in terms of power efficiency. Ta.

従来のSITを高周波スイッチング増幅素子として使用
した317回路は、駆動電力を軽減するために、第9図
に示すような回路構成を採用し、ゲート電圧を精々零V
以下とし、正電圧領域では動作させないことが多い。
The 317 circuit, which uses a conventional SIT as a high-frequency switching amplification element, adopts the circuit configuration shown in Figure 9 in order to reduce the driving power, and reduces the gate voltage to zero V at most.
It is set as below and is often not operated in the positive voltage region.

即ち、第9図は従来の317回路を示すもので、負電圧
電源からなる駆動電源lと、この駆動電源lに接続され
た一対の駆動素子21.22と、この駆動素子21.2
2に接続された5IT3とから構成される。なお、23
は駆動素子21.22を駆動する素子駆動回路であり、
ここで素子駆動回路23.駆動素子21.22を以下S
IT駆動回路2とする。
That is, FIG. 9 shows a conventional 317 circuit, which includes a driving power source l made of a negative voltage power source, a pair of driving elements 21.22 connected to this driving power source l, and this driving element 21.2.
It consists of 5IT3 connected to 2 and 5IT3. In addition, 23
is an element drive circuit that drives the drive elements 21 and 22,
Here, the element drive circuit 23. The driving elements 21 and 22 are referred to as S
It is assumed to be IT drive circuit 2.

この第9図に示す317回路において、駆動素子21.
22のインピーダンスが十分低い場合には、SIT駆動
回路2の出力インピーダンスを十分低くできるから、こ
のときの5IT3のゲー)31の電圧は、第1O図に示
すように負電圧から零■までの範囲での振幅で変化させ
得るので、5IT3自体の電力損失は最小とすることが
できる。
In the 317 circuit shown in FIG. 9, driving element 21.
If the impedance of 22 is sufficiently low, the output impedance of the SIT drive circuit 2 can be made sufficiently low, so the voltage of 5IT3's gate 31 at this time is in the range from negative voltage to zero, as shown in Figure 1O. The power loss of the 5IT3 itself can be minimized.

しかしながら、スイッチング周波数の高い領域で、第1
O因に示すようなゲート電圧により5IT3を駆動しよ
うとしても、上述のようにゲート入力静電容量の影響を
受けて、駆動電力が非常に大きくなり、SIT回路全体
の総合電力効率を考えた場合は、必ずしも最良とは言え
なくなる。従って、実際には第11図に示すように駆動
回路2の出力インピーダンスがある程度大きく、これに
よりゲート電圧の振幅がオン時に零Vに達しないような
ゲート駆動波形のときに電力効率が最大となる点がある
However, in the high switching frequency region, the first
Even if you try to drive 5IT3 with the gate voltage shown in factor O, the driving power will be extremely large due to the influence of the gate input capacitance as described above, and when considering the overall power efficiency of the entire SIT circuit. cannot necessarily be said to be the best. Therefore, in reality, as shown in FIG. 11, the output impedance of the drive circuit 2 is large to some extent, and the power efficiency is maximized when the gate drive waveform is such that the amplitude of the gate voltage does not reach 0 V when turned on. There is a point.

この理由は、SITのゲート駆動電圧が減少したことに
より駆動電力は減少し、逆に駆動電圧が下がることによ
りSITのオン時の抵抗が上昇してオン抵抗損失が増加
するが、零Vから零Vを若干下まわる駆動電圧の範囲で
は駆動電力の減少量がオン抵抗損失量を上まわり、結果
的として全体の電力効率が最大となる点が零V未満のと
ころに存在するからである。
The reason for this is that when the SIT gate drive voltage decreases, the drive power decreases, and conversely, when the drive voltage decreases, the resistance when the SIT is on increases and the on-resistance loss increases. This is because in a drive voltage range slightly below V, the amount of reduction in drive power exceeds the amount of on-resistance loss, and as a result, the point at which the overall power efficiency is maximized exists below zero V.

しかしながら、このように、駆動回路2の出力インピー
ダンスを調整することにより、駆動電圧の振幅を電源効
率が最も良好となる領域に設定した317回路であって
も、5IT3のゲート電圧が第11図に示すように、オ
ンとなる期間(T)中に一定とはならず変化する。この
ため、5ITIのオン抵抗値もオン期間(T)中に変化
し、特にD級で動作する高周波スイッチング増幅器とし
ての317回路であれば、最大電流が流れる時のオン抵
抗が大きいこともあって、必ずしも一定の駆動電力で得
ることが可能な最良の電力効率が得られないという欠点
があった。
However, even with the 317 circuit in which the amplitude of the drive voltage is set in the region where the power supply efficiency is the best by adjusting the output impedance of the drive circuit 2, the gate voltage of the 5IT3 will not be as shown in FIG. As shown, it is not constant but changes during the ON period (T). For this reason, the on-resistance value of the 5ITI also changes during the on-period (T), and especially for the 317 circuit as a high-frequency switching amplifier that operates in class D, the on-resistance is large when the maximum current flows. However, there is a drawback that the best power efficiency that can be obtained with a constant driving power cannot necessarily be obtained.

このように、従来の317回路は、駆動回路出力インピ
ーダンスとSITの入力静電容量で定まる時定数とスイ
ッチング周波数との関係によって、SITオン期間(T
)内でゲート電圧が変化し、最良の電力効率を得るのは
困難であった。
In this way, in the conventional 317 circuit, the SIT on period (T
), it was difficult to obtain the best power efficiency.

(発明が解決しようとする課8) 従来の317回路は、高周波スイッチング動作における
SIT駆動回路が、SITの人力静電容量が大きく、ま
たオン期間中の抵抗値も変化するために、常に最良の電
力効率が得られないという欠点があった。
(Issue 8 to be solved by the invention) In the conventional 317 circuit, the SIT drive circuit in high-frequency switching operation is always in the best condition because the SIT has a large human capacitance and the resistance value changes during the on period. The drawback was that power efficiency could not be achieved.

この発明は、SITの駆動電力を増加させることなく、
SITの実効オン抵抗を減少させ、電力効率を良好なら
しめ得る317回路を提供することを目的とする。
This invention does not increase the drive power of SIT,
It is an object of the present invention to provide a 317 circuit that can reduce the effective on-resistance of an SIT and improve power efficiency.

【発明の構成] (課題を解決するための手段) 第1の発明による静電誘導トランジスタ回路は、駆動電
源と、この駆動電源に接続された定電圧回路と、この定
電圧回路に接続された駆動素子と、この駆動素子に接続
された静電誘導トランジスタとを具備することを特徴と
する。
[Structure of the Invention] (Means for Solving the Problems) A static induction transistor circuit according to the first invention includes a driving power source, a constant voltage circuit connected to the driving power source, and a constant voltage circuit connected to the constant voltage circuit. It is characterized by comprising a driving element and a static induction transistor connected to the driving element.

第2の発明による静電誘導トランジスタ回路は、駆動電
源と、この駆動電源に接続された駆動素子と、この駆動
素子に接続された定電圧回路と、この定電圧回路に接続
された静電容量トランジスタとを具備することを特徴と
する。
The static induction transistor circuit according to the second invention includes a driving power source, a driving element connected to the driving power source, a constant voltage circuit connected to the driving element, and a capacitor connected to the constant voltage circuit. A transistor.

(作 用) この発明による静電誘導トランジスタ回路は、静電容量
トランジスタの前段に定電圧回路を接続構成したので、
SITの駆動電圧を零ボルトに達しない電圧レベルにク
ランプすることが可能である。
(Function) The static induction transistor circuit according to the present invention has a constant voltage circuit connected to the front stage of the capacitance transistor.
It is possible to clamp the drive voltage of the SIT to a voltage level that does not reach zero volts.

この結果、比較的低い出力インピーダンスの領域で、し
かもSITオン期間中の電圧値を一定値に保つことがで
き、SIT駆動電力を増加させることなく、実効オン抵
抗を減少させ、最適な電力効率を設定することができる
As a result, it is possible to keep the voltage value constant during the SIT on period in the region of relatively low output impedance, reducing the effective on resistance without increasing the SIT drive power and achieving optimal power efficiency. Can be set.

(実施例) 以下、この発明による静電容量トランジスタ回路の実施
例を主に第1図ないし第6図を参照し詳細に説明する。
(Embodiments) Hereinafter, embodiments of the capacitance transistor circuit according to the present invention will be described in detail with reference mainly to FIGS. 1 to 6.

なお、第9図に示した従来の817回路と同一構成には
同一符号を付し、詳細な説明は省略する。
Components that are the same as those of the conventional 817 circuit shown in FIG. 9 are designated by the same reference numerals, and detailed description thereof will be omitted.

即ち、第1図はこの発明回路の第1の実施例を示した回
路図で、負電源からなる駆動電源lと、この駆動電源に
接続された定電圧回路4と、この定電圧回路4に接続さ
れた一対の駆動素子21.22と、この駆動素子21.
22に接続された5IT3とから構成されている。
That is, FIG. 1 is a circuit diagram showing a first embodiment of the circuit of the present invention, in which a driving power source 1 consisting of a negative power source, a constant voltage circuit 4 connected to this driving power source, and a constant voltage circuit 4 connected to this driving power source A pair of connected driving elements 21.22, and this driving element 21.22.
It consists of 5IT3 connected to 22.

この第1図に示す定電圧回路4はダイオード4aを使用
し、ダイオードの■F特性により近似的に定電圧特性を
持たせたものである。
The constant voltage circuit 4 shown in FIG. 1 uses a diode 4a, and has a constant voltage characteristic approximately based on the F characteristic of the diode.

いま、各駆動素子21.22がオンのとき夫々のインピ
ーダンスが十分小さいものを選択したとすると、一方の
駆動素子21がオンのとき、他方の駆動素子22がオフ
となる期間は、5IT3のゲート(31)・ソース(3
2) (基準)間には駆動電源1の負電圧に略等しい電
圧が印加されることとなり、5IT3はオフとなる。
Now, assuming that drive elements 21 and 22 are selected whose respective impedances are sufficiently small when they are on, the period during which one drive element 21 is on and the other drive element 22 is off is equal to the gate of 5IT3. (31)・Sauce (3
2) (Reference) A voltage approximately equal to the negative voltage of the drive power supply 1 will be applied between them, and 5IT3 will be turned off.

また、一方の駆動素子21がオフで他方の駆動素子22
がオンとなる期間では、5IT3のゲート(31)電圧
は零VよりダイオードのVF電圧分だけ負の電圧が加え
られ、5IT3はオンとなる。この時の5IT3のゲー
ト電圧は第2図に示すように、ダイオード4aの定電圧
特性によって、オン時の電圧レベルが一定となる波形を
描く。即ち、5IT3のオン期間(T)の中央の時点(
1)での5IT3ゲート電圧が、定電圧特性によって、
第9図に示した従来回路における波形よりもより零■に
近くなるため、5IT3の実効オン抵抗はより低くなり
電力損失が小さくて済み、817回路での総合的な電力
効率の向上が図られる。
Also, when one drive element 21 is off and the other drive element 22
During the period in which the gate (31) of the 5IT3 is turned on, a negative voltage is applied to the gate (31) of the 5IT3 from zero V by the VF voltage of the diode, and the 5IT3 is turned on. As shown in FIG. 2, the gate voltage of 5IT3 at this time draws a waveform in which the voltage level when turned on is constant due to the constant voltage characteristics of the diode 4a. That is, the middle point in time (T) of the on period (T) of 5IT3
The 5IT3 gate voltage in 1) is due to constant voltage characteristics,
Since the waveform is closer to zero than the waveform in the conventional circuit shown in Figure 9, the effective on-resistance of 5IT3 is lower and power loss is smaller, improving the overall power efficiency of the 817 circuit. .

なお、このとき、第2図及び第11図との比較において
、駆動電圧の波形の最小レベル(L)及び最大レベル(
11)が夫々等しければ、SIT’の人力静電容量の充
放電に要する駆動電力は変わらない。
At this time, in comparison with FIGS. 2 and 11, the minimum level (L) and maximum level (L) of the drive voltage waveform are
11) are equal, the driving power required for charging and discharging the human power capacitance of SIT' remains the same.

しかし、例えば、第7図の特性を有するSITをD級電
圧増幅器として動作させ、第2図及び第11図のオン期
間の中央の時点(1)での5IT3のゲート電圧が−0
,3vと一〇、6vであったとすると、この中央の時点
でのオン抵抗は第2図の電圧波形のときは、第11図に
ときの1/2以下となっており、SITオン抵抗損失も
1/2以下に押えることができる。
However, for example, if the SIT having the characteristics shown in FIG. 7 is operated as a class D voltage amplifier, the gate voltage of 5IT3 at time (1) in the middle of the on period in FIGS. 2 and 11 is -0.
, 3v and 10, 6v, the on-resistance at the center point is less than 1/2 of the voltage waveform in Fig. 11 when the voltage waveform is in Fig. 2, and the SIT on-resistance loss can be reduced to 1/2 or less.

また、この第1の実施例では、定電圧回路としてダイオ
ードを使用したが、ダイオードに限らず、電池や直流電
源を置換え使用しても同様な効果が得られる。
Further, in this first embodiment, a diode is used as the constant voltage circuit, but the same effect can be obtained by replacing the diode with a battery or a DC power source.

第3図はこの発明回路の第2の実施例を示す構成図で、
第1図に示したダイオード4aによる定電源回路に代え
、抵抗R1とコンデンサC1の並列回路と、駆動電源l
の負端子1aと5IT3のゲート端子31との間に抵抗
R2を接続構成したものである。
FIG. 3 is a block diagram showing a second embodiment of the circuit of this invention.
Instead of the constant power supply circuit using the diode 4a shown in FIG.
A resistor R2 is connected between the negative terminal 1a of the 5IT3 and the gate terminal 31 of the 5IT3.

この第3図の回路によれば、各抵抗R1,R2及び各駆
動素子21.22のオン・オフのデユーティ(duty
)比によって抵抗R1両端間の電圧(El)が一定とな
る。
According to the circuit shown in FIG. 3, the on/off duty (duty
) ratio makes the voltage (El) between both ends of the resistor R1 constant.

また、この電圧ElによりコンデンサC1の容量値が5
IT3の入力容量よりもはるかに大きな値となるととも
に、コンデンサC1,抵抗R1によって定まる時定数が
、スイッチング周波数の周期に対して十分大きければ、
このコンデンサC1は第1図に示した定電圧回路と等し
い機能を持つものである。
Also, this voltage El causes the capacitance value of the capacitor C1 to increase to 5
If the value is much larger than the input capacitance of IT3, and the time constant determined by capacitor C1 and resistor R1 is sufficiently large with respect to the period of the switching frequency,
This capacitor C1 has the same function as the constant voltage circuit shown in FIG.

即ち、駆動素子22がオンの期間中に流れる駆動素子電
流は、第4図に示すようにパルス状に変化するが、この
電流変化に対してそのコンデンサC1の両端電圧の変動
が十分中さいような回路又は素子であれば、同様に定電
圧回路とみなして使用することができるものである。
That is, the drive element current that flows while the drive element 22 is on changes in a pulse-like manner as shown in FIG. Any circuit or element can be similarly used as a constant voltage circuit.

なお、第3図において、抵抗R2は駆動電源lと5IT
3のゲート端子31との間に接続したが、駆動回路2を
構成する2個の駆動素子21.22の直列回路に並列接
続しても同様に機能し、目的を達成することができる。
In addition, in FIG. 3, the resistor R2 is connected to the drive power supply l and 5IT.
Although the two driving elements 21 and 22 forming the driving circuit 2 are connected in parallel to the series circuit of the two driving elements 21 and 22, the same function can be achieved and the object can be achieved.

更に、第5図は、この発明回路の第3の実施例を示す回
路で、第1図及び第3図との相違点は、一方の駆動素子
22と5IT3のゲート端子31との間に定電圧回路4
を挿入接続したものである。このSIT回路でも、定電
圧回路4の作用により、5IT3オン時のゲート電圧レ
ベルを一定値に確保することができることから、第1図
と第3図の回路と同様な効果を得ることができるもので
ある。
Furthermore, FIG. 5 shows a third embodiment of the circuit of the present invention, and the difference from FIGS. Voltage circuit 4
is inserted and connected. This SIT circuit can also maintain the gate voltage level at a constant value when 5IT3 is on due to the action of the constant voltage circuit 4, so it is possible to obtain the same effect as the circuits in FIGS. 1 and 3. It is.

また、第6図は同じくこの発明による第4の実施例を示
す回路図で、第5図の実施例と同様に、定電圧回路4を
5IT3の前段、即ち駆動素子21゜22の接続点と5
IT3のゲート端子31との間に挿入することによって
、5IT3オン時のゲート電圧レベルを一定値に確保し
、常に最良の電力効率を得ることができる。
Further, FIG. 6 is a circuit diagram showing a fourth embodiment according to the present invention, in which, similarly to the embodiment of FIG. 5
By inserting it between the gate terminal 31 of the IT3, the gate voltage level when the 5IT3 is turned on can be maintained at a constant value, and the best power efficiency can always be obtained.

[発明の効果] 以上のように、この発明による静電誘導トランジスタ回
路は、SIT駆動回路の駆動電力を回答増加させること
なく、SITの実効オン抵抗を低くし、高周波スイッチ
ング増幅器としての電力効率を向上させることができる
ものであり、実用上の効果大である。
[Effects of the Invention] As described above, the electrostatic induction transistor circuit according to the present invention lowers the effective on-resistance of the SIT without increasing the drive power of the SIT drive circuit, and improves the power efficiency as a high frequency switching amplifier. This is something that can be improved and has a great practical effect.

【図面の簡単な説明】[Brief explanation of drawings]

第1図はこの発明による静電誘導トランジスタ回路の第
1の実施例を示す回路図、第2図は第1図に示す回路の
SITゲート電圧特性を示す特性図、第3図はこの発明
回路の第2の実施例を示す回路図、第4図は第3図に示
す回路の駆動素子2を流れる電流波形図、第5図は同じ
くこの発明回路の第3の実施例を示す回路図、第6図は
同じくこの発明回路の第4の実施例を示す回路図、第7
図はSITのゲート電圧に対するオン抵抗を示す特性図
、第8図はSITのゲート電圧に対するゲート入力容量
を示す特性図、第9図は従来のSIT回路を示す回路図
、第1O図及び第11図は夫々第9図に示すSITの動
作を説明するためのゲート電圧波形図である。 1・・・駆動電源、     2・・・素子駆動回路、
21、22・・・駆動素子、  3・・・SIT。 4・・・定電圧回路。
FIG. 1 is a circuit diagram showing a first embodiment of the electrostatic induction transistor circuit according to the present invention, FIG. 2 is a characteristic diagram showing the SIT gate voltage characteristics of the circuit shown in FIG. 1, and FIG. 3 is a circuit diagram of the circuit according to the invention. FIG. 4 is a waveform diagram of the current flowing through the drive element 2 of the circuit shown in FIG. 3, and FIG. 5 is a circuit diagram showing a third embodiment of the circuit of the present invention. FIG. 6 is a circuit diagram showing a fourth embodiment of the circuit of the present invention, and FIG.
Figure 8 is a characteristic diagram showing the on-resistance with respect to the gate voltage of SIT, Figure 8 is a characteristic diagram showing the gate input capacitance with respect to the gate voltage of SIT, Figure 9 is a circuit diagram showing a conventional SIT circuit, Figures 1O and 11. Each figure is a gate voltage waveform diagram for explaining the operation of the SIT shown in FIG. 9. 1... Drive power supply, 2... Element drive circuit,
21, 22... Drive element, 3... SIT. 4... Constant voltage circuit.

Claims (2)

【特許請求の範囲】[Claims] (1)駆動電源と、この駆動電源に接続された定電圧回
路と、この定電圧回路に接続された駆動素子と、この駆
動素子に接続された静電誘導トランジスタとを具備する
静電誘導トランジスタ回路。
(1) A static induction transistor including a driving power source, a constant voltage circuit connected to the driving power source, a driving element connected to the constant voltage circuit, and a static induction transistor connected to the driving element. circuit.
(2)駆動電源と、この駆動電源に接続された駆動素子
と、この駆動素子に接続された定電圧回路と、この定電
圧回路に接続された静電誘導トランジスタとを具備する
静電誘導トランジスタ回路。
(2) A static induction transistor comprising a driving power source, a driving element connected to this driving power source, a constant voltage circuit connected to this driving element, and a static induction transistor connected to this constant voltage circuit. circuit.
JP1169063A 1989-06-30 1989-06-30 Static induction transistor circuit Pending JPH0334710A (en)

Priority Applications (1)

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JP1169063A JPH0334710A (en) 1989-06-30 1989-06-30 Static induction transistor circuit

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JP1169063A JPH0334710A (en) 1989-06-30 1989-06-30 Static induction transistor circuit

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2012151838A (en) * 2011-01-19 2012-08-09 Harman Internatl Industries Inc Amplifier system for power converter

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JP2012151838A (en) * 2011-01-19 2012-08-09 Harman Internatl Industries Inc Amplifier system for power converter

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