JPH0319738B2 - - Google Patents
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- JPH0319738B2 JPH0319738B2 JP59223760A JP22376084A JPH0319738B2 JP H0319738 B2 JPH0319738 B2 JP H0319738B2 JP 59223760 A JP59223760 A JP 59223760A JP 22376084 A JP22376084 A JP 22376084A JP H0319738 B2 JPH0319738 B2 JP H0319738B2
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- circuit
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- 238000010586 diagram Methods 0.000 description 12
- 238000000034 method Methods 0.000 description 8
- 230000005540 biological transmission Effects 0.000 description 6
- 238000004891 communication Methods 0.000 description 5
- 238000012544 monitoring process Methods 0.000 description 4
- 238000013500 data storage Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
- 238000010276 construction Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000004044 response Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B7/00—Radio transmission systems, i.e. using radiation field
- H04B7/14—Relay systems
- H04B7/15—Active relay systems
- H04B7/204—Multiple access
- H04B7/212—Time-division multiple access [TDMA]
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Time-Division Multiplex Systems (AREA)
- Radio Relay Systems (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、時分割多元接続方式のような回線に
参加している各局の送受するデータがフレーム構
成をなしている系で、この回線に参加する局での
受信データ処理に関する。特に、時分割多元接続
方式の通信装置の監視および制御に使用される受
信データ（以下、監視制御情報という。）を処理
する装置に関する。
参加している各局の送受するデータがフレーム構
成をなしている系で、この回線に参加する局での
受信データ処理に関する。特に、時分割多元接続
方式の通信装置の監視および制御に使用される受
信データ（以下、監視制御情報という。）を処理
する装置に関する。
時分割多元接続方式の通信装置の監視および制
御に使用される監視制御情報は、基準局または従
局から送信される時分割多元接続方式のフレーム
と呼ばれる一定の時間に区切られたバースト状デ
ータに含まれ、ｎ個（ｎは２以上の整数）の時分
割多元接続方式のフレームに分割されて送信され
る。
御に使用される監視制御情報は、基準局または従
局から送信される時分割多元接続方式のフレーム
と呼ばれる一定の時間に区切られたバースト状デ
ータに含まれ、ｎ個（ｎは２以上の整数）の時分
割多元接続方式のフレームに分割されて送信され
る。
従来例受信データ処理装置では、監視制御情報
は各局から送信されるバースト状データが受信順
に抽出され、データ記憶回路に格納され時分割多
元接続方式のｎ個フレーム後に、データ記憶回路
から読出され、それぞれの時分割多元接続方式の
フレームに分割されて送出された情報を意味を有
する情報に集積して処理する方法がある。また他
の方法として、ｎ個フレーム間にわたつて分割さ
れて送出されてくるバースト状データをそれぞれ
のバースト毎に収集し、このバースト状データの
収集に使用される時間帯以外の空き時間帯を検出
して、収集したデータの受信処理をこの空き時間
帯に実行する方法がある。
は各局から送信されるバースト状データが受信順
に抽出され、データ記憶回路に格納され時分割多
元接続方式のｎ個フレーム後に、データ記憶回路
から読出され、それぞれの時分割多元接続方式の
フレームに分割されて送出された情報を意味を有
する情報に集積して処理する方法がある。また他
の方法として、ｎ個フレーム間にわたつて分割さ
れて送出されてくるバースト状データをそれぞれ
のバースト毎に収集し、このバースト状データの
収集に使用される時間帯以外の空き時間帯を検出
して、収集したデータの受信処理をこの空き時間
帯に実行する方法がある。
また、従来の時分割多元接続方式の通信系統で
は、基準局が送信する基準バースト状データを受
信して自局の受信同期を確立した後に、自局の送
信バースト状データをあらかじめ決められたタイ
ムスロツトに送信し、衛生中継器を介して自局が
送信したバースト状データを受信し、基準バース
ト状データと自局の送信バースト状データの位置
関係を衛生中継器で常に正しい位置になるように
自局の送信バースト状データの送信タイミングを
制御していた（以下、バースト同期という。）。
は、基準局が送信する基準バースト状データを受
信して自局の受信同期を確立した後に、自局の送
信バースト状データをあらかじめ決められたタイ
ムスロツトに送信し、衛生中継器を介して自局が
送信したバースト状データを受信し、基準バース
ト状データと自局の送信バースト状データの位置
関係を衛生中継器で常に正しい位置になるように
自局の送信バースト状データの送信タイミングを
制御していた（以下、バースト同期という。）。
しかし、スポツトビームアンテナを搭載した衛
星中継器を介して通信を行う新しい方式では、自
局が送信した送信バースト状データは衛星中継器
を介して受信することができないので、他のスポ
ツトビーム地域の基準局で受信された自局送信バ
ースト状データの位置関係を位置情報として、他
の監視制御情報に含めて返送させ、この返送され
た情報に基づいて自局の送信バースト状データ送
信タイミングを制御してバースト同期を確立して
いる。
星中継器を介して通信を行う新しい方式では、自
局が送信した送信バースト状データは衛星中継器
を介して受信することができないので、他のスポ
ツトビーム地域の基準局で受信された自局送信バ
ースト状データの位置関係を位置情報として、他
の監視制御情報に含めて返送させ、この返送され
た情報に基づいて自局の送信バースト状データ送
信タイミングを制御してバースト同期を確立して
いる。
従来例装置では、時分割多元接続方式のフレー
ム内に参加してくる時分割多元接続方式の局の局
数が少ないときはこの監視制御情報を規定時間内
で処理することができて問題を生じないが、参加
局数が増加するにつれて処理時間が増加すると規
定時間内での処理ができなくなる欠点がある。
ム内に参加してくる時分割多元接続方式の局の局
数が少ないときはこの監視制御情報を規定時間内
で処理することができて問題を生じないが、参加
局数が増加するにつれて処理時間が増加すると規
定時間内での処理ができなくなる欠点がある。
本発明は時分割多元接続方式のようにバースト
状データを送受信する通信装置の複数の受信バー
スト状データを処理する受信データ処理装置で、
前述の欠点を除去するもので、効率良く、かつ高
速処理を可能とする受信データ処理装置を提供す
ることを目的とする。
状データを送受信する通信装置の複数の受信バー
スト状データを処理する受信データ処理装置で、
前述の欠点を除去するもので、効率良く、かつ高
速処理を可能とする受信データ処理装置を提供す
ることを目的とする。
本発明は、時分割多元接続方式の受信信号出力
に接続され、時系列に配列された複数のフレーム
群に属するフレームのそれぞれに含まれその種類
を識別する識別符号がそれぞれに付加された入力
データを入力し、このデータをその種類別に編集
して出力する受信データ処理装置で、前述の問題
点を解決するための手段として、上記入力データ
を数フレーム群にわたり一時格納することができ
る記憶容量の第一の記憶手段と、上記識別符号に
対応する符号を有し、上記識別符号の配列順にそ
の符号が設定される編集符号列を格納する第二の
記憶手段と、上記入力データをその到来順に、か
つ上記識別符号に基づいてその種類別に上記第一
の記憶手段に格納する書込手段と、上記第二の記
憶手段に格納され回線プランに基づき配列された
上記編集符号列に基づいて上記第一の記憶手段に
格納されたデータを含むフレームが属するフレー
ム群に後続するフレーム群が継続する期間内にこ
の第一の記憶手段に格納されたデータを読出す読
出手段とを備えたことを特徴とする。
に接続され、時系列に配列された複数のフレーム
群に属するフレームのそれぞれに含まれその種類
を識別する識別符号がそれぞれに付加された入力
データを入力し、このデータをその種類別に編集
して出力する受信データ処理装置で、前述の問題
点を解決するための手段として、上記入力データ
を数フレーム群にわたり一時格納することができ
る記憶容量の第一の記憶手段と、上記識別符号に
対応する符号を有し、上記識別符号の配列順にそ
の符号が設定される編集符号列を格納する第二の
記憶手段と、上記入力データをその到来順に、か
つ上記識別符号に基づいてその種類別に上記第一
の記憶手段に格納する書込手段と、上記第二の記
憶手段に格納され回線プランに基づき配列された
上記編集符号列に基づいて上記第一の記憶手段に
格納されたデータを含むフレームが属するフレー
ム群に後続するフレーム群が継続する期間内にこ
の第一の記憶手段に格納されたデータを読出す読
出手段とを備えたことを特徴とする。
複数回に分割されて受信されるデータは、この
データに付加されている識別符号に基づいて到来
したデータの種類の順位別に第一の記憶手段に格
納される。編集符号列はこの識別符号に対応して
いて、データの種類の読出し順序を定義するよう
に設定されている。この設定は到来するデータの
種類の順位が変更される都度変更されて常に読出
手段での読出し順序が固定される。これにより第
一の記憶手段での不必要なアドレス動作が省略さ
れる。
データに付加されている識別符号に基づいて到来
したデータの種類の順位別に第一の記憶手段に格
納される。編集符号列はこの識別符号に対応して
いて、データの種類の読出し順序を定義するよう
に設定されている。この設定は到来するデータの
種類の順位が変更される都度変更されて常に読出
手段での読出し順序が固定される。これにより第
一の記憶手段での不必要なアドレス動作が省略さ
れる。
以下、本発明実施例装置を図面に基づいて説明
する。
する。
第１図はこの実施例装置の構成を示すブロツク
構成図である。第２図はこの実施例装置の動作を
示すタイミングチヤートである。第２図の符号
８，９，１０および１５は第１図中の符号８，
９，１０および１５に対応する。第３図はこの実
施例装置が備える第一記憶回路に入力受信データ
信号が書込まれている状態を示うメモリマツプ図
である。第４図は第一記憶回路にかかわる書込ア
ドレスおよび読出アドレスのフオーマツト図であ
る。第５図はこの実施例装置が備える第二記憶回
路に受信データ列用回線プランが書込まれている
状態を示すメモリマツプ図である。第６図はデー
タ処理回路の出力信号を示す信号構成図である。
第７図はこの実施例装置の出力信号を示す信号構
成図である。
構成図である。第２図はこの実施例装置の動作を
示すタイミングチヤートである。第２図の符号
８，９，１０および１５は第１図中の符号８，
９，１０および１５に対応する。第３図はこの実
施例装置が備える第一記憶回路に入力受信データ
信号が書込まれている状態を示うメモリマツプ図
である。第４図は第一記憶回路にかかわる書込ア
ドレスおよび読出アドレスのフオーマツト図であ
る。第５図はこの実施例装置が備える第二記憶回
路に受信データ列用回線プランが書込まれている
状態を示すメモリマツプ図である。第６図はデー
タ処理回路の出力信号を示す信号構成図である。
第７図はこの実施例装置の出力信号を示す信号構
成図である。
まず、この実施例の構成を第１図に基づいて説
明する。この実施例装置は、フレーム計数回路１
と、アドレス・データ選択回路２と、第一記憶回
路３と、第二記憶回路４と、アドレス係数回路５
と、データ処理回路６と、第三記憶回路７と、識
別符号入力端子５１と、フレーム同期信号入力端
子５２と、受信データ入力端子５３と、回線プラ
ン入力端子５４と、クロツク信号入力端子５５
と、マルチフレーム同期信号入力端子５６と、受
信データ列出力端子５７とを備える。
明する。この実施例装置は、フレーム計数回路１
と、アドレス・データ選択回路２と、第一記憶回
路３と、第二記憶回路４と、アドレス係数回路５
と、データ処理回路６と、第三記憶回路７と、識
別符号入力端子５１と、フレーム同期信号入力端
子５２と、受信データ入力端子５３と、回線プラ
ン入力端子５４と、クロツク信号入力端子５５
と、マルチフレーム同期信号入力端子５６と、受
信データ列出力端子５７とを備える。
受信データ入力端子５３はアドレス・データ選
択回路２の第一の入力に接続され、アドレス・デ
ータ選択回路２の第二の入出力は第一記憶回路３
の第一の入出力に接続される。アドレス・データ
選択回路２の第一の出力はデータ処理回路６の入
力に接続され、データ処理回路６の出力は第三記
憶回路７の第一の入力に接続され、第三記憶回路
７の出力は受信データ列出力端子５７に接続され
る。
択回路２の第一の入力に接続され、アドレス・デ
ータ選択回路２の第二の入出力は第一記憶回路３
の第一の入出力に接続される。アドレス・データ
選択回路２の第一の出力はデータ処理回路６の入
力に接続され、データ処理回路６の出力は第三記
憶回路７の第一の入力に接続され、第三記憶回路
７の出力は受信データ列出力端子５７に接続され
る。
フレーム同期信号入力端子５２はフレーム計数
回路１の第一の入力に接続され、マルチフレーム
同期信号入力端子５６はフレーウ計数回路１の第
二の入力に接続される。フレーム計数回路１の出
力はアドレス・データ選択回路２の第三の入力に
接続される。識別符号入力端子５１はアドレス・
データ選択回路２の第四の入力に接続される。
回路１の第一の入力に接続され、マルチフレーム
同期信号入力端子５６はフレーウ計数回路１の第
二の入力に接続される。フレーム計数回路１の出
力はアドレス・データ選択回路２の第三の入力に
接続される。識別符号入力端子５１はアドレス・
データ選択回路２の第四の入力に接続される。
回線プラン入力端子５４は第二記憶回路４の第
一の入力に接続され、第二記憶回路４の出力はア
ドレス・データ選択回路２の第五の入力に接続さ
れる。クロツク信号入力端子５５はアドレス計数
回路５の第一の入力に接続され、マルチフレーム
同期信号入力端子５６はアドレス計数回路５の第
二の入力およびアドレス・データ選択回路２の第
七の入力に接続される。アドレス計数回路５の出
力は、第三記憶回路７の第二の入力、第二記憶回
路４の第二の入力およびアドレス・データ選択回
路２の第六の入力に接続される。
一の入力に接続され、第二記憶回路４の出力はア
ドレス・データ選択回路２の第五の入力に接続さ
れる。クロツク信号入力端子５５はアドレス計数
回路５の第一の入力に接続され、マルチフレーム
同期信号入力端子５６はアドレス計数回路５の第
二の入力およびアドレス・データ選択回路２の第
七の入力に接続される。アドレス計数回路５の出
力は、第三記憶回路７の第二の入力、第二記憶回
路４の第二の入力およびアドレス・データ選択回
路２の第六の入力に接続される。
アドレス・データ選択回路２の第三の出力は第
一記憶回路３の第二の入力に接続される。
一記憶回路３の第二の入力に接続される。
ここで、フレーム計数回路１は基準局が送信し
た基準バースト状データを受信して作成した時分
割多元接続方式の同期信号９をタイミングベース
にして、計数自走させる回路である。またアドレ
ス・データ選択回路２は第一記憶回路３への書込
アドレス信号と読出しアドレス信号との選択およ
び第一記憶回路３に書込まれる入力受信データ１
０と読出された出力受信データ信号１６との選択
を行う回路であり、この第一記憶回路３には入力
受信データ１０が記憶される。
た基準バースト状データを受信して作成した時分
割多元接続方式の同期信号９をタイミングベース
にして、計数自走させる回路である。またアドレ
ス・データ選択回路２は第一記憶回路３への書込
アドレス信号と読出しアドレス信号との選択およ
び第一記憶回路３に書込まれる入力受信データ１
０と読出された出力受信データ信号１６との選択
を行う回路であり、この第一記憶回路３には入力
受信データ１０が記憶される。
また、第二記憶回路４は時分割多元接続方式の
通信装置を時分割多元接続方式の回線に参加させ
るときおよび受信データ列用回線プランの変更時
に連送される受信データ列用回線プラン入力信号
１２を記憶する回路である。アドレス計数回路５
はクロツク信号１９により自走する計数回路でマ
ルチフレーム同期信号１５により初期値化され
る。データ処理回路６は第一記憶回路３から第一
記憶回路読出アドレス信号１４によつて読出され
た出力受信データ信号１６をデータ処理する回路
である。第三記憶回路７はデータ処理回路６で各
局毎に集積されたデータ処理回路出力信号１７を
全局分にまとめて一つの受信データ列にして記憶
する回路である。
通信装置を時分割多元接続方式の回線に参加させ
るときおよび受信データ列用回線プランの変更時
に連送される受信データ列用回線プラン入力信号
１２を記憶する回路である。アドレス計数回路５
はクロツク信号１９により自走する計数回路でマ
ルチフレーム同期信号１５により初期値化され
る。データ処理回路６は第一記憶回路３から第一
記憶回路読出アドレス信号１４によつて読出され
た出力受信データ信号１６をデータ処理する回路
である。第三記憶回路７はデータ処理回路６で各
局毎に集積されたデータ処理回路出力信号１７を
全局分にまとめて一つの受信データ列にして記憶
する回路である。
次に、この実施例装置の動作を第１図ないし第
７図に基づいて説明する。
７図に基づいて説明する。
第１フレームの入力受信データ信号１０は識別
符号８によつてポイントされるアドレスに書込ま
れる。第２フレームの入力受信データ信号１０は
第１フレームのアドレスの次のアドレスに書込ま
れ、第ｎフレームの入力受信データ信号１０は、
第１フレームのデータが書込まれたアドレスに
「＋ｎ」したアドレスに書込まれる。このように
して、ｎ個フレームにわたつて分割された入力受
信データ信号１０は、識別符号８によりポイント
されたアドレスからｎ個オフセツトしたエリアま
でにわたり配列される。この動作は各局列に実行
される（第３図参照）。
符号８によつてポイントされるアドレスに書込ま
れる。第２フレームの入力受信データ信号１０は
第１フレームのアドレスの次のアドレスに書込ま
れ、第ｎフレームの入力受信データ信号１０は、
第１フレームのデータが書込まれたアドレスに
「＋ｎ」したアドレスに書込まれる。このように
して、ｎ個フレームにわたつて分割された入力受
信データ信号１０は、識別符号８によりポイント
されたアドレスからｎ個オフセツトしたエリアま
でにわたり配列される。この動作は各局列に実行
される（第３図参照）。
一方、第一記憶回路３からの入力受信データの
読出しは、次のマルチフレーム間に第一記憶回路
読出アドレス信号１４により読出される。このア
ドレス信号１４は受信データ列用回線プラン１３
とアドレス計数回路５の出力からなる（第４図参
照）。受信データ列用回線プラン１３は第一記憶
回路書込アドレス信号１１の識別符号部に対応し
ており、第一記憶回路３から各局の受信データの
読出す順序を定義する。したがつて、受信データ
列用回線プランが変更されて、時分割多元接続方
式のフレーム中の各局のバースト状データの配列
が変更される場合には、受信データ列用回線プラ
ン１３の各局用符号の配列順序の変更により読出
す順序は一定に保たれ、第一記憶回路３の不必要
なアドレスにアクセスされることがない。
読出しは、次のマルチフレーム間に第一記憶回路
読出アドレス信号１４により読出される。このア
ドレス信号１４は受信データ列用回線プラン１３
とアドレス計数回路５の出力からなる（第４図参
照）。受信データ列用回線プラン１３は第一記憶
回路書込アドレス信号１１の識別符号部に対応し
ており、第一記憶回路３から各局の受信データの
読出す順序を定義する。したがつて、受信データ
列用回線プランが変更されて、時分割多元接続方
式のフレーム中の各局のバースト状データの配列
が変更される場合には、受信データ列用回線プラ
ン１３の各局用符号の配列順序の変更により読出
す順序は一定に保たれ、第一記憶回路３の不必要
なアドレスにアクセスされることがない。
アドレス計数回路５はクロツク信号１９で自走
し、ｎ個フレームのマルチフレーム同期信号１５
により、初期値化され、このアドレス計数回路５
の出力は第二記憶回路４のアドレス信号になり、
受信データ列用回線プラン１３が読出され、ま
た、第一記憶回路読出アドレス信号１４の一部お
よび第三記憶回路７の書込アドレスにもなる。マ
ルチフレーム同期信号１５で初期値化されたアド
レス計数回路５の出力により、第二記憶回路４に
記憶されている受信データ列用回線プランのａ局
用符号が読出される（第５図参照）。このａ局用
符号によりａ局の第１フレームa′の受信データが
データ処理回路６に読出される。
し、ｎ個フレームのマルチフレーム同期信号１５
により、初期値化され、このアドレス計数回路５
の出力は第二記憶回路４のアドレス信号になり、
受信データ列用回線プラン１３が読出され、ま
た、第一記憶回路読出アドレス信号１４の一部お
よび第三記憶回路７の書込アドレスにもなる。マ
ルチフレーム同期信号１５で初期値化されたアド
レス計数回路５の出力により、第二記憶回路４に
記憶されている受信データ列用回線プランのａ局
用符号が読出される（第５図参照）。このａ局用
符号によりａ局の第１フレームa′の受信データが
データ処理回路６に読出される。
次に、アドレス計数回路５はクロツク信号１９
によりカウントアツプされ、出力アドレスは１番
地になる。第二の記憶回路４のアドレス信号はア
ドレス計数回路５がｎ進して１進するようにデコ
ードされており、したがつて受信データ列用回線
プラン１３によりａ局用符号の読出しが続けられ
る。アドレス計数回路がｎ進すると第ｎフレーム
anが読出され、ｎ個フレームに分割された入力受
信データ信号は、データ処理回路出力信号１７の
ように集積されて第三記憶回路７に書込まれる
（第６図参照）。
によりカウントアツプされ、出力アドレスは１番
地になる。第二の記憶回路４のアドレス信号はア
ドレス計数回路５がｎ進して１進するようにデコ
ードされており、したがつて受信データ列用回線
プラン１３によりａ局用符号の読出しが続けられ
る。アドレス計数回路がｎ進すると第ｎフレーム
anが読出され、ｎ個フレームに分割された入力受
信データ信号は、データ処理回路出力信号１７の
ように集積されて第三記憶回路７に書込まれる
（第６図参照）。
一方、アドレス計数回路５の出力がｎ＋１進に
カウントアツプされると、第二記憶回路４のアド
レスにより受信データ列用回線プランのｂ局用符
号が読出される。
カウントアツプされると、第二記憶回路４のアド
レスにより受信データ列用回線プランのｂ局用符
号が読出される。
このような一連の動作が繰り返えされて各局毎
に集積された受信データが一つの受信データ列に
なる。
に集積された受信データが一つの受信データ列に
なる。
本発明は、以上説明したように、受信データを
識別符号を参照して受信データ記憶回路１に一時
書込みを行い、ｎ個フレーム後に受信データ列回
線プランの各局用符号を参照してこの記憶回路か
ら受信データを読出し、分割された受信データを
後続する回路で受信データ処理を容易に実行する
ことができる受信データ列に変換するので、従来
例装置では実現できなかつた高速でかつ効率のよ
いデータ処理を可能にする効果がある。
識別符号を参照して受信データ記憶回路１に一時
書込みを行い、ｎ個フレーム後に受信データ列回
線プランの各局用符号を参照してこの記憶回路か
ら受信データを読出し、分割された受信データを
後続する回路で受信データ処理を容易に実行する
ことができる受信データ列に変換するので、従来
例装置では実現できなかつた高速でかつ効率のよ
いデータ処理を可能にする効果がある。
第１図は本発明実施例装置の構成を示すブロツ
ク構成図。第２図は本発明実施例装置の動作を示
すタイミングチヤート。第３図は記憶回路に入力
受信データが書込まれている状態を示すメモリマ
ツプ図。第４図は第３図に示す記憶回路の書込ア
ドレスおよび読出アドレスのフオーマツト図。第
５図は記憶回路に受信データ列用回線プランが書
込まれている状態を示すメモリマツプ図。第６図
はデータ処理回路の出力信号を示す信号構成図。
第７図は本発明実施例装置の出力信号を示す信号
構成図。 １……フレーム計数回路、２……アドレス・デ
ータ選択回路、３，４，７……記憶回路、５……
アドレス計数回路、６……データ処理回路、８…
…識別符号、９……フレーム同期信号、１０……
入力受信データ信号、１１……第一記憶回路書込
アドレス信号、１２……受信データ列用回線プラ
ン入力信号、１３……受信データ列用回線プラ
ン、１４……第一記憶回路読出アドレス信号、１
５……マルチフレーム同期信号、１６……出力受
信データ信号、１７……データ処理回路出力信
号、１８……第三記憶回路出力信号、１９……ク
ロツク信号、５１……識別符号入力端子、５２…
…フレーム同期信号入力端子、５３……受信デー
タ入力端子、５４……回線プラン入力端子、５５
……クロツク信号入力端子、５６……マルチフレ
ーム同期信号入力端子、５７……受信データ列出
力端子。
ク構成図。第２図は本発明実施例装置の動作を示
すタイミングチヤート。第３図は記憶回路に入力
受信データが書込まれている状態を示すメモリマ
ツプ図。第４図は第３図に示す記憶回路の書込ア
ドレスおよび読出アドレスのフオーマツト図。第
５図は記憶回路に受信データ列用回線プランが書
込まれている状態を示すメモリマツプ図。第６図
はデータ処理回路の出力信号を示す信号構成図。
第７図は本発明実施例装置の出力信号を示す信号
構成図。 １……フレーム計数回路、２……アドレス・デ
ータ選択回路、３，４，７……記憶回路、５……
アドレス計数回路、６……データ処理回路、８…
…識別符号、９……フレーム同期信号、１０……
入力受信データ信号、１１……第一記憶回路書込
アドレス信号、１２……受信データ列用回線プラ
ン入力信号、１３……受信データ列用回線プラ
ン、１４……第一記憶回路読出アドレス信号、１
５……マルチフレーム同期信号、１６……出力受
信データ信号、１７……データ処理回路出力信
号、１８……第三記憶回路出力信号、１９……ク
ロツク信号、５１……識別符号入力端子、５２…
…フレーム同期信号入力端子、５３……受信デー
タ入力端子、５４……回線プラン入力端子、５５
……クロツク信号入力端子、５６……マルチフレ
ーム同期信号入力端子、５７……受信データ列出
力端子。
Claims (1)
- 【特許請求の範囲】 １ 時分割多元接続方式の受信信号出力に接続さ
れ、時系列に配列された複数のフレーム群に属す
るフレームのそれぞれに含まれその種類を識別す
る識別符号がそれぞれに付加された入力データを
入力し、このデータをその種類別に編集して出力
する受信データ処理装置において、 上記入力データを数フレーム群にわたり一時格
納することができる記憶容量の第一の記憶手段
と、 上記識別符号に対応する符号を有し、上記識別
符号の配列順にその符号が設定される編集符号列
を格納する第二の記憶手段と、 上記入力データをその到来順に、かつ上記識別
符号に基づいてその種類別に上記第一の記憶手段
に格納する書込手段と、 上記第二の記憶手段に格納され回線プランに基
づき配列された上記編集符号列に基づいて上記第
一の記憶手段に格納されたデータを含むフレーム
が属するフレーム群に後続するフレーム群が継続
する期間内にこの第一の記憶手段に格納されたデ
ータを読出す読出手段と を備えたことを特徴とする受信データ処理装置。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59223760A JPS61102840A (ja) | 1984-10-24 | 1984-10-24 | 受信デ−タ処理装置 |
| US06/790,049 US4833674A (en) | 1984-10-24 | 1985-10-22 | Arrangement for processing received data in TDMA communications system and method therefor a TDMA communications system and method for retrieving received data in a preset order |
| CA000493699A CA1268868A (en) | 1984-10-24 | 1985-10-23 | Arrangement for processing received data in tdma communications system and method therefor |
| AU48963/85A AU586987B2 (en) | 1984-10-24 | 1985-10-23 | Arrangement for processing received data in TDMA communications system and method therefor |
| DE8585113476T DE3577253D1 (de) | 1984-10-24 | 1985-10-23 | Verfahren und anordnung zur verarbeitung von empfangsdaten in einem tdma-uebertragungssystem. |
| EP85113476A EP0179464B1 (en) | 1984-10-24 | 1985-10-23 | Arrangement for processing received data in a tdma communications system and method therefor |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59223760A JPS61102840A (ja) | 1984-10-24 | 1984-10-24 | 受信デ−タ処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61102840A JPS61102840A (ja) | 1986-05-21 |
| JPH0319738B2 true JPH0319738B2 (ja) | 1991-03-15 |
Family
ID=16803280
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59223760A Granted JPS61102840A (ja) | 1984-10-24 | 1984-10-24 | 受信デ−タ処理装置 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US4833674A (ja) |
| EP (1) | EP0179464B1 (ja) |
| JP (1) | JPS61102840A (ja) |
| AU (1) | AU586987B2 (ja) |
| CA (1) | CA1268868A (ja) |
| DE (1) | DE3577253D1 (ja) |
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| DE19503215C1 (de) * | 1995-02-02 | 1996-10-02 | Becker Gmbh | Verfahren zur gemeinsamen Übertragung von digitalen Quell- und Steuerdaten zwischen über Datenleitungen verbundenen Datenquellen und -senken |
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| DE2657878C3 (de) * | 1976-12-21 | 1979-11-08 | Standard Elektrik Lorenz Ag, 7000 Stuttgart | Schaltungsanordnung für ein Zeitmultiplex-Nachrichtenübertragungssystem zum empfangsseitigen Speichern und kanalweisen Zusammenstellen von in Form von Überrahmen übertragenen Informationen |
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-
1984
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-
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- 1985-10-23 AU AU48963/85A patent/AU586987B2/en not_active Ceased
- 1985-10-23 EP EP85113476A patent/EP0179464B1/en not_active Expired
- 1985-10-23 DE DE8585113476T patent/DE3577253D1/de not_active Expired - Fee Related
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| US4833674A (en) | 1989-05-23 |
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| AU586987B2 (en) | 1989-08-03 |
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