JPH031790A - 撮像装置 - Google Patents
撮像装置Info
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- JPH031790A JPH031790A JP1136646A JP13664689A JPH031790A JP H031790 A JPH031790 A JP H031790A JP 1136646 A JP1136646 A JP 1136646A JP 13664689 A JP13664689 A JP 13664689A JP H031790 A JPH031790 A JP H031790A
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- gate
- output
- integration
- signal
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- Pending
Links
- 238000003384 imaging method Methods 0.000 claims description 11
- 230000010354 integration Effects 0.000 abstract description 21
- 238000005375 photometry Methods 0.000 abstract description 3
- 230000003287 optical effect Effects 0.000 description 4
- 239000011159 matrix material Substances 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 230000000295 complement effect Effects 0.000 description 1
- 239000002131 composite material Substances 0.000 description 1
- 230000001186 cumulative effect Effects 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Photometry And Measurement Of Optical Pulse Characteristics (AREA)
- Color Television Image Signal Generators (AREA)
- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は撮像装置に関し、より具体的にはホワイト・バ
ランス調整機能を有する撮像装置に関する。
ランス調整機能を有する撮像装置に関する。
［従来の技術］
撮像素子の出力信号から露出量を自動調整する構成は公
知である。その従来例では、撮像素子の出力信号を処理
して得た輝度信号及び色差信号を所定期間（通常は１画
面期間）積分する。そして、輝度信号の積分結果により
絞り値及び撮像素子出力（例えばＲ，Ｇ、Ｈの各信号）
のレベルを調整し、更には、色差信号の積分結果に従い
、ホワイト・バランスの目的でＲ信号及びＢ信号のレベ
ルを調整する。
知である。その従来例では、撮像素子の出力信号を処理
して得た輝度信号及び色差信号を所定期間（通常は１画
面期間）積分する。そして、輝度信号の積分結果により
絞り値及び撮像素子出力（例えばＲ，Ｇ、Ｈの各信号）
のレベルを調整し、更には、色差信号の積分結果に従い
、ホワイト・バランスの目的でＲ信号及びＢ信号のレベ
ルを調整する。
［発明が解決しようとする課題］
しかし、上記従来例では、画面全体について積分を行な
うので、例えば画面の一部に強い光が入射している場合
などでは、正常なホワイト・バランスを得ることができ
ない。
うので、例えば画面の一部に強い光が入射している場合
などでは、正常なホワイト・バランスを得ることができ
ない。
画面の一部、例えば中央部の積分値またはピーク値を使
って露出を調節することも考えられるが、これをアナロ
グ積分器で実現するのは困難である。
って露出を調節することも考えられるが、これをアナロ
グ積分器で実現するのは困難である。
ディジタル回路で実現することを考えると、積分器のよ
うに低位器にカットオフ周波数を持つディジタル・フィ
ルタはタップ数が膨大になり、Ｆ■Ｒ（有限インパルス
応答）型フィルタでは実質的に実現不可能である。また
、ＩＩＲ（無限インパルス応答）型フィルタでは、フィ
ルタのビット数が長大になり、そのためフィルタの加算
器の規模が大きくなるだけでなく、カメラという用途で
はその消費電力も問題になる。
うに低位器にカットオフ周波数を持つディジタル・フィ
ルタはタップ数が膨大になり、Ｆ■Ｒ（有限インパルス
応答）型フィルタでは実質的に実現不可能である。また
、ＩＩＲ（無限インパルス応答）型フィルタでは、フィ
ルタのビット数が長大になり、そのためフィルタの加算
器の規模が大きくなるだけでなく、カメラという用途で
はその消費電力も問題になる。
そこで本発明はこのような問題点を解決し、部分測光に
よるホワイト・バランス調整を行なう撮像装置を提示す
ることを目的とする。
よるホワイト・バランス調整を行なう撮像装置を提示す
ることを目的とする。
［課題を解決するための手段］
本発明に係る撮像装置は、カラー撮像信号及びその要素
信号の何れかを画面上の任意の所定位置について通過さ
せるゲート手段と、当該ゲート手段の出力をカラー撮像
信号の要素信号別にディジタル積分する積分手段とを具
備し、当該積分結果に従い色バランスを自動調整する撮
像装置であって、当該積分手段が、画素ビット長と同一
ビット長の累積加算手段と、当該累積加算手段のキャリ
ー信号を計数するカウンタ手段とからなることを特徴と
する。
信号の何れかを画面上の任意の所定位置について通過さ
せるゲート手段と、当該ゲート手段の出力をカラー撮像
信号の要素信号別にディジタル積分する積分手段とを具
備し、当該積分結果に従い色バランスを自動調整する撮
像装置であって、当該積分手段が、画素ビット長と同一
ビット長の累積加算手段と、当該累積加算手段のキャリ
ー信号を計数するカウンタ手段とからなることを特徴と
する。
［作用］
上記ゲート手段及び積分手段により、画面」二の任０の
所定位置の積分値をカラー信号の要素別に得ることがで
き、従って、１最伸手段の出力を色毎にレベル調整する
ことによりホワイト・バランスを５．−１整できる。こ
の積分手段は回路構成が簡！１１なので、小型の回路で
構成でき、また、消費電力も小さく抑えることかできる
。
所定位置の積分値をカラー信号の要素別に得ることがで
き、従って、１最伸手段の出力を色毎にレベル調整する
ことによりホワイト・バランスを５．−１整できる。こ
の積分手段は回路構成が簡！１１なので、小型の回路で
構成でき、また、消費電力も小さく抑えることかできる
。
［実施例コ
以下、図面を参照して本発明の詳細な説明する。
第１図は、本発明の一実施例の構成ブロック図を示す。
１０は撮影光学系、１２は撮影レンズ、１４は絞り、１
６は赤外カット・フィルタ、１８は光学ローパス・フィ
ルタ、２０は色フィルタ、２２は撮像素子である。駆動
回路２４はクロック発生回路２６からのクロックに従い
撮像素子２０を駆動する。撮像素子２０は光学像をＲＧ
Ｂの色ｔＲ号に変換し、サンプル・ホールド（Ｓ／Ｈ）
回路２８，２．９．３０に印加する。Ｓ／）［回路２８
゜２９．３０の出力は可変利得アンプ３２，３３゜３４
によりレベル調整される。可変利得アンプ３２．３３．
３４の利得は、システム制御回路３６により制御される
。Ｓ／Ｈ回路２８，２９．３０の前に可変利得アンプ３
２，３３，３３４を配置してもよい。
６は赤外カット・フィルタ、１８は光学ローパス・フィ
ルタ、２０は色フィルタ、２２は撮像素子である。駆動
回路２４はクロック発生回路２６からのクロックに従い
撮像素子２０を駆動する。撮像素子２０は光学像をＲＧ
Ｂの色ｔＲ号に変換し、サンプル・ホールド（Ｓ／Ｈ）
回路２８，２．９．３０に印加する。Ｓ／）［回路２８
゜２９．３０の出力は可変利得アンプ３２，３３゜３４
によりレベル調整される。可変利得アンプ３２．３３．
３４の利得は、システム制御回路３６により制御される
。Ｓ／Ｈ回路２８，２９．３０の前に可変利得アンプ３
２，３３，３３４を配置してもよい。
スイッチ３７は画素単位で順次切り換わり、可変利得ア
ンプ３２，３３．３４の出力を循環的に選択する。スイ
ッチ３７の出力は、所謂スイッチＹ（輝度）信号である
。Ａ／Ｄ変換器３８はラダー自身にガンマ特性を持ち、
スイッチ３７の出力をディジタル化する。
ンプ３２，３３．３４の出力を循環的に選択する。スイ
ッチ３７の出力は、所謂スイッチＹ（輝度）信号である
。Ａ／Ｄ変換器３８はラダー自身にガンマ特性を持ち、
スイッチ３７の出力をディジタル化する。
４０．４２，４４．４６はそれぞれディジタル・ローパ
ス・フィルタであるＦＩＲフィルタであり、フィルタ４
０は輝度信号用、フィルタ４２はＲ信号用、フィルタ４
４はＧ信号用、フィルタ４６はＢ信号用である。Ａ／Ｄ
変換器３８の出力はフィルタ４０及び同４６に直接入力
し、ラッチ回路４８．５０を介してそれぞれフィルタ４
２．４４に入力する。第２図はＦＩＲフィルタ４０，４
２．４４．４６の構成例を示す。１００，１０２゜１０
４ １０６．１０８は単位遅延ｆｉｄの遅延素子、１１
０，１１２，１１４，１１６，１１８゜１２０は各遅延
信号に所定係数を乗算する係数回路、１２２は係数回路
１１０〜１２０の出力を加算する加算器である。加算器
１２２の出力がフィルタ出力になる。フィルタ４０，４
２，４４．４６としては、ＦＩＲ型でなくｚＲ型でもよ
い、フィルタ４０で帯域制限及びアパーチャ補償された
信号は、ブランキング回路５２でブランキングされ、シ
ンク加算回路５４で複合同期信号を重畳される。他方、
フィルタ４２，４４．４６の出力は、ＲＧ Ｂマトリク
ス回路５６により色差信号Ｒ−Ｙ、Ｂ−Ｙに変換される
。
ス・フィルタであるＦＩＲフィルタであり、フィルタ４
０は輝度信号用、フィルタ４２はＲ信号用、フィルタ４
４はＧ信号用、フィルタ４６はＢ信号用である。Ａ／Ｄ
変換器３８の出力はフィルタ４０及び同４６に直接入力
し、ラッチ回路４８．５０を介してそれぞれフィルタ４
２．４４に入力する。第２図はＦＩＲフィルタ４０，４
２．４４．４６の構成例を示す。１００，１０２゜１０
４ １０６．１０８は単位遅延ｆｉｄの遅延素子、１１
０，１１２，１１４，１１６，１１８゜１２０は各遅延
信号に所定係数を乗算する係数回路、１２２は係数回路
１１０〜１２０の出力を加算する加算器である。加算器
１２２の出力がフィルタ出力になる。フィルタ４０，４
２，４４．４６としては、ＦＩＲ型でなくｚＲ型でもよ
い、フィルタ４０で帯域制限及びアパーチャ補償された
信号は、ブランキング回路５２でブランキングされ、シ
ンク加算回路５４で複合同期信号を重畳される。他方、
フィルタ４２，４４．４６の出力は、ＲＧ Ｂマトリク
ス回路５６により色差信号Ｒ−Ｙ、Ｂ−Ｙに変換される
。
Ｄ／Ａ変換器５８，５９．６０はそれぞれ、シンク加算
回路５・８の輝度信号出力及びマトリクス回路５６から
の２つの色差信号出力をアナログ化し、そのアナログ出
ツノはＬＰＦ６２，６３．６４を介してエンコーダ６６
に供給される。エンコーダ６６は例えばＮＴＳＣテレビ
ジョン信号を出力する。
回路５・８の輝度信号出力及びマトリクス回路５６から
の２つの色差信号出力をアナログ化し、そのアナログ出
ツノはＬＰＦ６２，６３．６４を介してエンコーダ６６
に供給される。エンコーダ６６は例えばＮＴＳＣテレビ
ジョン信号を出力する。
シンク加算回路５４の出力の輝度信号は、ゲート回路７
０のスイッチ７０Ｙを介してディジタル積分回路６８に
供給され、ＲＧＢマトリクス回路５６の出力の色差信号
Ｒ−Ｙはゲート回路７０のスイッチ７０Ｒを介してディ
ジタル積分回路７２Ｒに供給され、色差信号Ｂ−Ｙはゲ
ート回路７０のスイッチ７０Ｂを介してディジタル積分
回路７２Ｂに供給される。カウンタ・デコーダ７４は、
ゲート回路７０のスイッチ７０Ｙ、７０Ｒ，７０Ｂの開
閉を制御することてディジタル積分回路６８．７２Ｒ，
７２Ｂの積分期間を制御する。
０のスイッチ７０Ｙを介してディジタル積分回路６８に
供給され、ＲＧＢマトリクス回路５６の出力の色差信号
Ｒ−Ｙはゲート回路７０のスイッチ７０Ｒを介してディ
ジタル積分回路７２Ｒに供給され、色差信号Ｂ−Ｙはゲ
ート回路７０のスイッチ７０Ｂを介してディジタル積分
回路７２Ｂに供給される。カウンタ・デコーダ７４は、
ゲート回路７０のスイッチ７０Ｙ、７０Ｒ，７０Ｂの開
閉を制御することてディジタル積分回路６８．７２Ｒ，
７２Ｂの積分期間を制御する。
第３図はディジタル積分回路６８，７２Ｒ，７２Ｂの構
成例を示す。１３０はデータ長に等しい加算器、１３２
はデータ長に等しいラッチ回路、１３４は係数器、１３
６は外部からのクロックＣＫの制御下で加算器１３０の
キャリー出力を検出するアンド・ゲート、１３８はアン
ド・ゲート１３６の出力をカウントするｍビット・カウ
ンタである。この構成により、カウンタ１３８は、加算
器１３０におけるデータ加算で発生するキャリーのみを
カウントする。カウンタ１３８の出力がこの積分回路の
出力であり、第１図ではシステム制御回路３６に印加さ
れる。システム制御回路３６は輝度信号の積分値により
絞り１４を制御し、勝つ可変利得アンプ３２，３３．３
４の各利得を同様に制御する（露出シ１を整）。システ
ム制御回路３６はまた、色差信号Ｒ−Ｙ、Ｂ−Ｙの積分
値に従い可変利得アンプ３２．３４の利得を調整し、ホ
ワイト・バランスを調整する。
成例を示す。１３０はデータ長に等しい加算器、１３２
はデータ長に等しいラッチ回路、１３４は係数器、１３
６は外部からのクロックＣＫの制御下で加算器１３０の
キャリー出力を検出するアンド・ゲート、１３８はアン
ド・ゲート１３６の出力をカウントするｍビット・カウ
ンタである。この構成により、カウンタ１３８は、加算
器１３０におけるデータ加算で発生するキャリーのみを
カウントする。カウンタ１３８の出力がこの積分回路の
出力であり、第１図ではシステム制御回路３６に印加さ
れる。システム制御回路３６は輝度信号の積分値により
絞り１４を制御し、勝つ可変利得アンプ３２，３３．３
４の各利得を同様に制御する（露出シ１を整）。システ
ム制御回路３６はまた、色差信号Ｒ−Ｙ、Ｂ−Ｙの積分
値に従い可変利得アンプ３２．３４の利得を調整し、ホ
ワイト・バランスを調整する。
本実施例では、積分回路７２Ｒ，７２Ｂに色差信号を入
力したが。勿論、Ｒ信号、Ｂ信号を直接人力してもよい
。また、撮像素子の色フィルタ２０はＲＧＢストライプ
・フィルタに限らず、その他の補色フィルタ、例えばマ
ゼンタ、シアン及びイエローや、シアン、グリ−及びイ
エローの組合せのフィルタであってもよい。撮像素子２
２の出力信号はＲ，Ｇ、Ｂ以外にも、例えばＲ−Ｙ／ｌ
３−Ｙでもよい。
力したが。勿論、Ｒ信号、Ｂ信号を直接人力してもよい
。また、撮像素子の色フィルタ２０はＲＧＢストライプ
・フィルタに限らず、その他の補色フィルタ、例えばマ
ゼンタ、シアン及びイエローや、シアン、グリ−及びイ
エローの組合せのフィルタであってもよい。撮像素子２
２の出力信号はＲ，Ｇ、Ｂ以外にも、例えばＲ−Ｙ／ｌ
３−Ｙでもよい。
［発明の効果］
以上の説明から容易に理解できるように、本発明によれ
ば、画面の一部でディジタル・データの積分値を得るこ
とができる。しかも、そのディジタル積分回路は小さな
回路で実現でき、消費電力もさほど大きくならないので
、本発明は、カメラ等の小型な装置、低消費電力である
ことが必要な電池駆動の装置に適用して大きな効果があ
る。
ば、画面の一部でディジタル・データの積分値を得るこ
とができる。しかも、そのディジタル積分回路は小さな
回路で実現でき、消費電力もさほど大きくならないので
、本発明は、カメラ等の小型な装置、低消費電力である
ことが必要な電池駆動の装置に適用して大きな効果があ
る。
第１図は本発明の一実施例の構成ブロック図、第２図は
ＦＩＲ型フィルタの構成例、第３図は第１図のディジタ
ル積分回路６８，７２Ｒ，７２Ｂの構成例である。 １６：赤外カット・フィルタ １８：光学ローパス・フ
ィルタ ２０：色フィルタ ２２：撮像素子 ３２，３
３，３４：可変利得アンプ ４０゜４２．４４，４６：
ＦＩＲフィルタ ４８．５０：ラッチ回路 ６８，７２
Ｒ，７２Ｂ：ディジタル積分回路
ＦＩＲ型フィルタの構成例、第３図は第１図のディジタ
ル積分回路６８，７２Ｒ，７２Ｂの構成例である。 １６：赤外カット・フィルタ １８：光学ローパス・フ
ィルタ ２０：色フィルタ ２２：撮像素子 ３２，３
３，３４：可変利得アンプ ４０゜４２．４４，４６：
ＦＩＲフィルタ ４８．５０：ラッチ回路 ６８，７２
Ｒ，７２Ｂ：ディジタル積分回路
Claims (1)
- カラー撮像信号及びその要素信号の何れかを画面上の任
意の所定位置について通過させるゲート手段と、当該ゲ
ート手段の出力をカラー撮像信号の要素信号別にディジ
タル積分する積分手段とを具備し、当該積分結果に従い
色バランスを自動調整する撮像装置であって、当該積分
手段が、画素ビット長と同一ビット長の累積加算手段と
、当該累積加算手段のキャリー信号を計数するカウンタ
手段とからなることを特徴とする撮像装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1136646A JPH031790A (ja) | 1989-05-30 | 1989-05-30 | 撮像装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1136646A JPH031790A (ja) | 1989-05-30 | 1989-05-30 | 撮像装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH031790A true JPH031790A (ja) | 1991-01-08 |
Family
ID=15180187
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1136646A Pending JPH031790A (ja) | 1989-05-30 | 1989-05-30 | 撮像装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH031790A (ja) |
Citations (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59121541A (ja) * | 1982-12-28 | 1984-07-13 | Fujitsu Ltd | 累算装置 |
| JPS6180988A (ja) * | 1984-09-28 | 1986-04-24 | Fuji Photo Film Co Ltd | カラ−ビデオカメラにおける自動ホワイトバランス調整装置 |
| JPS61199390A (ja) * | 1985-03-01 | 1986-09-03 | Hitachi Ltd | ホワイトバランス装置 |
| JPS63276981A (ja) * | 1987-03-04 | 1988-11-15 | Sanyo Electric Co Ltd | オ−トフオ−カス回路 |
| JPS6423698A (en) * | 1987-07-17 | 1989-01-26 | Matsushita Electric Ind Co Ltd | Ttl white balance circuit |
| JPS6424586A (en) * | 1987-07-20 | 1989-01-26 | Sharp Kk | Automatic white balance adjusting circuit |
| JPS6489884A (en) * | 1987-09-30 | 1989-04-05 | Sony Corp | White balance correction circuit |
-
1989
- 1989-05-30 JP JP1136646A patent/JPH031790A/ja active Pending
Patent Citations (7)
| Publication number | Priority date | Publication date | Assignee | Title |
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| JPS6489884A (en) * | 1987-09-30 | 1989-04-05 | Sony Corp | White balance correction circuit |
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