JPH031790A - 撮像装置 - Google Patents
撮像装置Info
- Publication number
- JPH031790A JPH031790A JP1136646A JP13664689A JPH031790A JP H031790 A JPH031790 A JP H031790A JP 1136646 A JP1136646 A JP 1136646A JP 13664689 A JP13664689 A JP 13664689A JP H031790 A JPH031790 A JP H031790A
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- Japan
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- circuit
- gate
- output
- integration
- signal
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- Pending
Links
- 238000003384 imaging method Methods 0.000 claims description 11
- 230000010354 integration Effects 0.000 abstract description 21
- 238000005375 photometry Methods 0.000 abstract description 3
- 230000003287 optical effect Effects 0.000 description 4
- 239000011159 matrix material Substances 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 230000000295 complement effect Effects 0.000 description 1
- 239000002131 composite material Substances 0.000 description 1
- 230000001186 cumulative effect Effects 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Photometry And Measurement Of Optical Pulse Characteristics (AREA)
- Color Television Image Signal Generators (AREA)
- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は撮像装置に関し、より具体的にはホワイト・バ
ランス調整機能を有する撮像装置に関する。
ランス調整機能を有する撮像装置に関する。
[従来の技術]
撮像素子の出力信号から露出量を自動調整する構成は公
知である。その従来例では、撮像素子の出力信号を処理
して得た輝度信号及び色差信号を所定期間(通常は1画
面期間)積分する。そして、輝度信号の積分結果により
絞り値及び撮像素子出力(例えばR,G、Hの各信号)
のレベルを調整し、更には、色差信号の積分結果に従い
、ホワイト・バランスの目的でR信号及びB信号のレベ
ルを調整する。
知である。その従来例では、撮像素子の出力信号を処理
して得た輝度信号及び色差信号を所定期間(通常は1画
面期間)積分する。そして、輝度信号の積分結果により
絞り値及び撮像素子出力(例えばR,G、Hの各信号)
のレベルを調整し、更には、色差信号の積分結果に従い
、ホワイト・バランスの目的でR信号及びB信号のレベ
ルを調整する。
[発明が解決しようとする課題]
しかし、上記従来例では、画面全体について積分を行な
うので、例えば画面の一部に強い光が入射している場合
などでは、正常なホワイト・バランスを得ることができ
ない。
うので、例えば画面の一部に強い光が入射している場合
などでは、正常なホワイト・バランスを得ることができ
ない。
画面の一部、例えば中央部の積分値またはピーク値を使
って露出を調節することも考えられるが、これをアナロ
グ積分器で実現するのは困難である。
って露出を調節することも考えられるが、これをアナロ
グ積分器で実現するのは困難である。
ディジタル回路で実現することを考えると、積分器のよ
うに低位器にカットオフ周波数を持つディジタル・フィ
ルタはタップ数が膨大になり、F■R(有限インパルス
応答)型フィルタでは実質的に実現不可能である。また
、IIR(無限インパルス応答)型フィルタでは、フィ
ルタのビット数が長大になり、そのためフィルタの加算
器の規模が大きくなるだけでなく、カメラという用途で
はその消費電力も問題になる。
うに低位器にカットオフ周波数を持つディジタル・フィ
ルタはタップ数が膨大になり、F■R(有限インパルス
応答)型フィルタでは実質的に実現不可能である。また
、IIR(無限インパルス応答)型フィルタでは、フィ
ルタのビット数が長大になり、そのためフィルタの加算
器の規模が大きくなるだけでなく、カメラという用途で
はその消費電力も問題になる。
そこで本発明はこのような問題点を解決し、部分測光に
よるホワイト・バランス調整を行なう撮像装置を提示す
ることを目的とする。
よるホワイト・バランス調整を行なう撮像装置を提示す
ることを目的とする。
[課題を解決するための手段]
本発明に係る撮像装置は、カラー撮像信号及びその要素
信号の何れかを画面上の任意の所定位置について通過さ
せるゲート手段と、当該ゲート手段の出力をカラー撮像
信号の要素信号別にディジタル積分する積分手段とを具
備し、当該積分結果に従い色バランスを自動調整する撮
像装置であって、当該積分手段が、画素ビット長と同一
ビット長の累積加算手段と、当該累積加算手段のキャリ
ー信号を計数するカウンタ手段とからなることを特徴と
する。
信号の何れかを画面上の任意の所定位置について通過さ
せるゲート手段と、当該ゲート手段の出力をカラー撮像
信号の要素信号別にディジタル積分する積分手段とを具
備し、当該積分結果に従い色バランスを自動調整する撮
像装置であって、当該積分手段が、画素ビット長と同一
ビット長の累積加算手段と、当該累積加算手段のキャリ
ー信号を計数するカウンタ手段とからなることを特徴と
する。
[作用]
上記ゲート手段及び積分手段により、画面」二の任0の
所定位置の積分値をカラー信号の要素別に得ることがで
き、従って、1最伸手段の出力を色毎にレベル調整する
ことによりホワイト・バランスを5.−1整できる。こ
の積分手段は回路構成が簡!11なので、小型の回路で
構成でき、また、消費電力も小さく抑えることかできる
。
所定位置の積分値をカラー信号の要素別に得ることがで
き、従って、1最伸手段の出力を色毎にレベル調整する
ことによりホワイト・バランスを5.−1整できる。こ
の積分手段は回路構成が簡!11なので、小型の回路で
構成でき、また、消費電力も小さく抑えることかできる
。
[実施例コ
以下、図面を参照して本発明の詳細な説明する。
第1図は、本発明の一実施例の構成ブロック図を示す。
10は撮影光学系、12は撮影レンズ、14は絞り、1
6は赤外カット・フィルタ、18は光学ローパス・フィ
ルタ、20は色フィルタ、22は撮像素子である。駆動
回路24はクロック発生回路26からのクロックに従い
撮像素子20を駆動する。撮像素子20は光学像をRG
Bの色tR号に変換し、サンプル・ホールド(S/H)
回路28,2.9.30に印加する。S/)[回路28
゜29.30の出力は可変利得アンプ32,33゜34
によりレベル調整される。可変利得アンプ32.33.
34の利得は、システム制御回路36により制御される
。S/H回路28,29.30の前に可変利得アンプ3
2,33,334を配置してもよい。
6は赤外カット・フィルタ、18は光学ローパス・フィ
ルタ、20は色フィルタ、22は撮像素子である。駆動
回路24はクロック発生回路26からのクロックに従い
撮像素子20を駆動する。撮像素子20は光学像をRG
Bの色tR号に変換し、サンプル・ホールド(S/H)
回路28,2.9.30に印加する。S/)[回路28
゜29.30の出力は可変利得アンプ32,33゜34
によりレベル調整される。可変利得アンプ32.33.
34の利得は、システム制御回路36により制御される
。S/H回路28,29.30の前に可変利得アンプ3
2,33,334を配置してもよい。
スイッチ37は画素単位で順次切り換わり、可変利得ア
ンプ32,33.34の出力を循環的に選択する。スイ
ッチ37の出力は、所謂スイッチY(輝度)信号である
。A/D変換器38はラダー自身にガンマ特性を持ち、
スイッチ37の出力をディジタル化する。
ンプ32,33.34の出力を循環的に選択する。スイ
ッチ37の出力は、所謂スイッチY(輝度)信号である
。A/D変換器38はラダー自身にガンマ特性を持ち、
スイッチ37の出力をディジタル化する。
40.42,44.46はそれぞれディジタル・ローパ
ス・フィルタであるFIRフィルタであり、フィルタ4
0は輝度信号用、フィルタ42はR信号用、フィルタ4
4はG信号用、フィルタ46はB信号用である。A/D
変換器38の出力はフィルタ40及び同46に直接入力
し、ラッチ回路48.50を介してそれぞれフィルタ4
2.44に入力する。第2図はFIRフィルタ40,4
2.44.46の構成例を示す。100,102゜10
4 106.108は単位遅延fidの遅延素子、11
0,112,114,116,118゜120は各遅延
信号に所定係数を乗算する係数回路、122は係数回路
110〜120の出力を加算する加算器である。加算器
122の出力がフィルタ出力になる。フィルタ40,4
2,44.46としては、FIR型でなくzR型でもよ
い、フィルタ40で帯域制限及びアパーチャ補償された
信号は、ブランキング回路52でブランキングされ、シ
ンク加算回路54で複合同期信号を重畳される。他方、
フィルタ42,44.46の出力は、RG Bマトリク
ス回路56により色差信号R−Y、B−Yに変換される
。
ス・フィルタであるFIRフィルタであり、フィルタ4
0は輝度信号用、フィルタ42はR信号用、フィルタ4
4はG信号用、フィルタ46はB信号用である。A/D
変換器38の出力はフィルタ40及び同46に直接入力
し、ラッチ回路48.50を介してそれぞれフィルタ4
2.44に入力する。第2図はFIRフィルタ40,4
2.44.46の構成例を示す。100,102゜10
4 106.108は単位遅延fidの遅延素子、11
0,112,114,116,118゜120は各遅延
信号に所定係数を乗算する係数回路、122は係数回路
110〜120の出力を加算する加算器である。加算器
122の出力がフィルタ出力になる。フィルタ40,4
2,44.46としては、FIR型でなくzR型でもよ
い、フィルタ40で帯域制限及びアパーチャ補償された
信号は、ブランキング回路52でブランキングされ、シ
ンク加算回路54で複合同期信号を重畳される。他方、
フィルタ42,44.46の出力は、RG Bマトリク
ス回路56により色差信号R−Y、B−Yに変換される
。
D/A変換器58,59.60はそれぞれ、シンク加算
回路5・8の輝度信号出力及びマトリクス回路56から
の2つの色差信号出力をアナログ化し、そのアナログ出
ツノはLPF62,63.64を介してエンコーダ66
に供給される。エンコーダ66は例えばNTSCテレビ
ジョン信号を出力する。
回路5・8の輝度信号出力及びマトリクス回路56から
の2つの色差信号出力をアナログ化し、そのアナログ出
ツノはLPF62,63.64を介してエンコーダ66
に供給される。エンコーダ66は例えばNTSCテレビ
ジョン信号を出力する。
シンク加算回路54の出力の輝度信号は、ゲート回路7
0のスイッチ70Yを介してディジタル積分回路68に
供給され、RGBマトリクス回路56の出力の色差信号
R−Yはゲート回路70のスイッチ70Rを介してディ
ジタル積分回路72Rに供給され、色差信号B−Yはゲ
ート回路70のスイッチ70Bを介してディジタル積分
回路72Bに供給される。カウンタ・デコーダ74は、
ゲート回路70のスイッチ70Y、70R,70Bの開
閉を制御することてディジタル積分回路68.72R,
72Bの積分期間を制御する。
0のスイッチ70Yを介してディジタル積分回路68に
供給され、RGBマトリクス回路56の出力の色差信号
R−Yはゲート回路70のスイッチ70Rを介してディ
ジタル積分回路72Rに供給され、色差信号B−Yはゲ
ート回路70のスイッチ70Bを介してディジタル積分
回路72Bに供給される。カウンタ・デコーダ74は、
ゲート回路70のスイッチ70Y、70R,70Bの開
閉を制御することてディジタル積分回路68.72R,
72Bの積分期間を制御する。
第3図はディジタル積分回路68,72R,72Bの構
成例を示す。130はデータ長に等しい加算器、132
はデータ長に等しいラッチ回路、134は係数器、13
6は外部からのクロックCKの制御下で加算器130の
キャリー出力を検出するアンド・ゲート、138はアン
ド・ゲート136の出力をカウントするmビット・カウ
ンタである。この構成により、カウンタ138は、加算
器130におけるデータ加算で発生するキャリーのみを
カウントする。カウンタ138の出力がこの積分回路の
出力であり、第1図ではシステム制御回路36に印加さ
れる。システム制御回路36は輝度信号の積分値により
絞り14を制御し、勝つ可変利得アンプ32,33.3
4の各利得を同様に制御する(露出シ1を整)。システ
ム制御回路36はまた、色差信号R−Y、B−Yの積分
値に従い可変利得アンプ32.34の利得を調整し、ホ
ワイト・バランスを調整する。
成例を示す。130はデータ長に等しい加算器、132
はデータ長に等しいラッチ回路、134は係数器、13
6は外部からのクロックCKの制御下で加算器130の
キャリー出力を検出するアンド・ゲート、138はアン
ド・ゲート136の出力をカウントするmビット・カウ
ンタである。この構成により、カウンタ138は、加算
器130におけるデータ加算で発生するキャリーのみを
カウントする。カウンタ138の出力がこの積分回路の
出力であり、第1図ではシステム制御回路36に印加さ
れる。システム制御回路36は輝度信号の積分値により
絞り14を制御し、勝つ可変利得アンプ32,33.3
4の各利得を同様に制御する(露出シ1を整)。システ
ム制御回路36はまた、色差信号R−Y、B−Yの積分
値に従い可変利得アンプ32.34の利得を調整し、ホ
ワイト・バランスを調整する。
本実施例では、積分回路72R,72Bに色差信号を入
力したが。勿論、R信号、B信号を直接人力してもよい
。また、撮像素子の色フィルタ20はRGBストライプ
・フィルタに限らず、その他の補色フィルタ、例えばマ
ゼンタ、シアン及びイエローや、シアン、グリ−及びイ
エローの組合せのフィルタであってもよい。撮像素子2
2の出力信号はR,G、B以外にも、例えばR−Y/l
3−Yでもよい。
力したが。勿論、R信号、B信号を直接人力してもよい
。また、撮像素子の色フィルタ20はRGBストライプ
・フィルタに限らず、その他の補色フィルタ、例えばマ
ゼンタ、シアン及びイエローや、シアン、グリ−及びイ
エローの組合せのフィルタであってもよい。撮像素子2
2の出力信号はR,G、B以外にも、例えばR−Y/l
3−Yでもよい。
[発明の効果]
以上の説明から容易に理解できるように、本発明によれ
ば、画面の一部でディジタル・データの積分値を得るこ
とができる。しかも、そのディジタル積分回路は小さな
回路で実現でき、消費電力もさほど大きくならないので
、本発明は、カメラ等の小型な装置、低消費電力である
ことが必要な電池駆動の装置に適用して大きな効果があ
る。
ば、画面の一部でディジタル・データの積分値を得るこ
とができる。しかも、そのディジタル積分回路は小さな
回路で実現でき、消費電力もさほど大きくならないので
、本発明は、カメラ等の小型な装置、低消費電力である
ことが必要な電池駆動の装置に適用して大きな効果があ
る。
第1図は本発明の一実施例の構成ブロック図、第2図は
FIR型フィルタの構成例、第3図は第1図のディジタ
ル積分回路68,72R,72Bの構成例である。 16:赤外カット・フィルタ 18:光学ローパス・フ
ィルタ 20:色フィルタ 22:撮像素子 32,3
3,34:可変利得アンプ 40゜42.44,46:
FIRフィルタ 48.50:ラッチ回路 68,72
R,72B:ディジタル積分回路
FIR型フィルタの構成例、第3図は第1図のディジタ
ル積分回路68,72R,72Bの構成例である。 16:赤外カット・フィルタ 18:光学ローパス・フ
ィルタ 20:色フィルタ 22:撮像素子 32,3
3,34:可変利得アンプ 40゜42.44,46:
FIRフィルタ 48.50:ラッチ回路 68,72
R,72B:ディジタル積分回路
Claims (1)
- カラー撮像信号及びその要素信号の何れかを画面上の任
意の所定位置について通過させるゲート手段と、当該ゲ
ート手段の出力をカラー撮像信号の要素信号別にディジ
タル積分する積分手段とを具備し、当該積分結果に従い
色バランスを自動調整する撮像装置であって、当該積分
手段が、画素ビット長と同一ビット長の累積加算手段と
、当該累積加算手段のキャリー信号を計数するカウンタ
手段とからなることを特徴とする撮像装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1136646A JPH031790A (ja) | 1989-05-30 | 1989-05-30 | 撮像装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1136646A JPH031790A (ja) | 1989-05-30 | 1989-05-30 | 撮像装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH031790A true JPH031790A (ja) | 1991-01-08 |
Family
ID=15180187
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1136646A Pending JPH031790A (ja) | 1989-05-30 | 1989-05-30 | 撮像装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH031790A (ja) |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS59121541A (ja) * | 1982-12-28 | 1984-07-13 | Fujitsu Ltd | 累算装置 |
JPS6180988A (ja) * | 1984-09-28 | 1986-04-24 | Fuji Photo Film Co Ltd | カラ−ビデオカメラにおける自動ホワイトバランス調整装置 |
JPS61199390A (ja) * | 1985-03-01 | 1986-09-03 | Hitachi Ltd | ホワイトバランス装置 |
JPS63276981A (ja) * | 1987-03-04 | 1988-11-15 | Sanyo Electric Co Ltd | オ−トフオ−カス回路 |
JPS6423698A (en) * | 1987-07-17 | 1989-01-26 | Matsushita Electric Ind Co Ltd | Ttl white balance circuit |
JPS6424586A (en) * | 1987-07-20 | 1989-01-26 | Sharp Kk | Automatic white balance adjusting circuit |
JPS6489884A (en) * | 1987-09-30 | 1989-04-05 | Sony Corp | White balance correction circuit |
-
1989
- 1989-05-30 JP JP1136646A patent/JPH031790A/ja active Pending
Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
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