JPH03123386A - 表示装置及び表示方法 - Google Patents

表示装置及び表示方法

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JPH03123386A
JPH03123386A JP1261297A JP26129789A JPH03123386A JP H03123386 A JPH03123386 A JP H03123386A JP 1261297 A JP1261297 A JP 1261297A JP 26129789 A JP26129789 A JP 26129789A JP H03123386 A JPH03123386 A JP H03123386A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、表示装置に関し、詳しくは例えば強誘電性液
晶表示素子等、電界に対して双安定性（メモリー性）を
有する２値化表示素子を用しＡた表示装置に適用して好
適な、画像情報の出力回路に関するものである。
（従来の技術〕 最近、パーソナル・コンピュータやワークステーション
などのデイスプレィは、大画面、高解像度化が急速に進
んでおり、従来からのものも含め多くの表示モードが存
在する。一般的によく用いられるＩＢＭ（登録商標）社
のパーソナル・コンピュータのグラフィックス環境を例
にとれば、ＣＧＡ（Ｃｏｌｏｒ　　ＧｒａｐｈｉｃＡｄ
ａｐｔｅｒ）、ＥＧＡ　（ＥｎｈａｎｃｅｄＧｒａｐｈ
ｉｃ　　　Ａｄａｐｔｅｒ）、ＶＧＡ　　（Ｖｉｄｅｏ
　　Ｇｒａｐｈｉｃ　　Ａｄａｐｔｅｒ）など１０数種
類におよぶ表示モードがあり、それぞれ解像度や表示可
能な色の数が異なる。
第１０図は、その−賢夫である。
（１）表示色について 第１０図から判るように、各表示モードによって１ピク
セル当りの構成ビット数（ビット／ビクセル）が異なり
、画像メモリ（ＶＲＡＭ）中の格納フォーマットも異な
っている。当然、１ビクセル当りの構成ビット数が多い
モードの方が、多色表示が可能である。
ここで、ＩＢＭ社のパーソナル・コンピュータのグラフ
ィックス環境において最も多色表示が可能な、表示モー
ド１３　（ｈ）（ＶＧＡ）を−例に挙げると、そのカラ
ー情報の出力フローは以下の通りである。まず、ＶＲＡ
ＭのあるアドレスがアクセスされるとＶＲＡＭ中の画像
データ（ビット／ピクセル：モード１３（ｈ）時）は、
予め色情報が格納されているカラーパレット内のカラー
レジスタを選択するためのアドレスとして働く。ＶＧＡ
の場合、カラーパレットは１８ビツト（Ｒ，Ｇ、Ｂの各
６ビツト）のカラーレジスタを２５６本持っており、こ
のカラーレジスタに色情報が格納されている。ＶＲＡＭ
からの画像データによって２５６木の中から１つのカラ
ーレジスタが選択されると、Ｒ，Ｇ、Ｂの各６ビツト構
成のカラーデータが読み出され、同じカラーパレット内
にあるＤ−Ａコンバータへと導かれる。Ｒ２Ｏ，Ｂ各１
つずつ設けられているＤ−Ａコンバータは、６ビツトの
カラーデータをアナログ信号に変換して、デイスプレィ
（ＣＲＴ）に送る。
この様なカラー情報の出力方式（カラーパレット中アナ
ログ出力）は、ＶＲＡＭのデータ量の割に多色表示が実
現できる点や、カラーレジスタのデータを書き換えるこ
とで、ＶＲＡＭ中のデータを書き換えなくても表示画面
上の色を変化させることができる点、またデイスプレィ
との接続本数を少なくできる点などの利点があり、現在
の主にパーソナル・コンピュータにおける標準的な手法
となっている。
（２）解像度について 第１０図において、解像度に関しても各表示モード毎に
異なり、例えば、モードＤ　（ｈ）の場合は、３２０ｘ
２００ピクセル（絵素）、モード１２（ｈ）＋７）場合
は、６４０ｘ４８０ピクセルである。この様な、多種類
の表示モードすべてを１つのデイスプレィ（ＣＲＴ）で
サポートすることは従来より比較的困難とされており、
表示可能な表示モードを規定（制限）しているものが一
般的である。また、“マルチスキャン”や“マルチシン
ク”と呼ばれる一部の自動追尾型のＣＲＴ等では、比較
的広範囲の表示モードをサポートするために、各表示モ
ードに応じて電子ビームの走査周波数を切り替えるとい
う手法をとっている。このため表示情報の少ない（解像
度の低い）表示モードで表示を行うと、文字や数字が歯
抜けて表示されるものも多い。
〔発明が解決しようとしている問題点〕前記の様な、表
示色及び解像度が異なる各種表示モードを強誘電性液晶
等のメモリー性を有する液晶を用いた表示装置に適用し
て表示する場合、ＣＲＴ等に表示する場合と異なり、以
下の様なことを考慮しなければならない。
（１）表示色に関して 強誘電性液晶表示装置などに代表される２値化表示素子
を用いた表示装置の場合、ＣＲＴ等の様に１ビクセル（
絵素）内でアナログ的に（深さ方向で）階調を表現する
こと、即ち３次元的に階調表示をすることが難しい。２
値化表示素子で階調表示を行わせる場合、深さ方向の階
調（゛カラー）データを横方向（広がり方向）に展開す
る処理を行い、２次元的に表示（面積階調）させるのが
−般的である。したがって、表示色が異なる各種表示モ
ードを強誘電性液晶表示装置等で表示させる場合、表示
モードに応じて、本来ＣＲＴ用の深さ方向の階調（カラ
ー）データを実際の表示装置の絵素の配置にしたがって
横方向（広がり方向）の階調データに変換しなければな
らない。
（２）解像度に関して 高解像度（１０００ｘｌＯＯＯ絵素以上）の強誘電性液
晶表示装置等の表示装置に対して、従来よりＣＲＴ等で
用いられている各種表示モードでの表示を行おうとする
と、液晶表示装置の有効絵素数（解像度）にくらべてＣ
Ｒ７表示モードの解像度が低い（表示情報が少ない）た
め、液晶表示装置側に全絵素（絵素が余る）が発生する
。このような場合、液晶表示装置側で縦・横の電極を複
数本束ねて同時駆動することで、拡大表示を行うことも
できる。例えば、１２８０ｘ１０２４絵素の強誘電性液
晶表示装置において、そ−ドＤ（ｈ）（３２０Ｘ２００
絵素）の画面を表示させる場合等（１）倍〜４倍までの
拡大表示が実現できる。この様な拡大表示を取り入れて
も、液晶表示装置の有効絵素数（解像度）と表示モード
の解像度との関係によりては、有効表示領域の外部に全
画素が生ずる。
したがって、この有効表示領域外の全絵素の部分（ボー
ダ一部）に対して、しかるべき処理を施す必要がある。
ＣＲＴで低解像度の表示モードを表示する場合は、電子
ビームの走査周波数を下げて蛍光面を間引き走査するこ
とによって、ビームがあたらない部分は黒色（暗）に保
たれる。しかしながら、強誘電性液晶表示装置の場合は
、画像データの入力がないとその絵素の状態が保証され
ない（明又は暗、ｏｎまたはｏｆｆ）。このため、全絵
素の部分にもデータを人力し、駆動制御してやることが
必要である。
本発明は、従来からのＣＲＴなどで用いられている画像
情報出力回路では実現で籾ない上記問題点を除去すべく
なされたもので、その目的は、従来からのＣＲＴなどで
用いられてきた各種表示モードでの画面を、強誘電性液
晶表示装置などの２値化表示素子を用いた表示装置上に
破綻なく表示するための画像情報出力回路を実現するこ
とにある。
〔問題点を解決するための手段（及び作用）〕双安定性
（メモリー性）を有する強誘電性液晶等を用いた表示装
置において、画像メモリから読みだされる画像データを
１画素データ毎に次段に導く第一のマルチプレクサ、第
一のマルチプレクサから出力されるデータに基づき、画
素データを出力するパレットＲＡＭ、さらにパレットＲ
ＡＭからの画素データを表示装置に転送するための出力
フォーマットに変換する第二のマルチプレクサを有し、
本体ＣＰＵからの表示モード要求に応じて、画像データ
の変換処理及び有効表示領域外（枠部）の処理を行うこ
とにより、多種多様な表示モードに適応できる表示装置
の画像情報出力回路を実現したものである。
〔実施例〕
第２図は、画像情報の併給源であるパーソナル・コンピ
ュータなどの本体装置側に設けられたグラフィックス・
コントローラと強誘電性液晶表示装置との全体構成図で
ある。本発明による画像情報出力回路は、第２図におけ
るグラフィックス・コントローラ内に設けられている。
表示パネルは、走査電８ｉ１０２４本、情報電極２５６
０本をマトリクス上に配し、配向処理を施した２枚のガ
ラス板の中に強誂電性液晶を封入したもので、走査線は
走査電極駆動回路、情報線は情報電極駆動回路にそれぞ
れ接続されている。また、１絵素（ビクセル）は第２図
の表示パネル中Ｏ内に示す様に３：２の面積比に分割さ
れた２ビツト／ビクセル構成をとっており、１絵素当９
４レベルの階調表示が可能である。
デイスプレィ・コントローラは、本発明による画像情報
出力回路からの表示情報を受は取り、走査電極駆動回路
及び情報電極駆動回路を制御する。
グラフィックス・コントローラは、表示機能全般を司る
ＣＰｔＪ　（中央演算処理装置、以下ＧＣＰＵ）とＶＲ
ＡＭ　（画像情報格納用メモリ）、及び本発明による画
像情報出力回路であるデイスプレィインターフェイスか
ら構成されており、ホストＣＰＵと表示装置との間の表
示情報の管理や通信全般を制御している。
第１図は、本発明によるデイスプレィインターフェイス
の構成図である。本回路は、ＶＲＡＭからの画像データ
を面積階調データに変換する階調変換部１、有効表示領
域外のデータを決めるためのボーダーレジスタ２、走査
線アドレス発生部３、液晶表示装置に画像データを転送
するための出力フォーマットに変換するためのデータセ
レクタ４、から構成されている。以下、図面にしたがっ
て、その動作を説明する。
（１）階調変換部 ＶＲＡＭ５に格納されている画像データは、前述のＩＢ
Ｍ社グラフィックス環境下の表示モードを例にとれば、
モード３（ｈ）のとき４ビツト／ビクセル、モード１３
（ｈ）のときは８ビツト／ピクセルというように表示モ
ード毎に１ビクセル（絵素）当りの構成ビット数が異な
る。本実施例では、ＶＲＡＭ５内に格納されている画像
データはＶＲＡＭ５への１回の読みだし操作（アクセス
）で常に２バイト（１６ビツト）出力されるように構成
されている。このため、ＶＲＡＭ５への１回のアクセス
で出力される絵素の数は、表示モードによって異なり、
例えばモード３（ｈ）の場合は４絵素分、モード１３（
ｈ）の場合は２絵素分が１回のアクセスで出力される。
後述するパレットＲＡＭ１２は、１絵素車位で階調変換
を行うことから、ＶＲＡＭ５から読みだされた画像デー
タを１絵素単位でパレットＲＡＭ１２に導かなければな
らない。
このために設けられたのがビクセル・マルチプレクサ１
１である。第３図は、ビクセル・マルチプレクサ１１の
画像データ変換フォーマットを示しており、これら変換
モードの切り替えはＧＣＰＵ６からの命令で行われる（
第２図）。例えば、表示モード３（ｈ）のとき、ＶＲＡ
Ｍからは１回のアクセスで４絵素分（４ビツト／ビクセ
ル）の画像データが出力されるから、ビクセル・マルチ
プレクサ１１は変換モードＢで動作させることになる。
この変換モードＢの場合、ビクセル・マルチプレクサ１
１はＶＲＡＭ５から出力される４絵素分のデータを含む
ＶＳＤＯ〜１５から、第一の位相でＶＳＤＯ〜３及びＶ
ＳＤ４〜７の２絵素分のデータを抽出し、それぞれＱＯ
〜３、Ｑ８〜１１としてパレットＲＡＭ１２、パレット
ＲＡＭ１３に導く。次に、第二の位相で今度はｖＳＤ８
〜１１、ＶＳＤＩ　２〜１５（７）２絵素分のデータを
、・それぞれＱＯ〜３、Ｑ８〜１１としてパレットＲＡ
Ｍ１２、パレットＲＡＭ１３に導く。この様に、マルチ
・プレクサ１１は２回の位相に分けて画像データをパレ
ットＲＡＭ部１２．１３に導く、また第３図において、
変換モードＡ及びＣは、それぞれＶＲＡＭ内の画像デー
タ・フォーマットが８ビツト／ビクセル及び２ビツト／
ピクセルの場合の変換モードであり、前記４ビツト／ビ
クセルの場合と同様に、画像データが１絵素単位でパレ
ットＲＡＭ１２に導かれるように構成されている。
パレットＲＡＭ１２及び１３は、ＶＲＡＭ５からの絵素
データ（色情報）をそれぞれ１絵素阜位で、実際の表示
パネルの絵素のＯＮ１０　Ｆ　Ｆデータに変換する部分
である。本発明によろく深さ方向の色情報〉からく横方
向の階調情報〉（面積階調）への変換は、ここで実現さ
れる。第１図の実施例では、パレットＲＡＭが２つ並列
に設けられているが、これはパレットＲＡＭでの画像デ
ータ変換速度が、要求される表示装置への転送速度に比
べて遅いことに対処するためのものであり、パレットＲ
ＡＭの処理速度が十分速ければ１つで全く問題ない。逆
に、ＶＲＡＭ５の読み出し速度やマルチプレクサ１１及
び１４の動作速度が十分速いケースでは、それに応じて
パレットＲＡＭの数を増やせばそれだけ変換系としての
処理速度を上げることも可能である。
パレットＲＡＭ１２及び１３は、それぞれパレットレジ
スタと呼ばれる８ビツト長のレジスタ×２５６木で構成
されており、予めＧＣＰＵ６によって絵素の色情報に応
じた階調情報（絵素のＯＮ１０　Ｆ　Ｆデータ）が書き
込まれる。尚、本実施例では、パレットＲＡＭ１２と１
３には同じ階調情報が書き込まれるように構成されてい
る。また、各パレットＲＡＭへの書き込み操作及び読み
出し操作は、任意のタイミングで行うことができるが、
通常は一水平走査期間毎もしくは一垂直走査期間毎に必
要に応じて行う。
第４図は、パレットＲＡＭ内パレットレジスタの階調デ
ータ（絵素のＯＮ１０　Ｆ　Ｆデータ）と実際の表示パ
ネルの絵素配置との関係を示している。第４図において
、（Ｃ）が本実施例で用いた表示パネルの最小絵素単位
である。前述のように、１絵素は面積比３：２で分割さ
れており各々独立に駆動されることにより、４レベルの
階調表示を実現している。また、（ｂ）及び（ａ）は、
拡大表示モードでの１絵素の取り扱いを示している。そ
れぞれ、４絵素、１６絵素分をとりまとめて１絵素とし
て扱うことにより、２倍、４倍の拡大表示を行うととも
に、表示できる階調数も８レベル、１６レベルと増加す
る。第４図に示すように、パレットレジスタの階調デー
タは、そのまま表示パネル上の各絵素のＯＮ１０　Ｆ　
Ｆデータと１：１で対応している。
第５図に示すようにＶＲＡＭ５からの絵素データ（色情
報）は、パレットＲＡＭのパレットレジスタを選択する
ためのアドレスとして働く。例えば、ＶＲＡＭ５からの
絵素データ（色情報）が４ビツト／ビクセルの場合、１
６木のパレットレジスタの中から１本を選択する。また
、絵素データが８ビツト／ピクセル及び２ビツト／ビク
セルの場合は、それぞれ２５６本、４木のパレットレジ
スタの中から１本を選択する。あるパレットレジスタが
選択されると、その中に格納されている階調データＰＬ
Ｏ〜７、ＰＨＯ〜７が出力され、次段のビクセル・マル
チプレクサ１４へと導かれる。
ビクセル・マルチプレクサ１４は、パレットＲＡＭから
出力される絵素のＯＮ１０　Ｆ　Ｆデータ（最大８ビツ
トのデータ）を表示パネルの拡大表示モード（ｅＸ、ｌ
ｘ、２ｘ、４ｘ）に応じて表示可能なビット数に変換す
る処理を行う。第６図は、ビクセル・マルチプレクサ１
４の変換モードを示している。例えば、表示パネルで２
倍（２×）拡大表示を行う場合、変換モードＢが選択さ
れる。このとき、１絵素当りの取り得る階調データ数は
４ビツトであるから、パレットＲＡＭ１２及び１３から
出力される８ビツトデータＰＬＯ〜７、ＰＨＯ〜７の内
、それぞれ下位４ビツト（ＰＬＯ〜３、ＰＨＯ〜３）の
みが抽出され、ＰＩＸＯ〜７として出力される。また、
変換モードＡ及びＣは、それぞれ４倍（４ｘ）、等倍（
１×）時の変換フォーマットを示している。
以上説明したように、ＶＲＡＭＥ内の絵素データ（色情
報）は、２つのマルチプレクサ１１及び１４とパレット
ＲＡＭによって、表示パネル上の階調データへと変換さ
れる。
（２）ボーダーレジスタ部 前述のように、液晶表示装置の有効絵素数〉表示モード
の解像度の場合、有効表示領域外の全絵素（ボーダ一部
）になんらかのパターンを表示させなければならない。
このボーダ一部に出力するデータを格納するために設け
られたのが、ボーダーレジスタ２である。第７図は、ボ
ーダーレジスタの構成を示している。本実施例では、ボ
ーダーレジスタは基本的には８ビツト長のレジスタ１木
からなり、各ビットがそれぞれボーダーデータＢＤＯ〜
７（第７図）に対応している。また、ボーダーレジスタ
２は、いわゆるダブルバッファの構成になっており、Ｇ
ＣＰＵ６からは任意のタイミングで書き換えができる。
実際のボーダーデータは、水平同期信号もしくは垂直同
期信号のタイミングでボーダーレジスタ出力段にセット
される。このボーダーレジスタ２に設定されたデータを
送出するタイミングを制御するのは水平及び垂直のブラ
ンク信号（ＨＢｌａｎｋ。
ＶＢｌａｎｋ）である。基本的には第８図に示すよう、
に、それぞれのブランク信号のいずれかがＬＯレベル（
ブランク期間内）にある時にボーダーデータが出力され
、それ以外の期間では有効表示領域内の画像データが出
力される。詳しくは、後述データセレクタの動作で説明
する。
（３）走査線アドレスデータ発生部 表示パネルの走査線アドレスデータＡＯ〜１５を発生さ
せるために設けられたのが、走査線アドレス発生部３で
ある。走査線アドレス発生部３は、液晶表示装置側のデ
イスプレィ・コントローラより入力される水平同期信号
Ｈｓｙｎｃをクロックとする１２ビツトのバイナリカウ
ンタ（走査線４０９６木まで選択可能）である。木カウ
ンタは、ＧＣＰＵ６からカウント値（走査線アドレスデ
ータ）を任意のタイミングでプリセットすることができ
る。さらに、カウントアツプの幅（何ろ 木飛び越し走査を行うか）も設定することがでピ４〒（
４）液晶表示装置への出力部 強訪電性液晶表示装置への画像データ転送フォーマット
は、すでに本出願人らが、特願昭６１−２１２１８４号
、あるいは特願昭６３−２８５１４１号などに於て、メ
モリー性を有する表示素子において高解像度表示を実現
するために通信方法に関して提案している。これら提案
によれば、画像データの転送に関して、書換えの必要の
走査線に対してその走査線アドレス情報と画像情報とを
同一伝送線上をシリアルに時分割転送する方式をとって
いる。
これら転送フォーマットを実現するために設けられたの
が、データセレクタ４である。データセレクタ４は、Ｇ
ＣＰＵ６からのタイミング制御信号に基づき、階調変換
済みの画像データＰＤＯ〜７、ボーダーデータＢＤＯ〜
７、走査線アドレスデータＡＯ〜１５の３種類のデータ
を時分割で切り替えて表示装置に送る。第９図は、前記
提案に準拠した形での本発明による画像情報出力回路で
あるデイスプレィインターフェイスからの転送フォーマ
ットの一例である。第９図において、水平ブランキング
信号ＨＢ１ａｎｋがＬＯレベル（ブランク期間内）の期
間において、水平同期信号Ｈｓｙｎｃが入力されると、
データセレクタ４はＧＣＰＵ６からのタイミング制御に
より、まず走査線アドレスデータＡＯ〜１５を２サイク
ル（４クロツク（ＣＬＫ））で出力する。次に、ＨＢｌ
ａｎｋがＨｉレベルになるまでの間ボーダーレジスタ２
からのボーダーデータＢＤＯ〜７を通信線ＰＩＸＯ〜７
にのせ続ける。ＨＢｌａｎｋがＨｉレベルになったら（
ブランク期間終了）、階調変換済みの有効表示領域内の
画像データＰＤ０〜７を通信線ＰＩＸＯ〜７にのせる。
第９図では、有効表示領域内の画像データとして１２８
０画素（６４０絵素）分の情報を転送すると、ＧＣＰＵ
６は再びＨＢｌａｎｋをＬｏレベルにする。
ＨＢｌａｎｋがＬＯレベルになったことで、データセレ
クタ１４は再びボーダーデータＢＤＯ〜７を通信線ＰＩ
ＸＯ〜７にのせ、全絵素分のデータ（１２８０絵素）の
転送を終了する。
尚、第９図は、水平走査方向の転送タイミングに関して
記しであるが、データセレクタ４は、垂直走査方向に関
しても同様に垂直ブランキング信号を使フてボーダーエ
リアと有効表示領域と区別し、出力データを切り替えて
いる。
さらに、ＨＢｌａｎｋ及びＶＢｌａｎｋのタイミングを
制御することにより、有効表示領域を画面上の任意の位
置に表示することも可能である。
〔発明の効果〕
以上説明した様に、双安定性（メモリー性）を有する強
訪電性液晶等を用いた表示装置において、画像メモリか
ら読みだされる画像データを１画素分毎に次段に導く第
一のマルチプレクサ、第一のマルチプレクサから出力さ
れるデータに基づき、予め定められた画素のＯＮ１０　
Ｆ　Ｆデータを出力するパレットＲＡＭ、さらにパレッ
トＲＡＭからのデータを表示装置に転送するための出力
フォーマットに変換する第二のマルチプレクサを有する
画像情報出力回路を設け、本体ＣＰＵからの表示モード
要求に応じて、画像データの変換処理及び有効表示領域
外（枠部）の処理を行うことにより、従来からのＣＲＴ
などで用いられてきた各種表示モードでの画面を、強誘
電性液晶表示装置などの２値化表示素子を用いた表示装
置上に破綻なく表示することが可能となる。
【図面の簡単な説明】
第１図は、本発明による画像情報出力回路の構成図。 第２図は、本発明による画像情報出力回路を含むグラフ
ィックスコントローラと強誘電性液晶表示パネルユニッ
トとの全体構成図。 第３図は、ビクセル・マルチプレクサ１１のデータ変換
フォーマットを示す図。 第４図は、パレットＲＡＭ内のパレットレジスタの階調
データと実際の表示パネルの絵素配置との関係を示す図
。 第５図は、ＶＲＡＭからの画像データとパレットレジス
タのアドレスとの関係を示す図。 第６図は、ピクセル・セレクタ１４のデータ変換フォー
マットを示す図。 第７図は、ボーダーレジスタの構成及びボーダーデータ
と表示パターンの一例を示す図。 第８図は、表示画面上のボーダ一部の位置と水平及び垂
直のブランキング信号との関係を示す図。 第９図は、本発明による画像情報出力回路からの転送フ
ォーマットの一例を示す図。 第１０図は、ＩＢＭ社のパーソナル・コンピュータにお
ける表示モードを示す図。 １・・・階調変換部 １１・・・マルチプレクサ １３・・・パレットＲＡＭ １４・・・マルチプレクサ １２・・・パレットＲＡＭ ビ２ｔル・マルチ２隻７丈 ｎ 吏ｆ奥ｆ己−ド （１） （ｂン とり仁）ｂ・マルチ７°し７丈Ｉ４ 灸湊 仁−ド （ＨＬＩ ＩＨ尺） （ＶＬＩ） （ＶＬ） ＨｏｒｉｚｏｎｔｅＬＩ　　Ｌｅｆｔ Ｈｏｉ＋ｚｏｎｔａｌ　　尺：１ｈｔ Ｖｅｒｔｒｒｃａｌ　　ＬＩｒｒｅｒ ｉ’ｅｒＤｉ（：ｉｆ　　ＬＯＷｅｒ

Claims (12)

    【特許請求の範囲】
  1. （１）メモリー性を有する液晶を使用した表示パネルを
    用い、画素数、表示色、最小画素単位等が異なる複数表
    示モードの画像データを表示可能な表示装置において、 画像データを記憶する記憶手段と、 前記記憶手段に記憶された画像データを画素データ毎に
    出力する画素データ出力手段と、前記画素データ出力手
    段により出力された画素データを前記表示パネルに表示
    する２値データに変換する変換手段と、 前記変換手段により変換された２値データを前記表示モ
    ードに対応した表示データに変換して出力する表示デー
    タ出力手段と、 前記表示データ出力手段により出力された画像データを
    前記表示パネルに表示する表示制御手段とを有する表示
    装置。
  2. （２）前記画素データ出力手段は、マルチプレクサであ
    ることを特徴とする請求項１記載の表示装置。
  3. （３）前記変換手段は、２値データを記憶したＲＡＭ（
    ランダムアクセスメモリー）であることを特徴とする請
    求項１記載の表示装置。
  4. （４）前記変換手段は、２値データを記憶した複数のＲ
    ＡＭ（ランダムアクセスメモリー）により構成されてい
    ることを特徴とする請求項１記載の表示装置。
  5. （５）前記表示パネルに表示された画像データの有効表
    示領域外に、所望の枠画像データを表示する枠表示手段
    を有することを特徴とする請求項１記載の表示装置。
  6. （６）前記枠表示手段は、有効表示領域外の枠画像デー
    タを有効表示領域に表示する画像データの水平及び垂直
    ブランキング期間内に出力して表示することを特徴とす
    る請求項５記載の表示装置。
  7. （７）前記表示データ出力手段は、マルチプレクサであ
    ることを特徴とする請求項１記載の表示装置。
  8. （８）前記メモリー性を有する液晶は強誘電性液晶であ
    ることを特徴とする請求項１記載の表示装置。
  9. （９）メモリー性を有する液晶を使用した表示パネルを
    用いた表示装置において、前記表示パネルの画像データ
    を表示する有効表示領域の外に、枠画像データを表示す
    る枠表示手段を有し、 当該枠表示手段は、画像データの水平及び垂直ブランキ
    ング期間内に枠画像データを出力して表示することを特
    徴とする表示装置。
  10. （１０）前記メモリー性を有する液晶は強誘電性液晶で
    あることを特徴とする請求項９記載の表示装置。
  11. （１１）前記枠表示手段は、前記有効表示領域外の枠画
    像データの設定を、画像データの１水平走査期間内又は
    １垂直表示期間内に行うことを特徴とする請求項９記載
    の表示装置。
  12. （１２）前記枠表示手段は、前記有効表示領域外に表示
    する枠画像データを記憶する記憶手段を更に有すること
    を特徴とする請求項９記載の表示装置。
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