JPH0155797B2 - - Google Patents
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- JPH0155797B2 JPH0155797B2 JP58021442A JP2144283A JPH0155797B2 JP H0155797 B2 JPH0155797 B2 JP H0155797B2 JP 58021442 A JP58021442 A JP 58021442A JP 2144283 A JP2144283 A JP 2144283A JP H0155797 B2 JPH0155797 B2 JP H0155797B2
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- 230000015572 biosynthetic process Effects 0.000 claims description 3
- 238000001514 detection method Methods 0.000 claims 2
- 238000000034 method Methods 0.000 description 8
- 239000013256 coordination polymer Substances 0.000 description 6
- 238000010586 diagram Methods 0.000 description 6
- 230000000630 rising effect Effects 0.000 description 3
- 239000003990 capacitor Substances 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 239000000284 extract Substances 0.000 description 1
- 230000001960 triggered effect Effects 0.000 description 1
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- Synchronizing For Television (AREA)
- Television Signal Processing For Recording (AREA)
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、VTRなどの磁気記録再生装置の疑
似垂直同期信号形成回路に関するものである。
似垂直同期信号形成回路に関するものである。
従来の回転ヘツド型VTRにおいて、標準の規
定テープ速度で記録したテープを、それとは異な
る一定速度、例えば標準速度の２倍あるいは標準
速度の1/2倍などの可変速で再生したり、又は、
テープ走行をストツプさせた、いわゆるスチル再
生等を行う場合、標準速度で記録形成された複数
個のトラツクをヘツドが斜めに横切つてトレース
することになり、再生出力のエンベローブ最小点
付近ではSN比が悪くなり、画面上にノイズバン
ドが生ずる。このノイズバンドが再生画面上に現
われないように、ノイズバンドを再生映像信号の
垂直ブランキング期間内に追込むようにトラツキ
ング調整する必要がある。
定テープ速度で記録したテープを、それとは異な
る一定速度、例えば標準速度の２倍あるいは標準
速度の1/2倍などの可変速で再生したり、又は、
テープ走行をストツプさせた、いわゆるスチル再
生等を行う場合、標準速度で記録形成された複数
個のトラツクをヘツドが斜めに横切つてトレース
することになり、再生出力のエンベローブ最小点
付近ではSN比が悪くなり、画面上にノイズバン
ドが生ずる。このノイズバンドが再生画面上に現
われないように、ノイズバンドを再生映像信号の
垂直ブランキング期間内に追込むようにトラツキ
ング調整する必要がある。
しかし、このため再生映像信号の垂直同期信号
がおかされて再生画像が垂直方向に動揺してしま
う問題があり、これを解決するために、フイール
ド毎にいわゆる疑似垂直同期信号を形成し、この
疑似垂直同期信号を再生映像信号に挿入すること
によつて、画像の動揺を補正する方法が一般に用
いられている。
がおかされて再生画像が垂直方向に動揺してしま
う問題があり、これを解決するために、フイール
ド毎にいわゆる疑似垂直同期信号を形成し、この
疑似垂直同期信号を再生映像信号に挿入すること
によつて、画像の動揺を補正する方法が一般に用
いられている。
この疑似垂直同期信号としては、倍速再生、ス
チル再生等においては、２フイールド周期で繰返
す２種類の信号が必要である。そして、この２種
類の疑似垂直同期信号（VDP）の形成方法とし
て、従来においては、第１図に示すように、ヘツ
ド切換信号（SW信号）の立上り、立下りからモ
ノマルチ回路等を用いてそれぞれ所定のパルス幅
P1，P2をもつ信号M1，M2を形成し、さらに、こ
の信号M1，M2をもとにして、パルス幅が各々、
P3，P4となる信号VDP１とVDP２を生成し、両
者を加え合せて、信号VDPとして形成していた
が、これらのVDPの位相とパルス幅（P1，P2，
P3，P4）は、すべて、アナログ的に、モノマル
チ回路の外付け時定数回路を調整して形成してい
た。
チル再生等においては、２フイールド周期で繰返
す２種類の信号が必要である。そして、この２種
類の疑似垂直同期信号（VDP）の形成方法とし
て、従来においては、第１図に示すように、ヘツ
ド切換信号（SW信号）の立上り、立下りからモ
ノマルチ回路等を用いてそれぞれ所定のパルス幅
P1，P2をもつ信号M1，M2を形成し、さらに、こ
の信号M1，M2をもとにして、パルス幅が各々、
P3，P4となる信号VDP１とVDP２を生成し、両
者を加え合せて、信号VDPとして形成していた
が、これらのVDPの位相とパルス幅（P1，P2，
P3，P4）は、すべて、アナログ的に、モノマル
チ回路の外付け時定数回路を調整して形成してい
た。
このため、従来の疑似垂直同期信号形成回路に
おいては、調整箇所が多く、部品点数も多く、ま
た、すべてアナログ的な調整であるため、経時変
化の影響を受け易いといつた欠点を有していた。
おいては、調整箇所が多く、部品点数も多く、ま
た、すべてアナログ的な調整であるため、経時変
化の影響を受け易いといつた欠点を有していた。
本発明の目的は、上記した問題点に鑑み調整箇
所および部品点数を減らし、経時的にも安定し
た、疑似垂直同期信号形成回路を提供することに
ある。
所および部品点数を減らし、経時的にも安定し
た、疑似垂直同期信号形成回路を提供することに
ある。
上記目的を達成するために、本発明はヘツド切
換信号をデイジタル的に形成し、疑似垂直同期信
号を上記ヘツド切換信号を形成するためのカウン
タを兼用して、そのヘツド切換信号から所定の位
相だけ遅延し、所定のパルス幅を有するように、
デイジタル的に生成するものである。
換信号をデイジタル的に形成し、疑似垂直同期信
号を上記ヘツド切換信号を形成するためのカウン
タを兼用して、そのヘツド切換信号から所定の位
相だけ遅延し、所定のパルス幅を有するように、
デイジタル的に生成するものである。
以下、本発明の一実施例をスチル再生時の疑似
垂直同期信号形成回路について説明する。第２図
は本発明に係わる、ヘツド切換信号形成回路とそ
れに基づくスチル再生時の疑似垂直同期信号形成
回路を示す図であり、第３図はその各部波形を示
す図である。上記ヘツド切換信号は、回転２ヘツ
ド形VTRにおいて、２つのヘツドからの再生信
号をフイールド毎に交互に切換えて一つに連続す
る信号に変換するための信号で、その繰返し周波
数はヘツド走査周波数（映像信号のフレーム周波
数）に等しく、デユーデイ比50％の信号である。
垂直同期信号形成回路について説明する。第２図
は本発明に係わる、ヘツド切換信号形成回路とそ
れに基づくスチル再生時の疑似垂直同期信号形成
回路を示す図であり、第３図はその各部波形を示
す図である。上記ヘツド切換信号は、回転２ヘツ
ド形VTRにおいて、２つのヘツドからの再生信
号をフイールド毎に交互に切換えて一つに連続す
る信号に変換するための信号で、その繰返し周波
数はヘツド走査周波数（映像信号のフレーム周波
数）に等しく、デユーデイ比50％の信号である。
第２図において、１はクロツクパルスCPの入
力端子である。２は、後述のSWカウンタ５が計
数開始するきつかけを与える信号Shの入力端子
を示す。この信号Shは、２つのヘツドのいずれ
か一方のヘツドの回転位相を表わす信号で、図示
しないが、そのヘツドの回転に同期して検出され
た信号より生成されて端子２に供給される。３は
ANDゲートであり、後述のRSフリツプフロツプ
９の出力Q1が“Ｈ”の間、クロツクCPをSWカ
ウンタ５に供給する。該SWカウンタ５は前述し
た如くヘツド切換信号（SW信号）を形成するた
めのカウンタである。
力端子である。２は、後述のSWカウンタ５が計
数開始するきつかけを与える信号Shの入力端子
を示す。この信号Shは、２つのヘツドのいずれ
か一方のヘツドの回転位相を表わす信号で、図示
しないが、そのヘツドの回転に同期して検出され
た信号より生成されて端子２に供給される。３は
ANDゲートであり、後述のRSフリツプフロツプ
９の出力Q1が“Ｈ”の間、クロツクCPをSWカ
ウンタ５に供給する。該SWカウンタ５は前述し
た如くヘツド切換信号（SW信号）を形成するた
めのカウンタである。
６，７，８は各々デコーダを示し、SWカウン
タ５の計数値がN1になつた時デコーダ６が、N2
になつた時デコーダ７が、N3になつた時デコー
ダ８が各々“Ｈ”を出力する。ここでN1＜N2＜
N3である。９，１０，１１，１２は各々RSフリ
ツプフロツプを示す。RSフリツプフロツプ９は、
信号Shでセツトされ、後述のANDゲート１５か
らの“Ｈ”出力でリセツトされ、そのQ1出力に
よりゲート３を介して、SWカウンタ５へのクロ
ツク供給を制御する。RSフリツプフロツプ１０
は、前述のSh信号でセツトされ、前記デコーダ
８からの“Ｈ”出力でリセツトされ、そのQ2出
力であるSW信号は、後述のモノマルチ回路１６
及びANDゲート１３，１４に入力され、また2
出力は、ANDゲート１５に入力される。
タ５の計数値がN1になつた時デコーダ６が、N2
になつた時デコーダ７が、N3になつた時デコー
ダ８が各々“Ｈ”を出力する。ここでN1＜N2＜
N3である。９，１０，１１，１２は各々RSフリ
ツプフロツプを示す。RSフリツプフロツプ９は、
信号Shでセツトされ、後述のANDゲート１５か
らの“Ｈ”出力でリセツトされ、そのQ1出力に
よりゲート３を介して、SWカウンタ５へのクロ
ツク供給を制御する。RSフリツプフロツプ１０
は、前述のSh信号でセツトされ、前記デコーダ
８からの“Ｈ”出力でリセツトされ、そのQ2出
力であるSW信号は、後述のモノマルチ回路１６
及びANDゲート１３，１４に入力され、また2
出力は、ANDゲート１５に入力される。
ANDゲート１３は前記SW信号が“Ｈ”でか
つ、デコーダ６が“Ｈ”を出力した時、“Ｈ”を
出力し、RSフリツプフロツプ１１をセツトする。
また、ANDゲート１４は、前記SW信号が“Ｈ”
かつ、デコーダ７が“Ｈ”を出力した時、“Ｈ”
を出力し、RSフリツプフロツプ１１をリセツト
する。RSフリツプフロツプ１１のQ3出力は、本
発明に係わる所の２種類の疑似垂直同期信号の一
方である、SW信号に対して固定遅延位相を有す
る第１の疑似垂直同期信号VDP１を生成する。
RSフリツプフロツプ１２は、デコーダ８が“Ｈ”
になつた時セツトされ、ANDゲート１５の“Ｈ”
出力でリセツトされる。ANDゲート１５は、前
述のRSフリツプフロツプ１０の2出力が“Ｈ”
かつデコーダ７が“Ｈ”になつた時、“Ｈ”を出
力する。
つ、デコーダ６が“Ｈ”を出力した時、“Ｈ”を
出力し、RSフリツプフロツプ１１をセツトする。
また、ANDゲート１４は、前記SW信号が“Ｈ”
かつ、デコーダ７が“Ｈ”を出力した時、“Ｈ”
を出力し、RSフリツプフロツプ１１をリセツト
する。RSフリツプフロツプ１１のQ3出力は、本
発明に係わる所の２種類の疑似垂直同期信号の一
方である、SW信号に対して固定遅延位相を有す
る第１の疑似垂直同期信号VDP１を生成する。
RSフリツプフロツプ１２は、デコーダ８が“Ｈ”
になつた時セツトされ、ANDゲート１５の“Ｈ”
出力でリセツトされる。ANDゲート１５は、前
述のRSフリツプフロツプ１０の2出力が“Ｈ”
かつデコーダ７が“Ｈ”になつた時、“Ｈ”を出
力する。
４はORゲートであり、デコーダ８又はANDゲ
ート１５の出力が“Ｈ”の時SWカウンタ５をリ
セツトする。１６はモノマルチ回路を示し、２０
は可変抵抗器、２１はコンデンサであり、両者の
定数で定まる時定数で、後述のようにSW信号を
もとにして、ワンシヨツトパルスのパルス幅を定
めて該ワンシヨツトパルスQMを出力する１７は
インバータであり、前記モノマルチ回路１６の出
力QMの極性を反転させる。１８はANDゲートで
あり、前記インバータ１７の出力と、RSフリツ
プフロツプ１２のQ4出力とも“Ｈ”の時、“Ｈ”
を出力する。この出力信号が本発明に係わる疑似
垂直同期信号のもう一つの成分である、SW信号
に対して可変遅延位相を有する第２の疑似垂直同
期信号VDP２である。以上説明した、２種類の
疑似垂直同期信号である、VDP１，VDP２は
OR回路１９を介し、VDPとして出力端子２２に
出力される。
ート１５の出力が“Ｈ”の時SWカウンタ５をリ
セツトする。１６はモノマルチ回路を示し、２０
は可変抵抗器、２１はコンデンサであり、両者の
定数で定まる時定数で、後述のようにSW信号を
もとにして、ワンシヨツトパルスのパルス幅を定
めて該ワンシヨツトパルスQMを出力する１７は
インバータであり、前記モノマルチ回路１６の出
力QMの極性を反転させる。１８はANDゲートで
あり、前記インバータ１７の出力と、RSフリツ
プフロツプ１２のQ4出力とも“Ｈ”の時、“Ｈ”
を出力する。この出力信号が本発明に係わる疑似
垂直同期信号のもう一つの成分である、SW信号
に対して可変遅延位相を有する第２の疑似垂直同
期信号VDP２である。以上説明した、２種類の
疑似垂直同期信号である、VDP１，VDP２は
OR回路１９を介し、VDPとして出力端子２２に
出力される。
以上述べた、本発明のスチル再生時の疑似垂直
同期信号形成回路について、第３図の各部波形図
を用いて本発明の特徴とする疑似垂直同期信号形
成過程を詳細に説明する。
同期信号形成回路について、第３図の各部波形図
を用いて本発明の特徴とする疑似垂直同期信号形
成過程を詳細に説明する。
まず、第３図に示すように、信号Shの到来に
より、RSフリツプフロツプ９はセツトされ、そ
の出力Q1が“Ｈ”になる。それと同時にクロツ
クCPがゲート３を介して、SWカウンタ５に入力
され、該カウンタはクロツクの計数を開始する。
また、前記信号Shにより、RSフリツプフロツプ
１０はセツトされ、そのQ2出力（SW信号）は
“Ｈ”となる。
より、RSフリツプフロツプ９はセツトされ、そ
の出力Q1が“Ｈ”になる。それと同時にクロツ
クCPがゲート３を介して、SWカウンタ５に入力
され、該カウンタはクロツクの計数を開始する。
また、前記信号Shにより、RSフリツプフロツプ
１０はセツトされ、そのQ2出力（SW信号）は
“Ｈ”となる。
SWカウンタ５の計数値がN1になつた時、デコ
ーダ６は“Ｈ”を出力する。この時RSフリツプ
フロツプ１０のQ2出力は“Ｈ”となつているか
ら、前記デコーダ６の“Ｈ”出力はゲート１３を
介してRSフリツプフロツプ１１をセツトし、そ
のQ3出力（VDP１）を“Ｌ”から“Ｈ”にする。
次に、SWカウンタ５の計数値がN2になつた時
（N2＞N1）デコーダ７が“Ｈ”を出力する。こ
の時、前記SW信号は“Ｈ”であるから、このデ
コーダ７の“Ｈ”出力は、ゲート１４を介して、
RSフリツプフロツプ１１をリセツトし、そのQ3
出力は、“Ｈ”から“Ｌ”になり、その波形は第
３図に示すごとく、SWカウンタ５の計数値がN1
からN2の期間（ここで、計数値が０かなN1まで
の時間をW1、０からN2までの時間をW2とする）
“Ｈ”となるパルス幅W2−W1の信号となる。該
信号VDP１が、本発明に係わる、２種類の疑似
垂直同期信号の一方で、SW信号の立上りから固
定の位相遅延（時間幅W1）を有し、また固定パ
ルス幅（W2−W1）となるように、SWカウンタ
５からデイジタル的に形成されたものである。
ーダ６は“Ｈ”を出力する。この時RSフリツプ
フロツプ１０のQ2出力は“Ｈ”となつているか
ら、前記デコーダ６の“Ｈ”出力はゲート１３を
介してRSフリツプフロツプ１１をセツトし、そ
のQ3出力（VDP１）を“Ｌ”から“Ｈ”にする。
次に、SWカウンタ５の計数値がN2になつた時
（N2＞N1）デコーダ７が“Ｈ”を出力する。こ
の時、前記SW信号は“Ｈ”であるから、このデ
コーダ７の“Ｈ”出力は、ゲート１４を介して、
RSフリツプフロツプ１１をリセツトし、そのQ3
出力は、“Ｈ”から“Ｌ”になり、その波形は第
３図に示すごとく、SWカウンタ５の計数値がN1
からN2の期間（ここで、計数値が０かなN1まで
の時間をW1、０からN2までの時間をW2とする）
“Ｈ”となるパルス幅W2−W1の信号となる。該
信号VDP１が、本発明に係わる、２種類の疑似
垂直同期信号の一方で、SW信号の立上りから固
定の位相遅延（時間幅W1）を有し、また固定パ
ルス幅（W2−W1）となるように、SWカウンタ
５からデイジタル的に形成されたものである。
次にSWカウンタ５がクロツクCPの計数を続け
てその計数値がN3（N3＞N2）になつた時、デコ
ーダ８が“Ｈ”を出力すると、RSフリツプフロ
ツプ１０をリセツトし、かつRSフリツプフロツ
プ１２をセツトする。これと同時に、デコーダ８
の“Ｈ”出力がゲート４を介して、SWカウンタ
５をリセツトする。したがつて、RSフリツプフ
ロツプ１０のQ2出力（SW信号）は“Ｌ”とな
り、かつ、RSフリツプフロツプ１２のQ4出力は
“Ｌ”から“Ｈ”になる。このように、SW信号
はSh信号が到来して、SWカウンタ５の計数が開
始され、計数値N3に至る期間だけ“Ｈ”となる。
てその計数値がN3（N3＞N2）になつた時、デコ
ーダ８が“Ｈ”を出力すると、RSフリツプフロ
ツプ１０をリセツトし、かつRSフリツプフロツ
プ１２をセツトする。これと同時に、デコーダ８
の“Ｈ”出力がゲート４を介して、SWカウンタ
５をリセツトする。したがつて、RSフリツプフ
ロツプ１０のQ2出力（SW信号）は“Ｌ”とな
り、かつ、RSフリツプフロツプ１２のQ4出力は
“Ｌ”から“Ｈ”になる。このように、SW信号
はSh信号が到来して、SWカウンタ５の計数が開
始され、計数値N3に至る期間だけ“Ｈ”となる。
モノマルチ回路１６は、前述のSW信号の立下
りをトリガーとして、可変抵抗器２０とコンデン
サ２１で定まる時定数に対応したパルス幅W4を
有する、ワンシヨツトパルスQMを発生する。
りをトリガーとして、可変抵抗器２０とコンデン
サ２１で定まる時定数に対応したパルス幅W4を
有する、ワンシヨツトパルスQMを発生する。
ところで、SWカウンタ５は前述したごとくデ
コーダN3が“Ｈ”を出力したのちにリセツトさ
れるが、その後、続いて、クロツクCPの計数を
続ける。そして、その計数値が再びN1になつた
時、デコーダ６の出力は“Ｈ”となるが、この時
SW信号は既に“Ｌ”になつているので、RSフリ
ツプフロツプ１１はセツトされず、そのQ3出力
即ちVDP１はは“Ｌ”のままである。続いて、
SWカウンタ５が計数を続け計数値がN2になつた
時、デコーダ７の出力が“Ｈ”となるが、この
時、SW信号は“Ｌ”即ちRSフリツプフロツプ１
０の2出力は“Ｈ”であるから、ゲート１５を
介して、RSフリツプフロツプ１２はリセツトさ
れ、その出力Q4は、“Ｈ”から“Ｌ”になる。即
ちQ4は、SWカウンタ５の計数値N2に対応した
時間幅W2のパルス幅をもつ信号となる。
コーダN3が“Ｈ”を出力したのちにリセツトさ
れるが、その後、続いて、クロツクCPの計数を
続ける。そして、その計数値が再びN1になつた
時、デコーダ６の出力は“Ｈ”となるが、この時
SW信号は既に“Ｌ”になつているので、RSフリ
ツプフロツプ１１はセツトされず、そのQ3出力
即ちVDP１はは“Ｌ”のままである。続いて、
SWカウンタ５が計数を続け計数値がN2になつた
時、デコーダ７の出力が“Ｈ”となるが、この
時、SW信号は“Ｌ”即ちRSフリツプフロツプ１
０の2出力は“Ｈ”であるから、ゲート１５を
介して、RSフリツプフロツプ１２はリセツトさ
れ、その出力Q4は、“Ｈ”から“Ｌ”になる。即
ちQ4は、SWカウンタ５の計数値N2に対応した
時間幅W2のパルス幅をもつ信号となる。
ここで、前述した如く、SWカウンタ５の計数
値がN2になり、ANDゲート１５が“Ｈ”になつ
た時、その“Ｈ”出力で、ORゲート４を介して
SWカウンタ５はリセツトされると同時に、RSフ
リツプフロツプ９はリセツトされ、そのQ1出力
は“Ｌ”となるので、クロツクCPはANDゲート
３でゲートされ、SWカウンタ５に入力されなく
なる。したがつて、SWカウンタ５は計数内容が
０の状態で計数動作を停止する。このように、
SWカウンタ５の計数動作はSh信号が到来してか
ら、計数値が、０→N1→N2→N3→0N1→N2→０
と、カウンタが計数値N2を２回目に計数した時
に停止する。そして、再び信号Shが到来してか
ら、また計数を開始する。
値がN2になり、ANDゲート１５が“Ｈ”になつ
た時、その“Ｈ”出力で、ORゲート４を介して
SWカウンタ５はリセツトされると同時に、RSフ
リツプフロツプ９はリセツトされ、そのQ1出力
は“Ｌ”となるので、クロツクCPはANDゲート
３でゲートされ、SWカウンタ５に入力されなく
なる。したがつて、SWカウンタ５は計数内容が
０の状態で計数動作を停止する。このように、
SWカウンタ５の計数動作はSh信号が到来してか
ら、計数値が、０→N1→N2→N3→0N1→N2→０
と、カウンタが計数値N2を２回目に計数した時
に停止する。そして、再び信号Shが到来してか
ら、また計数を開始する。
２種類の疑似垂直同期信号のもう一方のVDP
２は前述した、パルス幅W4のQM信号をインバー
タ１７で反転した信号と、RSフリツプフロツプ
１２の出力Q4信号とを、ANDゲート１８へ入力
し、その出力から得られる。そのパルス幅は、第
３図に示す如く、モノマルチ回路１６により、可
変抵抗器２０の抵抗を可変して、SW信号の立下
りからの位相の遅延量W4を調整して、W2−W4
の値になる。
２は前述した、パルス幅W4のQM信号をインバー
タ１７で反転した信号と、RSフリツプフロツプ
１２の出力Q4信号とを、ANDゲート１８へ入力
し、その出力から得られる。そのパルス幅は、第
３図に示す如く、モノマルチ回路１６により、可
変抵抗器２０の抵抗を可変して、SW信号の立下
りからの位相の遅延量W4を調整して、W2−W4
の値になる。
以上、その形成過程を説明した、２種類の疑似
垂直同期信号VDP１，VDP２はORゲート１９
を介して、出力端子２２に出力される。また、こ
の疑似垂直同期信号の位置とそのパルス幅は、一
例として、記録時の垂直同期信号の記録位置を、
SW信号から6Hの位置とした時、VDP１は、SW
信号を基準にして、記録垂直同期信号の位置より
先行して、概ねその固定位相W1として3H、パル
ス幅W2−W1は6Hに選ばれる。VDP２も、Ｈ並
びにより若干異なるが、ほぼVDP１に等しい値
になる。
垂直同期信号VDP１，VDP２はORゲート１９
を介して、出力端子２２に出力される。また、こ
の疑似垂直同期信号の位置とそのパルス幅は、一
例として、記録時の垂直同期信号の記録位置を、
SW信号から6Hの位置とした時、VDP１は、SW
信号を基準にして、記録垂直同期信号の位置より
先行して、概ねその固定位相W1として3H、パル
ス幅W2−W1は6Hに選ばれる。VDP２も、Ｈ並
びにより若干異なるが、ほぼVDP１に等しい値
になる。
以上説明したごとく、本発明のスチル再生時に
おける２フイールド周期で繰返す２種類の疑似垂
直同期信号の形成法の特徴としては、第１の疑似
垂直同期信号VDP１をSW信号の立上りエツジか
らW1の時間だけ固定遅延し、パルス幅がW2−
W1となるように、SWカウンタ５よりデイジタル
的に形成し、また、第２の疑似垂直同期信号
VDP２は、SW信号の立下りエツジから、モノマ
ルチ回路１６により、所定の位相だけ遅延（時間
幅W4）し、パルス幅W2−W4の信号とすること
である。尚、本実施例では、スチル再生時の疑似
垂直同期信号形成法を述べたが、同じ２フイール
ド周期で繰返す２種類の疑似垂直同期信号を必要
とする、倍速再生や高速再生モードでも、同様の
方法が可能である。さらに、４フイールド周期で
繰返す４種類の疑似垂直同期信号が必要な、標準
速の1/2倍速再生モードでも、そのうちの一つは、
実施例で示した、固定遅延を有するVDP１のよ
うに、デイジタル的に生成し、他の３つは、実施
例で示した、VDP２のように、３つのモノマル
チ回路で、位相調整して生成することによつて、
同様な形成方法が可能である。
おける２フイールド周期で繰返す２種類の疑似垂
直同期信号の形成法の特徴としては、第１の疑似
垂直同期信号VDP１をSW信号の立上りエツジか
らW1の時間だけ固定遅延し、パルス幅がW2−
W1となるように、SWカウンタ５よりデイジタル
的に形成し、また、第２の疑似垂直同期信号
VDP２は、SW信号の立下りエツジから、モノマ
ルチ回路１６により、所定の位相だけ遅延（時間
幅W4）し、パルス幅W2−W4の信号とすること
である。尚、本実施例では、スチル再生時の疑似
垂直同期信号形成法を述べたが、同じ２フイール
ド周期で繰返す２種類の疑似垂直同期信号を必要
とする、倍速再生や高速再生モードでも、同様の
方法が可能である。さらに、４フイールド周期で
繰返す４種類の疑似垂直同期信号が必要な、標準
速の1/2倍速再生モードでも、そのうちの一つは、
実施例で示した、固定遅延を有するVDP１のよ
うに、デイジタル的に生成し、他の３つは、実施
例で示した、VDP２のように、３つのモノマル
チ回路で、位相調整して生成することによつて、
同様な形成方法が可能である。
以上説明したように、本発明によれば、可変速
再生時に必要な複数個の疑似垂直同期信号をデイ
ジタル的に生成できるので、従来、すべてモノマ
ルチ等によりアナログ的に位相調整して形成して
いた方法に比較して調整箇所が減り、信頼性が向
上する。
再生時に必要な複数個の疑似垂直同期信号をデイ
ジタル的に生成できるので、従来、すべてモノマ
ルチ等によりアナログ的に位相調整して形成して
いた方法に比較して調整箇所が減り、信頼性が向
上する。
また、本回路をIC化した場合、外回路部品、
ピン数等も低減でき、部品の小形化、コスト低減
にも効果がある。
ピン数等も低減でき、部品の小形化、コスト低減
にも効果がある。
第１図は従来の疑似垂直同期信号形成回路によ
る動作を説明する波形図、第２図は本発明によ
る、スチル再生時の疑似垂直同期信号形成回路の
一実施例を示すブロツク図、第３図はその各部波
形図である。 ５……SWカウンタ、６，７，８……デコー
ダ、９，１０，１１，１２……RSフリツプフロ
ツプ。
る動作を説明する波形図、第２図は本発明によ
る、スチル再生時の疑似垂直同期信号形成回路の
一実施例を示すブロツク図、第３図はその各部波
形図である。 ５……SWカウンタ、６，７，８……デコー
ダ、９，１０，１１，１２……RSフリツプフロ
ツプ。
Claims (1)
- １ テープを移動し、移動するテープ上に回転磁
気ヘツドにより映像信号を記録し、映像信号を記
録した際のテープの移動速度と異なる移動速度で
テープを移動して、テープから映像信号を再生す
るとともに、疑似同期信号を発生する発生手段
と、再生された映像信号に疑似同期信号を挿入す
る挿入手段とを備えた回転磁気ヘツド形VTRに
おいて、回転磁気ヘツドの回転に同期して検出さ
れた検出信号が入力され、検出信号をもとにクロ
ツクパルスの計数を開始するカウンタと、このカ
ウンタのそれぞれ異なる計数値をデコードする第
１、第２、第３のデコーダと、上記カウンタが計
数を開始した後、第１のデコーダの出力信号によ
つて第１の疑似垂直同期信号の前縁を形成する第
１の形成手段と、第２のデコーダの出力信号によ
つて、第１の疑似垂直同期信号の後縁を形成する
第２の形成手段と、第３のデコーダの出力信号に
よつて、上記カウンタをリセツトするリセツト手
段と、第３のデコーダの出力信号によつてトリガ
され、第３のデコーダの出力信号に同期した所定
幅のパルスを形成する単安定マルチ回路と、単安
定マルチ回路の出力信号の後縁をもとに、第２の
疑似垂直同期信号の前縁を形成する第３の形成手
段と、第２のデコーダの出力信号をもとに第２の
疑似垂直同期信号の後縁を形成する第４の形成手
段と、第１、第２の疑似同期信号を加算する加算
手段と、上記単安定マルチ回路の遅延時間を変化
し、第２の疑似垂直同期信号の前縁の位相を調整
する調整手段とを備えていることを特徴とする疑
似垂直同期信号形成回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58021442A JPS59147573A (ja) | 1983-02-14 | 1983-02-14 | 疑似垂直同期信号形成回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58021442A JPS59147573A (ja) | 1983-02-14 | 1983-02-14 | 疑似垂直同期信号形成回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59147573A JPS59147573A (ja) | 1984-08-23 |
| JPH0155797B2 true JPH0155797B2 (ja) | 1989-11-27 |
Family
ID=12055076
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58021442A Granted JPS59147573A (ja) | 1983-02-14 | 1983-02-14 | 疑似垂直同期信号形成回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59147573A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61281688A (ja) * | 1985-06-06 | 1986-12-12 | Victor Co Of Japan Ltd | 磁気記録再生装置の疑似垂直同期信号生成方法及び疑似垂直同期信号生成回路 |
| JPH0822050B2 (ja) * | 1985-08-21 | 1996-03-04 | キヤノン株式会社 | ビデオ信号再生装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5696581A (en) * | 1979-12-29 | 1981-08-04 | Sony Corp | Generating circuit for vertical blanking signal and virtual vertical synchronizing signal |
-
1983
- 1983-02-14 JP JP58021442A patent/JPS59147573A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5696581A (en) * | 1979-12-29 | 1981-08-04 | Sony Corp | Generating circuit for vertical blanking signal and virtual vertical synchronizing signal |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59147573A (ja) | 1984-08-23 |
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