JP7415735B2 - Manufacturing method for semiconductor packages - Google Patents
Manufacturing method for semiconductor packages Download PDFInfo
- Publication number
- JP7415735B2 JP7415735B2 JP2020058788A JP2020058788A JP7415735B2 JP 7415735 B2 JP7415735 B2 JP 7415735B2 JP 2020058788 A JP2020058788 A JP 2020058788A JP 2020058788 A JP2020058788 A JP 2020058788A JP 7415735 B2 JP7415735 B2 JP 7415735B2
- Authority
- JP
- Japan
- Prior art keywords
- film
- semiconductor
- semiconductor packages
- semiconductor package
- stretchable film
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 239000004065 semiconductor Substances 0.000 title claims description 129
- 238000004519 manufacturing process Methods 0.000 title claims description 19
- 239000010410 layer Substances 0.000 claims description 55
- 238000000034 method Methods 0.000 claims description 25
- 239000002313 adhesive film Substances 0.000 claims description 22
- 239000002346 layers by function Substances 0.000 claims description 17
- 238000004544 sputter deposition Methods 0.000 claims description 12
- 238000007740 vapor deposition Methods 0.000 claims description 11
- 239000000853 adhesive Substances 0.000 claims description 7
- 230000001070 adhesive effect Effects 0.000 claims description 7
- 229910052751 metal Inorganic materials 0.000 claims description 6
- 239000003566 sealing material Substances 0.000 claims description 6
- 239000002184 metal Substances 0.000 claims description 4
- 239000012790 adhesive layer Substances 0.000 description 11
- 238000007789 sealing Methods 0.000 description 10
- 239000000463 material Substances 0.000 description 5
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 3
- 239000004020 conductor Substances 0.000 description 3
- 229910052802 copper Inorganic materials 0.000 description 3
- 239000010949 copper Substances 0.000 description 3
- PXHVJJICTQNCMI-UHFFFAOYSA-N nickel Substances [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 3
- 229920001721 polyimide Polymers 0.000 description 3
- VYZAMTAEIAYCRO-UHFFFAOYSA-N Chromium Chemical compound [Cr] VYZAMTAEIAYCRO-UHFFFAOYSA-N 0.000 description 2
- 229910052804 chromium Inorganic materials 0.000 description 2
- 239000011651 chromium Substances 0.000 description 2
- 238000010438 heat treatment Methods 0.000 description 2
- 239000002985 plastic film Substances 0.000 description 2
- 229920006255 plastic film Polymers 0.000 description 2
- 238000003825 pressing Methods 0.000 description 2
- 229910000679 solder Inorganic materials 0.000 description 2
- 229920002799 BoPET Polymers 0.000 description 1
- 229920001328 Polyvinylidene chloride Polymers 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 238000000748 compression moulding Methods 0.000 description 1
- 238000005520 cutting process Methods 0.000 description 1
- 239000000428 dust Substances 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000007772 electroless plating Methods 0.000 description 1
- 238000009713 electroplating Methods 0.000 description 1
- 230000017525 heat dissipation Effects 0.000 description 1
- 230000001771 impaired effect Effects 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 230000001678 irradiating effect Effects 0.000 description 1
- 238000010030 laminating Methods 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 229910052759 nickel Inorganic materials 0.000 description 1
- 239000005033 polyvinylidene chloride Substances 0.000 description 1
- 238000007639 printing Methods 0.000 description 1
- 239000011241 protective layer Substances 0.000 description 1
- 239000011342 resin composition Substances 0.000 description 1
- 238000007650 screen-printing Methods 0.000 description 1
- 239000002356 single layer Substances 0.000 description 1
- 239000007921 spray Substances 0.000 description 1
- 229920001187 thermosetting polymer Polymers 0.000 description 1
- 238000001721 transfer moulding Methods 0.000 description 1
Images
Landscapes
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
- Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)
- Dicing (AREA)
Description
本開示は半導体パッケージの製造方法に関し、より詳しくは、表面の少なくとも一部に機能層(例えば、電磁波シールド層)を有する半導体パッケージの製造方法に関する。 The present disclosure relates to a method for manufacturing a semiconductor package, and more particularly, to a method for manufacturing a semiconductor package having a functional layer (eg, an electromagnetic shielding layer) on at least a portion of the surface.
近年、半導体パッケージの小型化、高機能化、高集積化に伴い、半導体チップの多ピン化、高密度化、配線の狭ピッチ化が進展している。その結果、インピーダンスの増加又は信号ライン間の信号干渉に起因して半導体パッケージの本来の性能が阻害される傾向にある。特許文献1は、接着剤層と、電磁波シールド層とを有する半導体装置用接着フィルムを開示している。この半導体装置用接着フィルムは、接着剤層の表面上に、スパッタ法又は蒸着法によって電磁波シールド層を形成する工程を経て作製される。
In recent years, with the miniaturization, higher functionality, and higher integration of semiconductor packages, the number of pins in semiconductor chips has increased, the density has increased, and the pitch of wiring has become narrower. As a result, the inherent performance of the semiconductor package tends to be impaired due to increased impedance or signal interference between signal lines.
本発明者らは、半導体パッケージの表面に電磁波シールド層のような機能層を直接的に形成することによって、かかる機能を半導体パッケージに付与することを検討した。本開示は、表面の少なくとも一部が機能層で覆われている半導体パッケージを効率的に製造する方法を提供する。 The present inventors have considered providing such a function to a semiconductor package by directly forming a functional layer such as an electromagnetic shielding layer on the surface of the semiconductor package. The present disclosure provides a method for efficiently manufacturing a semiconductor package in which at least a portion of the surface is covered with a functional layer.
本開示に係る半導体パッケージの製造方法は以下の工程を含む。
(A)延伸性フィルムと、延伸性フィルムの表面上に互いに離間した状態で配置された複数の半導体パッケージとを備える被処理体を準備する工程。
(B)延伸性フィルムに張力を付与することにより、隣接する二つの半導体パッケージの間隔を拡大する工程。
(C)延伸性フィルムに張力を付与した状態で、複数の半導体パッケージの回路面を覆うように仮固定フィルムを貼る工程。
(D)複数の半導体パッケージから延伸性フィルムを剥離する工程。
(E)延伸性フィルムの剥離によって露出した、複数の半導体パッケージの表面上に機能層を形成する工程。
A method for manufacturing a semiconductor package according to the present disclosure includes the following steps.
(A) A step of preparing a processing object including a stretchable film and a plurality of semiconductor packages arranged on the surface of the stretchable film so as to be spaced apart from each other.
(B) A step of increasing the distance between two adjacent semiconductor packages by applying tension to the stretchable film.
(C) A step of applying a temporary fixing film to cover the circuit surfaces of a plurality of semiconductor packages while applying tension to the stretchable film.
(D) A step of peeling the stretchable film from the plurality of semiconductor packages.
(E) A step of forming a functional layer on the surfaces of the plurality of semiconductor packages exposed by peeling off the stretchable film.
上記製造方法によれば、(C)工程において、隣接する二つの半導体パッケージの間隔が拡大された状態で複数の半導体パッケージが仮固定フィルムに貼り付けられるため、(E)工程において、例えば、スパッタリング又は蒸着によって、半導体パッケージの側面にも所望の厚さの機能層を形成することができる。これに加え、(E)工程において、回路面が仮固定フィルムで覆われている半導体パッケージに対して機能層が形成されるため、機能層を構成する材料が半導体パッケージの回路面に回り込むことを抑制できる。機能層は、例えば、電磁波シールド層(金属層)である。 According to the above manufacturing method, in the step (C), a plurality of semiconductor packages are attached to the temporary fixing film with the gap between two adjacent semiconductor packages expanded, so in the step (E), for example, sputtering Alternatively, a functional layer with a desired thickness can be formed on the side surface of the semiconductor package by vapor deposition. In addition, in step (E), the functional layer is formed on the semiconductor package whose circuit surface is covered with a temporary fixing film, so the material constituting the functional layer is prevented from getting around to the circuit surface of the semiconductor package. It can be suppressed. The functional layer is, for example, an electromagnetic shielding layer (metal layer).
(A)工程は、(a1)複数の半導体チップと、複数の半導体チップを封止している封止材とを備えるパネル部材の第一の表面に対して延伸性フィルムを貼ることと、(a2)延伸性フィルム上のパネル部材を複数の半導体パッケージに個片化することとを含んでもよい。ここでいうパネル部材は、複数の半導体パッケージが一体化された状態の部材である。(a2)工程においてパネル部材が個片化されることで、例えば、ウエハレベルパッケージ又はパネルレベルパッケージが得られる。被処理体は、例えば、延伸性フィルムの表面上においてパネル部材をダイシングすることによって得ることができる。 (A) Step (a1) attaching a stretchable film to the first surface of a panel member including a plurality of semiconductor chips and a sealing material sealing the plurality of semiconductor chips; a2) It may include singulating the panel member on the stretchable film into a plurality of semiconductor packages. The panel member here is a member in which a plurality of semiconductor packages are integrated. In step (a2), the panel member is separated into pieces, thereby obtaining, for example, a wafer level package or a panel level package. The object to be processed can be obtained, for example, by dicing a panel member on the surface of a stretchable film.
(E)工程後、半導体パッケージを効率的にピックアップできるように、以下の工程を適宜実施してもよい。
(F)複数の半導体パッケージの表面に形成された機能層を覆うように粘着フィルムを貼る工程。
(G)粘着フィルム上の複数の半導体パッケージから仮固定フィルムを剥離する工程。
(E) After the step, the following steps may be carried out as appropriate so that the semiconductor package can be picked up efficiently.
(F) A step of applying an adhesive film to cover the functional layers formed on the surfaces of the plurality of semiconductor packages.
(G) Step of peeling off the temporary fixing film from the plurality of semiconductor packages on the adhesive film.
例えば、上記粘着フィルムの粘着力が紫外線照射又は加熱によって低下するものである場合、(G)工程後に以下の工程を適宜実施してもよい。
(H)粘着フィルムの半導体パッケージに対する粘着力を低下させる工程。
(I)粘着フィルムから半導体パッケージをピックアップする工程。
For example, if the adhesive strength of the adhesive film is reduced by ultraviolet irradiation or heating, the following steps may be carried out as appropriate after step (G).
(H) A step of reducing the adhesive strength of the adhesive film to the semiconductor package.
(I) Step of picking up the semiconductor package from the adhesive film.
本開示によれば、表面の少なくとも一部が機能層で覆われている半導体パッケージを効率的に製造する方法が提供される。 According to the present disclosure, a method for efficiently manufacturing a semiconductor package in which at least a portion of the surface is covered with a functional layer is provided.
以下、図面を参照しながら本開示の実施形態について詳細に説明する。以下の説明では、同一又は相当部分には同一符号を付し、重複する説明は省略する。また、上下左右等の位置関係は、特に断らない限り、図面に示す位置関係に基づくものとする。更に、図面の寸法比率は図示の比率に限られるものではない。 Embodiments of the present disclosure will be described in detail below with reference to the drawings. In the following description, the same or corresponding parts are given the same reference numerals, and overlapping description will be omitted. In addition, the positional relationships such as top, bottom, left, and right are based on the positional relationships shown in the drawings unless otherwise specified. Furthermore, the dimensional ratios in the drawings are not limited to the illustrated ratios.
本明細書の記載及び請求項において「左」、「右」、「正面」、「裏面」、「上」、「下」、「上方」、「下方」等の用語が利用されている場合、これらは、説明を意図したものであり、必ずしも永久にこの相対位置である、という意味ではない。また、「層」との語は、平面図として観察したときに、全面に形成されている形状の構造に加え、一部に形成されている形状の構造も包含される。 When terms such as "left", "right", "front", "back", "upper", "lower", "upper", "lower", etc. are used in the description and claims of this specification, These are intended to be illustrative and are not necessarily meant to be in permanent relative positions. Further, the term "layer" includes not only a structure formed on the entire surface but also a structure formed on a part of the layer when observed in a plan view.
(半導体パッケージ)
図1は本実施形態に係る製造方法によって製造される半導体パッケージを模式的に示す断面図である。この図に示す半導体パッケージ10は、ファンアウト・ウエハレベルパッケージ(Fan-out WLP、FO-WLP)と称されるものである。半導体パッケージ10は、半導体チップ1と、封止層3と、再配線層4と、電磁波シールド層5(機能層)とを備える。なお、パッケージ形態は、FO-WLPに限られるものではなく、ウェハレベルパッケージ(WLP)、フリップチップ・チップスケールパッケージ(FC-CSP)、フリップチップ・ボールグリッドアレイ(FC-BGA)、メモリーパッケージ等でもよい。
(semiconductor package)
FIG. 1 is a cross-sectional view schematically showing a semiconductor package manufactured by the manufacturing method according to the present embodiment. The
平面視における半導体パッケージ10の形状は、例えば正方形又は長方形である。平面視における半導体パッケージ10の面積は、例えば、1~900mm2であり、9~625mm2又は25~400mm2であってもよい。平面視における半導体パッケージ10の一辺の長さは、例えば、1~30mmであり、3~25mm又5~20mmであってもよい。半導体パッケージ10の厚さ(バンプ4cの高さを除く。)は、例えば、100~1500μmであり、200~1000μmであってもよい。
The shape of the
半導体チップ1は、回路面1aと、回路面1aに形成された複数のバンプ1b(突起電極)とを有する。回路面1aは、Ni/Auめっきパッド等の比較的平坦な金属パッドを有するものであってもよい。バンプ1bは、例えば、銅バンプ及びはんだバンプである。平面視における半導体チップ1の形状は、例えば正方形又は長方形である。平面視における半導体チップ1の面積は、例えば、1~400mm2であり、9~225mm2又は25~100mm2であってもよい。平面視における半導体チップ1の一辺の長さは、例えば、1~20mmであり、3~15mm又5~10mmであってもよい。半導体チップ1の厚さ(バンプ1bの高さを除く。)は、例えば、50~775μmであり、100~500μmであってもよい。
The
封止層3は、熱硬化性樹脂組成物によって構成されている。封止層3は、光、熱、湿気、ほこり及び物理的衝撃等から半導体チップ1を保護している。封止層3は、例えば、コンプレッションモールド、トランスファーモールド、フィルム状の封止材のラミネートによって形成される。封止層3の厚さは、例えば、50μm以上であり、100μm以上であってもよい。
The sealing
再配線層4は半導体チップ1のバンプ1bと電気的に接続されている。再配線層4は、導体部4aと、絶縁部4bと、バンプ4c,4dとによって構成されている。導体部4aは半導体チップ1のバンプ1bとバンプ4cとを電気的に接続している。図1の左端に示すバンプ4dは電磁波シールド層5と電気的に接続されている。再配線層4の側面4fはグランド接触点4gを有する。グランド接触点4gは電磁波シールド層5と接している。これにより、電磁波シールド層5はグランド接続を取ることができる。なお、図1には一点のグランド接触点4gを図示したが、半導体パッケージ10は再配線層4の側面4fに複数のグランド接触点を有してもよい。
The rewiring
電磁波シールド層5は、封止層3の面3a及び側面3bを覆うとともに、再配線層4の側面4fの少なくも一部を覆っている。電磁波シールド層5は、例えば、スパッタリング又は蒸着によって形成される金属層である。電磁波シールド層5は、例えば、銅、クロム及びニッケル等の金属元素を含む。電磁波シールド層5を構成する金属元素は一種であってもよいし、二種以上であってもよい。電磁波シールド層5の厚さは、例えば、0.01~100μmであり、0.05~50μmであってもよい。なお、電磁波シールド層5の形成方法は、スパッタリング又は蒸着に限定されず、スクリーン印刷法、スプレー印刷法、無電解めっき法又は電解めっき法等でもよい。
The
(半導体パッケージの製造方法)
次に、半導体パッケージ10の製造方法について説明する。半導体パッケージ10は、例えば、以下の工程を経て製造することができる。
(A)延伸性フィルム15と、延伸性フィルム15の表面上に互いに離間した状態で配置された複数の半導体パッケージ10Pとを備える被処理体20を準備する工程(図3(b)参照)。
(B)延伸性フィルム15に張力を付与することにより、隣接する二つの半導体パッケージ10Pの間隔を拡大する工程(図4参照)。
(C)延伸性フィルム15に張力を付与した状態で、複数の半導体パッケージ10Pの回路面1aを覆うように仮固定フィルム25を貼る工程(図4参照)。
(D)複数の半導体パッケージ10Pから延伸性フィルム15を剥離する工程(図6参照)。
(E)延伸性フィルム15の剥離によって露出した、複数の半導体パッケージ10Pの表面上にスパッタリング又は蒸着によって電磁波シールド層5を形成する工程(図7参照)。
(Method for manufacturing semiconductor packages)
Next, a method for manufacturing the
(A) A step of preparing a
(B) A step of increasing the distance between two
(C) A step of attaching the
(D) Step of peeling the
(E) A step of forming the
上記製造方法によれば、以下の効果が奏される。
・(C)工程において、隣接する二つの半導体パッケージ10Pの間隔が拡大された状態で複数の半導体パッケージ10Pが仮固定フィルム25に貼り付けられるため、(E)工程において、スパッタリング又は蒸着によって半導体パッケージ10Pの側面にも所望の厚さの電磁波シールド層5を形成することができる。
・(E)工程において、回路面1aが仮固定フィルム25で覆われている半導体パッケージ10Pに対して電磁波シールド層5が形成されるため、電磁波シールド層5を構成する材料が回路面1aに回り込むことを抑制できる。
According to the above manufacturing method, the following effects are achieved.
- In the step (C), a plurality of
- In step (E), the
[(A)工程]
(A)工程は被処理体20を準備する工程である。(A)工程において、例えば、以下のステップを経て被処理体20を作製することができる。
(a1)複数の半導体チップ1と、複数の半導体チップ1を封止している封止材13とを備えるパネル部材30の第一の表面30aに対して延伸性フィルム15を貼るステップ(図3(a)参照)。
(a2)延伸性フィルム15上のパネル部材30を複数の半導体パッケージ10Pに個片化するステップ(図3(b)参照)。
[(A) Process]
Step (A) is a step of preparing the
(a1) A step of attaching the
(a2) A step of singulating the
本実施形態においては、パネル部材30として、FO-WLPを製造するためのパネルを使用する場合を例に挙げる。なお、上述のとおり、パッケージ形態はFO-WLPに限られるものではない。図2は、FO-WLP用パネル部材の一例を模式的に示す平面図である。この図に示すパネル部材30は平面視で略円形であり、その直径は、例えば、100~300mmである。パネル部材30は、複数の半導体チップ1と、これらの半導体チップ1を封止する封止材13とによって構成されている。なお、図2には、便宜上、21個の半導体パッケージ10A(個片化前)が一体化されたものを図示したが、FO-WLP用パネル部材が備える半導体パッケージ10Aの数は、例えば、100個以上であり、100~6000個又は1600~24000個であってもよい。
In this embodiment, a case will be exemplified in which a panel for manufacturing FO-WLP is used as the
図3(a)は、パネル部材30に延伸性フィルム15を貼り付けた状態を模式的に示す断面図である。延伸性フィルム15は、延伸性を有する基材フィルム15aと、粘着層15bとを備える。延伸性フィルム15として、例えば、ステルスダイシング等に使用されるエキスパンドフィルムを使用することができる。延伸性フィルム15は(B)工程において隣接する二つの半導体パッケージ10Pの間隔を拡大するために使用される。拡大後の間隔は(E)工程において半導体パッケージ10Pの側面に電磁波シールド層5が適切に形成できればよく、間隔が全体にわたって必ずしも均一でなくてもよい。したがって、延伸性フィルム15として、エキスパンドフィルムの代わりに、ある程度の延伸性を有する粘着フィルム(例えば、ダイシングフィルム)を使用してもよい。
FIG. 3A is a cross-sectional view schematically showing a state in which the
図3(b)は、ブレードによってパネル部材30を複数の半導体パッケージ10Pに個片化した状態を示す断面図である。隣接する二つの半導体パッケージ10Pの離間距離は、切断に使用したブレード幅とほぼ同じであり、例えば、50μm程度である。これらのステップを経て被処理体20が得られる。
FIG. 3(b) is a cross-sectional view showing a state in which the
[(B)工程]
(B)工程は、延伸性フィルム15に張力を付与することにより、隣接する二つの半導体パッケージ10Pの間隔を拡大する工程である(図4参照)。延伸性フィルム15に対し、パネル部材30よりも直径が小さいリング状の部材(不図示)を押し当てることによって延伸性フィルム15に径方向の張力を付与することができる。隣接する二つの半導体パッケージ10Pの拡大後の離間距離は、好ましくは100~2000μmであり、より好ましくは200~800μmである。この距離が2000μm以下であることで、延伸性フィルム15の破断を抑制できる傾向にある。この距離Dと半導体パッケージの厚さTの比(D/T)は1以上であることが好ましい。比D/Tが1以上であることで、(E)工程におけるスパッタリング又は蒸着によって半導体パッケージ10Pの側面に、所望の厚さの電磁波シールド層5を安定的に形成することができる。
[(B) Process]
Step (B) is a step of increasing the distance between two
[(C)工程]
(C)工程は、延伸性フィルム15に張力を付与した状態で、複数の半導体パッケージ10Pの回路面1aを覆うように仮固定フィルム25を貼る工程である(図5参照)。仮固定フィルム25は、(E)工程におけるスパッタリング又は蒸着に曝されるため、十分な耐熱性を有する材質からなる。仮固定フィルム25は、例えば、耐熱性を有する基材フィルム25aと、半導体パッケージ10Pに対する高い粘着性を有する粘着層25bとを含む積層構造を有する。図5に示されたように、複数の半導体パッケージ10Pの回路面1aに粘着層25bが接し且つバンプ1bが粘着層25bに埋め込まれた状態とすることが好ましい。粘着層25bが回路面1aに密着していることで、(E)工程の電磁波シールド層5の形成を経ても電磁波シールド層5を構成する材料が回路面1aに回り込むことを高度に抑制できる。
[(C) Process]
Step (C) is a step of attaching the
基材フィルム25aは、上述のとおり、耐熱性を有するものであればよく、例えば、ポリイミドフィルム、PETフィルム(延伸)、ポリ塩化ビニリデン等が挙げられる。基材フィルム25aは、単層のフィルムであってもよいし、上記プラスチックフィルムを二種以上又は同種のプラスチックフィルムを二つ以上組み合わせて得られる多層のフィルムであってもよい。粘着層25bは、例えば、粘着性組成物からなり、加熱されることによって半導体パッケージ10Pに対して強い密着性が発現するものであってもよい。
As described above, the
[(D)工程]
(D)工程は、複数の半導体パッケージ10P及び仮固定フィルム25から、延伸性フィルム15を剥離する工程である。図6は、図5に示す状態から延伸性フィルム15を剥離した状態を模式的に示す断面図である。なお、図6は図5の状態から上下を反転させた状態を示している。(D)工程を実施するに先立ち、例えば、延伸性フィルム15に紫外線を照射することによって、延伸性フィルム15の粘着力を低下させてもよい。
[(D) Process]
Step (D) is a step of peeling the
[(E)工程]
(E)工程は、延伸性フィルム15の剥離によって露出した封止層の面3aと、側面3bに、スパッタリング又は蒸着によって電磁波シールド層5を形成する工程である。スパッタリングは、例えば、芝浦メカトロニクス株式会社製のCCS-2110(商品名)を使用して実施できる。蒸着は、例えば、株式会社神戸製鋼所(KOBELCO)製のAIP-Gシリーズ(商品名、「AIP」は登録商標)を使用して実施できる。図7は、仮固定フィルム25の表面上に複数の半導体パッケージ10が形成された状態を模式的に示す断面図である。
[(E) Process]
Step (E) is a step of forming the
(E)工程後、半導体パッケージ10を効率的にピックアップできるように、複数の半導体パッケージ10を仮固定フィルム25から粘着フィルム35に転写し、粘着フィルム35から半導体パッケージ10をピックアップしてもよい。すなわち、(E)工程後、以下の工程を適宜実施してもよい。なお、粘着フィルム35として、例えば、紫外線照射又は加熱によって粘着力が低下するものを使用すればよい。
(F)複数の半導体パッケージ10の表面に形成された電磁波シールド層5を覆うように粘着フィルム35を貼る工程(図8(a)参照)。
(G)粘着フィルム35上の複数の半導体パッケージから仮固定フィルムを剥離する工程(図8(b)参照)。
(H)粘着フィルム35の半導体パッケージ10に対する粘着力を低下させる工程。(I)粘着フィルム35から半導体パッケージ10をピックアップする工程。
(E) After the step, a plurality of
(F) Step of attaching the
(G) Step of peeling off the temporary fixing film from the plurality of semiconductor packages on the adhesive film 35 (see FIG. 8(b)).
(H) A step of reducing the adhesive force of the
図8(c)は、粘着フィルム35から半導体パッケージ10をピックアップしている様子を模式的に示す断面図である。図8(c)に示されたように、突き上げ冶具51で半導体パッケージ10を粘着フィルム35の下面側から突き上げるとともに、半導体パッケージ10をコレット52で吸引してピックアップする。
FIG. 8C is a cross-sectional view schematically showing how the
以上、本開示の実施形態について詳細に説明したが、本発明は上記実施形態に限定されるものではない。例えば、上記実施形態においては、機能層として電磁波シールド層5を形成する場合を例示したが、電磁波シールド層5の代わりに、放熱層及び/又は保護層を半導体パッケージ10Pの表面に形成してもよい。
Although the embodiments of the present disclosure have been described in detail above, the present invention is not limited to the above embodiments. For example, in the above embodiment, the
本開示について以下の実施例により更に詳細に説明するが、本発明はこれらの例に限定されるものではない。 The present disclosure will be explained in more detail with reference to the following examples, but the present invention is not limited to these examples.
WLP用パネル部材(直径:24mm、厚さ:0.3mm、半導体チップ数:16個、回路面のバンプ:はんだ)を準備した。WLP用パネル部材の一方の面(回路面と反対側の面)に延伸性フィルム(延伸性を有するダイシングフィルム)を貼り付けた。以下の条件でWLP用パネル部材をブレードダイシングすることにより、延伸性フィルム上に複数の半導体パッケージ(平面視でのサイズ6mm×6mm)を形成した((A)工程)。
・ダイサー:DFD3361(株式会社ディスコ製)
・ブレード:ZH05-SD3000-N1-70(株式会社ディスコ製)
・ブレード幅:28μm
・ブレード回転数:30000rpm
・ダイシング速度:10mm/秒
A WLP panel member (diameter: 24 mm, thickness: 0.3 mm, number of semiconductor chips: 16, bumps on circuit surface: solder) was prepared. A stretchable film (a stretchable dicing film) was attached to one surface (the surface opposite to the circuit surface) of the WLP panel member. A plurality of semiconductor packages (size 6 mm x 6 mm in plan view) were formed on the stretchable film by blade dicing the WLP panel member under the following conditions (step (A)).
・Dicer: DFD3361 (manufactured by DISCO Co., Ltd.)
・Blade: ZH05-SD3000-N1-70 (manufactured by DISCO Co., Ltd.)
・Blade width: 28μm
・Blade rotation speed: 30000rpm
・Dicing speed: 10mm/sec
WLP用パネル部材の直径よりも大きい内径を有するリングを延伸性フィルムの下方から押し当てることによって、延伸性フィルムに張力を付与した。これにより、隣接する二つの半導体パッケージの間隔を約320μmに拡大させた((B)工程)。延伸性フィルムに張力を付与した状態で、複数の半導体パッケージの回路面を覆うように仮固定フィルムを真空ラミネーターで貼り付けた((C)工程)。仮固定フィルムとして、紫外線硬化型の粘着層を表面に有するポリイミドフィルムを使用した。その後、複数の半導体パッケージから延伸性フィルムを剥離した((D)工程)。 Tension was applied to the stretchable film by pressing a ring having an inner diameter larger than the diameter of the WLP panel member from below the stretchable film. As a result, the distance between two adjacent semiconductor packages was increased to approximately 320 μm (step (B)). With tension applied to the stretchable film, a temporary fixing film was attached using a vacuum laminator so as to cover the circuit surfaces of the plurality of semiconductor packages (step (C)). A polyimide film having an ultraviolet curable adhesive layer on its surface was used as the temporary fixing film. Thereafter, the stretchable film was peeled off from the plurality of semiconductor packages (step (D)).
ポリイミドフィルム上の複数の半導体パッケージの表面にスパッタリングによって電磁波シールド層(厚さ:4380nm)を形成した((E)工程)。ターゲットとして、クロム及び銅を使用した。 An electromagnetic shielding layer (thickness: 4380 nm) was formed on the surface of a plurality of semiconductor packages on a polyimide film by sputtering (step (E)). Chromium and copper were used as targets.
半導体パッケージの回路面を拡大して観察したところ、電磁波シールド層を構成する材料の回路面への回り込みは認められなかった。 When the circuit surface of the semiconductor package was observed under magnification, no material constituting the electromagnetic wave shielding layer was found to have wrapped around the circuit surface.
1…半導体チップ、1a…回路面、1b…バンプ、3…封止層、3a…面、3b…側面、4…再配線層、4a…導体部、4b…絶縁部、4c,4d…バンプ、4f…再配線層の側面、4g…グランド接触点、5…電磁波シールド層、10…半導体パッケージ、10A…半導体パッケージ(個片化前)、10P…半導体パッケージ(電磁波シールド層形成前)、13…封止材、15…延伸性フィルム、20…被処理体、25…仮固定フィルム、30…パネル部材、30a…第一の表面、15a…基材フィルム、15b…粘着層、25a…基材フィルム、25b…粘着層、35…粘着フィルム、51…冶具、52…コレット
DESCRIPTION OF
Claims (6)
(B)前記延伸性フィルムに張力を付与することにより、隣接する二つの前記半導体パッケージの間隔を拡大する工程と、
(C)前記延伸性フィルムに張力を付与した状態で、複数の前記半導体パッケージの回路面を覆うように仮固定フィルムを貼る工程と、
(D)複数の前記半導体パッケージから前記延伸性フィルムを剥離する工程と、
(E)前記延伸性フィルムの剥離によって露出した、複数の前記半導体パッケージの表面上に機能層を形成する工程と、
を含む、半導体パッケージの製造方法。 (A) preparing a processed object comprising a stretchable film and a plurality of semiconductor packages arranged spaced apart from each other on the surface of the stretchable film;
(B) expanding the distance between the two adjacent semiconductor packages by applying tension to the stretchable film;
(C) applying a temporary fixing film to cover the circuit surfaces of the plurality of semiconductor packages while applying tension to the stretchable film;
(D) peeling the stretchable film from the plurality of semiconductor packages;
(E) forming a functional layer on the surfaces of the plurality of semiconductor packages exposed by peeling off the stretchable film;
A method of manufacturing a semiconductor package, including:
(a1)複数の半導体チップと、前記複数の半導体チップを封止している封止材とを備えるパネル部材の第一の表面に対して前記延伸性フィルムを貼ることと、
(a2)前記延伸性フィルム上の前記パネル部材を複数の前記半導体パッケージに個片化することと、
を含む、請求項1に記載の半導体パッケージの製造方法。 (A) The process is
(a1) pasting the stretchable film on a first surface of a panel member that includes a plurality of semiconductor chips and a sealing material that seals the plurality of semiconductor chips;
(a2) dividing the panel member on the stretchable film into a plurality of the semiconductor packages;
The method for manufacturing a semiconductor package according to claim 1, comprising:
(G)前記粘着フィルム上の複数の前記半導体パッケージから前記仮固定フィルムを剥離する工程と、
を更に含む、請求項1~4のいずれか一項に記載の半導体パッケージの製造方法。 (F) applying an adhesive film to cover the functional layer formed on the surface of the plurality of semiconductor packages;
(G) peeling off the temporary fixing film from the plurality of semiconductor packages on the adhesive film;
The method for manufacturing a semiconductor package according to any one of claims 1 to 4, further comprising:
(I)前記粘着フィルムから前記半導体パッケージをピックアップする工程と、
を更に含む、請求項5に記載の半導体パッケージの製造方法。 (H) reducing the adhesive force of the adhesive film to the semiconductor package;
(I) picking up the semiconductor package from the adhesive film;
The method for manufacturing a semiconductor package according to claim 5, further comprising:
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2020058788A JP7415735B2 (en) | 2020-03-27 | 2020-03-27 | Manufacturing method for semiconductor packages |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2020058788A JP7415735B2 (en) | 2020-03-27 | 2020-03-27 | Manufacturing method for semiconductor packages |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2021158279A JP2021158279A (en) | 2021-10-07 |
JP7415735B2 true JP7415735B2 (en) | 2024-01-17 |
Family
ID=77918797
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2020058788A Active JP7415735B2 (en) | 2020-03-27 | 2020-03-27 | Manufacturing method for semiconductor packages |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP7415735B2 (en) |
Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009044123A (en) | 2007-07-19 | 2009-02-26 | Citizen Finetech Miyota Co Ltd | Manufacturing method of electronic component and electronic component |
US20110115060A1 (en) | 2009-11-19 | 2011-05-19 | Advanced Semiconductor Engineering, Inc. | Wafer-Level Semiconductor Device Packages with Electromagnetic Interference Shielding |
US20160035680A1 (en) | 2014-08-01 | 2016-02-04 | Cyntec Co., Ltd. | Semiconductor package with conformal em shielding structure and manufacturing method of same |
US20160268216A1 (en) | 2015-03-10 | 2016-09-15 | Samsung Electronics Co., Ltd. | Semiconductor packages and methods of fabricating the same |
JP2017076748A (en) | 2015-10-16 | 2017-04-20 | リンテック株式会社 | Adhesive sheet, and method for manufacturing semiconductor device |
JP2017208529A (en) | 2016-05-11 | 2017-11-24 | 積水化学工業株式会社 | Semiconductor package manufacturing method |
WO2018216621A1 (en) | 2017-05-22 | 2018-11-29 | 日立化成株式会社 | Semiconductor device manufacturing method and expand tape |
WO2020032176A1 (en) | 2018-08-08 | 2020-02-13 | リンテック株式会社 | Terminal protecting tape and method for manufacturing semiconductor device having electromagnetic-wave blocking film attached thereto |
-
2020
- 2020-03-27 JP JP2020058788A patent/JP7415735B2/en active Active
Patent Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009044123A (en) | 2007-07-19 | 2009-02-26 | Citizen Finetech Miyota Co Ltd | Manufacturing method of electronic component and electronic component |
US20110115060A1 (en) | 2009-11-19 | 2011-05-19 | Advanced Semiconductor Engineering, Inc. | Wafer-Level Semiconductor Device Packages with Electromagnetic Interference Shielding |
US20160035680A1 (en) | 2014-08-01 | 2016-02-04 | Cyntec Co., Ltd. | Semiconductor package with conformal em shielding structure and manufacturing method of same |
US20160268216A1 (en) | 2015-03-10 | 2016-09-15 | Samsung Electronics Co., Ltd. | Semiconductor packages and methods of fabricating the same |
JP2017076748A (en) | 2015-10-16 | 2017-04-20 | リンテック株式会社 | Adhesive sheet, and method for manufacturing semiconductor device |
JP2017208529A (en) | 2016-05-11 | 2017-11-24 | 積水化学工業株式会社 | Semiconductor package manufacturing method |
WO2018216621A1 (en) | 2017-05-22 | 2018-11-29 | 日立化成株式会社 | Semiconductor device manufacturing method and expand tape |
WO2020032176A1 (en) | 2018-08-08 | 2020-02-13 | リンテック株式会社 | Terminal protecting tape and method for manufacturing semiconductor device having electromagnetic-wave blocking film attached thereto |
Also Published As
Publication number | Publication date |
---|---|
JP2021158279A (en) | 2021-10-07 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US10559525B2 (en) | Embedded silicon substrate fan-out type 3D packaging structure | |
TWI772672B (en) | Chip packaging method and chip packaging structure | |
TWI576927B (en) | Semiconductor device and manufacturing method thereof | |
JP4659660B2 (en) | Manufacturing method of semiconductor device | |
JP6527640B2 (en) | Carrier ultra thin substrate | |
KR102673994B1 (en) | Semiconductor package and method of manufacturing the same | |
US20150008566A1 (en) | Method and structure of panelized packaging of semiconductor devices | |
US20170141046A1 (en) | Semiconductor device with an electromagnetic interference (emi) shield | |
TWI733049B (en) | Semiconductor package and manufacturing method thereof | |
JP5942823B2 (en) | Electronic component device manufacturing method, electronic component device, and electronic device | |
TWI721038B (en) | Package structures, pop devices and methods of forming the same | |
US11233028B2 (en) | Chip packaging method and chip structure | |
JP2004193497A (en) | Chip-size package and manufacturing method thereof | |
JP2011061116A (en) | Semiconductor device and method of manufacturing the same | |
US20090124048A1 (en) | Semiconductor device and method of manufacturing semiconductor device | |
US7541217B1 (en) | Stacked chip structure and fabrication method thereof | |
US11398420B2 (en) | Semiconductor package having core member and redistribution substrate | |
US20050258536A1 (en) | Chip heat sink device and method | |
US11923337B2 (en) | Carrying substrate, electronic package having the carrying substrate, and methods for manufacturing the same | |
JP7415735B2 (en) | Manufacturing method for semiconductor packages | |
JP3618330B2 (en) | Semiconductor device and manufacturing method thereof | |
WO2021192341A1 (en) | Production method for semiconductor packages | |
KR101711710B1 (en) | Semiconductor package and manufacturing method thereof | |
JP7487519B2 (en) | Semiconductor package manufacturing method | |
JP2004039667A (en) | Method of manufacturing semiconductor device formed with through-hole and method of manufacturing semiconductor package |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20230127 |
|
TRDD | Decision of grant or rejection written | ||
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20231130 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20231205 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20231218 |
|
R151 | Written notification of patent or utility model registration |
Ref document number: 7415735 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R151 |
|
S801 | Written request for registration of abandonment of right |
Free format text: JAPANESE INTERMEDIATE CODE: R311801 |
|
ABAN | Cancellation due to abandonment | ||
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |