JP6025348B2 - 信号伝送装置、光電変換装置および撮像システム - Google Patents
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Description
特許文献1には、複数のメモリをブロックとして、ブロック毎にデータが出力される配線(以下、データ出力線)を分けることが、記載されている。この中で、各ブロック配線につき選択回路を設けて、対応付けられたブロック配線からのデジタルデータと、別の選択回路から出力されたデジタルデータのいずれかを選択して出力する構成が記載されている。
本発明は、上述の問題を解決することを目的とする。
図1は、本実施例に係る光電変換装置の構成を示す図である。ここではM行×N列の行列状に画素101が配列された画素アレイ100と、画素アレイ100の各列に信号処理回路200を備える構成を例にとって説明する。
本発明に係る別の実施例を説明する。実施例1では、デジタル信号出力部が、画素アレイの各列に設けられた例を説明したのに対し、本実施例に係る光電変換装置は、各画素にデジタル信号出力部を備える。
本発明に係る別の実施例を説明する。
本発明に係る別の実施例を説明する。
本発明に係る別の実施例を説明する。
本発明に係る別の実施例を説明する。
本発明に係る別の実施例を説明する。
本発明に係る別の実施例を説明する。
次に、本実施例に係る撮像システムの概略を、図17を用いて説明する。
上記の各実施例は、光電変換装置を例にとって説明したが、本発明は、光電変換装置に限らず、デジタル信号を出力するデジタル信号出力部が並列に設けられた構成に適用できる。
Claims (11)
- 各々が画素信号を出力する複数の光電変換部を有する撮像装置であって、
前記撮像装置は、
各々が、前記画素信号に基づく信号をデジタル信号に変換する複数のA/D変換部と、
各々が、前記デジタル信号を出力する複数のデジタル信号出力部と、
前記複数のデジタル信号出力部の出力端子が接続されたブロック配線と、
入力端子が前記ブロック配線と接続されたバッファ回路と、
を各々が含む複数の組を有し、
前記複数の組のうちの第1の組に含まれる前記バッファ回路の出力端子は、前記複数の組のうちの第2の組に含まれる前記ブロック配線と接続され、
前記複数のデジタル信号出力部の前記デジタル信号の出力を、前記第1の組と前記第2の組との一方の組が終えた後、前記第1の組および前記第2の組とは別の組の前記デジタル信号出力部の前記デジタル信号の出力を介さずに、他方の組が行い、
前記一方の組の前記デジタル信号出力部の出力する前記デジタル信号と、前記他方の組の前記デジタル信号出力部の出力する前記デジタル信号との間に、前記画素信号に対応するデジタル信号とは別のデジタル信号を挿入する回路を、前記撮像装置がさらに備えること、を特徴とする撮像装置。 - 前記デジタル信号出力部は、前記A/D変換部から出力されたデジタル信号を保持するメモリ部を有することを特徴とする請求項1に記載の撮像装置。
- 前記メモリ部は、出力インピーダンスを調整する出力インピーダンス調整部を含むことを特徴とする請求項2に記載の撮像装置。
- 前記バッファ回路は、出力インピーダンスを調整する出力インピーダンス調整部を含むことを特徴とする請求項1〜3のいずれか1項に記載の撮像装置。
- 前記バッファ回路は、クロック信号と同期して、前記デジタル信号を出力することを特徴とする請求項1〜4のいずれか1項に記載の撮像装置。
- 前記第1の組に含まれる前記バッファ回路の前記出力端子は、前記第2の組に含まれる前記ブロック配線および前記第2の組に含まれる前記複数のデジタル信号出力部に接続されることを特徴とする請求項1〜5のいずれか1項に記載の撮像装置。
- 前記デジタル信号出力部は、前記デジタル信号を保持するメモリ部と、前記メモリ部と前記ブロック配線との接続と非接続とを切り替えるスイッチとを有し、
前記第1の組の前記バッファ回路の前記出力端子が、前記第2の組の前記スイッチと接続されることを特徴とする請求項1〜6のいずれか1項に記載の撮像装置。 - 前記回路に、前記他方の組の前記デジタル信号出力部が出力する前記デジタル信号が、前記他方の組に対応する前記ブロック配線から入力され、
前記一方の組に対応する前記ブロック配線に、前記回路は、前記他方の組の前記デジタル信号出力部が出力する前記デジタル信号と、前記別のデジタル信号とを出力し、
前記一方の組の前記デジタル信号出力部が前記デジタル信号を、前記一方の組に対応する前記ブロック配線への出力を終えたタイミングから、前記回路が、前記他方の組の前記デジタル信号出力部が出力する前記デジタル信号を、前記一方の組に対応する前記ブロック配線に出力するタイミングまでの期間が、前記複数のデジタル信号出力部から前記デジタル信号が順次出力される周期の1周期の長さであって、前記期間に、前記回路が前記別のデジタル信号を挿入することを特徴とする請求項1〜7のいずれか1項に記載の撮像装置。 - 前記回路が、前記画素信号に基づくデジタル信号とクロックとを同期させる同期化回路であることを特徴とする請求項1〜8のいずれか1項に記載の撮像装置。
- 行列状に配された複数の画素をさらに有し、
前記複数の画素の各々が、前記A/D変換部と、前記デジタル信号出力部を含むことを特徴とする請求項1〜9のいずれか1項に記載の撮像装置。 - 請求項1〜10のいずれか1項に記載の撮像装置と、
前記撮像装置から出力された信号を処理して画像データを生成する映像信号処理部と、をさらに備えたことを特徴とする撮像システム。
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