JP5745073B2 - Ga2O3系単結晶体のドナー濃度制御方法 - Google Patents

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Description

本発明は、Ga系単結晶体のドナー濃度制御方法、特にイオン注入法を用いたGa系単結晶体のドナー濃度制御方法に関する。
従来のGa単結晶の形成方法として、Ga単結晶を成長させながらSiやSn等のIV族元素を添加して、Ga単結晶に導電性を付与する方法が知られている(例えば、特許文献1参照)。
また、従来の他のGa単結晶の形成方法として、サファイア基板上にSn等の不純物を添加しながらβ−Ga結晶をヘテロエピタキシャル成長させ、導電性を有するβ−Ga結晶膜を形成する方法が知られている(例えば、特許文献2参照)。
また、SiC結晶にイオン注入により不純物イオンを導入する方法が知られている(例えば、特許文献3参照)。
特開2005−235961号公報 特許第4083396号公報 特許第4581270号公報
一方、Ga単結晶等の酸化物単結晶に導電性を付与するための不純物の導入に、イオン注入法を用いることは難しい。これは、酸化物にはイオン注入によるダメージが発生しやすく、イオン注入後のアニール処理でもダメージを十分に回復させることが難しいことによる。酸化物単結晶においては、イオン注入の際に酸素が欠損することにより、結晶のダメージが大きくなるものと考えられる。
しかしながら、イオン注入法には、母結晶の形成後に不純物濃度を制御することが可能であることや、比較的容易に不純物を局所的に導入することが可能であること等の利点がある。
したがって、本発明の目的は、優れた導電性を有する領域をGa系単結晶体中に形成することのできる、イオン注入法を用いたGa系単結晶体のドナー濃度制御方法を提供することにある。
本発明の一態様は、上記目的を達成するために、[1]〜[5]のGa系単結晶体のドナー濃度制御方法を提供する。
[1]イオン注入法により、Ga系単結晶体にドナー不純物としてIV族元素を導入し、前記Ga系単結晶体中に、前記IV族元素を注入していない領域よりも前記IV族元素の濃度の高いドナー不純物注入領域を形成する工程と、800℃以上のアニール処理により、前記ドナー不純物注入領域中の前記IV族元素を活性化させ、前記ドナー不純物注入領域を前記アニール処理前のドナー濃度より高いドナー濃度を有する高ドナー濃度領域を形成する工程と、を含むGa系単結晶体のドナー濃度制御方法。
[2]前記アニール処理は、窒素雰囲気下で800℃以上の条件で実施される、前記[1]に記載のGa系単結晶体のドナー濃度制御方法。
[3]前記アニール処理は、酸素雰囲気下で800℃以上950℃以下の条件で実施される、前記[1]に記載のGa系単結晶体のドナー濃度制御方法。
[4]前記Ga系単結晶体上に形成されたマスクを用いて、前記IV族元素を前記Ga系単結晶体の表面の一部の領域に導入し、前記Ga系単結晶体の前記表面の一部の領域に前記ドナー不純物注入領域を形成する、前記[1]〜[3]のいずれか1つに記載のGa系単結晶体のドナー濃度制御方法。
[5]前記Ga系単結晶体は、Ga系単結晶基板、又は支持基板上に形成されたGa系結晶膜である、前記[1]に記載のGa系単結晶体のドナー濃度制御方法。
本発明によれば、優れた導電性を有する領域をGa系単結晶体中に形成することのできる、イオン注入法を用いたGa系単結晶体のドナー濃度制御方法を提供することができる。
イオン注入工程の一例を示すβ−Ga系単結晶体の断面図 イオン注入工程の一例を示すβ−Ga系単結晶体の断面図 イオン注入工程の一例を示すβ−Ga系単結晶体の断面図 イオン注入工程の一例を示すβ−Ga系単結晶体の断面図 イオン注入後の窒素雰囲気下でのアニール処理の温度とβ−Ga単結晶膜の導電性との関係を表すグラフ イオン注入後の酸素雰囲気下でのアニール処理の温度とβ−Ga単結晶膜の導電性との関係を表すグラフ
〔実施の形態〕
本実施の形態によれば、イオン注入法を用いてドナー不純物をGa系単結晶体に導入し、所定の条件下でアニール処理を施すことにより、優れた導電性を有する高ドナー濃度領域をGa系単結晶体中に形成することができる。以下、その実施の形態の一例として、β−Ga系単結晶体のドナー濃度制御方法について詳細に説明する。なお、本実施の形態のGa系単結晶体はβ−Ga系単結晶体に限られず、α−Ga系単結晶体等の他の構造を有するGa系単結晶体であってもよい。
図1A〜1Dは、イオン注入工程の一例を示すβ−Ga系単結晶体の断面図である。
まず、図1Aに示すように、β−Ga系単結晶体1にマスク2を形成する。マスク2は、フォトリソグラフィ法等を用いて形成される。
次に、図1Bに示すように、イオン注入によりドナー不純物をβ−Ga系単結晶体1に注入し、β−Ga系単結晶体1の表面にドナー不純物注入領域3を形成する。このとき、β−Ga系単結晶体1のマスク2に覆われた領域にはドナー不純物が注入されないため、ドナー不純物注入領域3はβ−Ga系単結晶体1の表面の一部の領域に形成される。ドナー不純物注入領域3のドナー不純物濃度は、β−Ga系単結晶体1のドナー不純物を注入していない領域のドナー不純物濃度よりも高い。
なお、マスク2を用いずにイオン注入を行い、β−Ga系単結晶体1の全表面にドナー不純物注入領域3を形成してもよい。また、イオン注入の条件を調整することにより、ドナー不純物注入領域3の深さや濃度分布を制御することができる。
次に、図1Cに示すように、マスク2を除去する。
その後、図1Dに示すように、800℃以上のアニール処理を施すことにより、ドナー不純物注入領域3のドナー不純物を活性化させ、ドナー濃度の高い高ドナー濃度領域4を形成する。また、このアニール処理により、イオン注入により生じたβ−Ga系単結晶体1のダメージを回復することができる。具体的なアニール処理の条件は、例えば、窒素雰囲気、アルゴン雰囲気等の不活性雰囲気下で800℃以上、酸素雰囲気下で800℃以上950℃以下である。
β−Ga系単結晶体1は、β−Ga単結晶、又は、Al、In等の元素が添加されたβ−Ga単結晶からなる。例えば、Al及びInが添加されたβ−Ga結晶である(GaAlIn(1−x−y)(0<x≦1、0≦y≦1、0<x+y≦1)結晶であってもよい。Alを添加した場合にはバンドギャップが広がり、Inを添加した場合にはバンドギャップが狭くなる。
β−Ga系単結晶体1は、例えば、β−Ga系単結晶基板や、支持基板上に形成されたβ−Ga系結晶膜である。
β−Ga系単結晶体1にイオン注入法により導入されるドナー不純物として、Si、Sn、Ge等のIV族元素が用いられる。
図2は、イオン注入後の窒素雰囲気下でのアニール処理の温度とβ−Ga系単結晶体としてのβ−Ga単結晶基板の導電性との関係を表すグラフである。図2の縦軸は、β−Ga単結晶基板の高ドナー濃度領域の単位立方センチ当たりのドナー密度とアクセプタ密度の差(Nd−Na)、すなわちn型半導体であるβ−Ga単結晶基板の高ドナー濃度領域の導電性の高さを表す。図2の横軸は、窒素雰囲気下でのアニール処理の温度を表す。アニール処理は、各々30分間実施される。
この高ドナー濃度領域は、深さ200nmのボックス型の領域であり、ドナー濃度が3
×1017/cmのβ−Ga単結晶基板に、濃度1×1019/cmのSi又はSnをイオン注入することにより形成した。また、この高ドナー濃度領域は、(010)面を主面とするβ−Ga単結晶基板の主面に垂直にドナー不純物を注入することにより形成した。
図2中の■及び▲は、それぞれドナー不純物としてSi及びSnを注入する場合のNd−Naの値を示す。また、○は、ドナー不純物を注入しない場合のNd−Naの値を示す。
図2に示されるように、Siを注入する場合、Snを注入する場合ともに、800℃以上のアニール処理によりNd−Naの値が高くなる。すなわち、イオン注入後に窒素雰囲気下で800℃以上のアニール処理を実施することにより、β−Ga単結晶基板に高い導電性を付与することができる。なお、ドナー不純物を注入しない場合は、アニール処理の温度を上げてもNd−Naの値が大きく増加することはない。
図3は、イオン注入後の酸素雰囲気下でのアニール処理の温度とβ−Ga系単結晶体としてのβ−Ga単結晶基板の導電性との関係を表すグラフである。図3の縦軸は、β−Ga単結晶基板の高ドナー濃度領域の単位立方センチ当たりのドナー密度とアクセプタ密度の差(Nd−Na)、すなわちn型半導体であるβ−Ga単結晶基板の高ドナー濃度領域の導電性の高さを表す。図3の横軸は、酸素雰囲気下でのアニール処理の温度を表す。アニール処理は、各々30分間実施される。
図3中の■及び▲は、それぞれドナー不純物としてSi及びSnを注入する場合のNd−Naの値を示す。
図3に示されるように、Siを注入する場合、800℃以上950℃以下のアニール処理によりNd−Naの値が高くなる。また、Snを注入する場合、800℃以上1100℃以下のアニール処理によりNd−Naの値が高くなる。すなわち、イオン注入後に酸素雰囲気下で800℃以上950℃以下のアニール処理を実施することにより、β−Ga単結晶基板に高い導電性を付与することができる。
(実施の形態の効果)
本実施の形態によれば、イオン注入法を用いてドナー不純物をβ−Ga系結晶体に導入し、所定の条件下でアニール処理を施すことにより、優れた導電性を有する高ドナー濃度領域をβ−Ga系結晶体中に形成することができる。イオン注入法を用いて高ドナー濃度領域を形成するため、β−Ga系結晶体の形成後に高ドナー濃度領域のドナー濃度を制御し、所望の導電性を付与することができる。また、マスク等を用いることにより、高ドナー濃度領域をβ−Ga系結晶体中に局所的に形成することができる。
以上、本発明の実施の形態を説明したが、上記に記載した実施の形態は特許請求の範囲に係る発明を限定するものではない。また、実施の形態の中で説明した特徴の組合せの全てが発明の課題を解決するための手段に必須であるとは限らない点に留意すべきである。
優れた導電性を有する領域をGa系単結晶体中に形成することのできる、イオン注入法を用いたGa系単結晶体のドナー濃度制御方法を提供する。
1…β−Ga系単結晶体、2…マスク、3…ドナー不純物注入領域、4…高ドナー濃度領域

Claims (5)

  1. イオン注入法により、Ga系単結晶体にドナー不純物としてIV族元素を導入し、前記Ga系単結晶体中に、前記IV族元素を注入していない領域よりも前記IV族元素の濃度の高いドナー不純物注入領域を形成する工程と、
    800℃以上のアニール処理により、前記ドナー不純物注入領域中の前記IV族元素を活性化させ、前記ドナー不純物注入領域を前記アニール処理前のドナー濃度より高いドナー濃度を有する高ドナー濃度領域を形成する工程と、
    を含むGa系単結晶体のドナー濃度制御方法。
  2. 前記アニール処理は、窒素雰囲気下で800℃以上の条件で実施される、
    請求項1に記載のGa系単結晶体のドナー濃度制御方法。
  3. 前記アニール処理は、酸素雰囲気下で800℃以上950℃以下の条件で実施される、
    請求項1に記載のGa系単結晶体のドナー濃度制御方法。
  4. 前記Ga系単結晶体上に形成されたマスクを用いて、前記IV族元素を前記Ga系単結晶体の表面の一部の領域に導入し、
    前記Ga系単結晶体の前記表面の一部の領域に前記ドナー不純物注入領域を形成する、
    請求項1〜3のいずれか1項に記載のGa系単結晶体のドナー濃度制御方法。
  5. 前記Ga系単結晶体は、Ga系単結晶基板、又は支持基板上に形成されたGa系結晶膜である、
    請求項1に記載のGa系単結晶体のドナー濃度制御方法。
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Families Citing this family (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8951897B2 (en) 2011-09-08 2015-02-10 Tamura Corporation Method for controlling concentration of donor in GA2O3—based single crystal
CN110010670A (zh) * 2011-09-08 2019-07-12 株式会社田村制作所 Ga2O3系MISFET和Ga2O3系MESFET
JP6142357B2 (ja) 2013-03-01 2017-06-07 株式会社タムラ製作所 Ga2O3系単結晶体のドナー濃度制御方法、及びオーミックコンタクト形成方法
JP2016031953A (ja) 2014-07-25 2016-03-07 株式会社タムラ製作所 半導体素子及びその製造方法、半導体基板、並びに結晶積層構造体
JP5828568B1 (ja) * 2014-08-29 2015-12-09 株式会社タムラ製作所 半導体素子及びその製造方法
JP2017041593A (ja) * 2015-08-21 2017-02-23 株式会社タムラ製作所 Ga2O3系結晶膜の形成方法
CN106868593B (zh) * 2017-01-06 2019-04-19 中国科学院上海光学精密机械研究所 高电导率的共掺杂氧化镓晶体及其制备方法
CN109671612B (zh) * 2018-11-15 2020-07-03 中国科学院上海微系统与信息技术研究所 一种氧化镓半导体结构及其制备方法
JP2024050122A (ja) * 2022-09-29 2024-04-10 株式会社ノベルクリスタルテクノロジー 単結晶の育成方法、半導体基板の製造方法、及び半導体基板

Family Cites Families (21)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01286308A (ja) * 1988-05-12 1989-11-17 Nec Corp GaAs電界効果トランジスタの製造方法
US5518938A (en) * 1995-05-08 1996-05-21 United Microelectronics Corporation Process for fabricating a CMOS transistor having high-voltage metal-gate
JP2001110746A (ja) * 1999-10-12 2001-04-20 Matsushita Electric Ind Co Ltd 炭化珪素への電極形成法および半導体素子
JP4083396B2 (ja) * 2000-07-10 2008-04-30 独立行政法人科学技術振興機構 紫外透明導電膜とその製造方法
JP4581270B2 (ja) 2001-03-05 2010-11-17 住友電気工業株式会社 SiC半導体のイオン注入層及びその製造方法
JP3679097B2 (ja) 2002-05-31 2005-08-03 株式会社光波 発光素子
JP4565062B2 (ja) * 2003-03-12 2010-10-20 学校法人早稲田大学 薄膜単結晶の成長方法
CA2517024C (en) * 2003-02-24 2009-12-01 Waseda University .beta.-ga2o3 single crystal growing method, thin-film single crystal growing method, ga2o3 light-emitting device, and its manufacturing method
JP4250998B2 (ja) * 2003-04-07 2009-04-08 株式会社デンソー 炭化珪素半導体装置の製造方法
CN100345314C (zh) * 2004-01-18 2007-10-24 泰谷光电科技股份有限公司 氮化镓透明导电氧化膜欧姆电极的制作方法
JP2005235961A (ja) * 2004-02-18 2005-09-02 Univ Waseda Ga2O3系単結晶の導電率制御方法
JP2007254174A (ja) * 2006-03-20 2007-10-04 Nippon Light Metal Co Ltd 酸化ガリウム単結晶及びその製造方法、並びに窒化物半導体用基板及びその製造方法
JP2007317794A (ja) * 2006-05-24 2007-12-06 Mitsubishi Electric Corp 半導体装置およびその製造方法
JP2008156141A (ja) * 2006-12-21 2008-07-10 Koha Co Ltd 半導体基板及びその製造方法
JP2008303119A (ja) * 2007-06-08 2008-12-18 Nippon Light Metal Co Ltd 高機能性Ga2O3単結晶膜及びその製造方法
JP5339698B2 (ja) * 2007-08-20 2013-11-13 新日本無線株式会社 半導体装置の製造方法
JP2009070950A (ja) * 2007-09-12 2009-04-02 Koha Co Ltd 紫外線センサ
JP2009302257A (ja) * 2008-06-12 2009-12-24 Nippon Light Metal Co Ltd 酸化ガリウム単結晶基板用オーミック電極及びその製造方法
CN103765593B (zh) * 2011-09-08 2017-06-09 株式会社田村制作所 Ga2O3系半导体元件
US8951897B2 (en) 2011-09-08 2015-02-10 Tamura Corporation Method for controlling concentration of donor in GA2O3—based single crystal
CN110010670A (zh) * 2011-09-08 2019-07-12 株式会社田村制作所 Ga2O3系MISFET和Ga2O3系MESFET

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