JP5073930B2 - Memsディスプレイ素子へデータを書き込む方法及びシステム - Google Patents
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Description
Claims (48)
- MEMSディスプレイ素子をアクチュエートさせる方法であって、前記MEMSディスプレイ素子は、MEMSディスプレイ素子アレイの一部であり、前記方法は、
ディスプレイ書き込み処理の第一の部分の間、第一の極性の電位差を用いて、ディスプレイデータを、前記MEMSディスプレイ素子に書き込むことと、
前記ディスプレイ書き込み処理の第二の部分の間、前記第一の極性と逆の極性を持つ電位差を用いて、前記ディスプレイデータを、前記MEMSディスプレイ素子に再び書き込むことと、
前記ディスプレイ書き込み処理の第三の部分の間、前記第一の極性を持つ第一のバイアス電位を、前記MEMSディスプレイ素子に印加することと、
前記ディスプレイ書き込み処理の第四の部分の間、前記逆の極性を持つ第二のバイアス電位を、前記MEMSディスプレイ素子に印加することと
を備える方法。 - 前記ディスプレイ書き込み処理の前記第一の部分は、ディスプレイデータの第一のフレームを、前記MEMSディスプレイ素子アレイに書き込むことを含み、前記ディスプレイ書き込み処理の前記第二の部分は、ディスプレイデータの前記第一のフレームを、前記MEMSディスプレイ素子アレイに再び書き込むことを含む請求項1に記載の方法。
- 前記ディスプレイ書き込み処理の前記第三及び第四の部分は、前記再び書き込むことの後に、ディスプレイデータの前記第一のフレームを保持することを含む請求項2に記載の方法。
- 前記書き込むこと、再び書き込むこと、第一のバイアス電圧を印加すること、及び第二のバイアス電圧を印加することを用いて、ディスプレイデータの第二のフレームを書き込むことを更に備える請求項3に記載の方法。
- 前記ディスプレイ書き込み処理の前記第一の部分は、ディスプレイデータの第一の行を、前記MEMSディスプレイ素子アレイに書き込むことを含み、前記ディスプレイ書き込み処理の前記第二の部分は、ディスプレイデータの前記第一の行を、前記MEMSディスプレイ素子アレイに再び書き込むことを含む請求項1に記載の方法。
- 前記ディスプレイ書き込み処理の前記第三及び第四の部分は、前記再び書き込むことの後に、ディスプレイデータの前記第一の行を保持することを備える請求項5に記載の方法。
- 前記書き込むこと、再び書き込むこと、第一のバイアス電圧を印加すること、及び第二のバイアス電圧を印加することを用いて、ディスプレイデータの第二の行を書き込むことを更に備える請求項6に記載の方法。
- 前記ディスプレイ書き込み処理の前記第一、第二、第三、及び第四の部分はそれぞれ、ディスプレイデータのフレームがディスプレイシステムによって取得されるレートの逆数によって定義される時間期間のおおよそ1/4からなる請求項1に記載の方法。
- 前記第一の部分と前記第二の部分とは合わせて、ディスプレイデータのフレームがディスプレイシステムによって取得されるレートの逆数によって定義される時間期間の1/2未満である請求項1に記載の方法。
- 前記第一の部分は、第一の時間期間続き、前記第二の部分は、第二の時間時間続く請求項1に記載の方法。
- 前記第1の時間期間と前記第2の時間期間とは異なっている請求項10に記載の方法。
- 前記第1及び第2の時間期間は、極性に依存する誘電体充電レートに少なくとも部分的に基づいて決定される請求項11に記載の方法。
- MEMSディスプレイ素子のアレイ上のディスプレイデータのフレームを維持する方法であって、
ディスプレイデータのフレームがディスプレイシステムによって取得されるレートの逆数によって少なくとも部分的に定義された時間期間の間、ほぼ等しい逆極性のバイアス電圧を前記MEMSディスプレイ素子に交互に印加することを備える方法。 - 前記時間の期間の各々は、1/(2f)に実質的に等しく、fは、定義されたフレームリフレッシュサイクルの頻度である請求項13に記載の方法。
- 前記時間の期間の各々は、1/(4f)に実質的に等しく、fは、定義されたフレームリフレッシュサイクルの頻度である請求項13に記載の方法。
- ディスプレイデータのフレームを、MEMSディスプレイ素子のアレイに、定義されたフレーム更新期間毎に1フレームの割合で書き込む方法であって、
ディスプレイデータを前記MEMSディスプレイ素子に書き込むことであって、前記書き込むことには、前記フレーム更新期間よりも短い時間を要することと、
極性を交互に変えながらバイアス電位のシリーズを、前記フレーム更新期間の残りについて、前記MEMSディスプレイ素子に印加することと
を備える方法。 - 前記シリーズは、前記フレーム更新期間の残りのおおよそ半分の間、第一の極性を加えることと、前記フレーム更新期間のおおよそ半分の間、第二の逆の極性を加えることとからなる請求項16に記載の方法。
- フレーム更新レートで画像を表示するように構成されたMEMSディスプレイ装置であって、
前記フレーム更新レートはフレーム更新期間を定義しており、前記ディスプレイ装置は、極性バランスしたバイアス電圧のシーケンスを、少なくとも1フレーム更新期間の部分についてMEMSディスプレイアレイの実質的に全ての列に印加するように構成された列ドライバ回路を備え、前記部分は、第一のフレームに対するフレーム書き込み処理を完了することと、次に続くフレームに対するフレーム書き込み処理を開始することとの間の残り時間によって定義されるMEMSディスプレイ装置。 - 前記ドライバ回路は、前記フレーム更新期間の部分の間、前記MEMSディスプレイアレイの実質的に全ての列に同じ電圧を印加するように構成されている請求項18に記載のMEMSディスプレイ装置。
- ディスプレイと、
前記ディスプレイと電気的に通信するプロセッサであって、画像データを処理するように構成されたプロセッサと、
前記プロセッサと電気的に通信するメモリ装置と
を更に備える請求項18に記載のMEMSディスプレイ装置。 - 前記ドライバ回路は、少なくとも一つの信号を前記ディスプレイに送るように構成されている請求項20に記載のMEMSディスプレイ装置。
- 前記画像データの少なくとも一部を前記ドライバ回路に送るように構成されたコントローラを更に備える請求項21に記載のMEMSディスプレイ装置。
- 前記画像データを前記プロセッサに送るように構成された画像ソースモジュールを更に備える請求項20に記載のMEMSディスプレイ装置。
- 前記画像ソースモジュールは、受信機、トランシーバ、及び送信機のうちの少なくとも一つを備える請求項23に記載のMEMSディスプレイ装置。
- 入力データを受信し、前記入力データを前記プロセッサに通信するように構成された入力装置を更に備える請求項20に記載のMEMSディスプレイ装置。
- MEMSディスプレイを駆動する方法であって、
前記ディスプレイの実質的に全てのピクセルを定期的にリリースすることを備え、前記定期的にリリースすることは、1時間のディスプレイ使用毎に1回よりも遅いレートで各ピクセルに対して行われる方法。 - MEMSディスプレイを駆動する方法であって、
前記ディスプレイの実質的に全てのピクセルを定期的にリリースすることを備え、前記定期的にリリースすることは、画像データが100,000回表示されたフレーム毎に1回よりも遅いレートで各ピクセルに対して行われる方法。 - MEMSディスプレイ装置であって、
複数のピクセルを有する画像を表示する手段と、
前記表示する手段の実質的に全てのピクセルを定期的にリリースする手段とを備え、
前記定期的にリリースすることは、画像データが100,000回表示されたフレーム毎に1回よりも遅いレートで各ピクセルに対して行われるMEMSディスプレイ装置。 - 前記表示する手段は、複数の行と列内に配置されたディスプレイ素子のアレイを備える請求項28に記載のMEMSディスプレイ装置。
- 前記アレイは、干渉変調器を備える請求項29に記載のMEMSディスプレイ装置。
- 前記リリースする手段は、極性バランスしたバイアス電圧のシーケンスを、前記アレイの実質的に全ての列に印加するように構成された列ドライバ回路を備える請求項29に記載のMEMSディスプレイ装置。
- 複数のピクセルを有する画像を表示する手段と、
前記表示する手段の実質的に全てのピクセルを定期的にリリースする手段とを備え、
前記定期的にリリースすることは、1時間のディスプレイ使用毎に1回よりも遅いレートで行われるMEMSディスプレイ装置。 - 前記アレイと電気的に通信するプロセッサであって、画像データを処理するように構成されたプロセッサと、
前記プロセッサと電気的に通信するメモリ装置と
を更に備える請求項31に記載のMEMSディスプレイ装置。 - 前記画像データの少なくとも一部を前記ドライバ回路に送るように構成されたコントローラを更に備える請求項33に記載のMEMSディスプレイ装置。
- 前記画像データを前記プロセッサに送るように構成された画像ソースモジュールを更に備える請求項33に記載のMEMSディスプレイ装置。
- 前記画像ソースモジュールは、受信機、トランシーバ、及び送信機のうちの少なくとも一つを備える請求項33に記載のMEMSディスプレイ装置。
- 入力データを受信し、前記入力データを前記プロセッサに通信するように構成された入力装置を更に備える請求項33に記載のMEMSディスプレイ装置。
- フレーム更新レートで画像を表示するように構成されたMEMSディスプレイ装置であって、前記フレーム更新レートはフレーム更新期間を定義しており、前記MEMSディスプレイ装置は、
画像を表示する手段と、
極性バランスしたバイアス電圧のシーケンスを、少なくとも1フレーム更新期間の部分に対して前記表示する手段に印加する手段とを備え、
前記部分は、第一のフレームに対するフレーム書き込み処理を完了することと、次に続くフレームに対するフレーム書き込み処理を開始することとの間の残り時間によって定義されるMEMSディスプレイ装置。 - 前記表示する手段は、複数の行と列内に配置されたMEMS素子のアレイを備える請求項38に記載のMEMSディスプレイ装置。
- 前記アレイは干渉変調器を備える請求項39に記載のMEMSディスプレイ装置。
- 前記印加する手段は、ドライバ回路である請求項39に記載のMEMSディスプレイ装置。
- 前記印加する手段は、プロセッサである請求項39に記載のMEMSディスプレイ装置。
- 前記ドライバ回路は、前記フレーム更新期間の部分の間、前記アレイの実質的に全ての列に同じ電圧を印加するように構成されている請求項41に記載のMEMSディスプレイ装置。
- 前記アレイと電気的に通信するプロセッサであって、画像データを処理するように構成されたプロセッサと、
前記プロセッサと電気的に通信するメモリ装置と
を更に備える請求項41に記載のMEMSディスプレイ装置。 - 前記画像データの少なくとも一部を前記ドライバ回路に送るように構成されたコントローラを更に備える請求項44に記載のMEMSディスプレイ装置。
- 前記画像データを前記プロセッサに送るように構成された画像ソースモジュールを更に備える請求項44に記載のMEMSディスプレイ装置。
- 前記画像ソースモジュールは、受信機、トランシーバ、及び送信機のうちの少なくとも一つを備える請求項46に記載のMEMSディスプレイ装置。
- 入力データを取得し、前記入力データを前記プロセッサに通信するように構成された入力装置を更に備える請求項44に記載のMEMSディスプレイ装置。
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