JP4343974B2 - 画像形成装置 - Google Patents
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Description
ページ記述言語で記述された1頁分の印刷データを複数のバンドに分割したときの各バンドについて、該プログラムは該CPUに対し、(a)該データ領域内の該バンドの印刷データを、1つ以上のブロック毎の中間コードに変換させて該データ領域に格納させ、(b)該バンドの最初のブロックを除き、該圧縮データを、該圧縮・伸長プロセッサを介し伸長させて該データ領域に格納させ、(c)該データ領域に格納されている該バンドの1つのブロックの中間コードをラスタライズさせて該データ領域内のビットマップデータと合成させ、(d)該データ領域内の該バンドのビットマップデータを、該圧縮・伸長プロセッサを介し圧縮させて該データ領域に格納させ、
該データ領域は、それぞれ1バンド分の第1〜3ビットマップデータ領域を有し、
該プログラムは該CPUに対し、該第1〜3ビットマップデータ領域に関する処理が同時に同一種類にならないように該第1〜3ビットマップデータ領域に関する処理を互いにずらして、該第1〜3ビットマップデータ領域の各々に関し種類(b)〜(d)の処理を順次実行させる。
該プログラムは該CPUに対し、該第1〜3ビットマップデータ領域の各々に関し種類(b)〜(d)の各処理が完了したときに該バンド識別コード及び該ブロック識別コードを更新させ、該バンド識別コード及び該ブロック識別コードの値に基づいて、同一バンド同一ブロックについて種類(a)〜(c)の処理がこの順に行われるように制御させる。
該プログラムは該CPUに対し、該第1〜3ビットマップデータ領域の各々に関し種類(a)〜(d)の各処理が完了したときに該バンド識別コード及び該ブロック識別コードを更新させ、該バンド識別コード及び該ブロック識別コードの値に基づいて、同一バンド同一ブロックについて種類(a)〜(c)の処理がこの順に行われるように制御させる。
(b)jがブロック番号最大値je(i)より小さければブロックjを1だけインクリメントさせて、(a)へ戻り、そうでなければ(d)へ進む。
11 CPU
12 EEPROM
121 インタープリタ
122 RIP
123 制御部
13 RAM
131 バッファメモリ
132 ヒープメモリ
133 共有メモリ
133C 圧縮データ領域
133B ビットマップデータ領域
1320 Lバンド配列
1330 Cバンド配列
1331 ブロック最大番号配列
1332 Bバンド配列
1333 バンド・ブロック番号変数群
14 圧縮・伸長プロセッサ
141 圧縮部
142、143 伸長部
15 通信インターフェイス
16 パネルインターフェイス
17 エンジンコントローラ
18 搬送コントローラ
19 バス
20 操作パネル
21 プリントエンジン
22 用紙搬送装置
30 印刷データ
31〜34 図形オブジェクト
40〜43 バンド
Th0〜Th3、Th0A、Th1A、Th2A、ThP スレッド
L0〜Ln ディスプレイリスト
Lij 中間コードブロック
Rij ラスタライズ
Cpq 圧縮
Drs 伸長
BND0〜BND2 バンド
BMP0〜BMP2 サブ領域
Claims (7)
- CPUと、該CPUに結合されプログラムが格納されデータ領域が確保される記憶装置と、ビットマップデータの圧縮と圧縮されたビットマップデータの伸長とを並列に行うことができる専用の圧縮・伸長プロセッサと、を備え、
ページ記述言語で記述された1頁分の印刷データを複数のバンドに分割したときの各バンドについて、該プログラムは該CPUに対し、(a)該データ領域内の該バンドの印刷データを、ブロック毎の中間コードに変換させて該データ領域に格納させ、(b)該バンドの最初のブロックを除き、該バンドの圧縮データを、該圧縮・伸長プロセッサを介し伸長させて該データ領域に格納させ、(c)該データ領域に格納されている該バンドの1つのブロックの中間コードをラスタライズさせて該データ領域内のビットマップデータと合成させ、(d)該データ領域内の該バンドの合成後のビットマップデータを、該圧縮・伸長プロセッサを介し圧縮させて該データ領域に格納させる画像形成装置であって、
該データ領域は、それぞれ1バンド分の第1〜3ビットマップデータ領域を有し、
該プログラムは該CPUに対し、該第1〜3ビットマップデータ領域の各々に関する処理の種類(b)〜(d)が、同時に互いに同一にならないように、該第1〜3ビットマップデータ領域の各々に関し種類(b)〜(d)の処理を循環的に実行させるとともに、種類(a)〜(d)のそれぞれの処理をバンド順次ブロック順次に行わせ、
ここにバンド順次ブロック順次とは、同一ブロックについて3バンドに関し処理対象バンドを順次変化させるという処理を、ブロック順に行うことである、
ことを特徴とする画像形成装置。 - 該プログラムは該CPUに対し、種類(a)と(c)とを交互に処理させることを特徴とする請求項1に記載の画像形成装置。
- 該データ領域にはさらに、種類(b)〜(d)の各々に関し、現在処理対象のバンド識別コードとブロック識別コードとが格納され、
該プログラムは該CPUに対し、該第1〜3ビットマップデータ領域の各々に関し種類(b)〜(d)の各処理が完了したときに該バンド識別コード及び該ブロック識別コードを更新させ、該バンド識別コード及び該ブロック識別コードの値に基づいて、該第1〜3ビットマップデータ領域の各々に関し種類(b)〜(d)の処理を順次実行させる、
ことを特徴とする請求項2に記載の画像形成装置。 - 該プログラムは該CPUに対し、種類(a)と(c)とを並列処理させることを特徴とする請求項1に記載の画像形成装置。
- 該データ領域にはさらに、種類(a)〜(d)の各々に関し、現在処理対象のバンド識別コードとブロック識別コードとが格納され、
該プログラムは該CPUに対し、該第1〜3ビットマップデータ領域の各々に関し種類(a)〜(d)の各処理が完了したときに該バンド識別コード及び該ブロック識別コードを更新させ、該バンド識別コード及び該ブロック識別コードの値に基づいて、該第1〜3ビットマップデータ領域の各々に関し種類(b)〜(d)の処理を順次実行させる、
ことを特徴とする請求項4に記載の画像形成装置。 - 該データ領域は、該バンド毎かつブロック毎の中間コードが格納される領域と、該バンド毎の圧縮データが格納される領域とを有することを特徴とする請求項1乃至5のいずれか1つに記載の画像形成装置。
- 該圧縮・伸長プロセッサは、該CPUに結合されたASICであることを特徴とする請求項1乃至6のいずれか1つに記載の画像形成装置。
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