JP3394636B2 - 誤り訂正方法 - Google Patents
誤り訂正方法Info
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- JP3394636B2 JP3394636B2 JP20356095A JP20356095A JP3394636B2 JP 3394636 B2 JP3394636 B2 JP 3394636B2 JP 20356095 A JP20356095 A JP 20356095A JP 20356095 A JP20356095 A JP 20356095A JP 3394636 B2 JP3394636 B2 JP 3394636B2
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Description
【０００１】
【発明の属する技術分野】本発明は、ＡＴＭセルを伝送
するＡＴＭネットワークにおける誤り訂正方法に関す
る。
するＡＴＭネットワークにおける誤り訂正方法に関す
る。
【０００２】
【従来の技術】図４は、ＡＴＭネットワークのシステム
構成を示す。図において、ＡＴＭ端末１１と基地局１２
は、無線回線１３または有線回線１４を介して接続され
る。基地局１２は、光ファイバ伝送路１５、加入者交換
機１６を介してＡＴＭ網１７に接続される。
構成を示す。図において、ＡＴＭ端末１１と基地局１２
は、無線回線１３または有線回線１４を介して接続され
る。基地局１２は、光ファイバ伝送路１５、加入者交換
機１６を介してＡＴＭ網１７に接続される。
【０００３】本システムでは、ＡＴＭ端末１１と基地局
１２との間で、図５に示すような53バイトのＡＴＭセル
が伝送される。このＡＴＭセルは、５バイトのヘッダと
48バイトの情報ビットから構成される。さらに、ＡＴＭ
セルヘッダは、セルのフロー制御ビットＧＦＣ（４ビッ
ト）、仮想パス識別子ＶＰＩ（８ビット）、仮想チャネ
ル識別子ＶＣＩ（16ビット）、情報の種別ＰＴ（３ビッ
ト）、セル転送の優先順位ＣＬＰ（１ビット）、ヘッダ
誤り制御ビットＨＥＣ（８ビット）から構成される。
１２との間で、図５に示すような53バイトのＡＴＭセル
が伝送される。このＡＴＭセルは、５バイトのヘッダと
48バイトの情報ビットから構成される。さらに、ＡＴＭ
セルヘッダは、セルのフロー制御ビットＧＦＣ（４ビッ
ト）、仮想パス識別子ＶＰＩ（８ビット）、仮想チャネ
ル識別子ＶＣＩ（16ビット）、情報の種別ＰＴ（３ビッ
ト）、セル転送の優先順位ＣＬＰ（１ビット）、ヘッダ
誤り制御ビットＨＥＣ（８ビット）から構成される。
【０００４】ＡＴＭ網１７では、ＶＰＩおよびＶＣＩに
設定されるＡＴＭチャネル番号が従来のディジタル回線
交換におけるタイムスロットの役割を果たす。したがっ
て、ＡＴＭチャネル番号情報に誤りが生じると信号が相
手先に伝わらなくなるだけでなく、ときには他の利用者
に誤伝送されるなど伝送路に及ぼす影響が大きい。そこ
で、ＡＴＭチャネル番号の誤りを訂正するために、ＡＴ
Ｍセルヘッダにはヘッダ誤り制御ビットＨＥＣが設けら
れている。加入者交換機１６は、ＡＴＭセルを受け取る
とＡＴＭセルヘッダの１ビット誤り訂正を行い、複数ビ
ット誤った場合にはそのＡＴＭセルを廃棄する。
設定されるＡＴＭチャネル番号が従来のディジタル回線
交換におけるタイムスロットの役割を果たす。したがっ
て、ＡＴＭチャネル番号情報に誤りが生じると信号が相
手先に伝わらなくなるだけでなく、ときには他の利用者
に誤伝送されるなど伝送路に及ぼす影響が大きい。そこ
で、ＡＴＭチャネル番号の誤りを訂正するために、ＡＴ
Ｍセルヘッダにはヘッダ誤り制御ビットＨＥＣが設けら
れている。加入者交換機１６は、ＡＴＭセルを受け取る
とＡＴＭセルヘッダの１ビット誤り訂正を行い、複数ビ
ット誤った場合にはそのＡＴＭセルを廃棄する。
【０００５】ところで、無線回線のように符号誤りが発
生する伝送路では、伝送品質向上のために誤り訂正技術
が不可欠である。本システムにおいても、無線回線１３
で接続されたＡＴＭ端末１１と基地局１２との間で、所
定のビット誤り率を得るとともに信号の誤伝送を防止す
るためには、ＡＴＭセルヘッダのビット誤りを訂正して
有線回線と同様のセル廃棄率を実現する必要がある。
生する伝送路では、伝送品質向上のために誤り訂正技術
が不可欠である。本システムにおいても、無線回線１３
で接続されたＡＴＭ端末１１と基地局１２との間で、所
定のビット誤り率を得るとともに信号の誤伝送を防止す
るためには、ＡＴＭセルヘッダのビット誤りを訂正して
有線回線と同様のセル廃棄率を実現する必要がある。
【０００６】図６は、従来の第１の誤り訂正方法を示
す。送信側のＡＴＭ端末では、(1) ＡＴＭセルを複数個
並べてビット列を構成し、(2) 複数のブロックに分割
し、(3) 各ブロックに誤り訂正用の冗長ビットを付加
し、(4) 回線に送出する。受信側の基地局では、ブロッ
クごとに符号誤りを訂正して加入者交換機に送出する。
加入者交換機では、ヘッダ誤り制御ビットＨＥＣを用い
て、ＡＴＭセルヘッダの誤り検出および訂正を行う。な
お、ＨＥＣは、１ビット訂正であるので、２ビット以上
誤った場合にはそのＡＴＭセルは廃棄される。
す。送信側のＡＴＭ端末では、(1) ＡＴＭセルを複数個
並べてビット列を構成し、(2) 複数のブロックに分割
し、(3) 各ブロックに誤り訂正用の冗長ビットを付加
し、(4) 回線に送出する。受信側の基地局では、ブロッ
クごとに符号誤りを訂正して加入者交換機に送出する。
加入者交換機では、ヘッダ誤り制御ビットＨＥＣを用い
て、ＡＴＭセルヘッダの誤り検出および訂正を行う。な
お、ＨＥＣは、１ビット訂正であるので、２ビット以上
誤った場合にはそのＡＴＭセルは廃棄される。
【０００７】このような誤り訂正方法では、ブロックの
中の１つのＡＴＭセル中に符号誤りが生じた場合に、訂
正しきれなかった残留誤りはブロック全体に広がること
になり、誤りが生じていなかったＡＴＭセルに誤りを生
じさせてしまうおそれがある。それを防ぐには、図７に
示すように１つのＡＴＭセルを１ブロックとする方法が
考えられる。すなわち、送信側のＡＴＭ端末では、(1)
１つのＡＴＭセルを１ブロックとし、(2) 各ブロックに
誤り訂正用の冗長ビットを付加し、(3) 回線に送出す
る。受信側の基地局では、ＡＴＭセル全体について符号
誤りを訂正して加入者交換機に送出する。加入者交換機
では、ヘッダ誤り制御ビットＨＥＣを用いて、ＡＴＭセ
ルヘッダの誤り検出および訂正を行う。しかし、ＡＴＭ
セルごとに誤り訂正を行ったとしても、訂正しきれなか
った残留誤りがＡＴＭセルヘッダに残ることがある。こ
の場合には、ＡＴＭセルヘッダに用いられている誤り訂
正が１ビット訂正であるので、訂正しきれずにヘッダ誤
りとなり、ＡＴＭセル全体が廃棄されるおそれがある。
中の１つのＡＴＭセル中に符号誤りが生じた場合に、訂
正しきれなかった残留誤りはブロック全体に広がること
になり、誤りが生じていなかったＡＴＭセルに誤りを生
じさせてしまうおそれがある。それを防ぐには、図７に
示すように１つのＡＴＭセルを１ブロックとする方法が
考えられる。すなわち、送信側のＡＴＭ端末では、(1)
１つのＡＴＭセルを１ブロックとし、(2) 各ブロックに
誤り訂正用の冗長ビットを付加し、(3) 回線に送出す
る。受信側の基地局では、ＡＴＭセル全体について符号
誤りを訂正して加入者交換機に送出する。加入者交換機
では、ヘッダ誤り制御ビットＨＥＣを用いて、ＡＴＭセ
ルヘッダの誤り検出および訂正を行う。しかし、ＡＴＭ
セルごとに誤り訂正を行ったとしても、訂正しきれなか
った残留誤りがＡＴＭセルヘッダに残ることがある。こ
の場合には、ＡＴＭセルヘッダに用いられている誤り訂
正が１ビット訂正であるので、訂正しきれずにヘッダ誤
りとなり、ＡＴＭセル全体が廃棄されるおそれがある。
【０００８】
【発明が解決しようとする課題】ここで、ＡＴＭセルの
廃棄率を低減するには、伝送路における誤り訂正を強力
にする必要があるが、そのために誤り訂正用の冗長ビッ
ト数を増大すると回線効率が低下する。なお、回線効率
とは、冗長ビットを含めた信号全体に対する有効な情報
の占める割合である。
廃棄率を低減するには、伝送路における誤り訂正を強力
にする必要があるが、そのために誤り訂正用の冗長ビッ
ト数を増大すると回線効率が低下する。なお、回線効率
とは、冗長ビットを含めた信号全体に対する有効な情報
の占める割合である。
【０００９】図８は、訂正ビット数とＡＴＭセル廃棄率
および回線効率との関係を示す。ここでは、ＡＴＭセル
を２ブロックに分割してＢＣＨ符号を用いて誤り訂正を
行った場合を示す。(1) は、１ビット訂正〜４ビット訂
正（２ブロックのためにＡＴＭセル全体で２ビット訂正
〜８ビット訂正）において、誤り訂正前のビット誤り率
とセル廃棄率との関係を示す。なお、（255,247)とは、
247ビットの情報ビットに対して伝送する信号が 255ビ
ット（冗長ビットが８ビット）であることを示す。(2)
は、訂正ビット数と回線効率との関係を示す。
および回線効率との関係を示す。ここでは、ＡＴＭセル
を２ブロックに分割してＢＣＨ符号を用いて誤り訂正を
行った場合を示す。(1) は、１ビット訂正〜４ビット訂
正（２ブロックのためにＡＴＭセル全体で２ビット訂正
〜８ビット訂正）において、誤り訂正前のビット誤り率
とセル廃棄率との関係を示す。なお、（255,247)とは、
247ビットの情報ビットに対して伝送する信号が 255ビ
ット（冗長ビットが８ビット）であることを示す。(2)
は、訂正ビット数と回線効率との関係を示す。
【００１０】本発明は、ＡＴＭセルを伝送するＡＴＭネ
ットワークにおいて、回線効率を低下させずにセル廃棄
率を低下させることができる誤り訂正方法を提供するこ
とを目的とする。
ットワークにおいて、回線効率を低下させずにセル廃棄
率を低下させることができる誤り訂正方法を提供するこ
とを目的とする。
【００１１】
【課題を解決するための手段】本発明は、ＡＴＭセルの
ＡＴＭセルヘッダと情報ビットを分離し、それぞれ個別
に冗長ビットを付加し、それぞれ個別に誤り訂正を行う
方法をとる。このとき、情報ビットに対する冗長ビット
の割合より、ＡＴＭセルヘッダに対する冗長ビットの割
合を大きくすることにより、ＡＴＭセルヘッダに対する
誤り訂正能力を相対的に高め、セル廃棄率を低減する。
ＡＴＭセルヘッダと情報ビットを分離し、それぞれ個別
に冗長ビットを付加し、それぞれ個別に誤り訂正を行う
方法をとる。このとき、情報ビットに対する冗長ビット
の割合より、ＡＴＭセルヘッダに対する冗長ビットの割
合を大きくすることにより、ＡＴＭセルヘッダに対する
誤り訂正能力を相対的に高め、セル廃棄率を低減する。
【００１２】また、ＡＴＭセルヘッダからヘッダ誤り制
御用ビットを削除し、残りのＡＴＭセルヘッダに対して
冗長ビットを付加する誤り訂正方法により、信号全体に
占める冗長ビットの割合を小さくする。また、受信側で
は、誤り訂正を行ったＡＴＭセルヘッダからヘッダ誤り
制御用ビットを求めて付加することにより、完全なＡＴ
Ｍセルヘッダを復元することができる。
御用ビットを削除し、残りのＡＴＭセルヘッダに対して
冗長ビットを付加する誤り訂正方法により、信号全体に
占める冗長ビットの割合を小さくする。また、受信側で
は、誤り訂正を行ったＡＴＭセルヘッダからヘッダ誤り
制御用ビットを求めて付加することにより、完全なＡＴ
Ｍセルヘッダを復元することができる。
【００１３】
【発明の実施の形態】図１は、本発明の誤り訂正方法の
第１の実施形態を示す。ここでは、ＡＴＭ端末から基地
局に伝送する場合を示すが、基地局からＡＴＭ端末に伝
送する場合でも同様である。図において、送信側のＡＴ
Ｍ端末では、(1) 53バイトのＡＴＭセルを５バイトのＡ
ＴＭセルヘッダと48バイトの情報ビットに分離し、(2)
それぞれに誤り訂正用の所定の冗長ビットを付加し、
(3) 回線に送出する。
第１の実施形態を示す。ここでは、ＡＴＭ端末から基地
局に伝送する場合を示すが、基地局からＡＴＭ端末に伝
送する場合でも同様である。図において、送信側のＡＴ
Ｍ端末では、(1) 53バイトのＡＴＭセルを５バイトのＡ
ＴＭセルヘッダと48バイトの情報ビットに分離し、(2)
それぞれに誤り訂正用の所定の冗長ビットを付加し、
(3) 回線に送出する。
【００１４】受信側の基地局では、ＡＴＭセルヘッダお
よび情報ビットについて、それぞれ個別に符号誤りを訂
正し、再び53バイトのＡＴＭセルを構成して加入者交換
機に送出する。なお、ＡＴＭセルヘッダに誤りが残った
場合には、そのＡＴＭセルを廃棄する。加入者交換機で
は、ヘッダ誤り制御ビットＨＥＣを用いて、ＡＴＭセル
ヘッダの誤り検出および訂正を行う。なお、ＨＥＣは、
１ビット訂正であるので、２ビット以上誤った場合には
そのＡＴＭセルは廃棄される。
よび情報ビットについて、それぞれ個別に符号誤りを訂
正し、再び53バイトのＡＴＭセルを構成して加入者交換
機に送出する。なお、ＡＴＭセルヘッダに誤りが残った
場合には、そのＡＴＭセルを廃棄する。加入者交換機で
は、ヘッダ誤り制御ビットＨＥＣを用いて、ＡＴＭセル
ヘッダの誤り検出および訂正を行う。なお、ＨＥＣは、
１ビット訂正であるので、２ビット以上誤った場合には
そのＡＴＭセルは廃棄される。
【００１５】ここで、48バイトの情報ビットに対する冗
長ビットの割合より、５バイトのＡＴＭセルヘッダに対
する冗長ビットの割合を大きくし、ＡＴＭセルヘッダに
対する誤り訂正能力を相対的に高める。例えば、ＢＣＨ
符号を用いて誤り訂正を行う場合に、従来方法により伝
送路のビット誤り率10-4に対してセル廃棄率10-9を得る
には、８ビット訂正（図８ではＡＴＭセルを２ブロック
に分割しているので４ビット訂正）が必要であった。す
なわち、53バイト(424ビット）のＡＴＭセル全体に64ビ
ットの冗長ビットを付加して８ビット訂正を行う必要が
あった。一方、本実施形態では、５バイト（40ビット）
のＡＴＭセルヘッダに28ビットの冗長ビットを付加して
４ビット訂正を行い、48バイト(384ビット）の情報ビッ
トに32ビットの冗長ビットを付加して４ビット訂正を行
い、全体として８ビット訂正とする。これにより、ＡＴ
Ｍセルヘッダに対する誤り訂正能力が相対的に向上し、
セル廃棄率を大幅に低減させることができる。具体的改
善例は第２の実施形態において示す。
長ビットの割合より、５バイトのＡＴＭセルヘッダに対
する冗長ビットの割合を大きくし、ＡＴＭセルヘッダに
対する誤り訂正能力を相対的に高める。例えば、ＢＣＨ
符号を用いて誤り訂正を行う場合に、従来方法により伝
送路のビット誤り率10-4に対してセル廃棄率10-9を得る
には、８ビット訂正（図８ではＡＴＭセルを２ブロック
に分割しているので４ビット訂正）が必要であった。す
なわち、53バイト(424ビット）のＡＴＭセル全体に64ビ
ットの冗長ビットを付加して８ビット訂正を行う必要が
あった。一方、本実施形態では、５バイト（40ビット）
のＡＴＭセルヘッダに28ビットの冗長ビットを付加して
４ビット訂正を行い、48バイト(384ビット）の情報ビッ
トに32ビットの冗長ビットを付加して４ビット訂正を行
い、全体として８ビット訂正とする。これにより、ＡＴ
Ｍセルヘッダに対する誤り訂正能力が相対的に向上し、
セル廃棄率を大幅に低減させることができる。具体的改
善例は第２の実施形態において示す。
【００１６】また、上記の例において、従来方法におけ
る回線効率は、 424／(424＋64) ≒0.869 であり、本実施形態における回線効率は、 424／(424＋28＋32) ≒0.876 であるので、若干の向上が期待できる。
る回線効率は、 424／(424＋64) ≒0.869 であり、本実施形態における回線効率は、 424／(424＋28＋32) ≒0.876 であるので、若干の向上が期待できる。
【００１７】図２は、本発明の誤り訂正方法の第２の実
施形態を示す。ここでは、ＡＴＭ端末から基地局に伝送
する場合を示すが、基地局からＡＴＭ端末に伝送する場
合でも同様である。図において、送信側のＡＴＭ端末で
は、(1) 53バイトのＡＴＭセルを５バイトのＡＴＭセル
ヘッダと48バイトの情報ビットに分離し、(2) ヘッダ誤
り制御ビットＨＥＣを削除した４バイトのＡＴＭセルヘ
ッダと、情報ビットのそれぞれに誤り訂正用の所定の冗
長ビットを付加し、(3) 回線に送出する。第１の実施形
態とはＡＴＭセルヘッダからＨＥＣを削除して冗長ビッ
トを付加する点が異なる。
施形態を示す。ここでは、ＡＴＭ端末から基地局に伝送
する場合を示すが、基地局からＡＴＭ端末に伝送する場
合でも同様である。図において、送信側のＡＴＭ端末で
は、(1) 53バイトのＡＴＭセルを５バイトのＡＴＭセル
ヘッダと48バイトの情報ビットに分離し、(2) ヘッダ誤
り制御ビットＨＥＣを削除した４バイトのＡＴＭセルヘ
ッダと、情報ビットのそれぞれに誤り訂正用の所定の冗
長ビットを付加し、(3) 回線に送出する。第１の実施形
態とはＡＴＭセルヘッダからＨＥＣを削除して冗長ビッ
トを付加する点が異なる。
【００１８】受信側の基地局では、(1) ＨＥＣを除くＡ
ＴＭセルヘッダおよび情報ビットについて、それぞれ個
別に符号誤りを訂正する。なお、ＡＴＭセルヘッダに誤
りが残った場合には、そのＡＴＭセルを廃棄する。(2)
誤り訂正後のＡＴＭセルヘッダ（ＡＴＭチャネル番号）
からＨＥＣを求めて付加し、完全な53バイトのＡＴＭセ
ルを構成して加入者交換機に送出する。加入者交換機で
は、ＨＥＣを用いて、ＡＴＭセルヘッダの誤り検出およ
び訂正を行う。なお、ＨＥＣは、１ビット訂正であるの
で、２ビット以上誤った場合にはそのＡＴＭセルは廃棄
される。
ＴＭセルヘッダおよび情報ビットについて、それぞれ個
別に符号誤りを訂正する。なお、ＡＴＭセルヘッダに誤
りが残った場合には、そのＡＴＭセルを廃棄する。(2)
誤り訂正後のＡＴＭセルヘッダ（ＡＴＭチャネル番号）
からＨＥＣを求めて付加し、完全な53バイトのＡＴＭセ
ルを構成して加入者交換機に送出する。加入者交換機で
は、ＨＥＣを用いて、ＡＴＭセルヘッダの誤り検出およ
び訂正を行う。なお、ＨＥＣは、１ビット訂正であるの
で、２ビット以上誤った場合にはそのＡＴＭセルは廃棄
される。
【００１９】ここで、48バイトの情報ビットに対する冗
長ビットの割合より、ＨＥＣを除く４バイトのＡＴＭセ
ルヘッダに対する冗長ビットの割合を大きくし、ＡＴＭ
セルヘッダに対する誤り訂正能力を相対的に高める。本
実施形態では、ＨＥＣを除く４バイト（32ビット）のＡ
ＴＭセルヘッダに24ビットの冗長ビットを付加して４ビ
ット訂正を行い、48バイト(384ビット）の情報ビットに
32ビットの冗長ビットを付加して４ビット訂正（２ブロ
ックに分割する場合にはそれぞれ２ビット訂正）を行
い、全体として８ビット訂正とする。これにより、ＡＴ
Ｍセルヘッダに対する誤り訂正能力が相対的に向上す
る。この場合のセル廃棄率を図３に示す。図３に示すよ
うに、ＡＴＭセルヘッダと情報ビットに分割してそれぞ
れで４ビット訂正を行うことにより、セル廃棄率を大幅
に低減できることがわかる。
長ビットの割合より、ＨＥＣを除く４バイトのＡＴＭセ
ルヘッダに対する冗長ビットの割合を大きくし、ＡＴＭ
セルヘッダに対する誤り訂正能力を相対的に高める。本
実施形態では、ＨＥＣを除く４バイト（32ビット）のＡ
ＴＭセルヘッダに24ビットの冗長ビットを付加して４ビ
ット訂正を行い、48バイト(384ビット）の情報ビットに
32ビットの冗長ビットを付加して４ビット訂正（２ブロ
ックに分割する場合にはそれぞれ２ビット訂正）を行
い、全体として８ビット訂正とする。これにより、ＡＴ
Ｍセルヘッダに対する誤り訂正能力が相対的に向上す
る。この場合のセル廃棄率を図３に示す。図３に示すよ
うに、ＡＴＭセルヘッダと情報ビットに分割してそれぞ
れで４ビット訂正を行うことにより、セル廃棄率を大幅
に低減できることがわかる。
【００２０】また、本実施形態における回線効率は、Ｈ
ＥＣを除く52バイト(416ビット）の信号に対して56ビッ
トの冗長ビットが付加されるので、 416／(416＋56) ≒0.881 となり、第１の実施形態よりもさらに若干の向上が期待
される。また、本発明の誤り訂正方法によれば、ＡＴＭ
セルの廃棄率と情報の品質の設計をそれぞれ個別に行う
ことが可能となる。
ＥＣを除く52バイト(416ビット）の信号に対して56ビッ
トの冗長ビットが付加されるので、 416／(416＋56) ≒0.881 となり、第１の実施形態よりもさらに若干の向上が期待
される。また、本発明の誤り訂正方法によれば、ＡＴＭ
セルの廃棄率と情報の品質の設計をそれぞれ個別に行う
ことが可能となる。
【００２１】
【発明の効果】以上説明したように、本発明の誤り訂正
方法では、ＡＴＭセルをＡＴＭセルヘッダと情報ビット
に分離してそれぞれ個別に誤り訂正を行い、かつＡＴＭ
セルヘッダに対する誤り訂正能力を相対的に高めること
により、回線効率を下げることなくセル廃棄率を低減す
ることができる。
方法では、ＡＴＭセルをＡＴＭセルヘッダと情報ビット
に分離してそれぞれ個別に誤り訂正を行い、かつＡＴＭ
セルヘッダに対する誤り訂正能力を相対的に高めること
により、回線効率を下げることなくセル廃棄率を低減す
ることができる。
【図１】本発明の誤り訂正方法の第１の実施形態を示す
図。
図。
【図２】本発明の誤り訂正方法の第２の実施形態を示す
図。
図。
【図３】第２の実施形態におけるセル廃棄率を示す図。
【図４】ＡＴＭネットワークのシステム構成を示す図。
【図５】ＡＴＭセルの構成を示す図。
【図６】従来の第１の誤り訂正方法を示す図。
【図７】従来の第２の誤り訂正方法を示す図。
【図８】訂正ビット数とＡＴＭセル廃棄率および回線効
率との関係を示す図。
率との関係を示す図。
１１ ＡＴＭ端末
１２ 基地局
１３ 無線回線
１４ 有線回線
１５ 光ファイバ伝送路
１６ 加入者交換機
１７ ＡＴＭ網
フロントページの続き
(72)発明者 梅比良 正弘
東京都千代田区内幸町１丁目１番６号
日本電信電話株式会社内
(56)参考文献 特開 昭59−79658（ＪＰ，Ａ)
特開 昭63−48030（ＪＰ，Ａ)
特開 平３−238950（ＪＰ，Ａ)
特公 平５−8897（ＪＰ，Ｂ２)
特公 平４−81905（ＪＰ，Ｂ２)
1996信学総合大会 Ｂ−462
(58)調査した分野(Int.Cl.7，ＤＢ名)
H04L 12/56
Claims (2)
- 【請求項１】 ＡＴＭセルヘッダと情報ビットから構成
されるＡＴＭセルを用いて情報を伝送するＡＴＭネット
ワークで、伝送信号に付加された冗長ビットを用いて伝
送路で生ずる符号誤りを訂正する誤り訂正方法におい
て、前記ＡＴＭセルヘッダと前記情報ビットを分離し、
前記ＡＴＭセルヘッダからヘッダ誤り制御用ビットを削
除したＡＴＭセルヘッダと前記情報ビットに、それぞれ
個別に冗長ビットを付加し、それぞれ個別に誤り訂正を
行うとともに、前記情報ビットに対する冗長ビットの割
合より、前記ヘッダ誤り制御用ビットを削除したＡＴＭ
セルヘッダに対する冗長ビットの割合を大きくしたこと
を特徴とする誤り訂正方法。 - 【請求項２】 請求項１に記載の誤り訂正方法におい
て、誤り訂正を行ったＡＴＭセルヘッダからヘッダ誤り
制御用ビットを求め、そのヘッダ誤り制御用ビットを含
むＡＴＭセルヘッダを復元することを特徴とする誤り訂
正方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20356095A JP3394636B2 (ja) | 1995-08-09 | 1995-08-09 | 誤り訂正方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20356095A JP3394636B2 (ja) | 1995-08-09 | 1995-08-09 | 誤り訂正方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0951337A JPH0951337A (ja) | 1997-02-18 |
| JP3394636B2 true JP3394636B2 (ja) | 2003-04-07 |
Family
ID=16476166
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
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