JP3386713B2 - Method for manufacturing active matrix display device - Google Patents

Method for manufacturing active matrix display device

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JP3386713B2
JP3386713B2 JP7305198A JP7305198A JP3386713B2 JP 3386713 B2 JP3386713 B2 JP 3386713B2 JP 7305198 A JP7305198 A JP 7305198A JP 7305198 A JP7305198 A JP 7305198A JP 3386713 B2 JP3386713 B2 JP 3386713B2
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crystalline semiconductor
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Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【発明の属する技術分野】本発明は、レーザー光によっ
て絶縁基板上に絶縁ゲイト型半導体を歩留まりよく多数
形成した集積回路を有する半導体装置に関する。より具
体的には、レーザー光の照射によって、アクティブマト
リクス回路および周辺駆動回路の半導体素材を結晶化し
て歩留まりよく多数の絶縁型半導体を形成した集積回路
を備える半導体装置に関する。そして、本発明による半
導体装置は、液晶ディスプレー等のアクティブマトリク
スやイメージセンサー等の駆動回路、あるいはSOI集
積回路や従来の半導体集積回路(マイクロプロセッサー
やマイクロコントローラ、マイクロコンピュータ、ある
いは半導体メモリー等)における薄膜トランジスタとし
て使用されるものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a semiconductor device having an integrated circuit in which a large number of insulating gate type semiconductors are formed on an insulating substrate with a high yield by laser light. More specifically, the present invention relates to a semiconductor device including an integrated circuit in which a semiconductor material of an active matrix circuit and a peripheral drive circuit is crystallized by laser light irradiation and a large number of insulating semiconductors are formed with high yield. The semiconductor device according to the present invention is a thin film transistor in an active matrix such as a liquid crystal display, a drive circuit such as an image sensor, an SOI integrated circuit, or a conventional semiconductor integrated circuit (microprocessor, microcontroller, microcomputer, semiconductor memory, or the like). Is used as.

【0002】[0002]

【従来の技術】近年、絶縁基板上に絶縁ゲイト型半導体
装置(MOSFET)を形成する研究が盛んに成されて
いる。このように絶縁基板上に半導体集積回路を形成す
ることは回路の高速駆動の上で有利である。なぜなら、
従来の半導体集積回路の速度は主として配線と基板との
容量(浮遊容量)によって制限されていたのに対し、絶
縁基板上ではこのような浮遊容量が存在しないからであ
る。このように絶縁基板上に形成され、薄膜状の活性層
を有するMOSFETを薄膜トランジスタ(TFT)と
いう。従来の半導体集積回路においても、例えばSRA
Mの負荷トランジスタとしてTFTが使用されている。
2. Description of the Related Art Recently, much research has been done on forming an insulating gate type semiconductor device (MOSFET) on an insulating substrate. Forming the semiconductor integrated circuit on the insulating substrate in this manner is advantageous for high-speed driving of the circuit. Because
This is because the speed of the conventional semiconductor integrated circuit is limited mainly by the capacitance (stray capacitance) between the wiring and the substrate, but such stray capacitance does not exist on the insulating substrate. A MOSFET having a thin film-like active layer formed on an insulating substrate in this manner is called a thin film transistor (TFT). Even in the conventional semiconductor integrated circuit, for example, SRA
A TFT is used as the M load transistor.

【0003】また、最近になって、透明な基板上に半導
体集積回路を形成する必要のある製品が出現した。例え
ば、液晶ディスプレーやイメージセンサーというような
光デバイスの駆動回路である。ここにもTFTが用いら
れている。これらの回路は大面積に形成することが要求
されるのでTFT作製プロセスの低温化が求められてい
る。また、例えば、絶縁基板上に多数の端子を有する装
置で、該端子を半導体集積回路に接続する必要がある場
合にも、実装密度を低減するために、半導体集積回路の
最初の方の段、あるいは半導体集積回路そのものを、同
じ絶縁基板上にモノリシックに形成することも考えられ
ている。
Further, recently, a product requiring the formation of a semiconductor integrated circuit on a transparent substrate has appeared. For example, it is a drive circuit for an optical device such as a liquid crystal display or an image sensor. A TFT is also used here. Since these circuits are required to be formed in a large area, it is required to lower the temperature of the TFT manufacturing process. Further, for example, in a device having a large number of terminals on an insulating substrate, even when it is necessary to connect the terminals to the semiconductor integrated circuit, in order to reduce the mounting density, the first stage of the semiconductor integrated circuit, Alternatively, it is considered that the semiconductor integrated circuit itself is monolithically formed on the same insulating substrate.

【0004】従来、TFTは、アモルファスもしくはセ
ミアモルファス、あるいは微結晶の半導体被膜を450
℃〜1200℃の温度でアニールすることによって、結
晶性を改善し、良質な(すなわち、移動度の十分に大き
な)半導体被膜に改善することがなされてきた。半導体
被膜にアモルファス材料を使用するアモルファスTFT
もあるが、移動度が5cm2 /Vs以下、通常は1cm
2/Vs程度と小さく、動作速度の点から、また、Pチ
ャネル型のTFTが得られない点からその利用は大きく
制限されている。移動度が5cm2/Vs以上のTFT
を得るには、上記のような温度でのアニールが必要であ
った。また、このようなアニールによってPチャネル型
TFT(PTFT)を形成することができた。
Conventionally, a TFT is provided with an amorphous, semi-amorphous, or microcrystalline semiconductor film 450.
It has been attempted to improve the crystallinity and improve the quality of the semiconductor film (that is, the mobility is sufficiently high) by annealing at a temperature of ℃ to 1200 ℃. Amorphous TFT using amorphous material for semiconductor film
However, mobility is 5 cm 2 / Vs or less, usually 1 cm
Its use is greatly limited because it is as small as 2 / Vs, the operating speed is low, and a P-channel TFT cannot be obtained. TFT with mobility of 5 cm 2 / Vs or more
In order to obtain, it was necessary to anneal at the above temperature. Moreover, a P-channel TFT (PTFT) could be formed by such annealing.

【0005】[0005]

【発明が解決しようとする課題】しかしながら、このよ
うな熱的なプロセスでは、基板材料等が著しい制約を受
けた。すなわち、いわゆる高温プロセス(最高プロセス
温度が900〜1200℃のプロセス)では、ゲイト酸
化膜として質のよい熱酸化膜が使用できるのであるが、
基板は石英やサファイヤ、スピネルのような高価で大面
積化の困難な材料しか使用できなかった。
However, in such a thermal process, the substrate material and the like are significantly restricted. That is, in a so-called high temperature process (process having a maximum process temperature of 900 to 1200 ° C.), a high quality thermal oxide film can be used as a gate oxide film.
Only expensive materials such as quartz, sapphire, and spinel that are difficult to increase in area can be used for the substrate.

【0006】これに対し、低温アニールプロセス(最高
プロセス温度が450〜650℃のプロセスで、アモル
ファス状もしくはそれと同等な結晶性の低い状態の半導
体をこの程度の温度でアニールすることを特徴とする)
では、高温プロセスよりも基板材料の選択の巾は広がる
が、得られるTFTの特性(例えば、ON電流とOFF
電流の比率や移動度)に関しては必ずしも満足なものは
得られていない。例えば、TFTをアクティブマトリク
ス型液晶表示装置に利用する場合、このような低温アニ
ールプロセスによって得られるTFTはアクティブマト
リクスのTFTとしては十分な特性を示すものであった
が、周辺回路に使用するには移動度が満足できるもので
はなかった。例えば、液晶表示装置等のデバイスに高速
駆動(移動度が5cm2/Vs以上)を使用するメリッ
トは、このような周辺回路までも同じプロセスによって
作製することにあるのだが、このように要求される特性
に応じてTFTを作り分けるという技術に関しては、こ
れまで特に考慮されることはなかった。
On the other hand, a low temperature annealing process (characterized by annealing a semiconductor in an amorphous state or a state of low crystallinity equivalent thereto at a temperature of this level in a process having a maximum process temperature of 450 to 650 ° C.)
So, although the range of choice of substrate material is wider than that of high temperature process, the characteristics of the obtained TFT (for example, ON current and OFF
Satisfactory results have not been obtained for the current ratio and mobility. For example, when the TFT is used in an active matrix type liquid crystal display device, the TFT obtained by such a low temperature annealing process has sufficient characteristics as an active matrix TFT, but is not suitable for use in peripheral circuits. Mobility was not satisfactory. For example, the advantage of using high-speed driving (mobility of 5 cm 2 / Vs or more) for a device such as a liquid crystal display device is that even such peripheral circuits are manufactured by the same process. Up to now, no particular consideration has been given to the technique of separately manufacturing TFTs according to the characteristics.

【0007】本発明はこのような現状を顧みてなされた
ものであり、本発明者は、例えば1枚の基板上に高速・
高移動度のTFTを作製する一方で、低OFF電流のT
FTも作製するというように、特性の異なったTFTを
同一基板上に同一プロセスで作製するための最適な方法
を開発したものであり、本発明では、これによって製造
された、従来得られることのなかった優れた電気的特性
を有する半導体装置を提供するものである。
The present invention has been made in consideration of such a current situation.
While making a TFT with high mobility, T with low OFF current
The inventors have developed an optimum method for manufacturing TFTs having different characteristics on the same substrate by the same process such as manufacturing FT. In the present invention, the method produced by this method can be obtained conventionally. The present invention provides a semiconductor device having excellent electric characteristics that has not been obtained.

【0008】[0008]

【課題を解決するための手段】本発明では、従来のよう
な熱平衡的なプロセスに加えて、パルスレーザー光の照
射によって半導体被膜の結晶性の改善をおこなうことに
よって、得られるTFTの特性を制御することを特徴と
するものである。例えば、低温アニールプロセスとパル
スレーザー照射を組み合わせることやパルスレーザー照
射の条件を変化させることによって上記の目的を達成す
る。
According to the present invention, in addition to the conventional thermal equilibrium process, the crystallinity of a semiconductor film is improved by irradiation with a pulsed laser beam to control the characteristics of the obtained TFT. It is characterized by doing. For example, the above object is achieved by combining a low-temperature annealing process and pulsed laser irradiation or changing the conditions of pulsed laser irradiation.

【0009】例えば、パルスレーザーの照射によって得
られる結晶性シリコンを用いたTFTは、極めて高速・
高移動度であるが、パルスレーザーの照射はバッチ処理
ができず、現状のレーザーにおいては、400mm×3
00mm基板を1枚処理するのにおよそ1分を要する。
一方、低温アニールプロセスでは、バッチ処理が可能
で、例えば、シリコン膜中の酸素濃度が1018cm2
Vs以下であれば、550℃、1時間のアニールによっ
て、通常の表示に使用するようなアクティブマトリクス
として使用するには十分な特性のTFTが得られ、さら
に、時間を短縮することも可能である。例えば、60枚
の基板を同時に処理すれば、レーザー照射のプロセスと
同じだけのタクトが可能であり、ランニングコストを考
慮すれば、がぜん低温アニール処理プロセスが有利にな
る。
For example, a TFT using crystalline silicon obtained by irradiating a pulsed laser is extremely fast.
Despite its high mobility, pulse laser irradiation does not allow batch processing, and the current laser is 400 mm x 3
It takes about 1 minute to process one 00 mm substrate.
On the other hand, in the low temperature annealing process, batch processing is possible and, for example, the oxygen concentration in the silicon film is 10 18 cm 2 /
If it is Vs or lower, annealing at 550 ° C. for 1 hour can provide a TFT having characteristics sufficient for use as an active matrix used for normal display, and further, it is possible to shorten the time. . For example, if 60 substrates are processed at the same time, the same takt time as the laser irradiation process can be obtained. Considering the running cost, the low temperature annealing process is advantageous at all.

【0010】しかしながら、低温アニールプロセスは、
先に述べたように周辺回路としてはあまり特性のよいも
のではない。したがって、それだけで周辺回路までも構
成することは不可能である。この場合には、レーザー照
射プロセスと低温アニールプロセスを組み合わせること
によって解決できる。すなわち、主として周辺回路部の
みをレーザー照射し、その他の領域を低温アニールによ
って結晶化させるのである。
However, the low temperature annealing process is
As described above, the characteristics of the peripheral circuit are not so good. Therefore, it is not possible to configure the peripheral circuit by itself. This case can be solved by combining the laser irradiation process and the low temperature annealing process. That is, mainly the peripheral circuit portion is irradiated with laser, and the other regions are crystallized by low temperature annealing.

【0011】この場合には、アモルファス状の半導体
は、最初の結晶化工程によって、ほぼその特性が決定さ
れてしまうことに注意しなければならない。例えば、最
初に低温アニールをおこなって、結晶化させたシリコン
に、さらにレーザー照射をおこなっても格段に特性が向
上することはない。すなわち、高移動度のTFTを得よ
うとしたら、最初にレーザー照射をおこなわなけれなな
らない。
In this case, it should be noted that the characteristics of the amorphous semiconductor are almost determined by the first crystallization step. For example, even if the crystallized silicon is first subjected to low temperature annealing and further laser irradiation is performed, the characteristics are not significantly improved. That is, in order to obtain a high mobility TFT, laser irradiation must be performed first.

【0012】本発明の別な構成は、パルスレーザーの照
射の条件を変えることによって、得られるTFTの特性
を制御するものである。一般に、レーザーのエネルギー
密度が大きいほど高移動度のTFTが得られる。しかし
ながら、これは半導体材料やレーザーの波長に依存す
る。あまりエネルギー密度が高すぎると、かえってTF
Tの特性を損なうこととなる。本発明人等の知見では、
レーザーとして、KrFエキシマーレーザー(波長24
8nm、パルス幅10nsec)を用いた場合には、シ
ョット数1〜50回の範囲では200〜350mJ/c
2 のエネルギー密度が適当である。
Another structure of the present invention is to control the characteristics of the obtained TFT by changing the irradiation conditions of the pulsed laser. Generally, the higher the energy density of the laser, the higher the mobility of the TFT that can be obtained. However, this depends on the semiconductor material and the wavelength of the laser. If the energy density is too high, TF
This will impair the characteristics of T. According to the findings of the present inventors,
As a laser, a KrF excimer laser (wavelength 24
8 nm, pulse width 10 nsec), 200 to 350 mJ / c in the range of 1 to 50 shots.
An energy density of m 2 is suitable.

【0013】この場合にも、もし、レーザー照射が重な
ることがある場合には、その部分のTFTの特性は、最
初に照射されたレーザーの条件によって支配されてしま
うことに注意しなければならない。すなわち、最初に低
移動度TFTの条件でレーザー照射をおこなった場合に
は、その後に高移動度の条件でレーザー照射をおこなっ
ても、高移動度TFTを作製することはほとんど不可能
である。
Also in this case, it should be noted that if the laser irradiation may overlap, the characteristics of the TFT in that portion are governed by the conditions of the laser initially irradiated. That is, when the laser irradiation is first performed under the condition of the low mobility TFT, it is almost impossible to manufacture the high mobility TFT even if the laser irradiation is performed thereafter under the condition of the high mobility.

【0014】本発明では、レーザーのビームは適当な形
状を有している。したがって、レーザーのビームによっ
て、マスクを用いずとも選択的なレーザー照射が可能で
ある。しかしながら、微細加工においては、僅かのレー
ザー光のもれも周囲に大きな影響を与えることがある。
したがって、適切なマスクを用いることも必要とされ
る。いうまでもなく、複雑に入り組んだ回路の中で特性
の異なるTFTを作製する場合には、通常のフォトリソ
グラフィー工程によるパターニングは不可欠である。ま
た、より精度の要求がゆるやかな場合にはメタルマスク
のように、基板に密着しないで用いられるマスクを使用
してもよい。例えば、液晶表示装置のアクティブマトリ
クスと周辺回路というように、明らかにブロックが距離
を隔てて構成されている場合には、特別なマスクを用い
なくても良いが、マトリクスと周辺回路は100μm以
上、好ましくは1mm以上離れていることが望ましい。
In the present invention, the laser beam has a suitable shape. Therefore, the laser beam enables selective laser irradiation without using a mask. However, in microfabrication, even a slight leakage of laser light may have a great influence on the surroundings.
Therefore, it is also necessary to use an appropriate mask. Needless to say, patterning by a normal photolithography process is indispensable when manufacturing TFTs having different characteristics in a complicated circuit. Further, when the requirement for accuracy is looser, a mask used without being in close contact with the substrate, such as a metal mask, may be used. For example, when the blocks are clearly separated from each other like the active matrix and the peripheral circuit of the liquid crystal display device, a special mask may not be used, but the matrix and the peripheral circuit are 100 μm or more, It is preferable that the distance is 1 mm or more.

【0015】本発明のプロセスは、絶縁基板上に半導体
被膜を形成する工程と、その上にレーザー光に対して透
明な絶縁被膜を形成する工程と、この積層膜に選択的に
パルスレーザー光を照射して、半導体被膜の結晶性を改
善する工程と、その後、低温アニールによってもしくは
先のレーザー照射とは異なる条件のレーザー光を基板の
全面もしくは一部に照射すること、前記半導体被膜の残
りの部分までも結晶化させる工程と、前記絶縁被膜を除
去して、半導体被膜の表面にゲイト絶縁膜を形成する工
程と、さらに、ゲイト電極を形成する工程を基本とす
る。その後、このゲイト電極を主たるマスクとして自己
整合的に不純物元素をイオン注入やイオンドーピング等
の方法で半導体被膜に導入し、さらにパルスレーザー光
を照射して、前記不純物元素の導入過程で破壊された半
導体被膜の結晶性を改善せしめ、この不純物領域に金属
配線を形成してTFTを完成させる。また、不純物導入
工程は本発明人等の出願であるレーザードーピング(例
えば、特願平4−100479)によって置き換えても
よい。本発明においては、ゲイト電極・配線の材料とし
てはアルミニウム等の低抵抗の金属材料が好ましい。ま
た、本発明で使用するパルスレーザーとしては、Kr
F、ArF、XeCl、XeF等のエキシマーレーザー
のような紫外光レーザーが望ましい。
In the process of the present invention, a step of forming a semiconductor film on an insulating substrate, a step of forming an insulating film transparent to a laser beam thereon, and a pulsed laser beam are selectively applied to this laminated film. The step of irradiating to improve the crystallinity of the semiconductor film, and then irradiating the entire surface or a part of the substrate with laser light under low temperature annealing or under a condition different from the above laser irradiation; It is based on a step of crystallizing even a part, a step of removing the insulating film to form a gate insulating film on the surface of the semiconductor film, and a step of forming a gate electrode. After that, by using this gate electrode as a main mask, an impurity element is self-alignedly introduced into the semiconductor film by a method such as ion implantation or ion doping, and further pulse laser light is irradiated to destroy the impurity element in the process of introducing the impurity element. The crystallinity of the semiconductor film is improved, and metal wiring is formed in this impurity region to complete the TFT. Further, the impurity doping step may be replaced by laser doping (for example, Japanese Patent Application No. 4-100479) filed by the present inventors. In the present invention, a low resistance metal material such as aluminum is preferable as a material for the gate electrode / wiring. Further, as the pulse laser used in the present invention, Kr
Ultraviolet lasers such as F, ArF, XeCl, XeF excimer lasers are preferred.

【0016】また、本発明においては、レーザー照射に
よって形成される結晶性のよい領域の深さを、本発明人
等の発明である特願平3−50793に記述されるよう
に必要に応じて自由に設定・変更し、結果として活性層
を2層構造として、ソース/ドレイン間のリーク電流を
低減させるような構造としてもよい。
Further, in the present invention, the depth of the region having good crystallinity formed by laser irradiation may be adjusted as necessary as described in Japanese Patent Application No. 3-50793, which is the invention of the present inventors. The active layer may be set / changed freely, and as a result, the active layer may have a two-layer structure to reduce the leak current between the source and the drain.

【0017】[0017]

【実施例】 〔実施例1〕 図1に本実施例を示す。本実施例は、T
FT型液晶表示装置の周辺回路にレーザー結晶化シリコ
ンTFTを、アクティブマトリクス領域に低温アニール
による結晶性TFTをそれぞれ使用したものである。こ
の場合には、両TFTの活性層を同一プロセスで作製で
きる。
EXAMPLES Example 1 FIG. 1 shows this example. In this embodiment, T
A laser crystallized silicon TFT is used in the peripheral circuit of the FT type liquid crystal display device, and a crystalline TFT by low temperature annealing is used in the active matrix region. In this case, the active layers of both TFTs can be manufactured by the same process.

【0018】まず、コーニング7059基板101上
に、スパッタ法によって下地酸化膜102を厚さ20〜
200nm堆積した。さらに、その上にモノシランもし
くはジシランを原料とするプラズマCVD法もしくは減
圧CVD法によって、アモルファスシリコン膜を厚さ5
0〜150nm堆積した。このときには、アモルファス
シリコン膜中の酸素濃度は1018cm-2以下、好ましく
は1017cm-2以下とすると、低温アニール工程の温度
を下げ、また、アニール時間を短縮することが可能であ
る。この目的には減圧CVD法が適している。本実施例
では、酸素濃度は1017cm-2以下とした。なお。プラ
ズマCVDによってアモルファスシリコン膜を堆積した
場合には、その後に脱水素化の工程が必要である。この
アモルファスシリコン膜の上に再びスパッタ法によって
保護の酸化珪素膜(厚さ10〜50nm)105を形成
した。その後、アクティブマトリクス領域103をフォ
トレジスト106等で覆い、周辺回路領域のみを露出さ
せた。
First, a base oxide film 102 having a thickness of 20 to 20 is formed on a Corning 7059 substrate 101 by a sputtering method.
200 nm was deposited. Further, an amorphous silicon film having a thickness of 5 is formed thereon by a plasma CVD method or a low pressure CVD method using monosilane or disilane as a raw material.
0 to 150 nm was deposited. At this time, if the oxygen concentration in the amorphous silicon film is 10 18 cm -2 or less, preferably 10 17 cm -2 or less, the temperature of the low temperature annealing step can be lowered and the annealing time can be shortened. The low pressure CVD method is suitable for this purpose. In this example, the oxygen concentration was set to 10 17 cm -2 or less. Incidentally. When the amorphous silicon film is deposited by plasma CVD, a dehydrogenation step is required thereafter. On this amorphous silicon film, a protective silicon oxide film (thickness 10 to 50 nm) 105 was formed again by the sputtering method. Then, the active matrix region 103 was covered with a photoresist 106 or the like to expose only the peripheral circuit region.

【0019】そして、図1(A)に示すようにKrFエ
キシマーレーザー(波長248nm、パルス幅20ns
ec)を照射して、シリコン膜のうち、領域104の結
晶性を改善させた。レーザー装置の構成は、例えば特願
平4−193005(平成4年6月26日出願)に示さ
れる。レーザーのエネルギー密度は200〜400mJ
/cm2、好ましくは250〜300mJ/cm2とし
た。一方、フォトレジストに覆われていた部分103に
はレーザー光が到達しないので、アモルファスシリコン
のままであった。その後、フォトレジスト106を除去
して、基板を550℃の窒素雰囲気に1時間放置して、
アモルファスシリコン膜全体を結晶化させた。この結
果、領域103も結晶性シリコンとなった。
Then, as shown in FIG. 1A, a KrF excimer laser (wavelength 248 nm, pulse width 20 ns) is used.
ec) was applied to improve the crystallinity of the region 104 in the silicon film. The configuration of the laser device is shown, for example, in Japanese Patent Application No. 4-193005 (filed on June 26, 1992). Laser energy density is 200 ~ 400mJ
/ Cm 2 , preferably 250 to 300 mJ / cm 2 . On the other hand, since the laser beam did not reach the portion 103 covered with the photoresist, it remained amorphous silicon. Then, the photoresist 106 is removed, and the substrate is left in a nitrogen atmosphere at 550 ° C. for 1 hour.
The entire amorphous silicon film was crystallized. As a result, the region 103 also became crystalline silicon.

【0020】以上の結晶化工程で得られたシリコン膜の
構造は全く異なったものであった。すなわち、レーザー
照射された領域104は、その後に低温アニールされた
にも関わらず、結晶は比較的大きかった。この結果、高
移動度が可能となった。一方、領域103は低温アニー
ルによって結晶化されたのであるが、比較的小さな結晶
からなっていた。以上の工程を逆にして、先に低温アニ
ールを行い、その後レーザー照射を行うと、領域104
は領域103と同じ小さな結晶から構成されることにな
る。
The structure of the silicon film obtained by the above crystallization process was completely different. That is, in the laser-irradiated region 104, the crystal was relatively large even though it was subjected to the low temperature annealing thereafter. As a result, high mobility has become possible. On the other hand, although the region 103 was crystallized by low temperature annealing, it was composed of relatively small crystals. When the above steps are reversed and low temperature annealing is performed first, and then laser irradiation is performed, the region 104 is removed.
Will be composed of the same small crystals as the region 103.

【0021】その後、これらのSi膜を島状にパターニ
ングし、例えば、図1(B)のように、周辺回路の島状
領域107とアクティブマトリクス領域の島状領域10
8を形成した。さらに、これらの島状領域を覆って、ス
パッタ法によって酸化珪素膜を形成し、これをゲイト絶
縁膜109とした。その後、厚さ200nm〜5μmの
アルミニウム膜を電子ビーム蒸着法によって形成して、
これをパターニングし、各島状領域にゲイト電極を形成
した。
After that, these Si films are patterned into islands, and, for example, as shown in FIG. 1B, the islands 107 of the peripheral circuit and the islands 10 of the active matrix region are formed.
8 was formed. Further, a silicon oxide film was formed by a sputtering method so as to cover these island regions, and this was used as a gate insulating film 109. After that, an aluminum film having a thickness of 200 nm to 5 μm is formed by an electron beam evaporation method,
This was patterned to form a gate electrode in each island region.

【0022】さらに、基板を電解溶液に浸してゲイト電
極に電流を通じ、その周囲に陽極酸化物の層を形成し
た。なお、この際には、本発明人等の発明である特願平
4−30220、同4−38637および同4−543
22に示される如く、周辺回路領域のTFTの陽極酸化
膜を薄くして移動度を向上せしめ、また、アクティブマ
トリクス部のTFTの陽極酸化膜を厚くしてゲイトリー
クを防止するという構成を取ることが望ましいが、本実
施例では、いずれも陽極酸化膜の厚さは200〜250
nmとした。以上の工程によって各TFTのゲイト電極
部110〜112が作製された。
Further, the substrate was dipped in an electrolytic solution to pass a current through the gate electrode to form an anodic oxide layer around the gate electrode. In this case, Japanese Patent Application Nos. 4-30220, 4-38637, and 4-543, which are the inventions of the present inventors, should be considered.
As shown in FIG. 22, the structure may be adopted in which the anodic oxide film of the TFT in the peripheral circuit region is thinned to improve the mobility, and the anodic oxide film of the TFT in the active matrix portion is thickened to prevent the gate leak. Although desirable, in this embodiment, the thickness of the anodic oxide film is 200 to 250 in all cases.
nm. Through the above steps, the gate electrode portions 110 to 112 of each TFT were manufactured.

【0023】その後、イオンドーピング法によって、各
TFTの島状シリコン膜中に、ゲイト電極部(すなわち
ゲイト電極とその周囲の陽極酸化膜)をマスクとして自
己整合的に不純物を注入した。この際には、最初に全面
にフォスフィン(PH3 )をドーピングガスとして燐を
注入し、その後、図の島状領域107の左側とアクティ
ブマトリクス領域をフォトレジストで覆って、ジボラン
(B2 6 )をドーピングガスとして、島状領域107
の右側だけに硼素を注入した。ドーズ量は、燐は2〜8
×1015cm-2、硼素は4〜10×1015cm-2とし、
硼素のドーズ量が燐を上回るように設定した。
After that, impurities were self-alignedly implanted into the island-shaped silicon film of each TFT by ion doping using the gate electrode portion (that is, the gate electrode and the anodic oxide film around it) as a mask. At this time, first, phosphorus is implanted into the entire surface by using phosphine (PH 3 ) as a doping gas, and then the left side of the island region 107 and the active matrix region in the figure are covered with a photoresist to remove diborane (B 2 H 6 ) As a doping gas, the island-shaped region 107
Boron was implanted only on the right side of the. The dose is 2-8 for phosphorus
× 10 15 cm -2 , boron is 4 to 10 × 10 15 cm -2 ,
The boron dose was set to exceed phosphorus.

【0024】その後、図1(C)に示すようにKrFエ
キシマーレーザー(波長248nm、パルス幅20ns
ec)を照射して、上記不純物領域の導入によって、結
晶性の劣化した部分の結晶性を改善させた。レーザーの
エネルギー密度は200〜400mJ/cm2 、好まし
くは250〜300mJ/cm2 とした。
After that, as shown in FIG. 1C, a KrF excimer laser (wavelength 248 nm, pulse width 20 ns) was used.
By irradiating ec) and introducing the impurity region, the crystallinity of the portion where the crystallinity is deteriorated is improved. The energy density of the laser was 200 to 400 mJ / cm 2 , preferably 250 to 300 mJ / cm 2 .

【0025】この結果、N型の領域113、115、お
よびP型の領域114が形成された。これらの領域のシ
ート抵抗は200〜800Ω/□であった。また、同時
に活性領域116〜118も形成されたが、このうち、
活性領域116と117はレーザー照射によって結晶化
され、また、活性領域118は低温アニールによって結
晶化させた。その後、全面に層間絶縁物119として、
スパッタ法によって酸化珪素膜を厚さ300〜1000
nm形成した。これは、プラズマCVD法による酸化珪
素膜であってもよい。特に、TEOSを原料とするプラ
ズマCVD法ではステップカバレージの良好な酸化珪素
膜が得られる。
As a result, N type regions 113 and 115 and a P type region 114 were formed. The sheet resistance in these regions was 200 to 800 Ω / □. At the same time, active regions 116 to 118 were also formed.
The active regions 116 and 117 were crystallized by laser irradiation, and the active region 118 was crystallized by low temperature annealing. After that, an interlayer insulator 119 is formed on the entire surface,
A silicon oxide film having a thickness of 300 to 1000 is formed by the sputtering method.
nm formed. This may be a silicon oxide film formed by the plasma CVD method. In particular, a plasma CVD method using TEOS as a raw material can provide a silicon oxide film having good step coverage.

【0026】その後、画素電極120として、スパッタ
法によってITO膜を形成し、これをパターニングし
た。そして、TFTのソース/ドレイン(不純物領域)
にコンタクトホールを形成し、クロム配線121〜12
4を形成した。図1(D)には左側のNTFTとPTF
Tでインバータ回路が形成されていることが示されてい
る。配線121〜124は、シート抵抗をさげるためク
ロムあるいは窒化チタンを下地とするアルミニウムとの
多層配線であってもよい。最後に、水素中で350℃で
2時間アニールして、シリコン膜のダングリングボンド
を減らした。以上の工程によって周辺回路とアクティブ
マトリクス回路を一体化して形成できた。
After that, an ITO film was formed as the pixel electrode 120 by a sputtering method and patterned. And source / drain of TFT (impurity region)
Contact holes are formed in the chrome wires 121 to 12
4 was formed. In FIG. 1 (D), NTFT and PTF on the left side are shown.
It is shown that the inverter circuit is formed by T. The wirings 121 to 124 may be multi-layered wiring with aluminum on which chrome or titanium nitride is used as a base to reduce the sheet resistance. Finally, it was annealed in hydrogen at 350 ° C. for 2 hours to reduce dangling bonds in the silicon film. Through the above steps, the peripheral circuit and the active matrix circuit could be integrally formed.

【0027】〔実施例2〕 図2に本実施例を示す。本
実施例は、TFT型液晶表示装置の周辺回路とアクティ
ブマトリクス双方にレーザー結晶化シリコンTFTを使
用したものである。当然、両TFTの活性層を同一プロ
セスで作製できる。しかしながら、レーザー結晶化の条
件はそれぞれ異なる。
Second Embodiment FIG. 2 shows this embodiment. In this embodiment, laser crystallized silicon TFTs are used for both the peripheral circuit and active matrix of a TFT type liquid crystal display device. Naturally, the active layers of both TFTs can be manufactured in the same process. However, the conditions for laser crystallization are different.

【0028】まず、コーニング7059基板201上
に、スパッタ法によって下地酸化膜202を厚さ20〜
200nm堆積した。さらに、その上にモノシランもし
くはジシランを原料とするプラズマCVD法もしくは減
圧CVD法によって、アモルファスシリコン膜を厚さ5
0〜150nm堆積した。なお。プラズマCVDによっ
てアモルファスシリコン膜を堆積した場合には、その後
に脱水素化の工程が必要である。このアモルファスシリ
コン膜の上に再びスパッタ法によって保護の酸化珪素膜
(厚さ10〜50nm)205を形成した。その後、基
板を石英製のメタルマスク206で覆った。メタルマス
クは、アクティブマトリクス領域203の上部は金属被
膜207によって覆われており、周辺回路領域のみレー
ザー光が透過することができる。
First, a base oxide film 202 having a thickness of 20 to 20 is formed on a Corning 7059 substrate 201 by a sputtering method.
200 nm was deposited. Further, an amorphous silicon film having a thickness of 5 is formed thereon by a plasma CVD method or a low pressure CVD method using monosilane or disilane as a raw material.
0 to 150 nm was deposited. Incidentally. When the amorphous silicon film is deposited by plasma CVD, a dehydrogenation step is required thereafter. A protective silicon oxide film (thickness: 10 to 50 nm) 205 was formed again on the amorphous silicon film by the sputtering method. After that, the substrate was covered with a metal mask 206 made of quartz. In the metal mask, the upper part of the active matrix region 203 is covered with the metal coating 207, and the laser beam can be transmitted only in the peripheral circuit region.

【0029】そして、図2(A)に示すようにKrFエ
キシマーレーザー(波長248nm、パルス幅20ns
ec)を照射して、シリコン膜のうち、領域204の結
晶性を改善させた。レーザーのエネルギー密度は300
mJ/cm2 、10ショットとした。一方、メタルマス
ク206に覆われていた部分203にはレーザー光が到
達しないので、アモルファスシリコンのままであった。
その後、メタルマスク206を外し、図2(B)に示す
ように、基板全面にKrFエキシマーレーザー(波長2
48nm、パルス幅20nsec)を照射して、領域2
03を含む全てのシリコン膜の結晶性を改善させた。レ
ーザーのエネルギー密度は250mJ/cm2 、10シ
ョットとした。この結果、領域203も結晶性シリコン
208となった。
Then, as shown in FIG. 2A, a KrF excimer laser (wavelength 248 nm, pulse width 20 ns) is used.
ec) was applied to improve the crystallinity of the region 204 in the silicon film. Laser energy density is 300
mJ / cm 2 , 10 shots. On the other hand, since the laser light did not reach the portion 203 covered with the metal mask 206, it remained as amorphous silicon.
After that, the metal mask 206 is removed, and as shown in FIG. 2B, the KrF excimer laser (wavelength 2
48 nm, pulse width 20 nsec) to irradiate area 2
The crystallinity of all silicon films including 03 was improved. The energy density of the laser was 250 mJ / cm 2 and 10 shots. As a result, the region 203 also became the crystalline silicon 208.

【0030】以上の結晶化工程で得られたシリコン膜の
構造は全く異なったものであった。すなわち、最初にレ
ーザー照射された領域204は、その後に別の条件でレ
ーザー照射されたものの、結晶は比較的大きかった。こ
の結果、高移動度が可能となった。一方、領域203は
比較的小さな結晶からなっていた。以上の工程を逆にし
て、先に250mJ/cm2 のレーザー照射を行い、そ
の後300mJ/cm2のレーザー照射を行えば、領域
204は領域203と同じ小さな結晶から構成され高移
動度は達成できなかった。
The structure of the silicon film obtained by the above crystallization process was completely different. That is, although the region 204 which was initially irradiated with laser was irradiated with laser under another condition after that, the crystal was relatively large. As a result, high mobility has become possible. On the other hand, the region 203 was composed of relatively small crystals. By reversing the above steps, the previously performed laser irradiation 250 mJ / cm 2, followed by performing the laser irradiation 300 mJ / cm 2, region 204 is a high mobility is composed of the same small crystals as region 203 can be accomplished There wasn't.

【0031】その後、これらのSi膜を島状にパターニ
ングし、例えば、図2(C)のように、周辺回路の島状
領域209とアクティブマトリクス領域の島状領域21
0を形成した。さらに、これらの島状領域を覆って、ス
パッタ法によって酸化珪素膜を形成し、これをゲイト絶
縁膜211とした。その後、厚さ200nm〜5μmの
アルミニウム膜を電子ビーム蒸着法によって形成して、
これをパターニングし、各島状領域にゲイト電極を形成
し、実施例1と同様に陽極酸化を施して、ゲイト電極部
212〜214を形成した。
Thereafter, these Si films are patterned into islands, and, for example, as shown in FIG. 2C, the islands 209 of the peripheral circuit and the islands 21 of the active matrix region are formed.
Formed 0. Further, a silicon oxide film is formed by a sputtering method so as to cover these island regions, and this is used as a gate insulating film 211. After that, an aluminum film having a thickness of 200 nm to 5 μm is formed by an electron beam evaporation method,
This was patterned, a gate electrode was formed in each island region, and anodization was performed in the same manner as in Example 1 to form gate electrode portions 212 to 214.

【0032】その後、イオンドーピング法によって、各
TFTの島状シリコン膜中に、ゲイト電極部(すなわち
ゲイト電極とその周囲の陽極酸化膜)をマスクとして自
己整合的に不純物を注入した。この際には、最初に全面
にフォスフィン(PH3 )をドーピングガスとして燐を
注入し、その後、図の島状領域209の左側とアクティ
ブマトリクス領域をフォトレジストで覆って、ジボラン
(B2 6 )をドーピングガスとして、島状領域209
の右側だけに硼素を注入した。ドーズ量は、燐は2〜8
×1015cm-2、硼素は4〜10×1015cm-2とし、
硼素のドーズ量が燐を上回るように設定した。
After that, by ion doping, impurities were self-alignedly implanted into the island-shaped silicon film of each TFT by using the gate electrode portion (that is, the gate electrode and the anodic oxide film around it) as a mask. At this time, phosphorus is first injected into the entire surface using phosphine (PH 3 ) as a doping gas, and then the left side of the island region 209 in the figure and the active matrix region are covered with a photoresist to remove diborane (B 2 H 6 ) As a doping gas, the island region 209
Boron was implanted only on the right side of the. The dose is 2-8 for phosphorus
× 10 15 cm -2 , boron is 4 to 10 × 10 15 cm -2 ,
The boron dose was set to exceed phosphorus.

【0033】その後、図2(D)に示すようにKrFエ
キシマーレーザー(波長248nm、パルス幅20ns
ec)を照射して、上記不純物領域の導入によって、結
晶性の劣化した部分の結晶性を改善させた。レーザーの
エネルギー密度は200〜400mJ/cm2 、好まし
くは250〜300mJ/cm2 とした。
After that, as shown in FIG. 2D, a KrF excimer laser (wavelength 248 nm, pulse width 20 ns) was used.
By irradiating ec) and introducing the impurity region, the crystallinity of the portion where the crystallinity is deteriorated is improved. The energy density of the laser was 200 to 400 mJ / cm 2 , preferably 250 to 300 mJ / cm 2 .

【0034】この結果、N型の領域215、217、お
よびP型の領域216が形成された。これらの領域のシ
ート抵抗は200〜800Ω/□であった。また、同時
に活性領域218〜220も形成された。その後、全面
に層間絶縁物221として、スパッタ法によって酸化珪
素膜を厚さ300〜1000nm形成した。これは、プ
ラズマCVD法による酸化珪素膜であってもよい。特
に、TEOSを原料とするプラズマCVD法ではステッ
プカバレージの良好な酸化珪素膜が得られる。
As a result, N-type regions 215 and 217 and a P-type region 216 were formed. The sheet resistance in these regions was 200 to 800 Ω / □. At the same time, active regions 218 to 220 were also formed. After that, a silicon oxide film having a thickness of 300 to 1000 nm was formed as an interlayer insulator 221 on the entire surface by a sputtering method. This may be a silicon oxide film formed by the plasma CVD method. In particular, a plasma CVD method using TEOS as a raw material can provide a silicon oxide film having good step coverage.

【0035】その後、画素電極222として、スパッタ
法によってITO膜を形成し、これをパターニングし
た。そして、TFTのソース/ドレイン(不純物領域)
にコンタクトホールを形成し、クロム配線223〜22
6を形成した。図2(E)には左側のNTFTとPTF
Tでインバータ回路が形成されていることが示されてい
る。配線223〜226は、シート抵抗をさげるためク
ロムあるいは窒化チタンを下地とするアルミニウムとの
多層配線であってもよい。最後に、水素中で350℃で
2時間アニールして、シリコン膜のダングリングボンド
を減らした。以上の工程によって周辺回路とアクティブ
マトリクス回路を一体化して形成できた。
After that, an ITO film was formed as the pixel electrode 222 by the sputtering method and patterned. And source / drain of TFT (impurity region)
Forming a contact hole in the chrome wiring 223-22
6 was formed. In Fig. 2 (E), NTFT and PTF on the left side
It is shown that the inverter circuit is formed by T. The wirings 223 to 226 may be multi-layered wiring with chromium or aluminum based on titanium nitride in order to reduce the sheet resistance. Finally, it was annealed in hydrogen at 350 ° C. for 2 hours to reduce dangling bonds in the silicon film. Through the above steps, the peripheral circuit and the active matrix circuit could be integrally formed.

【0036】〔実施例3〕 図3に本実施例を示す。本
実施例は、TFT型液晶表示装置の周辺回路とアクティ
ブマトリクス双方にレーザー結晶化シリコンTFTを使
用したものである。当然、両TFTの活性層を同一プロ
セスで作製できる。しかしながら、レーザー結晶化の条
件はそれぞれ異なる。
[Third Embodiment] FIG. 3 shows the present embodiment. In this embodiment, laser crystallized silicon TFTs are used for both the peripheral circuit and active matrix of a TFT type liquid crystal display device. Naturally, the active layers of both TFTs can be manufactured in the same process. However, the conditions for laser crystallization are different.

【0037】まず、コーニング7059基板301上
に、スパッタ法によって下地酸化膜302を厚さ20〜
200nm堆積した。さらに、その上にモノシランもし
くはジシランを原料とするプラズマCVD法もしくは減
圧CVD法によって、アモルファスシリコン膜を厚さ5
0〜150nm堆積した。なお。プラズマCVDによっ
てアモルファスシリコン膜を堆積した場合には、その後
に脱水素化の工程が必要である。このアモルファスシリ
コン膜の上に再びスパッタ法によって保護の酸化珪素膜
(厚さ10〜50nm)305を形成した。そして、図
3(A)に示すようにKrFエキシマーレーザー(波長
248nm、パルス幅20nsec)を周辺回路領域3
04のみに照射して、該領域の結晶性を改善させた。レ
ーザーのエネルギー密度は300mJ/cm2 、10シ
ョットとした。一方、レーザーの照射されなかった部分
303はアモルファスシリコンのままであった。その
後、図3(B)に示すように、基板全面にKrFエキシ
マーレーザー(波長248nm、パルス幅20nse
c)を照射して、領域303を含む全てのシリコン膜の
結晶性を改善させた。レーザーのエネルギー密度は25
0mJ/cm2 、10ショットとした。この結果、領域
303も結晶性シリコン306となった。
First, a base oxide film 302 having a thickness of 20 to 20 is formed on a Corning 7059 substrate 301 by a sputtering method.
200 nm was deposited. Further, an amorphous silicon film having a thickness of 5 is formed thereon by a plasma CVD method or a low pressure CVD method using monosilane or disilane as a raw material.
0 to 150 nm was deposited. Incidentally. When the amorphous silicon film is deposited by plasma CVD, a dehydrogenation step is required thereafter. On this amorphous silicon film, a protective silicon oxide film (thickness 10 to 50 nm) 305 was formed again by the sputtering method. Then, as shown in FIG. 3 (A), a KrF excimer laser (wavelength 248 nm, pulse width 20 nsec) is applied to the peripheral circuit region 3.
Only 04 was irradiated to improve the crystallinity of the region. The energy density of the laser was 300 mJ / cm 2 and 10 shots. On the other hand, the portion 303 which was not irradiated with laser remained amorphous silicon. Then, as shown in FIG. 3 (B), a KrF excimer laser (wavelength 248 nm, pulse width 20 nse is formed on the entire surface of the substrate.
C) was irradiated to improve the crystallinity of all silicon films including the region 303. Laser energy density is 25
It was 0 mJ / cm 2 and 10 shots. As a result, the region 303 also became the crystalline silicon 306.

【0038】以上の結晶化工程で得られたシリコン膜の
構造は全く異なったものであった。すなわち、最初にレ
ーザー照射された領域304は、その後に別の条件でレ
ーザー照射されたものの、結晶は比較的大きかった。こ
の結果、高移動度が可能となった。一方、領域303は
比較的小さな結晶からなっていた。もし、以上の工程を
逆にして、先に250mJ/cm2 のレーザー照射をお
こない、その後、300mJ/cm2 のレーザー照射を
おこなえば、領域304は領域303と同じ小さな結晶
から構成され、高移動度は達成できなかった。
The structure of the silicon film obtained by the above crystallization process was completely different. That is, although the region 304 initially irradiated with laser was subsequently irradiated with laser under another condition, the crystal was relatively large. As a result, high mobility has become possible. On the other hand, the region 303 was composed of relatively small crystals. If, in the reverse of the above steps, the previously performed laser irradiation 250 mJ / cm 2, then, by performing laser irradiation 300 mJ / cm 2, the area 304 is composed of the same small crystals as region 303, high mobility The degree could not be achieved.

【0039】その後、これらのSi膜を島状にパターニ
ングし、例えば、図3(C)のように、周辺回路の島状
領域307とアクティブマトリクス領域の島状領域30
8を形成した。さらに、これらの島状領域を覆って、ス
パッタ法によって酸化珪素膜を形成し、これをゲイト絶
縁膜309とした。その後、厚さ200nm〜5μmの
アルミニウム膜を電子ビーム蒸着法によって形成して、
これをパターニングし、各島状領域にゲイト電極を形成
し、実施例1と同様に陽極酸化を施して、ゲイト電極部
310〜312を形成した。
Thereafter, these Si films are patterned into islands, and, for example, as shown in FIG. 3C, the islands 307 of the peripheral circuit and the islands 30 of the active matrix region are formed.
8 was formed. Further, a silicon oxide film was formed by a sputtering method so as to cover these island regions, and this was used as a gate insulating film 309. After that, an aluminum film having a thickness of 200 nm to 5 μm is formed by an electron beam evaporation method,
This was patterned, a gate electrode was formed in each island region, and anodization was performed in the same manner as in Example 1 to form gate electrode portions 310 to 312.

【0040】その後、イオンドーピング法によって、各
TFTの島状シリコン膜中に、ゲイト電極部(すなわち
ゲイト電極とその周囲の陽極酸化膜)をマスクとして自
己整合的に不純物を注入した。この際には、最初に全面
にフォスフィン(PH3 )をドーピングガスとして燐を
注入し、その後、図の島状領域307の左側とアクティ
ブマトリクス領域をフォトレジストで覆って、ジボラン
(B2 6 )をドーピングガスとして、島状領域307
の右側だけに硼素を注入した。ドーズ量は、燐は2〜8
×1015cm-2、硼素は4〜10×1015cm-2とし、
硼素のドーズ量が燐を上回るように設定した。
After that, by ion doping, impurities were self-alignedly implanted into the island-shaped silicon film of each TFT by using the gate electrode portion (that is, the gate electrode and the anodic oxide film around it) as a mask. At this time, first, phosphorus is implanted into the entire surface by using phosphine (PH 3 ) as a doping gas, and then the left side of the island region 307 and the active matrix region are covered with a photoresist to remove diborane (B 2 H 6 ) As a doping gas, the island region 307
Boron was implanted only on the right side of the. The dose is 2-8 for phosphorus
× 10 15 cm -2 , boron is 4 to 10 × 10 15 cm -2 ,
The boron dose was set to exceed phosphorus.

【0041】その後、図3(D)に示すようにKrFエ
キシマーレーザー(波長248nm、パルス幅20ns
ec)を照射して、上記不純物領域の導入によって、結
晶性の劣化した部分の結晶性を改善させた。レーザーの
エネルギー密度は200〜400mJ/cm2 、好まし
くは250〜300mJ/cm2 とした。
After that, as shown in FIG. 3D, a KrF excimer laser (wavelength 248 nm, pulse width 20 ns) was used.
By irradiating ec) and introducing the impurity region, the crystallinity of the portion where the crystallinity is deteriorated is improved. The energy density of the laser was 200 to 400 mJ / cm 2 , preferably 250 to 300 mJ / cm 2 .

【0042】この結果、N型の領域313、315、お
よびP型の領域314が形成された。これらの領域のシ
ート抵抗は200〜800Ω/□であった。また、同時
に活性領域316〜318も形成された。その後、全面
に層間絶縁物319として、スパッタ法によって酸化珪
素膜を厚さ300〜1000nm形成した。これは、プ
ラズマCVD法による酸化珪素膜であってもよい。特
に、TEOSを原料とするプラズマCVD法ではステッ
プカバレージの良好な酸化珪素膜が得られる。
As a result, N-type regions 313 and 315 and a P-type region 314 were formed. The sheet resistance in these regions was 200 to 800 Ω / □. At the same time, active regions 316 to 318 were also formed. After that, a silicon oxide film having a thickness of 300 to 1000 nm was formed as an interlayer insulator 319 on the entire surface by a sputtering method. This may be a silicon oxide film formed by the plasma CVD method. In particular, a plasma CVD method using TEOS as a raw material can provide a silicon oxide film having good step coverage.

【0043】その後、画素電極320として、スパッタ
法によってITO膜を形成し、これをパターニングし
た。そして、TFTのソース/ドレイン(不純物領域)
にコンタクトホールを形成し、クロム配線321〜32
4を形成した。図3(E)には左側のNTFTとPTF
Tでインバータ回路が形成されていることが示されてい
る。配線321〜324は、シート抵抗をさげるためク
ロムあるいは窒化チタンを下地とするアルミニウムとの
多層配線であってもよい。最後に、大気圧の水素中で3
00℃で2時間アニールして、シリコン膜のダングリン
グボンドを減らした。以上の工程によって周辺回路とア
クティブマトリクス回路を一体化して形成できた。
After that, an ITO film was formed as the pixel electrode 320 by a sputtering method and patterned. And source / drain of TFT (impurity region)
Contact holes are formed in the chrome wires 321 to 32
4 was formed. In FIG. 3 (E), the NTFT and PTF on the left side are shown.
It is shown that the inverter circuit is formed by T. The wirings 321 to 324 may be multi-layered wirings with aluminum on which chromium or titanium nitride is used as a base to reduce the sheet resistance. Finally, 3 in hydrogen at atmospheric pressure
Annealing was performed at 00 ° C. for 2 hours to reduce dangling bonds in the silicon film. Through the above steps, the peripheral circuit and the active matrix circuit could be integrally formed.

【0044】〔実施例4〕 図4に本実施例を示す。本
実施例は、TFT型液晶表示装置の周辺回路とアクティ
ブマトリクス双方にレーザー結晶化シリコンTFTを使
用したものである。当然、両TFTの活性層を同一プロ
セスで作製できる。しかしながら、レーザー結晶化の条
件はそれぞれ異なる。
[Fourth Embodiment] FIG. 4 shows the present embodiment. In this embodiment, laser crystallized silicon TFTs are used for both the peripheral circuit and active matrix of a TFT type liquid crystal display device. Naturally, the active layers of both TFTs can be manufactured in the same process. However, the conditions for laser crystallization are different.

【0045】まず、コーニング7059基板401上
に、スパッタ法によって下地酸化膜402を厚さ20〜
200nm堆積した。さらに、その上にモノシランもし
くはジシランを原料とするプラズマCVD法もしくは減
圧CVD法によって、アモルファスシリコン膜を厚さ5
0〜150nm堆積した。なお。プラズマCVDによっ
てアモルファスシリコン膜を堆積した場合には、その後
に脱水素化の工程が必要である。このアモルファスシリ
コン膜の上に再びスパッタ法によって保護の酸化珪素膜
(厚さ10〜50nm)405を形成した。その後、基
板を石英製のメタルマスク406で覆った。メタルマス
クは、アクティブマトリクス領域403の上部は金属被
膜407によって覆われており、周辺回路領域のみレー
ザー光が透過することができる。
First, a base oxide film 402 having a thickness of 20 to 20 is formed on a Corning 7059 substrate 401 by a sputtering method.
200 nm was deposited. Further, an amorphous silicon film having a thickness of 5 is formed thereon by a plasma CVD method or a low pressure CVD method using monosilane or disilane as a raw material.
0 to 150 nm was deposited. Incidentally. When the amorphous silicon film is deposited by plasma CVD, a dehydrogenation step is required thereafter. A protective silicon oxide film (thickness: 10 to 50 nm) 405 was formed again on the amorphous silicon film by the sputtering method. After that, the substrate was covered with a metal mask 406 made of quartz. In the metal mask, the upper part of the active matrix region 403 is covered with the metal coating 407, and the laser beam can be transmitted only in the peripheral circuit region.

【0046】そして、図4(A)に示すようにKrFエ
キシマーレーザー(波長248nm、パルス幅20ns
ec)を照射して、シリコン膜のうち、領域404の結
晶性を改善させた。レーザーのエネルギー密度は300
mJ/cm2 、10ショットとした。一方、メタルマス
ク406に覆われていた部分403にはレーザー光が到
達しないので、アモルファスシリコンのままであった。
その後、メタルマスク406を外し、新たに別のメタル
マスク408を基板上に置いた。メタルマスク408は
周辺回路領域404の部分のみ金属被膜409で覆われ
ている。そして、図4(B)に示すように、基板全面に
KrFエキシマーレーザー(波長248nm、パルス幅
20nsec)を照射して、領域403の結晶性を改善
させた。レーザーのエネルギー密度は250mJ/cm
2 、10ショットとした。
Then, as shown in FIG. 4A, a KrF excimer laser (wavelength 248 nm, pulse width 20 ns) is used.
ec) was applied to improve the crystallinity of the region 404 in the silicon film. Laser energy density is 300
mJ / cm 2 , 10 shots. On the other hand, since the laser light does not reach the portion 403 covered with the metal mask 406, it remains amorphous silicon.
After that, the metal mask 406 was removed, and another metal mask 408 was newly placed on the substrate. The metal mask 408 is covered with the metal film 409 only in the peripheral circuit region 404. Then, as shown in FIG. 4B, the entire surface of the substrate was irradiated with a KrF excimer laser (wavelength 248 nm, pulse width 20 nsec) to improve the crystallinity of the region 403. Laser energy density is 250 mJ / cm
2 , 10 shots.

【0047】以上の結晶化工程で得られたシリコン膜の
構造は全く異なったものであった。すなわち、最初にレ
ーザー照射された領域404は結晶は比較的大きかっ
た。この結果、高移動度が可能となった。一方、領域4
03は比較的小さな結晶からなっていた。本実施例では
上記の工程を逆にしても構わない。
The structure of the silicon film obtained by the above crystallization process was completely different. That is, the crystal was relatively large in the region 404 that was initially irradiated with laser. As a result, high mobility has become possible. On the other hand, area 4
03 consisted of relatively small crystals. In this embodiment, the above steps may be reversed.

【0048】その後、これらのSi膜を島状にパターニ
ングし、例えば、図4(C)のように、周辺回路の島状
領域410とアクティブマトリクス領域の島状領域41
1を形成した。さらに、これらの島状領域を覆って、ス
パッタ法によって酸化珪素膜を形成し、これをゲイト絶
縁膜412とした。その後、厚さ200nm〜5μmの
アルミニウム膜を電子ビーム蒸着法によって形成して、
これをパターニングし、各島状領域にゲイト電極を形成
し、実施例1と同様に陽極酸化を施して、ゲイト電極部
413〜415を形成した。
After that, these Si films are patterned into islands, and, for example, as shown in FIG. 4C, the island-shaped region 410 of the peripheral circuit and the island-shaped region 41 of the active matrix region are formed.
1 was formed. Further, a silicon oxide film was formed by a sputtering method so as to cover these island regions, and this was used as a gate insulating film 412. After that, an aluminum film having a thickness of 200 nm to 5 μm is formed by an electron beam evaporation method,
This was patterned, a gate electrode was formed in each island region, and anodization was performed in the same manner as in Example 1 to form gate electrode portions 413 to 415.

【0049】その後、イオンドーピング法によって、各
TFTの島状シリコン膜中に、ゲイト電極部(すなわち
ゲイト電極とその周囲の陽極酸化膜)をマスクとして自
己整合的に不純物を注入した。この際には、最初に全面
にフォスフィン(PH3 )をドーピングガスとして燐を
注入し、その後、図の島状領域410の左側とアクティ
ブマトリクス領域をフォトレジストで覆って、ジボラン
(B2 6 )をドーピングガスとして、島状領域410
の右側だけに硼素を注入した。ドーズ量は、燐は2〜8
×1015cm-2、硼素は4〜10×1015cm-2とし、
硼素のドーズ量が燐を上回るように設定した。
After that, impurities were implanted into the island-shaped silicon film of each TFT by ion doping in a self-aligned manner using the gate electrode portion (that is, the gate electrode and the surrounding anodic oxide film) as a mask. At this time, phosphorus is first injected into the entire surface by using phosphine (PH 3 ) as a doping gas, and then the left side of the island region 410 and the active matrix region in the figure are covered with a photoresist to remove diborane (B 2 H 6 ) As a doping gas, the island region 410
Boron was implanted only on the right side of the. The dose is 2-8 for phosphorus
× 10 15 cm -2 , boron is 4 to 10 × 10 15 cm -2 ,
The boron dose was set to exceed phosphorus.

【0050】その後、図4(D)に示すようにKrFエ
キシマーレーザー(波長248nm、パルス幅20ns
ec)を照射して、上記不純物領域の導入によって、結
晶性の劣化した部分の結晶性を改善させた。レーザーの
エネルギー密度は200〜400mJ/cm2 、好まし
くは250〜300mJ/cm2 とした。
After that, as shown in FIG. 4D, a KrF excimer laser (wavelength 248 nm, pulse width 20 ns) was used.
By irradiating ec) and introducing the impurity region, the crystallinity of the portion where the crystallinity is deteriorated is improved. The energy density of the laser was 200 to 400 mJ / cm 2 , preferably 250 to 300 mJ / cm 2 .

【0051】この結果、N型の領域416、418、お
よびP型の領域417が形成された。これらの領域のシ
ート抵抗は200〜800Ω/□であった。また、同時
に活性領域419〜421も形成された。その後、全面
に層間絶縁物422として、スパッタ法によって酸化珪
素膜を厚さ300〜1000nm形成した。これは、プ
ラズマCVD法による酸化珪素膜であってもよい。特
に、TEOSを原料とするプラズマCVD法ではステッ
プカバレージの良好な酸化珪素膜が得られる。
As a result, N-type regions 416 and 418 and P-type region 417 were formed. The sheet resistance in these regions was 200 to 800 Ω / □. At the same time, active regions 419 to 421 were also formed. After that, a silicon oxide film having a thickness of 300 to 1000 nm was formed as an interlayer insulator 422 on the entire surface by a sputtering method. This may be a silicon oxide film formed by the plasma CVD method. In particular, a plasma CVD method using TEOS as a raw material can provide a silicon oxide film having good step coverage.

【0052】その後、画素電極423として、スパッタ
法によってITO膜を形成し、これをパターニングし
た。そして、TFTのソース/ドレイン(不純物領域)
にコンタクトホールを形成し、クロム配線424〜42
7を形成した。図4(E)には左側のNTFTとPTF
Tでインバータ回路が形成されていることが示されてい
る。配線424〜427は、シート抵抗をさげるためク
ロムあるいは窒化チタンを下地とするアルミニウムとの
多層配線であってもよい。最後に、水素中で350℃で
2時間アニールして、シリコン膜のダングリングボンド
を減らした。以上の工程によって周辺回路とアクティブ
マトリクス回路を一体化して形成できた。
After that, an ITO film was formed as the pixel electrode 423 by a sputtering method and patterned. And source / drain of TFT (impurity region)
A contact hole is formed in the chrome wiring 424-42.
Formed 7. In FIG. 4 (E), the NTFT and PTF on the left side are shown.
It is shown that the inverter circuit is formed by T. The wirings 424 to 427 may be multi-layer wirings with aluminum on which chromium or titanium nitride is used as a base to reduce the sheet resistance. Finally, it was annealed in hydrogen at 350 ° C. for 2 hours to reduce dangling bonds in the silicon film. Through the above steps, the peripheral circuit and the active matrix circuit could be integrally formed.

【0053】本実施例では、マスクを2種類使用した
が、必要によっては3種類以上のマスクを使用してもよ
く、また、実施例1や実施例2を併用しても、より一層
の効果を得ることができる。
Although two kinds of masks are used in this embodiment, three or more kinds of masks may be used if necessary. Further, even if the first embodiment and the second embodiment are used together, a further effect is obtained. Can be obtained.

【0054】[0054]

【発明の効果】本発明によって、低温で極めて歩留りよ
くTFTを作製することが出来た。そして、実施例にお
いて示したように本発明を利用して1枚の基板上に様々
なTFTを形成することができた。これはTFTが必要
とする特性をレーザー照射による結晶化によって自由に
設定できるからである。このため、例えば、アクティブ
マトリクス型液晶表示装置の作製においても、マトリク
ス領域のTFTと周辺回路領域のTFTの特性を最適な
ものとすることができ、その結果、本発明の半導体装置
では、従来の方法では得られることのない優れた電気的
特性を有するものを得ることができた。しかも、それは
実質的に同一プロセスによって製造することができたの
である。従来であれば、例えば周辺回路はICのTAB
接続等の方法によって作製せねばならず、そのためにコ
スト上昇が生じていたが、本発明ではそのような問題は
ほぼ解決された。実施例では示さなかったが、本発明を
単結晶結晶ICやその他のICの上にさらに半導体回路
を積み重ねるといういわゆる立体ICを形成することに
用いてもよい。
According to the present invention, a TFT can be manufactured at a low temperature with a very high yield. Then, as shown in the examples, various TFTs could be formed on one substrate by utilizing the present invention. This is because the characteristics required by the TFT can be freely set by crystallization by laser irradiation. Therefore, for example, even in the production of an active matrix type liquid crystal display device, the characteristics of the TFT in the matrix region and the TFT in the peripheral circuit region can be optimized, and as a result, in the semiconductor device of the present invention, It was possible to obtain one having excellent electrical characteristics that could not be obtained by the method. Moreover, it could be manufactured by substantially the same process. Conventionally, for example, the peripheral circuit is TAB of IC
Although it had to be manufactured by a method such as connection, which resulted in an increase in cost, the present invention solved most of such problems. Although not shown in the embodiments, the present invention may be used for forming a so-called three-dimensional IC in which semiconductor circuits are further stacked on a single crystal IC or other IC.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明によるTFTの作製方法を示す。FIG. 1 shows a method for manufacturing a TFT according to the present invention.

【図2】本発明によるTFTの作製方法を示す。FIG. 2 shows a method for manufacturing a TFT according to the present invention.

【図3】本発明によるTFTの作製方法を示す。FIG. 3 shows a method for manufacturing a TFT according to the present invention.

【図4】本発明によるTFTの作製方法を示す。FIG. 4 shows a method for manufacturing a TFT according to the present invention.

【符号の説明】[Explanation of symbols]

101 絶縁基板 102 下地酸化膜 103 半導体領域(マトリクス領域) 104 半導体領域(周辺回路領域) 105 保護絶縁膜 106 マスク(フォレジスト) 107 島状半導体領域(周辺回路用) 108 島状半導体領域(マトリクス用) 109 ゲイト絶縁膜 110 ゲイト電極(NTFT用) 111 ゲイト電極(PTFT用) 112 ゲイト電極(アクティブマトリクスT
FT用) 113、115 N型不純物領域 114 P型不純物領域 116〜118 活性領域 119 層間絶縁物 120 画素電極(ITO) 121〜124 金属配線
Reference Signs List 101 insulating substrate 102 underlying oxide film 103 semiconductor region (matrix region) 104 semiconductor region (peripheral circuit region) 105 protective insulating film 106 mask (photoresist) 107 island semiconductor region (for peripheral circuit) 108 island semiconductor region (for matrix) ) 109 gate insulating film 110 gate electrode (for NTFT) 111 gate electrode (for PTFT) 112 gate electrode (active matrix T
FT) 113, 115 N-type impurity region 114 P-type impurity region 116-118 Active region 119 Interlayer insulator 120 Pixel electrode (ITO) 121-124 Metal wiring

───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭64−45162(JP,A) 特開 平4−124813(JP,A) (58)調査した分野(Int.Cl.7,DB名) H01L 29/786 H01L 21/336 ─────────────────────────────────────────────────── ─── Continuation of the front page (56) References JP-A 64-45162 (JP, A) JP-A 4-124813 (JP, A) (58) Fields investigated (Int.Cl. 7 , DB name) H01L 29/786 H01L 21/336

Claims (2)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】 基板上に非晶質半導体膜を形成し、 該非晶質半導体膜の一部をマスクし、第1のパルスレー
ザー光を照射し、第1の結晶性半導体膜を形成し、 該マスクを外し、 第2のパルスレーザー光を第1のパルスレーザー光のエ
ネルギー密度よりも小さいエネルギー密度で照射して、
該第1の結晶性半導体膜を第2の結晶性半導体膜に、非
晶質半導体膜を該第2の結晶性半導体膜よりも小さい結
晶からなる第3の結晶性半導体膜にし、 該第2の結晶性半導体膜及び該第3の結晶性半導体膜を
パターニングして、該第2の結晶性半導体膜を第1の島
状の結晶性半導体膜に、該第3の結晶性半導体膜を第2
の島状の結晶性半導体膜にし、 該第1の島状の結晶性半導体膜及び第2の島状の結晶性
半導体膜上にゲート絶縁膜を形成し、 該ゲート絶縁膜を介して、該第1の島状の結晶性半導体
膜上に第1のゲート電極と第2の島状の結晶性半導体膜
上に第2のゲート電極を形成し、 該第1のゲート電極及び該第2のゲート電極をマスクと
して、該第1の島状の結晶性半導体膜及び第2の島状の
結晶性半導体膜にN型の不純物又はP型の不純物を添加
し、 該N型の不純物又は該P型の不純物を添加した領域の結
晶性を回復させて周辺回路領域の薄膜トランジスタ及び
画素領域の薄膜トランジスタを形成するアクテイブマト
リクス型表示装置の作製方法であって、 周辺回路領域の薄膜トランジスタは、該第1の島状の結
晶性半導体膜、該ゲート絶縁膜、該第1のゲート電極を
有し、 画素領域の薄膜トランジスタは、該第2の島状の結晶性
半導体膜、該ゲート絶縁膜、該第2のゲート電極を有す
ることを特徴とするアクテイブマトリクス型表示装置の
作製方法。
1. An amorphous semiconductor film is formed on a substrate, a part of the amorphous semiconductor film is masked, and a first pulsed laser beam is irradiated to form a first crystalline semiconductor film, The mask is removed, and the second pulsed laser light is irradiated at an energy density lower than that of the first pulsed laser light,
The first crystalline semiconductor film is a second crystalline semiconductor film, and the amorphous semiconductor film is a third crystalline semiconductor film made of a crystal smaller than the second crystalline semiconductor film; Patterning the crystalline semiconductor film and the third crystalline semiconductor film, the second crystalline semiconductor film is used as the first island-shaped crystalline semiconductor film, and the third crystalline semiconductor film is used as the third crystalline semiconductor film. Two
Of the island-shaped crystalline semiconductor film, a gate insulating film is formed on the first island-shaped crystalline semiconductor film and the second island-shaped crystalline semiconductor film, and the gate insulating film is interposed therebetween. A first gate electrode is formed on the first island-shaped crystalline semiconductor film, and a second gate electrode is formed on the second island-shaped crystalline semiconductor film, and the first gate electrode and the second gate electrode are formed. Using the gate electrode as a mask, an N-type impurity or a P-type impurity is added to the first island-shaped crystalline semiconductor film and the second island-shaped crystalline semiconductor film, and the N-type impurity or the P-type impurity is added. A method of manufacturing an active matrix display device, which comprises recovering the crystallinity of an impurity-doped region of a type to form a thin film transistor in a peripheral circuit region and a thin film transistor in a pixel region. An island-shaped crystalline semiconductor film, the gate insulating film, An active matrix display device having a first gate electrode, wherein the thin film transistor in the pixel region has the second island-shaped crystalline semiconductor film, the gate insulating film, and the second gate electrode. Of manufacturing.
【請求項2】 前記第1のパルスレーザー光及び前記第
2のパルスレーザー光は、エキシマレーザー光である請
求項1に記載のアクテイブマトリクス型表示装置の作製
方法。
2. The method for manufacturing an active matrix display device according to claim 1, wherein the first pulsed laser light and the second pulsed laser light are excimer laser light.
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