JP2900707B2 - 設計ルールエラーの表示方法 - Google Patents
設計ルールエラーの表示方法Info
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- JP2900707B2 JP2900707B2 JP4160887A JP16088792A JP2900707B2 JP 2900707 B2 JP2900707 B2 JP 2900707B2 JP 4160887 A JP4160887 A JP 4160887A JP 16088792 A JP16088792 A JP 16088792A JP 2900707 B2 JP2900707 B2 JP 2900707B2
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Description
方法に関する。
まずオペレータの目視により画面上の設計ルールエラー
識別子を検索し、設計ルールエラー個所が見つかると図
3に示す如く2点A,Bを指示し、その矩形内で示され
る部分を拡大表示するという方法であった。この後、そ
の設計ルールエラー個所に対し必要な配線修正を行い、
設計ルールエラーを取り除くという方法を全ての設計ル
ールエラー個所に対し順次行っていた。
ールエラーの表示方法は、オペレータに依存する部分が
多いばかりでなく、設計ルールエラー個所の検索及び拡
大表示等の処理が並列にできないため作業効率が悪いと
いう問題があった。
ーの表示方法は、配線設計結果が設計ルールに違反して
いないかを調べる設計ルールチェック手段と、設計ルー
ルエラーが1ケ 所以上あった場合にその各々について設
計ルールーエラー内容を規定するエラー種生成手段と、
その各々の設計ルールエラーに対応する座標を求めるエ
ラー座標算出手段と、その求めた座標位置が一定の拡大
倍率の基に表示領域の中心となる様な表示領域を求める
表示領域算出手段と、求めた表示領域を画面分割された
複数の画面を表示する画面表示手段のどの画面に表示す
るかを割り当てる表示画面割り当て手段と、割り当てた
表示画面を表示する様起動をかけるためのエラー表示起
動手段と、画面分割表示する際にその表示に先だって各
設計ルールエラー個所にエラーマークーを付加するエラ
ーマーク生成手段と、画面分割された複数の画面にそれ
ぞれ表示画面割り当て手段によって割り当てられた表示
領域をエラーマークとともに表示する画面表示手段と、
表示された複数の画面の配線修正を並列に行う配線集計
手段と、現在の表示領域が表示された複数の画面に分割
画面数分同時に次の表示領域を呼び出す画面選択手段と
を備えている。
る。
ートである。
ルールエラー個所の分割画面表示例を示す図であり、図
2(b)はその設計ルールエラー個所を並列に修正した
後の分割画面表示例を示す図である。
説明する。この段階でまず、設計ルールチェック手段2
01を用いて設計ルールエラーの有無がチェックされる
が、ここでは、設計ルールエラーがあったと仮定する。
するとエラー種生成手段202では、全て設計ルールエ
ラーに対し、どの様なエラーかを判定し、その情報を生
成する。具体的には、図2(a)に示すエラー種12の
ショート スペースなどである。エラー種生成が終ると
同様にエラー座標算出手段203により全ての設計ルー
ルエラー個所の座標位置が算出される。この座標を基に
表示領域算出手段204では、分割画面表示上での中心
座標への対応ずけと自動拡大率を全ての設計ルールエラ
ー個所について算出する。
画面上のどの画面に表示するかをあらかじめ割り当てた
のが表示画面割り当て手段205である。この例では1
画面を4画面に分割しようとしているので割り当ては、
4画面単位となっている。こうしてあらかじめ画面表示
に必要な情報を作成しておき、エラー表示起動手段20
6によってオペレータの指示があると、図2(a)のエ
ラーマーク11で示される破線の円がエラーマーク生成
手段207により表示対象となっている4画面分生成さ
れ、画面表示手段208によっ4画面分の設計ルールエ
ラー個所が表示される際にそれらのエラー個所を示すエ
ラーマーク11が合成表示される。その表示状態を示す
ものが図2(a)である。
ーに対し配線修正手段209を用いて設計ルールエラー
を解消するために配線修正を画面分並列に行ってゆく。
4画面分の修正を終えた状態が図2(b)である。4画
面分の修正が終り、まだ設計ルールエラーがある場合に
は画面選択手段210により次の設計ルールエラー画面
呼びだし、エラーマーク生成手段207以降同様の処理
を行って、最終的に全ての設計ルールエラーがなくなる
までくり返し行う。
時に発生する設計ルールエーラーの表示方法に関し、設
計ルールエラー個所の自動検索と自動部分拡大及び複数
画面表示を可能にしたので、配線時の表示効果、修正効
果等の作業性を向上されることができるという効果を有
する。
る。
び設計ルールエーラ修正後の画面表示例を示す図であ
る。
Claims (1)
- 【請求項1】 配線設計結果が設計ルールに違反してい
ないかを調べる設計ルールチェック手段と、設計ルール
エラーが1ケ 所以上あった場合にその各々について設計
ルールーエラー内容を規定するエラー種生成手段と、そ
の各々の設計ルールエラーに対応する座標を求めるエラ
ー座標算出手段と、その求めた座標位置が一定の拡大倍
率の基に表示領域の中心となる様な表示領域を求める表
示領域算出手段と、求めた表示領域を画面分割された複
数の画面を表示する画面表示手段のどの画面に表示する
かを割り当てる表示画面割り当て手段と、割り当てた表
示画面を表示する様起動をかけるためのエラー表示起動
手段と、画面分割表示する際にその表示に先だって各設
計ルールエラー個所にエラーマークーを付加するエラー
マーク生成手段と、画面分割された複数の画面にそれぞ
れ表示画面割り当て手段によって割り当てられた表示領
域をエラーマークとともに表示する画面表示手段と、表
示された複数の画面の配線修正を並列に行う配線集計手
段と、現在の表示領域が表示された複数の画面に分割画
面数分同時に次の表示領域を呼び出す画面選択手段とを
備えることを特徴とする設計ルールエラーの表示方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4160887A JP2900707B2 (ja) | 1992-06-19 | 1992-06-19 | 設計ルールエラーの表示方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4160887A JP2900707B2 (ja) | 1992-06-19 | 1992-06-19 | 設計ルールエラーの表示方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH06168284A JPH06168284A (ja) | 1994-06-14 |
JP2900707B2 true JP2900707B2 (ja) | 1999-06-02 |
Family
ID=15724517
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4160887A Expired - Fee Related JP2900707B2 (ja) | 1992-06-19 | 1992-06-19 | 設計ルールエラーの表示方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2900707B2 (ja) |
-
1992
- 1992-06-19 JP JP4160887A patent/JP2900707B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JPH06168284A (ja) | 1994-06-14 |
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Legal Events
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