JP2819624B2 - ディジタル信号再生装置 - Google Patents
ディジタル信号再生装置Info
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- JP2819624B2 JP2819624B2 JP1147890A JP14789089A JP2819624B2 JP 2819624 B2 JP2819624 B2 JP 2819624B2 JP 1147890 A JP1147890 A JP 1147890A JP 14789089 A JP14789089 A JP 14789089A JP 2819624 B2 JP2819624 B2 JP 2819624B2
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- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/76—Television signal recording
- H04N5/91—Television signal processing therefor
- H04N5/93—Regeneration of the television signal or of selected parts thereof
- H04N5/94—Signal drop-out compensation
- H04N5/945—Signal drop-out compensation for signals recorded by pulse code modulation
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
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- G—PHYSICS
- G11—INFORMATION STORAGE
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- Multimedia (AREA)
- Television Signal Processing For Recording (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【発明の詳細な説明】 産業上の利用分野 本発明は、ディジタルVTRのように、ディジタル記録
された信号の再生に用いて好適なるディジタル信号再生
装置に関する。
された信号の再生に用いて好適なるディジタル信号再生
装置に関する。
従来の技術 一般的に、ディジタルデータの記録には、第３図に示
すようなブロック化記録が行われる。即ち、複数のデー
タよりなるデータサブブロックと、このデータサブブロ
ックに関する情報、例えば、ビデオ信号ならば、何番目
の水平走査線のデータである等の情報よりなるIDサブブ
ロックと、データサブブロックまたはデータサブブロッ
クとIDサブブロックとに対する誤り訂正用のパリティー
よりなるパリティーサブブロックと、ブロック同期のた
めの同期パターンよりなる同期サブブロックとにより１
ブロックが構成される。
すようなブロック化記録が行われる。即ち、複数のデー
タよりなるデータサブブロックと、このデータサブブロ
ックに関する情報、例えば、ビデオ信号ならば、何番目
の水平走査線のデータである等の情報よりなるIDサブブ
ロックと、データサブブロックまたはデータサブブロッ
クとIDサブブロックとに対する誤り訂正用のパリティー
よりなるパリティーサブブロックと、ブロック同期のた
めの同期パターンよりなる同期サブブロックとにより１
ブロックが構成される。
このようにブロック記録されたデータの再生に関して
は、まず、同期パターンを検出し、次いでID情報のすべ
てまたはいくつかを参照してメモリーに記憶する。この
場合、データは参照されたIDをアドレスの一部とするメ
モリー領域に記憶される。
は、まず、同期パターンを検出し、次いでID情報のすべ
てまたはいくつかを参照してメモリーに記憶する。この
場合、データは参照されたIDをアドレスの一部とするメ
モリー領域に記憶される。
発明が解決しようとする課題 このような従来構成では、参照するID情報に誤りがあ
るとデータは正しい領域に記憶されず、ブロックエラー
が生じる。しかも、このエラーは前記パリティーによっ
ては訂正できない。例えば、本来の参照IDが「Ａ」であ
る場合に、これが誤って「Ｂ」になったとする。この場
合、前記「Ａ」に対応するメモリーには書込みが行われ
ないから、このメモリーの内容は正しく更新されずに終
わる。
るとデータは正しい領域に記憶されず、ブロックエラー
が生じる。しかも、このエラーは前記パリティーによっ
ては訂正できない。例えば、本来の参照IDが「Ａ」であ
る場合に、これが誤って「Ｂ」になったとする。この場
合、前記「Ａ」に対応するメモリーには書込みが行われ
ないから、このメモリーの内容は正しく更新されずに終
わる。
メモリーからの読出しに際しては、この未更新データ
が前記アドレス「Ａ」に対するデータとして得られてい
るが、このデータは本来のデータとは異なっている。し
かも、データに対するパリティーもまたこの未更新デー
タに対するものであるから、読出されたデータが未更新
のものかどうかを識別できない。
が前記アドレス「Ａ」に対するデータとして得られてい
るが、このデータは本来のデータとは異なっている。し
かも、データに対するパリティーもまたこの未更新デー
タに対するものであるから、読出されたデータが未更新
のものかどうかを識別できない。
以上示したように、従来の技術では多くの原因で生じ
る未更新エラーをブロック内パリティーのみで検出する
ことはできない。
る未更新エラーをブロック内パリティーのみで検出する
ことはできない。
本発明は、このような従来技術に残された課題を解決
することを目的とする。
することを目的とする。
課題を解決するための手段 本発明は、上記目的を達成するため、ディジタル信号
を記憶する記憶手段と、この記憶手段に関して書込みを
行ったことを示す書込信号と読出しを行ったことを示す
読出信号とを生成保持し、前記記憶手段に関する読み書
き状態を監視する状態監視手段と、前記状態監視手段が
書込みと読出しが交互に行われなかったことを示す場合
には、前記記憶手段からの読出データを読出されたデー
タとは異なるデータに変換して出力とするデータ変換手
段とを備えることを特徴とするものである。
を記憶する記憶手段と、この記憶手段に関して書込みを
行ったことを示す書込信号と読出しを行ったことを示す
読出信号とを生成保持し、前記記憶手段に関する読み書
き状態を監視する状態監視手段と、前記状態監視手段が
書込みと読出しが交互に行われなかったことを示す場合
には、前記記憶手段からの読出データを読出されたデー
タとは異なるデータに変換して出力とするデータ変換手
段とを備えることを特徴とするものである。
また、データを変換せずに包含状態を示す信号を出力
してもよいし、データ読出し後特定のデータを記憶手段
に書込むようにしてもよい。
してもよいし、データ読出し後特定のデータを記憶手段
に書込むようにしてもよい。
作用 記憶手段に関しては、書込みと読出しとが交互に繰り
返されなければならない。つまり、書込まれずに読出し
が２回以上続く場合には、読出されたデータは未更新デ
ータであり、誤りである。したがって、このような場合
には読出データを変形して、パリティーで誤りを検出で
きるようにするか、または誤りであることを示す信号を
付加すれば、正しいデータとして処理されることはなく
なる。
返されなければならない。つまり、書込まれずに読出し
が２回以上続く場合には、読出されたデータは未更新デ
ータであり、誤りである。したがって、このような場合
には読出データを変形して、パリティーで誤りを検出で
きるようにするか、または誤りであることを示す信号を
付加すれば、正しいデータとして処理されることはなく
なる。
また、データ読出し後特定のデータを書込むようにし
ておいても、入力したディジタル信号の書込みなしで読
出すとこの特定のデータを読出すので、未更新データで
あることを検出することができる。
ておいても、入力したディジタル信号の書込みなしで読
出すとこの特定のデータを読出すので、未更新データで
あることを検出することができる。
実 施 例 第１図に、本発明の第１実施例におけるディジタル信
号再生装置の回路構成を示す。同装置における入力は、
ブロックスタート信号（sync）と、第３図に示したよう
にブロック化された再生データ（data）である。
号再生装置の回路構成を示す。同装置における入力は、
ブロックスタート信号（sync）と、第３図に示したよう
にブロック化された再生データ（data）である。
ブロックスタート信号は、データをメモリー２に書込
むために必要なIDをブロック化データから抽出すると共
に前記データをメモリー２に書込むためのアドレスを生
成する書込アドレス生成回路１に送られる。書込アドレ
ス生成回路１では、前記IDに基づいて生成された書込ブ
ロックアドレス（WBA）と、ブロック内データを記憶す
るための書込データアドレス（WDA）よりなる書込アド
レスを生成する。
むために必要なIDをブロック化データから抽出すると共
に前記データをメモリー２に書込むためのアドレスを生
成する書込アドレス生成回路１に送られる。書込アドレ
ス生成回路１では、前記IDに基づいて生成された書込ブ
ロックアドレス（WBA）と、ブロック内データを記憶す
るための書込データアドレス（WDA）よりなる書込アド
レスを生成する。
メモリー２へは書込ブロックアドレスとデータアドレ
スとが送られ、読み書き監視回路３へはブロックアドレ
スが送られる。メモリー２は書込アドレス生成回路１か
らの書込アドレスに対応する領域にデータを記憶する。
スとが送られ、読み書き監視回路３へはブロックアドレ
スが送られる。メモリー２は書込アドレス生成回路１か
らの書込アドレスに対応する領域にデータを記憶する。
一方、読み書き監視回路３は、ブロックアドレスへの
書込回数を保持する書込回数保持回路４の内容を読出
し、これに「１」を加えて再び書込回数保持回路４に記
憶させる。したがって、例えば、ブロックアドレス
「Ａ」に対するこれまでの書込回数がゼロの場合は、
「１」を新たに保持させ、これまでの書込回数が「１」
の場合には「２」を新たに保持させる。
書込回数を保持する書込回数保持回路４の内容を読出
し、これに「１」を加えて再び書込回数保持回路４に記
憶させる。したがって、例えば、ブロックアドレス
「Ａ」に対するこれまでの書込回数がゼロの場合は、
「１」を新たに保持させ、これまでの書込回数が「１」
の場合には「２」を新たに保持させる。
逆に、読出し時には、読出アドレス生成回路５で生成
される読出ブロックアドレス（RBA）と読出データアド
レス（RDA）よりなる読出アドレスに基づいて、データ
を読出す。さらに、読出ブロックアドレスは、読み書き
監視回路３へも送られる。
される読出ブロックアドレス（RBA）と読出データアド
レス（RDA）よりなる読出アドレスに基づいて、データ
を読出す。さらに、読出ブロックアドレスは、読み書き
監視回路３へも送られる。
このとき、読み書き監視回路３では、読出アドレス生
成回路５からの読出ブロックアドレス（例えば「Ａ」）
に対応する書込回数保持回路４の内容（例えば「Ｘ」）
を読出して保持すると共に、書込回数保持回路４のアド
レス「Ａ」の内容をゼロにする。
成回路５からの読出ブロックアドレス（例えば「Ａ」）
に対応する書込回数保持回路４の内容（例えば「Ｘ」）
を読出して保持すると共に、書込回数保持回路４のアド
レス「Ａ」の内容をゼロにする。
さらに、前記「Ｘ」がゼロの場合には、読出しと読出
しとの間に書込みが無かったことを示すから、このブロ
ックアドレス「Ａ」に対応する読出データは未更新であ
ることがわかる。したがって、この場合、読み書き監視
回路３は未更新信号を生成して出力とする。
しとの間に書込みが無かったことを示すから、このブロ
ックアドレス「Ａ」に対応する読出データは未更新であ
ることがわかる。したがって、この場合、読み書き監視
回路３は未更新信号を生成して出力とする。
データ変換手段６は、読み書き監視回路３から現在の
読出データが未更新であることを知らされたときのみ、
この読出データをブロック内パリティーで誤りを検出で
きる形に変換して送出する。
読出データが未更新であることを知らされたときのみ、
この読出データをブロック内パリティーで誤りを検出で
きる形に変換して送出する。
このように本実施例では、従来ブロック内パリティー
では誤りを検出できなかったメモリー未更新データに対
しても正しく誤りを検出できる。
では誤りを検出できなかったメモリー未更新データに対
しても正しく誤りを検出できる。
なお、本実施例ではブロック内パリティーで誤りを検
出できる形に変形して送出しているが、メモリー２から
の読出データを変形せずに送出すると共に、読み書き監
視回路３からの未更新信号をも後続の回路に送ること
で、同等の効果が得られるので、システムに応じて何れ
を用いてもよい。
出できる形に変形して送出しているが、メモリー２から
の読出データを変形せずに送出すると共に、読み書き監
視回路３からの未更新信号をも後続の回路に送ること
で、同等の効果が得られるので、システムに応じて何れ
を用いてもよい。
また、本実施例では前記書込回数「Ｘ」がゼロの場合
のみ、未更新データとして扱っているが、「Ｘ」が
「２」以上の場合も読出データが誤っている可能性があ
る。したがって、正しいことがはっきりしていないデー
タは誤りであるとした方がよい場合には、「Ｘ」が
「２」以上の場合にも未更新データと同じ処理を施せば
よい。必要であれば、「Ｘ」の値そのものを後続の回路
に送ってもよい。
のみ、未更新データとして扱っているが、「Ｘ」が
「２」以上の場合も読出データが誤っている可能性があ
る。したがって、正しいことがはっきりしていないデー
タは誤りであるとした方がよい場合には、「Ｘ」が
「２」以上の場合にも未更新データと同じ処理を施せば
よい。必要であれば、「Ｘ」の値そのものを後続の回路
に送ってもよい。
何れにしても、メモリー２の読み書き状態を監視する
ことで、従来では検出できなかった誤りを検出できる本
実施例は、ディジタル信号の確からしさを大きく高める
ことができると共に、回路規模も非常に小さいので、実
用的な性能向上が可能である。
ことで、従来では検出できなかった誤りを検出できる本
実施例は、ディジタル信号の確からしさを大きく高める
ことができると共に、回路規模も非常に小さいので、実
用的な性能向上が可能である。
次に、本発明の第２実施例におけるディジタル信号再
生装置を、第２図に基づいて説明する。
生装置を、第２図に基づいて説明する。
第１実施例では、読み書きのブロックアドレスを監視
して分かる未更新データに対しては、メモリー２から読
出したデータに対して処理しているが、本実施例では、
メモリー２からデータを読み出した後、ブロック内パリ
ティーで誤りを検出できるデータをメモリー２に書込む
ようにしている。
して分かる未更新データに対しては、メモリー２から読
出したデータに対して処理しているが、本実施例では、
メモリー２からデータを読み出した後、ブロック内パリ
ティーで誤りを検出できるデータをメモリー２に書込む
ようにしている。
第２図に示す同装置の回路構成において、入力は、第
１実施例の場合と同じく、ブロックスタート信号（syn
c）と、第３図に示したようにブロック化された再生デ
ータ（data）である。
１実施例の場合と同じく、ブロックスタート信号（syn
c）と、第３図に示したようにブロック化された再生デ
ータ（data）である。
ブロックスタート信号は、データをメモリー２に書込
むために必要なIDをブロック化データから抽出すると共
に前記データをメモリー２に書込むためのアドレスを生
成する書込アドレス生成回路１に送られる。書込アドレ
ス生成回路１では、前記IDに基づいて生成された書込ブ
ロックアドレス（WBA）と、ブロック内データを記憶す
るための書込データアドレス（WDA）よりなる書込アド
レスを生成する。メモリー２は、書込アドレス生成回路
１からの書込アドレスに対応する領域にデータ（data）
を記憶する。
むために必要なIDをブロック化データから抽出すると共
に前記データをメモリー２に書込むためのアドレスを生
成する書込アドレス生成回路１に送られる。書込アドレ
ス生成回路１では、前記IDに基づいて生成された書込ブ
ロックアドレス（WBA）と、ブロック内データを記憶す
るための書込データアドレス（WDA）よりなる書込アド
レスを生成する。メモリー２は、書込アドレス生成回路
１からの書込アドレスに対応する領域にデータ（data）
を記憶する。
逆に、読出し時には、読出アドレス生成回路７で生成
される読出ブロックアドレス（RBA）と読出データアド
レス（RDA）よりなる読出アドレス（例えば「Ａ」）に
基づいて、データを読出す。さらに、読出した直後にア
ドレス「Ａ」に対して、メモリー未更新検出用データ生
成回路８からのメモリー未更新検出用データを記憶させ
る。
される読出ブロックアドレス（RBA）と読出データアド
レス（RDA）よりなる読出アドレス（例えば「Ａ」）に
基づいて、データを読出す。さらに、読出した直後にア
ドレス「Ａ」に対して、メモリー未更新検出用データ生
成回路８からのメモリー未更新検出用データを記憶させ
る。
この結果、読出し以前に書込みがなされていないメモ
リー２の領域には、前記メモリー未更新検出用データが
記憶されたままになっている。したがって、未更新検出
用データが読出されることにより、第１実施例の場合と
同様に未更新データに対して誤りを検出できる。当然、
正しく書込みがなされた場合には、メモリー未更新検出
用データは正しいデータに書換えられているので、何等
問題は起こらない。
リー２の領域には、前記メモリー未更新検出用データが
記憶されたままになっている。したがって、未更新検出
用データが読出されることにより、第１実施例の場合と
同様に未更新データに対して誤りを検出できる。当然、
正しく書込みがなされた場合には、メモリー未更新検出
用データは正しいデータに書換えられているので、何等
問題は起こらない。
このように、本実施例でも第１実施例の場合と同様
に、未更新データに対してブロック内パリティーを用い
て、誤りを検出できる。しかも、回路規模も非常に小さ
く、本実施例の実用性は非常に高い。
に、未更新データに対してブロック内パリティーを用い
て、誤りを検出できる。しかも、回路規模も非常に小さ
く、本実施例の実用性は非常に高い。
発明の効果 本発明は、メモリーの読み書きを監視することで、従
来ブロック内パリティーでは誤りを検出できなかったメ
モリー未更新データに対しても、ブロックパリティーの
みで誤りを検出できるのみならず、非常に小さい回路規
模で実現できる。
来ブロック内パリティーでは誤りを検出できなかったメ
モリー未更新データに対しても、ブロックパリティーの
みで誤りを検出できるのみならず、非常に小さい回路規
模で実現できる。
したがって、ディジタルVTRをはじめとする各種ディ
ジタル信号処理回路に容易に利用でき、非常に大きな実
用上の利用効果がある。
ジタル信号処理回路に容易に利用でき、非常に大きな実
用上の利用効果がある。
第１図は本発明の第１実施例におけるディジタル信号再
生装置の回路構成を示すブロック図、第２図は本発明の
第２実施例におけるディジタル信号再生装置の回路構成
を示すブロック図、第３図はブロック化データの構成図
である。 １……書込アドレス生成回路、２……メモリー、３……
読み書き監視回路、４……書込回数保持回路、５、７…
…読出アドレス生成回路、６……データ変換回路、８…
…メモリー未更新検出用データ生成回路。
生装置の回路構成を示すブロック図、第２図は本発明の
第２実施例におけるディジタル信号再生装置の回路構成
を示すブロック図、第３図はブロック化データの構成図
である。 １……書込アドレス生成回路、２……メモリー、３……
読み書き監視回路、４……書込回数保持回路、５、７…
…読出アドレス生成回路、６……データ変換回路、８…
…メモリー未更新検出用データ生成回路。
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.6，ＤＢ名) G11B 20/18
Claims (2)
- 【請求項１】ディジタル信号を記憶する記憶手段と、こ
の記憶手段に関して書込みを行ったことを示す書込信号
と読出しを行ったことを示す読出信号とを生成保持し、
前記記憶手段に関する読み書き状態を監視する状態監視
手段と、前記状態監視手段が書込みと読出しが交互に行
われなかったことを示す場合には、前記記憶手段からの
読出データを読出されたデータとは異なるデータに変換
して出力とするデータ変換手段とを備えることを特徴と
するディジタル信号再生装置。 - 【請求項２】ディジタル信号を記憶する記憶手段と、こ
の記憶手段に関して書込みを行ったことを示す書込信号
と読出を行ったことを示す読出信号とを生成保持し、前
記記憶手段に関する書き込みと読み出しが交互に行われ
なかったことを示す信号を生成して出力とする状態監視
手段を備えることを特徴とするディジタル信号再生装
置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1147890A JP2819624B2 (ja) | 1989-06-09 | 1989-06-09 | ディジタル信号再生装置 |
| US07/534,276 US5202890A (en) | 1989-06-09 | 1990-06-07 | Block error detector |
| DE69028447T DE69028447T2 (de) | 1989-06-09 | 1990-06-08 | Blockfehlerdetektor |
| EP90110890A EP0401855B1 (en) | 1989-06-09 | 1990-06-08 | Block error detector |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1147890A JP2819624B2 (ja) | 1989-06-09 | 1989-06-09 | ディジタル信号再生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0312874A JPH0312874A (ja) | 1991-01-21 |
| JP2819624B2 true JP2819624B2 (ja) | 1998-10-30 |
Family
ID=15440498
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1147890A Expired - Fee Related JP2819624B2 (ja) | 1989-06-09 | 1989-06-09 | ディジタル信号再生装置 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5202890A (ja) |
| EP (1) | EP0401855B1 (ja) |
| JP (1) | JP2819624B2 (ja) |
| DE (1) | DE69028447T2 (ja) |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54117576U (ja) * | 1978-01-30 | 1979-08-17 | ||
| MY109399A (en) * | 1992-01-07 | 1997-01-31 | Koninklijke Philips Electronics Nv | Device for processing digital data, and digital video system comprising the device |
| KR100228267B1 (ko) * | 1992-12-30 | 1999-11-01 | 윤종용 | 영상부호화 시스템의 에러수정장치 |
| JPH086127A (ja) * | 1994-06-15 | 1996-01-12 | Canon Inc | カメラ |
| US6029208A (en) * | 1996-10-09 | 2000-02-22 | Samsung Electronics Co., Ltd. | System for generating block address by replacing second count with second valid block address whenever sync is detected or symbol count is reached in one complete block |
| US7325249B2 (en) | 2001-04-30 | 2008-01-29 | Aol Llc | Identifying unwanted electronic messages |
| US7870089B1 (en) * | 2001-12-03 | 2011-01-11 | Aol Inc. | Reducing duplication of embedded resources on a network |
| US7496604B2 (en) | 2001-12-03 | 2009-02-24 | Aol Llc | Reducing duplication of files on a network |
| US7590695B2 (en) | 2003-05-09 | 2009-09-15 | Aol Llc | Managing electronic messages |
| US7739602B2 (en) | 2003-06-24 | 2010-06-15 | Aol Inc. | System and method for community centric resource sharing based on a publishing subscription model |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5661873A (en) * | 1979-10-25 | 1981-05-27 | Sony Corp | Digital video signal processor |
| JPS5750307A (en) * | 1980-09-05 | 1982-03-24 | Sony Corp | Time base correcting device |
| JPS59175011A (ja) * | 1983-03-24 | 1984-10-03 | Hitachi Ltd | Ｐｃｍ信号再生方式 |
| US4742519A (en) * | 1985-05-21 | 1988-05-03 | Sony Corporation | Apparatus for decoding error correcting code |
| JPH0654590B2 (ja) * | 1985-07-24 | 1994-07-20 | パイオニア株式会社 | ディジタルデータの再生方法 |
| JPH0636285B2 (ja) * | 1985-09-26 | 1994-05-11 | パイオニア株式会社 | デジタルデ−タ再生方式 |
| JP2522258B2 (ja) * | 1986-09-05 | 1996-08-07 | ソニー株式会社 | 信号処理装置 |
-
1989
- 1989-06-09 JP JP1147890A patent/JP2819624B2/ja not_active Expired - Fee Related
-
1990
- 1990-06-07 US US07/534,276 patent/US5202890A/en not_active Expired - Fee Related
- 1990-06-08 EP EP90110890A patent/EP0401855B1/en not_active Expired - Lifetime
- 1990-06-08 DE DE69028447T patent/DE69028447T2/de not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| EP0401855B1 (en) | 1996-09-11 |
| DE69028447T2 (de) | 1997-03-13 |
| DE69028447D1 (de) | 1996-10-17 |
| EP0401855A2 (en) | 1990-12-12 |
| US5202890A (en) | 1993-04-13 |
| JPH0312874A (ja) | 1991-01-21 |
| EP0401855A3 (en) | 1992-01-15 |
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