JP2751704B2 - プラズマディスプレイパネルの製造方法 - Google Patents
プラズマディスプレイパネルの製造方法Info
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- JP2751704B2 JP2751704B2 JP414592A JP414592A JP2751704B2 JP 2751704 B2 JP2751704 B2 JP 2751704B2 JP 414592 A JP414592 A JP 414592A JP 414592 A JP414592 A JP 414592A JP 2751704 B2 JP2751704 B2 JP 2751704B2
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- address electrode
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Description
【０００１】
【発明が解決しようとする課題】本発明は、プラズマデ
ィスプレイパネルの製造方法に係り、特に電極を焼成工
程を含んだ厚膜法で形成する製造方法の改良に関する。
ィスプレイパネルの製造方法に係り、特に電極を焼成工
程を含んだ厚膜法で形成する製造方法の改良に関する。
【０００２】コンピュータが多用されることにより、コ
ンピュータによる計算結果の表示やＣＡＤ、ＣＧなどの
図形表示、ワードプロセッサによる文章作成、情報照会
などにディスプレイも頻繁に使用されるようになった。
ンピュータによる計算結果の表示やＣＡＤ、ＣＧなどの
図形表示、ワードプロセッサによる文章作成、情報照会
などにディスプレイも頻繁に使用されるようになった。
【０００３】このディスプレイの使用に伴いディスプレ
イの小型化が進み、より薄く、かつ鮮明で安定した表示
が可能なディスプレイが要求されている。このため、今
日では、薄型ディスプレイパネルが製造可能な液晶ディ
スプレイやプラズマディスプレイが使用されているが、
画像を鮮明で安定に表示可能にすることが今後の課題と
なっている。
イの小型化が進み、より薄く、かつ鮮明で安定した表示
が可能なディスプレイが要求されている。このため、今
日では、薄型ディスプレイパネルが製造可能な液晶ディ
スプレイやプラズマディスプレイが使用されているが、
画像を鮮明で安定に表示可能にすることが今後の課題と
なっている。
【０００４】
【従来の技術】プラズマディスプレイパネル（ＰＤＰ）
には、例えば特開昭59-79938，同61-39341などに示され
た三電極面放電形ＰＤＰがある。
には、例えば特開昭59-79938，同61-39341などに示され
た三電極面放電形ＰＤＰがある。
【０００５】この三電極面放電形ＰＤＰは、表示用放電
を行うための維持電極対を有する基板とアドレス用放電
（消去放電ともいう）を発生させるためのアドレス電極
を有する基板とをガス放電空間を挟んで対向配置して構
成される。
を行うための維持電極対を有する基板とアドレス用放電
（消去放電ともいう）を発生させるためのアドレス電極
を有する基板とをガス放電空間を挟んで対向配置して構
成される。
【０００６】図３はその表示面側の基板３に設けたアド
レス電極の配列形態を示し、この図ではカラー表示のた
めに３本のアドレス電極を１セットにして１絵素（ドッ
ト）を構成するとともに、５×７ドットの表示を得るた
めに５セットずつで群をなして１表示行を構成してい
る。
レス電極の配列形態を示し、この図ではカラー表示のた
めに３本のアドレス電極を１セットにして１絵素（ドッ
ト）を構成するとともに、５×７ドットの表示を得るた
めに５セットずつで群をなして１表示行を構成してい
る。
【０００７】各セットのアドレス電極群１１、１２は電
極３本相当のスペースを隔てて配列され、かつ各アドレ
ス電極セットの一端からは、リード端子４が導出され、
そのリード端子４はアドレス電極に電圧をかけるための
ドライバに接続される。
極３本相当のスペースを隔てて配列され、かつ各アドレ
ス電極セットの一端からは、リード端子４が導出され、
そのリード端子４はアドレス電極に電圧をかけるための
ドライバに接続される。
【０００８】前記アドレス電極は、例えば厚膜銀ペース
トを基板３上の所定領域に印刷した後、該厚膜銀ペース
トを所定温度で焼成することにより基板３に融着して形
成されるが、基板３の端部とアドレス電極群１１間、ア
ドレス電極群１１とアドレス電極群１２間のように電極
が存在しない領域が余りに広いと、その厚膜銀ペースト
の焼成時に表示領域を構成するアドレス電極群１１、１
２のそれぞれの両端部分のアドレス電極と中央部分のア
ドレス電極の焼成が均一に行われないため、それら両端
部分のアドレス電極の表面部分に、酸化物層が厚く形成
されるということがあった。
トを基板３上の所定領域に印刷した後、該厚膜銀ペース
トを所定温度で焼成することにより基板３に融着して形
成されるが、基板３の端部とアドレス電極群１１間、ア
ドレス電極群１１とアドレス電極群１２間のように電極
が存在しない領域が余りに広いと、その厚膜銀ペースト
の焼成時に表示領域を構成するアドレス電極群１１、１
２のそれぞれの両端部分のアドレス電極と中央部分のア
ドレス電極の焼成が均一に行われないため、それら両端
部分のアドレス電極の表面部分に、酸化物層が厚く形成
されるということがあった。
【０００９】
【発明が解決しようとする課題】従って、上記したよう
に、焼成状態の不均一化により表示領域を構成するアド
レス電極群の両端部分と中央部分のアドレス電極での電
気特性の差が大きくなり、ディスプレイパネル全面で安
定にかつ均一に動作出来る電圧範囲が狭くなり、しかも
アドレス電極に電圧をかけても本来アドレスのための消
去放電を発生しなければならないセルに、その消去放電
が確実に行われず余剰点灯、従って誤表示を引き起こす
という問題を生じていた。
に、焼成状態の不均一化により表示領域を構成するアド
レス電極群の両端部分と中央部分のアドレス電極での電
気特性の差が大きくなり、ディスプレイパネル全面で安
定にかつ均一に動作出来る電圧範囲が狭くなり、しかも
アドレス電極に電圧をかけても本来アドレスのための消
去放電を発生しなければならないセルに、その消去放電
が確実に行われず余剰点灯、従って誤表示を引き起こす
という問題を生じていた。
【００１０】本発明は、このような従来の状況から、ア
ドレス電極群を基板に融着するための焼成時において、
その焼成状態を良好にし、該アドレス電極群の電気特性
の不均一性を解消したプラズマディスプレイパネルの製
造方法を提供することを目的とする。
ドレス電極群を基板に融着するための焼成時において、
その焼成状態を良好にし、該アドレス電極群の電気特性
の不均一性を解消したプラズマディスプレイパネルの製
造方法を提供することを目的とする。
【００１１】
【課題を解決するための手段】図１は本発明の原理図で
ある。図中、１は前述したアドレス電極群であり、プラ
ズマディスプレイパネルを構成する一方の基板３上の表
示領域のみに焼成工程を含んだ厚膜法で形成されるもの
である。
ある。図中、１は前述したアドレス電極群であり、プラ
ズマディスプレイパネルを構成する一方の基板３上の表
示領域のみに焼成工程を含んだ厚膜法で形成されるもの
である。
【００１２】２はダミー電極であり、アドレス電極と実
質的に同一形状を持ち、かつアドレス電極群１の外側領
域、つまりプラズマディスプレイパネルの表示領域外に
焼成工程を含んだ厚膜法でアドレス電極群１と同時に形
成されるものである。
質的に同一形状を持ち、かつアドレス電極群１の外側領
域、つまりプラズマディスプレイパネルの表示領域外に
焼成工程を含んだ厚膜法でアドレス電極群１と同時に形
成されるものである。
【００１３】
【作用】本発明では、図１のようにアドレス電極群１の
両側にアドレス電極と実質的に同一形状のダミー電極２
を同時に形成している。
両側にアドレス電極と実質的に同一形状のダミー電極２
を同時に形成している。
【００１４】従って、アドレス電極を形成するための厚
膜銀ペーストの焼成時において、焼成状態が不良となる
領域がアドレス電極群１の外側のいわゆる表示領域外の
表示に使用しないダミー電極２の部分となり、表示に使
用するアドレス電極は良好な焼成状態を得られるため、
表示領域のアドレス電極の電気特性を均一化することが
可能となる。
膜銀ペーストの焼成時において、焼成状態が不良となる
領域がアドレス電極群１の外側のいわゆる表示領域外の
表示に使用しないダミー電極２の部分となり、表示に使
用するアドレス電極は良好な焼成状態を得られるため、
表示領域のアドレス電極の電気特性を均一化することが
可能となる。
【００１５】
【実施例】以下、図面を用いて実施例を詳細に説明す
る。図２は、本発明の実施例を示す図である。
る。図２は、本発明の実施例を示す図である。
【００１６】図２は三電極面放電形ＰＤＰを形成する表
示面側の基板の一部分を示すものであり、基板３にアド
レス電極群１１および１２とダミー電極２１および２２
が厚膜印刷で同時に形成されている。
示面側の基板の一部分を示すものであり、基板３にアド
レス電極群１１および１２とダミー電極２１および２２
が厚膜印刷で同時に形成されている。
【００１７】本実施例では、図２に示すように、従来例
同様３本のアドレス電極を１セットとし、５セットでア
ドレス電極群１１および１２を構成しており、各アドレ
ス電極群を所定間隔で配置し、各アドレス電極のセット
にはリード端子４が接続し、該リード端子４はドライバ
に配線している。
同様３本のアドレス電極を１セットとし、５セットでア
ドレス電極群１１および１２を構成しており、各アドレ
ス電極群を所定間隔で配置し、各アドレス電極のセット
にはリード端子４が接続し、該リード端子４はドライバ
に配線している。
【００１８】また、基板３の端部とアドレス電極群１
１、アドレス電極群１１と１２の間には、それぞれ３本
ずつのダミー電極群２１と２２が設けられており、その
各ダミー電極は各アドレス電極と同様な形状で、かつア
ドレス電極と同じ間隔で形成されている。
１、アドレス電極群１１と１２の間には、それぞれ３本
ずつのダミー電極群２１と２２が設けられており、その
各ダミー電極は各アドレス電極と同様な形状で、かつア
ドレス電極と同じ間隔で形成されている。
【００１９】なお、これらダミー電極群２１、２２はリ
ード端子４が設けられておらず、ドライバにも接続され
ていない。更に、アドレス電極群１１、１２とダミー電
極群２１、２２は、それぞれ各電極のセット間の間隔と
同じ間隔で配置している。
ード端子４が設けられておらず、ドライバにも接続され
ていない。更に、アドレス電極群１１、１２とダミー電
極群２１、２２は、それぞれ各電極のセット間の間隔と
同じ間隔で配置している。
【００２０】このように本実施例では、アドレス電極群
の両側にダミー電極群を該アドレス電極群とともに焼成
工程を含んだ厚膜法で形成するので、焼成工程時におい
て各アドレス電極群のうちの外側の電極も内側（中央部
分）の電極と同じ状態で焼成が行われる。
の両側にダミー電極群を該アドレス電極群とともに焼成
工程を含んだ厚膜法で形成するので、焼成工程時におい
て各アドレス電極群のうちの外側の電極も内側（中央部
分）の電極と同じ状態で焼成が行われる。
【００２１】この実施例の場合、基板端部に近いダミー
電極では焼成不良状態が発生し易いけれども、この電極
は表示には無関係であるため表示品質向上何ら問題な
い。なお、上記実施例では複数のアドレス電極群の間に
非表示のスペース領域を設けた部分的表示のパネル構成
を示したが、本発明はこれに限らず例えばパネル全面が
１つの表示領域となる構成のパネルにも適用可能であ
り、その表示領域全体のアドレス電極を１つの群として
両外側にダミー電極を配置すれば良い。
電極では焼成不良状態が発生し易いけれども、この電極
は表示には無関係であるため表示品質向上何ら問題な
い。なお、上記実施例では複数のアドレス電極群の間に
非表示のスペース領域を設けた部分的表示のパネル構成
を示したが、本発明はこれに限らず例えばパネル全面が
１つの表示領域となる構成のパネルにも適用可能であ
り、その表示領域全体のアドレス電極を１つの群として
両外側にダミー電極を配置すれば良い。
【００２２】また、各電極間の間隔を等間隔にするよう
にも上記したが、必ずしも等間隔でなくてもよい。
にも上記したが、必ずしも等間隔でなくてもよい。
【００２３】以上説明したように、本発明によれば、三
電極面放電形プラズマディスプレイパネルの焼成工程を
含んだ厚膜法によるアドレス電極群を均一に焼成するこ
とが出来、それによって表示領域内のアドレス電極群の
電気特性の均一化が可能となり、更に該ディスプレイパ
ネルの動作電圧の電圧範囲が広くなるため、ディスプレ
イパネル全面での安定した表示およびそのディスプレイ
パネルの性能向上に寄与するところが大きい。
電極面放電形プラズマディスプレイパネルの焼成工程を
含んだ厚膜法によるアドレス電極群を均一に焼成するこ
とが出来、それによって表示領域内のアドレス電極群の
電気特性の均一化が可能となり、更に該ディスプレイパ
ネルの動作電圧の電圧範囲が広くなるため、ディスプレ
イパネル全面での安定した表示およびそのディスプレイ
パネルの性能向上に寄与するところが大きい。
【図１】本発明の原理図である。
【図２】本発明の実施例を示す図である。
【図３】従来例を示す図である。
１、１１、１２ アドレス電極群 ２ ダミー電極 ３ 基板 ４ リード端子 ２１、２２ ダミー電極群
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.6，ＤＢ名) H01J 9/14 H01J 9/02 H01J 11/00 H01J 11/02
Claims (1)
- 【請求項１】 隣接電極間での面放電を発生させるため
の電極対を構成する複数の維持電極と、これら電極と交
差する方向に配列された複数のアドレス電極とを有する
プラズマディスプレイパネルの製造方法において、 前記複数のアドレス電極を焼成工程を含んだ厚膜法によ
り形成する際、群単位のアドレス電極の外側領域に当該
アドレス電極と実質的に同一形状のダミー電極を同時に
形成することを特徴とするプラズマディスプレイパネル
の製造方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP414592A JP2751704B2 (ja) | 1992-01-13 | 1992-01-13 | プラズマディスプレイパネルの製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP414592A JP2751704B2 (ja) | 1992-01-13 | 1992-01-13 | プラズマディスプレイパネルの製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05190085A JPH05190085A (ja) | 1993-07-30 |
| JP2751704B2 true JP2751704B2 (ja) | 1998-05-18 |
Family
ID=11576613
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP414592A Expired - Fee Related JP2751704B2 (ja) | 1992-01-13 | 1992-01-13 | プラズマディスプレイパネルの製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2751704B2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100235483B1 (ko) * | 1995-09-28 | 1999-12-15 | 김영남 | 평판소자의 기능층 배열구조 |
| KR100496283B1 (ko) * | 2000-04-28 | 2005-06-17 | 삼성에스디아이 주식회사 | 플라즈마 디스플레이 패널 |
| KR100488449B1 (ko) * | 2002-09-12 | 2005-05-11 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널 |
-
1992
- 1992-01-13 JP JP414592A patent/JP2751704B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH05190085A (ja) | 1993-07-30 |
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| Date | Code | Title | Description |
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