JP2023126671A - ドライバ回路 - Google Patents
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Abstract
Description
このように、図7に示した構成によれば、信号を出力しないシャットダウンモードを実現することができる。
以下、本発明の実施例について図面を参照して説明する。図1は本発明の第1の実施例に係るドライバ回路の構成を示す回路図である。本実施例のドライバ回路は、ゲート端子が信号入力端子1,2に接続され、ドレイン端子が信号出力端子3,4に接続されたNMOSトランジスタQ1,Q2(差動対トランジスタ)と、ドレイン端子がNMOSトランジスタQ1,Q2のソース端子に接続され、ソース端子がグラウンドに接続され、NMOSトランジスタQ1,Q2に定電流を供給する電流源となるNMOSトランジスタQ3と、一端が電圧電圧VDDに接続され、他端が信号出力端子3,4に接続された負荷抵抗R1,R2と、通常の増幅モード時にオンとなってバイアス電圧VbをNMOSトランジスタQ3のゲート端子に印加し、シャットダウンモード時にオフとなってNMOSトランジスタQ3のゲート端子へのバイアス電圧印加を停止するスイッチSW1と、一端がグラウンドに接続されたキャパシタC3,C4と、シャットダウンモード時にオンとなってキャパシタC3の他端と正相側の信号出力端子3とを接続し、増幅モード時にオフとなってキャパシタC3を信号出力端子3から切り離すスイッチSW2と、シャットダウンモード時にオンとなってキャパシタC4の他端と逆相側の信号出力端子4とを接続し、増幅モード時にオフとなってキャパシタC4を信号出力端子4から切り離すスイッチSW3と、スイッチSW1~SW3を制御する制御回路10とから構成される。
シャットダウンモード時には、スイッチSW1への制御入力としてシャットダウン信号SDが入力され、またスイッチSW2,SW3の制御入力としてシャットダウン信号SDの反転信号バーSDがスイッチSW2,SW3に入力される。
従来のドライバ回路の中には可変利得機能を持つものが存在する。本実施例は、この可変利得機能を応用して、シャットダウンモード時における入出力アイソレーション特性を改善する例である。図3は本実施例のドライバ回路の構成を示す回路図である。
第1の実施例と第2の実施例を組み合わせることで、シャットダウンモード時の入出力アイソレーション特性をさらに改善することが可能である。
第1の実施例と第2の実施例を組み合わせた構成を図6に示す。図6の各構成要素の動作は第1、第2の実施例で説明したとおりである。
Claims (3)
- 差動入力信号を増幅して一対の信号出力端子から出力するように構成された差動対トランジスタと、
前記差動対トランジスタに定電流を供給するように構成された電流源と、
シャットダウンモード時に前記電流源から前記差動対トランジスタへの電流供給を停止させるように構成されたスイッチと、
前記一対の信号出力端子間に挿入されたMOSトランジスタからなる可変抵抗と、
通常の増幅モード時にドライバ回路の利得を所望の値に設定するための利得制御信号に応じて前記MOSトランジスタのゲート端子に印加する制御電圧を設定し、前記シャットダウンモード時に前記制御電圧をドライバ回路の電源電圧よりも高く設定するように構成された第1の制御回路とを備えることを特徴とするドライバ回路。 - 請求項1記載のドライバ回路において、
前記増幅モード時に前記スイッチがオンとなり、前記シャットダウンモード時に前記スイッチがオフとなるように制御するように構成された第2の制御回路をさらに備えることを特徴とするドライバ回路。 - 請求項1または2記載のドライバ回路において、
前記MOSトランジスタは、
ソース端子が正相側の前記信号出力端子に接続された第1のMOSトランジスタと、
ドレイン端子が前記第1のMOSトランジスタのドレイン端子に接続され、ソース端子が逆相側の前記信号出力端子に接続された第2のMOSトランジスタとを含み、
前記第1の制御回路は、前記第1、第2のMOSトランジスタのゲート-ソース間に加えることができる最大電圧にドライバ回路の電源電圧を足した電圧を、前記シャットダウンモード時の前記制御電圧とすることを特徴とするドライバ回路。
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