JP2018508810A - 酸化物半導体薄膜トランジスタに用いる走査駆動回路 - Google Patents
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Abstract
Description
100 プルアップ制御部分
200 プルアップ部分
300 トランスファー部分
400 第1プルダウン部分
500 ブーストラップコンデンサ部分
600 プルダウンホールディング回路部分
600a メインインバータ
700 サブインバータ
Cb コンデンサ
CK(P) クロック信号
CK(n) クロック信号
CK(1) 第1クロック信号
CK(2) 第2クロック信号
CK(3) 第3クロック信号
CK(4) 第4クロック信号
CK(5) 第5クロック信号
CK(6) 第6クロック信号
CK(7) 第7クロック信号
CK(8) 第8クロック信号
DCH 定電圧高電位
DCL 定電圧低電位
G(N) 出力端
G(N−2) 出力端
G(N+2) 出力端
K(N) 第3ノード
P(N) 第2ノード
S(N) 第4ノード
S(1) 第4ノード
T11 第11トランジスタ
T21 第21トランジスタ
T22 第22トランジスタ
T32 第32トランジスタ
T41 第41トランジスタ
T42 第42トランジスタ
T51 第51トランジスタ
T52 第52トランジスタ
T53 第53トランジスタ
T54 第54トランジスタ
T71 第71トランジスタ
T72 第72トランジスタ
T73 第73トランジスタ
T74 第74トランジスタ
Q(1) 第1ノード
Q(N) 第1ノード
Q(N+2) 第1ノード
Q(N+4) 第1ノード
S(N) 第4ノード
ST(N−2) 駆動出力端
STV 起動信号端
VSS1 第1負電位
VSS2 第2負電位
Claims (15)
- 酸化物半導体薄膜トランジスタに用いる走査駆動回路であって、カスケード接続するP個のGOAユニットを含み、それぞれのGOAユニットは、プルアップ制御部分と、プルアップ部分と、トランスファー部分と、第1プルダウン部分と、ブーストラップコンデンサ部分とメインインバータ部分とを含み、
該走査駆動回路がさらにサブインバータを含み、かつ該サブインバータが各段の接続関係における該メインインバータ部分に接続して対応する該GOAユニットのプルダウンホールディング部分を形成し、
P、Nを正の整数に設定し、かつN≦Pとし、
第N段接続関係における該メインインバータ部分が、ゲート電極とドレイン電極とのいずれもが定電圧高電位(DCH)に電気的に接続し、ドレイン電極が第4ノード(S(N))に電気的に接続する第51トランジスタ(T51)と、
ゲート電極が第1ノード(Q(N))に電気的に接続し、ドレイン電極が第4ノード(S(N))に電気的に接続し、ソース電極が第1負壓電位(VSS1)に電気的に接続する第52トランジスタ(T52)と、
ゲート電極が第4ノード(S(N))に電気的に接続し、ドレイン電極が該定電圧高電位(DCH)に電気的に接続し、ソース電極が第2ノード(P(N))に電気的に接続する第53トランジスタ(T53)と、
ゲート電極が第1ノード(Q(N))に電気的に接続し、ドレイン電極が第2ノード(P(N))に電気的に接続し、ソース電極が第3ノード(K(N))に電気的に接続する第54トランジスタと(T54)と、を含み、
該サブインバータが、ゲート電極が第1段の接続関係において該メインインバータの第4ノード(S(1))に電気的に接続し、ドレイン電極が定電圧高電位(DCH)に電気的に接続する第73トランジスタ(T73)と、
ゲート電極が最後の1段の接続関係において該メインインバータの第4ノード(S(P))に電気的に接続し、ドレイン電極が第3ノード(K(N))に電気的に接続し、ソース電極が該第73トランジスタ(T73)のソース電極に電気的に接する第74トランジスタ(T74)と、
ゲート電極が第1段の接続関係において該メインインバータの第1ノード(Q(1))に電気的に接続し、ドレイン電極が第3ノードK(N)に電気的に接続し、ソース電極が定電圧低電位(DCL)に電気的に接する第75トランジスタ(T75)と、
ゲート電極が最後の1段の接続関係において該メインインバータの第1ノード(Q(P))に電気的に接続し、ドレイン電極が定電圧低電位(DCL)に電気的に接続し、ソース電極が第3ノードK(N)に電気的に接する第76トランジスタ(T76)と、を含み、
該プルアップ部分が、ゲート電極が第1ノード(Q(N))に電気的に接続し、ドレイン電極がクロック信号(CK(n))に電気的に接続し、ソース電極が出力端G(N)に電気的に接続する第21トランジスタ(T21)を含み、
該トランスファー部分が、ゲート電極が第1ノード(Q(N))に電気的に接続し、ドレイン電極がクロック信号(CK(n)に電気的に接続しソース電極が駆動出力端(ST(N))に電気的に接続する第22トランジスタ(T22)を含み、
該走査駆動回路の第1段の接続関係における第1ノード(Q(1))の出力する信号の第1波形は凸字状を呈するとともに、最後の1段の接続関係における第1ノード(Q(P))の出力する信号の第2波形は凸字状を呈して、かつ第1波形と第2波形の重なる部分の対応する信号に基づき該サブインバータを制御することを特徴とする酸化物半導体薄膜トランジスタに用いる走査駆動回路。 - 酸化物半導体薄膜トランジスタに用いる走査駆動回路であって、カスケード接続するP個のGOAユニットを含み、それぞれのGOAユニットは、プルアップ制御部分と、プルアップ部分と、トランスファー部分と、第1プルダウン部分と、ブーストラップコンデンサ部分とメインインバータ部分とを含み、
該走査駆動回路がさらにサブインバータを含み、かつ該サブインバータが各段の接続関係における該メインインバータ部分に接続して対応する該GOAユニットのプルダウンホールディング部分を形成し、
P、Nを正の整数に設定し、かつN≦Pとし、
第N段接続関係における該メインインバータ部分が、ゲート電極とドレイン電極とのいずれもが定電圧高電位(DCH)に電気的に接続し、ソース電極が第4ノード(S(N))に電気的に接続する第51トランジスタ(T51)と、
ゲート電極が第1ノード(Q(N))に電気的に接続し、ドレイン電極が第4ノード(S(N))に電気的に接続し、ソース電極が第1負壓電位(VSS1)に電気的に接続する第52トランジスタ(T52)と、
ゲート電極が第4ノード(S(N))に電気的に接続し、ドレイン電極が該定電圧高電位(DCH)に電気的に接続し、ソース電極が第2ノード(P(N))に電気的に接続する第53トランジスタ(T53)と、
ゲート電極が第1ノード(Q(N))に電気的に接続し、ドレイン電極が第2ノード(P(N))に電気的に接続し、ソース電極が第3ノード(K(N))に電気的に接続する第54トランジスタと(T54)と、を含み、
該サブインバータがゲート電極が第1段の接続関係において該メインインバータの第4ノード(S(1))に電気的に接続し、ドレイン電極が定電圧高電位(DCH)に電気的に接続する第73トランジスタ(T73)と、
ゲート電極が最後の1段の接続関係において該メインインバータの第4ノード(S(P))に電気的に接続し、ドレイン電極が第3ノード(K(N))に電気的に接続し、ソース電極が該第73トランジスタ(T73)のソース電極に電気的に接する第74トランジスタ(T74)と、
ゲート電極が第1段の接続関係において該メインインバータの第1ノード(Q(1))に電気的に接続し、ドレイン電極が第3ノードK(N)に電気的に接続し、ソース電極が定電圧低電位(DCL)に電気的に接する第75トランジスタ(T75)と、
ゲート電極が最後の1段の接続関係において該メインインバータの第1ノード(Q(P))に電気的に接続し、ドレイン電極が定電圧低電位(DCL)に電気的に接続し、ソース電極が第3ノードK(N)に電気的に接する第76トランジスタ(T76)と、を含むことを特徴とする酸化物半導体薄膜トランジスタに用いる走査駆動回路。 - 第N段の接続関係において、該プルアップ部分が、ゲート電極が第1ノード(Q(N))に電気的に接続し、ドレイン電極がクロック信号(CK(n))に電気的に接続し、ソース電極が出力端(G(N))に電気的に接続する第21トランジスタ(T21)を含み、
該トランスファー部分が、ゲート電極が第1ノードQ(N)に電気的に接続し、ドレイン電極がクロック信号CK(n)に電気的に接続し、ソース電極が駆動出力端ST(N)に電気的に接続する第22トランジスタ(T22)を含み、
該ブーストラップコンデンサ部分が、一端が第1ノード(Q(N))に電気的に接続し、他端が出力端(G(N))に電気的に接続するコンデンサ(Cb)を含むこと、を特徴とする請求項2に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。 - P=3である場合、前記クロック信号(CK(n))が4組のクロック信号である第1クロック信号(CK(1))と、第2クロック信号(CK(2))と、第3クロック信号(CK(3))と、第4クロック信号(CK(4)を含むことを特徴とする請求項3に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。
- P=5である場合、前記クロック信号(CK(n))が8組のクロック信号である第1クロック信号(CK(1))と、第2クロック信号(CK(2))と、第3クロック信号(CK(3))と、第4クロック信号(CK(4)と、第5クロック信号(CK(5))と、第6クロック信号(CK(6))と、第7クロック信号(CK(7))と、第8クロック信号(CK(8))とを含むことを特徴とする請求項3に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。
- 前記クロック信号(CK(n))のデューティー比が、25/75より大きくならないことを特徴とする請求項3に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。
- P=3である場合、前記クロック信号(CK(n))が4組のクロック信号である第1クロック信号(CK(1))と、第2クロック信号(CK(2))と、第3クロック信号(CK(3))と、第4クロック信号(CK(4)を含むことを特徴とする請求項6に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。
- P=5である場合、前記クロック信号(CK(n))が8組のクロック信号である第1クロック信号(CK(1))と、第2クロック信号(CK(2))と、第3クロック信号(CK(3))と、第4クロック信号(CK(4)と、第5クロック信号(CK(5))と、第6クロック信号(CK(6))と、第7クロック信号(CK(7))と、第8クロック信号(CK(8))とを含むことを特徴とする請求項6に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。
- 前記クロック信号(CK(n))のデューティー比が、25/75に等しいことを特徴とする請求項3に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。
- P=3である場合、前記クロック信号(CK(n))が4組のクロック信号である第1クロック信号(CK(1))と、第2クロック信号(CK(2))と、第3クロック信号(CK(3))と、第4クロック信号(CK(4)を含むことを特徴とする請求項9に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。
- P=5である場合、前記クロック信号(CK(n))が8組のクロック信号である第1クロック信号(CK(1))と、第2クロック信号(CK(2))と、第3クロック信号(CK(3))と、第4クロック信号(CK(4)と、第5クロック信号(CK(5))と、第6クロック信号(CK(6))と、第7クロック信号(CK(7))と、第8クロック信号(CK(8))とを含むことを特徴とする請求項9に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。
- 前記走査駆動回路の第1段の接続関係における第1ノード(Q(1))の出力する信号の第1波形が凸字状を呈するとともに、最後の1段の接続関係における第1ノード(Q(P))の出力する信号の第2波形がいずれも凸字状を呈して、かつ第1波形と第2波形の重なる部分の対応する信号に基づき該サブインバータを制御することを特徴とする請求項2に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。
- 前記走査駆動回路に採用する段伝送方式が、第N-2段が第N段に伝送する方式であることを特徴とする請求項2に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。
- 前記走査駆動回路の第1段の接続関係において、第11トランジスタ(T11)のゲート電極とドレイン電極が回路の起動信号端(STV)に電気的に接続することを特徴とする請求項2に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。
- 前記走査駆動回路の最後の1段の接続関係において、第41トランジスタ(T41)のゲート電極とドレイン電極が回路の起動信号端STVに電気的に接続することを特徴とする請求項2に記載の酸化物半導体薄膜トランジスタに用いる走査駆動回路。
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