JP2018106251A - Information processing apparatus, updating method of operation program and program - Google Patents
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Abstract
Description
本発明は、情報処理装置、動作プログラムの更新方法およびプログラムに関する。 The present invention relates to an information processing apparatus, an operation program update method, and a program.
一般的に、通信機器等の情報処理装置は、装置の電源が投入されると、ブートローダプログラムを用いて起動する。ブートローダプログラムは、情報処理装置を初期化し、情報処理装置の使用を可能とするものである。このブートローダプログラムは、情報処理装置に搭載されたデータ読み出し専用電子部品であるＲＯＭ（Ｒｅａｄ Ｏｎｌｙ Ｍｅｍｏｒｙ）に格納され、装置の電源投入時にＣＰＵ（Ｃｅｎｔｒａｌ Ｐｒｏｃｅｓｓｉｎｇ Ｕｎｉｔ）によってＲＯＭから読み出され実行される。
ブートローダプログラムの機能強化や動作不具合等の問題解決などを目的として、ブートローダプログラムを更新する必要が生じる場合がある。ブートローダプログラムの更新を容易にするため、近年、通常はデータの読み出し専用に使用されるが、特別な操作をしたときに記憶内容が書き換え可能となるプログラマブルＲＯＭ（例えば、フラッシュＲＯＭ）が利用されている。ブートローダプログラムを更新する必要が生じた場合、ブートローダプログラム中の書き換え機能を利用し、プログラマブルＲＯＭ中のブートローダプログラムが更新される。
しかしながら、ブートローダプログラムの更新には、更新したブートローダプログラムの実装に問題があった場合、ブートローダプログラムを更新後、ブートローダプログラムを動作させた場合、情報処理装置が利用不能となってしまう。
そこで、ブートローダプログラムをプログラマブルＲＯＭ中に２つ格納しておき、一方のブートローダプログラムが利用不能となった場合であっても、他方のブートローダプログラムを利用することで、情報処理装置が利用不能となることを回避する方法が提案されている（例えば、特許文献１，２参照。）。
また、更新用のファームウェアを更新前のファームウェアとは別の不揮発性メモリ領域に格納し、更新用のファームウェアを用いて再起動して正常性の確認を行った後、再度、自装置を再起動する技術が考えられている（例えば、特許文献３参照。）。
また、ブートローダプログラムを２つのプログラマブルＲＯＭそれぞれの中に格納しておき、一方のプログラマブルＲＯＭに格納されたブートローダプログラムが利用不能となった場合であっても、他方のプログラマブルＲＯＭに格納されたブートローダプログラムを利用することで、情報処理装置が利用不能となることを回避する方法が提案されている（例えば、特許文献４，５参照。）。
Generally, an information processing apparatus such as a communication device is activated using a boot loader program when the apparatus is turned on. The boot loader program initializes the information processing apparatus and enables the use of the information processing apparatus. This boot loader program is stored in a ROM (Read Only Memory) which is a data read-only electronic component mounted on the information processing apparatus, and is read from the ROM by a CPU (Central Processing Unit) and executed when the apparatus is turned on.
In some cases, it is necessary to update the boot loader program for the purpose of enhancing the function of the boot loader program or solving problems such as malfunctions. In order to facilitate the update of the boot loader program, in recent years, a programmable ROM (for example, a flash ROM) that can be rewritten when a special operation is performed is usually used for reading data. Yes. When it is necessary to update the boot loader program, the boot loader program in the programmable ROM is updated using the rewrite function in the boot loader program.
However, in updating the boot loader program, if there is a problem in the implementation of the updated boot loader program, the information processing apparatus becomes unusable if the boot loader program is operated after updating the boot loader program.
Therefore, if two boot loader programs are stored in the programmable ROM and one of the boot loader programs becomes unusable, the information processing apparatus becomes unusable by using the other boot loader program. A method for avoiding this has been proposed (see, for example, Patent Documents 1 and 2).
Also, store the firmware for update in a non-volatile memory area different from the firmware before update, restart using the update firmware, check the normality, and then restart the device again The technique which considers is considered (for example, refer patent document 3).
Moreover, even if the boot loader program is stored in each of the two programmable ROMs and the boot loader program stored in one programmable ROM becomes unavailable, the boot loader program stored in the other programmable ROM There has been proposed a method for avoiding that the information processing apparatus cannot be used by using (see, for example, Patent Documents 4 and 5).
特許文献１，２に記載された技術においては、ブートローダプログラムをプログラマブルＲＯＭ中に２つ格納しておく必要がある。そのため、使用するプログラマブルＲＯＭ容量がより多く必要となってしまうという問題点がある。
特許文献３に記載された技術では、更新用のファームウェアと更新前のファームウェアとを不揮発性メモリに格納しておく必要がある。そのため、使用するプログラマブルＲＯＭ容量がより多く必要となってしまうという問題点がある。
特許文献４，５に記載された技術には、ブートローダプログラムを格納するためのプログラマブルＲＯＭを情報処理装置に２つ搭載する必要がある。そのため、情報処理装置の価格が高騰し、情報処理装置の構成も複雑になってしまうという問題点がある。
In the techniques described in Patent Documents 1 and 2, it is necessary to store two boot loader programs in the programmable ROM. Therefore, there is a problem that more programmable ROM capacity is required.
In the technique described in Patent Literature 3, it is necessary to store firmware for update and firmware before update in a nonvolatile memory. Therefore, there is a problem that more programmable ROM capacity is required.
In the techniques described in Patent Documents 4 and 5, two programmable ROMs for storing the boot loader program need to be installed in the information processing apparatus. Therefore, there is a problem that the price of the information processing apparatus rises and the configuration of the information processing apparatus becomes complicated.
本発明の目的は、上記課題を解決する情報処理装置、動作プログラムの更新方法およびプログラムを提供することにある。 An object of the present invention is to provide an information processing apparatus, an operation program update method, and a program that solve the above-described problems.
本発明の情報処理装置は、
当該情報処理装置を動作させるための動作プログラムの更新に必要な更新データを取得する第１のインタフェース部と、
前記第１のインタフェース部が取得した更新データを実行し、該更新データを実行した結果が正常である場合、前記更新データを、当該情報処理装置の再起動後に前記動作プログラムを実行させるためのメモリエリアに書き込み、当該情報処理装置を再起動させる制御部とを有する。
また、本発明の動作プログラムの更新方法は、
情報処理装置を動作させるための動作プログラムの更新に必要な更新データを取得する処理と、
前記取得した更新データを実行する処理と、
前記実行した結果が正常である場合、前記更新データを、前記情報処理装置の再起動後に前記動作プログラムを実行させるためのメモリエリアに書き込む処理と、
前記情報処理装置を再起動させる処理とを行う。
また、本発明のプログラムは、
コンピュータに実行させるためのプログラムであって、
情報処理装置を動作させるための動作プログラムの更新に必要な更新データを取得する手順と、
前記取得した更新データを実行する手順と、
前記実行した結果が正常である場合、前記更新データを、前記情報処理装置の再起動後に前記動作プログラムを実行させるためのメモリエリアに書き込む手順と、
前記情報処理装置を再起動させる手順とを実行させる。
The information processing apparatus of the present invention
A first interface unit for acquiring update data necessary for updating an operation program for operating the information processing apparatus;
A memory for executing update data acquired by the first interface unit and causing the update data to be executed after the information processing apparatus is restarted when a result of executing the update data is normal And a controller that writes to the area and restarts the information processing apparatus.
Further, the operation program update method of the present invention includes:
Processing for obtaining update data necessary for updating an operation program for operating the information processing apparatus;
Processing for executing the acquired update data;
When the executed result is normal, the update data is written in a memory area for executing the operation program after restarting the information processing apparatus;
And a process of restarting the information processing apparatus.
The program of the present invention is
A program for causing a computer to execute,
A procedure for acquiring update data necessary for updating an operation program for operating the information processing apparatus;
A procedure for executing the acquired update data;
When the executed result is normal, the update data is written in a memory area for executing the operation program after the information processing apparatus is restarted;
And a procedure for restarting the information processing apparatus.
以上説明したように、本発明においては、動作プログラムを更新した場合に、情報処理装置が利用不能となることを容易に回避することができる。 As described above, in the present invention, when the operation program is updated, it is possible to easily prevent the information processing apparatus from being unavailable.
以下に本発明の実施の形態について図面を参照して説明する。
（第１の実施の形態）
Embodiments of the present invention will be described below with reference to the drawings.
(First embodiment)
図１は、本発明の情報処理装置の第１の実施の形態を示す図である。
本形態における情報処理装置１００は図１に示すように、インタフェース部１１０と、制御部１２０と、メモリエリア１３０とを有する。なお、図１には、本発明の情報処理装置１００が具備する構成要素のうち、本実施の形態に関わる主要な構成要素の一例を示す。
FIG. 1 is a diagram showing a first embodiment of an information processing apparatus according to the present invention.
As shown in FIG. 1, the information processing apparatus 100 in this embodiment includes an
インタフェース部１１０は、情報処理装置１００を動作させるための動作プログラムの更新に必要な更新データを取得する第１のインタフェース部である。
制御部１２０は、インタフェース部１１０が取得した更新データを実行する。制御部１２０は、更新データを実行した結果が正常である場合、その更新データを、情報処理装置１００の再起動後に動作プログラムを実行させるためのメモリエリア１３０に書き込み、情報処理装置１００を再起動させる。
The
The
以下に、図１に示した情報処理装置１００における動作プログラムの更新方法について説明する。図２は、図１に示した情報処理装置１００における動作プログラムの更新方法の一例を説明するためのフローチャートである。
まず、インタフェース部１１０が、情報処理装置１００を動作させるための動作プログラムの更新に必要な更新データを取得する（ステップＳ１）。すると、制御部１２０が、インタフェース部１１０が取得した更新データを実行する（ステップＳ２）。続いて、制御部１２０は、更新データを実行した結果が正常であるかどうかを判定する（ステップＳ３）。更新データを実行した結果が正常である場合、制御部１２０は、動作プログラムを実行させるためのメモリエリア１３０にその更新データを書き込み（ステップＳ４）、情報処理装置１００を再起動させる（ステップＳ５）。
Hereinafter, a method for updating the operation program in the information processing apparatus 100 illustrated in FIG. 1 will be described. FIG. 2 is a flowchart for explaining an example of an operation program update method in the information processing apparatus 100 shown in FIG.
First, the
このように、情報処理装置１００が、動作プログラムの更新に必要な更新データを取得し、取得した更新データを実行し、実行の結果が正常である場合に、動作プログラムを実行させるためのメモリエリア１３０にその更新データを書き込み、再起動する。そのため、動作プログラムを更新した場合に、情報処理装置が利用不能となることを容易に回避することができる。
（第２の実施の形態）
As described above, the information processing apparatus 100 acquires update data necessary for updating the operation program, executes the acquired update data, and executes the operation program when the execution result is normal. The updated data is written in 130 and restarted. Therefore, when the operation program is updated, it is possible to easily avoid the information processing apparatus from being unavailable.
(Second Embodiment)
図３は、本発明の情報処理装置の第２の実施の形態を示す図である。
本形態における情報処理装置１０１は図１に示すように、ＰＣ２０１と通信を行う機能を有する通信機器である。ＰＣ２０１は、一般的なＰＣ（Ｐｅｒｓｏｎａｌ Ｃｏｍｐｕｔｅｒ）等の情報処理装置である。
情報処理装置１０１は、ＵＡＲＴ（Ｕｎｉｖｅｒｓａｌ Ａｓｙｎｃｈｒｏｎｏｕｓ Ｒｅｃｅｉｖｅｒ Ｔｒａｎｓｍｉｔｔｅｒ）１１１と、ＣＰＵ１２１と、プログラマブルＲＯＭ１３１と、ＲＡＭ１４１とを有する。なお、図３には、本発明の情報処理装置１０１が具備する構成要素のうち、本実施の形態に関わる主要な構成要素の一例を示す。
ＵＡＲＴ１１１は、シリアル通信用インタフェース機能を有し、ＣＰＵ１２１からの指示でＰＣ２０１との間で双方向シリアル通信を行う第１のインタフェース部である。ＵＡＲＴ１１１は、情報処理装置１０１を動作させるための動作プログラムの更新に必要な更新データをＰＣ２０１から取得する。また、ＵＡＲＴ１１１は、ＣＰＵ１２１からの指示で、ＣＰＵ１２１が更新データを実行した結果を出力するものであっても良い。
ＣＰＵ１２１は、ＵＡＲＴ１１１が取得した更新データを実行する制御部である。ＣＰＵ１２１は、更新データを実行した結果が正常である場合、更新データをプログラマブルＲＯＭ１３１に書き込み、情報処理装置１０１を再起動させる。ＣＰＵ１２１は、情報処理装置１０１を起動した際、プログラマブルＲＯＭ１３１に格納されている起動プログラム（ブートローダプログラム）を実行する。ＣＰＵ１２１は、実行した起動プログラムの手順に従って、ＵＡＲＴ１１１に対して、更新データの取得を指示する。ＣＰＵ１２１は、ＵＡＲＴ１１１が取得した更新データを、起動プログラムの手順に従って実行する。また、ＣＰＵ１２１は、起動プログラムの手順に従って、ＵＡＲＴ１１１に対して、ＣＰＵ１２１が実行した結果の出力を指示するものであっても良い。このとき、ＣＰＵ１２１は、ＵＡＲＴ１１１が出力した結果に対して、結果が正常である旨を示す第１の入力をＵＡＲＴ１１１が受け付けた場合、起動プログラムの手順に従って、更新データをプログラマブルＲＯＭ１３１のメモリエリアに書き込むものであっても良い。ＣＰＵ１２１は、起動プログラムを実行した後、動作プログラムの更新要求を示す第２の入力をＵＡＲＴ１１１が受け付けた場合、ＵＡＲＴ１１１に対して、更新データの取得を指示するものであっても良い。
プログラマブルＲＯＭ１３１は、ブロック単位で消去、書き換え動作が可能な不揮発性メモリ（ＲＯＭ：Ｒｅａｄ Ｏｎｌｙ Ｍｅｍｏｒｙ）である。プログラマブルＲＯＭ１３１は、起動プログラムおよび動作プログラムの２つのブートローダプログラム、ならびにシステムプログラムを格納する。
ＲＡＭ１４１は、自由に読み書きが行われるメモリ（ＲＡＭ：Ｒａｎｄｏｍ ａｃｃｅｓｓ ｍｅｍｏｒｙ）である。ＲＡＭ１４１は、起動プログラムおよび動作プログラムの２つのブートローダプログラム、ならびにシステムプログラムが動作する際に利用される。
FIG. 3 is a diagram showing a second embodiment of the information processing apparatus of the present invention.
As illustrated in FIG. 1, the information processing apparatus 101 in this embodiment is a communication device having a function of performing communication with the
The information processing apparatus 101 includes a UART (Universal Asynchronous Receiver Transmitter) 111, a
The
The
The
The
図４は、図３に示したプログラマブルＲＯＭ１３１の内部構造（メモリエリアの配置）の一例を示す図である。
図３に示したプログラマブルＲＯＭ１３１は図４に示すように、起動プログラムであるブートローダプログラム３０１を格納する領域と、動作プログラムであるブートローダプログラム３０２を格納する領域と、システムプログラム３０３を格納する領域との３つのメモリエリアを有する。
FIG. 4 is a diagram showing an example of the internal structure (arrangement of memory areas) of the
As shown in FIG. 4, the
プログラマブルＲＯＭ１３１に格納されたブートローダプログラム３０２を更新する場合、ＣＰＵ１２１は、起動したブートローダプログラム３０１の手順に従って、ＵＡＲＴ１１１を介して接続されているＰＣ２０１から転送されるブートローダプログラム３０２の更新データを取得し、ＲＡＭ１４１に格納する。ＣＰＵ１２１は、ブートローダプログラム３０１の手順に従って、プログラマブルＲＯＭ１３１に格納されているブートローダプログラム３０２を、ＲＡＭ１４１に格納したブートローダプログラム３０２の更新データを用いて更新する。ブートローダプログラム３０１は、情報処理装置１０１の電源投入時、ＣＰＵ１２１によって、プログラマブルＲＯＭ１３１から読み出され実行される。ブートローダプログラム３０１は、ＣＰＵ１２１によって実行されることで、ブートローダプログラム３０２の書き換え機能、プログラマブルＲＯＭ１３１、ＲＡＭ１４１等の初期設定機能、ブートローダプログラム３０２をＲＡＭ１４１へ展開し、実行する機能を有する。ブートローダプログラム３０１については、ブートローダプログラム３０１およびブートローダプログラム３０２の書き換え途中の情報処理装置１０１の電源断などの失敗で、情報処理装置１０１が利用不能となってしまうことを防止するため、読み出し専用とし、書き換えは行われない。ブートローダプログラム３０２は、ＣＰＵ１２１によって実行されることで、システムプログラム３０３をＲＡＭ１４１へ展開し、実行する機能を有する。システムプログラム３０３は、ＲＡＭ１４１上で実行され、情報処理装置１０１として必要な機能を実現する。
When updating the
以下に、図３に示した情報処理装置１０１における動作プログラムの更新方法について説明する。図５は、図３に示した情報処理装置１０１における動作プログラムの更新方法の一例を説明するためのフローチャートである。 Hereinafter, a method for updating the operation program in the information processing apparatus 101 illustrated in FIG. 3 will be described. FIG. 5 is a flowchart for explaining an example of the operation program update method in the information processing apparatus 101 shown in FIG.
利用者が、情報処理装置１０１の電源を投入すると（ステップＳ１１）、ＣＰＵ１２１はプログラマブルＲＯＭ１３１からブートローダプログラム３０１を読み出し、実行（起動）する（ステップＳ１２）。その後、ＣＰＵ１２１は、起動したブートローダプログラム３０１の手順に従って以下の処理を実行する。ＣＰＵ１２１は、ブートローダプログラム３０２の更新の要求があるかどうかを判定する（ステップＳ１３）。例えば、ＣＰＵ１２１は、ブートローダプログラム３０１を実行した後、ブートローダプログラム３０２の更新要求を示す所定の入力をＵＡＲＴ１１１が受け付けた場合、ブートローダプログラム３０２の更新の要求があったと判定するものであっても良い。この所定の入力は、利用者が行うＰＣ２０１へのコマンド入力であっても良い。
ＣＰＵ１２１は、ブートローダプログラム３０２の更新の要求があったと判定した場合、ブートローダプログラム３０２の更新処理を実行する。この更新処理について、具体的に説明する。ＣＰＵ１２１は、ＵＡＲＴ１１１を介して、ＰＣ２０１からブートローダプログラム３０２の更新に必要なデータ（以下、更新データと称する）を受信し、ＲＡＭ１４１に取得する（ステップＳ１４）。ＣＰＵ１２１は、ＲＡＭ１４１に取得したブートローダプログラム３０２の更新データを実行する（ステップＳ１５）。
When the user turns on the information processing apparatus 101 (step S11), the
When the
ＣＰＵ１２１は、更新データ実行後、更新データが正常に実行完了したかどうかを判定する（ステップＳ１６）。例えば、ＣＰＵ１２１は、ＵＡＲＴ１１１に対して、ＣＰＵ１２１が実行した結果の出力を指示し、ＵＡＲＴ１１１が出力した結果に対して、結果が正常である旨を示す所定の入力をＵＡＲＴ１１１が受け付けた場合、更新データが正常に実行完了したと判定するものであっても良い。この所定の入力は、利用者が行うＰＣ２０１へのコマンド入力であっても良い。
ＣＰＵ１２１は、更新データが正常に実行完了したと判定した場合、プログラマブルＲＯＭ１３１のブートローダプログラム３０２用のメモリエリアに格納されたデータを消去する（ステップＳ１７）。続いて、ＣＰＵ１２１は、ＲＡＭ１４１に取得済みのブートローダプログラム３０２の更新データを、プログラマブルＲＯＭ１３１のブートローダプログラム３０２用のメモリエリアへ書き込む（ステップＳ１８）。その後、ＣＰＵ１２１が情報処理装置１０１を再起動させる（ステップＳ１９）。これにより、ＣＰＵ１２１は、プログラマブルＲＯＭ１３１に書き込まれた更新データで情報処理装置１０１を動作させる。
After executing the update data, the
When the
一方、ステップＳ１６にて、ＣＰＵ１２１が、更新データが正常に実行完了しなかったと判定した場合、ＣＰＵ１２１は、ブートローダプログラム３０２の更新処理は実施せずに、情報処理装置１０１を再起動させる。
On the other hand, if the
また、ステップＳ１３にて、ＣＰＵ１２１は、ブートローダプログラム３０２の更新の要求がないと判定した場合、ＣＰＵ１２１は、ブートローダプログラム３０２の起動処理を実施する（ステップＳ２０）。具体的には、ＣＰＵ１２１は、通常動作時と同様に、ブートローダプログラム３０２をＲＡＭ１４１上へ展開して実行する。続いて、ＣＰＵ１２１は、システムプログラム３０３の起動処理を実施し（ステップＳ２１）、処理を実行する（ステップＳ２２）。具体的には、ＣＰＵ１２１は、システムプログラム３０３をＲＡＭ１４１上へ展開して実行する。その後、システムプログラム３０３の処理実行が継続される。
If the
なお、本実施例ではブートローダプログラム３０２の更新時の動作について説明を行ったが、システムプログラム３０３の更新時の動作についても適応可能である。
In this embodiment, the operation at the time of updating the
以上説明したように、本形態においては、動作プログラムの更新データをＲＡＭ上で実行し、正常に完了した場合に、動作プログラムを実行させるためのＲＯＭのメモリエリアに書き込んで、装置を再起動する。つまり、装置の電源投入後、ソフトウェア起動途中でソフトウェア更新データを取得する。プログラマブルＲＯＭに記憶されているソフトウェアを更新せず、更新データを実行する。実行された更新データが正常動作したことを確認後、プログラマブルＲＯＭに記憶されているソフトウェアを更新する。そのため、以下に示す効果を奏する。
第１の効果は、ブートローダプログラム３０２の更新データを、動作確認後にプログラマブルＲＯＭ１３１へ書き込むことで、ブートローダプログラム３０２の書き換え後、ブートローダプログラム３０２の起動が完了しないことを防止することができる。
第２の効果は、ブートローダプログラム３０２の書き換え失敗に備えるための、リカバリ用ブートローダプログラムをプログラマブルＲＯＭ１３１中に格納しておく必要が無くなり、プログラマブルＲＯＭ１３１の容量を効率的に利用することができる。
第３の効果は、ブートローダプログラム３０２の書き換え失敗に備えるための、リカバリ用ブートローダプログラムを格納するためのプログラマブルＲＯＭ１３１を情報処理装置１０１中に具備する必要が無くなり、情報処理装置１０１の価格上昇を抑え、情報処理装置１０１の構成も簡略化することができる。
（第３の実施の形態）
As described above, in this embodiment, the update data of the operation program is executed on the RAM, and when it is normally completed, it is written in the memory area of the ROM for executing the operation program, and the apparatus is restarted. . That is, after the apparatus is turned on, software update data is acquired during software activation. Update data is executed without updating the software stored in the programmable ROM. After confirming that the executed update data operates normally, the software stored in the programmable ROM is updated. Therefore, the following effects are exhibited.
The first effect is that update data of the
The second effect is that it is not necessary to store a recovery boot loader program in the
The third effect is that it is not necessary to provide the information processing apparatus 101 with the
(Third embodiment)
図６は、本発明の情報処理装置の第３の実施の形態を示す図である。
本形態における情報処理装置１０２−１〜１０２−３それぞれは図６に示すように、互いに有線ネットワーク１６２を介して接続され、相互通信が可能である通信機器である。また、情報処理装置１０２−１〜１０２−３それぞれは、ＰＣ２０２−１〜２０２−３それぞれと通信を行う機能を有する。ＰＣ２０２−１〜２０２−３それぞれは、一般的なＰＣ等の情報処理装置である。なお、図６には、情報処理装置およびＰＣがそれぞれ３つずつである場合を例に挙げて示しているが、この数は限定しない。また、有線ネットワーク１６２は、イーサネット（登録商標）等の通信ネットワークである。また、図６に示した形態では、情報処理装置１０２−１〜１０２−３が有線ネットワーク１６２を介して接続されているが、無線ネットワークを介して接続されているものであっても良い。
FIG. 6 is a diagram showing a third embodiment of the information processing apparatus of the present invention.
As shown in FIG. 6, each of the information processing apparatuses 102-1 to 102-3 in this embodiment is a communication device that is connected to each other via a wired network 162 and can perform mutual communication. Each of the information processing apparatuses 102-1 to 102-3 has a function of communicating with each of the PCs 202-1 to 202-3. Each of the PCs 202-1 to 202-3 is an information processing apparatus such as a general PC. FIG. 6 shows an example in which there are three information processing apparatuses and three PCs, but this number is not limited. The wired network 162 is a communication network such as Ethernet (registered trademark). In the form shown in FIG. 6, the information processing apparatuses 102-1 to 102-3 are connected via the wired network 162, but may be connected via a wireless network.
情報処理装置１０２−１は、ＵＡＲＴ１１２−１と、ＣＰＵ１２２−１と、プログラマブルＲＯＭ１３２−１と、ＲＡＭ１４２−１と、有線インタフェース部１５２−１とを有する。また、同様に、情報処理装置１０２−２は、ＵＡＲＴ１１２−２と、ＣＰＵ１２２−２と、プログラマブルＲＯＭ１３２−２と、ＲＡＭ１４２−２と、有線インタフェース部１５２−２とを有する。また、同様に、情報処理装置１０２−３は、ＵＡＲＴ１１２−３と、ＣＰＵ１２２−３と、プログラマブルＲＯＭ１３２−３と、ＲＡＭ１４２−３と、有線インタフェース部１５２−３とを有する。なお、図６には、本発明の情報処理装置１０２−１〜１０２−３が具備する構成要素のうち、本実施の形態に関わる主要な構成要素の一例を示す。 The information processing apparatus 102-1 includes a UART 112-1, a CPU 122-1, a programmable ROM 132-1, a RAM 142-1, and a wired interface unit 152-1. Similarly, the information processing apparatus 102-2 includes a UART 112-2, a CPU 122-2, a programmable ROM 132-2, a RAM 142-2, and a wired interface unit 152-2. Similarly, the information processing apparatus 102-3 includes a UART 112-3, a CPU 122-3, a programmable ROM 132-3, a RAM 142-3, and a wired interface unit 152-3. FIG. 6 shows an example of main components related to the present embodiment among the components included in the information processing apparatuses 102-1 to 102-3 of the present invention.
図６に示したＵＡＲＴ１１２−１〜１１２−３、プログラマブルＲＯＭ１３２−１〜１３２−３およびＲＡＭ１４２−１〜１４２−３それぞれは、図３に示したＵＡＲＴ１１１、プログラマブルＲＯＭ１３１およびＲＡＭ１４１と同じ機能を有する。また、プログラマブルＲＯＭ１３２−１〜１３２−３の内部構造（メモリエリアの配置）については、図４に示したものと同じである。
図６に示した有線インタフェース部１５２−１〜１５２−３それぞれは、更新データを実行した結果が正常である場合、その旨を示す通知信号を有線ネットワーク１６２上へ送信する第２のインタフェース部である。例えば、更新データを実行した結果が正常である旨を示す第１の入力をＵＡＲＴ１１２−１〜１１２−３が受け付けた場合、有線インタフェース部１５２−１〜１５２−３それぞれは、その旨を示す通知信号を有線ネットワーク１６２上へ送信するものであっても良い。また、有線インタフェース部１５２−１〜１５２−３それぞれは、通知信号を送信してから所定の時間が経過しても応答信号を受信しない場合、通知信号を再送する。
図６に示したＣＰＵ１２２−１〜１２２−３それぞれは、図３に示したＣＰＵ１２１が具備する機能に加えて、以下の機能を有する。ＣＰＵ１２２−１〜１２２−３それぞれは、更新データを実行した結果が正常である場合、その旨を示す通知信号を有線ネットワーク１６２上へ送信するように有線インタフェース部１５２−１〜１５２−３に指示する。ＣＰＵ１２２−１〜１２２−３それぞれは、ＵＡＲＴ１１２−１〜１１２−３が第１の入力を受け付けた場合、第１の入力を受け付けた旨を示す通知信号を送信するように有線インタフェース部１５２−１〜１５２−３へ指示する。ＣＰＵ１２２−１〜１２２−３それぞれは、有線インタフェース部１５２−１〜１５２−３が、通知信号に対する応答信号を受信した場合、応答信号を送信してきた装置に対して更新データを送信するように有線インタフェース部１５２−１〜１５２−３へ指示する。
Each of the UARTs 112-1 to 112-3, the programmable ROMs 132-1 to 132-3 and the RAMs 142-1 to 142-3 shown in FIG. 6 has the same functions as the
Each of the wired interface units 152-1 to 152-3 illustrated in FIG. 6 is a second interface unit that transmits a notification signal indicating that to the wired network 162 when the result of executing the update data is normal. is there. For example, when the UART 112-1 to 112-3 receives the first input indicating that the result of executing the update data is normal, each of the wired interface units 152-1 to 152-3 is notified to that effect. The signal may be transmitted on the wired network 162. In addition, each of the wired interface units 152-1 to 152-3 retransmits the notification signal when a response signal is not received even after a predetermined time has elapsed since the notification signal was transmitted.
Each of the CPUs 122-1 to 122-3 illustrated in FIG. 6 has the following functions in addition to the functions of the
図７は、図６に示した有線インタフェース部１５２−１〜１５２−３が送受信する信号のフレーム構成の一例を示す図である。
図６に示した有線インタフェース部１５２−１〜１５２−３が送受信する信号のフレーム構成は図７に示すように、宛先ＭＡＣアドレス４００と、送信元ＭＡＣアドレス４１０と、タイプ４２０と、データ４３０と、ＦＣＳ４４０とから構成される。
宛先ＭＡＣアドレス４００は、フレームの送信相手となる宛先のコンピュータのＭＡＣ（Ｍｅｄｉａ Ａｃｃｅｓｓ Ｃｏｎｔｒｏｌ）アドレスの情報を格納する。宛先ＭＡＣアドレス４００のサイズは、６ｂｙｔｅｓである。送信元ＭＡＣアドレス４１０は、フレームを送信する情報処理装置のＭＡＣアドレスの情報を格納する。送信元ＭＡＣアドレス４１０のサイズは、６ｂｙｔｅｓである。タイプ４２０は、次に続くデータ４３０に格納する上位層プロトコルを識別する値を格納する。タイプ４２０のサイズは、２ｂｙｔｅｓである。データ４３０は、ユーザデータを格納する。データ４３０のサイズは、４６〜１５００ｂｙｔｅｓである。ＦＣＳ４４０は、受信したフレームに誤りがないかどうかを調べるために付加されるデータである。ＦＣＳ４４０のサイズは、４ｂｙｔｅｓである。
FIG. 7 is a diagram illustrating an example of a frame configuration of a signal transmitted and received by the wired interface units 152-1 to 152-3 illustrated in FIG.
As shown in FIG. 7, the frame configuration of signals transmitted and received by the wired interface units 152-1 to 152-3 shown in FIG. 6 includes a
The
図８は、図７に示したタイプ４２０に格納される値の一例を示す図である。
図７に示したタイプ４２０には図８に示すように、フレーム種別に応じた値が格納される。例えば、フレーム種別がブートローダプログラム３０２の更新通知フレームである場合、「０ｘ０００１」（ｘは１６進数を示す）がフレームタイプ値としてタイプ４２０に格納される。また、フレーム種別がブートローダプログラム３０２の更新応答フレームである場合、「０ｘ０００２」（ｘは１６進数を示す）がフレームタイプ値としてタイプ４２０に格納される。また、フレーム種別がブートローダプログラム３０２の更新データフレームである場合、「０ｘ０００３」（ｘは１６進数を示す）がフレームタイプ値としてタイプ４２０に格納される。
FIG. 8 is a diagram illustrating an example of values stored in the
The
例えば、情報処理装置１０２−１が送信するフレームが、ブートローダプログラム３０２の更新通知フレームである場合、接続されている情報処理装置１０２−２，１０２−３すべてへフレームを送信するため、宛先ＭＡＣアドレス４００には、ブロードキャストＭＡＣアドレス（ＦＦ：ＦＦ：ＦＦ：ＦＦ：ＦＦ：ＦＦ）が設定される。送信元ＭＡＣアドレス４１０には、情報処理装置１０２−１のＭＡＣアドレスが設定される。タイプ４２０には、ブートローダプログラム３０２の更新通知フレームであることを示すため、０ｘ０００１が格納される。データ４３０は、サイズは４６ｂｙｔｅｓとし、ここでは任意の値とする。
また、情報処理装置１０２−２が情報処理装置１０２−１へ送信するフレームが、ブートローダプログラム３０２の更新応答フレームである場合、宛先ＭＡＣアドレス４００には、情報処理装置１０２−１のＭＡＣアドレスが設定される。送信元ＭＡＣアドレス４１０には、フレームを送信する情報処理装置１０２−２のＭＡＣアドレスが設定される。タイプ４２０には、ブートローダプログラム３０２の更新応答フレームであることを示すため、０ｘ０００２が格納される。データ４３０は、サイズは４６ｂｙｔｅｓとし、ここでは任意の値とする。
また、情報処理装置１０２−１が送信するフレームが、ブートローダプログラム３０２の更新データフレームである場合、宛先ＭＡＣアドレス４００には、ブートローダプログラム３０２の更新応答フレームを送信した情報処理装置の送信元ＭＡＣアドレスが設定される。送信元ＭＡＣアドレス４１０には、情報処理装置１０２−１のＭＡＣアドレスが設定される。タイプ４２０には、ブートローダプログラム３０２の更新データフレームであることを示すため、０ｘ０００３が格納される。データ４３０には、ブートローダプログラム３０２の更新データが格納される。ブートローダプログラム３０２の更新データのサイズが、データ４３０の最大サイズである１５００ｂｙｔｅｓよりも大きな場合、情報処理装置１０２−１は、ブートローダプログラム３０２の更新データを複数のブートローダプログラム３０２の更新データフレームに分割し、ブートローダプログラム３０２の更新データを送信する。
For example, when the frame transmitted by the information processing apparatus 102-1 is an update notification frame of the
When the frame transmitted from the information processing apparatus 102-2 to the information processing apparatus 102-1 is an update response frame of the
When the frame transmitted by the information processing apparatus 102-1 is an update data frame of the
以下に、図６に示した形態における動作プログラムの更新方法について説明する。まずは、更新通知を送信する場合の処理について説明する。図９Ａ，９Ｂは、図６に示した形態における動作プログラムの更新方法のうち、更新通知を送信する場合の処理の一例を説明するためのフローチャートである。ここでは、図６に示した情報処理装置１０２−１がブートローダプログラム３０２の更新通知を送信する処理について説明する。
The operation program update method in the embodiment shown in FIG. 6 will be described below. First, a process when an update notification is transmitted will be described. FIGS. 9A and 9B are flowcharts for explaining an example of processing when an update notification is transmitted in the update method of the operation program in the form shown in FIG. Here, a process in which the information processing apparatus 102-1 illustrated in FIG. 6 transmits an update notification of the
利用者が、情報処理装置１０２−１の電源を投入すると（ステップＳ３１）、ＣＰＵ１２２−１はプログラマブルＲＯＭ１３２−１からブートローダプログラム３０１を読み出し、実行（起動）する（ステップＳ３２）。その後、ＣＰＵ１２２−１は、起動したブートローダプログラム３０１の手順に従って以下の処理を実行する。ＣＰＵ１２２−１は、ブートローダプログラム３０２の更新の要求があるかどうかを判定する（ステップＳ３３）。例えば、ＣＰＵ１２２−１は、ブートローダプログラム３０１を実行した後、ブートローダプログラム３０２の更新要求を示す所定の入力をＵＡＲＴ１１２−１が受け付けた場合、ブートローダプログラム３０２の更新の要求があったと判定するものであっても良い。この所定の入力は、利用者が行うＰＣ２０２−１へのコマンド入力であっても良い。
When the user turns on the power of the information processing apparatus 102-1 (step S31), the CPU 122-1 reads the
ＣＰＵ１２２−１は、ブートローダプログラム３０２の更新の要求があったと判定した場合、ブートローダプログラム３０２の更新処理を実行する。この更新処理について、具体的に説明する。ＣＰＵ１２２−１は、ＵＡＲＴ１１２−１を介して、ＰＣ２０２−１からブートローダプログラム３０２の更新に必要な更新データを受信し、ＲＡＭ１４２−１に取得する（ステップＳ３４）。ＣＰＵ１２２−１は、ＲＡＭ１４２−１に取得したブートローダプログラム３０２の更新データを実行する（ステップＳ３５）。
When the CPU 122-1 determines that there is a request for updating the
ＣＰＵ１２２−１は、更新データ実行後、更新データが正常に実行完了したかどうかを判定する（ステップＳ３６）。例えば、ＣＰＵ１２２−１は、ＵＡＲＴ１１２−１に対して、ＣＰＵ１２２−１が実行した結果の出力を指示し、ＵＡＲＴ１１２−１が出力した結果に対して、結果が正常である旨を示す所定の入力をＵＡＲＴ１１２−１が受け付けた場合、更新データが正常に実行完了したと判定するものであっても良い。この所定の入力は、利用者が行うＰＣ２０２−１へのコマンド入力であっても良い。
ＣＰＵ１２２−１は、更新データが正常に実行完了したと判定した場合、情報処理装置１０２−１内に具備されたカウンタｔ１（不図示）に「０」の値を代入する（ステップＳ３７）。続いて、ＣＰＵ１２２−１は、有線インタフェース部１５２−１を用いて、有線ネットワーク１６２上へブートローダプログラム３０２の更新通知フレームを送信する（ステップＳ３８）。情報処理装置１０２−１がブートローダプログラム３０２の更新通知フレームを送信することにより、有線ネットワーク１６２と接続されている情報処理装置１０２−２，１０２−３へブートローダプログラム３０２を更新することを通知する。
After executing the update data, the CPU 122-1 determines whether or not the update data has been normally executed (step S36). For example, the CPU 122-1 instructs the UART 112-1 to output the result executed by the CPU 122-1, and gives a predetermined input indicating that the result is normal with respect to the result output by the UART 112-1. When the UART 112-1 receives, it may be determined that the update data has been normally executed. This predetermined input may be a command input to the PC 202-1 performed by the user.
When determining that the update data has been normally executed, the CPU 122-1 assigns a value of “0” to a counter t1 (not shown) provided in the information processing apparatus 102-1 (step S37). Subsequently, the CPU 122-1 transmits an update notification frame of the
それから所定の時間が経過した後、ＣＰＵ１２２−１は、有線ネットワーク１６２と接続されている情報処理装置１０２−２，１０２−３から、有線インタフェース部１５２−１がブートローダプログラム３０２の更新応答フレームを受信したかどうかを判定する（ステップＳ３９）。
有線インタフェース部１５２−１がブートローダプログラム３０２の更新応答フレームを受信した場合、ＣＰＵ１２２−１は、ブートローダプログラム３０２の更新応答フレームを送信元した送信元の情報処理装置へ、ステップＳ３４にてＲＡＭ１４２−１に取得したブートローダプログラム３０２の更新データを、有線インタフェース部１５２−１を介して送信する（ステップＳ４０）。続いて、ＣＰＵ１２２−１は、プログラマブルＲＯＭ１３２−１のブートローダプログラム３０２用のメモリエリアに格納されたデータを消去する（ステップＳ４１）。ＣＰＵ１２２−１は、ＲＡＭ１４２−１に取得済みのブートローダプログラム３０２の更新データを、プログラマブルＲＯＭ１３２−１のブートローダプログラム３０２用のメモリエリアへ書き込む（ステップＳ４２）。その後、ＣＰＵ１２２−１が情報処理装置１０２−１を再起動させる（ステップＳ４３）。これにより、ＣＰＵ１２２−１は、プログラマブルＲＯＭ１３２−１に書き込まれた更新データを用いて情報処理装置１０２−１を動作させる。
After a predetermined time has elapsed, the CPU 122-1 receives the update response frame of the
When the wired interface unit 152-1 receives the update response frame of the
一方、ステップＳ３３にて、ＣＰＵ１２２−１は、ブートローダプログラム３０２の更新の要求がないと判定した場合、ＣＰＵ１２２−１は、ブートローダプログラム３０２の起動処理を実施する（ステップＳ４４）。具体的には、ＣＰＵ１２２−１は、通常動作時と同様に、ブートローダプログラム３０２をＲＡＭ１４２−１上へ展開して実行する。続いて、ＣＰＵ１２２−１は、システムプログラム３０３の起動処理を実施し（ステップＳ４５）、処理を実行する（ステップＳ４６）。具体的には、ＣＰＵ１２２−１は、システムプログラム３０３をＲＡＭ１４２−１上へ展開して実行する。その後、システムプログラム３０３の処理実行が継続される。
On the other hand, if the CPU 122-1 determines in step S33 that there is no update request for the
また、ステップＳ３６にて、ＣＰＵ１２２−１が、更新データが正常に実行完了しなかったと判定した場合、ＣＰＵ１２２−１は、ブートローダプログラム３０２の更新処理は実施せずに、情報処理装置１０２−１を再起動させる。
If the CPU 122-1 determines in step S36 that the update data has not been normally executed, the CPU 122-1 does not perform the update process of the
また、ステップＳ３９にて、有線インタフェース部１５２−１がブートローダプログラム３０２の更新応答フレームを受信しなかった場合、ＣＰＵ１２２−１は、カウンタｔ１の値をインクリメント（値に１を加算）する（ステップＳ４７）。そして、ＣＰＵ１２２−１は、そのカウンタｔ１の値があらかじめ設定された閾値を超えたかどうかを判定する（ステップＳ４８）。この閾値は、事前に行われた実験等の結果に基づいて定められた値である。
ＣＰＵ１２２−１は、カウンタｔ１の値が閾値を超えたと判定した場合、ステップＳ４１の処理を行う。一方、ＣＰＵ１２２−１は、カウンタｔ１の値が閾値を超えていないと判定した場合、ステップＳ３８の処理を行う。
If the wired interface unit 152-1 does not receive the update response frame of the
When the CPU 122-1 determines that the value of the counter t1 exceeds the threshold value, the CPU 122-1 performs the process of step S41. On the other hand, if the CPU 122-1 determines that the value of the counter t1 does not exceed the threshold value, the CPU 122-1 performs the process of step S38.
なお、以上ではブートローダプログラム３０２の更新時の動作について説明を行ったが、システムプログラム３０３の更新時の動作についても適応可能である。
Although the operation at the time of updating the
以下に、更新通知を受信する場合の処理について説明する。図１０Ａ，１０Ｂは、図６に示した形態における動作プログラムの更新方法のうち、更新通知を受信する場合の処理の一例を説明するためのフローチャートである。ここでは、図６に示した情報処理装置１０２−１がブートローダプログラム３０２の更新通知を送信し、情報処理装置１０２−２が更新通知を受信する処理について説明する。図６に示した情報処理装置１０２−１がブートローダプログラム３０２の更新通知を送信し、情報処理装置１０２−３が更新通知を受信する処理についても同様である。
In the following, processing when receiving an update notification will be described. FIGS. 10A and 10B are flowcharts for explaining an example of processing in the case of receiving an update notification in the operation program update method in the embodiment shown in FIG. Here, a process in which the information processing apparatus 102-1 illustrated in FIG. 6 transmits an update notification of the
まず、利用者が、情報処理装置１０２−２の電源を投入すると（ステップＳ５１）、情報処理装置１０２−２は、通常、システムプログラム３０３が実行された状態で動作している（ステップＳ５２）。システムプログラム３０３を実行時、ＣＰＵ１２２−２は、有線インタフェース部１５２−２がブートローダプログラム３０２の更新通知フレームを受信したかどうかを判定する（ステップＳ５３）。ＣＰＵ１２２−２は、ブートローダプログラム３０２の更新通知フレームを受信していないと判定した場合、システムプログラム３０３の実行を継続する。
First, when the user turns on the information processing apparatus 102-2 (step S51), the information processing apparatus 102-2 normally operates with the
一方、ＣＰＵ１２２−２は、ブートローダプログラム３０２の更新通知フレームを受信したと判定した場合、情報処理装置１０２−２を再起動させる（ステップＳ５４）。すると、ＣＰＵ１２２−２は、プログラマブルＲＯＭ１３２−２からブートローダプログラム３０１を読み出し、実行（起動）する（ステップＳ５５）。その後、ＣＰＵ１２２−２は、有線インタフェース部１５２−２が、ブートローダプログラム３０２の更新通知フレームを受信したかどうかを判定する（ステップＳ５６）。ＣＰＵ１２２−２は、ブートローダプログラム３０２の更新通知フレームを受信していないと判定した場合、ブートローダプログラム３０２の起動処理を実施する（ステップＳ５７）。具体的には、ＣＰＵ１２２−２は、通常動作時と同様に、ブートローダプログラム３０２をＲＡＭ１４２−２上へ展開して実行する。続いて、ＣＰＵ１２２−２は、システムプログラム３０３の起動処理を実施し（ステップＳ５８）、処理を実行する（ステップＳ５９）。具体的には、ＣＰＵ１２２−２は、システムプログラム３０３をＲＡＭ１４２−２上へ展開して実行する。その後、システムプログラム３０３の処理実行が継続される。
On the other hand, when it is determined that the update notification frame of the
一方、ステップＳ５６にて、ＣＰＵ１２２−２は、ブートローダプログラム３０２の更新通知フレームを受信したと判定した場合、ブートローダプログラム３０２の更新通知フレーム内の送信元ＭＡＣアドレスを宛先ＭＡＣアドレスとして、有線インタフェース部１５２−２を用いてブートローダプログラム３０２の更新応答フレームを送信する（ステップＳ６０）。ＣＰＵ１２２−２がブートローダプログラム３０２の更新応答フレームを送信することにより、有線ネットワーク１６２と接続されている情報処理装置１０２−１へブートローダプログラム３０２を更新することを通知する。通知を受信した情報処理装置１０２−１は、有線インタフェース部１５２−１を介して、有線ネットワーク１６２と接続されているブートローダプログラム３０２の更新応答フレームの送信元の情報処理装置１０２−２へ、ステップＳ３４にてＲＡＭ１４２−１に取得したブートローダプログラム３０２の更新データを、ブートローダプログラム３０２の更新データフレームを用いて送信する。ブートローダプログラム３０２の更新応答フレームの送信元の情報処理装置１０２−２のＣＰＵ１２２−２は、有線ネットワーク１６２を介して情報処理装置１０２−１から送信されてきたブートローダプログラム３０２の更新データをＲＡＭ１４２−２に取得する（ステップＳ６１）。ＣＰＵ１２２−２は、ＲＡＭ１４２−２に取得したブートローダプログラム３０２の更新データを実行する（ステップＳ６２）。
On the other hand, if the CPU 122-2 determines in step S56 that the update notification frame of the
ＣＰＵ１２２−２は、更新データ実行後、更新データが正常に実行完了したかどうかを判定する（ステップＳ６３）。例えば、ＣＰＵ１２２−２は、ＵＡＲＴ１１２−２に対して、ＣＰＵ１２２−２が実行した結果の出力を指示し、ＵＡＲＴ１１２−２が出力した結果に対して、結果が正常である旨を示す所定の入力をＵＡＲＴ１１２−２が受け付けた場合、更新データが正常に実行完了したと判定するものであっても良い。この所定の入力は、利用者が行うＰＣ２０２−２へのコマンド入力であっても良い。
ＣＰＵ１２２−２は、更新データが正常に実行完了したと判定した場合、プログラマブルＲＯＭ１３２−２のブートローダプログラム３０２用のメモリエリアに格納されたデータを消去する（ステップＳ６４）。続いて、ＣＰＵ１２２−２は、ＲＡＭ１４２−２に取得済みのブートローダプログラム３０２の更新データを、プログラマブルＲＯＭ１３２−２のブートローダプログラム３０２用のメモリエリアへ書き込む（ステップＳ６５）。その後、ＣＰＵ１２２−２が情報処理装置１０２−２を再起動させる（ステップＳ６６）。これにより、ＣＰＵ１２２−２は、プログラマブルＲＯＭ１３２−２に書き込まれた更新データを用いて情報処理装置１０２−２を動作させる。
After executing the update data, the CPU 122-2 determines whether or not the update data has been normally executed (step S63). For example, the CPU 122-2 instructs the UART 112-2 to output the result executed by the CPU 122-2, and gives a predetermined input indicating that the result is normal to the result output by the UART 112-2. When the UART 112-2 receives, it may be determined that the update data has been normally executed. This predetermined input may be a command input to the PC 202-2 performed by the user.
When determining that the update data has been normally executed, the CPU 122-2 erases the data stored in the memory area for the
一方、ステップＳ６３にて、ＣＰＵ１２２−２が、更新データが正常に実行完了しなかったと判定した場合、ＣＰＵ１２２−２は、ブートローダプログラム３０２の更新処理は実施せずに、情報処理装置１０２−２を再起動させる。
On the other hand, when the CPU 122-2 determines in step S63 that the update data has not been successfully executed, the CPU 122-2 does not perform the update process of the
このように、複数の情報処理装置がネットワークを用いて接続された場合、１つの情報処理装置から他の情報処理装置へ、動作プログラムの更新通知を行い、その更新通知に応答した情報処理装置に対して、更新データを送信する。更新データを受信した情報処理装置は、第１および第２の実施の形態と同様に、更新データをＲＡＭ上で実行し、その実行結果が正常である場合、その更新データをプログラマブルＲＯＭへ書き込んでソフトウェアの更新を行う。これにより、複数の情報処理装置間で、更新データのやり取りが可能となり、各情報処理装置においては、更新データの正常動作を確認してからソフトウェアの更新を行うことができる。 As described above, when a plurality of information processing apparatuses are connected using a network, an operation program update notification is sent from one information processing apparatus to another information processing apparatus, and the information processing apparatus responding to the update notification is notified. On the other hand, update data is transmitted. The information processing apparatus that has received the update data executes the update data on the RAM and writes the update data to the programmable ROM if the execution result is normal, as in the first and second embodiments. Update the software. Thus, update data can be exchanged between a plurality of information processing apparatuses, and each information processing apparatus can update software after confirming normal operation of the update data.
以上、各構成要素に各機能（処理）それぞれを分担させて説明したが、この割り当ては上述したものに限定しない。また、構成要素の構成についても、上述した形態はあくまでも例であって、これに限定しない。 As described above, each function (process) is assigned to each component, but this assignment is not limited to the above. In addition, the configuration described above is merely an example, and the present invention is not limited to this.
上述した情報処理装置１００，１０１，１０２−１〜１０２−３それぞれに設けられた各構成要素が行う処理は、目的に応じてそれぞれ作製された論理回路で行うようにしても良い。また、処理内容を手順として記述したコンピュータプログラム（以下、プログラムと称する）を情報処理装置１００，１０１，１０２−１〜１０２−３それぞれにて読取可能な記録媒体に記録し、この記録媒体に記録されたプログラムを情報処理装置１００，１０１，１０２−１〜１０２−３それぞれに読み込ませ、実行するものであっても良い。情報処理装置１００，１０１，１０２−１〜１０２−３それぞれにて読取可能な記録媒体とは、フロッピー（登録商標）ディスク、光磁気ディスク、ＤＶＤ（Ｄｉｇｉｔａｌ Ｖｅｒｓａｔｉｌｅ Ｄｉｓｃ）、ＣＤ（Ｃｏｍｐａｃｔ Ｄｉｓｃ）、Ｂｌｕ−ｒａｙ（登録商標） Ｄｉｓｃなどの移設可能な記録媒体の他、情報処理装置１００，１０１，１０２−１〜１０２−３それぞれに内蔵されたＲＯＭ（Ｒｅａｄ Ｏｎｌｙ Ｍｅｍｏｒｙ）、ＲＡＭ（Ｒａｎｄｏｍ Ａｃｃｅｓｓ Ｍｅｍｏｒｙ）等のメモリやＨＤＤ（Ｈａｒｄ Ｄｉｓｃ Ｄｒｉｖｅ）等を指す。この記録媒体に記録されたプログラムは、情報処理装置１００，１０１，１０２−１〜１０２−３それぞれに設けられたＣＰＵにて読み込まれ、ＣＰＵの制御によって、上述したものと同様の処理が行われる。ここで、ＣＰＵは、プログラムが記録された記録媒体から読み込まれたプログラムを実行するコンピュータとして動作するものである。 The processing performed by each component provided in each of the information processing apparatuses 100, 101, 102-1 to 102-3 described above may be performed by a logic circuit that is produced according to the purpose. Further, a computer program (hereinafter referred to as a program) in which processing contents are described as a procedure is recorded on a recording medium that can be read by each of the information processing apparatuses 100, 101, 102-1 to 102-3, and recorded on this recording medium. The information processing apparatus 100, 101, 102-1 to 102-3 may be read and executed by the program. Recording media that can be read by each of the information processing apparatuses 100, 101, 102-1 to 102-3 include a floppy (registered trademark) disk, a magneto-optical disk, a DVD (Digital Versatile Disc), a CD (Compact Disc), and a Blu. -Ray (registered trademark) In addition to a transferable recording medium such as a disc, ROM (Read Only Memory), RAM (Random Access Memory), etc. incorporated in each of the information processing apparatuses 100, 101, 102-1 to 102-3 Memory, HDD (Hard Disc Drive), and the like. The program recorded on this recording medium is read by the CPU provided in each of the information processing apparatuses 100, 101, 102-1 to 102-3, and the same processing as described above is performed under the control of the CPU. . Here, the CPU operates as a computer that executes a program read from a recording medium on which the program is recorded.
上記の実施の形態の一部または全部は、以下の付記のようにも記載され得るが、以下には限られない。
（付記１）情報処理装置であって、
当該情報処理装置を動作させるための動作プログラムの更新に必要な更新データを取得する第１のインタフェース部と、
前記第１のインタフェース部が取得した更新データを実行し、該更新データを実行した結果が正常である場合、前記更新データを、当該情報処理装置の再起動後に前記動作プログラムを実行させるためのメモリエリアに書き込み、当該情報処理装置を再起動させる制御部とを有する情報処理装置。
（付記２）前記制御部は、当該情報処理装置を起動した際、前記メモリエリアに格納されている起動プログラムを実行し、該起動プログラムの手順に従って、前記第１のインタフェース部に対して、前記更新データの取得を指示し、前記取得した更新データを実行し、該更新データを実行した結果が正常である場合、前記更新データを前記メモリエリアに書き込み、当該情報処理装置を再起動させる、付記１に記載の情報処理装置。
（付記３）前記第１のインタフェース部は、前記制御部が実行した結果を出力し、
前記制御部は、前記第１のインタフェース部が出力した結果に対して該結果が正常である旨を示す第１の入力を前記第１のインタフェース部が受け付けた場合、前記更新データを前記メモリエリアに書き込む、付記２に記載の情報処理装置。
（付記４）前記制御部は、前記起動プログラムの手順に従って、前記第１のインタフェース部に対して、前記制御部が実行した結果の出力を指示する、付記３に記載の情報処理装置。
（付記５）前記制御部は、前記起動プログラムを実行した後、前記動作プログラムの更新要求を示す第２の入力を前記第１のインタフェース部が受け付けた場合、前記第１のインタフェース部に対して、前記更新データの取得を指示する、付記２から４のいずれか１項に記載の情報処理装置。
（付記６）前記制御部の指示に基づいて所定の通知信号を送信する第２のインタフェース部を有し、
前記制御部は、前記更新データを実行した結果が正常である場合、前記通知信号を送信するように前記第２のインタフェース部へ指示し、前記第２のインタフェース部が、前記通知信号に対する応答信号を受信した場合、該応答信号を送信してきた装置に対して、前記更新データを送信するように第２のインタフェース部へ指示し、
前記第２のインタフェース部は、前記制御部の指示に基づいて前記更新データを送信する、付記から５のいずれか１項に記載の情報処理装置。
（付記７）前記第２のインタフェース部は、前記通知信号を送信してから所定の時間が経過しても前記応答信号を受信しない場合、該通知信号を再送する、付記６に記載の情報処理装置。
（付記８）前記メモリエリアは不揮発性メモリの領域である、付記１から７のいずれか１項に記載の情報処理装置。
（付記９）情報処理装置を動作させるための動作プログラムの更新に必要な更新データを取得する処理と、
前記取得した更新データを実行する処理と、
前記実行した結果が正常である場合、前記更新データを、前記情報処理装置の再起動後に前記動作プログラムを実行させるためのメモリエリアに書き込む処理と、
前記情報処理装置を再起動させる処理とを行う動作プログラムの更新方法。
（付記１０）コンピュータに、
情報処理装置を動作させるための動作プログラムの更新に必要な更新データを取得する手順と、
前記取得した更新データを実行する手順と、
前記実行した結果が正常である場合、前記更新データを、前記情報処理装置の再起動後に前記動作プログラムを実行させるためのメモリエリアに書き込む手順と、
前記情報処理装置を再起動させる手順とを実行させるためのプログラム。
A part or all of the above embodiment can be described as in the following supplementary notes, but is not limited thereto.
(Appendix 1) An information processing apparatus,
A first interface unit for acquiring update data necessary for updating an operation program for operating the information processing apparatus;
A memory for executing update data acquired by the first interface unit and causing the update data to be executed after the information processing apparatus is restarted when a result of executing the update data is normal An information processing apparatus having a control unit that writes to an area and restarts the information processing apparatus.
(Additional remark 2) When the said information processing apparatus starts the said information processing apparatus, the startup program stored in the said memory area is performed, According to the procedure of this startup program, with respect to the said 1st interface part, Instructing acquisition of update data, executing the acquired update data, and if the result of executing the update data is normal, writing the update data to the memory area and restarting the information processing apparatus, The information processing apparatus according to 1.
(Supplementary Note 3) The first interface unit outputs a result executed by the control unit,
When the first interface unit receives a first input indicating that the result is normal with respect to a result output from the first interface unit, the control unit stores the update data in the memory area The information processing apparatus according to appendix 2, wherein
(Supplementary note 4) The information processing apparatus according to supplementary note 3, wherein the control unit instructs the first interface unit to output a result executed by the control unit in accordance with the procedure of the activation program.
(Additional remark 5) When the said 1st interface part receives the 2nd input which shows the update request | requirement of the said operation | movement program after the said start program is run with respect to the said 1st interface part The information processing apparatus according to any one of appendices 2 to 4, which instructs acquisition of the update data.
(Additional remark 6) It has the 2nd interface part which transmits a predetermined notice signal based on the directions of the control part,
The control unit instructs the second interface unit to transmit the notification signal when a result of executing the update data is normal, and the second interface unit responds to the notification signal. Is received, the second interface unit is instructed to transmit the update data to the device that has transmitted the response signal.
6. The information processing apparatus according to claim 5, wherein the second interface unit transmits the update data based on an instruction from the control unit.
(Supplementary note 7) The information processing according to supplementary note 6, wherein the second interface unit retransmits the notification signal when the response signal is not received even after a predetermined time has elapsed since the notification signal was transmitted. apparatus.
(Supplementary note 8) The information processing apparatus according to any one of supplementary notes 1 to 7, wherein the memory area is a non-volatile memory region.
(Additional remark 9) The process which acquires the update data required for the update of the operation program for operating information processing apparatus,
Processing for executing the acquired update data;
When the executed result is normal, the update data is written in a memory area for executing the operation program after restarting the information processing apparatus;
A method for updating an operation program for performing a process of restarting the information processing apparatus.
(Appendix 10)
A procedure for acquiring update data necessary for updating an operation program for operating the information processing apparatus;
A procedure for executing the acquired update data;
When the executed result is normal, the update data is written in a memory area for executing the operation program after the information processing apparatus is restarted;
A program for executing a procedure for restarting the information processing apparatus.
１００，１０１，１０２−１〜１０２−３ 情報処理装置
１１０ インタフェース部
１１１，１１２−１〜１１２−３ ＵＡＲＴ
１２０ 制御部
１２１，１２２−１〜１２２−３ ＣＰＵ
１３０ メモリエリア
１３１，１３２−１〜１３２−３ プログラマブルＲＯＭ
１４１，１４２−１〜１４２−３ ＲＡＭ
１５２−１〜１５２−３ 有線インタフェース部
１６２ 有線ネットワーク
２０１，２０２−１〜２０２−３ ＰＣ
３０１，３０２ ブートローダプログラム
３０３ システムプログラム
４００ 宛先ＭＡＣアドレス
４１０ 送信元ＭＡＣアドレス
４２０ タイプ
４３０ データ
４４０ ＦＣＳ
100, 101, 102-1 to 102-3
120
130
141, 142-1 to 142-3 RAM
152-1 to 152-3 Wired interface unit 162
301, 302
Claims (10)
当該情報処理装置を動作させるための動作プログラムの更新に必要な更新データを取得する第１のインタフェース部と、
前記第１のインタフェース部が取得した更新データを実行し、該更新データを実行した結果が正常である場合、前記更新データを、当該情報処理装置の再起動後に前記動作プログラムを実行させるためのメモリエリアに書き込み、当該情報処理装置を再起動させる制御部とを有する情報処理装置。 An information processing apparatus,
A first interface unit for acquiring update data necessary for updating an operation program for operating the information processing apparatus;
A memory for executing update data acquired by the first interface unit and causing the update data to be executed after the information processing apparatus is restarted when a result of executing the update data is normal An information processing apparatus having a control unit that writes to an area and restarts the information processing apparatus.
前記制御部は、当該情報処理装置を起動した際、前記メモリエリアに格納されている起動プログラムを実行し、該起動プログラムの手順に従って、前記第１のインタフェース部に対して、前記更新データの取得を指示し、前記取得した更新データを実行し、該更新データを実行した結果が正常である場合、前記更新データを前記メモリエリアに書き込み、当該情報処理装置を再起動させる情報処理装置。 The information processing apparatus according to claim 1,
When the information processing apparatus is activated, the control unit executes the activation program stored in the memory area, and acquires the update data from the first interface unit according to the procedure of the activation program. An information processing apparatus that executes the acquired update data and writes the update data to the memory area and restarts the information processing apparatus when the result of executing the update data is normal.
前記第１のインタフェース部は、前記制御部が実行した結果を出力し、
前記制御部は、前記第１のインタフェース部が出力した結果に対して該結果が正常である旨を示す第１の入力を前記第１のインタフェース部が受け付けた場合、前記更新データを前記メモリエリアに書き込む情報処理装置。 The information processing apparatus according to claim 2,
The first interface unit outputs a result executed by the control unit,
When the first interface unit receives a first input indicating that the result is normal with respect to a result output from the first interface unit, the control unit stores the update data in the memory area Information processing device to write to.
前記制御部は、前記起動プログラムの手順に従って、前記第１のインタフェース部に対して、前記制御部が実行した結果の出力を指示する情報処理装置。 The information processing apparatus according to claim 3.
The information processing apparatus, wherein the control unit instructs the first interface unit to output a result executed by the control unit in accordance with a procedure of the activation program.
前記制御部は、前記起動プログラムを実行した後、前記動作プログラムの更新要求を示す第２の入力を前記第１のインタフェース部が受け付けた場合、前記第１のインタフェース部に対して、前記更新データの取得を指示する情報処理装置。 The information processing apparatus according to any one of claims 2 to 4,
When the first interface unit receives a second input indicating an update request for the operation program after executing the startup program, the control unit transmits the update data to the first interface unit. Information processing apparatus instructing acquisition.
前記制御部の指示に基づいて所定の通知信号を送信する第２のインタフェース部を有し、
前記制御部は、前記更新データを実行した結果が正常である場合、前記通知信号を送信するように前記第２のインタフェース部へ指示し、前記第２のインタフェース部が、前記通知信号に対する応答信号を受信した場合、該応答信号を送信してきた装置に対して、前記更新データを送信するように第２のインタフェース部へ指示し、
前記第２のインタフェース部は、前記制御部の指示に基づいて前記更新データを送信する情報処理装置。 The information processing apparatus according to any one of claims 2 to 5,
A second interface unit that transmits a predetermined notification signal based on an instruction from the control unit;
The control unit instructs the second interface unit to transmit the notification signal when a result of executing the update data is normal, and the second interface unit responds to the notification signal. Is received, the second interface unit is instructed to transmit the update data to the device that has transmitted the response signal.
The information processing apparatus, wherein the second interface unit transmits the update data based on an instruction from the control unit.
前記第２のインタフェース部は、前記通知信号を送信してから所定の時間が経過しても前記応答信号を受信しない場合、該通知信号を再送する情報処理装置。 The information processing apparatus according to claim 6,
The information processing apparatus that retransmits the notification signal when the second interface unit does not receive the response signal even if a predetermined time has elapsed after transmitting the notification signal.
前記メモリエリアは不揮発性メモリの領域である情報処理装置。 The information processing apparatus according to any one of claims 1 to 7,
The information processing apparatus, wherein the memory area is a non-volatile memory area.
前記取得した更新データを実行する処理と、
前記実行した結果が正常である場合、前記更新データを、前記情報処理装置の再起動後に前記動作プログラムを実行させるためのメモリエリアに書き込む処理と、
前記情報処理装置を再起動させる処理とを行う動作プログラムの更新方法。 Processing for obtaining update data necessary for updating an operation program for operating the information processing apparatus;
Processing for executing the acquired update data;
When the executed result is normal, the update data is written in a memory area for executing the operation program after restarting the information processing apparatus;
A method for updating an operation program for performing a process of restarting the information processing apparatus.
情報処理装置を動作させるための動作プログラムの更新に必要な更新データを取得する手順と、
前記取得した更新データを実行する手順と、
前記実行した結果が正常である場合、前記更新データを、前記情報処理装置の再起動後に前記動作プログラムを実行させるためのメモリエリアに書き込む手順と、
前記情報処理装置を再起動させる手順とを実行させるためのプログラム。 On the computer,
A procedure for acquiring update data necessary for updating an operation program for operating the information processing apparatus;
A procedure for executing the acquired update data;
When the executed result is normal, the update data is written in a memory area for executing the operation program after the information processing apparatus is restarted;
A program for executing a procedure for restarting the information processing apparatus.
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