JP2015225536A - 情報処理装置、メモリーアクセス調停方法 - Google Patents
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Abstract
Description
まず、図1及び図2を参照しつつ、本発明の実施形態に係る画像形成装置10の概略構成について説明する。ここで、図1は、前記画像形成装置10の断面模式図である。
以下、図5を参照しつつ、前記画像形成装置10において前記第1制御部5が前記優先度変更プログラムに従って実行する優先度変更処理の手順の一例について説明する。ここで、ステップS1、S2・・・は、前記第1制御部5により実行される処理手順(ステップ)の番号を表している。
まず、ステップS1において、前記第1制御部5は、前記画像形成装置10の電源投入時又は省電力モードからの復帰時であるか否かを判断する。
ステップS2において、前記第1制御部5は、前記EEPROMに記憶されている前記ジョブ各々の実行回数を読み出し、読み出した前記ジョブ各々の実行回数を前記ジョブ各々に対応する前記モジュール8X各々の使用頻度として取得する。ここに、前記ステップS2の処理が、本発明における第2ステップの一例であって、前記第1制御部5の前記頻度取得部52により実行される。
ステップS3において、前記第1制御部5は、前記ステップS2で取得された前記モジュール8X各々の使用頻度に応じて、前記モジュール8X各々の前記優先度を変更する。ここに、前記ステップS3の処理が、本発明における第3ステップの一例であって、前記第1制御部5の前記優先度変更部53により実行される。
2 :画像読取部
3 :画像形成部
4 :給紙部
5 :第1制御部
51:実行回数計数部
52:頻度取得部
53:優先度変更部
6 :操作表示部
7 :記憶部
8 :第2制御部
80:バス
81:画像入力回路
82:コピー処理回路
83:画像出力回路
84:プリント処理回路
85:ファクス処理回路
86:プレビュー表示回路
87:メモリーコントローラー
88:メモリー
89:バス調停回路
10:画像形成装置
Claims (6)
- バスを介して接続されるメモリーにアクセス可能な複数のモジュールと、
複数の前記モジュール間で前記メモリーへのアクセスが競合する場合に、前記モジュールごとに予め設定された優先度に基づいて前記メモリーへのアクセスの競合を調停する調停部と、
前記モジュール各々の使用頻度を取得する頻度取得部と、
前記頻度取得部によって取得される前記モジュール各々の使用頻度に応じて前記モジュール各々の前記優先度を変更する優先度変更部と、
を備える情報処理装置。 - 複数の前記モジュール各々が、前記情報処理装置で実行されるジョブの種別に対応して設けられており、
前記頻度取得部が、前記ジョブの種別ごとの実行頻度を前記モジュール各々の使用頻度として取得する請求項1に記載の情報処理装置。 - 前記優先度変更部が、使用頻度が最も低い前記モジュールの前記優先度を上げる請求項1又は2に記載の情報処理装置。
- 前記優先度変更部が、使用頻度が最も高い前記モジュールの前記優先度を下げる請求項1〜3のいずれかに記載の情報処理装置。
- 前記優先度変更部が、前記情報処理装置の電源投入時又は省電力モードからの復帰時を含む予め定められた時機ごとに前記モジュール各々の前記優先度を変更する請求項1〜4のいずれかに記載の情報処理装置。
- バスを介して接続されるメモリーにアクセス可能な複数のモジュール間で前記メモリーへのアクセスが競合する場合に、前記モジュールごとに予め設定された優先度に基づいて前記メモリーへのアクセスの競合を調停する第1ステップと、
前記モジュール各々の使用頻度を取得する第2ステップと、
前記第2ステップによって取得される前記モジュール各々の使用頻度に応じて前記モジュール各々の前記優先度を変更する第3ステップと、
を含むメモリーアクセス調停方法。
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CN108984443A (zh) * | 2018-06-27 | 2018-12-11 | 郑州云海信息技术有限公司 | 一种优先级实时调整装置及方法 |
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-
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- 2014-05-28 JP JP2014110441A patent/JP6210022B2/ja not_active Expired - Fee Related
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