JP2015177722A - スイッチングレギュレータ - Google Patents
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Abstract
Description
AND 論理積回路
C1,C2 キャパシタ
CLK クロック信号生成回路
clk クロック信号
Cpwm PWMコンパレータ
DC 放電回路
DRV ドライバ
ERRAMP 誤差増幅器
FD 周波数検出回路
FD1 第1カウンタ回路
FD2 第2カウンタ回路
FD3 論理回路部
FF1〜FF6 フリップフリップ
INV1,INV2 インバータ
L インダクタ
NAND 否定論理積回路
Q1 第1スイッチングトランジスタ
Q2 第2スイッチングトランジスタ
Q3 逆電流検出トランジスタ
Q4 スイッチング出力帰還トランジスタ
Q5 放電用トランジスタ
R1,R2,R3,R4,R5 抵抗
R6 放電用抵抗
RL 負荷
Sdis 周波数検出信号
SLOPE スロープ電圧生成回路
Spwm PWM出力信号
Ve 誤差電圧
VIN 入力端子
Vin 入力電圧
VOUT 出力端子
Vout 出力電圧
Vsl スロープ電圧
Vsle スロープ比較電圧
Vswe モニタリング電圧
VSW スイッチング出力端子
Vsw スイッチング出力信号
Vref 基準電圧
ZC 逆電流検出回路
Zc 逆電流検出信号
Claims (8)
- 入力電圧が供給されオンオフのスイッチング動作を行う第1スイッチングトランジスタと、該スイッチングトランジスタと相補的なオンオフ動作を行う第2スイッチングトランジスタと、クロック信号に同期し前記第1スイッチングトランジスタおよび前記第2スイッチングトランジスタのオンオフの制御を行うドライバと、前記第1スイッチングトランジスタおよび前記第2スイッチングトランジスタから出力されるスイッチング出力信号の供給を受けて電流が供給されるインダクタと、該インダクタと直列に接続されるキャパシタと、前記スイッチング出力信号の1周期中の前記クロック信号をカウントする周波数検出回路と、前記周波数検出回路の出力で制御される放電回路を備え、前記インダクタおよび前記キャパシタ側から流れる電流を放電回路側に側路することを特徴とするスイッチングレギュレータ。
- 前記スイッチングレギュレータは、さらに前記出力端子から出力される出力電圧を分圧する分圧抵抗と、該分圧抵抗で生成された帰還電圧および基準電圧が入力され、これら両者の電圧差に応じた誤差電圧を出力する誤差増幅器と、前記誤差電圧と三角形状または鋸歯形状のスロープ比較電圧が入力され前記誤差電圧と前記スロープ比較電圧との差に応じたパルス幅を有するパルス幅変調信号を出力し該パルス幅変調信号を前記ドライバに供給するPWMコンパレータとを備え、前記スイッチング出力信号の1周期中の前記クロック信号のカウントは、前記PWMコンパレータの出力であるPWM出力信号の1周期中の前記クロック信号をカウントすることを特徴とする請求項1に記載のスイッチングレギュレータ。
- 前記周波数検出回路は、複数のフリップフロップから構成され前記クロック信号をカウントする第1カウンタ回路と、複数のフリップフロップから構成され前記パルス幅変調信号をカウントする第2カウンタ回路を備え、前記第1カウンタ回路と前記第2カウンタ回路を構成する最終段の前記フリップフロップはラッチ機能を有することを特徴とする請求項2に記載のスイッチングレギュレータ。
- 前記第1カウンタ回路および前記第2カウンタ回路を構成する前記複数のフリップフロップはDフリップフロップであることを特徴とする請求項3に記載のスイッチングレギュレータ。
- 前記周波数検出回路は、前記クロック信号が入力され前記パルス幅変調信号でリセットされる第1フリップフロップと、前記第1フリップフロップの出力が入力され前記第1フリップフロップと同じタイミングでリセットされる第2フリップフロップと、前記第2フリップフロップの出力が入力され前記第1フリップフロップおよび前記第2フリップフロップと同じタイミングでリセットされ前記最終段のフリップフロップにあたる第3フリップフロップと、前記パルス幅変調信号が入力され前記第3フリップフロップの出力でリセットされる第4フリップフロップと、前記第4フリップフロップの出力が入力され前記第4フリップフロップと同じタイミングでリセットされる第5フリップフロップと、前記第5フリップフロップの出力が入力され前記第4フリップフロップおよび前記第5のフリップと同じタイミングでリセットされ前記最終段のフリップフロップにあたる第6フリップフロップを備え、前記第3フリップフロップの出力と前記第6フリップフロップの出力を論理回路で論理演算し、前記論理演算した出力信号によって前記放電用トランジスタをオンまたはオフさせることを特徴とする請求項4に記載のスイッチングレギュレータ。
- 前記第2スイッチングトランジスタの動作に同期し前記出力端子に流れる電流を検出する逆電流検出トランジスタが設けられていることを特徴とする請求項2に記載のスイッチングレギュレータ。
- 前記逆電流検出トランジスタは逆電流の流れを検出し、該検出した出力を逆電流検出回路に伝達し、前記逆電流検出回路は前記第2スイッチングトランジスタをオフとすることを特徴とする請求項6に記載のスイッチングレギュレータ。
- 前記第1スイッチングトランジスタと同期し前記スイッチング出力端子に生じるスイッチング出力信号を帰還するスイッチング出力帰還トランジスタが前記PWMコンパレータへ結合されていることを特徴とする請求項2に記載のスイッチングレギュレータ。
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