JP2013110434A - 表面実装可能な集積回路のパッケージ化機構 - Google Patents
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Abstract
【解決手段】集積回路(IC)パッケージが開示される。ICパッケージは、上部層、中間層、及び底部層を有する基板と、基板の上部層に埋め込まれたミリメートル波アンテナのアレイと、基板の底部層に実装されたモノリシック・マイクロ波集積回路(MMIC)とを含む。1つの実施形態において、プリント回路基板(PCB)への表面実装のための第2のレベルの相互接続が基板の底部層に設けられる。
【選択図】図1
Description
このような集積パッケージは、集積レベルが増加するのに伴って、様々な機能を収容すると予想される。これらの機能には、中でも、低損失無共振のmm波信号経路の提供、多層アンテナ素子とそれらのフィード・ネットワークの埋め込み、局部発振器(LO)、中間周波数(IF)分配及び受動回路の統合、並びに制御層とバイアス層の組み込みが含まれる。
さらに、IC及びアンテナを十分な間隔で同じ表面上に配置する必要があるので、パッケージが大きくなる。パッケージの大きさが増大するのに伴って、コストが増加し、場合によっては、基板が製造するのに大きくなりすぎる可能性さえある。最後に、ICからの熱除去が難しくなる。
別の実施形態により、システムが開示される。このシステムは、上部層、中間層、及び底部層を有する基板と、基板の1つの層(例えば、上部層)に埋め込まれたミリメートル波アンテナのアレイと、基板の別の層(例えば、底部層)の上に実装されたモノリシック・マイクロ波集積回路(MMIC)とを含む集積回路(IC)パッケージを含む。プリント回路基板(PCB)は、基板のこの第2の層の上に実装される。
ミリメートル波モジュールの放射素子と集積回路素子を統合するための表面実装可能なパッケージング・スキームを説明する。1つの実施形態によれば、アンテナは、基板の上部層内に組み込まれる。モノリシック・マイクロ波集積回路(MMIC)及びボール・グリッド・アレイ(BGA)は、基板の底面に取り付けられる。
従って、十分な性能を有するミリメートル波機能の高レベルの統合を可能にする両面型パッケージングを実施する機構を説明する。
以下の説明において、多数の詳細が示される。しかしながら、当業者であれば、これらの特定の詳細なしに本発明の実施形態を実施できることは明らかであろう。他の場合には、説明の理解を不明瞭にすることを避けるために、周知の構造体、デバイス及び技術は、詳細には示されていない。従って、この説明は、限定するのではなく例証するものと考えられたい。
システム100は、プリント回路基板(PCB)105の上に実装された多層基板160を含む。基板160は、誘電体層と、2つの誘電体層の界面に配置された金属層とを含む。本明細書において説明されるように、単独での「層」という用語への如何なる言及も「金属層」を示す。1つの実施形態において、基板160は、High Temperature Co−Fired Ceramics(HTCC)又はLow Temperature Co−Fired Ceramics(LTCC)アルミナによる大量生産に適しているが、例えば、積層ベース又はビルドアップ有機物のような他の基板型を用いることもできる。さらに、1つの実施形態において、基板160は、キャビティ、又は、側壁メタライゼーション等のような特定の構造部を含まない。
1つの実施形態によれば、アンテナ・アレイ170の素子の各々は、MMIC145のうちの1つの上に、対応するミリメートル波ポートを有する。フリップチップ・バンプ147は、アンダーフィル149によって、対応するアンテナ・アレイ170の素子をMMIC145に結合する。その結果、MMIC145から発したミリメートル波信号は、基板160の中間層に伝わり、そこで、これらの信号は、それぞれのアンテナ・フィード・ポイント165に分配され、結局アンテナ・アレイ170内のアンテナに結合される。
図2は、基板160の1つの実施形態の断面図を示す。埋め込んだ主要機能に基づいて、それらの層は、接地平面168によって分離される、上部210、中間部220及び底部230の3つのグループに分けられる。1つの実施形態において、上部層210は、平面アンテナ素子に割り当てられる。多くの場合、パッチ積層化のような技術を実施してアンテナの性能を高めるために多層が必要とされる。代替的な実施形態において、単一層を平面アンテナ素子用に用いることができることに留意されたい。誘電体層の厚さは、アンテナ設計の考慮事項から決定することができる。上部接地平面168は、アンテナ層210をパッケージの残り部分から絶縁し、これにより電磁干渉からの耐性を与える。
従って、1つの実施形態において、この垂直相互接続の問題の解決法として、補償用垂直相互接続機構が実施される。この垂直相互接続機構において、ミリメートル波信号は、基板の内側金属層である補償用垂直相互接続215の上をフリップチップ・パッド208に至るまで伝送される。
1つの実施形態によれば、補償用垂直相互接続は、底部のMMICの全てのミリメートル波ポートの位置に又はその極めて近くに配置される。他の実施形態においては、同様の垂直相互接続が、ミリメートル波信号を中間層から上部層に伝送する必要があるフィード・スキームにおけるアンテナ・フィード・ネットワーク内で用いられる。
1つの実施形態によれば、基板160の底面は、MMIC145及びパッケージの第2のレベルの相互接続面の両方として構成される。1つ又はそれ以上のMMIC145は、標準的なフリップチップ組立て技術を用いて基板160にフリップチップ実装される。上述のように、他の実装技術を用いることができる。それらの低い電気的寄生振動により、フリップチップ相互接続は、mm波周波数において十分な性能をもたらすことができる。
さらに別の実施形態において、ダイ145は、高周波動作のための短いワイヤ・ボンド長を達成するためにキャビティ実装される。この構成におけるフリップチップ実装の別の利点は、ダイ145の裏面が露出するので効率的な熱除去のために使用できることである。
このようなシナリオにおいては、第2のレベルの相互接続は低周波数において十分な性能を有し、従ってその仕様を緩和する。結果として、他の型の相互接続を実施することが可能になる。図3は、BGAボール150ではなくリード300が基板160をPCB105に結合させるシステム100の実施形態を示す。
1つの実施形態において、フリップチップ実装されたダイ145及びBGAボール150は、パッケージの表面実装面にあり、このパッケージはPCB105に取り付ける準備ができた状態にある。パッケージをPCB105に取り付けることができる幾つかの方法がある。図1に示されるように、ダイ145のメタライズされた裏面140が、表面実装操作中にPCB105上のはんだ付け可能な実装用パッド130と結合する。ダイと実装用パッドの間のギャップの大きさは考慮する必要がある。BGAにおける良好なはんだ接続のために、はんだボール150はリフロー中に十分に潰れる必要がある。ダイ145はPCB105に対するハード・ストップとして機能するので、小さすぎるギャップは、はんだボール150が良好な接続を形成するのを妨げる。
第3の取付け方法において、PCB105は、ダイ145の大きさよりも大きな貫通切欠き部を含む。図5は、システム100のこのような実施形態を示す。図5に示されるように、切欠き部505はダイの真下に配置されることになる。表面実装中、BGAボール150が潰れつつあるとき、ダイ145は切欠き部に滑り込む。ダイ145とPCB105の間にギャップが必要ないので、この構成は、より小さなBGAボール150の使用を可能にすることになる。ダイ145の裏面は、切欠き部505を通して露出することになるので、例えば、ヒートシンクを用いて、熱接続を確立することができる。
上述のシステムは、アンテナが基板の上部層に組み込まれ、MMIC及び表面実装用BGAが底部に取り付けられた厚い多層基板をベースとする高集積ミリメートル波パッケージを形成する機構を説明する。この機構は、このような従来にないパッケージ化体を製造する困難を克服し、大量製造プロセスを用いて実施することができる。
105:プリント回路基板(PCB)
130:はんだ可能パッド
140:金属成分
145:モノリシック・マイクロ波集積回路(MMIC)
147:フリップチップ・バンプ
149:アンダーフィル
150:ボール・グリッド・アレイ(BGA)
160:基板
162:信号ルーティング
165:伝送ライン(アンテナ・フィード・ポイント)
168:接地面
170:アンテナ・アレイ
210:上部層(アンテナ層)
220:中間層
230:底部層
300:リード
505:切欠き部
510:金属パドル
Claims (12)
- 第1、第2及び第3の組の1つ又はそれ以上の層を有し、前記第2の組の1つ又はそれ以上の層は前記第1及び第3の組の1つ又はそれ以上の層の間にある、基板と、
前記基板の前記第1の組の層に埋め込まれたミリメートル波アンテナのアレイと、
前記基板の前記第3の組の層のうちの1つの上に実装されたモノリシック・マイクロ波集積回路(MMIC)と、
前記基板の前記第2の組の層のうちの1つ又はそれ以上の中に埋め込まれたアンテナ・フィード・ポイントと、
前記MMICから前記フィード・ポイントに信号を伝送するための相互接続と、
前記基板をプリント回路基板(PCB)に実装するための、前記第3の組の層上に取り付けられたリードと、
を備えることを特徴とする集積回路(IC)パッケージ。 - 前記MMICは、前記アレイ内のアンテナに対応する1つ又はそれ以上のポートを備えることを特徴とする、請求項1に記載のパッケージ。
- 前記相互接続は、前記第3の組の層の内の層から前記第2の組の層に至る遷移部の寄生効果を減少させるための補償構造体を含むことを特徴とする、請求項1に記載のパッケージ。
- 前記第3の組の層に埋め込まれたアナログ信号ラインをさらに備えることを特徴とする、請求項1に記載のパッケージ。
- 前記基板をプリント回路基板(PCB)に実装するための、前記第3の組の層上に取り付けられたボール・グリッド・アレイ(BGA)ボールをさらに備えることを特徴とする、請求項4に記載のパッケージ。
- 第1、第2及び第3の組の1つ又はそれ以上の層を有し、前記第2の組の1つ又はそれ以上の層は、前記第1及び第3の組の1つ又はそれ以上の層の間にある、基板と、
前記基板の前記第1の組の層に埋め込まれたミリメートル波アンテナのアレイと、
前記基板の前記第3の組の層のうちの1つの上に実装されたモノリシック・マイクロ波集積回路(MMIC)と、
前記基板の前記第2の組の層のうちの1つ又はそれ以上の中に埋め込まれたアンテナ・フィード・ポイントと、
前記MMICから前記フィード・ポイントに信号を伝送するための相互接続と、
プリント回路基板(PCB)に実装するための、前記MMICダイの直下に取り付けられたパッドと、
を備えることを特徴とする集積回路(IC)パッケージ。 - 前記MMICダイの裏面はメタライズされることを特徴とする、請求項6に記載のパッケージ。
- 前記MMICは、前記アレイ内のアンテナに対応する1つ又はそれ以上のポートを備えることを特徴とする、請求項6に記載のパッケージ。
- 第1、第2及び第3の組の1つ又はそれ以上の層を有し、前記第2の組の1つ又はそれ以上の層は、前記第1及び第3の組の1つ又はそれ以上の層の間にある、基板と、
前記基板の前記第1の組の層に埋め込まれたミリメートル波アンテナのアレイと、
前記基板の前記第3の組の層のうちの1つの上に実装されたモノリシック・マイクロ波集積回路(MMIC)と、
を含む集積回路(IC)パッケージと、
前記基板の前記第3の組の層の上に、前記基板をプリント回路基板に実装するための前記第3の組みの層のうちの少なくとも1つに取り付けられたリードを用いて、実装されたプリント回路基板(PCB)と、
を備えることを特徴とするシステム。 - 前記MMICは、前記アレイ内のアンテナに対応する1つ又はそれ以上のポートを備えることを特徴とする、請求項9に記載のシステム。
- 前記パッケージは、前記基板の前記第2の組の層のうちの1つ又はそれ以上の中に埋め込まれたアンテナ・フィード・ポイントをさらに備えることを特徴とする、請求項10に記載のシステム。
- 前記MMICから前記フィード・ポイントまで信号を伝送するための相互接続をさらに備えることを特徴とする、請求項11に記載のシステム。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2013020236A JP5762452B2 (ja) | 2013-02-05 | 2013-02-05 | 表面実装可能な集積回路のパッケージ化機構 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2013020236A JP5762452B2 (ja) | 2013-02-05 | 2013-02-05 | 表面実装可能な集積回路のパッケージ化機構 |
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Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2008292779A Division JP2010098274A (ja) | 2008-10-20 | 2008-10-20 | 表面実装可能な集積回路のパッケージ化機構 |
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Application Number | Title | Priority Date | Filing Date |
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JP2014226914A Division JP2015026873A (ja) | 2014-11-07 | 2014-11-07 | 表面実装可能な集積回路のパッケージ化機構 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2013110434A true JP2013110434A (ja) | 2013-06-06 |
JP5762452B2 JP5762452B2 (ja) | 2015-08-12 |
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2013020236A Expired - Fee Related JP5762452B2 (ja) | 2013-02-05 | 2013-02-05 | 表面実装可能な集積回路のパッケージ化機構 |
Country Status (1)
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JP (1) | JP5762452B2 (ja) |
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---|---|
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20130822 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20130902 |
|
RD03 | Notification of appointment of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7423 Effective date: 20140320 |
|
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20140320 |
|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20140708 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20141107 |
|
A911 | Transfer of reconsideration by examiner before appeal (zenchi) |
Free format text: JAPANESE INTERMEDIATE CODE: A911 Effective date: 20141117 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20150113 |
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A521 | Written amendment |
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S531 | Written request for registration of change of domicile |
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