JP2013053998A - Device and method for testing circuit board - Google Patents
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Abstract
Description
本発明は、回路基板における各導体パターン間の絶縁検査を実行する回路基板検査装置および回路基板検査方法に関するものである。 The present invention relates to a circuit board inspection apparatus and a circuit board inspection method for performing an insulation inspection between conductor patterns on a circuit board.
この種の回路基板検査装置として、特開2009−264834号公報において出願人が開示した絶縁検査装置が知られている。この絶縁検査装置は、テストヘッド、測定部、スキャナ部、処理部などを備えて、基板に形成されている各導体パターン間の絶縁状態をマルチプル方式で検査可能に構成されている。マルチプル方式で検査を行うこの種の絶縁検査装置では、一般的に、次のようにして検査を行う。まず、各導体パターンを2つのグループにグループ分けして、処理部がスキャナ部を制御して、その一方のグループに属する導体パターンにそれぞれ接触しているテストヘッドのプローブを測定部の高電位および低電位のいずれか一方に接続させると共に、2つのグループの他方に属する導体パターンにそれぞれ接触しているプローブを測定部の高電位および低電位の他方に接続させる。次いで、処理部が、測定部を制御して検査用信号(試験用電圧)の供給によって流れる電流を測定させ、続いて、その測定値と基準値とを比較して絶縁状態を検査する。次いで、処理部は、グループ分けを変更して同様の検査を行う。この場合、検査対象の導体パターンの数をMとしたときに、N種類((log2M)以上であって(log2M)に最も近い整数)のグループ分けで、つまり上記の検査をN回行うことで、各導体パターンのいずれかにおいて絶縁不良が存在しているか、またはいずれにも絶縁不良が存在していないかを判定することができる。このため、この種の絶縁検査装置では、1つの導体パターンと1つの導体パターンとの間の絶縁状態を全ての組み合わせについて検査する構成と比較して、検査回数を十分に少なくすることが可能となっている。 As this type of circuit board inspection apparatus, an insulation inspection apparatus disclosed by the applicant in Japanese Patent Application Laid-Open No. 2009-264834 is known. The insulation inspection apparatus includes a test head, a measurement unit, a scanner unit, a processing unit, and the like, and is configured to be able to inspect the insulation state between the conductor patterns formed on the substrate by a multiple method. In this type of insulation inspection apparatus that performs inspection by a multiple method, the inspection is generally performed as follows. First, each conductor pattern is grouped into two groups, the processing unit controls the scanner unit, and the probe of the test head that is in contact with the conductor pattern belonging to one of the groups is connected to the high potential and the measurement unit. The probe that is in contact with the conductor pattern belonging to the other of the two groups is connected to the other of the high potential and the low potential of the measurement unit. Next, the processing unit controls the measurement unit to measure the current flowing by supplying the inspection signal (test voltage), and then inspects the insulation state by comparing the measured value with the reference value. Next, the processing unit changes the grouping and performs the same inspection. In this case, when the number of conductor patterns to be inspected is M, N types (an integer closest to (log 2 M) and greater than (log 2 M)) are grouped, that is, the above inspection is performed in N It is possible to determine whether there is an insulation failure in any one of the conductor patterns or no insulation failure in any of the conductive patterns. For this reason, in this type of insulation inspection apparatus, it is possible to sufficiently reduce the number of inspections compared to a configuration in which the insulation state between one conductor pattern and one conductor pattern is inspected for all combinations. It has become.
ところが、上記した従来の絶縁検査装置には、改善すべき以下の課題がある。すなわち、マルチプル方式で検査を行う上記の絶縁検査装置では、検査対象の導体パターンを2つのグループにグループ分けし、各導体パターンに接触しているプローブを介して各導体パターンに検査用信号を供給する。つまり、この種の絶縁検査装置では、一度に多くのプローブを介して検査用信号が供給される。一方、この種の絶縁検査装置では、プローブと測定部とを繋ぐ接続ケーブルとしてフラットケーブル(平ケーブル)が一般的に用いられる。このようなフラットケーブルを用いた場合において、フラットケーブルを構成する各信号線のうちの隣り合う一対の信号線の一方が高電位に接続され、他方が低電位に接続されているときには、両者の間の浮遊容量がチャージされる。この場合、上記したように一度に多くのプローブを介して検査用信号を供給したときには、接続先の電位が異なる信号線の対(ペア)の数も多くなり、この結果、チャージされる浮遊容量が大きくなる。一方、検査用信号を供給する際に、接続先の電位が異なる信号線のペアが存在するときには、浮遊容量がチャージされるまでの間に比較的大きな電流が流れて、検査結果が不正確となるおそれがある。このため、この種の絶縁検査装置では、検査用信号の供給を開始してから浮遊容量がチャージされるまでに必要な時間だけ待機し、その後に測定した電流値に基づいて検査を行っている。このため、従来の絶縁検査装置には、チャージされる浮遊容量が大きいために待機時間が長くなり、これに起因して検査効率の向上が困難となっているという課題が存在し、この点の改善が望まれている。 However, the above-described conventional insulation inspection apparatus has the following problems to be improved. That is, in the above-described insulation inspection apparatus that performs the inspection by the multiple method, the conductor patterns to be inspected are grouped into two groups, and an inspection signal is supplied to each conductor pattern via a probe that is in contact with each conductor pattern. To do. That is, in this type of insulation inspection apparatus, inspection signals are supplied through many probes at once. On the other hand, in this type of insulation inspection apparatus, a flat cable (flat cable) is generally used as a connection cable that connects the probe and the measurement unit. In the case where such a flat cable is used, when one of a pair of adjacent signal lines constituting each flat cable is connected to a high potential and the other is connected to a low potential, The stray capacitance between them is charged. In this case, as described above, when inspection signals are supplied through many probes at a time, the number of signal line pairs having different connection destination potentials increases, and as a result, the stray capacitance to be charged is increased. Becomes larger. On the other hand, when supplying a test signal, if there is a pair of signal lines with different connection destination potentials, a relatively large current flows until the stray capacitance is charged, resulting in an inaccurate test result. There is a risk. For this reason, this type of insulation inspection apparatus waits for a necessary time from the start of supply of the inspection signal until the stray capacitance is charged, and then performs inspection based on the measured current value. . For this reason, the conventional insulation inspection apparatus has a problem that the standby time is long because of the large stray capacitance to be charged, and this makes it difficult to improve inspection efficiency. Improvement is desired.
本発明は、かかる改善すべき課題に鑑みてなされたものであり、回路基板における各導体パターン間の絶縁検査を行う際の検査効率を向上し得る回路基板検査装置および回路基板検査方法を提供することを主目的とする。 The present invention has been made in view of the problems to be improved, and provides a circuit board inspection apparatus and a circuit board inspection method capable of improving the inspection efficiency when performing an insulation inspection between conductor patterns on a circuit board. The main purpose.
上記目的を達成すべく請求項1記載の回路基板検査装置は、検査用信号を出力する信号出力部と、回路基板の導体パターンと前記信号出力部の低電位および高電位との接断を行うスイッチ部と、前記スイッチ部を制御して検査対象のM個(Mは3以上の整数)の前記導体パターンのうちの一部の導体パターンを第1グループとして設定して当該第1グループの導体パターンを前記低電位および前記高電位のいずれか一方の電位に接続させると共に当該M個の導体パターンのうちの当該第1グループの導体パターンを除く他の全ての導体パターンを第2グループとして設定して当該第2グループの導体パターンを当該低電位および当該高電位の他方の電位に接続させる接続処理を当該両グループとしてそれぞれ設定する前記導体パターンの組み合わせを変更しつつN回(Nは(log2M)以上であって(log2M)に最も近い整数)実行する制御部と、前記各導体パターン間の絶縁検査を前記接続処理が実行される毎に行う検査部とを備えた回路基板検査装置であって、前記制御部は、前記M個としての16個の前記導体パターンについての前記接続処理を前記N回としての4回実行して前記絶縁検査を行う際に、当該各導体パターンに1から16の番号が付されているとしたときに、1、2、3、6、7、8、9および10の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に4、5、11、12、13、14、15および16の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第1形態での前記接続処理、3、4、5、6、9、10、11および12の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に1、2、7、8、13、14、15および16の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第2形態での前記接続処理、1、2、3、4、10、11、15および16の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に5、6、7、8、9、12、13および14の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第3形態での前記接続処理、並びに2、3、4、5、6、7、14および15の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に1、8、9、10、11、12、13および16の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第4形態での前記接続処理を予め決められた順番で実行する。
In order to achieve the above object, a circuit board inspection apparatus according to
また、請求項2記載の回路基板検査方法は、回路基板における検査対象のM個(Mは3以上の整数)の導体パターンのうちの一部の導体パターンを第1グループとして設定して当該第1グループの導体パターンを検査用信号を出力する信号出力部の低電位および高電位のいずれか一方の電位に接続させると共に当該M個の導体パターンのうちの当該第1グループの導体パターンを除く他の全ての導体パターンを第2グループとして設定して当該第2グループの導体パターンを当該低電位および当該高電位の他方の電位に接続させる接続処理を当該両グループとしてそれぞれ設定する前記導体パターンの組み合わせを変更しつつN回(Nは(log2M)以上であって(log2M)に最も近い整数)実行し、前記各導体パターン間の絶縁検査を前記接続処理を実行する毎に行う回路基板検査方法であって、前記M個としての16個の前記導体パターンについての前記接続処理を前記N回としての4回実行して前記絶縁検査を行う際に、当該各導体パターンに1から16の番号が付されているとしたときに、1、2、3、6、7、8、9および10の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に4、5、11、12、13、14、15および16の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第1形態での前記接続処理、3、4、5、6、9、10、11および12の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に1、2、7、8、13、14、15および16の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第2形態での前記接続処理、1、2、3、4、10、11、15および16の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に5、6、7、8、9、12、13および14の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第3形態での前記接続処理、並びに2、3、4、5、6、7、14および15の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に1、8、9、10、11、12、13および16の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第4形態での前記接続処理を予め決められた順番で実行する。
According to a second aspect of the present invention, there is provided a circuit board inspection method in which a part of the M (M is an integer of 3 or more) conductor patterns to be inspected on a circuit board is set as a first group. Other than connecting one group of conductor patterns to either the low potential or the high potential of the signal output unit that outputs the inspection signal, and excluding the first group of the M conductor patterns. A combination of conductor patterns in which all the conductor patterns are set as a second group and a connection process for connecting the second group of conductor patterns to the other potential of the low potential and the high potential is set as the two groups, respectively. while changing the N times (N is (log 2 M) greater than or equal to a (log 2 M) nearest integer) perform insulation test between the conductor patterns A circuit board inspection method for performing inspection every time the connection processing is executed, wherein the connection processing for the 16 conductor patterns as the M pieces is executed four times as the N times, and the insulation inspection is performed. When conducting, assuming that each conductor pattern is numbered 1 to 16, the conductor patterns numbered 1, 2, 3, 6, 7, 8, 9 and 10 are The conductor pattern set as the first group and connected to one of the potentials and numbered 4, 5, 11, 12, 13, 14, 15 and 16 is set as the second group. The conductor patterns numbered 3, 4, 5, 6, 9, 10, 11 and 12 in the first form for connecting to the other potential are set as the first group. One of the above In the second mode, the conductor patterns connected to the potential and numbered 1, 2, 7, 8, 13, 14, 15 and 16 are set as a second group and connected to the other potential. The connection process, 1, 2, 3, 4, 10, 11, 15, and 16 are set as the first group and connected to any one of the potentials, and 5, The connection process in the third mode in which the conductor patterns numbered 6, 7, 8, 9, 12, 13 and 14 are set as a second group and connected to the other potential, and 2, The conductor patterns numbered 3, 4, 5, 6, 7, 14 and 15 are set as the first group and connected to any one of the potentials, and 1, 8, 9, 10, 11, 12, 13 The conductor
請求項1記載の回路基板検査装置、および請求項2記載の回路基板検査方法によれば、16個の導体パターンについての接続処理を4回実行する際に、第1形態での接続処理、第2形態での接続処理、第3形態での接続処理、および第4形態での接続処理を予め決められた順番で実行することにより、隣り合う一対の導体パターンの一方が低電位に接続され他方が高電位に接続されている異電位の導体パターンのペアの数を、従来の構成および方法と比較して十分に少なくすることができる。したがって、この回路基板検査装置および回路基板検査によれば、異電位の導体パターンのペアの数が少なくなる分、検査用信号の供給の際にチャージされる浮遊容量(例えば、異電位の導体パターンに検査用信号を供給する各信号線間の浮遊容量)を小さくすることができるため、検査用信号の供給開始から浮遊容量がチャージされるまでの待機時間を十分に短くすることができる結果、検査効率を十分に向上することができる。
According to the circuit board inspection apparatus according to
以下、本発明に係る回路基板検査装置および回路基板検査方法の実施の形態について、添付図面を参照して説明する。 Embodiments of a circuit board inspection apparatus and a circuit board inspection method according to the present invention will be described below with reference to the accompanying drawings.
最初に、回路基板検査装置の一例としての回路基板検査装置1の構成について説明する。図1に示す回路基板検査装置1は、複数の導体パターンを有する回路基板(例えば、図2に示す回路基板100)における各導体パターン(例えば、同図に示す導体パターンP1〜P16であって、以下、区別しないときには「導体パターンP」ともいう)の間の絶縁状態の検査(絶縁検査)を後述する回路基板検査方法に従って実行可能に構成されている。具体的には、回路基板検査装置1は、図1に示すように、基板保持部11、プローブユニット12、移動機構13、信号出力部14、スイッチ部15、測定部16、記憶部17および制御部18を備えて構成されている。なお、測定部16および制御部18によって検査部が構成される。
First, the configuration of the circuit
基板保持部11は、保持板と、保持板に取り付けられて回路基板100の端部を挟み込んで固定するクランプ機構(いずれも図示せず)とを備えて、回路基板100を保持可能に構成されている。プローブユニット12は、複数のプローブ21(図1参照)を備えて治具型に構成されている。この場合、プローブユニット12は、回路基板100の各導体パターンPの形状や配設位置などに応じて、プローブ21の数や配列パターンが予め規定されている。
The
移動機構13は、制御部18の制御に従い、プローブユニット12を上下方向に移動させることによってプロービングを実行する。信号出力部14は、制御部18の制御に従い、検査用信号S(一例として、電圧値が15V〜250V程度の直流電圧)を出力する。
The moving
スイッチ部15は、スキャナであって、複数のスイッチ(図示せず)を備えて構成されている。また、スイッチ部15には、プローブユニット12に配設されているプローブ21の数と同数またはそれ以上の数の信号線が並設されたフラットケーブル(平ケーブル)が連結され、このフラットケーブルの各信号線を介して各プローブ21とスイッチ部15とが電気的に結ばれている。このスイッチ部15は、制御部18の制御に従って各スイッチをオン状態またはオフ状態に移行させることにより、導体パターンPに接触しているプローブユニット12のプローブ21と信号出力部14の低電位および高電位との接断(接続および切断)を行うと共に、プローブ21と測定部16との接断を行う。つまり、スイッチ部15は、プローブ21を介して、導体パターンPと信号出力部14の低電位および高電位との接断、および導体パターンPと測定部16との接断を行う。
The
測定部16は、検査用信号Sの電圧値と、導体パターンPに対する検査用信号Sの供給によって導体パターンP間に流れる電流の電流値とに基づき、導体パターンP間の抵抗値を測定する測定処理を実行する。
The
記憶部17は、基板データDcを記憶する。この基板データDcには、回路基板100に形成されている各導体パターンPを特定する情報(具体的には、各導体パターンPに付された番号)が含まれている。また、記憶部17は、プローブユニット12の各プローブ21を識別する識別情報Ddを記憶する。この識別情報Ddには、各プローブ21にそれぞれ付された番号を示す情報が含まれている。また、記憶部17は、導体パターンP間の絶縁状態の良否判定に用いる基準値を記憶する。さらに、記憶部17は、測定部16によって測定される測定値、および制御部18によって実行される絶縁検査の結果を記憶する。
The
制御部18は、図外の操作部から出力される操作信号に従って回路基板検査装置1を構成する各構成要素を制御する。また、制御部18は、接続処理を実行して回路基板100における各導体パターンPと信号出力部14の高電位および低電位との接断、並びに導体パターンPと測定部16との接断をスイッチ部15に行わせる。
The
この接続処理では、制御部18は、スイッチ部15を制御して、検査対象のM個の導体パターンPのうちの一部の導体パターンPを第1グループとして設定して、その第1グループの導体パターンPを信号出力部14における低電位および高電位のいずれか一方の電位に接続させると共に、M個の導体パターンPのうちの第1グループの導体パターンPを除く他の全ての導体パターンPを第2グループとして設定して、その第2グループの導体パターンPを信号出力部14における低電位および高電位の他方の電位に接続させる。また、制御部18は、この接続処理を、両グループとしてそれぞれ設定する導体パターンPの組み合わせを変更しつつN回(Nは(log2M)以上であって(log2M)に最も近い整数)実行する。
In this connection process, the
また、制御部18は、16個の導体パターンPを検査対象とするときに、後述する手順で第1グループおよび第2グループとして設定する導体パターンPのグループ分けを行う。また、制御部18は、より多くの複数の導体パターンPを検査対象とするときには、16個の導体パターンPを1つの単位として後述するグループ分けを行う。
In addition, when the 16 conductor patterns P are to be inspected, the
さらに、制御部18は、測定部16を制御して、接続処理を実行する毎に測定処理を実行させると共に、測定処理によって測定された導体パターンP間の抵抗値に基づいて導体パターンP間の絶縁状態を検査する。つまり、制御部18は、接続処理を実行する毎に絶縁検査を実行する。なお、上記した形態での接続処理を伴う絶縁検査の方式を以下「マルチプル方式」ともいう。
Further, the
次に、回路基板検査装置1を用いて図2に示す回路基板100における各導体パターンPの間の絶縁状態を検査する回路基板検査方法、およびその際の回路基板検査装置1の動作について、図面を参照して説明する。なお、回路基板100は、数多くの導体パターンPを有しているが、図2では、その一部として、16個の導体パターンP1〜P16を図示している。また、この例では、この16個(M個の一例)の導体パターンP1〜P16を検査対象とするものとし、各導体パターンP1〜P16には、「1」〜「16」の番号がそれぞれ付されているものとする。さらに、各導体パターンP1〜P16には、各導体パターンP1〜P16に付された番号と同じ番号(「1」〜「16」の番号)がそれぞれ付されたプローブ21が接触(プロービング)されるものとする。
Next, the circuit board inspection method for inspecting the insulation state between the conductor patterns P in the
まず、回路基板100を基板保持部11における保持板(図示せず)に載置し、次いで、基板保持部11のクランプ機構(図示せず)で回路基板100の端部を挟み込んで固定することにより、回路基板100を基板保持部11に保持させる。続いて、図外の操作部を用いて検査開始操作を行う。この際に、制御部18が、操作部から出力された操作信号に従い、移動機構13を制御してプローブユニット12を下向きに移動させる。これにより、プローブユニット12の各プローブ21の先端部が各導体パターンPにそれぞれ接触(プロービング)させられる。
First, the
次いで、制御部18は、マルチプル方式での絶縁検査を実行する。この例では、回路基板100における検査対象の導体パターンPの数Mが「16」のため、第1グループおよび第2グループとしてそれぞれ設定する導体パターンPの組み合わせの種類数Nは、(log2M)以上であって(log2M)に最も近い整数である「4」となる。つまり、制御部18が、4回の接続処理および絶縁検査を実行することで、全ての導体パターンPについての絶縁状態の良否を検査することができる。この回路基板検査装置1では、制御部18は、この4回の接続処理および絶縁検査を、一例として、次の手順で行う。
Next, the
制御部18は、まず、基板データDcおよび識別情報Ddを記憶部17から読み出し、続いて、各導体パターンPに付されている番号および各導体パターンに接触しているプローブ21の番号を基板データDcおよび識別情報Ddに基づいて特定する。次いで、制御部18は、1回目の接続処理を実行する。この1回目の接続処理では、制御部18は、スイッチ部15を制御して、図3に示すように、「1」、「2」、「3」、「6」、「7」、「8」、「9」および「10」の番号が付されている導体パターンPを第1グループとして設定して信号出力部14の低電位(低電位および高電位のいずれか一方の電位に相当する)に接続すると共に、「4」、「5」、「11」、「12」、「13」、「14」、「15」および「16」の番号が付されている導体パターンPを第2グループとして設定して信号出力部14の高電位(低電位および高電位の他方の電位に相当する)に接続する(図3では、低電位を「低」で、高電位を「高」でそれぞれ図示している)。以下、このグループ分けによる接続処理の形態をA形態(第1の形態に相当する)ともいう。
First, the
続いて、制御部18は、信号出力部14を制御して検査用信号Sを出力させる。この際に、スイッチ部15に連結されているフラットケーブルの各信号線、および各信号線に接続されている各プローブ21を介して、各導体パターンPに検査用信号Sが供給される。次いで、制御部18は、測定部16に対して測定処理を実行させる。この測定処理では、測定部16は、検査用信号Sの電圧値と、導体パターンPに対する検査用信号Sの供給によって導体パターンP間に流れる電流の電流値とに基づき、導体パターンP間の抵抗値を測定する。
Subsequently, the
続いて、制御部18は、測定部16によって測定された抵抗の測定値と記憶部17に記憶されている基準値とを比較して、各導体パターンP間の絶縁状態を検査する。この場合、制御部18は、測定値が基準値以上のときには、絶縁状態が良好と判定し、測定値が基準値未満のときには、絶縁状態が不良と判定する。次いで、制御部18は、検査結果(判定結果)を記憶部17に記憶させて、1回目の接続処理および絶縁検査を終了する。
Subsequently, the
続いて、制御部18は、2回目の接続処理を実行する。この2回目の接続処理では、制御部18は、スイッチ部15を制御して、図3に示すように、「3」、「4」、「5」、「6」、「9」、「10」、「11」および「12」の番号が付されている導体パターンPを第1グループとして設定して信号出力部14の低電位に接続すると共に、「1」、「2」、「7」、「8」、「13」、「14」、「15」および「16」の番号が付されている導体パターンPを第2グループとして設定して信号出力部14の高電位に接続する。以下、このグループ分けによる接続処理の形態をB形態(第2の形態に相当する)ともいう。
Subsequently, the
次いで、制御部18は、上記したように、信号出力部14を制御して検査用信号Sを出力させると共に、測定部16を制御して測定処理を実行させる。続いて、制御部18は、測定部16によって測定された測定値に基づく各導体パターンP間の絶縁検査を実行する。次いで、制御部18は、検査結果を記憶部17に記憶させて、2回目の接続処理および絶縁検査を終了する。
Next, as described above, the
続いて、制御部18は、3回目の接続処理を実行する。この3回目の接続処理では、制御部18は、スイッチ部15を制御して、図3に示すように、「1」、「2」、「3」、「4」、「10」、「11」、「15」および「16」の番号が付されている導体パターンPを第1グループとして設定して信号出力部14の低電位に接続すると共に、「5」、「6」、「7」、「8」、「9」、「12」、「13」および「14」の番号が付されている導体パターンPを第2グループとして設定して信号出力部14の高電位に接続する。以下、このグループ分けによる接続処理の形態をC形態(第3の形態に相当する)ともいう。
Subsequently, the
次いで、制御部18は、上記したように、信号出力部14を制御して検査用信号Sを出力させると共に、測定部16を制御して測定処理を実行させる。続いて、制御部18は、測定部16によって測定された測定値に基づく各導体パターンP間の絶縁検査を実行する。次いで、制御部18は、検査結果を記憶部17に記憶させて、3回目の接続処理および絶縁検査を終了する。
Next, as described above, the
続いて、制御部18は、4回目の接続処理を実行する。この4回目の接続処理では、制御部18は、スイッチ部15を制御して、図3に示すように、「2」、「3」、「4」、「5」、「6」、「7」、「14」および「15」の番号が付されている導体パターンPを第1グループとして設定して信号出力部14の低電位に接続すると共に、「1」、「8」、「9」、「10」、「11」、「12」、「13」および「16」の番号が付されている導体パターンPを第2グループとして設定して信号出力部14の高電位に接続する。以下、このグループ分けによる接続処理の形態をD形態(第4の形態に相当する)ともいう。
Subsequently, the
次いで、制御部18は、上記したように、信号出力部14を制御して検査用信号Sを出力させると共に、測定部16を制御して測定処理を実行させる。続いて、制御部18は、測定部16によって測定された測定値に基づく各導体パターンP間の絶縁検査を実行する。次いで、制御部18は、検査結果を記憶部17に記憶させて、4回目の接続処理および絶縁検査を終了する。このように、この回路基板検査装置1では、上記した4つの形態(A形態〜D形態)の各接続処理をA形態、B形態、C形態およびD形態の順番(予め決められた順番の一例)で1回ずつ実行し、各接続処理を実行する毎に絶縁検査を実行する。
Next, as described above, the
ここで、上記のように4回の接続処理を実行したときには、図3に示すように、隣り合う一対の導体パターンPのいずれか一方が低電位に接続され、他方が高電位に接続されている対(以下「異電位のペア」ともいう)の数(同図に示す「異電位ペア数」)が、1回目〜4回目の各接続処理においてそれぞれ「3」、「4」、「4」および「4」となり、4回の接続処理における異電位のペアの合計が「15」となる。 Here, when the connection process is executed four times as described above, as shown in FIG. 3, one of a pair of adjacent conductor patterns P is connected to a low potential and the other is connected to a high potential. The number of pairs (hereinafter also referred to as “different potential pairs”) (“different potential pair number” shown in the figure) is “3”, “4”, “4” in the first to fourth connection processes, respectively. And “4”, and the total of the pairs of different potentials in the four connection processes is “15”.
一方、従来の回路基板検査装置および回路基板検査方では、一般的に、第1グループおよび第2グループとして設定する導体パターンPのグループ分けを次のようにして行う。例えば、16個の導体パターンPについてグループ分けを行うときには、図10に示すように、1回目のグループ分けにおいて、各導体パターンPに「0000」〜「1111」までの16個の2進数の番号(10進数で「0」〜「15」にそれぞれ対応する番号)をそれぞれ付して、2進数の各番号における1桁目が「0」の番号が付された導体パターンP(10進数で「0」、「2」、「4」、「6」、「8」、「10」、「12」および「14」の各番号が付された導体パターンP)を第1グループとして設定し、これ以外の番号が付された導体パターンPを第2グループとして設定する。 On the other hand, in the conventional circuit board inspection apparatus and circuit board inspection method, the conductor patterns P set as the first group and the second group are generally grouped as follows. For example, when grouping 16 conductor patterns P, as shown in FIG. 10, in the first grouping, 16 binary numbers from “0000” to “1111” are assigned to each conductor pattern P. (Numbers corresponding to “0” to “15” in decimal numbers), respectively, and a conductor pattern P (in decimal numbers “0” in the first digit of each binary number) Conductor patterns P) numbered “0”, “2”, “4”, “6”, “8”, “10”, “12” and “14” are set as a first group, Conductor patterns P with numbers other than are set as the second group.
次いで、図10に示すように、2回目のグループ分けにおいて、2進数の各番号における2桁目が「0」の導体パターンP(10進数で「0」、「1」、「4」、「5」、「8」、「9」、「12」および「13」の各番号が付された導体パターンP)を第1グループとして設定し、これ以外の番号が付された導体パターンPを第2グループとして設定する。続いて、3回目のグループ分けにおいて、2進数の各番号における3桁目が「0」の導体パターンP(10進数で「0」、「1」、「2」、「3」、「8」、「9」、「10」および「11」の各番号が付された導体パターンP)を第1グループとして設定し、これ以外の番号が付された導体パターンPを第2グループとして設定する。 Next, as shown in FIG. 10, in the second grouping, the conductor pattern P in which the second digit of each binary number is “0” (decimal numbers “0”, “1”, “4”, “ Conductor patterns P) with numbers “5”, “8”, “9”, “12” and “13” are set as the first group, and conductor patterns P with other numbers are set as the first group. Set as 2 groups. Subsequently, in the third grouping, the conductor pattern P in which the third digit of each binary number is “0” (“0”, “1”, “2”, “3”, “8” in decimal) , “9”, “10” and “11” are set as the first group, and the conductor patterns P with other numbers are set as the second group.
次いで、4回目のグループ分けにおいて、2進数の各番号における4桁目が「0」の導体パターンP(10進数で「0」、「1」、「2」、「3」、「4」、「5」、「6」および「7」の各番号が付された導体パターンP)を第1グループとして設定し、これ以外の番号が付された導体パターンPを第2グループとして設定する。このような、従来の手法でのグループ分けによって4回目の接続処理を実行したときには、図10に示すように、異電位のペアの数が、1回目〜4回目の各接続処理においてそれぞれ「15」、「7」、「3」および「1」となり、4回の接続処理における異電位のペアの合計が「26」となる。このことから、この回路基板検査装置1および回路基板検査では、従来の構成および方法と比較して、4回の接続処理における異電位のペアの合計が十分に小さく、かつ各回の接続処理における異電位のペアの数が平均化していることが明らかである。
Next, in the fourth grouping, the conductor pattern P (in decimal numbers “0”, “1”, “2”, “3”, “4”, “0” in the fourth digit in each binary number) Conductor patterns P) with numbers “5”, “6”, and “7” are set as the first group, and conductor patterns P with other numbers are set as the second group. When the fourth connection process is executed by the grouping in the conventional method, the number of different potential pairs is “15” in each of the first to fourth connection processes as shown in FIG. ”,“ 7 ”,“ 3 ”, and“ 1 ”, and the total of the pairs of different potentials in the four connection processes is“ 26 ”. Therefore, in this circuit
この場合、異電位のペアの数が多いほど、検査用信号Sの供給の際にチャージされる浮遊容量(異電位のペアに検査用信号Sを供給する各信号線間の浮遊容量)が大きくなり、検査用信号Sの供給開始から浮遊容量がチャージされるまで待機する時間が長くなることに起因して検査効率が低下する。この回路基板検査装置1では、このような検査効率の低下の要因となるチャージされる浮遊容量、すなわち異電位のペアの数を、従来の構成および方法と比較して十分に少なくすることが可能となっている。
In this case, the larger the number of different potential pairs, the larger the stray capacitance charged when the test signal S is supplied (the stray capacitance between the signal lines supplying the test signal S to the different potential pair). As a result, the inspection efficiency is lowered due to the longer waiting time from the start of supply of the inspection signal S until the stray capacitance is charged. In this circuit
続いて、制御部18は、検査結果を図外の表示部に表示させる。以上により、回路基板100の各導体パターンPについてマルチプル方式による絶縁検査が終了する。
Subsequently, the
このように、この回路基板検査装置1および回路基板検査方法によれば、16個の導体パターンPについての接続処理を4回実行する際に、A形態での接続処理、B形態での接続処理、C形態での接続処理、およびD形態での接続処理を予め決められた順番としてのA形態、B形態、C形態およびD形態の順番で実行することにより、隣り合う一対の導体パターンPの一方が低電位に接続され他方が高電位に接続されている異電位のペアの数を、従来の構成および方法と比較して十分に少なくすることができる。したがって、この回路基板検査装置1および回路基板検査によれば、異電位のペアの数が少なくなる分、検査用信号Sの供給の際にチャージされる浮遊容量(異電位のペアに検査用信号Sを供給する各信号線間の浮遊容量)を小さくすることができるため、検査用信号Sの供給開始から浮遊容量がチャージされるまでの待機時間を十分に短くすることができる結果、検査効率を十分に向上することができる。
As described above, according to the circuit
なお、回路基板検査装置および回路基板検査方法は、上記した構成および方法に限定されない。例えば、上記した4つの形態(A形態〜D形態)での各接続処理をA形態、B形態、C形態およびD形態の順番で1回ずつ実行する例について上記したが、この順番は任意に変更することができる。この例では、図4,5に示すように、予め決められた順番として、上記した順番(図3参照)に加えて、23通りの順番(合計24通りの順番)でA形態〜D形態での接続処理を1回ずつ実行することができる。なお、図4,5では、1つの縦の列に1通りの順番を図示している。 The circuit board inspection apparatus and the circuit board inspection method are not limited to the configuration and method described above. For example, although the above-described example in which each connection process in the four forms (A form to D form) is executed once in the order of the A form, the B form, the C form, and the D form is described above, this order is arbitrary. Can be changed. In this example, as shown in FIGS. 4 and 5, in addition to the above-described order (see FIG. 3) as a predetermined order, there are 23 orders (total 24 orders) in A form to D form. The connection process can be executed once. 4 and 5, one order is shown in one vertical column.
また、第1グループとして設定した各導体パターンPを信号出力部14の低電位(低電位および高電位のいずれか一方の電位に相当する)に接続し、第2グループ分けとして設定した各導体パターンPを信号出力部14の高電位(低電位および高電位の他方の電位に相当する)に接続する構成および方法について上記したが、これとは逆に、第1グループとして設定した各導体パターンPを信号出力部14の高電位に接続し、第2グループ分けとして設定した各導体パターンPを信号出力部14の低電位に接続する構成および方法を採用することができる。
In addition, each conductor pattern P set as the first group is connected to the low potential (corresponding to one of the low potential and the high potential) of the
具体的には、この構成および方法では、1回目の接続処理において、図6に示すように、「1」、「2」、「3」、「6」、「7」、「8」、「9」および「10」の番号が付されている導体パターンPを第1グループとして設定して信号出力部14の高電位(低電位および高電位のいずれか一方の電位に相当する)に接続すると共に、他の番号が付されている導体パターンPを第2グループとして設定して信号出力部14の低電位(低電位および高電位の他方の電位に相当する)に接続する。以下、このグループ分けによる接続処理の形態をE形態(第1の形態に相当する)ともいう。また、2回目の接続処理において、「3」、「4」、「5」、「6」、「9」、「10」、「11」および「12」の番号が付されている導体パターンPを第1グループとして設定して信号出力部14の高電位に接続すると共に、他の番号が付されている導体パターンPを第2グループとして設定して信号出力部14の低電位に接続する。以下、このグループ分けによる接続処理の形態をF形態(第2の形態に相当する)ともいう。
Specifically, in this configuration and method, in the first connection process, as shown in FIG. 6, “1”, “2”, “3”, “6”, “7”, “8”, “8” Conductor patterns P numbered “9” and “10” are set as a first group and connected to a high potential (corresponding to one of a low potential and a high potential) of the
また、3回目の接続処理において、図6に示すように、「1」、「2」、「3」、「4」、「10」、「11」、「15」および「16」の番号が付されている導体パターンPを第1グループとして設定して信号出力部14の高電位に接続すると共に、他の番号が付されている導体パターンPを第2グループとして設定して信号出力部14の低電位に接続する。以下、このグループ分けによる接続処理の形態をG形態(第3の形態に相当する)ともいう。また、4回目の接続処理において、「2」、「3」、「4」、「5」、「6」、「7」、「14」および「15」の番号が付されている導体パターンPを第1グループとして設定して信号出力部14の高電位に接続すると共に、他の番号が付されている導体パターンPを第2グループとして設定して信号出力部14の低電位に接続する。以下、このグループ分けによる接続処理の形態をH形態(第4の形態に相当する)ともいう。
In the third connection process, numbers “1”, “2”, “3”, “4”, “10”, “11”, “15”, and “16” are assigned as shown in FIG. The assigned conductor pattern P is set as the first group and connected to the high potential of the
また、上記した4つの形態(E形態〜H形態)での各接続処理を実行する予め決められた順番として、上記した順番(図6参照)に加えて、図7,8に示す23通りの順番(合計24通りの順番)を採用することができる。なお、両図では、1つの縦の列に1通りの順番を図示している。 Moreover, in addition to the above-mentioned order (refer FIG. 6) as a predetermined order which performs each connection process by the above-mentioned four forms (E form-H form), 23 kinds shown in FIG. The order (a total of 24 orders) can be adopted. In both figures, one order is shown in one vertical column.
また、16個の導体パターンPを検査対象とする例(16個の導体パターンPを有する回路基板100を検査対象とする例)について上記したが、より多くの導体パターンPを検査対象とする場合においても、16個の導体パターンPに対する上記した各グループ分けによって接続処理を実行する手法を適用することができる。
Moreover, although it described above about the example which makes 16 conductor patterns P inspection object (example which makes
例えば、M個の一例としての32個の導体パターンPを検査対象とする場合には、図9に示す手順で、接続処理をN回としての5回(log232回)実行し、接続処理を実行する毎に絶縁検査を実行する。なお、この例において、32個の導体パターンPには「1」〜「32」の番号が付されているものとする。また、以下の説明において、上記した構成および方法と同じ構成要素については、同じ符号を付して、重複する説明を省略する。 For example, when 32 conductor patterns P as one example of M are to be inspected, the connection process is executed 5 times (log 2 32 times) as N times in the procedure shown in FIG. Insulation inspection is performed every time. In this example, 32 conductor patterns P are numbered “1” to “32”. Moreover, in the following description, the same code | symbol is attached | subjected about the same component as an above-described structure and method, and the overlapping description is abbreviate | omitted.
この例では、図9に示すように、1回目の接続処理において、「1」〜「16」までの番号が付されている導体パターンPについては、上記したA形態でのグループ分けによる接続処理を行う。また、1回目の接続処理において、「17」〜「32」までの番号が付されている導体パターンPについては、各番号から「16」を差し引いて、A形態でのグループ分けによる接続処理を行う。つまり、「17」、「18」、「19」、「22」、「23」、「24」、「25」および「26」の番号が付されている導体パターンPを第1グループとして設定して信号出力部14の低電位に接続すると共に、「20」、「21」、「27」、「28」、「29」、「30」、「31」および「32」の番号が付されている導体パターンPを第2グループとして設定して信号出力部14の高電位に接続する。以下、このグループ分けによる接続処理の形態をA’形態ともいう。
In this example, as shown in FIG. 9, in the first connection process, for the conductor pattern P numbered from “1” to “16”, the connection process by grouping in the above-described A form I do. Also, in the first connection process, for the conductor pattern P numbered “17” to “32”, “16” is subtracted from each number, and the connection process by grouping in the A form is performed. Do. That is, conductor patterns P numbered “17”, “18”, “19”, “22”, “23”, “24”, “25” and “26” are set as the first group. Connected to the low potential of the
また、図9に示すように、2回目の接続処理において、「1」〜「16」までの番号が付されている導体パターンPについては、上記したB形態でグループ分けによる接続処理を行い、「17」〜「32」までの番号が付されている導体パターンPについては、各番号から「16」を差し引いて、B形態でのグループ分けを適用したグループ分けによる接続処理を行う(以下、このグループ分けによる接続処理の形態をB’形態ともいう)。 In addition, as shown in FIG. 9, in the second connection process, for the conductor patterns P numbered from “1” to “16”, the connection process by grouping is performed in the above-described B form, For the conductor patterns P numbered “17” to “32”, “16” is subtracted from each number, and connection processing is performed by grouping to which grouping in the B form is applied (hereinafter, referred to as “B”). This form of connection processing by grouping is also referred to as B ′ form).
また、3回目の接続処理において、「1」〜「16」までの番号が付されている導体パターンPについては、上記したC形態でグループ分けによる接続処理を行い、「17」〜「32」までの番号が付されている導体パターンPについては、各番号から「16」を差し引いて、C形態でのグループ分けを適用したグループ分けによる接続処理を行う(以下、このグループ分けによる接続処理の形態をC’形態ともいう)。 In the third connection process, for the conductor patterns P numbered from “1” to “16”, the connection process by grouping is performed in the above-described C form, and “17” to “32”. For the conductor patterns P numbered up to, “16” is subtracted from each number, and connection processing is performed by grouping to which grouping in the C form is applied (hereinafter referred to as connection processing by this grouping). The form is also referred to as C ′ form).
さらに、4回目の接続処理において、「1」〜「16」までの番号が付されている導体パターンPについては、上記したD形態でグループ分けによる接続処理を行い、「17」〜「32」までの番号が付されている導体パターンPについては、各番号から「16」を差し引いて、D形態でのグループ分けを適用したグループ分けによる接続処理を行う(以下、このグループ分けによる接続処理の形態をD’形態ともいう)。 Further, in the fourth connection process, the conductor patterns P numbered from “1” to “16” are subjected to the connection process by grouping in the above-described D form, and “17” to “32”. For the conductor patterns P numbered up to, “16” is subtracted from each number, and connection processing by grouping to which grouping in the D form is applied (hereinafter referred to as connection processing by this grouping). The form is also referred to as D 'form).
また、図9に示すように、5回目の接続処理において、「1」〜「16」までの番号が付されている導体パターンPを第1グループとして設定して信号出力部14の低電位に接続すると共に、「17」〜「32」までの番号が付されている導体パターンPを第2グループとして設定して信号出力部14の高電位に接続する。
Further, as shown in FIG. 9, in the fifth connection process, the conductor patterns P numbered from “1” to “16” are set as the first group and the
上記したグループ分けによって5回の接続処理を実行したときには、図9に示すように、異電位のペアの数が、1回目〜5目の各接続処理においてそれぞれ「7」、「8」、「8」、「8」および「1」となり、5回の接続処理における異電位のペアの合計が「32」となる。これに対して、上記したように、各導体パターンPに付されている2進数の番号に基づいてグループ分けを行う従来の手法によって5回の接続処理を実行したときには、異電位のペアの数が、1回目〜5回目の各接続処理においてそれぞれ「31」、「15」、「7」、「3」および「1」となり、5回の接続処理における異電位のペアの合計が「57」となる。このことから、16個よりも多くの導体パターンPを検査対象とする場合においても、16個の導体パターンPに対する上記した各グループ分けによって接続処理を実行する手法を適用することで、従来の手法によって接続処理を実行する構成および方法と比較して、異電位のペアの合計が十分に小さくなり、これによって検査効率が十分に向上されることが明らかである。 When the connection process is executed five times by the above grouping, as shown in FIG. 9, the number of different potential pairs is “7”, “8”, “ 8 ”,“ 8 ”, and“ 1 ”, and the total of different potential pairs in the five connection processes is“ 32 ”. On the other hand, as described above, when the connection process is performed five times by the conventional method of performing grouping based on the binary number assigned to each conductor pattern P, the number of pairs of different potentials Becomes “31”, “15”, “7”, “3”, and “1” in the first to fifth connection processes, respectively, and the sum of the pairs of different potentials in the five connection processes is “57”. It becomes. Therefore, even when more than 16 conductor patterns P are to be inspected, the conventional technique can be applied by applying the method of executing the connection process by the above grouping for the 16 conductor patterns P. It is clear that the total of different potential pairs is sufficiently small as compared with the configuration and method in which the connection process is performed by this, thereby sufficiently improving the inspection efficiency.
1 回路基板検査装置
12 プローブユニット
14 信号出力部
15 スイッチ部
16 測定部
18 制御部
21 プローブ
100 回路基板
P1〜P16 導体パターン
S 検査用信号
DESCRIPTION OF
Claims (2)
前記制御部は、前記M個としての16個の前記導体パターンについての前記接続処理を前記N回としての4回実行して前記絶縁検査を行う際に、当該各導体パターンに1から16の番号が付されているとしたときに、1、2、3、6、7、8、9および10の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に4、5、11、12、13、14、15および16の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第1形態での前記接続処理、3、4、5、6、9、10、11および12の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に1、2、7、8、13、14、15および16の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第2形態での前記接続処理、1、2、3、4、10、11、15および16の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に5、6、7、8、9、12、13および14の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第3形態での前記接続処理、並びに2、3、4、5、6、7、14および15の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に1、8、9、10、11、12、13および16の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第4形態での前記接続処理を予め決められた順番で実行する回路基板検査装置。 A signal output unit that outputs an inspection signal, a switch unit that connects and disconnects the conductor pattern of the circuit board and the low potential and high potential of the signal output unit, and M switches to be inspected by controlling the switch unit ( (M is an integer of 3 or more) part of the conductor patterns is set as a first group, and the conductor pattern of the first group is connected to one of the low potential and the high potential And all the conductor patterns other than the first group of conductor patterns among the M conductor patterns are set as the second group, and the second group of conductor patterns is set to the low potential and the high potential. while the connection process of connecting to the other potential to change the combination of the conductor pattern for setting each as the two groups N times (N is a by (log 2 M) or And (log 2 M) to the nearest whole number) control unit for executing said a circuit board inspection apparatus comprising an inspection unit for performing each time the connection process the insulation test between the conductor patterns is performed,
When the control unit performs the insulation inspection by performing the connection process for the 16 conductor patterns as the M times four times as the N times, a number from 1 to 16 is assigned to each conductor pattern. Is set as the first group, and the potential of either one of the conductor patterns numbered 1, 2, 3, 6, 7, 8, 9 and 10 is set as the first group. And the conductor patterns numbered 4, 5, 11, 12, 13, 14, 15 and 16 are set as a second group and connected to the other potential. The connection patterns 3, 4, 5, 6, 9, 10, 11, and 12 are set as the first group and connected to one of the potentials, and 1, 2 , 7, 8, 13, 1 , 15 and 16 are set as a second group and connected to the other potential, the connection processing in the second form, 1, 2, 3, 4, 10, 11, The conductor patterns numbered 15 and 16 are set as the first group and connected to any one of the potentials, and numbers 5, 6, 7, 8, 9, 12, 13 and 14 are assigned. The connection process in the third mode in which the attached conductor pattern is set as the second group and connected to the other potential, and the numbers 2, 3, 4, 5, 6, 7, 14 and 15 are The conductor patterns set as the first group and connected to any one of the potentials and numbered 1, 8, 9, 10, 11, 12, 13 and 16 Pattern The connection processing circuit board inspection apparatus for performing in a predetermined order of the fourth mode of connecting set as 2 group to the other potential.
前記M個としての16個の前記導体パターンについての前記接続処理を前記N回としての4回実行して前記絶縁検査を行う際に、当該各導体パターンに1から16の番号が付されているとしたときに、1、2、3、6、7、8、9および10の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に4、5、11、12、13、14、15および16の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第1形態での前記接続処理、3、4、5、6、9、10、11および12の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に1、2、7、8、13、14、15および16の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第2形態での前記接続処理、1、2、3、4、10、11、15および16の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に5、6、7、8、9、12、13および14の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第3形態での前記接続処理、並びに2、3、4、5、6、7、14および15の番号が付されている前記導体パターンを前記第1グループとして設定して前記いずれか一方の電位に接続すると共に1、8、9、10、11、12、13および16の番号が付されている前記導体パターンを第2グループとして設定して前記他方の電位に接続する第4形態での前記接続処理を予め決められた順番で実行する回路基板検査方法。 A signal for setting a part of the M conductor patterns to be inspected on the circuit board (M is an integer of 3 or more) as a first group and outputting a test signal for the first group of conductor patterns. Connect to one of the low potential and high potential of the output unit and set all the other conductor patterns except the first group of the M conductor patterns as the second group. N times (N is (log 2 M) while changing the combination of the conductor patterns for setting the connection processing for connecting the second group of conductor patterns to the other of the low potential and the high potential as the two groups, respectively. ) Which is the above and is the closest integer to (log 2 M)), and a circuit base for performing an insulation test between the conductor patterns every time the connection process is executed. A board inspection method,
When the insulation test is performed by performing the connection process for the 16 conductor patterns as the M times four times as the N times, numbers 1 to 16 are assigned to the conductor patterns. , The conductor patterns numbered 1, 2, 3, 6, 7, 8, 9 and 10 are set as the first group and connected to any one of the potentials. The connection process in the first mode in which the conductor patterns numbered 5, 11, 12, 13, 14, 15, and 16 are set as a second group and connected to the other potential, 3, The conductor patterns numbered 4, 5, 6, 9, 10, 11 and 12 are set as the first group and connected to any one of the potentials, and 1, 2, 7, 8, 13, 14, 15 and 6, 1, 2, 3, 4, 10, 11, 15 and 16 in the second form in which the conductor pattern numbered 6 is set as a second group and connected to the other potential. The conductor patterns numbered are set as the first group and connected to any one of the potentials, and numbers 5, 6, 7, 8, 9, 12, 13 and 14 are numbered. The connection process in the third mode in which the conductor pattern is set as a second group and connected to the other potential, and numbers 2, 3, 4, 5, 6, 7, 14 and 15 are attached. The conductor patterns are set as the first group and connected to one of the potentials, and the conductor patterns numbered 1, 8, 9, 10, 11, 12, 13 and 16 are connected to the first group. With 2 groups Circuit board inspection method for executing by the connection processing predetermined order of the fourth mode of connection is set to the other potential Te.
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