JP2011091251A - Nitride semiconductor light-emitting device - Google Patents

Nitride semiconductor light-emitting device Download PDF

Info

Publication number
JP2011091251A
JP2011091251A JP2009244422A JP2009244422A JP2011091251A JP 2011091251 A JP2011091251 A JP 2011091251A JP 2009244422 A JP2009244422 A JP 2009244422A JP 2009244422 A JP2009244422 A JP 2009244422A JP 2011091251 A JP2011091251 A JP 2011091251A
Authority
JP
Japan
Prior art keywords
nitride semiconductor
layer
semiconductor layer
recess
substrate
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2009244422A
Other languages
Japanese (ja)
Inventor
Wataru Kuribayashi
渉 栗林
Tsuyoshi Hirao
剛 平尾
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Nichia Corp
Original Assignee
Nichia Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nichia Corp filed Critical Nichia Corp
Priority to JP2009244422A priority Critical patent/JP2011091251A/en
Publication of JP2011091251A publication Critical patent/JP2011091251A/en
Pending legal-status Critical Current

Links

Images

Landscapes

  • Semiconductor Lasers (AREA)
  • Led Devices (AREA)

Abstract

<P>PROBLEM TO BE SOLVED: To reduce the stress applied to a nitride semiconductor layer from a substrate, and to improve the planarity of the nitride semiconductor layer and reduce the generation of cracks, in a nitride semiconductor light-emitting device in which the nitride semiconductor layer is laminated on a nitride semiconductor substrate. <P>SOLUTION: A first recess part 11, having a stripe-shaped aperture, is provided on a surface 10a of a substrate 10 constituted of a nitride semiconductor, and further, a second recess part 13, having an aperture and depth smaller than the first recess part 11, is provided on the entire surface 10a of the substrate 10, including the base of the first recess part 11. Furthermore, the second recess part 13 is planarized in a first semiconductor layer 30 on the lower layer side of a second semiconductor layer 40 having an active layer, as well as, a nitride semiconductor layer 20, constituted of the first semiconductor layer 30 and the second semiconductor layer 40, is layered on the surface 10a of the substrate 10 so that a recess part 41 is formed at a location corresponding to the recess part 11 on an upper-end face of the second semiconductor layer 40. <P>COPYRIGHT: (C)2011,JPO&INPIT

Description

本発明は、レーザ素子や発光ダイオード素子などに用いられる窒化物半導体発光素子に関する。   The present invention relates to a nitride semiconductor light emitting device used for a laser device, a light emitting diode device, or the like.

窒化物半導体発光素子は、Blu−ray(登録商標)などの光ディスク装置の光源やディスプレイ用光源、その他にも露光用光源としての用途が期待されている。
窒化物半導体発光素子は、窒化物半導体基板を成長基板として用い、その表面に窒化物半導体層を積層して製造される。
一般に、窒化物半導体発光素子は、製造上の歩留まりが低いことが問題となっている。その理由の一つが、窒化物半導体基板の格子定数とその表面に積層される窒化物半導体層の格子定数とが完全に一致しないため、あるいは窒化物半導体基板中の転位欠陥による結晶の歪みのため、窒化物半導体層に引っ張り歪みが生じて、窒化物半導体層内にクラックが生じることである。特に窒化物半導体層にアルミニウム(Al)の組成比率の高い混晶を用いる場合や、Alの組成比率が低くとも、多層で形成している場合には、クラックがより発生しやすくなる。
このような問題を解消するために、特許文献1(段落0016〜段落0019、図1参照)には、窒化物半導体基板の転位集中領域(高転位密度領域)を含む領域に帯状の溝を形成し、その窒化物半導体基板の表面に窒化物半導体層を積層することで、窒化物半導体基板と窒化物半導体層との格子定数の違い及び窒化物半導体基板の転位によって生じる引っ張り歪によって基板から窒化物半導体層にかかる応力を緩和し、クラックの発生を低減する窒化物半導体発光素子が記載されている。
Nitride semiconductor light emitting devices are expected to be used as light sources for optical disc devices such as Blu-ray (registered trademark), light sources for displays, and other light sources for exposure.
A nitride semiconductor light emitting device is manufactured by using a nitride semiconductor substrate as a growth substrate and laminating a nitride semiconductor layer on the surface thereof.
In general, nitride semiconductor light-emitting devices have a problem of low manufacturing yield. One of the reasons is that the lattice constant of the nitride semiconductor substrate and the lattice constant of the nitride semiconductor layer stacked on the surface do not completely match, or because of crystal distortion due to dislocation defects in the nitride semiconductor substrate. In other words, tensile strain is generated in the nitride semiconductor layer, and cracks are generated in the nitride semiconductor layer. In particular, when a mixed crystal having a high aluminum (Al) composition ratio is used for the nitride semiconductor layer, or even when the Al composition ratio is low, cracks are more likely to occur.
In order to solve such a problem, in Patent Document 1 (see paragraphs 0016 to 0019 and FIG. 1), a band-like groove is formed in a region including a dislocation concentration region (high dislocation density region) of a nitride semiconductor substrate. By stacking a nitride semiconductor layer on the surface of the nitride semiconductor substrate, the nitride semiconductor substrate is nitrided due to the difference in lattice constant between the nitride semiconductor substrate and the nitride semiconductor layer and tensile strain caused by dislocation of the nitride semiconductor substrate. A nitride semiconductor light emitting device is described that relieves stress applied to a nitride semiconductor layer and reduces the occurrence of cracks.

また、特許文献2(段落0021〜段落0024、図3参照)には、サファイアなどの基板の表面に多重パターン構造を形成し、その上に窒化物化合物半導体を成長させた半導体発光素子が記載されている。   Patent Document 2 (see paragraphs 0021 to 0024 and FIG. 3) describes a semiconductor light emitting device in which a multiple pattern structure is formed on the surface of a substrate such as sapphire and a nitride compound semiconductor is grown thereon. ing.

特開2005−294416号公報JP 2005-294416 A 特開2007−311784号公報JP 2007-31784 A

特許文献1では、窒化物半導体基板の高転位密度領域を含む領域に溝を形成することによって、窒化物半導体基板上に積層される窒化物半導体層にかかる応力を緩和することができるが、窒化物半導体基板に設けた溝のエッジ部において、窒化物半導体層が盛り上がるエッジグロースが発生する。   In Patent Document 1, by forming a groove in a region including a high dislocation density region of a nitride semiconductor substrate, stress applied to the nitride semiconductor layer stacked on the nitride semiconductor substrate can be reduced. Edge growth in which the nitride semiconductor layer rises occurs at the edge portion of the groove provided in the semiconductor substrate.

ここで、図10を参照してエッジグロースについて説明する。図10は、従来例における窒化物半導体基板上に窒化物半導体層を積層した状態の様子を示す模式的断面図である。
図10に示すように、高転位密度領域210Hに沿って、図10の紙面垂直方向に延伸する帯状の溝211が配設された従来例における窒化物半導体基板210を用いて、その表面に窒化物半導体層220を積層した場合、溝211のエッジ部213の上方において、窒化物半導体が盛り上がって積層されるエッジグロース221が発生する。
このようなエッジグロース221が生じると、クラックの発生を十分に抑制することができない。また、エッジグロース221が生じると、窒化物半導体層の加工工程において、窒化物半導体層に形成されるレジストの膜厚が不均一になりやすいため、十分なエッチングの加工精度が得られない。これらの不具合のため、窒化物半導体発光素子の安定した製造歩留まりが望めないこととなる。
Here, edge growth will be described with reference to FIG. FIG. 10 is a schematic cross-sectional view showing a state in which a nitride semiconductor layer is stacked on a nitride semiconductor substrate in a conventional example.
As shown in FIG. 10, a nitride semiconductor substrate 210 in the conventional example in which a strip-like groove 211 extending in the direction perpendicular to the paper surface of FIG. 10 is provided along the high dislocation density region 210H is nitrided on the surface thereof. When the physical semiconductor layer 220 is stacked, an edge growth 221 in which the nitride semiconductor is raised and stacked is generated above the edge portion 213 of the groove 211.
When such edge growth 221 occurs, the generation of cracks cannot be sufficiently suppressed. Further, when the edge growth 221 occurs, the film thickness of the resist formed on the nitride semiconductor layer is likely to be non-uniform in the nitride semiconductor layer processing step, so that sufficient etching processing accuracy cannot be obtained. Due to these problems, a stable manufacturing yield of the nitride semiconductor light emitting device cannot be expected.

なお、特許文献2における半導体発光素子の基板上に形成される多重パターン構造は、活性層で発光した光を効率的に半導体発光素子の外部に取り出すためのものであり、窒化物半導体発光素子の窒化物半導体層におけるクラックやエッジグロースの発生を低減し、信頼性や製造歩留まりを向上することを目的とするものではない。   Note that the multiple pattern structure formed on the substrate of the semiconductor light emitting device in Patent Document 2 is for efficiently extracting light emitted from the active layer to the outside of the semiconductor light emitting device. It is not intended to reduce the occurrence of cracks and edge growth in the nitride semiconductor layer, and to improve reliability and manufacturing yield.

本発明は、かかる問題に鑑みてなされたものであり、本発明の課題は、窒化物半導体層におけるクラックやエッジグロースの発生を低減し、信頼性の高い窒化物半導体発光素子及びその歩留まりの高い製造方法を提供することである。   The present invention has been made in view of such problems, and an object of the present invention is to reduce the occurrence of cracks and edge growth in the nitride semiconductor layer, and to provide a highly reliable nitride semiconductor light emitting device and a high yield thereof. It is to provide a manufacturing method.

前記した課題を達成するために、請求項1に記載の窒化物半導体発光素子は、窒化物半導体からなる基板と基板の表面に積層された窒化物半導体層とを備えた窒化物半導体発光素子であって、基板の表面に形成された帯状の第1凹部と、第1凹部の底面及び第1凹部以外の基板の表面である凸部に形成された複数の第2凹部とを有し、窒化物半導体層は第1半導体層と少なくとも活性層を有する第2半導体層とを有し、第1半導体層は、その上端面において、第1凹部に対応する位置に凹部が形成されるように積層して構成した。   In order to achieve the above object, a nitride semiconductor light emitting device according to claim 1 is a nitride semiconductor light emitting device including a substrate made of a nitride semiconductor and a nitride semiconductor layer stacked on the surface of the substrate. A first recess in the shape of a band formed on the surface of the substrate, and a plurality of second recesses formed on the bottom surface of the first recess and the protrusions that are the surface of the substrate other than the first recess, and nitriding The physical semiconductor layer has a first semiconductor layer and a second semiconductor layer having at least an active layer, and the first semiconductor layer is laminated so that a recess is formed at a position corresponding to the first recess on the upper end surface thereof. And configured.

かかる構成によれば、窒化物半導体発光素子は、第1凹部を設けた基板上に積層した窒化物半導体層によって構成されるため、基板と窒化物半導体層の下層部である第1半導体層との間の格子定数の違いによる歪みが第1凹部により分断されることで、基板から凸部の上方領域における第1半導体層にかかる応力が緩和される。
また、第2凹部を設けることにより、第1半導体層の横方向成長が促進され、エッジグロースの盛り上がりとなる窒化物半導体の縦方向成長が抑制されるため、エッジグロースの発生が低減される。
更にまた、活性層は、基板からかかる応力が緩和された第1半導体層上に形成されるため、窒化物半導体発光素子は安定した発光動作をする。
また、第1凹部及び第2凹部は、基板への漏れ光を散乱させるため、窒化物半導体発光素子内の垂直方向の迷光が低減される。
According to such a configuration, the nitride semiconductor light-emitting element is configured by the nitride semiconductor layer stacked on the substrate provided with the first recess, and thus the substrate and the first semiconductor layer which is the lower layer portion of the nitride semiconductor layer, The strain applied to the first semiconductor layer in the region above the convex portion is relaxed by dividing the distortion due to the difference in lattice constant between the first concave portion and the first concave portion.
In addition, by providing the second recess, the lateral growth of the first semiconductor layer is promoted, and the vertical growth of the nitride semiconductor that causes the edge growth is suppressed, so that the occurrence of edge growth is reduced.
Furthermore, since the active layer is formed on the first semiconductor layer in which the stress applied from the substrate is relieved, the nitride semiconductor light emitting element performs a stable light emitting operation.
Moreover, since the 1st recessed part and the 2nd recessed part scatter the leakage light to a board | substrate, the stray light of the orthogonal | vertical direction in a nitride semiconductor light-emitting device is reduced.

請求項2に記載の窒化物半導体発光素子は、請求項1に記載の窒化物半導体発光素子において、第1半導体層は、窒化物半導体の複数の層からなるように構成した。   The nitride semiconductor light emitting device according to claim 2 is configured such that the first semiconductor layer is composed of a plurality of layers of nitride semiconductors in the nitride semiconductor light emitting device according to claim 1.

かかる構成によれば、第1凹部及び第2凹部が形成された基板上に、複数の層として窒化物半導体が積層される。
これによって、第1半導体層が従来はクラックの発生しやすい多層構成でありながら、効果的に基板から第1半導体層にかかる応力が緩和され、クラックの発生が低減される。
According to this configuration, the nitride semiconductor is stacked as a plurality of layers on the substrate on which the first recess and the second recess are formed.
Thereby, although the first semiconductor layer conventionally has a multi-layer structure in which cracks are likely to occur, the stress applied from the substrate to the first semiconductor layer is effectively relieved, and the occurrence of cracks is reduced.

請求項3に記載の窒化物半導体発光素子は、請求項1又は請求項2に記載の窒化物半導体発光素子において、凸部の上方領域における第1半導体層の上端面は平坦化されるように構成した。   The nitride semiconductor light emitting device according to claim 3 is the nitride semiconductor light emitting device according to claim 1 or 2, wherein the upper end surface of the first semiconductor layer in the upper region of the convex portion is flattened. Configured.

かかる構成によれば、窒化物半導体発光素子は、窒化物半導体層の下層部である第1半導体層によって第2凹部が埋め込まれ、第1半導体層の上端面において第2凹部による凹凸が平坦化されるように、第1半導体層が基板の表面に積層される。このため、活性層は、第2凹部が埋め込まれて平坦化された平坦面上に形成される。
これによって、活性層は、面内における発光モードの均一性がよく、均一な強度及び波長で発光する。
According to this configuration, in the nitride semiconductor light emitting device, the second recess is embedded by the first semiconductor layer which is the lower layer of the nitride semiconductor layer, and the unevenness due to the second recess is flattened on the upper end surface of the first semiconductor layer. As described above, the first semiconductor layer is stacked on the surface of the substrate. Therefore, the active layer is formed on a flat surface that is flattened by embedding the second recess.
Thereby, the active layer has good uniformity of the emission mode in the plane, and emits light with uniform intensity and wavelength.

請求項4に記載の窒化物半導体発光素子は、請求項1乃至請求項3の何れか一項に記載の窒化物半導体発光素子において、第2凹部は、帯状の第1凹部の延伸方向と平行して延伸する開口を有するように構成した。   The nitride semiconductor light-emitting device according to claim 4 is the nitride semiconductor light-emitting device according to any one of claims 1 to 3, wherein the second recess is parallel to the extending direction of the band-shaped first recess. And an opening that extends.

かかる構成によれば、窒化物半導体層の積層時に、窒化物半導体が帯状の第1凹部のエッジ部においてエッジグロースの盛り上がりとなる窒化物半導体層の縦方向成長を、第1凹部のエッジ部に沿って延伸する帯状の第2凹部への横方向成長で効果的に抑制され、エッジグロースの発生が効果的に低減される。   According to this configuration, when the nitride semiconductor layer is stacked, the nitride semiconductor layer grows in the edge direction of the first recess, and the nitride semiconductor grows in the edge growth of the band-shaped first recess. The lateral growth to the belt-like second recess extending along the direction is effectively suppressed, and the occurrence of edge growth is effectively reduced.

請求項5に記載の窒化物半導体発光素子は、請求項1乃至請求項3の何れか一項に記載の窒化物半導体発光素子において、複数の第2凹部は、特定方向に延伸せずに断続する開口を有するように構成した。   The nitride semiconductor light emitting device according to claim 5 is the nitride semiconductor light emitting device according to any one of claims 1 to 3, wherein the plurality of second recesses are intermittent without extending in a specific direction. It comprised so that it might have an opening.

かかる構成によれば、窒化物半導体層の積層時に、窒化物半導体が第1凹部のエッジ部においてエッジグロースの盛り上がりとなる窒化物半導体層の縦方向成長を、断続的に設けられた第2凹部への横方向成長で抑制され、エッジグロースの発生が効果的に低減される。   According to such a configuration, when the nitride semiconductor layer is stacked, the second recess is provided with intermittent growth of the nitride semiconductor layer in which the nitride semiconductor grows at the edge of the first recess. The occurrence of edge growth can be effectively reduced by the lateral growth.

請求項6に記載の窒化物半導体発光素子は、請求項1乃至請求項5の何れか一項に記載の窒化物半導体発光素子において、基板は、相対的に転位欠陥密度が高い高転位密度領域と、高転位密度領域よりも転位欠陥密度が低い低転位密度領域とを有し、高転位密度領域を有する領域に第1凹部を設けるように構成した。   The nitride semiconductor light emitting device according to claim 6 is the nitride semiconductor light emitting device according to any one of claims 1 to 5, wherein the substrate has a high dislocation density region having a relatively high dislocation defect density. And a low dislocation density region having a dislocation defect density lower than that of the high dislocation density region, and the first recess is provided in the region having the high dislocation density region.

かかる構成によれば、基板の凸部は、高転位密度領域を含む第1凹部以外の低転位密度領域に形成される。このため、窒化物半導体層の積層時に、基板と窒化物半導体層との間の格子定数の違いによる歪みが第1凹部に積層される窒化物半導体に蓄積されるとともに、高転位密度領域の転位欠陥の影響が第1凹部内に止められる。
これによって、窒化物半導体層の積層時に生じる歪みや転位欠陥による影響が基板の凸部の上方領域に積層される窒化物半導体層に波及することが防止される。
According to this configuration, the convex portion of the substrate is formed in the low dislocation density region other than the first concave portion including the high dislocation density region. Therefore, when the nitride semiconductor layer is stacked, strain due to the difference in lattice constant between the substrate and the nitride semiconductor layer is accumulated in the nitride semiconductor stacked in the first recess, and the dislocations in the high dislocation density region The influence of the defect is stopped in the first recess.
As a result, it is possible to prevent the influence caused by strain and dislocation defects generated when the nitride semiconductor layers are stacked from spreading to the nitride semiconductor layer stacked in the region above the convex portion of the substrate.

請求項7に記載の窒化物半導体発光素子は、請求項1乃至請求項6の何れか一項に記載の窒化物半導体発光素子において、基板の表面は窒化物半導体のC面であり、帯状の第1凹部の延伸方向は窒化物半導体のM面に垂直であるように構成した。   The nitride semiconductor light emitting device according to claim 7 is the nitride semiconductor light emitting device according to any one of claims 1 to 6, wherein the surface of the substrate is a C plane of the nitride semiconductor, The extending direction of the first recess was configured to be perpendicular to the M-plane of the nitride semiconductor.

かかる構成によれば、帯状の第1凹部の壁面はM面と直交するA面で形成され、M面は露出されない。M面の露出がないため、第1凹部の壁面からのクラックの発生が低減される。また、窒化物半導体発光素子をレーザ素子構造とした場合は、レーザ発振のための共振器端面をM面の劈開によって形成することができるため、共振器は、高精度に形成された共振器端面を用いてレーザ発振する。   According to such a configuration, the wall surface of the belt-shaped first recess is formed by the A plane orthogonal to the M plane, and the M plane is not exposed. Since there is no exposure of the M surface, the occurrence of cracks from the wall surface of the first recess is reduced. Further, when the nitride semiconductor light emitting element has a laser element structure, the resonator end face for laser oscillation can be formed by cleaving the M plane. Laser oscillation using

請求項8に記載の窒化物半導体発光素子は、請求項7に記載の窒化物半導体発光素子において、第2凹部の壁面は、窒化物半導体のM面に平行でない面からなるように構成した。   The nitride semiconductor light emitting device according to claim 8 is the nitride semiconductor light emitting device according to claim 7, wherein the wall surface of the second recess is formed of a surface not parallel to the M-plane of the nitride semiconductor.

かかる構成によれば、M面が露出しないように第2凹部を設けたため、第2凹部の壁面からのクラックの発生が防止される。   According to such a configuration, since the second recess is provided so that the M surface is not exposed, generation of cracks from the wall surface of the second recess is prevented.

請求項9に記載の窒化物半導体発光素子は、請求項1乃至請求項8の何れか一項に記載の窒化物半導体発光素子において、第1半導体層は、Alを含有する窒化物半導体を含む構成とした。   The nitride semiconductor light emitting device according to claim 9 is the nitride semiconductor light emitting device according to any one of claims 1 to 8, wherein the first semiconductor layer includes a nitride semiconductor containing Al. The configuration.

かかる構成によれば、第1半導体層が、基板として通常用いられる窒化物半導体との格子定数の差が大きいAlを含有する窒化物半導体を含んでいながら、第1凹部のエッジ部におけるエッジグロースの発生を抑えつつ、基板から第1半導体層にかかる応力を緩和する。   According to this configuration, the first semiconductor layer includes the nitride semiconductor containing Al having a large lattice constant difference from the nitride semiconductor normally used as the substrate, and the edge growth at the edge portion of the first recess is performed. The stress applied from the substrate to the first semiconductor layer is relaxed while suppressing the occurrence of.

請求項10に記載の窒化物半導体発光素子は、請求項9に記載の窒化物半導体発光素子において、第2凹部は、第1半導体層のAlを含有する窒化物半導体によって埋め込まれているように構成した。   The nitride semiconductor light emitting device according to claim 10 is the nitride semiconductor light emitting device according to claim 9, wherein the second recess is embedded by a nitride semiconductor containing Al of the first semiconductor layer. Configured.

かかる構成によれば、基板として通常用いられる窒化物半導体との格子定数の差が大きいAlを含有する窒化物半導体からなる層が、第2凹部を埋め込むように成長して積層される。
これによって、基板との格子定数の差に基づく歪みによって、この層に基板からかかる応力が効果的に緩和される。
According to such a configuration, a layer made of a nitride semiconductor containing Al having a large lattice constant difference from a nitride semiconductor normally used as a substrate is grown and stacked so as to fill the second recess.
This effectively relieves the stress on the layer from the substrate due to strain based on the difference in lattice constant from the substrate.

請求項11に記載の窒化物半導体発光素子は、請求項1乃至請求項10の何れか一項に記載の窒化物半導体発光素子において、第2半導体層は、その上端面において、第1凹部に対応する位置に凹部が形成されるように積層して構成した。   The nitride semiconductor light-emitting device according to claim 11 is the nitride semiconductor light-emitting device according to any one of claims 1 to 10, wherein the second semiconductor layer is formed in the first recess at the upper end surface thereof. The layers were laminated so that the concave portions were formed at the corresponding positions.

かかる構成によれば、第2半導体層は、第1凹部に対応する位置に凹部が形成された第1半導体層上に積層した窒化物半導体層によって構成されるため、第1半導体層と第2半導体層との間の格子定数の違いによる歪みが、第1半導体層の第1凹部に対応する位置に形成された凹部により分断されることで、第1半導体層から、及び第1半導体層を介して基板から凸部の上方領域における第2半導体層にかかる応力を緩和する。   According to such a configuration, the second semiconductor layer includes the nitride semiconductor layer stacked on the first semiconductor layer in which the recess is formed at a position corresponding to the first recess. Distortion due to the difference in lattice constant between the semiconductor layer and the first semiconductor layer is divided by a recess formed at a position corresponding to the first recess of the first semiconductor layer, so that the first semiconductor layer and the first semiconductor layer are separated from each other. The stress applied to the second semiconductor layer in the region above the convex portion from the substrate is relaxed.

請求項12に記載の窒化物半導体発光素子は、請求項11に記載の窒化物半導体発光素子において、窒化物半導体発光素子は、第2半導体層の上端面に形成される凹部に沿って分割して構成した。   The nitride semiconductor light emitting device according to claim 12 is the nitride semiconductor light emitting device according to claim 11, wherein the nitride semiconductor light emitting device is divided along a recess formed in an upper end surface of the second semiconductor layer. Configured.

かかる構成によれば、窒化物半導体発光素子は、第2半導体層の上端面に形成される凹部、すなわち、第1凹部に沿って分割される。窒化物半導体層に形成される第1凹部に基づく凹部が窒化物半導体発光素子チップの切り代となるため、チップ内の活性層は第1凹部による凹凸の影響を受けない領域に設けられることになる。これによって窒化物半導体発光素子は、発光モードの均一性がよく、均一な強度及び波長で発光する。   According to this configuration, the nitride semiconductor light emitting element is divided along the recess formed in the upper end surface of the second semiconductor layer, that is, along the first recess. Since the concave portion based on the first concave portion formed in the nitride semiconductor layer serves as a cutting allowance for the nitride semiconductor light emitting device chip, the active layer in the chip is provided in a region not affected by the concave and convex portions by the first concave portion. Become. As a result, the nitride semiconductor light emitting device has good emission mode uniformity and emits light with uniform intensity and wavelength.

請求項13に記載の窒化物半導体発光素子は、請求項1乃至請求項12の何れか一項に記載の窒化物半導体発光素子において、第2半導体層は、凸部の上方領域にレーザ発振のための共振器を有する構成とした。   The nitride semiconductor light emitting device according to claim 13 is the nitride semiconductor light emitting device according to any one of claims 1 to 12, wherein the second semiconductor layer emits laser light in a region above the convex portion. For this reason, a resonator is provided.

かかる構成によれば、窒化物半導体発光素子はレーザ素子構造であって、第1凹部に基づく窒化物半導体層の凹部を避けた領域に共振器を設ける。これによって、窒化物半導体発光素子は、安定した強度及び波長でレーザ発振する。   According to this configuration, the nitride semiconductor light emitting element has a laser element structure, and the resonator is provided in a region avoiding the recess of the nitride semiconductor layer based on the first recess. As a result, the nitride semiconductor light emitting device oscillates with a stable intensity and wavelength.

請求項1に記載の発明によれば、基板から窒化物半導体層にかかる応力が緩和されるため、窒化物半導体層におけるクラックの発生が低減され、その結果としてクラックの発生による窒化物半導体発光素子の突然の機能喪失などを防ぐことができ、信頼性の高い窒化物半導体発光素子が得られる。また、エッジグロースの発生が低減されるため、窒化物半導体層上部に作製するデバイスの加工精度が向上し、安定した品質の窒化物半導体発光素子が得られる。更に、活性層からの発光の強度及び波長の均一性が良好な、安定した品質の窒化物半導体発光素子が得られる。また、迷光が低減されるため、活性層からの発光の強度及び波長の均一性を向上することができる。また、クラックに対する臨界膜厚を大きくできるため、窒化物半導体層の膜厚を増加し、又はAl組成率の高い窒化物半導体を用いることができる。   According to the first aspect of the present invention, since the stress applied to the nitride semiconductor layer from the substrate is relieved, the occurrence of cracks in the nitride semiconductor layer is reduced, and as a result, the nitride semiconductor light-emitting device due to the occurrence of cracks Therefore, a highly reliable nitride semiconductor light emitting device can be obtained. Further, since the occurrence of edge growth is reduced, the processing accuracy of a device fabricated on the nitride semiconductor layer is improved, and a nitride semiconductor light emitting element with stable quality can be obtained. Furthermore, a stable quality nitride semiconductor light-emitting device having good light emission intensity and wavelength uniformity from the active layer can be obtained. Further, since stray light is reduced, the intensity of light emitted from the active layer and the uniformity of wavelength can be improved. Moreover, since the critical film thickness with respect to cracks can be increased, the film thickness of the nitride semiconductor layer can be increased, or a nitride semiconductor having a high Al composition ratio can be used.

請求項2に記載の発明によれば、第1半導体層を複数の層によって構成しながらも、クラックの発生が低減されるため、材料などの自由度が高い構成の窒化物半導体発光素子が得られる。
請求項3に記載の発明によれば、活性層からの発光の強度及び波長の均一性の良好な、安定した品質の窒化物半導体発光素子が得られる。
請求項4又は請求項5に記載の発明によれば、効果的にエッジグロースの発生が低減されるために、信頼性が高く安定した品質の窒化物半導体発光素子が得られる。
請求項6に記載の発明によれば、高転位密度領域を有する基板を用いた場合において、転位欠陥の波及によるクラックの発生を防止しつつ、エッジグロースの発生を低減するため、信頼性が高く安定した品質の窒化物半導体発光素子が得られる。
請求項7に記載の発明によれば、クラックの発生が低減されるため、信頼性が高い窒化物半導体発光素子が得られる。
請求項8に記載の発明によれば、第2凹部の壁面からのクラックの発生が防止されるため、新たなクラックを発生することなくエッジグロースの発生を低減することができ、その結果として、信頼性が高く安定した品質の窒化物半導体発光素子が得られる。
According to the second aspect of the present invention, since the generation of cracks is reduced while the first semiconductor layer is constituted by a plurality of layers, a nitride semiconductor light emitting device having a high degree of freedom in materials and the like is obtained. It is done.
According to the third aspect of the present invention, a stable quality nitride semiconductor light emitting device having good light emission intensity and wavelength uniformity from the active layer can be obtained.
According to the invention described in claim 4 or claim 5, since the occurrence of edge growth is effectively reduced, a nitride semiconductor light emitting device having a reliable and stable quality can be obtained.
According to the invention described in claim 6, in the case of using a substrate having a high dislocation density region, the generation of edge growth is reduced while preventing the generation of cracks due to the spread of dislocation defects. Stable quality nitride semiconductor light emitting devices can be obtained.
According to the seventh aspect of the present invention, since the generation of cracks is reduced, a highly reliable nitride semiconductor light emitting device can be obtained.
According to the invention described in claim 8, since the occurrence of cracks from the wall surface of the second recess is prevented, the occurrence of edge growth can be reduced without generating new cracks. A nitride semiconductor light emitting device with high reliability and stable quality can be obtained.

請求項9に記載の発明によれば、第1半導体層が、基板を構成する窒化物半導体との格子定数の差の大きなAl含有の窒化物半導体を含む場合であっても、クラックの発生やエッジグロースの発生を低減できるため、材料の自由度の高い、窒化物半導体発光素子が得られる。
請求項10に記載の発明によれば、特に大きな歪みを生じるAlを含有する窒化物半導体からなる層に基板からかかる応力が効果的に緩和されて、クラックの発生が低減されるため、Alの組成比率を高くすることができる。
請求項11に記載の発明によれば、第1半導体層から、及び第1半導体層を介して基板から凸部の上方領域における第2半導体層にかかる応力を緩和することができるため、クラックの発生がより低減された信頼性の高い窒化物半導体発光素子が得られる。
請求項12に記載の発明によれば、活性層からの発光の強度及び波長の均一性が良好な、安定した品質の窒化物半導体発光素子が得られる。
請求項13に記載の発明によれば、共振器からのレーザ発振光の強度及び波長の均一性が良好な、安定した品質の窒化物半導体発光素子が得られる。
According to the ninth aspect of the present invention, even when the first semiconductor layer includes an Al-containing nitride semiconductor having a large difference in lattice constant from the nitride semiconductor constituting the substrate, generation of cracks or Since the occurrence of edge growth can be reduced, a nitride semiconductor light emitting device with a high degree of freedom of materials can be obtained.
According to the invention described in claim 10, since the stress applied from the substrate to the layer made of the nitride semiconductor containing Al that generates particularly large strain is effectively relaxed and the generation of cracks is reduced, The composition ratio can be increased.
According to the eleventh aspect of the present invention, since the stress applied to the second semiconductor layer in the upper region of the convex portion from the substrate through the first semiconductor layer and through the first semiconductor layer can be relaxed, A highly reliable nitride semiconductor light-emitting device with reduced generation can be obtained.
According to the twelfth aspect of the present invention, there can be obtained a nitride semiconductor light emitting device having a stable quality with good light emission intensity and wavelength uniformity from the active layer.
According to the thirteenth aspect of the present invention, there can be obtained a nitride semiconductor light emitting device having a stable quality in which the intensity and wavelength uniformity of the laser oscillation light from the resonator is good.

本発明に係る第1実施形態における窒化物半導体基板上に窒化物半導体層を積層した状態の様子を示す模式的断面図である。It is typical sectional drawing which shows the mode of the state which laminated | stacked the nitride semiconductor layer on the nitride semiconductor substrate in 1st Embodiment which concerns on this invention. 本発明に係る第1実施形態における窒化物半導体基板を上側から見た模式的平面図である。It is the typical top view which looked at the nitride semiconductor substrate in a 1st embodiment concerning the present invention from the upper part. 本発明に係る第1実施形態における窒化物半導体基板の模式的斜視図である。1 is a schematic perspective view of a nitride semiconductor substrate according to a first embodiment of the present invention. 本発明に係る第1実施形態における窒化物半導体発光素子の模式的断面図である。1 is a schematic cross-sectional view of a nitride semiconductor light emitting device in a first embodiment according to the present invention. 本発明に係る窒化物半導体の結晶方位及び結晶面を説明するための説明図である。It is explanatory drawing for demonstrating the crystal orientation and crystal plane of the nitride semiconductor which concern on this invention. 本発明に係る第1実施形態における窒化物半導体発光素子の製造工程を示す模式的断面図であり、(a)は加工前の窒化物半導体基板、(b)は第1凹部形成工程、(c)は第2凹部形成工程、(d)は第1半導体層形成工程、(e)は第2半導体層形成工程を示す。It is typical sectional drawing which shows the manufacturing process of the nitride semiconductor light-emitting device in 1st Embodiment concerning this invention, (a) is the nitride semiconductor substrate before a process, (b) is a 1st recessed part formation process, (c ) Shows a second recess forming step, (d) shows a first semiconductor layer forming step, and (e) shows a second semiconductor layer forming step. 本発明に係る第2実施形態における窒化物半導体基板を上側から見た模式的平面図である。It is the typical top view which looked at the nitride semiconductor substrate in a 2nd embodiment concerning the present invention from the upper part. 本発明に係る第3実施形態における窒化物半導体発光素子の模式的断面図である。It is typical sectional drawing of the nitride semiconductor light-emitting device in 3rd Embodiment concerning this invention. 本発明に係る第4実施形態における窒化物半導体発光素子の模式的断面図である。It is a typical sectional view of the nitride semiconductor light emitting element in a 4th embodiment concerning the present invention. 従来例における窒化物半導体基板上に窒化物半導体層を積層した状態の様子を示す模式的断面図である。It is typical sectional drawing which shows the mode of the state which laminated | stacked the nitride semiconductor layer on the nitride semiconductor substrate in a prior art example.

<第1実施形態>
以下、本発明の第1実施形態について、適宜図面を参照して説明する。
<構成>
まず、図1乃至図3を参照して、本発明の第1実施形態における窒化物半導体基板(以下、単に基板という)10と当該基板10の表面10aに積層された窒化物半導体層20の構成について説明する。
<First Embodiment>
Hereinafter, a first embodiment of the present invention will be described with reference to the drawings as appropriate.
<Configuration>
First, referring to FIGS. 1 to 3, a configuration of a nitride semiconductor substrate (hereinafter simply referred to as a substrate) 10 and a nitride semiconductor layer 20 stacked on a surface 10 a of the substrate 10 according to the first embodiment of the present invention. Will be described.

図1乃至図3に示すように、第1実施形態における基板10は、表面10a上に幅W2、深さD1の帯状の第1凹部11と、基板10の表面10aの第1凹部11以外の領域である幅W1の第1丘部(凸部)12とが形成されている。更に、基板10の表面10aの全領域、すなわち第1凹部11の底面及び第1丘部12の表面には、幅W5(<W2)、深さD2(<D1)の、第1凹部11の帯形状の延伸方向と平行方向に延伸した開口を有する溝が縞状に配設された第2凹部13が形成されている。第2凹部13は、第1凹部11よりも幅及び深さが小さく(W5<W2、D2<D1)形成されている。また、隣接する第2凹部13同士は、幅W4の第2丘部14を隔てて形成されている。   As shown in FIGS. 1 to 3, the substrate 10 according to the first embodiment includes a band-shaped first recess 11 having a width W2 and a depth D1 on the surface 10 a and the first recess 11 on the surface 10 a of the substrate 10. A first hill portion (convex portion) 12 having a width W1, which is a region, is formed. Further, the entire region of the surface 10a of the substrate 10, that is, the bottom surface of the first recess 11 and the surface of the first hill portion 12, the first recess 11 having a width W5 (<W2) and a depth D2 (<D1). A second recess 13 is formed in which grooves having openings extending in a direction parallel to the strip-shaped extending direction are arranged in a stripe pattern. The second recess 13 has a smaller width and depth than the first recess 11 (W5 <W2, D2 <D1). Moreover, the adjacent 2nd recessed parts 13 are formed across the 2nd hill part 14 of width W4.

第1凹部11は、基板10の表面10a上に、基板10とは格子定数の異なる窒化物半導体層20を積層するときに、基板10と窒化物半導体層20との格子定数の違いによる歪みが生じ、基板10から窒化物半導体層20にかかる応力を緩和するために設けるものである。   When the nitride semiconductor layer 20 having a lattice constant different from that of the substrate 10 is stacked on the surface 10 a of the substrate 10, the first concave portion 11 is distorted due to a difference in lattice constant between the substrate 10 and the nitride semiconductor layer 20. It is provided in order to relieve the stress applied to the nitride semiconductor layer 20 from the substrate 10.

この応力は基板10と窒化物半導体層20との間の格子定数との差、及び両者が接触している面積によって決まる。第1凹部11を設けることにより、基板10の表面10aと窒化物半導体層20とが歪みを生じながら連続して接触している面積を低減できるため、基板10から窒化物半導体層20にかかる応力を緩和することができる。すなわち、窒化物半導体層20を形成する際に、窒化物半導体を基板10の横方向(第1凹部11の内側方向)に成長させて積層することにより、第1凹部11において横方向成長した窒化物半導体に歪みが蓄積される。このため、第1凹部11以外における基板10と窒化物半導体層20との接触部における歪みが第1凹部11によって分断される。この結果、基板10と窒化物半導体層20との間に歪みが生じながら接触している同一面において連続面積が減少するため、特に第1凹部11以外の領域である第1丘部12の上方領域に積層される窒化物半導体層20に基板10からかかる応力が緩和される。   This stress is determined by the difference between the lattice constant between the substrate 10 and the nitride semiconductor layer 20 and the area where both are in contact. By providing the first recess 11, it is possible to reduce the area where the surface 10 a of the substrate 10 and the nitride semiconductor layer 20 are continuously in contact with each other while being distorted. Can be relaxed. That is, when the nitride semiconductor layer 20 is formed, the nitride semiconductor is grown in the lateral direction of the substrate 10 (the inner side of the first recess 11) and stacked, so that the nitride grown laterally in the first recess 11 Distortion accumulates in the physical semiconductor. For this reason, the strain in the contact portion between the substrate 10 and the nitride semiconductor layer 20 other than the first recess 11 is divided by the first recess 11. As a result, since the continuous area decreases on the same surface that is in contact with the substrate 10 and the nitride semiconductor layer 20 while being distorted, particularly above the first hill 12 that is a region other than the first recess 11. The stress applied from the substrate 10 to the nitride semiconductor layer 20 stacked in the region is relieved.

また、基板10には、基板10の裏面10bから表面10aにかけて貫通した窒化物半導体の結晶の転位欠陥が高密度に生じた高転位密度領域10Hと、転位欠陥が少ない低転位密度領域10Lとが交互に繰り返されている。そして、第1凹部11は、幅W3の高転位密度領域10Hを完全に含むように、かつ、隣接する低転位密度領域10Lの一部を含むように幅W2(W2>W3)の領域に形成されている。また、幅W1の第1丘部12は、その全領域が低転位密度領域10Lに形成されている。   Further, the substrate 10 includes a high dislocation density region 10H in which dislocation defects of the nitride semiconductor crystal penetrating from the back surface 10b to the front surface 10a of the substrate 10 are generated at a high density, and a low dislocation density region 10L with few dislocation defects. It is repeated alternately. The first recess 11 is formed in a region having a width W2 (W2> W3) so as to completely include the high dislocation density region 10H having the width W3 and including a part of the adjacent low dislocation density region 10L. Has been. Further, the entire first hill portion 12 having the width W1 is formed in the low dislocation density region 10L.

転位欠陥が集中する高転位密度領域10Hを包含するように第1凹部11を形成することにより、第1丘部12の上方領域に積層される窒化物半導体層20の部分への転位欠陥の波及を防止できる。   By forming the first recess 11 so as to include the high dislocation density region 10H in which dislocation defects are concentrated, the dislocation defect spreads to the portion of the nitride semiconductor layer 20 stacked in the upper region of the first hill portion 12. Can be prevented.

第1実施形態では、第1凹部11は、高転位密度領域10Hを含む領域に形成するようにしたが、更に、隣接する高転位密度領域10H同士の中間の低転位密度領域10Lにも第1凹部11を形成するようにしてもよい。この場合、低転位密度領域10Lに形成する第1凹部11は、高転位密度領域を完全に包含する必要がないため、幅W2よりも小さい幅で形成するようにしてもよい。
また、高転位密度領域10Hのない低転位密度の窒化物半導体からなる基板10を用いて、適宜な間隔で第1凹部11を形成するようにしてもよい。
In the first embodiment, the first recess 11 is formed in a region including the high dislocation density region 10H, but the first recess 11 is also formed in the low dislocation density region 10L intermediate between the adjacent high dislocation density regions 10H. The recess 11 may be formed. In this case, the first recess 11 formed in the low dislocation density region 10L need not completely include the high dislocation density region, and may be formed with a width smaller than the width W2.
Alternatively, the first recesses 11 may be formed at appropriate intervals using the substrate 10 made of a low dislocation density nitride semiconductor without the high dislocation density region 10H.

基板10において、低転位密度領域10Lの単位面積あたりの転位数(転位密度)は、1×10/cm以下、好ましくは5×10/cm以下、より好ましくは1×10/cm以下である。また、高転位密度領域10Hは、低転位密度領域10Lよりも転位密度が高い領域であって、特に、その転位密度は限定されない。
なお、この転位密度は、CL(カソード・ルミネッセンス)観察をして測定することができる。
In the substrate 10, the number of dislocations (dislocation density) per unit area of the low dislocation density region 10L is 1 × 10 7 / cm 2 or less, preferably 5 × 10 6 / cm 2 or less, more preferably 1 × 10 6 / cm 2 or less. The high dislocation density region 10H is a region having a higher dislocation density than the low dislocation density region 10L, and the dislocation density is not particularly limited.
The dislocation density can be measured by CL (cathode luminescence) observation.

また、基板10は、GaN、AlGaN、AlN、GaInN、AlGaInN、AlBGaInNなどの窒化物半導体からなる基板であり、基板10上に形成される窒化物半導体層20と良好な格子整合を示す組成からなるものが選択される。この基板10は、SiやGe、Oなどのn型の不純物がドーピングされていてもよい。不純物がドーピングされている場合は、その濃度は、特に限定されるものではないが、例えば、5×1015/cm〜5×1021/cm程度が適当である。更に、この基板10の形状は、円板状または正方形板状である。製造プロセス上、基板10の元となるウエハのサイズは1インチ(2.54cm)以上、好ましくは2インチ(5.08cm)以上である。またウエハの厚さは、50μm以上が好ましい。
更にまた、基板10は、2層以上の構造となっていてもよい。例えば、異種基板上に窒化物半導体層が積層されているものや、半導体層が2層以上となっているものでもよい。いわゆるテンプレート基板であってもよい。また、基板に窒化物半導体層を積層した後で、更に別の金属基板を貼り合わせてもよい。
基板10の材料は、波長による光吸収を考慮して選択することが好ましい。例えば、光を効率良く取り出す場合には、その波長領域で光吸収の少ない基板を選択する。このような観点からは、発光(発振)波長が紫外領域の場合であれば、GaNよりもAlNを用いることが好ましい。
The substrate 10 is a substrate made of a nitride semiconductor such as GaN, AlGaN, AlN, GaInN, AlGaInN, and AlBGaInN, and has a composition that exhibits good lattice matching with the nitride semiconductor layer 20 formed on the substrate 10. The one is selected. The substrate 10 may be doped with n-type impurities such as Si, Ge, and O. When impurities are doped, the concentration thereof is not particularly limited, but for example, about 5 × 10 15 / cm 3 to 5 × 10 21 / cm 3 is appropriate. Furthermore, the shape of the substrate 10 is a disk shape or a square plate shape. In the manufacturing process, the size of the wafer serving as the substrate 10 is 1 inch (2.54 cm) or more, preferably 2 inches (5.08 cm) or more. Further, the thickness of the wafer is preferably 50 μm or more.
Furthermore, the substrate 10 may have a structure of two or more layers. For example, a nitride semiconductor layer laminated on a different substrate or a semiconductor layer having two or more semiconductor layers may be used. A so-called template substrate may be used. Further, another metal substrate may be bonded after the nitride semiconductor layer is stacked on the substrate.
The material of the substrate 10 is preferably selected in consideration of light absorption by wavelength. For example, in order to extract light efficiently, a substrate that absorbs less light in that wavelength region is selected. From such a viewpoint, if the emission (oscillation) wavelength is in the ultraviolet region, it is preferable to use AlN rather than GaN.

第1凹部11の深さD1は、通常、0.5μm〜10.0μm程度であり、1.0μm〜6.0μmが好ましい。第1凹部11は、高転位密度領域10Hを包含するように、その幅W2が、高転位密度領域10Hの幅W3よりも広く(W2>W3)なるように形成される。   The depth D1 of the first recess 11 is usually about 0.5 μm to 10.0 μm, preferably 1.0 μm to 6.0 μm. The first recess 11 is formed so as to include the high dislocation density region 10H so that its width W2 is wider than the width W3 of the high dislocation density region 10H (W2> W3).

また、第1凹部11同士の間隔、すなわち幅W1は、高転位密度領域10Hを有する基板10を用いる場合は、高転位密度領域10Hの間隔に合わせればよい。低転位密度領域10Lのみからなる基板10を用いる場合は、ウエハ内に第1凹部11を1個でも設けることで応力緩和効果が得られる。幅W1を小さくするほどこの効果は大きくなるが、窒化物半導体発光素子を形成する第1丘部12の領域が狭くなりウエハ当たりの素子の形成数が少なくなり過ぎず、また、1つの第1丘部12上に少なくとも1つの素子が形成できるように、幅W1は、例えば、100μm〜20mm程度とすることができる。   Moreover, what is necessary is just to match | combine the space | interval of 1st recessed parts 11, ie, width W1, with the space | interval of the high dislocation density area | region 10H, when using the board | substrate 10 which has the high dislocation density area | region 10H. When using the substrate 10 composed of only the low dislocation density region 10L, the stress relaxation effect can be obtained by providing at least one first recess 11 in the wafer. This effect increases as the width W1 is reduced. However, the area of the first hill portion 12 for forming the nitride semiconductor light emitting element is narrowed, and the number of elements formed per wafer is not reduced too much. The width W1 can be, for example, about 100 μm to 20 mm so that at least one element can be formed on the hill portion 12.

第2凹部13は、第1凹部11の底面及び第1丘部12の表面に、第1凹部11よりも小さい凹部として形成される。
第1凹部11を設けることにより、第1凹部11のエッジ部の上方領域において、窒化物半導体層20が盛り上がるエッジグロースが発生する。本実施形態では、このエッジグロースを低減するため、第2凹部13を設けるものである。
The second recess 13 is formed as a recess smaller than the first recess 11 on the bottom surface of the first recess 11 and the surface of the first hill portion 12.
By providing the first recess 11, edge growth in which the nitride semiconductor layer 20 swells occurs in the region above the edge portion of the first recess 11. In this embodiment, in order to reduce this edge growth, the 2nd recessed part 13 is provided.

第2凹部13の深さD2は、通常、0.1μm〜1μm程度であり、0.1μm〜0.5μmが好ましい。第2凹部13の幅W5は、1μm〜10μm程度である。また第2凹部13同士の間隔、すなわち第2丘部14の幅W4は、第2凹部13の幅W5と同程度とすることができる。   The depth D2 of the second recess 13 is usually about 0.1 μm to 1 μm, preferably 0.1 μm to 0.5 μm. The width W5 of the second recess 13 is about 1 μm to 10 μm. Further, the interval between the second recesses 13, that is, the width W 4 of the second hill portion 14 can be set to be approximately the same as the width W 5 of the second recess 13.

第2凹部13を設け、横方向成長を促進して窒化物半導体材料で第2凹部13を埋め込むようにすることで、第1凹部11のエッジ部における窒化物半導体層20の縦方向成長を抑制し、エッジグロースの盛り上がり量を低減することができる。また、第2凹部13を埋め込むように窒化物半導体を横方向成長させることにより、横方向成長した層で基板10から窒化物半導体層20にかかる応力を緩和することができる。   By providing the second recess 13 and promoting the lateral growth to fill the second recess 13 with a nitride semiconductor material, the vertical growth of the nitride semiconductor layer 20 at the edge portion of the first recess 11 is suppressed. In addition, the amount of rising edge growth can be reduced. In addition, by growing the nitride semiconductor laterally so as to fill the second recess 13, the stress applied from the substrate 10 to the nitride semiconductor layer 20 in the laterally grown layer can be relaxed.

また、窒化物半導体層20を積層する基板10の表面10aは、図5に示すように、窒化物半導体の六方晶系における(0001)面(C面)とすることが好ましい。
更に、第1凹部11の端面(図1に示した基板10の断面に平行な面)を(1−100)面(M面)とすることにより、窒化物半導体層20の上部に形成される後記するリッジ構造を用いて共振器42(図4参照)を形成するときに、劈開によって共振器端面を形成することができる。
Further, the surface 10a of the substrate 10 on which the nitride semiconductor layer 20 is laminated is preferably a (0001) plane (C plane) in the hexagonal system of the nitride semiconductor, as shown in FIG.
Further, the end surface of the first recess 11 (the surface parallel to the cross section of the substrate 10 shown in FIG. 1) is the (1-100) plane (M plane), so that it is formed on the nitride semiconductor layer 20. When the resonator 42 (see FIG. 4) is formed using a ridge structure described later, the resonator end face can be formed by cleavage.

また、C面を基板10の表面(主面)10aとした場合、窒化物半導体層20を基板面の広がり方向である横方向に成長させることにより、転位が結晶方位<0001>に垂直方向に発生する。すなわち、結晶方位<11−20>又は<1−100>などの方向に転位が発生する。横方向に窒化物半導体層20を成長させた領域には、これらの結晶方位に転位が発生することにより、結晶にかかる歪みをこの転位部分に分断して蓄えることができる。更に横方向への成長領域の幅が大きいほど、また、縦方向(基板10の表面10aに垂直方向)への結晶成長速度Xが横方向への結晶成長速度Yより小さく(X<Y)、かつその比Y/Xが大きいほど、歪みを抑制する効果は大きくなる。   Further, when the C plane is the surface (main surface) 10a of the substrate 10, the nitride semiconductor layer 20 is grown in the lateral direction, which is the spreading direction of the substrate surface, so that the dislocations are perpendicular to the crystal orientation <0001>. appear. That is, dislocation occurs in the direction of crystal orientation <11-20> or <1-100>. In the region where the nitride semiconductor layer 20 is grown in the lateral direction, dislocations are generated in these crystal orientations, so that strain applied to the crystals can be divided and stored in the dislocation portions. Further, as the width of the growth region in the lateral direction is larger, the crystal growth rate X in the vertical direction (perpendicular to the surface 10a of the substrate 10) is smaller than the crystal growth rate Y in the lateral direction (X <Y). And the effect which suppresses distortion becomes large, so that ratio Y / X is large.

窒化物半導体層20は基板10の表面10a上に積層され、窒化物半導体発光素子を構成するための窒化物半導体が適宜積層されて構成される。例えば、図4に示す窒化物半導体発光素子1は、窒化物半導体レーザ素子であって、その窒化物半導体層20は、下地層50(第1のn型半導体層)、n型クラッド層60(第2のn型半導体層)、n型光ガイド層70(第3のn型半導体層)、活性層80、p型キャップ層90(第1のp型半導体層)、p型光ガイド層100(第2のp型半導体層)、p型クラッド層110(第3のp型半導体層)、p型コンタクト層120(第4のp型半導体層)から構成されている。ここでは、説明の便宜上、光を生成する層である活性層80を含まず、活性層80よりも下層を第1半導体層30、活性層80を含む上層を第2半導体層40とする。
以下、適宜図4も参照して説明を続ける。
The nitride semiconductor layer 20 is laminated on the surface 10a of the substrate 10, and a nitride semiconductor for constituting a nitride semiconductor light emitting element is appropriately laminated. For example, the nitride semiconductor light emitting device 1 shown in FIG. 4 is a nitride semiconductor laser device, and the nitride semiconductor layer 20 includes an underlayer 50 (first n-type semiconductor layer) and an n-type cladding layer 60 ( Second n-type semiconductor layer), n-type light guide layer 70 (third n-type semiconductor layer), active layer 80, p-type cap layer 90 (first p-type semiconductor layer), p-type light guide layer 100 (Second p-type semiconductor layer), p-type cladding layer 110 (third p-type semiconductor layer), and p-type contact layer 120 (fourth p-type semiconductor layer). Here, for convenience of explanation, the active layer 80 that generates light is not included, the lower layer than the active layer 80 is the first semiconductor layer 30, and the upper layer including the active layer 80 is the second semiconductor layer 40.
Hereinafter, the description will be continued with reference to FIG.

第1半導体層30は、基板10の表面10a上に、下地層50、n型クラッド層60及びn型光ガイド層70が順次積層されて構成されている。第1凹部11の上方領域に積層された第1半導体層30の上端面30aにおいては、第1凹部11に対応する位置に凹部31が形成されている。また、第2凹部13は、第1半導体層30において埋め込まれており、第1丘部12の上方領域における上端面30aが平坦化されている。   The first semiconductor layer 30 is configured by sequentially laminating a base layer 50, an n-type cladding layer 60, and an n-type light guide layer 70 on the surface 10 a of the substrate 10. In the upper end surface 30 a of the first semiconductor layer 30 stacked in the upper region of the first recess 11, a recess 31 is formed at a position corresponding to the first recess 11. The second recess 13 is embedded in the first semiconductor layer 30, and the upper end surface 30 a in the upper region of the first hill portion 12 is flattened.

基板10の表面10aには、第1凹部11が形成され、第1半導体層30の上端面30aにおいて、第1凹部11に対応する位置に凹部31が形成される程度に窒化物半導体が積層されているため、基板10の表面10a側に積層される第1半導体層30は、基板10との間の歪みから生じる応力が緩和される。また、第1凹部11は、転位欠陥が集中する高転位密度領域10Hを包含するように形成されているため、第1丘部12の上方領域に積層される第1半導体層30への転位欠陥の波及を防止できる。更に、第2凹部13が形成されているため、第1凹部11のエッジ部において、第1半導体層30が盛り上がるエッジグロースの発生が低減される。
特に、基板10の第1丘部12の上方領域に積層された第1半導体層30の上端面30aは、第1凹部11及び第2凹部13の影響を残さずに平坦面となっている。
A first recess 11 is formed on the surface 10 a of the substrate 10, and a nitride semiconductor is stacked to such an extent that a recess 31 is formed at a position corresponding to the first recess 11 on the upper end surface 30 a of the first semiconductor layer 30. Therefore, the first semiconductor layer 30 stacked on the surface 10a side of the substrate 10 is relieved of stress caused by distortion between the first semiconductor layer 30 and the substrate 10. Moreover, since the 1st recessed part 11 is formed so that the high dislocation density area | region 10H where a dislocation defect concentrates may be included, the dislocation defect to the 1st semiconductor layer 30 laminated | stacked on the upper area | region of the 1st hill part 12 is carried out. Can be prevented. Furthermore, since the second recess 13 is formed, the occurrence of edge growth in which the first semiconductor layer 30 rises at the edge portion of the first recess 11 is reduced.
In particular, the upper end surface 30 a of the first semiconductor layer 30 stacked in the upper region of the first hill portion 12 of the substrate 10 is a flat surface without leaving the influence of the first recess 11 and the second recess 13.

なお、窒化物半導体層20の各層について、第1半導体層30に区分するかどうかは、活性層80よりも下層で、かつ少なくとも第1半導体層30の上端面において、第2凹部13が埋め込まれて平坦化されているか否かで便宜的に決めるものである。すなわち、第2凹部13が平坦化された層を含めて、少なくともその層より下層を第1半導体層30に区分する。そして、第2凹部13が平坦化された層より上層で、かつ活性層80より下層は、第1半導体層30又は第2半導体層40の何れに区分してもよい。従って、例えば図4に示した第1実施形態のように、最下層の下地層50の上端面で第2凹部13が埋められて平坦化される場合は、n型クラッド層60から上層を第2半導体層40に区分してもよく、n型クラッド層60から下層や活性層80に隣接するn型光ガイド層70から下層を第1半導体層30に区分するようにしてもよい。言い換えれば、第2凹部13は、第1半導体層30の最上層までに平坦化されていればよく、それより下層の、例えば、最下層で平坦化されてもよい。   Whether each layer of the nitride semiconductor layer 20 is divided into the first semiconductor layer 30 is determined depending on whether the second recess 13 is buried below the active layer 80 and at least on the upper end surface of the first semiconductor layer 30. For convenience, it is determined by whether or not it is flattened. That is, at least a lower layer than the layer including the layer in which the second recess 13 is planarized is divided into the first semiconductor layer 30. The layer above the layer where the second recess 13 is planarized and below the active layer 80 may be divided into either the first semiconductor layer 30 or the second semiconductor layer 40. Therefore, for example, when the second recess 13 is filled and planarized by the upper end surface of the lowermost underlayer 50 as in the first embodiment shown in FIG. The semiconductor layer 40 may be divided into two semiconductor layers 40, and the lower layer from the n-type cladding layer 60 and the lower layer from the n-type light guide layer 70 adjacent to the active layer 80 may be divided into the first semiconductor layer 30. In other words, the second recess 13 only needs to be flattened up to the uppermost layer of the first semiconductor layer 30, and may be flattened at a lower layer, for example, the lowermost layer.

第2半導体層40は、第1半導体層30の上端面30aに、活性層80、p型キャップ層90、p型光ガイド層100、p型クラッド層110及びp型コンタクト層120が順次積層されて構成されている。第2半導体層40の上端面40aにおいては、下層である第1半導体層30の凹部31に対応する位置、すなわち基板10の第1凹部11に対応する位置に凹部41が形成されている。また、第2凹部13に基づく凹部は、第1半導体層30の上端面30aにおいて平坦化されているため、第2半導体層40は厚さ方向の全領域に渡って、第2凹部13に基づく凹部は生じない。   In the second semiconductor layer 40, an active layer 80, a p-type cap layer 90, a p-type light guide layer 100, a p-type cladding layer 110, and a p-type contact layer 120 are sequentially stacked on the upper end surface 30 a of the first semiconductor layer 30. Configured. On the upper end surface 40 a of the second semiconductor layer 40, a recess 41 is formed at a position corresponding to the recess 31 of the first semiconductor layer 30 as a lower layer, that is, a position corresponding to the first recess 11 of the substrate 10. In addition, since the concave portion based on the second concave portion 13 is flattened on the upper end surface 30a of the first semiconductor layer 30, the second semiconductor layer 40 is based on the second concave portion 13 over the entire region in the thickness direction. A recess does not occur.

第2半導体層40が積層される第1半導体層30の上端面30aにおいては、第1凹部11に対応する位置に凹部31が形成されている。このため、第2半導体層40においても、下層との間の格子定数の違いによる歪みが低減され、下層を介して基板10から受ける応力が緩和される。
また、第1半導体層30の上端面30aにおいては、第2凹部13が埋め込まれ、平坦化されているため、その上端面に積層される第2半導体層40の最下層である活性層80及び更にその上層の平坦性が確保される。このため、均一性の良好な面内の発光分布が得られ、発光モードの均一性もよいため発光波長の単一性も良好となる。
On the upper end surface 30 a of the first semiconductor layer 30 on which the second semiconductor layer 40 is stacked, a recess 31 is formed at a position corresponding to the first recess 11. For this reason, also in the 2nd semiconductor layer 40, the distortion by the difference in a lattice constant between lower layers is reduced, and the stress received from the board | substrate 10 through a lower layer is relieve | moderated.
In addition, since the second recess 13 is embedded and planarized in the upper end surface 30a of the first semiconductor layer 30, the active layer 80, which is the lowermost layer of the second semiconductor layer 40 stacked on the upper end surface, and Furthermore, the flatness of the upper layer is ensured. For this reason, in-plane light emission distribution with good uniformity is obtained, and since the uniformity of the light emission mode is good, the unity of the light emission wavelength is also good.

以上説明したように、基板10の表面10aに第1凹部11及び第2凹部13を設け、その上に窒化物半導体層20を積層することにより、窒化物半導体層20におけるクラックの発生を抑制することができる。また、クラック発生数の許容範囲において、窒化物半導体層20を構成する各層の膜厚を厚くすることができる。特に、基板10として通常用いられる窒化物半導体との格子定数の差が大きいAl組成率の高い窒化物半導体を積層する場合に有用である。   As described above, the first concave portion 11 and the second concave portion 13 are provided on the surface 10a of the substrate 10, and the nitride semiconductor layer 20 is laminated thereon, thereby suppressing the occurrence of cracks in the nitride semiconductor layer 20. be able to. Moreover, the film thickness of each layer constituting the nitride semiconductor layer 20 can be increased within the allowable range of the number of cracks. In particular, it is useful when a nitride semiconductor having a high Al composition ratio and a large difference in lattice constant from the nitride semiconductor normally used as the substrate 10 is stacked.

次に、図4を参照(適宜図1乃至図3参照)して、本発明における第1実施形態の窒化物半導体発光素子1の構成について説明する。   Next, the configuration of the nitride semiconductor light emitting device 1 of the first embodiment of the present invention will be described with reference to FIG. 4 (refer to FIGS. 1 to 3 as appropriate).

(窒化物半導体発光素子の構成)
図4に示す第1実施形態の窒化物半導体発光素子1は、窒化物半導体からなる基板10の表面10a上に窒化物半導体層20が積層されている。窒化物半導体層20の上端面は、一部を除き保護膜160で覆われ、窒化物半導体層20の壁面は、一部を除き保護膜170で覆われている。窒化物半導体層20の上端面の一部はp側電極130とオーミック接触しており、更にp側電極130はp側パッド電極140と電気的に接続されている。また、基板10の裏面10bにおいて、n側電極150が基板10とオーミック接触し、両者は電気的に接続されている。
(Configuration of nitride semiconductor light emitting device)
In the nitride semiconductor light emitting device 1 of the first embodiment shown in FIG. 4, a nitride semiconductor layer 20 is stacked on the surface 10 a of the substrate 10 made of a nitride semiconductor. The upper end surface of the nitride semiconductor layer 20 is covered with a protective film 160 except for a part thereof, and the wall surface of the nitride semiconductor layer 20 is covered with a protective film 170 except for a part thereof. A part of the upper end surface of the nitride semiconductor layer 20 is in ohmic contact with the p-side electrode 130, and the p-side electrode 130 is electrically connected to the p-side pad electrode 140. Further, on the back surface 10b of the substrate 10, the n-side electrode 150 is in ohmic contact with the substrate 10 and both are electrically connected.

基板10は、図1乃至図3に示した窒化物半導体からなる基板10から窒化物半導体発光素子1のチップ化によって切り出されたものであり、第1丘部12を中心にして、両側に第1凹部11が形成されている。また、基板10の表面10a、すなわち第1丘部12の表面及び第1凹部11の底面には縞状に配設された複数の第2凹部13が形成されている。
基板10の表面10a上には窒化物半導体層20が積層され、基板10は窒化物半導体層20とは下地層50によって接続されている。また、第1実施形態における基板10は導電性であり、裏面10b側に設けられたn側電極150と電気的に接続されている。
The substrate 10 is cut from the nitride semiconductor substrate 10 shown in FIG. 1 to FIG. 3 by forming the nitride semiconductor light emitting device 1 into chips, and is formed on both sides with the first hill portion 12 as the center. One recess 11 is formed. In addition, a plurality of second recesses 13 arranged in a stripe pattern are formed on the surface 10 a of the substrate 10, that is, on the surface of the first hill portion 12 and the bottom surface of the first recess 11.
A nitride semiconductor layer 20 is stacked on the surface 10 a of the substrate 10, and the substrate 10 is connected to the nitride semiconductor layer 20 by an underlayer 50. In addition, the substrate 10 in the first embodiment is conductive and is electrically connected to the n-side electrode 150 provided on the back surface 10b side.

窒化物半導体層20は、基板10側から順に、下地層50、n型クラッド層60及びn型光ガイド層70が積層されてなる第1半導体層30と、活性層80、p型キャップ層90、p型光ガイド層100、p型クラッド層110及びp型コンタクト層120が積層されてなる第2半導体層40とから構成されている。
更に、例えば、基板10と下地層50との間にバッファ層(図示せず)、下地層50とn型クラッド層60との間にクラック防止層(図示せず)などを適宜形成するようにしてもよい。また、これらの層の一部を適宜省略するようにしてもよい。
The nitride semiconductor layer 20 includes a first semiconductor layer 30 in which an underlayer 50, an n-type cladding layer 60, and an n-type light guide layer 70 are stacked in order from the substrate 10 side, an active layer 80, and a p-type cap layer 90. , A p-type light guide layer 100, a p-type cladding layer 110, and a p-type contact layer 120 are stacked to form a second semiconductor layer 40.
Further, for example, a buffer layer (not shown) is appropriately formed between the substrate 10 and the underlayer 50, and a crack prevention layer (not shown) is appropriately formed between the underlayer 50 and the n-type cladding layer 60. May be. Further, some of these layers may be omitted as appropriate.

下地層50は、窒化物半導体層20と導電性の基板10とを電気的に接続するための層である。また、下地層50は、活性層80のバンドギャップエネルギより大きい組成であることが好ましく、AlGa1−aN(0≦a<0.3)が一例として挙げられる。この下地層50は、n型クラッド層60と兼用するようにしてもよい。例えば、発振波長が370nm程度の紫外領域の場合は、AlGa1−aN(0≦a<0.15)程度が好ましく、n型クラッド層60と兼用しない場合であれば、AlGa1−aN(0≦a<0.05)程度が好ましい。また、下地層50の上にInを含有するクラック防止層(図示せず)を形成してもよい。
また、下地層50がAlを含有する窒化物半導体からなる層である場合、この層で第2凹部13を埋め込むことにより、Alを含有する窒化物半導体を含んでいながら、第1凹部11のエッジ部におけるエッジグロースの発生を抑えつつ、基板10から窒化物半導体層20にかかる応力を、更に効果的に緩和することができる。活性層80よりも下の層において、Alの組成比率を高くすることができるため、本発明の効果がより顕著となる。
例えば、発振波長が370nm程度の紫外領域の場合であって、下地層50にAlを含有する場合、n型クラッド層60と兼用しない場合はAlGa1−aN(0<a<0.05)、n型クラッド層60と兼用する場合はAlGa1−aN(0.05<a<0.15)程度であることが好ましい。また、発振波長が488nm程度の場合、n型クラッド層60と兼用する場合はAlGa1−aN(0<a<0.1)程度であることが好ましい。
The underlayer 50 is a layer for electrically connecting the nitride semiconductor layer 20 and the conductive substrate 10. The underlayer 50 preferably has a composition larger than the band gap energy of the active layer 80, and Al a Ga 1-a N (0 ≦ a <0.3) is an example. This underlayer 50 may also be used as the n-type cladding layer 60. For example, when the oscillation wavelength is in the ultraviolet region of about 370 nm, about Al a Ga 1-a N (0 ≦ a <0.15) is preferable, and when not using the n-type cladding layer 60, Al a Ga About 1-a N (0 ≦ a <0.05) is preferable. Further, a crack preventing layer (not shown) containing In may be formed on the underlayer 50.
Further, in the case where the underlayer 50 is a layer made of a nitride semiconductor containing Al, by embedding the second recess 13 with this layer, the nitride layer containing Al is contained while the first recess 11 is included. The stress applied to the nitride semiconductor layer 20 from the substrate 10 can be more effectively reduced while suppressing the occurrence of edge growth at the edge portion. Since the Al composition ratio can be increased in a layer below the active layer 80, the effect of the present invention becomes more remarkable.
For example, when the oscillation wavelength is in the ultraviolet region of about 370 nm and the Al layer is contained in the underlayer 50, and when the n-type cladding layer 60 is not used, Al a Ga 1-a N (0 <a <0. 05), when the n-type cladding layer 60 is also used, it is preferably about Al a Ga 1-a N (0.05 <a <0.15). Further, when the oscillation wavelength is about 488 nm, it is preferably about Al a Ga 1-a N (0 <a <0.1) when also used as the n-type cladding layer 60.

n型クラッド層60は、n型光ガイド層70を介して電子を活性層80に注入する層である。n型クラッド層60は、Alを含有していることが好ましい。また、単一層でも多層膜層(超格子構造)でもよい。n型不純物濃度は特に限定されるものではないが、好ましくは1×1017〜1×1020/cmであり、n型不純物濃度に、膜厚方向において傾斜をつけてもよい。さらに、Alの組成傾斜をつけることで電子を閉じ込めるクラッド層としても機能させてもよい。 The n-type cladding layer 60 is a layer that injects electrons into the active layer 80 via the n-type light guide layer 70. The n-type cladding layer 60 preferably contains Al. Further, it may be a single layer or a multilayer layer (superlattice structure). The n-type impurity concentration is not particularly limited, but is preferably 1 × 10 17 to 1 × 10 20 / cm 3 , and the n-type impurity concentration may be inclined in the film thickness direction. Further, it may function as a clad layer for confining electrons by providing a composition gradient of Al.

n型光ガイド層70は、n型クラッド層60から注入された電子を活性層80内に閉じ込め、かつ、活性層80で生成される光は閉じ込めない層として設けられる。n型光ガイド層70は、AlGa1−aN(0≦a≦1)を成長させて形成される。n型光ガイド層70の膜厚は特に限定されるものではなく、任意の膜厚を選択することができ、例
えば、0.15μm程度とすることができる。この層は、単層または多層膜層(超格子構造)で形成させることができる。また、n型不純物をドープさせてもよい。但し、n型光ガイド層70は、活性層80の組成や膜厚などによっては省略することもできる。また、レーザの発振波長が440nm以上の波長帯であれば、n型光ガイド層70は、InGa1−aN(0≦a≦1)よりなることが好ましい。
The n-type light guide layer 70 is provided as a layer in which electrons injected from the n-type clad layer 60 are confined in the active layer 80 and light generated in the active layer 80 is not confined. The n-type light guide layer 70 is formed by growing Al a Ga 1-a N (0 ≦ a ≦ 1). The film thickness of the n-type light guide layer 70 is not particularly limited, and an arbitrary film thickness can be selected. For example, the film thickness can be about 0.15 μm. This layer can be formed of a single layer or a multilayer layer (superlattice structure). Further, an n-type impurity may be doped. However, the n-type light guide layer 70 may be omitted depending on the composition and thickness of the active layer 80. In addition, when the laser oscillation wavelength is a wavelength band of 440 nm or more, the n-type light guide layer 70 is preferably made of In a Ga 1-a N (0 ≦ a ≦ 1).

なお、第1半導体層30の最上層となるn型光ガイド層70の上端面30aにおいては、基板10の表面10aに設けられた第1凹部11が埋め込まれずに凹部31が残っている。一方、第2凹部13は埋め込まれており、上端面30aの第1丘部12の上方領域は平坦化されている。   In addition, in the upper end surface 30a of the n-type light guide layer 70 that is the uppermost layer of the first semiconductor layer 30, the first recess 11 provided in the surface 10a of the substrate 10 is not embedded and the recess 31 remains. On the other hand, the 2nd recessed part 13 is embedded, and the upper area | region of the 1st hill part 12 of the upper end surface 30a is planarized.

活性層80は、n型光ガイド層70を介してn型クラッド層60から注入された電子と、p型光ガイド層100及びp型キャップ層90を介してp型クラッド層110から注入されたホールとが再結合して光を生成する層である。活性層80は、単一(SQW)または多重量子井戸構造(MQW)の何れでもよい。例えば、AlInGa1−a−bN(0≦a≦1、0≦b≦1、a+b≦1)からなる井戸層と、AlInGa1−c−dN(0≦c≦1、0≦d≦1、c+d≦1)からなる障壁層とを含む量子井戸構造が挙げられる。活性層80に用いられる半導体層は、アンドープ、n型不純物ドープ、p型不純物ドープのいずれでもよいが、アンドープまたはn型不純物ドープであることが好ましい。これにより高出力の窒化物半導体発光素子1を得ることができる。さらに、井戸層をアンドープとし、障壁層をn型不純物ドープとしてもよい。これにより発光素子の出力と発光効率を高めることができる。また、井戸層にAlを含ませることで、従来のInGaNの井戸層では困難な波長域、具体的には、GaNのバンドギャップエネルギである波長365nm付近、もしくはそれより短い波長を得ることができる。 The active layer 80 is injected from the n-type cladding layer 60 via the n-type light guide layer 70 and from the p-type cladding layer 110 via the p-type light guide layer 100 and the p-type cap layer 90. It is a layer that recombines with holes to generate light. The active layer 80 may be either a single (SQW) or multiple quantum well structure (MQW). For example, a well layer composed of Al a In b Ga 1-ab N (0 ≦ a ≦ 1, 0 ≦ b ≦ 1, a + b ≦ 1), and Al c In d Ga 1-cd N (0 ≦ and a quantum well structure including a barrier layer of c ≦ 1, 0 ≦ d ≦ 1, c + d ≦ 1). The semiconductor layer used for the active layer 80 may be any of undoped, n-type impurity doped, and p-type impurity doped, but is preferably undoped or n-type impurity doped. Thereby, a high-power nitride semiconductor light emitting device 1 can be obtained. Furthermore, the well layer may be undoped and the barrier layer may be n-type impurity doped. Thereby, the output and luminous efficiency of the light emitting element can be increased. In addition, by including Al in the well layer, it is possible to obtain a wavelength range that is difficult for a conventional InGaN well layer, specifically, a wavelength near 365 nm, which is the band gap energy of GaN, or shorter. .

障壁層は、例えば、n型不純物をドープする場合、その濃度は少なくとも5×1016/cm以上が好ましい。また、高出力の窒化物半導体発光素子1では、5×1017/cm以上、1×1020/cm以下が適当である。なお、障壁層にn型不純物をドープする場合、活性層80内のすべての障壁層にドープしてもよいし、一部をドープとし、一部をアンドープとすることもできる。 For example, when the barrier layer is doped with an n-type impurity, the concentration is preferably at least 5 × 10 16 / cm 3 or more. Further, in the high-power nitride semiconductor light-emitting element 1, 5 × 10 17 / cm 3 or more and 1 × 10 20 / cm 3 or less are appropriate. When the n-type impurity is doped in the barrier layer, all the barrier layers in the active layer 80 may be doped, or a part may be doped and a part may be undoped.

p型キャップ層90は、バンドギャップが大きく、窒化物半導体発光素子1が温度上昇し、また注入電荷密度が増えても、活性層80に注入されたキャリアをオーバフローさせないための層である。p型キャップ層90は、Mg含有のAlGa1−aN(0≦a≦1)で形成され、ホールがトンネル効果により通過できる100Å程度の膜厚とすることが好ましい。但し、p型キャップ層90は、活性層80の組成や膜厚によっては省略することもできる。 The p-type cap layer 90 is a layer that prevents the carriers injected into the active layer 80 from overflowing even if the band gap is large, the temperature of the nitride semiconductor light emitting device 1 rises, and the injected charge density increases. The p-type cap layer 90 is preferably made of Mg-containing Al a Ga 1-a N (0 ≦ a ≦ 1) and has a thickness of about 100 mm through which holes can pass through the tunnel effect. However, the p-type cap layer 90 may be omitted depending on the composition and film thickness of the active layer 80.

p型光ガイド層100は、p型クラッド層110から活性層80に注入されたホールを活性層80内に閉じ込め、かつ、活性層80で生成される光は閉じ込めない層である。p型光ガイド層100は、AlGa1−aN(0≦a≦1)で形成される。このp型光ガイド層100はアンドープとして成長させることが好ましいが、Mgをドープさせてもよい。また、n型光ガイド層70と同様に、単層または多層膜層(超格子構造)で形成させることができる。さらに、p型光ガイド層100は、活性層80の組成や膜厚などによっては省略することもできる。また、レーザ発振の波長が440nm以上の波長帯であれば、前記したn型光ガイド層70は、InGa1−aN(0≦a≦1)よりなることが好ましい。 The p-type light guide layer 100 is a layer in which holes injected from the p-type cladding layer 110 into the active layer 80 are confined in the active layer 80 and light generated in the active layer 80 is not confined. The p-type light guide layer 100 is formed of Al a Ga 1-a N (0 ≦ a ≦ 1). The p-type light guide layer 100 is preferably grown as undoped, but may be doped with Mg. Similarly to the n-type light guide layer 70, it can be formed of a single layer or a multilayer film layer (superlattice structure). Furthermore, the p-type light guide layer 100 can be omitted depending on the composition, film thickness, etc. of the active layer 80. In addition, when the wavelength of laser oscillation is a wavelength band of 440 nm or more, the n-type light guide layer 70 is preferably made of In a Ga 1-a N (0 ≦ a ≦ 1).

p型光ガイド層100の上部は、p型クラッド層110及びp型コンタクト層120とともに、図4の紙面垂直方向に延伸する線状のリッジ構造を形成している。このリッジ構造は、共振器42の光導波路を構成している。   The p-type light guide layer 100 and the p-type cladding layer 110 and the p-type contact layer 120 form a linear ridge structure extending in the direction perpendicular to the paper surface of FIG. This ridge structure constitutes the optical waveguide of the resonator 42.

p型クラッド層110は、p型光ガイド層100及びp型キャップ層90を介してホールを活性層80に注入する層である。p型クラッド層110は、活性層80のバンドギャップエネルギより大きい組成を有し、活性層80へのホールの閉じ込めができるものであれば特に限定されず、その一例として、AlGa1−aN(0≦a<1)が挙げられる。p型クラッド層110のp型不純物濃度は、1×1018〜1×1021/cmが適当である。p型不純物濃度が上記の範囲にあると、結晶性を低下させることなくバルク抵抗を低下させることができる。p型クラッド層110は、単一層でも多層膜層(超格子構造)でもよい。多層膜層の場合、前記したAlGa1−aNと、それよりバンドギャップエネルギの小さい窒化物半導体とからなる多層膜層であればよい。例えば、バンドギャップエネルギの小さい窒化物半導体としては、n型クラッド層60の場合と同様に、InGa1−aN(0≦a<1)、AlGa1−bN(0≦b<1)が挙げられる。また、p型クラッド層110がバンドギャップエネルギの大きい層と、バンドギャップエネルギの小さい層からなる多層膜層である場合、バンドギャップエネルギの大きい層及び小さい層の少なくとも何れか一方にp型不純物をドープさせてもよい。バンドギャップエネルギの大きい層および小さい層の両方にドープする場合は、ドープ量は同一でも異なってもよい。 The p-type cladding layer 110 is a layer that injects holes into the active layer 80 via the p-type light guide layer 100 and the p-type cap layer 90. The p-type cladding layer 110 is not particularly limited as long as it has a composition larger than the band gap energy of the active layer 80 and can confine holes in the active layer 80. As an example, Al a Ga 1-a N (0 ≦ a <1). The p-type impurity concentration of the p-type cladding layer 110 is suitably 1 × 10 18 to 1 × 10 21 / cm 3 . When the p-type impurity concentration is in the above range, the bulk resistance can be reduced without reducing the crystallinity. The p-type cladding layer 110 may be a single layer or a multilayer film layer (superlattice structure). In the case of a multilayer film layer, it may be a multilayer film layer composed of the aforementioned Al a Ga 1-a N and a nitride semiconductor having a smaller band gap energy. For example, as a nitride semiconductor having a small band gap energy, as in the case of the n-type cladding layer 60, In a Ga 1-a N (0 ≦ a <1), Al b Ga 1-b N (0 ≦ b <1). In addition, when the p-type cladding layer 110 is a multilayer film composed of a layer having a large band gap energy and a layer having a small band gap energy, p-type impurities are added to at least one of the layer having a large band gap energy and the layer having a small band gap energy. You may dope. When doping both the layer with large band gap energy and the layer with small band gap energy, the doping amount may be the same or different.

また、p型クラッド層110は、p型光ガイド層100の上部及びp型コンタクト層120とともに、共振器42の光導波路を構成するリッジ構造を形成している。   The p-type cladding layer 110 forms a ridge structure that constitutes the optical waveguide of the resonator 42 together with the upper portion of the p-type light guide layer 100 and the p-type contact layer 120.

p型コンタクト層120は、上端面がp側電極130とオーミック接触し、p側電極130と電気的に接続するための層である。p型コンタクト層120は、p型光ガイド層100の上部及びp型クラッド層110とともに、共振器42の光導波路を構成するリッジ構造を形成している。また、p型コンタクト層120の上端面はp側電極130とオーミック接触している。
p型コンタクト層120としては、p型不純物を含有したAlGa1−aN(0≦a<1)が挙げられる。
The p-type contact layer 120 is a layer whose upper end surface is in ohmic contact with the p-side electrode 130 and is electrically connected to the p-side electrode 130. The p-type contact layer 120 forms a ridge structure that constitutes the optical waveguide of the resonator 42 together with the upper part of the p-type light guide layer 100 and the p-type cladding layer 110. Further, the upper end surface of the p-type contact layer 120 is in ohmic contact with the p-side electrode 130.
Examples of the p-type contact layer 120 include Al a Ga 1-a N (0 ≦ a <1) containing a p-type impurity.

共振器42は、活性層80で生成した光を閉じ込め、レーザ発振を起こすための共振器である。第1実施形態における共振器42は、ファブリ・ペロ共振器を構成している。
共振器42は、p型光ガイド層100の上部、p型クラッド層110及びp型コンタクト層120で形成されるリッジ構造を光導波路とする。このリッジ構造の図4の紙面垂直方向の手前側の端面には、例えば、Alなどからなる誘電体膜などからなる反射膜(図示せず)が形成されている。この反射膜は、ハーフミラーとして機能し、手前側の端面は、共振器42内に閉じ込められた光の一部を外部に出射する光出射側端面となる。また、このリッジ構造の紙面垂直方向の奧側の端面には、例えば、Alからなる誘電体膜に、SiOとZrOを交互に積層した反射膜(図示せず)が形成されている。この奧側の端面は、共振器42の光反射側端面となる。
The resonator 42 is a resonator for confining light generated in the active layer 80 and causing laser oscillation. The resonator 42 in the first embodiment constitutes a Fabry-Perot resonator.
The resonator 42 uses a ridge structure formed by the upper part of the p-type light guide layer 100, the p-type cladding layer 110, and the p-type contact layer 120 as an optical waveguide. A reflective film (not shown) made of, for example, a dielectric film made of Al 2 O 3 or the like is formed on the end face on the near side in the direction perpendicular to the paper surface of FIG. 4 of this ridge structure. This reflection film functions as a half mirror, and the end surface on the near side becomes a light emission side end surface that emits a part of the light confined in the resonator 42 to the outside. In addition, a reflection film (not shown) in which SiO 2 and ZrO 2 are alternately laminated on a dielectric film made of, for example, Al 2 O 3 is formed on the end surface of the ridge structure in the vertical direction on the paper surface. ing. This end surface on the heel side becomes the light reflection side end surface of the resonator 42.

また、共振器42は、第1丘部12の上方領域に設けられ、基板10の第1凹部11に基づく凹凸の影響を受けないように形成されている。このため、レーザ発振の波長や強度のバラツキが少なく、安定した品質の共振器42を形成することができ、結果として、窒化物半導体発光素子1を高い歩留まりで製造することができる。   The resonator 42 is provided in the upper region of the first hill portion 12 and is formed so as not to be affected by unevenness based on the first recess 11 of the substrate 10. For this reason, there is little variation in the wavelength and intensity of laser oscillation, and the resonator 42 with stable quality can be formed. As a result, the nitride semiconductor light emitting device 1 can be manufactured with a high yield.

p側電極130は、窒化物半導体層20に電力を供給するための正極である。p側電極130は、p型コンタクト層120及び保護膜160の上に積層されており、p型コンタクト層120の上端面とオーミック接触するとともに、更に上層のp側パッド電極140と接続されている。なお、p側電極130は、p型コンタクト層120の上端面とオーミック接触していればよく、保護膜160の上には積層されずにp型コンタクト層120の上端面のみに積層されていてもよい。
p側電極130は、例えば、Ni、Auなどの金属又は合金、あるいはこれらをスパッタ法や蒸着法などによって積層して形成することができる。
The p-side electrode 130 is a positive electrode for supplying power to the nitride semiconductor layer 20. The p-side electrode 130 is laminated on the p-type contact layer 120 and the protective film 160, is in ohmic contact with the upper end surface of the p-type contact layer 120, and is further connected to the upper p-side pad electrode 140. . The p-side electrode 130 only needs to be in ohmic contact with the upper end surface of the p-type contact layer 120 and is not stacked on the protective film 160 but only on the upper end surface of the p-type contact layer 120. Also good.
The p-side electrode 130 can be formed, for example, by laminating a metal or alloy such as Ni or Au, or laminating these by sputtering or vapor deposition.

p側パッド電極140は、外部電源(図示せず)とAuワイヤ(図示せず)などで接続され、p側電極130に電力を供給するための電極パッドである。
p側パッド電極140は、例えば、Ni、Ti、Auなどの金属又は合金、あるいはこれらをスパッタ法や蒸着法などによって積層して形成することができる。
The p-side pad electrode 140 is an electrode pad that is connected to an external power source (not shown) by an Au wire (not shown) or the like and supplies power to the p-side electrode 130.
The p-side pad electrode 140 can be formed, for example, by laminating a metal or alloy such as Ni, Ti, or Au, or by laminating these using a sputtering method or a vapor deposition method.

n側電極150は、窒化物半導体層20に電力を供給するための負極である。n側電極150は、導電性の基板10の裏面10b上に形成されている。
n側電極150は、例えば、V、Pt、Auなどの金属又は合金、あるいはこれらをスパッタ法や蒸着法などによって積層して形成することができる。
The n-side electrode 150 is a negative electrode for supplying power to the nitride semiconductor layer 20. The n-side electrode 150 is formed on the back surface 10 b of the conductive substrate 10.
The n-side electrode 150 can be formed, for example, by laminating a metal or alloy such as V, Pt, Au, or the like by sputtering or vapor deposition.

保護膜160は、p型コンタクト層120の上端面を除く窒化物半導体層20の上端面を覆う絶縁保護膜である。保護膜160は、例えば、SiOなどの絶縁材料を用いてスパッタ法、蒸着法などによって形成される。 The protective film 160 is an insulating protective film that covers the upper end surface of the nitride semiconductor layer 20 excluding the upper end surface of the p-type contact layer 120. The protective film 160 is formed by a sputtering method, a vapor deposition method, or the like using an insulating material such as SiO 2 .

保護膜170は、窒化物半導体層20の側面を覆う絶縁保護膜であり、保護膜160と同様にしてSiOなどの絶縁材料を用いて形成される。 The protective film 170 is an insulating protective film that covers the side surfaces of the nitride semiconductor layer 20, and is formed using an insulating material such as SiO 2 in the same manner as the protective film 160.

なお、第1実施形態においては、窒化物半導体層20は、基板10(下層)側をn型半導体層で構成したが、p型半導体層を基板10側に構成してもよい。   In the first embodiment, the nitride semiconductor layer 20 is configured by the n-type semiconductor layer on the substrate 10 (lower layer) side, but the p-type semiconductor layer may be configured on the substrate 10 side.

<動作>
次に、図4を参照して、本発明の第1実施形態における窒化物半導体発光素子(窒化物半導体レーザ素子)1の動作について説明する。
<Operation>
Next, the operation of the nitride semiconductor light emitting device (nitride semiconductor laser device) 1 in the first embodiment of the present invention will be described with reference to FIG.

p側電極130(p側パッド電極140)を正極、n側電極150を負極として、窒化物半導体層20に順方向に電圧を印加することにより、n型クラッド層60からn型光ガイド層70を介して電子が活性層80に注入されるとともに、p型クラッド層110からp型光ガイド層100及びp型キャップ層90を介してホールが活性層80に注入される。活性層80では、注入された電子とホールとが再結合し、光を生成する。   By applying a forward voltage to the nitride semiconductor layer 20 with the p-side electrode 130 (p-side pad electrode 140) as a positive electrode and the n-side electrode 150 as a negative electrode, the n-type cladding layer 60 to the n-type light guide layer 70 are applied. Then, electrons are injected into the active layer 80 via holes and holes are injected from the p-type cladding layer 110 into the active layer 80 via the p-type light guide layer 100 and the p-type cap layer 90. In the active layer 80, the injected electrons and holes recombine to generate light.

活性層80で生成された光は、窒化物半導体層20の各層の屈折率の違いにより共振器42内に閉じこめられ、共振器42の図4の紙面垂直方向の両端面に設けられた反射膜(図示せず)によって、一部は内部へフィードバックされてレーザ発振に寄与する。共振器42の内部では、共振器42の長さなどによって定められる波長の光のみが存在する。そして、共振器42内の光の一部は、光射出側端面である図4の紙面垂直方向の手前側の共振器端面にハーフミラーとして形成された反射膜を透過して外部に放出される。放出された光はレーザ光として各種用途に利用される。
<製造方法>
次に、図6を参照(適宜図1乃至図4参照)して、本発明の第1実施形態における窒化物半導体発光素子1の製造方法について説明する。
The light generated in the active layer 80 is confined in the resonator 42 due to the difference in the refractive index of each layer of the nitride semiconductor layer 20, and the reflection films provided on both end surfaces of the resonator 42 in the direction perpendicular to the plane of FIG. (Not shown) partly feeds back to contribute to laser oscillation. Inside the resonator 42, only light having a wavelength determined by the length of the resonator 42 or the like exists. A part of the light in the resonator 42 is emitted to the outside through a reflecting film formed as a half mirror on the resonator end surface on the near side in the direction perpendicular to the paper surface of FIG. . The emitted light is used for various purposes as laser light.
<Manufacturing method>
Next, a method for manufacturing the nitride semiconductor light-emitting element 1 according to the first embodiment of the present invention will be described with reference to FIG. 6 (see FIGS. 1 to 4 as appropriate).

第1実施形態における窒化物半導体発光素子1の製造方法は、窒化物半導体からなる基板10と、この基板10の表面10aに積層された窒化物半導体層20とを備えた窒化物半導体発光素子1の製造方法であって、第1凹部形成工程と、第2凹部形成工程と、窒化物半導体層20の活性層80を含まない下層部である第1半導体層形成工程と、窒化物半導体層20の活性層80を含む上層部である第2半導体層形成工程とを含むものである。   The manufacturing method of the nitride semiconductor light emitting device 1 according to the first embodiment includes a nitride semiconductor light emitting device 1 including a substrate 10 made of a nitride semiconductor and a nitride semiconductor layer 20 stacked on the surface 10a of the substrate 10. The first recess forming step, the second recess forming step, the first semiconductor layer forming step which is a lower layer portion of the nitride semiconductor layer 20 that does not include the active layer 80, and the nitride semiconductor layer 20 And a second semiconductor layer forming step which is an upper layer portion including the active layer 80.

まず、第1凹部形成工程において、基板10の表面10aに、溝状の第1凹部11を形成し、第2凹部形成工程において、第1凹部11の底面及び第1凹部11以外の基板10の表面である第1丘部12に、第1凹部11よりも深さ及び開口幅が小さい第2凹部13を形成する。   First, in the first recess forming step, the groove-shaped first recess 11 is formed on the surface 10a of the substrate 10, and in the second recess forming step, the bottom surface of the first recess 11 and the substrate 10 other than the first recess 11 are formed. A second concave portion 13 having a depth and an opening width smaller than those of the first concave portion 11 is formed in the first hill portion 12 which is the surface.

次に、第1半導体層形成工程では、第1半導体層30の上端面30aにおいて、第1凹部11に対応する位置に凹部31が形成されるとともに、第2凹部13が埋め込まれて第1丘部12の上方領域が平坦化されるように、第1凹部11及び第2凹部13が形成された基板10の表面10aに第1半導体層30を形成する。   Next, in the first semiconductor layer forming step, a recess 31 is formed at a position corresponding to the first recess 11 on the upper end surface 30a of the first semiconductor layer 30, and the second recess 13 is embedded to fill the first hill. The first semiconductor layer 30 is formed on the surface 10a of the substrate 10 on which the first recess 11 and the second recess 13 are formed so that the upper region of the portion 12 is planarized.

そして、第2半導体層形成工程において、第2半導体層40の上端面40aにおいて、第1凹部11に対応する位置に凹部41が形成されるように、第1半導体層30上に、第2半導体層40を形成する。   Then, in the second semiconductor layer forming step, the second semiconductor is formed on the first semiconductor layer 30 so that the recess 41 is formed at a position corresponding to the first recess 11 on the upper end surface 40 a of the second semiconductor layer 40. Layer 40 is formed.

第1凹部11を設け、第1凹部11に対応する凹部41が窒化物半導体層20の上端面40aにおいて残るように窒化物半導体層20を形成することにより、窒化物半導体層20の積層時に基板10と窒化物半導体層20との間の格子定数の違いにより生じる歪みが第1凹部11に蓄積され、その結果、第1凹部11において歪みが分断される。これによって、基板10と窒化物半導体層20とが歪みを生じながら連続して接触する面積が低減されるため、基板10から第1丘部12の上方領域の窒化物半導体層20にかかる応力が緩和される。また、第2凹部13を設けたため、第1凹部11のエッジ部に発生するエッジグロースの盛り上がり量が低減されるとともに、基板10から窒化物半導体層20にかかる応力が更に緩和される。また、第2凹部13は第1半導体層30の上端面30aまでに埋め込んで平坦化されるため、第2半導体層40に含まれる活性層80は平坦に積層される。   A substrate is formed when the nitride semiconductor layer 20 is stacked by providing the first recess 11 and forming the nitride semiconductor layer 20 so that the recess 41 corresponding to the first recess 11 remains on the upper end surface 40 a of the nitride semiconductor layer 20. The strain caused by the difference in lattice constant between the nitride semiconductor layer 20 and the nitride semiconductor layer 20 is accumulated in the first recess 11, and as a result, the strain is divided in the first recess 11. As a result, the area in which the substrate 10 and the nitride semiconductor layer 20 are continuously in contact with each other while being distorted is reduced, so that the stress applied from the substrate 10 to the nitride semiconductor layer 20 in the upper region of the first hill portion 12 is reduced. Alleviated. In addition, since the second recess 13 is provided, the amount of rising edge growth generated at the edge of the first recess 11 is reduced, and the stress applied to the nitride semiconductor layer 20 from the substrate 10 is further relaxed. Further, since the second recess 13 is buried and flattened up to the upper end surface 30a of the first semiconductor layer 30, the active layer 80 included in the second semiconductor layer 40 is laminated flat.

このような製造方法によって、基板10から窒化物半導体層20にかかる応力が緩和され、窒化物半導体層20におけるクラックの発生を低減されるため、製造歩留まりが向上し、クラック発生による窒化物半導体発光素子1の突然の機能喪失などを防ぐことができる。また、エッジグロースの発生が低減されるため、窒化物半導体層20の上部に作製するデバイスの加工精度が向上し、製造歩留まりを向上することができる。更に、活性層80における発光強度や発振波長の均一性がよいため、安定した品質の窒化物半導体発光素子1を製造することができる。また、クラックに対する臨界膜厚を大きくできるため、窒化物半導体層20の膜厚を増加し、又はAl組成率の高い窒化物半導体を用いて窒化物半導体発光素子1を製造することができる。
以下、各工程について詳細に説明する。
By such a manufacturing method, the stress applied to the nitride semiconductor layer 20 from the substrate 10 is relieved and the generation of cracks in the nitride semiconductor layer 20 is reduced, so that the manufacturing yield is improved, and nitride semiconductor light emission due to the generation of cracks is achieved. A sudden loss of function of the element 1 can be prevented. Further, since the occurrence of edge growth is reduced, the processing accuracy of a device manufactured on the nitride semiconductor layer 20 can be improved, and the manufacturing yield can be improved. Furthermore, since the emission intensity and oscillation wavelength uniformity in the active layer 80 are good, the nitride semiconductor light emitting device 1 with stable quality can be manufactured. Moreover, since the critical film thickness with respect to a crack can be enlarged, the nitride semiconductor light-emitting element 1 can be manufactured using the nitride semiconductor with the high film thickness of the nitride semiconductor layer 20, or a high Al composition rate.
Hereinafter, each step will be described in detail.

(第1凹部形成工程)
まず、第1凹部形成工程において、図6(a)に示すような高転位密度領域10Hと低転位密度領域10Lとが交互に繰り返し形成された窒化物半導体からなる基板10に、図6(b)に示すように第1凹部11を形成する。
第1凹部11は、高転位密度領域10Hを包含するように、その幅W2が、高転位密度領域10Hの幅W3よりも広く(W2>W3)なるように形成する。
(1st recessed part formation process)
First, in the first recess forming step, a substrate 10 made of a nitride semiconductor in which high dislocation density regions 10H and low dislocation density regions 10L as shown in FIG. The first recess 11 is formed as shown in FIG.
The first recess 11 is formed so as to include the high dislocation density region 10H so that its width W2 is wider than the width W3 of the high dislocation density region 10H (W2> W3).

このような高転位密度領域10Hを有する領域の表面10aに第1凹部11を有する基板10は、第1実施形態のように、基板10を製造した後に第1凹部11を形成したものであっても、基板10を製造する段階で第1凹部11を形成したものであってもよい。また、基板10として、市販されている高転位密度領域10Hを有さない低転位密度の窒化物半導体基板を用いてもよい。   The substrate 10 having the first recess 11 on the surface 10a of the region having the high dislocation density region 10H is obtained by forming the first recess 11 after the substrate 10 is manufactured as in the first embodiment. Alternatively, the first recess 11 may be formed at the stage of manufacturing the substrate 10. Further, as the substrate 10, a low dislocation density nitride semiconductor substrate that does not have a commercially available high dislocation density region 10 </ b> H may be used.

第1実施形態のように、平坦な基板10を製造した後に、第1凹部11を形成する場合は、第1凹部11を形成する方法は特に限定されない。例えば、第1凹部11に対応したマスクパターンを用いてエッチングする方法、又はマスクパターンを使用せずに、低転位密度領域10Lと高転位密度領域10Hとのエッチング選択比を利用して高転位密度領域10Hに第1凹部11を形成する方法などがある。具体的には、BHF(バッファードフッ酸)や他の酸溶液、ドライエッチングなどにおける低転位密度領域10Lと高転位密度領域10Hとのエッチング選択比を利用して、高転位密度領域10Hを選択的にエッチングして第1凹部11を形成することができる。
後の工程で、この第1凹部11に沿って分割することができるため、第1凹部11の断面形状は下底が上底よりも短い略台形状とすることが、分割時に刃を入れやすく、好ましい。
When the first recess 11 is formed after the flat substrate 10 is manufactured as in the first embodiment, the method for forming the first recess 11 is not particularly limited. For example, a method of etching using a mask pattern corresponding to the first recess 11 or a high dislocation density using an etching selectivity between the low dislocation density region 10L and the high dislocation density region 10H without using the mask pattern. There is a method of forming the first recess 11 in the region 10H. Specifically, the high dislocation density region 10H is selected using the etching selectivity between the low dislocation density region 10L and the high dislocation density region 10H in BHF (buffered hydrofluoric acid), other acid solutions, dry etching, and the like. The first recess 11 can be formed by etching.
Since it can be divided along the first recess 11 in a later step, the cross-sectional shape of the first recess 11 should be a substantially trapezoid whose bottom is shorter than the top. ,preferable.

(第2凹部形成工程)
次に、図6(c)に示すように、第2凹部形成工程において、基板10の表面10aの全領域、すなわち第1凹部11の底面及び第1丘部12の表面に、第1凹部11よりも小さい第2凹部13を形成する。
(Second recess forming step)
Next, as shown in FIG. 6 (c), in the second recess forming step, the first recess 11 is formed on the entire surface 10 a of the substrate 10, that is, on the bottom surface of the first recess 11 and the surface of the first hill 12. A smaller second recess 13 is formed.

なお、第1凹部形成工程と第2凹部形成工程とは順序を入れ替えてもよい。まず、基板10の表面10aに第2凹部13を形成した後で、エッチングにより第1凹部11を形成する。これにより、第2凹部13の凹部形状を維持したまま、第1凹部11が形成されるため、第1凹部11の底面に第2凹部13が配設された構成の基板10を作製することができる。
また、低転位密度領域10Lに、第2凹部13のみならず、第2凹部13よりも大きい第3凹部(図示せず)を形成してもよい。第3凹部の深さ、幅は、第1凹部11と同様に形成することが好ましい。第3凹部の底面にも、第1凹部11と同様に、第2凹部13を有することが好ましい。
このように、実質的に第1凹部11の形成間隔を狭くすることで、基板10の表面10aに積層される窒化物半導体層20の歪みを低減し、基板10から窒化物半導体層20にかかる応力を緩和する効果を向上することができる。
Note that the order of the first recess forming step and the second recess forming step may be interchanged. First, after forming the second recess 13 on the surface 10a of the substrate 10, the first recess 11 is formed by etching. Thereby, since the first recess 11 is formed while maintaining the recess shape of the second recess 13, it is possible to manufacture the substrate 10 having the configuration in which the second recess 13 is disposed on the bottom surface of the first recess 11. it can.
Further, not only the second recess 13 but also a third recess (not shown) larger than the second recess 13 may be formed in the low dislocation density region 10L. The depth and width of the third recess are preferably formed in the same manner as the first recess 11. Similarly to the first recess 11, it is preferable to have the second recess 13 on the bottom surface of the third recess.
In this way, by substantially reducing the formation interval of the first recesses 11, the strain of the nitride semiconductor layer 20 stacked on the surface 10 a of the substrate 10 is reduced, and the nitride semiconductor layer 20 is applied from the substrate 10. The effect of relieving stress can be improved.

(第1半導体層形成工程)
次に、図6(d)に示すように、第1半導体層形成工程において、第1凹部11及び第2凹部13が形成された基板10の表面10a上に、窒化物半導体層20の活性層80より下層部である第1半導体層30を形成する。
(First semiconductor layer forming step)
Next, as shown in FIG. 6D, in the first semiconductor layer forming step, the active layer of the nitride semiconductor layer 20 is formed on the surface 10a of the substrate 10 on which the first recess 11 and the second recess 13 are formed. A first semiconductor layer 30, which is a lower layer than 80, is formed.

第1半導体層30の形成方法は、特に限定されないが、MOVPE(有機金属気相成長法)、MOCVD(有機金属化学気相成長法)、HVPE(ハイドライド気相成長法)、MBE(分子線エピタキシ法)など、窒化物半導体の成長方法として知られている全ての方法を好適に用いることができる。特に、MOCVDは結晶性良く成長させることができるので好ましい。また、窒化物半導体は、種々の窒化物半導体の成長方法を使用目的により適宜選択して成長させることが好ましい。   The formation method of the first semiconductor layer 30 is not particularly limited, but MOVPE (metal organic chemical vapor deposition), MOCVD (metal organic chemical vapor deposition), HVPE (hydride vapor deposition), MBE (molecular beam epitaxy). Any method known as a method for growing a nitride semiconductor can be suitably used. In particular, MOCVD is preferable because it can be grown with good crystallinity. The nitride semiconductor is preferably grown by appropriately selecting various nitride semiconductor growth methods depending on the purpose of use.

第1半導体層30は、基板10の第1凹部11及び第2凹部13の壁面から横方向へ成長しやすい条件で成長させる。このような具体的な条件としては、常圧よりも減圧で、また、1050℃以上で成長させることが好ましい。   The first semiconductor layer 30 is grown under conditions that allow it to grow laterally from the wall surfaces of the first recess 11 and the second recess 13 of the substrate 10. As such specific conditions, it is preferable to grow at a reduced pressure rather than normal pressure and at 1050 ° C. or higher.

第1半導体層30は、第1凹部11は平坦化せずに、第2凹部13のみ平坦化するように成長させる。第1凹部11を平坦化せずに、第1凹部11に対応する位置に凹部31が形成されることにより、基板10の表面10aと第1半導体層30とが歪みを生じながら連続して接触している面積が低減されるため、基板10から第1半導体層30にかかる応力を緩和することができる。
また、第2凹部13を設け、横方向成長により窒化物半導体材料で第2凹部13を埋め込むようにすることでも、基板10と第1半導体層30との間の格子定数の違いに基づく歪みが低減され、基板10から第1半導体層30にかかる応力を緩和する効果が得られる。
The first semiconductor layer 30 is grown so that only the second recess 13 is planarized without planarizing the first recess 11. By forming the recess 31 at a position corresponding to the first recess 11 without flattening the first recess 11, the surface 10 a of the substrate 10 and the first semiconductor layer 30 are continuously in contact with each other while being distorted. Since the area that is being reduced is reduced, the stress applied to the first semiconductor layer 30 from the substrate 10 can be relaxed.
In addition, by providing the second recess 13 and embedding the second recess 13 with a nitride semiconductor material by lateral growth, distortion based on the difference in lattice constant between the substrate 10 and the first semiconductor layer 30 is also caused. This reduces the stress applied to the first semiconductor layer 30 from the substrate 10.

更に、第1半導体層30を横方向成長しやすい条件で基板10の表面10a上に積むことにより、第1凹部11のエッジ部の上方にできるエッジグロースを低減らすことができる。このエッジグロースを低減することにより、基板10から第1半導体層30にかかる応力が緩和される。また、エッジグロースを低減することにより、ウエハ面内の窒化物半導体層20の膜厚分布が改善されるため、エッジ部におけるエッチング用マスクなどの付着性が改善されるなど、窒化物半導体発光素子1の加工精度が向上する。このため、クラック発生を抑制するとともに、安定した品質で窒化物半導体発光素子1を作製することができる。   Furthermore, by stacking the first semiconductor layer 30 on the surface 10a of the substrate 10 under conditions that allow easy growth in the lateral direction, the edge growth that can be formed above the edge portion of the first recess 11 can be reduced. By reducing the edge growth, the stress applied from the substrate 10 to the first semiconductor layer 30 is relaxed. Moreover, since the film thickness distribution of the nitride semiconductor layer 20 in the wafer surface is improved by reducing the edge growth, the adhesion of an etching mask or the like at the edge portion is improved. The processing accuracy of 1 is improved. For this reason, while suppressing generation | occurrence | production of a crack, the nitride semiconductor light-emitting device 1 can be produced with stable quality.

また、第2凹部13は、例えば、下地層50において埋め込んで平坦化することもできるし、n型クラッド層60やn型光ガイド層70において平坦化を完了するようにすることもできる。
また、下地層50とn型クラッド層60との間に、クラック防止層(図示せず)を形成するようにしてもよい。クラック防止層としては、好ましくは一般式がInGa1−xN(0<x≦1)で示されるIn含有の窒化物半導体を用いることができ、面内方向の緩衝層として働き、クラックの発生をより効果的に抑制することができる。
Further, the second recess 13 can be embedded and planarized in the underlayer 50, for example, or the planarization can be completed in the n-type cladding layer 60 and the n-type light guide layer 70.
Further, a crack prevention layer (not shown) may be formed between the base layer 50 and the n-type cladding layer 60. As the crack prevention layer, an In-containing nitride semiconductor represented by a general formula of In x Ga 1-x N (0 <x ≦ 1) can be preferably used, acting as an in-plane buffer layer, Can be more effectively suppressed.

(第2半導体層形成工程)
その後、図6(e)に示すように、第2半導体層形成工程において、第1半導体層30の上端面30a上に第2半導体層40を形成する。この第2半導体層40は、活性層80を含む層である。
第2半導体層40を構成する各層は、第1半導体層30と同様の方法により積層形成することができる。
(Second semiconductor layer forming step)
Thereafter, as shown in FIG. 6E, the second semiconductor layer 40 is formed on the upper end surface 30 a of the first semiconductor layer 30 in the second semiconductor layer forming step. The second semiconductor layer 40 is a layer including the active layer 80.
Each layer constituting the second semiconductor layer 40 can be stacked by the same method as the first semiconductor layer 30.

第2半導体層形成工程では、第2半導体層40の凹部31に対応する位置に凹部41が形成されるようにすることが好ましい。これによって、第1半導体層30を介して基板10から活性層80を含む第2半導体層40の各層にかかる応力を緩和することができる。   In the second semiconductor layer forming step, the recess 41 is preferably formed at a position corresponding to the recess 31 of the second semiconductor layer 40. Thereby, stress applied to each layer of the second semiconductor layer 40 including the active layer 80 from the substrate 10 through the first semiconductor layer 30 can be relaxed.

また、第2凹部13は、第1半導体層30において埋め込まれており、活性層80を含む第2半導体層40の各層は、基板10の第1丘部12の上方領域においては、平坦面上に積層されることとなる。
このため、第2半導体層40の活性層80の面内における発光強度のムラや、第2半導体層40を加工して形成される共振器42におけるレーザ発振の波長のバラツキなどを低減することができる。
The second recess 13 is embedded in the first semiconductor layer 30, and each layer of the second semiconductor layer 40 including the active layer 80 is on a flat surface in the region above the first hill portion 12 of the substrate 10. It will be laminated.
For this reason, it is possible to reduce unevenness in the emission intensity in the plane of the active layer 80 of the second semiconductor layer 40, variation in the wavelength of laser oscillation in the resonator 42 formed by processing the second semiconductor layer 40, and the like. it can.

以上の製造工程により、基板10の表面10a上に窒化物半導体層20が積層された窒化物半導体の積層構造が形成される。   Through the above manufacturing process, a nitride semiconductor multilayer structure in which the nitride semiconductor layer 20 is laminated on the surface 10a of the substrate 10 is formed.

(発光素子形成工程)
次に、図4を参照して、前記した窒化物半導体の積層構造から、窒化物半導体発光素子1を形成する発光素子形成工程について説明する。
(Light emitting element formation process)
Next, with reference to FIG. 4, the light emitting element formation process which forms the nitride semiconductor light emitting element 1 from the laminated structure of the nitride semiconductor mentioned above is demonstrated.

まず、窒化物半導体層20に対して、基板10の第1凹部11の上方領域に対応する領域を、下地層50の途中まで、エッチングする。
次に、p型コンタクト層120、p型クラッド層110及びp型光ガイド層100の途中から上の領域を、図4における横方向の中央部を残してエッチングすることによりリッジ構造を形成する。
次に、p型コンタクト層120の上端面を除く窒化物半導体層20の上端面に、スパッタ法などにより絶縁性の保護膜160を形成する。
そして、p型コンタクト層120の上端面、すなわちリッジ構造の上端面に接触するように、スパッタ法などにより金属材料からなるp側電極130を形成する。
次に、下地層50の途中まで露出した窒化物半導体層20の側面にスパッタ法などにより絶縁性の保護膜170を形成する。
そして、p側電極130の上に、スパッタ法などにより金属材料からなるp側パッド電極140を形成する。また、基板10の裏面10b側に、スパッタ法などにより金属材料からなるn側電極150を形成する。
First, the nitride semiconductor layer 20 is etched in a region corresponding to the region above the first recess 11 of the substrate 10 to the middle of the base layer 50.
Next, the ridge structure is formed by etching the upper region from the middle of the p-type contact layer 120, the p-type cladding layer 110, and the p-type light guide layer 100, leaving the central portion in the horizontal direction in FIG.
Next, an insulating protective film 160 is formed on the upper end surface of the nitride semiconductor layer 20 excluding the upper end surface of the p-type contact layer 120 by sputtering or the like.
Then, the p-side electrode 130 made of a metal material is formed by sputtering or the like so as to contact the upper end surface of the p-type contact layer 120, that is, the upper end surface of the ridge structure.
Next, an insulating protective film 170 is formed on the side surface of the nitride semiconductor layer 20 exposed partway through the underlayer 50 by sputtering or the like.
Then, a p-side pad electrode 140 made of a metal material is formed on the p-side electrode 130 by sputtering or the like. Further, an n-side electrode 150 made of a metal material is formed on the back surface 10b side of the substrate 10 by sputtering or the like.

そして、熱処理による電極の合金化などの処理を行った後、第1凹部11に沿って、一辺が150〜1000μm程度の四角形または多角形のチップに分割及び/又は劈開して、分割又は劈開面の共振器42部分の端面に反射膜(図示せず)を形成して窒化物半導体発光素子1が得られる。   Then, after performing a process such as alloying of the electrode by heat treatment, it is divided and / or cleaved into square or polygonal chips each having a side of about 150 to 1000 μm along the first recess 11, and the divided or cleaved surface A nitride semiconductor light-emitting device 1 is obtained by forming a reflection film (not shown) on the end face of the resonator 42 of FIG.

<第2実施形態>
次に、図7を参照(適宜図1及び図4参照)して、本発明の第2実施形態における基板10Aの構成について説明する。
Second Embodiment
Next, referring to FIG. 7 (refer to FIGS. 1 and 4 as appropriate), the configuration of the substrate 10A in the second embodiment of the present invention will be described.

図7に示す第2実施形態における基板10Aは、図1に示した第1実施形態の基板10に対して、帯状の開口を有する第2凹部13に替えて、特定方向に延伸せずに断続的に開口する第2凹部13Aを基板10Aの表面の全領域に形成するものである。図7に示した例は、第2凹部13Aの開口形状を正六角形としたものである。   The substrate 10A in the second embodiment shown in FIG. 7 is intermittently formed without extending in a specific direction, instead of the second recess 13 having a band-like opening, with respect to the substrate 10 of the first embodiment shown in FIG. The second concave portion 13A that is open automatically is formed in the entire region of the surface of the substrate 10A. In the example shown in FIG. 7, the opening shape of the second recess 13A is a regular hexagon.

第2実施形態において、第2凹部13Aは、正六角形の開口を有する正六角柱の形状の有底穴である。この正六角形の第2凹部13Aの開口径及び深さは、それぞれ図1に示した第1実施形態における第2凹部13の幅W5及び深さD2と同等とすることができる。   In the second embodiment, the second recess 13A is a bottomed hole in the shape of a regular hexagonal column having a regular hexagonal opening. The opening diameter and depth of the regular hexagonal second recess 13A can be equal to the width W5 and the depth D2 of the second recess 13 in the first embodiment shown in FIG.

図1に示した基板10を用いた場合と同様に、特定方向に延伸せずに断続する開口を有する第2凹部13Aが形成された基板10A上に窒化物半導体層(図示せず)を積層することにより、基板10Aに形成された第1凹部11のエッジ部上方領域の窒化物半導体層(図示せず)にエッジグロースが発生することを防止できる。その結果、窒化物半導体層(図示せず)におけるクラックの発生を低減できるとともに、レジストなどの付着性が良好なため窒化物半導体層(図示せず)を安定した精度で加工でき、高い歩留まりで窒化物半導体発光素子(図示せず)を製造することができる。   As in the case of using the substrate 10 shown in FIG. 1, a nitride semiconductor layer (not shown) is stacked on the substrate 10A on which the second recess 13A having an opening that is interrupted without extending in a specific direction is formed. By doing so, it is possible to prevent edge growth from occurring in the nitride semiconductor layer (not shown) in the region above the edge portion of the first recess 11 formed in the substrate 10A. As a result, it is possible to reduce the occurrence of cracks in the nitride semiconductor layer (not shown) and to process the nitride semiconductor layer (not shown) with stable accuracy because of good adhesion of resist and the like, with high yield. A nitride semiconductor light emitting device (not shown) can be manufactured.

また、第2凹部13Aの開口形状は正六角形に限定されず、三角形、四角形、多角形、円などとすることもできる。なお、特定方向に延伸せずに断続する開口とは、円、正方形などに限定されず、楕円、長方形、平行四辺形なども含まれ、「第1実施形態における帯状のように、基板10Aの長さや幅などの全域に渡って連続するもの」を含まないことを意味するものである。   Further, the opening shape of the second recess 13A is not limited to a regular hexagon, and may be a triangle, a quadrangle, a polygon, a circle, or the like. Note that the intermittent opening without extending in a specific direction is not limited to a circle or a square, but also includes an ellipse, a rectangle, a parallelogram, and the like. This means that it does not include “sequentially extending over the entire area such as length and width”.

また、図7に示した例では、複数の第2凹部13Aを、正六角形の角辺に垂直方向に規則的に整列するように配設したが、これに限定されるものではなく、例えば、第1凹部11の開口の長さ方向に密に配設し、垂直方向に疎に配設するようにしてもよい。また、規則的ではなく、ランダムに配設するようにしてもよい。   In the example shown in FIG. 7, the plurality of second concave portions 13A are arranged so as to be regularly aligned with the square sides of the regular hexagon in the vertical direction. However, the present invention is not limited to this. It may be arranged densely in the length direction of the opening of the first recess 11 and sparsely arranged in the vertical direction. Further, it may be arranged randomly rather than regularly.

ここで、基板10Aの表面はC面であり、第2凹部13Aは、図7において紙面の上下方向に垂直な壁面がM面であるが、第2凹部13Aの壁面には、M面又はM面に角度の近い面の露出を少なくするように形成することが好ましい。特に、M面と直交する(11−20)面(A面、図5参照)又はA面に角度が近い面で形成することが、更に好ましい。   Here, the surface of the substrate 10A is a C surface, and the second recess 13A has an M surface perpendicular to the vertical direction of the paper surface in FIG. 7, but the wall surface of the second recess 13A includes an M surface or an M surface. The surface is preferably formed so as to reduce the exposure of the surface having an angle close to the surface. In particular, it is more preferable to form a (11-20) plane (A plane, see FIG. 5) orthogonal to the M plane or a plane having an angle close to the A plane.

なお、これと反対に、第2凹部13Aに相当する小さな凹部として、M面の露出が多い横長の溝を形成すると、第1凹部11のエッジ部におけるエッジグロースの低減には効果があるが、クラック発生の抑制には効果が得られないことがある。   On the other hand, when a horizontally long groove with many exposed M faces is formed as a small concave portion corresponding to the second concave portion 13A, it is effective in reducing edge growth at the edge portion of the first concave portion 11, An effect may not be obtained in suppressing the occurrence of cracks.

また、図4に示した窒化物半導体発光素子1の基板10に替えて、第2実施形態における基板10Aを用いて窒化物半導体発光素子(図示せず)を構成することができる。基板10A以外の構成は、図4に示した窒化物半導体発光素子1と同様であるので、構成についての説明は省略する。   Further, instead of the substrate 10 of the nitride semiconductor light emitting device 1 shown in FIG. 4, a nitride semiconductor light emitting device (not shown) can be configured using the substrate 10A in the second embodiment. Since the configuration other than the substrate 10A is the same as that of the nitride semiconductor light emitting device 1 shown in FIG. 4, the description of the configuration is omitted.

図7に示した第2実施形態における基板10Aを用いて構成した窒化物半導体発光素子(図示せず)の動作は、図1乃至図4に示した窒化物半導体発光素子1と同様であるので、説明は省略する。   The operation of the nitride semiconductor light emitting device (not shown) configured using the substrate 10A in the second embodiment shown in FIG. 7 is the same as that of the nitride semiconductor light emitting device 1 shown in FIGS. The description is omitted.

図7に示した第2実施形態における基板10Aを用いて構成した窒化物半導体発光素子(図示せず)の製造方法は、図6に示した第1実施形態における窒化物半導体発光素子1の製造方法とは、図6(c)に示した第2凹部形成工程において、第2凹部13形成のための縞状に開口したマスクの替わりに、正六角形に開口したマスクを用いること以外は同様であるので、説明は省略する。   The manufacturing method of the nitride semiconductor light emitting device (not shown) configured using the substrate 10A in the second embodiment shown in FIG. 7 is the same as that of the nitride semiconductor light emitting device 1 in the first embodiment shown in FIG. The method is the same as the second recess forming step shown in FIG. 6C except that a mask opened in a regular hexagon is used in place of the mask opened in a stripe pattern for forming the second recess 13. Since there is, explanation is omitted.

<第3実施形態>
次に、図8を参照して、本発明の第3実施形態における窒化物半導体発光素子1B、1Bについて説明する。
<Third Embodiment>
Next, with reference to FIG. 8, the nitride semiconductor light emitting devices 1B 1 and 1B 2 according to the third embodiment of the present invention will be described.

図4に示した第1実施形態においては、基板10に配設された第1凹部11に挟まれた一つの第1丘部12に、一つの窒化物半導体発光素子1を形成するのに対して、図8に示す第3実施形態においては、基板10に配設された第1凹部11に挟まれた一つの第1丘部12に、二つの窒化物半導体発光素子1B、1Bを形成するものである。 In the first embodiment shown in FIG. 4, one nitride semiconductor light emitting element 1 is formed on one first hill portion 12 sandwiched between first recesses 11 provided on the substrate 10. In the third embodiment shown in FIG. 8, two nitride semiconductor light emitting devices 1 </ b > B 1 , 1 </ b > B 2 are attached to one first hill portion 12 sandwiched between first recesses 11 disposed on the substrate 10. To form.

基板10は、第1実施形態と同様のものを用いることができるが、各窒化物半導体発光素子1B、1Bのチップ毎の基板10は、第1凹部11に挟まれた図8における横方向について、第1凹部11及び第1丘部12の中間領域12aを切り代として、分割されたものである。 The substrate 10 can be the same as that of the first embodiment, but the substrate 10 for each chip of the nitride semiconductor light emitting devices 1B 1 , 1B 2 is laterally sandwiched between the first recesses 11 in FIG. The direction is divided by using the first recess 11 and the intermediate region 12a of the first hill portion 12 as a cutting margin.

基板10は、基板10から表面10a上に積層される窒化物半導体層20にかかる応力が緩和されるように、適宜な間隔で帯状の第1凹部11が縞状に配設されているものを用いる。また、基板10の表面10aの全領域、すなわち第1凹部11の底面及び第1丘部12の表面には複数の第2凹部13が形成されている。そして、第1凹部11に挟まれた第1丘部12に積層され、基板10からかかる応力が緩和された窒化物半導体の積層構造から、一つの第1丘部12毎に二つの窒化物半導体発光素子1B、1Bを形成する。これにより、基板10の元となるウエハにおける第1凹部11の面積を低減できるため、ウエハ当たりに形成される窒化物半導体発光素子1B、1Bのチップ数を増加することができる。
その他の構成は、図4に示した第1実施形態の窒化物半導体発光素子1と同様であるので、構成についての詳細な説明は省略する。
The substrate 10 has the strip-shaped first recesses 11 arranged in stripes at appropriate intervals so that the stress applied to the nitride semiconductor layer 20 stacked on the surface 10a from the substrate 10 is relieved. Use. A plurality of second recesses 13 are formed in the entire area of the surface 10 a of the substrate 10, that is, in the bottom surface of the first recess 11 and the surface of the first hill portion 12. Then, two nitride semiconductors are formed for each first hill portion 12 from a laminated structure of nitride semiconductors stacked on the first hill portion 12 sandwiched between the first recesses 11 and the stress applied from the substrate 10 being relaxed. Light emitting elements 1B 1 and 1B 2 are formed. Accordingly, it is possible to reduce the area of the first recess 11 in the wafer which is the source of the substrate 10, the number of chip nitride semiconductor are formed light-emitting element 1B 1, 1B 2 per wafer can be increased.
Since the other configuration is the same as that of the nitride semiconductor light emitting device 1 of the first embodiment shown in FIG. 4, detailed description of the configuration is omitted.

図8に示した第3実施形態における窒化物半導体発光素子1B、1Bの動作は、図4に示した第1実施形態における窒化物半導体発光素子1と同様であるので、説明は省略する。 The operations of the nitride semiconductor light emitting devices 1B 1 and 1B 2 in the third embodiment shown in FIG. 8 are the same as those of the nitride semiconductor light emitting device 1 in the first embodiment shown in FIG. .

次に、図8に示した第3実施形態の窒化物半導体発光素子1B、1Bの製造方法について説明する。
第3実施形態の窒化物半導体発光素子1B、1Bの製造方法において、基板10の表面10a上に窒化物半導体層20を積層した窒化物半導体の積層構造を作製する工程まで(第1凹部形成工程〜第2半導体層形成工程)は、図6に示した第1実施形態の窒化物半導体発光素子1の製造方法と同様であるので、これらの工程の説明は省略する。
Next, a method for manufacturing the nitride semiconductor light emitting devices 1B 1 and 1B 2 according to the third embodiment shown in FIG. 8 will be described.
In the method for manufacturing the nitride semiconductor light emitting devices 1B 1 and 1B 2 according to the third embodiment, the process up to the step of producing a nitride semiconductor laminated structure in which the nitride semiconductor layer 20 is laminated on the surface 10a of the substrate 10 (first concave portion) Since the formation process to the second semiconductor layer formation process are the same as the manufacturing method of the nitride semiconductor light emitting device 1 of the first embodiment shown in FIG. 6, the description of these processes is omitted.

次に、図8を参照して、窒化物半導体の積層構造から、窒化物半導体発光素子1B、1Bを形成する発光素子形成工程について説明する。 Next, with reference to FIG. 8, a stacked structure of a nitride semiconductor, it is described light-emitting element forming step of forming a nitride semiconductor light emitting device 1B 1, 1B 2.

まず、窒化物半導体層20に対して、基板10の第1凹部11の上方領域に対応する領域及び第1丘部12における切り代となる中間領域12aを含む領域を、下地層50の途中まで、エッチングする。   First, with respect to the nitride semiconductor layer 20, the region corresponding to the region above the first recess 11 of the substrate 10 and the region including the intermediate region 12 a serving as a cutting allowance in the first hill portion 12 are partway through the foundation layer 50. Etch.

続く、p型コンタクト層120、p型クラッド層110及びp型光ガイド層100の途中から上の領域にリッジ構造を形成する工程、p型コンタクト層120の上端面を除く窒化物半導体層20の上端面に絶縁性の保護膜160を形成する工程、p型コンタクト層120の上端面に接触するようにp側電極130を形成する工程、下地層50の途中まで露出した窒化物半導体層20の側面に絶縁性の保護膜170を形成する工程、p側電極130の上にp側パッド電極140を形成する工程、及び基板10の裏面10b側にn側電極150を形成する工程は、第1実施形態と同様であるので詳細な説明は省略する。   Next, a step of forming a ridge structure in the upper region from the middle of the p-type contact layer 120, the p-type cladding layer 110, and the p-type light guide layer 100, and the nitride semiconductor layer 20 excluding the upper end surface of the p-type contact layer 120 A step of forming an insulating protective film 160 on the upper end surface, a step of forming a p-side electrode 130 so as to be in contact with the upper end surface of the p-type contact layer 120, and the nitride semiconductor layer 20 exposed partway through the underlayer 50. The step of forming the insulating protective film 170 on the side surface, the step of forming the p-side pad electrode 140 on the p-side electrode 130, and the step of forming the n-side electrode 150 on the back surface 10b side of the substrate 10 are the first step. Since it is the same as that of embodiment, detailed description is abbreviate | omitted.

そして、熱処理による電極の合金化などの処理を行った後、第1凹部11及び第1丘部12の中間領域12aに沿って、四角形または多角形のチップに分割及び/又は劈開して、分割又は劈開面の共振器42部分の端面に反射膜(図示せず)を形成して窒化物半導体発光素子1B、1Bが得られる。 Then, after performing a process such as alloying of the electrode by heat treatment, it is divided and / or cleaved into quadrangular or polygonal chips along the intermediate region 12a of the first concave portion 11 and the first hill portion 12. Alternatively, a reflective film (not shown) is formed on the end face of the resonator 42 portion of the cleavage plane, so that the nitride semiconductor light emitting devices 1B 1 and 1B 2 are obtained.

なお、第3実施形態では、基板10に配設された第1凹部11に挟まれた一つの第1丘部12に、二つの窒化物半導体発光素子1B、1Bを形成することとしたが、これに限定されるものではなく、第1凹部11に挟まれた一つの第1丘部12に、三つ以上の窒化物半導体発光素子を形成することもできる。
また、基板10に形成する第2凹部13は溝状、すなわち帯状の開口を有する凹部に限定されるものではなく、第2凹部13に替えて、第2実施形態における正六角形などの開口を有する第2凹部13Aを形成するようにしてもよい。
In the third embodiment, two nitride semiconductor light emitting devices 1B 1 and 1B 2 are formed in one first hill portion 12 sandwiched between the first recesses 11 disposed on the substrate 10. However, the present invention is not limited to this, and three or more nitride semiconductor light emitting elements can be formed in one first hill portion 12 sandwiched between the first recesses 11.
In addition, the second recess 13 formed in the substrate 10 is not limited to a recess having a groove, that is, a strip-shaped opening, and instead of the second recess 13, the second recess 13 has an opening such as a regular hexagon in the second embodiment. The second recess 13A may be formed.

<第4実施形態>
次に、図9を参照(適宜図1参照)して、本発明における第4実施形態の窒化物半導体発光素子1Cの構成について説明する。第1実施形態乃至第3実施形態の窒化物半導体発光素子1、1B、1Bなどはレーザ素子の構成としたが、第4実施形態の窒化物半導体発光素子1CはLED(発光ダイオード)素子の構成である。
<Fourth embodiment>
Next, with reference to FIG. 9 (refer to FIG. 1 as appropriate), the structure of the nitride semiconductor light emitting device 1C according to the fourth embodiment of the present invention will be described. The nitride semiconductor light emitting elements 1 , 1B 1 , 1B 2 and the like of the first to third embodiments are configured as laser elements, but the nitride semiconductor light emitting element 1C of the fourth embodiment is an LED (light emitting diode) element. It is the composition.

<構成>
図9に示す第4実施形態の窒化物半導体発光素子1Cは、窒化物半導体からなる基板10の表面10a上に第1半導体層30C及び第2半導体層40Cからなる窒化物半導体層20Cが積層されている。第1半導体層30Cは、下地層(第1のn型半導体層)50C及びn型コンタクト層(第2のn型半導体層)180からなり、第2半導体層40Cは、活性層80及びp型半導体層190からなる。
<Configuration>
In the nitride semiconductor light emitting device 1C of the fourth embodiment shown in FIG. 9, a nitride semiconductor layer 20C composed of a first semiconductor layer 30C and a second semiconductor layer 40C is stacked on a surface 10a of a substrate 10 composed of a nitride semiconductor. ing. The first semiconductor layer 30C includes a base layer (first n-type semiconductor layer) 50C and an n-type contact layer (second n-type semiconductor layer) 180. The second semiconductor layer 40C includes the active layer 80 and the p-type. It consists of a semiconductor layer 190.

窒化物半導体層20Cの上端面(p型半導体層190の上端面)はp側電極130Cとオーミック接触しており、更にp側電極130Cはp側パッド電極140Cと電気的に接続されている。また、窒化物半導体層20Cの上端面の一部に凹部21が設けられ、この凹部21の底面はn型コンタクト層180の露出面180aである。そして、このn型コンタクト層180の露出面180a上に、n側電極150Cが設けられ、n側電極150Cとn型コンタクト層180とがオーミック接触している。   The upper end surface of the nitride semiconductor layer 20C (the upper end surface of the p-type semiconductor layer 190) is in ohmic contact with the p-side electrode 130C, and the p-side electrode 130C is electrically connected to the p-side pad electrode 140C. A recess 21 is provided in a part of the upper end surface of the nitride semiconductor layer 20 </ b> C, and the bottom surface of the recess 21 is an exposed surface 180 a of the n-type contact layer 180. An n-side electrode 150C is provided on the exposed surface 180a of the n-type contact layer 180, and the n-side electrode 150C and the n-type contact layer 180 are in ohmic contact.

次に、各部の構成について説明する。
第4実施形態における基板10は、第1実施形態乃至第3実施形態の基板10と同様のものを用いることができる。図9に示した第4実施形態における基板10は、第3実施形態における基板10と同様に、第1凹部11及び第1丘部12の中間領域12a(図8参照)に沿って分割されたものである。
Next, the configuration of each unit will be described.
The substrate 10 in the fourth embodiment can be the same as the substrate 10 in the first to third embodiments. The substrate 10 in the fourth embodiment shown in FIG. 9 is divided along the intermediate region 12a (see FIG. 8) of the first recess 11 and the first hill portion 12 in the same manner as the substrate 10 in the third embodiment. Is.

第1半導体層30Cは、下地層50Cとn型コンタクト層180とから構成されるn型半導体層である。   The first semiconductor layer 30 </ b> C is an n-type semiconductor layer including the base layer 50 </ b> C and the n-type contact layer 180.

第4実施形態においては、下地層50Cにおいて、第2凹部13が埋め込まれており、第1丘部12の上方領域における下地層50Cの上端面は平坦化されている。下地層50Cとしては、AlGa1−aN(0≦a≦1)が一例として挙げられる。この下地層50は、n型コンタクト層180と兼用するようにしてもよい。 In the fourth embodiment, the second recess 13 is embedded in the base layer 50C, and the upper end surface of the base layer 50C in the upper region of the first hill portion 12 is flattened. An example of the underlayer 50C is Al a Ga 1-a N (0 ≦ a ≦ 1). The underlayer 50 may also be used as the n-type contact layer 180.

n型コンタクト層180は、オーミック接触するn側電極150Cから電力の供給を受け、電子を活性層80に注入する層である。
n型コンタクト層180は、例えば、n型不純物としてSiがドープされたGaNや、SiがドープされたGaNからなるn型コンタクト層とn型AlGaNからなるn型クラッド層とをこの順に積層した2層構造とすることができる。また、2層構造とする場合のn型クラッド層として、図4に示した第1実施形態におけるn型クラッド層60と同様の材料を用いて構成とすることもできる。
The n-type contact layer 180 is a layer that receives power supplied from the n-side electrode 150 </ b> C that is in ohmic contact and injects electrons into the active layer 80.
The n-type contact layer 180 includes, for example, a GaN layer doped with Si as an n-type impurity, an n-type contact layer made of Si-doped GaN, and an n-type cladding layer made of n-type AlGaN in this order. It can be a layered structure. Further, the n-type cladding layer in the case of a two-layer structure can be configured using the same material as that of the n-type cladding layer 60 in the first embodiment shown in FIG.

また、n型コンタクト層180は、下地層50Cと兼用するようにしてもよい。この場合は、n型コンタクト層180において第2凹部13が埋め込まれ、第1丘部12の上方領域におけるその上端面、すなわち第1半導体層30Cの上端面において、平坦となるようにすればよい。   The n-type contact layer 180 may also be used as the base layer 50C. In this case, the second recess 13 is embedded in the n-type contact layer 180, and the upper end surface in the upper region of the first hill portion 12, that is, the upper end surface of the first semiconductor layer 30C may be flat. .

活性層80は、n型コンタクト層180から注入された電子と、p型半導体層190から注入されたホールとが再結合して光を生成する層である。活性層80は、第2凹部13が埋め込まれ平坦となった第1半導体層30Cの上に積層される。このため、活性層80の面内における発光強度のムラが低減される。
活性層80は、第1実施形態における活性層80と同様の構成とすることができるため、詳細な説明は省略する。
The active layer 80 is a layer that generates light through recombination of electrons injected from the n-type contact layer 180 and holes injected from the p-type semiconductor layer 190. The active layer 80 is stacked on the first semiconductor layer 30 </ b> C that is flattened by embedding the second recess 13. For this reason, unevenness of the emission intensity in the plane of the active layer 80 is reduced.
Since the active layer 80 can have the same configuration as the active layer 80 in the first embodiment, a detailed description thereof is omitted.

p型半導体層190は、上端面がp側電極130Cとオーミック接触し、p側電極130Cから電力の供給を受け、ホールを活性層80に注入する層である。
p型半導体層190は、例えば、p型不純物としてMgがドープされたGaNや、n型AlGaNからなるn型クラッド層とMgがドープされたGaNからなるp型コンタクト層とをこの順に積層した2層構造とすることができる。また、2層構造とする場合のp型クラッド層及びp型コンタクト層として、図4に示した第1実施形態におけるp型クラッド層110及びp型コンタクト層120と同様の材料を用いて構成することもできる。
The p-type semiconductor layer 190 is a layer whose upper end surface is in ohmic contact with the p-side electrode 130 </ b> C, receives power supplied from the p-side electrode 130 </ b> C, and injects holes into the active layer 80.
The p-type semiconductor layer 190 is, for example, a laminate of a GaN doped with Mg as a p-type impurity, an n-type cladding layer made of n-type AlGaN, and a p-type contact layer made of GaN doped with Mg in this order. It can be a layered structure. Further, the p-type cladding layer and the p-type contact layer in the case of the two-layer structure are configured using the same materials as the p-type cladding layer 110 and the p-type contact layer 120 in the first embodiment shown in FIG. You can also

p側電極130Cは、窒化物半導体層20Cに電力を供給するための正極である。p側電極130Cは、p型半導体層190の上端面のほぼ全領域とオーミック接触する透光性の全面電極であり、p側電極130Cの上端面の一部に設けられたp側パッド電極140Cと電気的に接続されている。   The p-side electrode 130C is a positive electrode for supplying power to the nitride semiconductor layer 20C. The p-side electrode 130C is a translucent full-surface electrode that is in ohmic contact with almost the entire region of the upper end surface of the p-type semiconductor layer 190, and a p-side pad electrode 140C provided on a part of the upper end surface of the p-side electrode 130C. And are electrically connected.

第4実施形態の窒化物半導体発光素子1Cは、電極配置面側からも光を取り出す構成であるため、p側電極130Cが、活性層80から放出される光の波長において透光性を有することが好ましい。このような透光性と導電性とを兼ね備えた材料として、例えば、ITO(酸化インジウムスズ)、ZnO、p型半導体層190側から順にNi、Auを積層した金属薄膜、Ag、Ni、Auなどの金属又はこれらの合金の薄膜などを用いることができる。
p側電極130Cは、前記した材料を、例えば、スパッタ法や蒸着法などによって積層して形成することができる。
Since the nitride semiconductor light emitting device 1C of the fourth embodiment is configured to extract light also from the electrode arrangement surface side, the p-side electrode 130C has translucency at the wavelength of light emitted from the active layer 80. Is preferred. Examples of materials having both translucency and conductivity include, for example, ITO (indium tin oxide), ZnO, a metal thin film in which Ni and Au are stacked in this order from the p-type semiconductor layer 190 side, Ag, Ni, Au, and the like. A thin film of these metals or an alloy thereof can be used.
The p-side electrode 130C can be formed by stacking the above-described materials by, for example, a sputtering method or a vapor deposition method.

p側パッド電極140Cは、p側電極130Cの上端面の一部に設けられ、外部電源(図示せず)とAuワイヤ(図示せず)などで接続され、p側電極130Cに電力を供給するための電極パッドである。
p側パッド電極140Cは、図4に示した第1実施形態におけるp側パッド電極140と同様の材料を用いて構成することができる。
The p-side pad electrode 140C is provided on a part of the upper end surface of the p-side electrode 130C, is connected to an external power source (not shown) by an Au wire (not shown), etc., and supplies power to the p-side electrode 130C. It is an electrode pad for.
The p-side pad electrode 140C can be configured using the same material as the p-side pad electrode 140 in the first embodiment shown in FIG.

n側電極150Cは、窒化物半導体層20Cに電力を供給するための負極である。n側電極150Cは、n型コンタクト層180の露出面180a上に形成され、n型コンタクト層180とオーミック接触している。
n側電極150Cは、図4に示した第1実施形態におけるn側電極150と同様の材料を用いて構成することができる。
The n-side electrode 150C is a negative electrode for supplying power to the nitride semiconductor layer 20C. The n-side electrode 150 </ b> C is formed on the exposed surface 180 a of the n-type contact layer 180 and is in ohmic contact with the n-type contact layer 180.
The n-side electrode 150C can be configured using the same material as the n-side electrode 150 in the first embodiment shown in FIG.

また、図4に示した第1実施形態における窒化物半導体発光素子1のように、窒化物半導体発光素子1Cの、p側パッド電極140C及びn側電極150Cを除く上端面及び側面を絶縁性の保護膜で被覆するようにしてもよい。   Further, like the nitride semiconductor light emitting device 1 in the first embodiment shown in FIG. 4, the upper end surface and side surfaces of the nitride semiconductor light emitting device 1C excluding the p-side pad electrode 140C and the n-side electrode 150C are insulated. You may make it coat | cover with a protective film.

その他、窒化物半導体発光素子1Cの構成は、少なくとも、活性層80が積層される第1半導体層30Cの上端面において、第2凹部13が埋め込まれて平坦化されていればよく、窒化物半導体層20Cの層構成や電極の配置など、他の発光ダイオード素子構成としてもよい。   In addition, the configuration of the nitride semiconductor light emitting device 1C is sufficient if the second recess 13 is embedded and planarized at least on the upper end surface of the first semiconductor layer 30C on which the active layer 80 is stacked. Other light emitting diode element configurations such as a layer configuration of the layer 20C and electrode arrangement may be employed.

<動作>
次に、図9を参照して、本発明の第4実施形態における窒化物半導体発光素子(窒化物半導体発光ダイオード素子)1Cの動作について説明する。
<Operation>
Next, the operation of the nitride semiconductor light emitting device (nitride semiconductor light emitting diode device) 1C according to the fourth embodiment of the present invention will be described with reference to FIG.

p側電極130C(p側パッド電極140C)を正極、n側電極150Cを負極として、窒化物半導体層20Cに順方向に電圧を印加することにより、n型コンタクト層180から電子が活性層80に注入されるとともに、p型半導体層190からホールが活性層80に注入される。活性層80では、注入された電子とホールとが再結合し、光を生成する。   By applying a forward voltage to the nitride semiconductor layer 20C using the p-side electrode 130C (p-side pad electrode 140C) as a positive electrode and the n-side electrode 150C as a negative electrode, electrons are transferred from the n-type contact layer 180 to the active layer 80. While being injected, holes are injected from the p-type semiconductor layer 190 into the active layer 80. In the active layer 80, the injected electrons and holes recombine to generate light.

活性層80で生成された光は、窒化物半導体層20C、透光性のp側電極130C及び基板10を透過し、窒化物半導体発光素子1Cの外部に取り出される。   The light generated in the active layer 80 passes through the nitride semiconductor layer 20C, the translucent p-side electrode 130C, and the substrate 10, and is extracted outside the nitride semiconductor light emitting device 1C.

<製造方法>
引き続き、図9を参照して、第4実施形態における窒化物半導体発光素子1Cの製造方法について説明する。
第4実施形態の窒化物半導体発光素子1Cの製造方法において、基板10上に窒化物半導体の積層構造を形成するまでの製造工程は、前記した窒化物半導体層20Cの各層を構成する材料を用いて、図6に示した第1実施形態と同様の製造工程とすることができる。
<Manufacturing method>
Next, with reference to FIG. 9, a method for manufacturing the nitride semiconductor light emitting device 1C in the fourth embodiment will be described.
In the method for manufacturing the nitride semiconductor light emitting device 1C according to the fourth embodiment, the manufacturing process until the nitride semiconductor multilayer structure is formed on the substrate 10 uses the material constituting each layer of the nitride semiconductor layer 20C. Thus, the manufacturing process can be the same as that of the first embodiment shown in FIG.

このとき、第1半導体層30Cは、第1凹部11は平坦化せずに、第2凹部13のみ平坦化するように成長させる。すなわち、第1凹部11を平坦化せずに、第1凹部11に対応する位置に凹部31(図6参照)が形成されるようにする。また、第2半導体層40Cは、第1半導体層30Cの凹部31(図6参照)に対応する位置に凹部41(図6参照)が形成されるように成長させることが好ましい。   At this time, the first semiconductor layer 30C is grown so that only the second recess 13 is planarized without planarizing the first recess 11. That is, the recess 31 (see FIG. 6) is formed at a position corresponding to the first recess 11 without flattening the first recess 11. In addition, the second semiconductor layer 40C is preferably grown such that a recess 41 (see FIG. 6) is formed at a position corresponding to the recess 31 (see FIG. 6) of the first semiconductor layer 30C.

次に、発光素子形成工程において、窒化物半導体層20Cの上端面にスパッタ法などにより、ITOなどの透光性の導電材料からなるp側電極130Cを形成する。   Next, in the light emitting element forming step, a p-side electrode 130C made of a light-transmitting conductive material such as ITO is formed on the upper end surface of the nitride semiconductor layer 20C by sputtering or the like.

続いて、p側電極130Cの層を含めて、窒化物半導体層20Cに対して、第3実施形態と同様に、基板10の第1凹部11の上方領域に対応する領域及び第1丘部12の中間領域12a(図8参照)を、下地層50Cの途中までエッチングする。また、窒化物半導体層20Cに対して、n側電極150Cを形成するために、窒化物半導体層20Cの一部の領域をn型コンタクト層180が露出するまでエッチングする。   Subsequently, in the nitride semiconductor layer 20C including the layer of the p-side electrode 130C, the region corresponding to the upper region of the first recess 11 of the substrate 10 and the first hill portion 12 are formed as in the third embodiment. The intermediate region 12a (see FIG. 8) is etched partway through the underlayer 50C. Further, in order to form the n-side electrode 150C for the nitride semiconductor layer 20C, a part of the nitride semiconductor layer 20C is etched until the n-type contact layer 180 is exposed.

次に、n型コンタクト層180の露出面180a上にスパッタ法などにより金属材料からなるn側電極150Cを形成する。また、p側電極130Cの一部にスパッタ法などにより金属材料からなるp側パッド電極140Cを形成する。
なお、p側パッド電極140C及びn側電極150Cとして同じ材料を用いる場合は、これらは同じ工程で形成するようにしてもよい。
Next, an n-side electrode 150C made of a metal material is formed on the exposed surface 180a of the n-type contact layer 180 by sputtering or the like. Further, a p-side pad electrode 140C made of a metal material is formed on a part of the p-side electrode 130C by sputtering or the like.
When the same material is used for the p-side pad electrode 140C and the n-side electrode 150C, these may be formed in the same process.

そして、熱処理による電極の合金化などの処理を行った後、第1凹部11及び第1丘部12の中間領域12a(図8参照)に沿って、一辺が150〜1000μm程度の四角形または多角形のチップに分割及び/又は劈開して、窒化物半導体発光素子1Cが得られる。   Then, after performing a process such as alloying of the electrode by heat treatment, a rectangular or polygonal shape having a side of about 150 to 1000 μm along the intermediate region 12a (see FIG. 8) of the first concave portion 11 and the first hill portion 12. By dividing and / or cleaving the chip, a nitride semiconductor light emitting device 1C is obtained.

次に、本発明の効果を確認するための実施例及び比較例について適宜図1及び図4を参照して説明する。
(実施例1)
本実施例では、図1に示した基板10を用い、図4に示した構成の窒化物半導体層20を基板10上に積層した積層構造体を以下の方法で作製する。
基板10として、C面を主面(表面10a)とし、高転位密度領域10Hと低転位密度領域10Lとを交互に縞状に有するGaN基板を用いる。
Next, examples and comparative examples for confirming the effects of the present invention will be described with reference to FIGS. 1 and 4 as appropriate.
Example 1
In this example, a laminated structure in which the nitride semiconductor layer 20 having the configuration shown in FIG. 4 is laminated on the substrate 10 using the substrate 10 shown in FIG. 1 is manufactured by the following method.
As the substrate 10, a GaN substrate having a C-plane as a main surface (surface 10a) and alternately having high dislocation density regions 10H and low dislocation density regions 10L is used.

まず、基板10の表面10aに第1凹部11を形成する。そして第1丘部12に相当する低転位密度領域10L上に、SiOからなるマスクをパターン形成する。このとき、高転位密度領域10Hを含む領域がマスクの開口部とする。その後、Clガスを用いたRIE(反応性イオンエッチング)によりエッチングを行い、幅W2が60μmであり、深さD1が2.4μmである第1凹部11を形成する。次に、第1凹部11の底面及び低転位密度領域10Lである第1丘部12の表面に、第1凹部11よりも小さい第2凹部13を第1凹部11と同様の方法で形成する。第2凹部13の幅W5は3μmであり、隣接する第2凹部13同士の間隔である第2丘部14の幅W4は3μmである。深さD2は0.4μmとする。第1凹部11、第2凹部13ともに、開口がM面と垂直になる方向に延伸する溝を縞状に配設して形成する。すなわち、縞状に配設された第1凹部11及び第2凹部13の壁面にはA面が露出しており、M面が露出しないように形成される。また、第1凹部11及び第2凹部13の底面にはC面が露出している。このような第1凹部11及び第2凹部13が形成された基板10を、MOCVD装置に搬送し、窒化物半導体層20を形成する。 First, the first recess 11 is formed in the surface 10 a of the substrate 10. Then, a mask made of SiO 2 is patterned on the low dislocation density region 10L corresponding to the first hill portion 12. At this time, a region including the high dislocation density region 10H is an opening of the mask. Thereafter, etching is performed by RIE (reactive ion etching) using Cl 2 gas to form a first recess 11 having a width W2 of 60 μm and a depth D1 of 2.4 μm. Next, a second recess 13 smaller than the first recess 11 is formed in the same manner as the first recess 11 on the bottom surface of the first recess 11 and the surface of the first hill portion 12 which is the low dislocation density region 10L. The width W5 of the second recess 13 is 3 μm, and the width W4 of the second hill portion 14 that is the interval between the adjacent second recesses 13 is 3 μm. The depth D2 is 0.4 μm. Both the first concave portion 11 and the second concave portion 13 are formed by arranging stripes extending in the direction in which the opening is perpendicular to the M-plane. That is, the A surface is exposed on the wall surfaces of the first concave portion 11 and the second concave portion 13 arranged in stripes, and the M surface is not exposed. Further, the C surface is exposed on the bottom surfaces of the first recess 11 and the second recess 13. The substrate 10 on which the first recess 11 and the second recess 13 are formed is transported to the MOCVD apparatus, and the nitride semiconductor layer 20 is formed.

まず、基板10上に第1のn型半導体層として、Si含有のAl0.02Ga0.98Nからなる下地層50を膜厚2.0μmに成長させる。 First, a base layer 50 made of Si-containing Al 0.02 Ga 0.98 N is grown as a first n-type semiconductor layer on the substrate 10 to a thickness of 2.0 μm.

下地層50上に第2のn型半導体層として、Si含有のIn0.05Ga0.95Nからなるクラック防止層(図示せず)を膜厚0.15μmに成長させる。 A crack prevention layer (not shown) made of Si-containing In 0.05 Ga 0.95 N is grown as a second n-type semiconductor layer on the underlayer 50 to a thickness of 0.15 μm.

クラック防止層(図示せず)上に第3のn型半導体層として、Si含有のAl0.11Ga0.89Nからなるn型クラッド層60を膜厚1.0μmに成長させる。 An n-type cladding layer 60 made of Si-containing Al 0.11 Ga 0.89 N is grown to a thickness of 1.0 μm as a third n-type semiconductor layer on the crack prevention layer (not shown).

次に、n型クラッド層60上に第4のn型半導体層として、アンドープのAl0.05Ga0.95Nからなるn型光ガイド層70を0.14μmの膜厚に成長させる。 Next, an n-type light guide layer 70 made of undoped Al 0.05 Ga 0.95 N is grown as a fourth n-type semiconductor layer on the n-type cladding layer 60 to a thickness of 0.14 μm.

n型光ガイド層70上に3層構造の活性層80を形成する。活性層80は、まず、Si含有のAl0.11Ga0.89Nよりなる障壁層を105Åの膜厚に成長させる。続いて、アンドープのGaNよりなる井戸層を175Åの膜厚に成長させる。最後にアンドープのAl0.11Ga0.89Nよりなる障壁層を75Åの膜厚に成長させて層膜厚355Åの単一量子井戸構造(SQW)の活性層80を形成する。 An active layer 80 having a three-layer structure is formed on the n-type light guide layer 70. In the active layer 80, first, a barrier layer made of Si-containing Al 0.11 Ga 0.89 N is grown to a thickness of 105 mm. Subsequently, a well layer made of undoped GaN is grown to a thickness of 175 mm. Finally, a barrier layer made of undoped Al 0.11 Ga 0.89 N is grown to a thickness of 75 mm to form an active layer 80 having a single quantum well structure (SQW) having a thickness of 355 mm.

活性層80上に第1のp型半導体層として、Mg含有のAl0.20Ga0.80Nからなるp型キャップ層90を130Åの膜厚に成長させる。 A p-type cap layer 90 made of Mg-containing Al 0.20 Ga 0.80 N is grown as a first p-type semiconductor layer on the active layer 80 to a thickness of 130 Å.

p型キャップ層90上に第2のp型半導体層として、アンドープのAl0.05Ga0.95Nからなるp型光ガイド層100を0.15μmの膜厚に成長させる。 A p-type light guide layer 100 made of undoped Al 0.05 Ga 0.95 N is grown as a second p-type semiconductor layer on the p-type cap layer 90 to a thickness of 0.15 μm.

p型光ガイド層100上に第3のp型半導体層として、p型クラッド層110を形成する。p型クラッド層110は、まず、アンドープのAl0.14Ga0.86NからなるA層を80Åの膜厚に成長させ、その上にMgドープのAl0.06Ga0.94NからなるB層を80Åの膜厚に成長させる。これを28回繰り返して、A層とB層とを交互に積層して、層膜厚0.45μmの多層膜(超格子構造)を形成して、p型クラッド層110とする。 A p-type cladding layer 110 is formed on the p-type light guide layer 100 as a third p-type semiconductor layer. In the p-type cladding layer 110, first, an A layer made of undoped Al 0.14 Ga 0.86 N is grown to a thickness of 80 mm, and then Mg-doped Al 0.06 Ga 0.94 N is made thereon. The B layer is grown to a thickness of 80 mm. This is repeated 28 times, and the A layer and the B layer are alternately laminated to form a multilayer film (superlattice structure) having a layer thickness of 0.45 μm.

最後に、p型クラッド層110上に第4のp型半導体層として、MgドープのGaNからなるp型コンタクト層120を150Åの膜厚に成長させる。
以上のようにして基板10上に窒化物半導体層20を成長させた積層構造体を形成する。
Finally, a p-type contact layer 120 made of Mg-doped GaN is grown on the p-type cladding layer 110 as a fourth p-type semiconductor layer to a thickness of 150 mm.
As described above, a stacked structure in which the nitride semiconductor layer 20 is grown on the substrate 10 is formed.

(実施例2)
実施例2として、実施例1において、基板10の替わりに図7に示した基板10Aを用いて窒化物半導体層20の積層構造体を作製する。基板10Aの正六角形の開口を有する第2凹部13Aは、正六角形の一辺の長さを3μm、深さを0.4μmとし、隣接する第2凹部13A同士の間隔を2μmとする。
基板10Aの第2凹部13Aの形状の違い以外は、実施例1と同様にして作製する。
(Example 2)
As Example 2, a stacked structure of the nitride semiconductor layer 20 is produced using the substrate 10A shown in FIG. The second recess 13A having a regular hexagonal opening in the substrate 10A has a regular hexagonal side length of 3 μm and a depth of 0.4 μm, and an interval between adjacent second recesses 13A of 2 μm.
The substrate is manufactured in the same manner as in Example 1 except for the difference in the shape of the second recess 13A of the substrate 10A.

(比較例1)
比較例1として、実施例1において、基板10の替わりに、第2凹部13を形成しない従来技術における基板を用いて窒化物半導体層20の積層構造体を作製する。基板の違い以外は、実施例1と同様にして作製する。
(Comparative Example 1)
As a comparative example 1, a laminated structure of the nitride semiconductor layer 20 is manufactured using a substrate in the related art in which the second recess 13 is not formed instead of the substrate 10 in the first embodiment. The substrate is manufactured in the same manner as in Example 1 except for the difference in substrate.

(実験結果)
前記した実施例及び比較例の積層構造体について、窒化物半導体層20を光学顕微鏡で観察して、縦20mm×横500μmの範囲におけるクラック数を計数した結果を以下に示す。但し、クラック数は、従来技術である比較例1の場合を基準にした百分率で示す。
実施例1 62%
実施例2 77%
比較例1 100%
(Experimental result)
With respect to the laminated structures of the above-described examples and comparative examples, the nitride semiconductor layer 20 was observed with an optical microscope, and the results of counting the number of cracks in a range of 20 mm long × 500 μm wide are shown below. However, the number of cracks is shown as a percentage based on the case of Comparative Example 1 which is a conventional technique.
Example 1 62%
Example 2 77%
Comparative Example 1 100%

実験結果に示したように、従来技術である比較例1に比べて、実施例1及び実施例2では、クラックの発生が抑制されている。
また、実施例1及び実施例2の積層構造体を用いて窒化物半導体発光素子(窒化物半導体レーザ素子)を作製することにより、信頼性のよい装置とすることができる。
As shown in the experimental results, the occurrence of cracks is suppressed in Example 1 and Example 2 as compared to Comparative Example 1 which is a conventional technique.
Further, by manufacturing a nitride semiconductor light emitting element (nitride semiconductor laser element) using the stacked structure of Example 1 and Example 2, a highly reliable device can be obtained.

(実施例3)
また、図9に示した第4実施形態における実施例として、窒化物半導体発光素子(窒化物半導体発光ダイオード素子)を作製する。
(Example 3)
Further, as an example of the fourth embodiment shown in FIG. 9, a nitride semiconductor light emitting device (nitride semiconductor light emitting diode device) is manufactured.

実施例3において、基板10として、転位欠陥が集中した高転位密度領域を有さない、低転位密度の窒化物半導体からなるAlN基板を用いる。まず、実施例1と同様にして作製した基板10の表面10a上に、第1のn型半導体層として、アンドープのGaNからなる膜厚4μmの下地層50Cを形成する。
次に、第2のn型半導体層として、Si含有のAl0.07Ga0.93Nからなる約2μmの膜厚のn型コンタクト層180を形成する。
In Example 3, an AlN substrate made of a low dislocation density nitride semiconductor that does not have a high dislocation density region where dislocation defects are concentrated is used as the substrate 10. First, a 4 μm-thick underlayer 50C made of undoped GaN is formed as a first n-type semiconductor layer on the surface 10a of the substrate 10 manufactured in the same manner as in Example 1.
Next, as the second n-type semiconductor layer, an n-type contact layer 180 having a thickness of about 2 μm made of Si-containing Al 0.07 Ga 0.93 N is formed.

次に、活性層80として、SiをドープしたAl0.1Ga0.9Nからなる障壁層と、アンドープのIn0.05Ga0.95Nからなる井戸層とを、第1障壁層/第1井戸層/第2障壁層/第2井戸層/第3障壁層/第3井戸層/第4障壁層/第4井戸層/第5障壁層/第5井戸層/第6障壁層の順に積層する。このとき、第1障壁層〜第5障壁層を200Å、第6障壁層を400Å、第1井戸層〜第5井戸層を150Åの膜厚で形成する。但し、第6障壁層のみアンドープのAl0.1Ga0.9Nとする。 Next, as the active layer 80, a barrier layer made of Si-doped Al 0.1 Ga 0.9 N and a well layer made of undoped In 0.05 Ga 0.95 N are used as the first barrier layer / First well layer / second barrier layer / second well layer / third barrier layer / third well layer / fourth barrier layer / fourth well layer / fifth barrier layer / fifth well layer / sixth barrier layer Laminate in order. At this time, the first barrier layer to the fifth barrier layer are formed with a thickness of 200 mm, the sixth barrier layer with a thickness of 400 mm, and the first well layer to the fifth well layer with a thickness of 150 mm. However, only the sixth barrier layer is made of undoped Al 0.1 Ga 0.9 N.

また、p型半導体層190を3層構造とし、活性層80上に順次積層する。
まず、第1のp型半導体層として、MgドープのAl0.3Ga0.7Nからなる膜厚220Åのp型クラッド層を形成する。
次に、第2のp型半導体層として、Al0.07Ga0.93Nからなる膜厚0.1μmの第1のp型コンタクト層を形成する。
そして、第3のp型半導体層として、MgドープのAl0.07Ga0.93Nからなる膜厚0.02μmの第2のp型コンタクト層を形成する。
以上のようにして、基板10上に窒化物半導体層20Cを成長させた積層構造体を形成する。その後、p側電極130Cの層を含む窒化物半導体の積層構造体の一部をエッチングして、n型コンタクト層180を露出させる。
Further, the p-type semiconductor layer 190 has a three-layer structure and is sequentially stacked on the active layer 80.
First, as a first p-type semiconductor layer, a p-type cladding layer having a thickness of 220 mm made of Mg-doped Al 0.3 Ga 0.7 N is formed.
Next, a first p-type contact layer made of Al 0.07 Ga 0.93 N and having a thickness of 0.1 μm is formed as the second p-type semiconductor layer.
Then, a 0.02 μm-thick second p-type contact layer made of Mg-doped Al 0.07 Ga 0.93 N is formed as the third p-type semiconductor layer.
As described above, a stacked structure in which the nitride semiconductor layer 20C is grown on the substrate 10 is formed. Thereafter, a part of the nitride semiconductor multilayer structure including the layer of the p-side electrode 130 </ b> C is etched to expose the n-type contact layer 180.

第2のp型コンタクト層上には、Ni、Ag、Ti、Ptを材料とするp側電極130Cを形成する。
そして、p側電極130C上及びn型コンタクト層180の露出面180a上に、それぞれp側パッド電極140C及びn側電極150Cを、金属材料で形成する。
A p-side electrode 130C made of Ni, Ag, Ti, or Pt is formed on the second p-type contact layer.
Then, the p-side pad electrode 140C and the n-side electrode 150C are formed of a metal material on the p-side electrode 130C and the exposed surface 180a of the n-type contact layer 180, respectively.

また、p側パッド電極140C及びn側電極150C以外の窒化物半導体発光素子1Cの露出面にSiOからなる絶縁性の保護膜を形成する。 Further, an insulating protective film made of SiO 2 is formed on the exposed surface of the nitride semiconductor light emitting device 1C other than the p-side pad electrode 140C and the n-side electrode 150C.

その後、ダイシングにより素子を分割して、サイズが約1mm×約1mmの窒化物半導体発光素子1Cとする。   Thereafter, the element is divided by dicing to obtain a nitride semiconductor light emitting element 1C having a size of about 1 mm × about 1 mm.

実施例3に示したように、第1凹部11及び第2凹部13を配設した基板10を用いて発光ダイオード素子構成の窒化物半導体発光素子1Cを作製することにより、信頼性のよい装置とすることができる。   As shown in Example 3, a nitride semiconductor light-emitting element 1C having a light-emitting diode element configuration is manufactured using the substrate 10 provided with the first concave portion 11 and the second concave portion 13, whereby a highly reliable device and can do.

以上説明したように、本発明によれば、窒化物半導体基板に第2凹部を設けることにより、第1凹部のみ設けた場合に比べ、基板上に積層される窒化物半導体層におけるエッジグロースの発生が低減されるとともに、基板から窒化物半導体層にかかる応力が緩和される。このため、クラックの発生が低減できるとともに加工精度が向上し、安定して動作する窒化物半導体発光素子を作製することができる。   As described above, according to the present invention, by providing the second recess in the nitride semiconductor substrate, edge growth occurs in the nitride semiconductor layer stacked on the substrate, compared to the case where only the first recess is provided. Is reduced, and stress applied to the nitride semiconductor layer from the substrate is relieved. For this reason, the generation of cracks can be reduced, the processing accuracy is improved, and a nitride semiconductor light emitting device that operates stably can be manufactured.

本発明に係る窒化物半導体発光素子は、光ディスク用光源、ディスプレイ用光源、露光用光源などとして利用することができる。
また、本発明の窒化物半導体発光素子の実施形態の一つである窒化物半導体レーザ素子としては、端面で帰還させるファブリ・ペロ共振器を有するもの以外に、内部に回折格子を設けて帰還させるDBR(Distributed Bragg Reflector)を有するものに適用することができる。
The nitride semiconductor light emitting device according to the present invention can be used as an optical disk light source, a display light source, an exposure light source, and the like.
Further, as a nitride semiconductor laser element, which is one of the embodiments of the nitride semiconductor light emitting element of the present invention, a diffraction grating is provided inside for feedback, in addition to the one having a Fabry-Perot resonator that feeds back at the end face. The present invention can be applied to a device having a DBR (Distributed Bragg Reflector).

1、1B、1B、1C 窒化物半導体発光素子
10、10A 基板
10H 高転位密度領域
10L 低転位密度領域
12 第1丘部(凸部)
13、13A 第2凹部
14、14A 第2丘部
20、20C 窒化物半導体層
30、30C 第1半導体層
30a 上端面
31 凹部
40、40C 第2半導体層
40a 上端面
41 凹部
42 共振器
50、50C 下地層
60 n型クラッド層
70 n型光ガイド層
80 活性層
90 p型キャップ層
100 p型光ガイド層
110 p型クラッド層
120 p型コンタクト層
130、130C p側電極
140、140C p側パッド電極
150、150C n側電極
160 保護膜
170 保護膜
180 n型コンタクト層
190 p型半導体層
1 , 1B 1 , 1B 2 , 1C Nitride semiconductor light emitting device 10, 10A Substrate 10H High dislocation density region 10L Low dislocation density region 12 First hill (convex portion)
13, 13A Second recessed portion 14, 14A Second hill portion 20, 20C Nitride semiconductor layer 30, 30C First semiconductor layer 30a Upper end surface 31 Recessed portion 40, 40C Second semiconductor layer 40a Upper end surface 41 Recessed portion 42 Resonator 50, 50C Underlayer 60 n-type cladding layer 70 n-type light guide layer 80 active layer 90 p-type cap layer 100 p-type light guide layer 110 p-type cladding layer 120 p-type contact layer 130, 130C p-side electrode 140, 140C p-side pad electrode 150, 150C n-side electrode 160 protective film 170 protective film 180 n-type contact layer 190 p-type semiconductor layer

Claims (13)

窒化物半導体からなる基板と前記基板の表面に積層された窒化物半導体層とを備えた窒化物半導体発光素子であって、
前記基板の表面に形成された帯状の第1凹部と、
前記第1凹部の底面及び前記第1凹部以外の前記基板の表面である凸部に形成された複数の第2凹部とを有し、
前記窒化物半導体層は、前記基板の表面に積層された第1半導体層と、
前記第1半導体層上に積層された、少なくとも活性層を有する第2半導体層とを有し、
前記第1半導体層は、前記第1半導体層の上端面において前記第1凹部に対応する位置に凹部が形成されるように積層されたこと、
を特徴とする窒化物半導体発光素子。
A nitride semiconductor light emitting device comprising a substrate made of a nitride semiconductor and a nitride semiconductor layer laminated on the surface of the substrate,
A band-shaped first recess formed on the surface of the substrate;
A plurality of second concave portions formed on the bottom surface of the first concave portion and the convex portion which is the surface of the substrate other than the first concave portion;
The nitride semiconductor layer includes a first semiconductor layer stacked on a surface of the substrate;
A second semiconductor layer having at least an active layer stacked on the first semiconductor layer,
The first semiconductor layer is stacked such that a recess is formed at a position corresponding to the first recess on an upper end surface of the first semiconductor layer;
A nitride semiconductor light emitting device characterized by the above.
前記第1半導体層は、窒化物半導体の複数の層からなることを特徴とする請求項1に記載の窒化物半導体発光素子。   The nitride semiconductor light emitting device according to claim 1, wherein the first semiconductor layer includes a plurality of nitride semiconductor layers. 前記凸部の上方領域における前記第1半導体層の上端面は平坦化されていることを特徴とする請求項1又は請求項2に記載の窒化物半導体発光素子。   3. The nitride semiconductor light emitting device according to claim 1, wherein an upper end surface of the first semiconductor layer in a region above the convex portion is flattened. 4. 前記複数の第2凹部は、前記帯状の第1凹部の延伸方向と平行して延伸する開口を有することを特徴とする請求項1乃至請求項3の何れか一項に記載の窒化物半導体発光素子。   4. The nitride semiconductor light-emitting device according to claim 1, wherein the plurality of second recesses have openings extending in parallel with an extending direction of the belt-shaped first recess. 5. element. 前記複数の第2凹部は、特定方向に延伸せずに断続する開口を有することを特徴とする請求項1乃至請求項3の何れか一項に記載の窒化物半導体発光素子。   4. The nitride semiconductor light emitting element according to claim 1, wherein the plurality of second recesses have openings that are intermittently extended without extending in a specific direction. 5. 前記基板は、相対的に転位欠陥密度が高い高転位密度領域と、前記高転位密度領域よりも転位欠陥密度が低い低転位密度領域とを有し、
前記高転位密度領域を含む領域に前記第1凹部を設けたことを特徴とする請求項1乃至請求項5の何れか一項に記載の窒化物半導体発光素子。
The substrate has a high dislocation density region having a relatively high dislocation defect density, and a low dislocation density region having a dislocation defect density lower than that of the high dislocation density region,
6. The nitride semiconductor light emitting device according to claim 1, wherein the first recess is provided in a region including the high dislocation density region.
前記基板の表面は前記窒化物半導体のC面であり、前記帯状の第1凹部の延伸方向は前記窒化物半導体のM面に垂直であることを特徴とする請求項1乃至請求項6の何れか一項に記載の窒化物半導体発光素子。   The surface of the substrate is a C-plane of the nitride semiconductor, and the extending direction of the strip-shaped first recess is perpendicular to the M-plane of the nitride semiconductor. The nitride semiconductor light-emitting device according to claim 1. 前記第2凹部の壁面は、前記窒化物半導体のM面に平行でない面からなることを特徴とする請求項7に記載の窒化物半導体発光素子。   The nitride semiconductor light emitting device according to claim 7, wherein a wall surface of the second recess is a surface that is not parallel to the M-plane of the nitride semiconductor. 前記第1半導体層は、アルミニウムを含有する窒化物半導体を含むことを特徴とする請求項1乃至請求項8の何れか一項に記載の窒化物半導体発光素子。   9. The nitride semiconductor light emitting device according to claim 1, wherein the first semiconductor layer includes a nitride semiconductor containing aluminum. 前記第2凹部は、前記第1半導体層の前記アルミニウムを含有する窒化物半導体によって埋め込まれていることを特徴とする請求項9に記載の窒化物半導体発光素子。   The nitride semiconductor light emitting device according to claim 9, wherein the second recess is filled with a nitride semiconductor containing the aluminum of the first semiconductor layer. 前記第2半導体層は、前記第2半導体層の上端面において、前記第1凹部に対応する位置に凹部が形成されるように積層されたことを特徴とする請求項1乃至請求項10の何れか一項に記載の窒化物半導体発光素子。   11. The first semiconductor layer according to claim 1, wherein the second semiconductor layer is laminated so that a recess is formed at a position corresponding to the first recess on an upper end surface of the second semiconductor layer. The nitride semiconductor light-emitting device according to claim 1. 前記窒化物半導体発光素子は、前記第2半導体層の上端面に形成される前記凹部に沿って分割されたことを特徴とする請求項11に記載の窒化物半導体発光素子。   The nitride semiconductor light emitting device according to claim 11, wherein the nitride semiconductor light emitting device is divided along the recess formed in an upper end surface of the second semiconductor layer. 前記第2半導体層は、前記凸部の上方領域にレーザ発振のための共振器を有することを特徴とする請求項1乃至請求項12の何れか一項に記載の窒化物半導体発光素子。   13. The nitride semiconductor light emitting element according to claim 1, wherein the second semiconductor layer has a resonator for laser oscillation in a region above the convex portion.
JP2009244422A 2009-10-23 2009-10-23 Nitride semiconductor light-emitting device Pending JP2011091251A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2009244422A JP2011091251A (en) 2009-10-23 2009-10-23 Nitride semiconductor light-emitting device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2009244422A JP2011091251A (en) 2009-10-23 2009-10-23 Nitride semiconductor light-emitting device

Publications (1)

Publication Number Publication Date
JP2011091251A true JP2011091251A (en) 2011-05-06

Family

ID=44109236

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2009244422A Pending JP2011091251A (en) 2009-10-23 2009-10-23 Nitride semiconductor light-emitting device

Country Status (1)

Country Link
JP (1) JP2011091251A (en)

Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP5318281B2 (en) * 2010-03-25 2013-10-16 京セラ株式会社 Photoelectric conversion device
WO2015012017A1 (en) * 2013-07-23 2015-01-29 ウシオ電機株式会社 Nitride semiconductor light-emitting element and method for manufacturing same
WO2015152228A1 (en) * 2014-03-31 2015-10-08 ウシオ電機株式会社 Semiconductor light emitting element, method for manufacturing semiconductor light emitting element, led element and electron-beam-pumped light source device
JP2020077832A (en) * 2018-11-09 2020-05-21 旭化成株式会社 Semiconductor element and semiconductor laser diode
CN111628054A (en) * 2019-02-28 2020-09-04 日亚化学工业株式会社 Method for manufacturing semiconductor element
JP2020145417A (en) * 2019-02-28 2020-09-10 日亜化学工業株式会社 Manufacturing method for semiconductor element

Cited By (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP5318281B2 (en) * 2010-03-25 2013-10-16 京セラ株式会社 Photoelectric conversion device
WO2015012017A1 (en) * 2013-07-23 2015-01-29 ウシオ電機株式会社 Nitride semiconductor light-emitting element and method for manufacturing same
JP2015023238A (en) * 2013-07-23 2015-02-02 ウシオ電機株式会社 Nitride semiconductor light emitting element and manufacturing method of the same
WO2015152228A1 (en) * 2014-03-31 2015-10-08 ウシオ電機株式会社 Semiconductor light emitting element, method for manufacturing semiconductor light emitting element, led element and electron-beam-pumped light source device
JPWO2015152228A1 (en) * 2014-03-31 2017-04-13 ウシオ電機株式会社 Semiconductor light emitting device, method for manufacturing semiconductor light emitting device, LED device, electron beam excitation light source device
JP2020077832A (en) * 2018-11-09 2020-05-21 旭化成株式会社 Semiconductor element and semiconductor laser diode
CN111628054A (en) * 2019-02-28 2020-09-04 日亚化学工业株式会社 Method for manufacturing semiconductor element
JP2020145417A (en) * 2019-02-28 2020-09-10 日亜化学工業株式会社 Manufacturing method for semiconductor element

Similar Documents

Publication Publication Date Title
US9287445B2 (en) Nano-structured light-emitting devices
JP6947386B2 (en) Semiconductor light emitting element and manufacturing method of semiconductor light emitting element
US7583716B2 (en) Semiconductor laser device
CN101316026B (en) Nitride semiconductor laser chip and fabrication method thereof
JP4572270B2 (en) Nitride semiconductor device and manufacturing method thereof
JP4169821B2 (en) Light emitting diode
JP5627871B2 (en) Semiconductor device and manufacturing method thereof
JP6152848B2 (en) Semiconductor light emitting device
JP4446315B2 (en) Nitride semiconductor laser device manufacturing method
JP5076656B2 (en) Nitride semiconductor laser device
JP2006216772A (en) Optically integrated semiconductor light emitting element
JP2011091251A (en) Nitride semiconductor light-emitting device
JP2010251531A (en) Semiconductor light-emitting element
JP2011124521A (en) Semiconductor laser and method of manufacturing the same
JP2006165407A (en) Nitride semiconductor laser device
WO2018020793A1 (en) Semiconductor light-emitting element and method for manufacturing semiconductor light-emitting element
EP3016219B1 (en) Semiconductor laser element
JP2011054677A (en) Semiconductor light-emitting device
JP2008028375A (en) Nitride semiconductor laser device
JP5079613B2 (en) Nitride-based semiconductor laser device and manufacturing method thereof
JP4890509B2 (en) Manufacturing method of semiconductor light emitting device
JP2006179573A (en) Semiconductor laser device and its manufacturing method
WO2014192206A1 (en) Semiconductor light-emitting element
WO2024162277A1 (en) Surface-emitting laser element
JP2011023524A (en) Nitride-based semiconductor light-emitting element