JP2009199146A - プログラマブル・ロジック・コントローラ - Google Patents
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Abstract
【解決手段】プログラマブル・ロジック・コントローラPLC1は、各シーケンスエリアSA1,SA2の各シーケンス・プログラムをシーケンス演算部SOUでそれぞれ実行することにより各制御対象に対応して生成される各制御信号がいずれのシーケンスエリアの各シーケンス・プログラムに基づいて生成されたかに応じて、各制御信号に対応する各レジスタアドレスR1,R2を各制御対象に対応付けるアドレス変換を行うアドレスコンバータAC1と、アドレス変換された各レジスタアドレスに対応する入出力インタフェースとして兼用される複数の入出力端子I/Oと、を備えている。
【選択図】図1
Description
SA1,SA2,SA10,SA20 シーケンス(プログラム)エリア
SOU,SOU10,SOU20 シーケンス演算部
SW1,SW2 切替スイッチ
R1,R2,R10,R20 レジスタエリア
I/O,I/O10,I/O20 入出力端子
AC1 アドレスコンバータ
T1 入出力テーブル
Claims (8)
- 各シーケンス・プログラムをそれぞれ格納する二以上の所定数のシーケンスエリアと、前記各シーケンス・プログラムをそれぞれ実行するための演算を行うシーケンス演算部と、各制御対象に対応する各レジスタアドレスをそれぞれ保持し、前記各シーケンスエリアと一対一に対応する前記所定数のレジスタエリアと、を含む中央演算処理装置と、
前記各シーケンスエリアの前記各シーケンス・プログラムを前記シーケンス演算部でそれぞれ実行することにより前記各制御対象に対応して生成される各制御信号がいずれの前記シーケンスエリアの前記各シーケンス・プログラムに基づいて生成されたかに応じて、前記各制御信号に対応する前記各レジスタアドレスを前記各制御対象に対応付けるアドレス変換を行うアドレスコンバータと、
アドレス変換された前記各レジスタアドレスに対応する入出力インタフェースとして兼用される複数の入出力端子と、
を備えていることを特徴とするプログラマブル・ロジック・コントローラ。 - 前記アドレスコンバータは、前記各シーケンスエリアの前記各シーケンス・プログラムを前記シーケンス演算部でそれぞれ実行することにより生成される前記各制御信号と、前記各制御信号により制御される前記各制御対象との対応関係を規定すると共に、前記各制御信号の前記各入出力端子への割り当てを規定した入出力テーブルを備えていることを特徴とする請求項1に記載のプログラマブル・ロジック・コントローラ。
- 前記各レジスタエリアにそれぞれ保持されている前記各レジスタアドレスは、レジスタアドレス名に加えて、対応する前記各シーケンスエリアに応じた各PLC番号をアドレスデータの一部として有していることを特徴とする請求項1又は2に記載のプログラマブル・ロジック・コントローラ。
- 前記アドレスコンバータは、前記各制御信号が対応する前記各レジスタアドレス及び前記各PLC番号を前記アドレスデータとして前記各レジスタエリアから受け取り、前記入出力テーブルを参照して前記各レジスタアドレス及び前記各PLC番号を前記各制御対象と照合することにより、前記各制御信号の前記各レジスタアドレス及び前記各PLC番号を前記各制御対象に対応する個別のアドレスにアドレス変換し、且つ、前記各制御信号を前記各入出力端子に割り当てることを特徴とする請求項3に記載のプログラマブル・ロジック・コントローラ。
- 前記各レジスタエリアは、相互に独立して前記各レジスタアドレスをそれぞれ保持するものであることを特徴とする請求項1乃至4のいずれか一項に記載のプログラマブル・ロジック・コントローラ。
- 前記各レジスタエリアは、一部のエリア及び一部のレジスタアドレスを共有して保持し、前記各シーケンスエリアの前記各シーケンスプログラムをリンクさせるものであることを特徴とする請求項1乃至4のいずれか一項に記載のプログラマブル・ロジック・コントローラ。
- 共有される前記一部のレジスタアドレスは、レジスタアドレス名に加えて、前記一部のレジスタアドレスに対応する各制御信号が前記各シーケンスエリアの前記各シーケンスプログラムのリンクによって生成されたものであることを示す所定のPLC番号をアドレスデータの一部として有していることを特徴とする請求項6に記載のプログラマブル・ロジック・コントローラ。
- 前記各シーケンスエリアと前記シーケンス演算部との間及び前記シーケンス演算部と前記各レジスタエリアとの間にそれぞれ配設され、相互に対応する前記シーケンスエリア及び前記レジスタエリアを選択的に前記シーケンス演算部と接続する第1及び第2の切替スイッチを備えていることを特徴とする請求項1乃至7のいずれか一項に記載のプログラマブル・ロジック・コントローラ。
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JP2008037327A JP5020856B2 (ja) | 2008-02-19 | 2008-02-19 | プログラマブル・ロジック・コントローラ |
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JP5020856B2 JP5020856B2 (ja) | 2012-09-05 |
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Country | Link |
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Publication number | Priority date | Publication date | Assignee | Title |
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-
2008
- 2008-02-19 JP JP2008037327A patent/JP5020856B2/ja active Active
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JP5020856B2 (ja) | 2012-09-05 |
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