JP2008521319A - 制御整合ステージを備える装置 - Google Patents
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Abstract
Description
−第1のステージの出力信号から第1の信号と第2の信号とを導出するための導出手段と、
−第1の信号と第2の信号の間の位相を検出するための検出手段と、
−前記整合のために前記検出に応じて調整可能インピーダンス・ネットワークを制御するための制御手段とを備える。
Claims (12)
- 第1のステージに第2のステージを整合させるための制御整合ステージを備える装置であって、前記制御整合ステージが、
前記第1のステージの出力信号から第1の信号と第2の信号とを導出するための導出手段と、
前記第1の信号と前記第2の信号の間の位相を検出するための検出手段と、
前記整合のために前記検出に応じて調整可能インピーダンス・ネットワークを制御するための制御手段と、
を備えることを特徴とする装置。 - 前記第2のステージが、アンテナ・ステージを備え、前記第1のステージが、電力増幅器ステージまたはスイッチング・ステージを備える、請求項1に記載の装置。
- 前記第1のステージが、電力増幅器ステージを備え、前記第2のステージが、スイッチング・ステージまたはアンテナ・ステージを備える、請求項1に記載の装置。
- 前記導出手段が、素子を備え、前記第1の信号が、前記出力信号であり、前記第2の信号が、前記素子を介して導出される、請求項1に記載の装置。
- 前記素子が、受動素子を備え、前記調整可能インピーダンス・ネットワークが、調整可能キャパシタを備える、請求項4に記載の装置。
- 前記検出手段が、位相検出器を備える、請求項1に記載の装置。
- 前記位相検出器が、前記第1および第2の信号を制限するための第1および第2のリミッタを備え、また前記制限された第1および第2の信号を混合するためのミキサを備える、請求項6に記載の装置。
- 前記制御手段が、アナログ−デジタル変換器と、デジタル回路とを備える、請求項1に記載の装置。
- 前記デジタル回路が、アップ−ダウン・カウンタを備え、前記アップ−ダウン・カウンタが、前記アナログ−デジタル変換器に結合されるカウント入力と、ベースバンド・コントローラに結合されるイネーブル入力とを含む、請求項8に記載の装置。
- 第1のステージに第2のステージを整合させるための制御整合ステージであって、前記制御整合ステージが、
前記第1のステージの出力信号から第1の信号と第2の信号とを導出するための導出手段と、
前記第1の信号と前記第2の信号の間の位相を検出するための検出手段と、
前記整合のために前記検出に応じて調整可能インピーダンス・ネットワークを制御するための制御手段と、
を備えることを特徴とする制御整合ステージ。 - 第1のステージに第2のステージを整合させるための方法であって、
前記第1のステージの出力信号から第1の信号と第2の信号とを導出するステップと、
前記第1の信号と前記第2の信号の間の位相を検出するステップと、
前記整合のために前記検出に応じて調整可能インピーダンス・ネットワークを制御するステップと、
を備えることを特徴とする方法。 - 第1のステージに第2のステージを整合させるためのプロセッサ・プログラム製品であって、前記プロセッサ・プログラム製品が、
前記第1のステージの出力信号から第1の信号と第2の信号とを導出する機能と、
前記第1の信号と前記第2の信号の間の位相を検出する機能と、
前記整合のために前記検出に応じて調整可能インピーダンス・ネットワークを制御する機能と、
を備えることを特徴とするプロセッサ・プログラム製品。
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