JP2007054414A - 遊技機 - Google Patents

Abstract

【課題】 識別情報の可変表示の表示結果の決定に用いる乱数を生成する際に、生成する乱数のランダム性を向上させることができ、特定遊技状態への移行条件を不正に発生させられてしまうことを防止する。
【解決手段】 遊技機は、乱数回路５０３を内蔵する遊技制御用マイクロコンピュータ５６０を備える。遊技制御用マイクロコンピュータ５６０は、メイン処理の実行時に、乱数回路５０３を初期設定する乱数回路設定処理（ステップＳ１５）を実行する。また、乱数回路設定処理において、乱数回路５０３のカウンタ５２１に入力する初期値を、遊技制御用マイクロコンピュータ５６０毎に付与された固有のＩＤナンバにもとづく値に変更させる。また、乱数回路５０３が発生させる乱数にもとづいて大当りとするか否かを判定し、判定用乱数（ソフトウェア乱数）にもとづいて大当りの種類を決定する。
【選択図】 図３９

Description

本発明は、各々を識別可能な複数種類の識別情報を可変表示可能な可変表示手段を備え、あらかじめ定められている可変表示の実行条件が成立した後、可変表示の開始条件の成立にもとづいて識別情報の可変表示を開始し、識別情報の可変表示の表示結果が特定の表示結果となったときに遊技者にとって有利な特定遊技状態に移行させる遊技機に関する。

遊技機として、遊技球などの遊技媒体を発射装置によって遊技領域に発射し、遊技領域に設けられている入賞口などの入賞領域に遊技媒体が入賞すると、所定個の賞球が遊技者に払い出されるものがある。さらに、表示状態が変化可能な可変表示部が設けられ、可変表示部の表示結果があらかじめ定められた特定表示態様となった場合に所定の遊技価値を遊技者に与えるように構成されたものがある。

なお、遊技価値とは、遊技機の遊技領域に設けられた可変入賞球装置の状態が打球が入賞しやすい遊技者にとって有利な状態になることや、遊技者にとって有利な状態になるための権利を発生させたりすることや、賞球払出の条件が成立しやすくなる状態になることである。

遊技機では、所定の移行条件が成立したときに、遊技状態を遊技者にとって有利な特定遊技状態に移行させる。例えば、パチンコ遊技機では、特別図柄を表示する可変表示部の表示結果があらかじめ定められた特定表示態様の組合せ（大当り図柄）になることを、通常、「大当り」という。大当りが発生すると、例えば、大入賞口が所定回数開放して打球が入賞しやすい大当り遊技状態に移行する。また、可変表示部の表示結果が大当り図柄のうちの特別の大当り図柄となるなどの特別の条件が成立すると、以後、大当りが発生する確率が高くなる高確率状態（確変状態ともいう。）に移行するように構成することもある。

遊技機における遊技進行は、マイクロコンピュータ等による遊技制御手段によって制御される。また、遊技制御手段は、疑似乱数を生成する手段を備え、乱数の値にもとづいて所定の移行条件が成立するか否か（例えば、可変表示の表示結果を特定表示態様の組み合わせとするか否か）を決定する。例えば、遊技制御手段は、乱数の値が所定の判定値と一致するか否かを判断することによって、所定の移行条件が成立するか否かを判定する。そして、所定の移行条件が成立したと判定すると、遊技制御手段は、遊技状態を特定遊技状態に移行させる。さらに、遊技制御手段は、所定の移行条件が成立したときに、乱数の値にもとづいて特別の条件が成立するか否か（例えば、可変表示部の表示結果を大当り図柄のうちの特別の大当り図柄とするか否か）を決定する。そして、特別の条件が成立すると、遊技制御手段は、高確率状態（確変状態）に移行させる。

乱数回路を搭載するマイクロコンピュータを遊技制御手段として用いることによって、乱数生成手段や遊技制御手段を基板上に実装する実装面積を縮小した遊技機がある（例えば、特許文献１参照）。また、特許文献１に記載された遊技機では、マイクロコンピュータに搭載した乱数回路が生成する乱数を用いることによって、マイクロコンピュータの制御負担を軽減している。さらに、特許文献１には、遊技機への電源投入が開始されてからタイマ割込設定を行うまでに乱数回路の初期設定を行うようにし、遊技の進行を制御する遊技制御処理を実行するように構成することが記載されている。

また、遊技制御手段としてのマイクロコンピュータとは別に乱数回路を設けた遊技機がある（例えば、特許文献２参照）。特許文献２では、乱数回路が発生する乱数を用いて、遊技状態を特定遊技状態に移行させるか否か（大当りとするか否か）を決定することが記載されている。また、特許文献２では、乱数回路が発生する乱数とは別に、遊技制御手段としてのマイクロコンピュータが生成した乱数を用いて、高確率状態（確変状態）とするか否かを決定することが記載されている。

特開２００５−１０３１６６号公報（段落００３９，００４１，００９５−０１００、図３−４，２０−２１） 特開２００１−３０００４０号公報（段落００５０−００５６，００７４，００７５、図７、図１１）

特許文献１に記載された遊技機では、遊技機への電源投入が開始されてからタイマ割込設定を行うまでに、乱数回路の初期設定として、生成する乱数の最大値、乱数の更新方式および乱数を更新する周期の設定を行う。しかし、生成する乱数の初期値をあらかじめ設定することはできない。そのため、複数の遊技機を用いる場合に、各遊技機は、共通の初期値から乱数の生成を開始することになる。すると、特許文献１に記載された遊技機を複数用いる場合、各遊技機の電源を同時に投入すると、各遊技機が同じ初期値から同じタイミングで乱数の生成を開始することになり、乱数生成のタイミングを遊技者や遊技店に認識されてしまう虞がある。従って、所定の周期で無線信号などを用いた取り込み信号を遊技機に対して発生させることによって、大当たりなどの特定遊技状態への移行条件を不正に成立させられてしまう虞がある。

また、特許文献２に記載された遊技機では、マイクロコンピュータとは別に設けられた乱数回路が発生する乱数を用いることによって、主基板に搭載された遊技制御用のマイクロコンピュータの制御負担を軽減している。しかし、生成する乱数の初期値をあらかじめ設定することはできない。そのため、乱数生成のタイミングを遊技者や遊技店に認識されてしまう虞があり、所定の周期で無線信号などを用いた取り込み信号を遊技機に対して発生させることによって、大当たりなどの特定遊技状態への移行条件を不正に成立させられてしまう虞がある。

そこで、本発明は、識別情報の可変表示の表示結果が特定の表示結果となったときに遊技者にとって有利な特定遊技状態に移行させる遊技機において、識別情報の可変表示の表示結果の決定に用いる乱数を生成する際に、生成する乱数のランダム性を向上させることができ、特定遊技状態への移行条件を不正に発生させられてしまうことを防止できるようにすることを目的とする。

本発明による遊技機は、各々を識別可能な複数種類の識別情報（例えば、特別図柄）を可変表示可能な可変表示手段（例えば、特別図柄表示器８）を備え、あらかじめ定められている可変表示の実行条件（例えば、始動入賞口１４への遊技球の入賞）が成立した後、可変表示の開始条件（例えば、特別図柄の最終停止および大当たり遊技の終了）の成立にもとづいて識別情報の可変表示を開始し、識別情報の可変表示の表示結果が特定の表示結果（例えば、大当たり図柄）となったときに遊技者にとって有利な特定遊技状態に移行させる遊技機であって、乱数を発生する乱数回路（例えば、乱数回路５０３）を内蔵し、遊技の進行を制御する遊技制御処理を実行する遊技制御用マイクロコンピュータ（例えば、遊技制御用マイクロコンピュータ５６０）を備え、乱数回路は、所定の信号（例えば、クロック信号）の入力にもとづいて、数値データ（例えば、カウント値）を更新可能な所定の範囲において、所定の初期値から所定の最終値まで予め定められた順序に従って数値データを更新する数値更新手段（例えば、カウンタ５２１）と、数値更新手段によって更新された数値データを乱数値として記憶する乱数記憶手段（例えば、乱数値記憶回路５３１）とを含み、遊技制御用マイクロコンピュータは、遊技機への電力供給が開始されたときに、乱数回路の初期設定を行う乱数回路初期設定手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ１５を実行する部分）と、乱数回路初期設定手段が乱数回路の初期設定を行ったあとに、所定時間毎にタイマ割込を発生させるための設定をするタイマ割込設定手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ１６を実行する部分）と、タイマ割込が発生したときに、遊技制御処理（例えば、タイマ割込処理におけるステップＳ２１〜Ｓ３５（ステップＳ３１，Ｓ３３を除く）の処理）を含むタイマ割込処理を実行するタイマ割込処理実行手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ２０〜Ｓ３５を実行する部分）と、タイマ割込処理実行手段によるタイマ割込処理において、特定遊技状態の種類（例えば、特別図柄表示装置８に表示させる特別図柄や、大当り遊技終了後に確変状態に移行させるか否か）を決定するための決定用乱数（例えば、大当り図柄決定用や確変決定用乱数）を、更新可能な所定の範囲において、所定の更新初期値から所定の更新最終値まで循環的に更新する決定用乱数更新手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ２３を実行する部分）と、タイマ割込処理実行手段によるタイマ割込処理において、可変表示の実行条件（例えば、始動入賞口１４への遊技球の入賞）が成立したか否かを判定する実行条件判定手段（例えば、遊技制御用マイクロコンピュータのＣＰＵ５６におけるステップＳ３１１を実行する部分）と、実行条件判定手段により可変表示の実行条件が成立したと判定されたときに、乱数記憶手段が記憶する乱数値を読み出す乱数読出手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ３２０４を実行する部分）と、可変表示の開始条件が成立したときに、乱数読出手段によって読み出された乱数値が所定の判定値と合致するか否かを判定することによって、識別情報の可変表示の表示結果を特定の表示結果とするか否かを決定する表示結果決定手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ３３１９を実行する部分）と、表示結果決定手段が識別情報の可変表示の表示結果を特定の表示結果とすると決定したときに、決定用乱数更新手段によって更新された決定用乱数にもとづいて、特定遊技状態の種類を決定する特定遊技種類決定手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ３３２２，Ｓ３３２６，Ｓ３３２５ａ，Ｓ３７２〜Ｓ３７６を実行する部分）と、特定遊技種類決定手段によって決定された特定遊技状態の種類に従って、遊技状態を制御する遊技状態制御手段（例えば、遊技制御用マイクロコンピュータ５６０における、判定用乱数にもとづいて決定した大当りの種類（例えば、特別可変入賞球装置２０を何回開放する大当りであるかや、大当り遊技終了後に確変状態に移行する大当りであるか否か）に従って、大当り遊技状態を制御する部分（例えば、遊技制御用マイクロコンピュータ５６０が、ステップＳ３０７において、判定用乱数を用いて決定したラウンド数に従って、内部状態をステップＳ３０５またはステップＳ３０８に移行する部分））とを含み、乱数回路初期設定手段は、初期設定において、数値更新手段が更新する数値データの所定の初期値を、遊技制御用マイクロコンピュータ毎に付与された遊技制御用マイクロコンピュータを識別するためのマイコン識別情報（例えば、遊技制御用マイクロコンピュータ５６０固有のＩＤナンバ）にもとづいて設定する（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ１５４ｂを実行する部分）ことを特徴とする。

遊技制御用マイクロコンピュータは、決定用乱数の所定の更新初期値を決定するための初期値決定用乱数（例えば、ランダム６（ランダム２初期値決定用乱数）や、ランダム７（ランダム５初期値決定用乱数）、ランダム１２（ランダム８初期値決定用乱数）、ランダム１３（ランダム９初期値決定用乱数））を更新する初期値用乱数更新手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ１８ａ，Ｓ２４を実行する部分）と、決定用乱数更新手段によって決定用乱数が所定の更新初期値から所定の更新最終値まで更新されたときに、初期値用乱数更新手段によって更新された初期値決定用乱数の値を、決定用乱数の所定の更新初期値として設定する決定用乱数初期値設定手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ２３０５，Ｓ２３１１，Ｓ２３１７，Ｓ２３２３を実行する部分）とを含み、決定用乱数更新手段は、決定用乱数初期値設定手段によって決定用乱数の所定の更新初期値が設定されたときには、設定された所定の更新初期値から決定用乱数の更新を再び開始する（例えば、遊技制御用マイクロコンピュータ５６０が、ステップＳ２３０５，Ｓ２３１１，Ｓ２３１７，Ｓ２３２３を実行したあとに、再びタイマ割込の発生によってステップＳ２３の判定用乱数更新処理を実行する部分）ように構成されていてもよい。

遊技制御用マイクロコンピュータは、数値更新手段が更新可能な数値データの所定の範囲が異なる乱数回路（例えば、１２ビット乱数回路５０３ａと１６ビット乱数回路５０３ｂ）を複数内蔵し、乱数回路初期設定手段は、初期設定において、遊技制御用マイクロコンピュータが内蔵する複数の乱数回路の中から使用可能な乱数回路を設定し（例えば、遊技制御用マイクロコンピュータ５６０がステップＳ１５１を実行する）、乱数回路初期設定手段により使用可能と設定された乱数回路以外の乱数回路の機能を停止させる乱数回路停止手段（例えば、遊技制御用マイクロコンピュータ５６０が、ステップＳ１５１で使用する乱数回路５０３を設定すると、使用しないように設定した方の乱数回路のカウンタ５２１がカウント値Ｃを更新しないように制御する部分）を備えるように構成されていてもよい。

乱数回路初期設定手段は、初期設定において、数値データが更新される所定の範囲の最大値としての値が設定される数値最大値レジスタ（例えば、乱数最大値設定レジスタ５３５）に、数値更新手段により更新可能な数値データの範囲内において所定の最大値（例えば、乱数最大値）を設定し（例えば、遊技制御用マイクロコンピュータ５６０がステップＳ１５２を実行する部分）、数値更新手段は、乱数回路初期設定手段により設定された所定の最大値が、所定の下限値（例えば、１２ビット乱数回路５０３ａを設定した場合における「２５６」）以下であるか否かを判定する設定値判定手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ１５３ｂを実行する部分）と、設定値判定手段によって数値最大値レジスタに設定された所定の最大値が所定の下限値以下であると判定されたときに、数値最大値レジスタに、数値更新手段により更新可能な数値データの範囲内の所定値（例えば、１２ビット乱数回路５０３ａを設定した場合における「４０９５」）を設定しなおす最大値再設定手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ１５３ｃを実行する部分）とを含むように構成されていてもよい。

遊技機は、所定周期のクロック信号を生成し、乱数回路に出力するクロック信号生成手段（例えば、クロック回路５０１）を備え、数値更新手段は、クロック信号を所定回数入力したことを条件に、数値データを更新し（例えば、クロック信号出力回路５２４が基準クロック信号ＣＬＫを１６分周した乱数発生用クロック信号ＳＩを入力すると、カウンタ５２１がカウント値Ｃを更新する部分）、乱数回路初期設定手段は、初期設定において、数値更新手段が数値データを更新する条件であるクロック信号の入力回数を設定する（例えば、遊技制御用マイクロコンピュータ５６０がステップＳ１５６を実行する）ように構成されていてもよい。

遊技制御用マイクロコンピュータは、乱数回路初期設定手段によって設定される数値データの所定の初期値を、マイコン識別情報を用いて演算する数値演算手段（例えば、遊技用マイクロコンピュータにおけるステップＳ１５４ｂの処理を実行する際に、遊技制御用マイクロコンピュータ５６０のＩＤナンバと所定値とを演算して（例えば、ＩＤナンバに所定値を加算して）演算値を求める部分）を含み、乱数回路初期設定手段は、数値演算手段による演算によって算出された値にもとづいて初期値を設定する（例えば、遊技用マイクロコンピュータがステップＳ１５４ｂの処理を実行する際に、求めた演算値をカウント値の初期値として設定する）ように構成されていてもよい。

遊技機は、遊技領域における入賞領域（例えば、始動入賞口１４）に遊技媒体が入賞したことを検出して入賞検出信号（例えば、入賞検出信号ＳＳ）を出力する入賞検出手段（例えば、始動口スイッチ１４ａ）を備え、乱数回路は、入賞検出手段からの入賞検出信号が入力されたことにもとづいて、数値更新手段が更新する数値データを乱数記憶手段に記憶させるためのラッチ信号を出力するラッチ信号出力手段（例えば、ラッチ信号生成回路５３３）を含み、ラッチ信号出力手段は、入賞検出手段から入賞検出信号が所定期間継続して入力されたことを条件（例えば、タイマ回路５３４が所定期間（例えば、３ｍｓ）を計測したときに、乱数値読取信号出力回路５２６から出力される乱数値読取信号を入力したこと）に、ラッチ信号を出力する（例えば、ラッチ信号生成回路５３３が、乱数値読取信号出力回路５２６から出力される乱数値読取信号を、反転回路５３２から出力される反転クロック信号ＳＩ２の立ち上がりエッヂに同期させて、ラッチ信号ＳＬとして乱数値記憶回路５３１に出力する部分）ように構成されていてもよい。

実行条件判定手段は、入賞検出手段からの入賞検出信号が所定回数のタイマ割込処理が実行されるに亘って入力されたことを条件に、可変表示の実行条件が成立したと判定し（例えば、遊技制御用マイクロコンピュータ５６０が、ステップＳ３１２の処理において、割込回数カウンタに示されるタイマ割込処理の実行回数が所定回数（例えば、３回）に達しているか否かを判断する部分）、所定期間（例えば、３ｍｓ）は所定回数のタイマ割込処理が実行される期間（例えば、６ｍｓ）よりも短いように構成されていてもよい。

乱数回路初期設定手段は、初期設定において、数値更新手段によって所定の最終値まで数値データが更新されたときに、乱数回路初期設定手段が設定した所定の初期値を変更するか否かを設定し（例えば、遊技制御用マイクロコンピュータ５６０がステップＳ１５７を実行する）、乱数回路は、数値更新手段によって所定の最終値まで数値データが更新されたきに、数値データが所定の最終値まで更新された旨を示す通知信号を出力する通知信号出力手段（例えば、カウンタ５２１の出力端子）と、通知信号が出力されたことにもとづいて、乱数回路初期設定手段によって初期値を変更する設定がされているときに、所定の初期値の値を変更する初期値変更手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ２２０〜Ｓ２２６を実行する部分）とを含むように構成されていてもよい。

乱数回路初期設定手段は、初期設定において、数値更新手段が更新する数値データの所定の初期値から所定の最終値までの値の並び順（例えば、カウンタ５２１が更新するカウント値Ｃの順列）を変更するか否かを設定する数値順設定手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ１５８を実行する部分）を含み、乱数回路は、数値更新手段によって所定の最終値まで数値データが更新されたときに、数値データが所定の最終値まで更新された旨を示す通知信号を出力する通知信号出力手段（例えば、カウンタ５２１の出力端子）と、通知信号が出力されたことにもとづいて、乱数回路初期設定手段によって、数値データの前記所定の初期値から所定の最終値までの並び順を変更する設定がされているときに、数値更新手段が更新する数値データの所定の初期値から所定の最終値までの並び順を変更する数値順変更手段（例えば、遊技制御用マイクロコンピュータ５６０におけるステップＳ２６を実行する部分）とを含むように構成されていてもよい。

請求項１記載の発明では、遊技制御用マイクロコンピュータが、遊技機への電源投入が開始されてからタイマ割込設定を行うまでに乱数回路の初期設定を行うとともに、初期設定においてマイコン識別情報にもとづく値を乱数の初期値として設定するように構成されているので、乱数回路が生成する乱数のランダム性を向上させることができる。また、乱数のランダム性を向上させることができるので、乱数生成のタイミングを遊技者や遊技店に認識されにくくすることができ、無線信号を用いて不正に可変表示の実行条件を成立させることによって、特定遊技状態への移行条件を不正に成立させられてしまうことを防止することができる。また、遊技制御処理に用いる各乱数のうち、識別情報の可変表示の表示結果を特定の表示結果とするか否かを決定するための乱数のみを乱数回路を用いて発生させるように構成されているので、乱数回路の回路構成が複雑化することを防止することができる。

請求項２記載の発明では、初期値決定用乱数にもとづいて決定用乱数の所定の初期値を設定するように構成されているので、特定遊技状態の種類を決定するために用いる決定用乱数のランダム性を向上させることができる。

請求項３記載の発明では、更新可能な数値データの所定の範囲が異なる複数の乱数回路について、それぞれ使用可能とするか否かを設定するように構成されているので、使用する乱数回路だけを設定することによって、生成する乱数の値の範囲を適切に設定することができる。

請求項４記載の発明では、数値データが更新される所定の範囲の最大値としての値をあらかじめ設定するように構成されているので、タイマ割込処理の実行中に用いる乱数の範囲より大きい値の乱数を生成してしまうことを防止でき、乱数回路および遊技制御用マイクロコンピュータの処理負担を軽減することができる。また、設定された所定の最大値が所定の下限値以下である場合には、所定の最大値を設定しなおすように構成されているので、遊技制御用マイクロコンピュータの誤動作や、無線信号を用いた取り込み信号を遊技機に対して発生させるなどの行為によって、過度に小さい値が乱数の最大値として設定されてしまうことを防止することができる。

請求項５記載の発明では、数値更新手段が数値データを更新する条件であるクロック信号の入力回数をあらかじめ設定するように構成されているので、乱数回路が生成する乱数のランダム性をより向上させることができる。

請求項６記載の発明では、マイコン識別情報を用いた演算によって算出された値にもとづいて初期値を設定するように構成されているので、乱数回路が生成する乱数のランダム性をより向上させることができる。そのため、マイコン識別情報を見ただけでは乱数の初期値を認識しにくくすることができ、セキュリティ性を向上させることができる。

請求項７記載の発明では、ラッチ信号が出力されたことにもとづいて乱数記憶手段が乱数を記憶するにあたって、所定期間に亘って継続して入賞検出信号が入力されたことを条件にラッチ信号を出力するように構成されているので、ノイズの発生を入力検出信号の入力と誤認識してラッチ信号を出力し、生成した乱数を記憶してしまうことを防止できる。また、無線信号を用いた取り込み信号を遊技機に対して発生させるなどの行為によってラッチ信号が出力され、不正なラッチ信号によって生成された乱数を記憶させられてしまう可能性を低減することができる。

請求項８記載の発明では、乱数記憶手段から乱数を読み出すにあたって、タイマ割込処理が所定回数実行される間継続して入賞検出信号が入力されたことを条件に乱数記憶手段から乱数を読み出すように構成されているので、乱数を読み出してから、乱数記憶手段に記憶される乱数の値が更新される前に再び乱数を読み出してしまうことを防止することができる。そのため、前回乱数記憶手段から読み出した乱数と同じ値の乱数を再び読み出してしまうことを防止することができる。

請求項９記載の発明では、数値データを所定の最終値まで更新したときに、所定の初期値を更新するように構成されているので、乱数回路が生成する乱数のランダム性をより向上させることができる。

請求項１０記載の発明では、数値データを所定の最終値まで更新したときに、所定の初期値から所定の最終値までの並び順を更新するように構成されているので、乱数回路が生成する乱数のランダム性をより向上させることができる。

実施の形態１．
以下、本発明の一実施形態を図面を参照して説明する。
まず、遊技機の一例であるパチンコ遊技機の全体の構成について説明する。図１はパチンコ遊技機を正面からみた正面図、図２は遊技盤の前面を示す正面図である。なお、以下の実施の形態では、パチンコ遊技機を例に説明を行うが、本発明による遊技機はパチンコ遊技機に限られず、スロット機などの他の遊技機に適用することもできる。

パチンコ遊技機１は、縦長の方形状に形成された外枠（図示せず）と、外枠の内側に開閉可能に取り付けられた遊技枠とで構成される。また、パチンコ遊技機１は、遊技枠に開閉可能に設けられている額縁状に形成されたガラス扉枠２を有する。遊技枠は、外枠に対して開閉自在に設置される前面枠（図示せず）と、機構部品等が取り付けられる機構板と、それらに取り付けられる種々の部品（後述する遊技盤を除く。）とを含む構造体である。

図１に示すように、パチンコ遊技機１は、額縁状に形成されたガラス扉枠２を有する。ガラス扉枠２の下部表面には打球供給皿（上皿）３がある。打球供給皿３の下部には、打球供給皿３に収容しきれない遊技球を貯留する余剰球受皿４と遊技球を発射する打球操作ハンドル（操作ノブ）５が設けられている。ガラス扉枠２の背面には、遊技盤６が着脱可能に取り付けられている。なお、遊技盤６は、それを構成する板状体と、その板状体に取り付けられた種々の部品とを含む構造体である。また、遊技盤６の前面には遊技領域７が形成されている。

遊技領域７の中央付近には、それぞれが演出用の飾り図柄を可変表示する複数の可変表示部を含む可変表示装置（飾り図柄表示装置）９が設けられている。可変表示装置９には、例えば「左」、「中」、「右」の３つの可変表示部（図柄表示エリア）がある。可変表示装置９は、特別図柄表示器８による特別図柄の可変表示期間中に、装飾用（演出用）の図柄としての飾り図柄の可変表示を行う。飾り図柄の可変表示を行う可変表示装置９は、演出制御基板に搭載されている演出制御用マイクロコンピュータによって制御される。

可変表示装置９の下部には、始動入賞口１４に入った有効入賞球数すなわち保留記憶（始動記憶または始動入賞記憶ともいう。）数を表示する４つの特別図柄保留記憶表示器１８が設けられている。特別図柄保留記憶表示器１８は、保留記憶数を入賞順に４個まで表示する。特別図柄保留記憶表示器１８は、始動入賞口１４に始動入賞があるごとに、点灯状態のＬＥＤの数を１増やす。そして、特別図柄保留記憶表示器１８は、特別図柄表示器８で可変表示が開始されるごとに、点灯状態のＬＥＤの数を１減らす（すなわち１つのＬＥＤを消灯する）。具体的には、特別図柄保留記憶表示器１８は、特別図柄表示器８で可変表示が開始されるごとに、点灯状態をシフトする。なお、この例では、始動入賞口１４への入賞による始動記憶数に上限数（４個まで）が設けられているが、上限数を４個以上にしてもよい。

可変表示装置９の上部には、識別情報としての特別図柄を可変表示する特別図柄表示器（特別図柄表示装置）８が設けられている。この実施の形態では、特別図柄表示器８は、例えば０〜９の数字を可変表示可能な簡易で小型の表示器（例えば７セグメントＬＥＤ）で実現されている。特別図柄表示器８は、遊技者に特定の停止図柄を把握しづらくさせるために、０〜９９など、より多種類の数字を可変表示するように構成されていてもよい。また、可変表示装置９は、特別図柄表示器８による特別図柄の可変表示期間中に、装飾用（演出用）の図柄としての飾り図柄の可変表示を行う。

さらに、可変表示装置９の左側には、遊技演出に用いられる可動部材としてのハンマ１５１が設けられている。ハンマ１５１は、可動部１５２を支点として右方向に倒れ、可変表示装置９に表示される飾り図柄のうち最も左側の飾り図柄を叩くような演出を行うことができる。

また、パチンコ遊技機１は、遊技の進行中に遊技者が操作可能な操作スイッチ８１を備えている。例えば、操作スイッチ８１が操作（押下）されると、可動部材としてのハンマ１５１が動作する。

可変表示装置９の下方には、始動入賞口１４を形成する可変入賞球装置１５が設けられている。始動入賞口１４に入った入賞球は、遊技盤６の背面に導かれ、始動口スイッチ１４ａによって検出される。可変入賞球装置１５は、ソレノイド１６によって開状態にされる。

可変入賞球装置１５の下部には、特定遊技状態（大当り状態）においてソレノイド２１によって開状態に制御される開閉板を用いた特別可変入賞球装置２０が設けられている。特別可変入賞球装置２０は大入賞口を開閉する手段である。特別可変入賞球装置２０に入賞し遊技盤６の背面に導かれた入賞球のうち一方（Ｖ入賞領域：特別領域）に入った入賞球はＶ入賞スイッチ２２で検出された後カウントスイッチ２３で検出され、他方の領域に入った遊技球は、そのままカウントスイッチ２３で検出される。遊技盤６の背面には、大入賞口内の経路を切り換えるためのソレノイド２１Ａも設けられている。

遊技球がゲート３２を通過しゲートスイッチ３２ａで検出されると、普通図柄表示器１０の表示の可変表示が開始される。この実施の形態では、左右のランプ（点灯時に図柄が視認可能になる）が交互に点灯することによって可変表示が行われ、例えば、可変表示の終了時に左側のランプが点灯すれば当たりになる。そして、普通図柄表示器１０における停止図柄が所定の図柄（当り図柄）である場合に、可変入賞球装置１５が所定回数、所定時間だけ開状態になる。普通図柄表示器１０の近傍には、ゲート３２を通過した入賞球数を表示する４つのＬＥＤによる表示部を有する普通図柄始動記憶表示器４１が設けられている。ゲート３２への遊技球の通過があるごとに、普通図柄始動記憶表示器４１は点灯するＬＥＤを１増やす。そして、普通図柄表示器１０の可変表示が開始されるごとに、点灯するＬＥＤを１減らす。

遊技盤６には、複数の入賞口２９，３０，３３，３９が設けられ、遊技球の入賞口２９，３０，３３，３９への入賞は、それぞれ入賞口スイッチ２９ａ，３０ａ，３３ａ，３９ａによって検出される。各入賞口２９，３０，３３，３９は、遊技媒体を受け入れて入賞を許容する領域として遊技盤６に設けられる入賞領域を構成している。なお、始動入賞口１４や大入賞口も、遊技媒体を受け入れて入賞を許容する入賞領域を構成する。遊技領域７の左右周辺には、遊技中に点滅表示される装飾ランプ２５が設けられ、下部には、入賞しなかった遊技球を吸収するアウト口２６がある。また、遊技領域７の外側の左右上部には、効果音を発する２つのスピーカ２７が設けられている。遊技領域７の外周には、天枠ランプ２８ａ、左枠ランプ２８ｂおよび右枠ランプ２８ｃが設けられている。さらに、遊技領域７における各構造物（大入賞口等）の周囲には装飾ＬＥＤが設置されている。天枠ランプ２８ａ、左枠ランプ２８ｂおよび右枠ランプ２８ｃおよび装飾用ＬＥＤは、遊技機に設けられている装飾発光体の一例である。

そして、この例では、左枠ランプ２８ｂの近傍に、賞球払出中に点灯する賞球ランプ５１が設けられ、天枠ランプ２８ａの近傍に、補給球が切れたときに点灯する球切れランプ５２が設けられている。さらに、プリペイドカードが挿入されることによって球貸しを可能にするプリペイドカードユニット（以下、「カードユニット」という。）５０が、パチンコ遊技機１に隣接して設置されている。

カードユニット５０には、例えば、使用可能状態であるか否かを示す使用可表示ランプ、カードユニットがいずれの側のパチンコ遊技機１に対応しているのかを示す連結台方向表示器、カードユニット内にカードが投入されていることを示すカード投入表示ランプ、記録媒体としてのカードが挿入されるカード挿入口、およびカード挿入口の裏面に設けられているカードリーダライタの機構を点検する場合にカードユニットを解放するためのカードユニット錠が設けられている。

遊技者の操作により打球発射装置から発射された遊技球は、打球レールを通って遊技領域７に入り、その後、遊技領域７を下りてくる。遊技球が始動入賞口１４に入り始動口スイッチ１４ａで検出されると、図柄の可変表示を開始できる状態であれば、特別図柄表示器８において特別図柄が可変表示（変動）を始める。図柄の可変表示を開始できる状態でなければ、保留記憶数を１増やす。

特別図柄表示器８における特別図柄の可変表示は、一定時間が経過したときに停止する。停止時の特別図柄（停止図柄）が大当り図柄（特定表示結果）であると、大当り遊技状態に移行する。すなわち、特別可変入賞球装置２０が、一定時間経過するまで、または、所定個数（例えば１０個）の遊技球が入賞するまで開放する。そして、特別可変入賞球装置２０の開放中に遊技球がＶ入賞領域に入賞しＶ入賞スイッチ２２で検出されると、継続権が発生し特別可変入賞球装置２０の開放が再度行われる。継続権の発生は、所定回数（例えば１５ラウンド）許容される。なお、この実施の形態では、特別可変入賞球装置２０の開放回数（ラウンド数ともいう）は、後述するようにラウンド数決定用乱数を用いて決定される。そして、継続権の発生は、ラウンド数決定用乱数を用いて決定されたラウンド数だけ許容される。また、Ｖ入賞領域を設けずに、特別可変入賞球装置２０の開放を常に決定されたラウンド数の最後のラウンドまで（例えば、１５ラウンドまで）許容するようにしてもよい。

停止時の特別図柄表示器８における特別図柄が確率変動を伴う大当り図柄（確変図柄）である場合には、次に大当りになる確率が高くなる。すなわち、確変状態という遊技者にとってさらに有利な状態になる。

遊技球がゲート３２を通過すると、普通図柄表示器１０において普通図柄が可変表示される状態になる。また、普通図柄表示器１０における停止図柄が所定の図柄（当り図柄）である場合に、可変入賞球装置１５が所定時間だけ開状態になる。さらに、確変状態では、普通図柄表示器１０における停止図柄が当り図柄になる確率が高められるとともに、可変入賞球装置１５の開放時間と開放回数が高められる。すなわち、可変入賞球装置１５の開放時間と開放回数は、普通図柄の停止図柄が当り図柄であったり、特別図柄の停止図柄が確変図柄である場合等に高められ、遊技者にとって不利な状態から有利な状態に変化する。なお、開放回数が高められることは、閉状態から開状態になることも含む概念である。

次に、パチンコ遊技機１の裏面の構造について図３を参照して説明する。図３は、遊技機を裏面から見た背面図である。

図３に示すように、遊技機裏面側では、可変表示装置９を制御する演出制御用マイクロコンピュータが搭載された演出制御基板８０を含む可変表示制御ユニット４９、遊技制御用マイクロコンピュータ等が搭載された遊技制御基板（主基板）３１が設置されている。また、球払出制御を行う払出制御用マイクロコンピュータ等が搭載された払出制御基板３７が設置されている。なお、演出制御マイクロコンピュータは、遊技盤６に設けられている可変表示装置９を制御するとともに、各種装飾ＬＥＤ、装飾ランプ２５、枠側に設けられている天枠ランプ２８ａ、左枠ランプ２８ｂおよび右枠ランプ２８ｃを点灯制御し、スピーカ２７からの音発生を制御する。

さらに、ＤＣ３０Ｖ、ＤＣ２１Ｖ、ＤＣ１２ＶおよびＤＣ５Ｖを作成する電源回路が搭載された電源基板９１０やタッチセンサ基板９１が設けられている。電源基板９１０は、大部分が主基板３１と重なっているが、主基板３１に重なることなく外部から視認可能に露出した露出部分がある。この露出部分には、遊技機１における主基板３１および各電気部品制御基板（演出制御基板８０および払出制御基板３７）や遊技機に設けられている各電気部品（電力が供給されることによって動作する部品）への電力供給を実行あるいは遮断するための電力供給許可手段としての電源スイッチが設けられている。さらに、露出部分における電源スイッチの内側（基板内部側）には、交換可能なヒューズが設けられている。

なお、電気部品制御基板には、電気部品制御用マイクロコンピュータを含む電気部品制御手段が搭載されている。電気部品制御手段は、遊技制御手段等からのコマンドとしての指令信号（制御信号）に従って遊技機に設けられている電気部品（遊技用装置：球払出装置９７、可変表示装置９、ランプやＬＥＤなどの発光体、スピーカ２７等）を制御する。以下、主基板３１を電気部品制御基板に含めて説明を行うことがある。その場合には、電気部品制御基板に搭載される電気部品制御手段は、遊技制御手段と、遊技制御手段等からの指令信号に従って遊技機に設けられている電気部品を制御する手段とのそれぞれを指す。また、主基板３１以外のマイクロコンピュータが搭載された基板をサブ基板ということがある。

遊技機裏面において、上方には、各種情報を遊技機外部に出力するための各端子を備えたターミナル基板１６０が設置されている。ターミナル基板１６０には、少なくとも、球切れ検出スイッチ１６７の出力を導入して外部出力するための球切れ用端子、賞球情報（賞球個数信号）を外部出力するための賞球用端子および球貸し情報（球貸し個数信号）を外部出力するための球貸し用端子が設けられている。また、中央付近には、主基板３１からの各種情報を遊技機外部に出力するための各端子を備えた情報端子基板（情報出力基板）３６が設置されている。

貯留タンク３８に貯留された遊技球は誘導レール３９を通り、カーブ樋を経て払出ケース４０Ａで覆われた球払出装置に至る。球払出装置の上部には、遊技媒体切れ検出手段としての球切れスイッチ１８７が設けられている。球切れスイッチ１８７が球切れを検出すると、球払出装置の払出動作が停止する。球切れスイッチ１８７は遊技球通路内の遊技球の有無を検出するスイッチであるが、貯留タンク３８内の補給球の不足を検出する球切れ検出スイッチ１６７も誘導レール３９における上流部分（貯留タンク３８に近接する部分）に設けられている。球切れ検出スイッチ１６７が遊技球の不足を検知すると、遊技機設置島に設けられている補給機構から遊技機に対して遊技球の補給が行われる。

入賞にもとづく景品としての遊技球や球貸し要求にもとづく遊技球が多数払い出されて打球供給皿３が満杯になると、遊技球は、余剰球通路を経て余剰球受皿４に導かれる。さらに遊技球が払い出されると、感知レバー（図示せず）が貯留状態検出手段としての満タンスイッチ（図示せず）を押圧して、貯留状態検出手段としての満タンスイッチがオンする。その状態では、球払出装置内の払出モータの回転が停止して球払出装置の動作が停止するとともに打球発射装置の駆動も停止する。

図４は、主基板３１における回路構成の一例を示すブロック図である。なお、図４には、遊技機に搭載されている払出制御基板３７、ランプドライバ基板３５、音声出力基板７０、インタフェース基板６６、中継基板７７および演出制御基板８０も示されている。主基板３１には、プログラムに従ってパチンコ遊技機１を制御する基本回路（遊技制御手段に相当）５３と、ゲートスイッチ３２ａ、始動口スイッチ１４ａ、Ｖ入賞スイッチ２２、カウントスイッチ２３、入賞口スイッチ２９ａ，３０ａ，３３ａ，３９ａ、および全入賞計数スイッチ３４からの信号を基本回路５３に与える入力ドライバ回路５８と、可変入賞球装置１５を開閉するソレノイド１６、特別可変入賞球装置２０を開閉するソレノイド２１および大入賞口内の経路を切り換えるためのソレノイド２１Ａを基本回路５３からの指令に従って駆動する出力回路５９とが搭載されている。

なお、ゲートスイッチ３２ａ、始動口スイッチ１４ａ、Ｖ入賞スイッチ２２、カウントスイッチ２３、入賞口スイッチ２９ａ，３０ａ，３３ａ，３９ａ、全入賞計数スイッチ３４等のスイッチは、センサと称されているものでもよい。すなわち、遊技球を検出できる遊技媒体検出手段（この例では遊技球検出手段）であれば、その名称を問わない。入賞検出を行う始動口スイッチ１４ａ、カウントスイッチ２３、および入賞口スイッチ２９ａ，３０ａ，３３ａ，３９ａの各スイッチは、入賞領域への遊技球の入賞を検出する入賞検出手段でもある。なお、ゲート３２のような通過ゲートであっても、賞球の払い出しが行われるものであれば、通過ゲートへ遊技球が進入することが入賞になり、通過ゲートに設けられているスイッチ（例えばゲートスイッチ３２ａ）が入賞検出手段になる。さらに、この実施の形態では、Ｖ入賞領域に入賞した遊技球が、Ｖ入賞スイッチ２２で検出されるとともにカウントスイッチ２３でも検出される。よって、大入賞口に入賞した遊技球数は、カウントスイッチ２３による検出数に相当する。しかし、Ｖ入賞領域に入賞した遊技球はＶ入賞スイッチ２２のみで検出されるようにし、大入賞口に入賞した遊技球数は、Ｖ入賞スイッチ２２による検出数とカウントスイッチ２３による検出数との和になるようにしてもよい。さらに、Ｖ入賞領域を設けず、最終ラウンド以外のラウンドでは、常に継続権が発生するようにしてもよい。

基本回路５３は、ゲーム制御（遊技進行制御）用のプログラム等を記憶するＲＯＭ５４、ワークメモリとして使用される記憶手段（変動データを記憶する変動データ記憶手段）としてのＲＡＭ５５、およびプログラムに従って制御動作を行うＣＰＵ５６を有する遊技制御用マイクロコンピュータ５６０を含む。なお、この実施の形態では、ＣＰＵ５６とは、基本回路５３のうち、プログラムに従って動作する中央処理装置（ＲＯＭ５４やＲＡＭ５５などの記憶手段、Ｉ／Ｏポート部５７などを除いた部分）を指す。また、遊技制御用マイクロコンピュータ５６０とは、基本回路５３のうち、ＣＰＵ５６に加えて、ＲＯＭ５４やＲＡＭ５５などの記憶手段、乱数回路５０３、シリアル通信回路５０５、Ｉ／Ｏポート部５７などを含む部分を指す。この実施の形態では、ＲＯＭ５４、ワークメモリとしての記憶手段であるＲＡＭ５５およびＩ／Ｏポート部５７は遊技制御用マイクロコンピュータ５６０に内蔵されている。すなわち、遊技制御用マイクロコンピュータ５６０は、１チップマイクロコンピュータである。１チップマイクロコンピュータは、少なくともＲＡＭ５５が内蔵されていればよく、ＲＯＭ５４は外付けであっても内蔵されていてもよい。

なお、遊技制御用マイクロコンピュータ５６０においてＣＰＵ５６がＲＯＭ５４に格納されているプログラムに従って制御を実行するので、以下、遊技制御用マイクロコンピュータ５６０が実行する（または、処理を行う）ということは、具体的には、ＣＰＵ５６がプログラムに従って制御を実行することである。このことは、主基板３１以外の他の基板に搭載されているマイクロコンピュータについても同様である。また、遊技制御手段は、遊技制御用マイクロコンピュータ５６０を含む基本回路５３で実現されている。

また、ＲＡＭ５５は、その一部または全部が電源基板９１０において作成されるバックアップ電源によってバックアップされている不揮発性記憶手段としてのバックアップＲＡＭである。すなわち、遊技機に対する電力供給が停止しても、所定期間（バックアップ電源としてのコンデンサが放電してバックアップ電源が電力供給不能になるまで）は、ＲＡＭ５５の一部または全部の内容は保存される。特に、少なくとも、遊技状態すなわち遊技制御手段の制御状態に応じたデータ（特別図柄プロセスフラグ等）と未払出賞球数を示すデータは、バックアップＲＡＭに保存される。遊技制御手段の制御状態に応じたデータとは、停電等が生じた後に復旧した場合に、そのデータにもとづいて、制御状態を停電等の発生前に復旧させるために必要なデータである。また、制御状態に応じたデータと未払出賞球数を示すデータとを遊技の進行状態を示すデータと定義する。なお、この実施の形態では、ＲＡＭ５５の全部が、電源バックアップされているとする。

遊技制御用マイクロコンピュータ５６０のリセット端子には、電源基板９１０からのリセット信号が入力される。また、払出制御用マイクロコンピュータのリセット端子にも、電源基板９１０からのリセット信号が入力される。なお、リセット信号がハイレベルになると遊技制御用マイクロコンピュータ５６０および払出制御用マイクロコンピュータは動作可能状態になり、リセット信号がローレベルになると遊技制御用マイクロコンピュータ５６０および払出制御用マイクロコンピュータは動作停止状態になる。従って、リセット信号がハイレベルである期間は、遊技制御用マイクロコンピュータ５６０および払出制御用マイクロコンピュータの動作を許容する許容信号が出力されていることになり、リセット信号がローレベルである期間は、遊技制御用マイクロコンピュータ５６０および払出制御用マイクロコンピュータの動作を停止させる動作停止信号が出力されていることになる。なお、リセット回路をそれぞれの電気部品制御基板（主基板３１を含む）に搭載してもよいし、複数の電気部品制御基板のうちの一つまたは複数にリセット回路を搭載し、そこからリセット信号を他の電気部品制御基板に供給するようにしてもよい。

さらに、基本回路５３の入力ポートには、払出制御基板３７を経由して、電源基板９１０からの電源電圧が所定値以下に低下したことを示す電源断信号が入力される。また、基本回路５３の入力ポートには、ＲＡＭの内容をクリアすることを指示するためのクリアスイッチが操作されたことを示すクリア信号が入力される。

クリア信号は、主基板３１において分岐され、払出制御基板３７にも供給される。なお、遊技制御用マイクロコンピュータ５６０が入力ポートを介して入力したクリア信号の状態を、出力ポートを介して払出制御基板３７に出力してもよい。

この実施の形態では、演出制御基板８０に搭載されている演出制御手段（演出制御用マイクロコンピュータで構成される。）が、中継基板７７を介して遊技制御用マイクロコンピュータ５６０からの演出制御コマンドを受信し、飾り図柄を可変表示する可変表示装置９の表示制御等を行う。

図５は、主基板３１における回路構成および主基板３１から演出制御基板８０に送信される演出制御コマンドの信号線を示すブロック図である。図５に示すように、この実施の形態では、主基板３１が搭載する遊技制御用マイクロコンピュータ５６０は、演出制御信号送信用の８本の信号線ＣＤ０〜ＣＤ７を用いて、演出制御コマンドを演出制御基板８０に送信する。また、主基板３１と演出制御基板８０との間には、ストローブ信号を送受するための演出制御ＩＮＴ信号の信号線も配線されている。

主基板３１には、図５に示すように、始動口スイッチ１４ａからの配線が接続されている。また、主基板３１には、大入賞口である特別可変入賞球装置２０や、その他の入賞口への遊技球の入賞等を検出するための各種スイッチ２９ａ，３０ａ，３３ａ，３９ａからの配線も接続されている。さらに、主基板３１には、可変入賞球装置１５を開閉するソレノイド１６、特別可変入賞球装置２０を開閉するソレノイド２１および大入賞口内の経路を切り換えるためのソレノイド２１Ａへの配線が接続されている。

主基板３１は、遊技制御用マイクロコンピュータ５６０、入力ドライバ回路５８および出力回路５９を搭載する。遊技制御用マイクロコンピュータ５６０は、クロック回路５０１、システムリセット手段として機能するリセットコントローラ５０２、乱数回路５０３ａ，５０３ｂ、ゲーム制御用のプログラム等を記憶するＲＯＭ５４、ワークメモリとして使用されるＲＡＭ５５、プログラムに従って動作するＣＰＵ５６、ＣＰＵに割込要求信号（タイマ割込による割込要求信号）を送出するＣＴＣ５０４、払出制御基板３７や演出制御基板８０が備えるＣＰＵと非同期シリアル通信を行うシリアル通信回路５０５およびＩ／Ｏポート部５７を内蔵する。

なお、この実施の形態では、シリアル通信回路５０５を内蔵するマイクロコンピュータを搭載した基板（例えば、主基板３１）とは異なる基板（例えば、払出制御基板３７や演出制御基板８０）のＣＰＵとの通信にシリアル通信回路５０５を用いる場合を説明するが、シリアル通信回路５０５は、シリアル通信回路５０５を内蔵するマイクロコンピュータを搭載した基板が備える別のＣＰＵとシリアル通信を行ってもよい。例えば、同じ構成の２つのマイクロコンピュータが同じ基板に搭載されている場合に、各マイクロコンピュータが内蔵するシリアル通信回路が相互にシリアル通信を行ってもよい。

クロック回路５０１は、システムクロック信号を２^７（＝１２８）分周して生成した所定の周期の基準クロック信号ＣＬＫを、各乱数回路５０３ａ，５０３ｂに出力する。リセットコントローラ５０２は、ローレベルの信号が一定期間入力されたとき、ＣＰＵ５６および各乱数回路５０３ａ，５０３ｂに所定の初期化信号を出力して、遊技制御用マイクロコンピュータ５６０をシステムリセットする。

また、この実施の形態では、図５に示すように、遊技制御用マイクロコンピュータ５６０は、発生可能な乱数の値の範囲が異なる２つの乱数回路５０３ａ，５０３ｂを搭載する。乱数回路５０３ａは、１２ビットの疑似乱数を発生する乱数回路（以下、１２ビット乱数回路ともいう）である。１２ビット乱数回路５０３ａは、１２ビットで発生できる範囲（すなわち、０から４０９５までの範囲）の値の乱数を発生する機能を備える。また、乱数回路５０３ｂは、１６ビットの疑似乱数を発生する乱数回路（以下、１６ビット乱数回路ともいう）である。１６ビット乱数回路５０３ｂは、１６ビットで発生できる範囲（すなわち、０から６５５３５までの範囲）の値の乱数を発生する機能を備える。なお、この実施の形態では、遊技制御用マイクロコンピュータ５６０が２つの乱数回路を内蔵する場合を説明するが、遊技制御用マイクロコンピュータ５６０は、３以上の乱数回路を内蔵してもよい。また、この実施の形態では、１２ビット乱数回路５０３ａおよび１６ビット乱数回路５０３ｂを包括的に表現する場合、または、１２ビット乱数回路５０３ａと１６ビット乱数回路５０３ｂとのうちいずれかを指す場合に、乱数回路５０３という。

次に、乱数回路５０３の構成について説明する。図６は、乱数回路５０３の構成例を示すブロック図である。なお、この実施の形態において、１２ビット乱数回路５０３ａと１６ビット乱数回路５０３ｂとの基本的な構成は同じである。図６に示すように、乱数回路５０３は、カウンタ５２１、比較器５２２、カウント値順列変更回路５２３、クロック信号出力回路５２４、カウント値更新信号出力回路５２５、乱数値読取信号出力回路５２６、乱数更新方式選択信号出力回路５２７、セレクタ５２８、乱数回路起動信号出力回路５３０、乱数値記憶回路５３１、反転回路５３２、ラッチ信号生成回路５３３およびタイマ回路５３４とを含む。

この実施の形態では、乱数回路５０３は、複数種類の識別情報の可変表示の表示結果を特定の表示結果とするか否か（例えば、特別図柄表示装置８の表示図柄の組み合わせを大当り図柄の組み合わせとするか否か）を判定するための大当り判定用の乱数を発生する。そして、遊技制御用マイクロコンピュータ５６０は、乱数回路５０３が発生した乱数にもとづいて特定の表示結果とすると判定すると、遊技状態を遊技者にとって有利な特定遊技状態（例えば、大当り遊技状態）に移行させる。なお、この実施の形態では、確変とするか否かを決定するための確変決定用乱数や、特別図柄（大当り図柄）を決定する特別図柄決定用乱数など、大当り判定用以外の判定用乱数については、後述するようにソフトウェア乱数を用いる。

カウンタ５２１は、セレクタ５２８によって選択された所定の信号を入力し、セレクタ５２８から入力する信号に応答してカウント値Ｃを出力する。この場合、カウンタ５２１は、所定の初期値を入力し、カウント値Ｃを一定の規則に従って初期値から所定の最終値まで循環的に更新して出力する。また、カウンタ５２１は、カウント値Ｃを最終値まで更新すると、カウント値Ｃを最終値まで更新した旨を示す通知信号をＣＰＵ５６に出力する。この実施の形態では、カウンタ５２１から通知信号が出力されると、ＣＰＵ５６によって初期値が更新される。

この実施の形態において、カウンタ５２１は、セレクタ５２８から信号を入力するごとに（セレクタ５２８からの信号における立ち上がりエッヂが入力されるごとに）、カウント値Ｃを「０」から「４０９５」まで１ずつカウントアップする。また、カウンタ５２１は、カウント値Ｃを「４０９５」までカウントアップすると、カウント値Ｃを最終値まで更新した旨を示す通知信号をＣＰＵ５６に出力する。すると、ＣＰＵ５６は、カウンタ５２１から通知信号を入力し、初期値を更新する。そして、カウンタ５２１は、ＣＰＵ５６によって更新された初期値から「４０９５」まで、再びカウント値Ｃをカウントアップする。また、「４０９５」までカウントアップすると、カウンタ５２１は、再び「０」からカウントを開始する。そして、カウンタ５２１は、更新後の初期値の１つ前の値（最終値）までカウントアップすると、通知信号をＣＰＵ５６に出力する。なお、この実施の形態では、比較器５２２は、後述するように、全てのカウント値を入力すると通知信号をカウンタ５２１に出力する。この場合、カウンタ５２１は、比較器５２２から通知信号を入力すると、カウント値をリセットして「０」にする。

なお、比較器５２２は、入力したカウント値が乱数最大値設定レジスタ５３５に設定されている乱数最大値より大きいか否かを判断し、カウント値が乱数最大値より大きい（乱数最大値を超えた）と判断すると、通信信号をカウンタ５２１に出力してもよい。この場合、例えば、比較器５２２は、カウント値が乱数最大値を超えたと判断すると、クロック信号出力回路５２４が次に乱数発生用クロック信号ＳＩ１を出力する前に、通知信号をカウンタ５２１に出力する。例えば、乱数最大値設定レジスタ５３５に乱数最大値「２５６」が設定されている場合を考える。この場合、カウンタ５２１が「０」から「２５６」までカウントアップし、さらにカウント値「２５７」を出力すると、比較器５２２は、入力したカウント値「２５７」が乱数最大値「２５６」を超えたと判断し、カウンタ５２１に通知信号を出力する。比較器５２２から通知信号を入力すると、カウンタ５２１は、クロック信号出力回路５２４からの乱数発生用クロック信号ＳＩ１の入力を待つことなく、カウント値を「２５８」に更新し出力する。以上の処理を繰り返し実行することによって、比較器５２２は、カウント値「２５７」から「４０９５」まで入力している間、カウント値が乱数最大値を超えていると判断して、繰り返しカウンタ５２１に通知信号を出力する。そして、カウンタ５２１は、比較器５２２から通知信号を入力している間、クロック信号出力回路５２４からの乱数発生用クロック信号ＳＩ１の入力を待つことなく、カウント値を繰り返し更新し出力する。そのようにすることによって、クロック信号出力回路５２４が次に乱数発生用クロック信号ＳＩ１を出力するまでの間に、「２５７」から「４０９５」までカウント値を高速にカウントアップさせるように制御し、「２５７」から「４０９５」までの乱数値を読み飛ばす（乱数値記憶回路５３１に記憶させない）ように制御する。

カウント値順列変更回路５２３は、カウント値順列変更レジスタ（ＲＳＣ）５３６、更新規則選択レジスタ（ＲＲＣ）５４２および更新規則メモリ５４３を含む。カウント値順列変更レジスタ５３６は、カウンタ５２１がカウントアップするカウント値Ｃの更新順である順列（初期値から最終値までの並び順）を変更させるためのカウント値順列変更データ「０１ｈ」を格納する。カウント値順列変更回路５２３は、カウント値順列変更レジスタ５３６に数値順列変更データ「０１ｈ」が格納されているとき、カウンタ５２１がカウントアップして更新するカウント値Ｃの順列を、カウント値順列変更データ「０１ｈ」が格納されていないときとは異なる順列に変更する。この場合、カウント値順列変更回路５２３は、数値順列変更データ「０１ｈ」が格納されているとき、カウント値の順列の変更に用いる更新規則を切り換える。また、カウント値の順列の変更に用いる更新規則を切り換えた後に、カウンタ５２１がカウント値の更新を開始すると、カウント値順列変更レジスタ５３６のカウント値順列変更データは、ＣＰＵ５６によって、「０１ｈ」から初期値である「０（＝００ｈ）」に戻される（クリアされる）。

図７は、更新規則選択レジスタ５４２の例を示す説明図である。更新規則選択レジスタ５４２は、カウンタ５２１が出力するカウント値の並び順の並べ替え（順列の変更）に用いる更新規則を設定するレジスタである。この実施の形態では、更新規則選択レジスタ５４２にレジスタ値が設定されることによって、カウンタ５２１が出力するカウント値の順列の変更に用いる更新規則が設定される。図７に示すように、更新規則選択レジスタ５４２は、８ビットレジスタであり、初期値が「０（＝００ｈ）」に設定されている。また、更新規則選択レジスタ５４２は、ビット０〜ビット３が書込および読出ともに可能な状態に構成されている。また、更新規則選択レジスタ５４２は、ビット４〜ビット７が書込および読出ともに不可能な状態に構成されている。したがって、更新規則選択レジスタ５４２のビット４〜ビット７に値を書き込む制御を行っても無効とされ、ビット４〜ビット７から読み出す値は全て「０（＝００００ｂ）」である。

更新規則選択レジスタ５４２の値（レジスタ値）は、カウント値順列変更レジスタ５３６にカウント値順列変更データ「０１ｈ」が書き込まれたことに応じて、レジスタ値が「０（＝００ｈ）」から「１５（＝０Ｆｈ）」まで循環的に更新される。すなわち、カウント値順列変更レジスタ５３６にカウント値順列データ「０１ｈ」が書き込まれるごとに、更新規則選択レジスタ５４２のレジスタ値は、「０」から「１」ずつ加算され、「１５」になると再び「０」に戻る。

図８は、更新規則メモリ５４３の例を示す説明図である。図８に示すように、更新規則メモリ５４３は、更新規則選択レジスタ５４２の値（レジスタ値）と、カウント値の更新規則とを対応付けて格納している。図８に示す例では、例えば、更新規則選択レジスタ５４２にレジスタ値１が設定されている場合、更新規則Ｂを用いて、カウンタ５２１が出力するカウント値の順列が変更されることが分かる。なお、図８において、更新規則Ａは、カウンタ５２１がカウント値Ｃを更新する規則と同一の更新規則であり、レジスタ値「０」に対応づけて更新規則メモリ５４３に格納される。また、更新規則メモリ５４３には、カウンタ５２１がカウント値Ｃを更新する更新規則とは異なる更新規則Ｂ〜Ｐが、レジスタ値「１」〜「１５」に対応づけて格納される。

カウント値順列変更回路５２３は、カウント値順列変更レジスタ５３６にカウント値順列変更データ「０１ｈ」が書き込まれている場合、まず、カウンタ５２１からカウント値の最終値「４０９５」が最初に入力されるまで、現在設定されている更新規則に従って、そのままカウント値を出力する。そして、カウント値順列変更回路５２３は、カウンタ５２１からカウント値の最終値「４０９５」を入力すると、カウント値の更新規則を変更する。なお、ＣＰＵ５６によって初期値が変更されている場合には、カウント値順列変更回路５２３は、カウンタ５２１から変更後の最終値（初期値の１つ前の値）まで入力すると、カウント値の更新規則を変更することになる。

カウント値順列変更回路５２３は、更新規則選択レジスタ５４２のレジスタ値に対応する更新規則を更新規則メモリ５４３から選択し、カウント値の順列の変更に用いる更新規則として設定する。また、カウント値順列変更回路５２３は、カウンタ５２１によって再び初期値「０」から順にカウント値の更新が開始されると、設定した更新規則に従って、カウント値の初期値から最終値までの順列を変更する。なお、ＣＰＵ５６によって初期値が変更されている場合には、カウント値順列変更回路５２３は、カウンタ５２１によって変更後の初期値から順にカウント値の更新が開始されると、設定した更新規則に従って、カウント値の初期値から最終値までの順列を変更することになる。そして、カウント値順列変更回路５２３は、変更した順列に従ってカウント値を出力する。

なお、この実施の形態では、後述する乱数最大値設定レジスタ５３５に乱数最大値が設定されていることによって、発生させる乱数の最大値が制限されている場合、カウント値順列変更回路５２３は、カウント値Ｃを乱数最大値以下に制限して順列を変更して出力する。例えば、乱数最大値設定レジスタ５３５に乱数最大値「２５６」が設定されているものとし、カウント値順列変更回路５２３が、更新規則Ａから更新規則Ｂに変更して、カウント値の順列を変更するものとする。この場合、カウント値順列変更回路５２３は、比較器５２２の乱数最大値設定レジスタ５３５に設定されている乱数最大値「２５６」にもとづいて、更新規則Ｂに従って、カウント値の順列を「２５６→２５５→・・・→０」に変更して出力する。

以上のように、カウント値順列変更回路５２３は、カウント値順列変更レジスタ５３６にカウント値順列変更データ「０１ｈ」が書き込まれている場合、更新規則を切り替えて用いることによって、カウント値Ｃの順列を変更して出力する。そのため、乱数回路５０３が生成する乱数のランダム性を向上させることができる。

図９は、カウント値順列変更回路５２３が、カウンタ５２１が出力するカウント値の順列を変更する場合の例を示す説明図である。図９に示すように、ＣＰＵ５６は、所定のタイミングで、カウント値順列変更データ「０１ｈ」をカウント値順列変更レジスタ５３６に書き込む。すると、更新規則選択レジスタ５４２のレジスタ値が１加算される。例えば、更新規則選択レジスタ５４２のレジスタ値が「０」から「１」に更新される。レジスタ値が更新されると、カウント値順列変更回路５２３は、カウンタ５２１から最初にカウント値の最終値「４０９５」が入力されるまで、更新前のレジスタ値「０」に対応する「更新規則Ａ」に従ってカウント値を更新して出力する。このとき、カウント値順列変更回路５２３は、更新規則Ａに従って、「０→１→・・・→４０９５」の順列でカウント値を出力する。

カウンタ５２１からカウント値の最終値「４０９５」が入力されると、カウント値順列変更回路５２３は、更新規則メモリ５４３から、更新後のレジスタ値「１」に対応する「更新規則Ｂ」を選択して設定する。カウント値順列変更回路５２３は、カウンタ５２１から再び初期値「０」以降のカウント値の入力を開始すると、選択設定した「更新規則Ｂ」に従って、カウント値の順列を変更して出力する。本例では、カウント値順列変更回路５２３は、順列を「０→１→・・・→４０９５」から「４０９５→４０９４→・・・→０」に変更して、カウント値を出力する。

その後、カウント値順列変更レジスタ５３６は、後述するように、カウント値順列変更回路５２３が切り替え後の更新規則に従ってカウント値の更新動作を開始したことに応じてリセットされる。そして、次にカウント値順列変更データ「０１ｈ」がカウント値順列変更レジスタ５３６に書き込まれるまで、カウント値順列変更回路５２３は、「４０９５→４０９４→・・・→０」のままの順列で、カウント値を出力し続ける。

ＣＰＵ５６によってカウント値順列変更データ「０１ｈ」がカウント値順列変更レジスタ５３６に再度書き込まれると、カウント値順列変更レジスタ５３６のレジスタ値が「１」から「２」に更新される。そして、カウンタ５２１からカウント値の最終値「４０９５」を入力すると、カウント値順列変更回路５２３は、更新規則メモリ５４３から、レジスタ値「２」に対応する「更新規則Ｃ」を選択して設定する。カウント値順列変更回路５２３は、カウンタ５２１から再び初期値「０」以降のカウント値の入力を開始すると、選択設定した「更新規則Ｃ」に従って、カウント値の順列を更新して出力する。本例では、カウント値順列変更回路５２３は、順列を「４０９５→４０９４→・・・→０」から「１→３→…→４０９５→０→・・・→４０９４」に変更して、カウント値を出力する。

以上のように、カウント値順列変更レジスタ５３６をリセットした後、カウント値順列データ「０１ｈ」をカウント値順列変更レジスタ５３６に再度書き込むことによって、カウント値の順列をさらに変更することができる。

図１０は、カウント値順列変更レジスタ５３６の例を示す説明図である。カウント値順列変更レジスタ５３６は、カウンタ５２１がカウントアップするカウント値の順列を変更させるためのカウント値順列変更データ「０１ｈ」を設定するレジスタである。図１０に示すように、カウント値順列変更レジスタ５３６は、読出可能な８ビットレジスタであり、初期値が「０（＝００ｈ）」に設定されている。また、カウント値順列変更レジスタ５３６は、ビット０だけが書込および読出ともに可能な状態に構成されている。すなわち、カウント値順列変更レジスタ５３６は、ビット１〜ビット７が書込および読出ともに不可能な状態に構成されている。したがって、カウント値順列変更レジスタ５３６のビット１〜ビット７に値を書き込む制御を行っても無効とされ、ビット１〜ビット７から読み出す値は全て「０（＝０００００００ｂ）」である。

なお、カウント値順列変更レジスタ５３６の値は、カウント値順列変更回路５２３が切り替え後の更新規則に従ってカウント値の更新動作を開始したことに応じて、ＣＰＵ５６によってリセットされる。この場合、ＣＰＵ５６は、カウント値順列変更レジスタ５３６に書き込まれている値を、カウント値順列変更データ「０１ｈ」から初期値である「０（＝００ｈ）」に戻す。

比較器５２２は、ランダムＲの最大値（乱数最大値）を指定するための乱数最大値設定データを格納する乱数最大値設定レジスタ（ＲＭＸ）５３５を備える。比較器５２２は、乱数最大値設定レジスタ５３５に格納されている乱数最大値設定データに示される乱数最大値に従って、カウンタ５２１が更新するカウント値の更新範囲を制限する。この実施の形態では、比較器５２２は、カウンタ５２１から入力するカウント値と乱数最大値設定レジスタ５３５に格納されている乱数最大値設定データ（例えば「００ＦＦｈ」）に示される乱数最大値（例えば「２５６」）とを比較する。そして、比較器５２２は、入力したカウント値が乱数最大値以下であると判断すると、入力したカウント値を乱数値記憶回路５３１に出力する。

この実施の形態では、比較器５２２は、具体的には、以下のような制御を行う。比較器５２２は、カウント値の初期値更新の際に、ＣＰＵ５６からカウント値の初期値をもらい、初期値から乱数最大値までのカウント値の個数を求める。例えば、カウント値の初期値が「１５７」であり乱数最大値が「２５６」である場合、比較器５２２は、初期値から乱数最大値までのカウント値の個数を「１００個」と求める。また、比較器５２２は、カウント値順列変更回路５２３からカウント値を入力するに従って、初期値からカウント値をいくつ入力したかをカウントアップする。初期値からカウント値を入力した回数が「１００回」に達すると、比較器５２２は、初期値「１５７」から最大値「２５６」までの全てのカウント値を入力したと判断する。そして、比較器５２２は、全てのカウント値を入力した旨の通知信号をカウンタ５２１に出力する。カウント値の個数で判断することによって、カウント値順列変更回路５２３によってカウント値の順列が変更されている場合であっても、比較器５２２は、カウント値の更新範囲を乱数最大値以下に制限し、全てのカウント値を入力した際にカウンタ５２１に通知信号を出力することができる。

カウント値の更新範囲を比較器５２２が制限する動作について説明する。なお、本例では、カウント値順列変更回路５２３が更新規則Ａを選択し、乱数最大値設定レジスタ５３５に乱数最大値「２５６」が設定されている場合を説明する。

カウンタ５２１が「０」から「２５６」までカウント値を更新している間、カウント値順列変更回路５２３は、乱数最大値設定レジスタ５３５に設定されている乱数最大値「２５６」にもとづいて、更新規則Ａに従って、「０」から「２５６」までのカウント値をそのまま比較器５２２に出力する。この場合、カウント値順列変更回路５２３は、比較器５２２から乱数最大値「２５６」の値をもらい、カウンタ５２１から入力するカウント値が乱数最大値より大きいか否かを判断し、更新規則が変更されているとき（例えば、更新規則Ｂ）であっても、乱数最大値設定レジスタ５３５に設定されている乱数最大値「２５６」にもとづいて、「２５７」から「４０９５」までのカウント値を比較器５２２に出力しない。カウンタ５２１は、例えば、初期値が「０」と設定されているときに、最終値「２５６」までカウント値を更新すると、通知信号をＣＰＵ５６に出力する。通知信号を出力すると、ＣＰＵ５６によって、カウンタ５２１のカウント値の初期値が変更される。本例では、ＣＰＵ５６によって、初期値が「５０」に変更されるものとする。

更新規則Ａにもとづいて、カウント値順列変更回路５２３から、「０」から「２５５」までカウント値を入力している間、比較器５２２は、入力するカウント値が乱数最大値「２５６」以下であるので、入力したカウント値をそのまま乱数値記憶回路５３１に出力する。次に、カウント値順列変更回路５２３から入力するカウント値が「２５６」に達すると、比較器５２２は、入力したカウント値を乱数値記憶回路５３１に出力するとともに、初期値から最大値までの全てのカウント値を入力した旨の通知信号をカウンタ５２１に出力する。具体的には、比較器５２２は、カウント値の初期値変更の際に、ＣＰＵ５６からカウント値の初期値（本例では、「０」）をもらい、初期値「０」から乱数最大値（本例では、「２５６」）までのカウント値の個数（本例では、「２５７個」）を求める。そして、カウント値順列変更回路５２３から入力したカウント値の個数が２５７個に達すると、全てのカウント値を入力した旨の通知信号をカウンタ５２１に出力する。なお、本例では、ＣＰＵ５６によって初期値が「５０」に変更されるので、カウンタ５２１は、比較器５２２から通知信号を入力しても、カウント値をリセットするとなく、変更後の初期値「５０」からカウント値の更新を行う。

カウンタ５２１が変更後の初期値「５０」から「２５６」までカウント値を更新している間、カウント値順列変更回路５２３は、乱数最大値設定レジスタ５３５に設定されている乱数最大値「２５６」にもとづいて、更新規則Ａに従って、「５０」から「２５６」までのカウント値をそのまま比較器５２２に出力する。また、カウント値順列変更回路５２３は、乱数最大値設定レジスタ５３５に設定されている乱数最大値「２５６」にもとづいて、「２５７」から「４０９５」までのカウント値を比較器５２２に出力せず、カウンタ５２１の更新するカウント値が１周したとき（２５７回更新したとき）に、カウント値順列変更レジスタ５３６にカウント値順列変更データが書き込まれた場合には、カウント値順列変更回路５２３は、カウント値の順列を変更して出力する。例えば、更新規則が更新規則Ｂに変更された場合、カウント値順列変更回路５２３は、カウント値の順列を「２５６→２５５→・・・→５０」に変更して出力する。

カウント値順列変更回路５２３から、「２５６」から「５０」までカウント値を入力している間、比較器５２２は、入力したカウント値をそのまま乱数値記憶回路５３１に出力する。次に、カウント値順列変更回路５２３から入力するカウント値が「５０」に達すると、比較器５２２は、入力したカウント値を乱数値記憶回路５３１に出力するとともに、初期値から最大値までの全てのカウント値を入力した旨の通知信号をカウンタ５２１に出力する。具体的には、比較器５２２は、カウント値の初期値変更の際に、ＣＰＵ５６からカウント値の初期値（本例では、「５０」）をもらい、初期値「５０」から乱数最大値（本例では、「２５６」）までのカウント値の個数（本例では、「２０７個」）を求める。そして、カウント値順列変更回路５２３から入力したカウント値の個数が２０７個に達すると、全てのカウント値を入力した旨の通知信号をカウンタ５２１に出力する。

なお、カウント値順列変更回路５２３がカウント値の順列を変更した場合であっても、比較器５２２は、カウント値の個数が２０７個に達すると、通知信号をカウンタ５２１に出力する。そのようにすることによって、カウント値の順列が変更された場合であっても、初期値「５０」から最大値「２５６」までの全てのカウント値を入力したことにもとづいて、通知信号をカウンタ５２１に出力できる。

比較器５２２から通知信号を入力すると、カウンタ５２１は、カウント値をリセットし「０」に戻す。そして、カウンタ５２１は、「０」からカウント値の更新を行う。カウンタ５２１の値が「０」から再び更新がされると、カウンタ５２１からのカウント値にもとづいて、カウント値順列変更回路５２３は「４９」〜「０」までのカウント値を比較器５２２に出力し、比較器５２２はカウント値順列変更回路５２３からのカウント値の入力にもとづいて乱数値記憶回路５３１にカウント値を出力する。そして、カウンタ５２１は、最終値（本例では、「４９」）までカウント値を更新すると、通知信号をＣＰＵ５６に出力する。通知信号を出力すると、ＣＰＵ５６によって、カウンタ５２１のカウント値の初期値が再び変更される。

以上のような動作を繰り返すことにより、比較器５２２は、カウンタ５２１に、「０」から乱数最大値「２５６」まで連続的にカウント値をカウントアップさせ、「０」から「２５６」までの値を乱数値記憶回路５３１にランダムＲ（乱数値）として記憶させる。すなわち、比較器５２２は、カウント値の更新範囲を乱数最大値「２５６」以下に制限して、カウンタ５２１にカウント値を更新させる。

図１１は、乱数最大値設定レジスタ５３５の例を示す説明図である。図１１（ａ）は、１２ビット乱数回路５０３ａが搭載する乱数最大値設定レジスタ５３５の例を示す。また、図１１（ｂ）は、１６ビット乱数回路５０３ｂが搭載する乱数最大値設定レジスタ５３５の例を示す。まず、１２ビット乱数回路５０３ａが搭載する乱数最大値設定レジスタ５３５について説明する。図１１（ａ）に示すように、１２ビット乱数回路５０３ａにおいて、乱数最大値設定レジスタ５３５は、１６ビットレジスタであり、初期値が「４０９５（＝０ＦＦＦｈ）」に設定されている。乱数最大値設定レジスタ５３５は、ビット０〜ビット１１が書込および読出ともに可能な状態に構成されている。また、乱数最大値設定レジスタ５３５は、ビット１２〜ビット１５が書込および読出ともに不可能な状態に構成されている。したがって、１２ビット乱数回路５０３ａにおいて、乱数最大値設定レジスタ５３５のビット１２〜ビット１５に値を書き込む制御を行っても無効とされ、ビット１２〜ビット１５から読み出す値は全て「０（＝００００ｂ）」である。

また、乱数最大値設定レジスタ５３５に設定される乱数最大値は、所定の下限値が定められている。この実施の形態では、乱数最大値設定レジスタ５３５に下限値「２５６」より小さい値を指定する乱数最大値設定データ「００００ｈ」〜「００ＦＥｈ」が書き込まれた場合、ＣＰＵ５６は、乱数最大値設定レジスタ５３５に、初期値「４０９５」を指定する乱数最大値設定データ「０ＦＦＦｈ」を設定しなおす。すなわち、乱数最大値設定レジスタ５３５に設定可能な乱数最大値は「２５６」から「４０９５」までであり、ＣＰＵ５６は、下限値「２５６」より小さい値が設定されていると判断すると、乱数最大値を所定値「４０９５」に設定しなおす。なお、ＣＰＵ５６は、リセットコントローラ５０２によって遊技制御用マイクロコンピュータ５６０がシステムリセットされるまで、乱数最大値設定データが書き込まれた乱数最大値設定レジスタ５３５を書込不可能に制御する。

次に、１６ビット乱数回路５０３ｂが搭載する乱数最大値設定レジスタ５３５について説明する。図１１（ｂ）に示すように、１６ビット乱数回路５０３ｂにおいて、乱数最大値設定レジスタ５３５は、１６ビットレジスタであり、初期値が「６５５３５（＝ＦＦＦＦｈ）」に設定されている。また、１６ビット乱数回路５０３ｂにおいて、乱数最大値設定レジスタ５３５は、ビット０〜ビット１５の全てのビットが書込および読出ともに可能な状態に構成されている。

また、乱数最大値設定レジスタ５３５に下限値「５１２」より小さい値を指定する乱数最大値設定データ「００００ｈ」〜「００ＦＥｈ」が書き込まれた場合、ＣＰＵ５６は、乱数最大値設定レジスタ５３５に、初期値「６５５３５」を指定する乱数最大値設定データ「ＦＦＦＦｈ」を設定しなおす。すなわち、乱数最大値設定レジスタ５３５に設定可能な乱数最大値は「５１２」から「６５５３５」までであり、ＣＰＵ５６は、下限値「５１２」より小さい値が設定されていると判断すると、乱数最大値を所定値「６５５３５」に設定しなおす。なお、ＣＰＵ５６は、リセットコントローラ５０２によって遊技制御用マイクロコンピュータ５６０がシステムリセットされるまで、乱数最大値設定データが書き込まれた乱数最大値設定レジスタ５３５を書込不可能に制御する。

クロック信号出力回路５２４は、セレクタ５２８および反転回路５３２に出力するクロック信号の周期（すなわち、カウント値の更新周期）を指定するための周期設定データを格納する周期設定レジスタ（ＲＰＳ）５３７を備える。クロック信号出力回路５２４は、周期設定レジスタ５３７に格納されている周期設定データに基づいて、遊技制御用マイクロコンピュータ５６０が搭載するクロック回路５０１から入力する基準クロック信号ＣＬＫを分周して、乱数回路５０３内部で乱数値の生成に用いるクロック信号（乱数発生用クロック信号ＳＩ１）を生成する。そのようにすることによって、クロック信号出力回路５２４は、クロック信号を所定回数入力したことを条件に、カウント値Ｃを更新させるための乱数発生用クロック信号ＳＩ１をカウンタ５２１に出力するように動作する。なお、周期設定データとは、クロック回路５０１から入力した基準クロック信号ＣＬＫを何分周させるかを設定するためのデータである。また、クロック出力回路５２４は、生成した乱数発生用クロック信号ＳＩ１をセレクタ５２８および反転回路５３２に出力する。例えば、周期設定レジスタ５３７に周期設定データ「０Ｆｈ（＝１６）」が書き込まれている場合、クロック信号出力回路５２４は、クロック回路５０１から入力する基準クロック信号ＣＬＫを１６分周して乱数発生用クロック信号ＳＩ１を生成する。この場合、クロック信号出力回路５２４が生成する乱数発生用クロック信号ＳＩ１の周期は、「システムクロック信号の周期×１２８×１６」となる。

図１２は、周期設定レジスタ５３７の例を示す説明図である。図１２に示すように、周期設定レジスタ５３７は、８ビットレジスタであり、初期値が「２５６（＝ＦＦｈ）」に設定されている。また、周期設定レジスタ５３７は、書込および読出ともに可能な状態に構成されている。

また、周期設定レジスタ５３７に設定される周期設定データの値は、所定の下限値が定められている。この実施の形態では、周期設定レジスタ５３７に下限値「システムクロック信号の周期×１２８×７」より小さい値を指定する周期設定データ「００ｈ〜０６ｈ」が書き込まれた場合、ＣＰＵ５６は、周期設定レジスタ５３７に下限値「システムクロック信号の周期×１２８×７」を指定する周期設定データ「０７ｈ」を設定しなおす。すなわち、周期設定レジスタ５３７に設定可能な周期は「システムクロック信号の周期×１２８×７」から「システムクロック信号の周期×１２８×２５６」までであり、ＣＰＵ５６は、下限値より小さい値が設定されていると判断すると、周期設定データを設定しなおす。なお、ＣＰＵ５６は、リセットコントローラ５０２によって遊技制御用マイクロコンピュータ５６０がシステムリセットされるまで、周期設定データが書き込まれた周期設定レジスタ５３７を書込不可能に制御する。

なお、周期設定レジスタ５３７に下限値としての周期設定データを設定することなく、設定された周期設定データに基づいて、例えばクロック信号出力回路５２４が基準クロック信号ＣＬＫをそのままカウンタ５２１および反転回路５３２に出力するようにしてもよい。この場合、ＣＰＵ５６は、周期設定レジスタ５３７に設定される周期設定データの値を下限値と比較して設定しなおす処理を行う必要がなくなる。また、カウンタ５２１は、クロック信号出力回路５２４から基準クロック信号ＣＬＫを入力する毎にカウント値Ｃを更新することになる。

カウント値更新信号出力回路５２５は、カウント値更新データ「０１ｈ」を格納するカウント値更新レジスタ（ＲＧＮ）５３８を備える。カウント値更新データとは、カウント値の更新を要求するためのデータである。カウント値更新信号出力回路５２５は、カウント値更新レジスタ５３８にカウント値更新データ「０１ｈ」が書き込まれたことに応じて、カウント値更新信号ＳＩ３をセレクタ５２８に出力する。

図１３は、カウント値更新レジスタ５３８の例を示す説明図である。図１３に示すように、カウント値更新レジスタ５３８は、読出不能な８ビットレジスタであり、ビット０のみが書込可能な状態に構成されている。したがって、カウント値更新レジスタ５３８のビット１〜ビット７に値を書き込む制御を行っても無効とされる。

乱数値読取信号出力回路５２６は、乱数値取込データ「０１ｈ」を格納する乱数値取込レジスタ（ＲＬＴ）５３９を備える。乱数値取込データとは、乱数値記憶回路５３１へのカウント値の取込を要求するためのデータである。乱数値読取信号出力回路５２６は、乱数値取込レジスタ５３９に乱数値取込データ「０１ｈ」が書き込まれたことに応じて、乱数値の読み取りを要求するための乱数値読取信号をラッチ信号生成回路５３３に出力する。

図１４は、乱数値取込レジスタ５３９の例を示す説明図である。図１４に示すように、乱数値取込レジスタ５３９は、読出不能な８ビットレジスタである。また、乱数値取込レジスタ５３９は、ビット０だけが書込可能な状態に構成されている。すなわち、乱数値取込レジスタ５３９のビット１〜ビット７に値を書き込む制御を行っても無効とされる。

乱数更新方式選択信号出力回路５２７は、乱数更新方式選択データを格納する乱数更新方式選択レジスタ（ＲＴＳ）５４０を備える。乱数更新方式選択データとは、ランダムＲの値を更新する方式である各乱数更新方式のうち、いずれかの乱数更新方式を指定するためのデータである。乱数更新方式選択信号出力回路５２７は、乱数更新方式選択レジスタ５４０に乱数更新方式選択データが書き込まれたことに応じて、書き込まれた乱数更新方式選択データにより指定される乱数更新方式に対応する乱数更新方式選択信号を、セレクタ５２８およびラッチ信号生成回路５３３に出力する。

図１５（Ａ）は、乱数更新方式選択レジスタ５４０の例を示す説明図である。図１５（Ａ）に示すように、乱数更新方式選択レジスタ５４０は、８ビットレジスタであり、初期値が「００ｈ」に設定されている。また、乱数更新方式選択レジスタ５４０は、ビット０〜ビット１が書込および読出ともに可能な状態に構成されている。また、乱数更新方式選択レジスタ５４０は、ビット２〜ビット７が書込および読出ともに不可能な状態に構成されている。したがって、乱数更新方式選択レジスタ５４０のビット２〜ビット７に値を書き込む制御を行っても無効とされ、ビット２〜ビット７から読み出す値は全て「０（＝００００００ｂ）」である。

図１５（Ｂ）は、乱数更新方式選択レジスタ５４０に書き込まれる乱数更新方式選択データの一例の説明図である。図１５（Ｂ）に示すように、乱数更新方式選択データは、２ビットのデータから構成される。乱数更新方式選択データ「０１ｂ」は、第１の乱数更新方式を指定するために用いられる。また、乱数更新方式選択データ「１０ｂ」は、第２の乱数更新方式を指定するために用いられる。なお、この実施の形態では、第１の乱数更新方式とは、カウント値更新信号出力回路５２５からカウント値更新信号ＳＩ３が出力されたことをトリガとして、カウント値を更新する方式である。また、第２の乱数更新方式とは、クロック信号出力回路５２４から乱数発生用クロック信号ＳＩ１が出力されたことをトリガとして、カウント値を更新する方式である。また、乱数更新方式選択データ「０１ｂ」または「１０ｂ」が乱数更新方式選択レジスタ５４０に書き込まれた場合、乱数回路５０３は起動可能な状態となる。一方、乱数更新方式選択データ「００ｂ」または「１１ｂ」が乱数更新方式選択レジスタ５４０に書き込まれた場合、乱数回路５０３は起動不能な状態となる。

セレクタ５２８は、カウント値更新信号出力回路５２５から出力されるカウント値更新信号ＳＩ３、またはクロック信号出力回路５２４から出力される乱数発生用クロック信号ＳＩ１のいずれかを選択してカウンタ５２１に出力する。セレクタ５２８は、乱数更新方式選択信号出力回路５２７から第１の乱数更新方式に対応する乱数更新方式選択信号（第１の乱数更新方式選択信号ともいう）が入力されると、カウント値更新信号出力回路５２５から出力されるカウント値更新信号ＳＩ３を選択してカウンタ５２１に出力する。一方、セレクタ５２８は、乱数更新方式選択信号出力回路５２７から第２の乱数更新方式に対応する乱数更新方式選択信号（第２の乱数更新方式選択信号ともいう）が入力されると、クロック信号出力回路５２４から出力される乱数発生用クロック信号ＳＩ１を選択してカウンタ５２１に出力する。なお、セレクタ５２８は、乱数更新方式選択信号出力回路５２７から第１の更新方式選択信号が入力されると、カウント値更新信号出力回路５２５から出力されるカウント値更新信号ＳＩ３に応じて、クロック信号出力回路５２４から出力される乱数発生用クロック信号ＳＩ１に同期した数値データの更新を指示する数値更新指示信号を、カウンタ５２１に出力してもよい。

乱数回路起動信号出力回路５３０は、乱数回路起動データ「８０ｈ」を格納する乱数回路起動レジスタ（ＲＳＴ）５４１を備える。乱数回路起動データとは、乱数回路５０３の起動を要求するためのデータである。乱数回路起動信号出力回路５３０は、乱数回路起動レジスタ５４１に乱数回路起動データ「８０ｈ」が書き込まれると、所定の乱数回路起動信号をカウンタ５２１およびクロック信号出力回路５２４に出力し、カウンタ５２１およびクロック信号出力回路５２４をオンにさせる。そして、カウンタ５２１によるカウント値の更新動作とクロック信号出力回路５２４による内部クロック信号の出力動作とを開始させることによって、乱数回路５０３を起動させる。

図１６は、乱数回路起動レジスタ５４１の例を示す説明図である。図１６に示すように、乱数回路起動レジスタ５４１は、８ビットレジスタであり、初期値が「００ｈ」に設定されている。乱数回路起動レジスタ５４１は、ビット７だけが書込および読出ともに可能な状態に構成されている。また、乱数回路起動レジスタ５４１は、ビット０〜ビット６が書込および読出ともに不可能な状態に構成されている。すなわち、乱数回路起動レジスタ５４１のビット０〜ビット６に値を書き込む制御を行っても無効とされ、ビット０〜ビット６から読み出す値は全て「０（＝００００００ｂ）」である。

乱数値記憶回路５３１は、例えば１６ビットレジスタであり、遊技制御処理における大当り判定において用いられる乱数であるランダムＲの値を格納する。乱数値記憶回路５３１は、ラッチ信号生成回路５３３からラッチ信号ＳＬを入力したことに応じて、カウンタ５２１から比較器５２２を介して出力されるカウント値ＣをランダムＲの値として格納する。そして、乱数値記憶回路５３１は、ラッチ信号生成回路５３３からラッチ信号ＳＬを入力するごとに、カウンタ５２１が更新するカウント値Ｃを読み込んでランダムＲの値を記憶する。

図１７は、乱数値記憶回路５３１の一構成例を示す回路図である。乱数値記憶回路５３１は、図１７に示すように、２個のＡＮＤ回路２０１，２０３と、２個のＮＯＴ回路２０２，２０４と、１６個のフリップフロップ回路２１０１〜２１１６と、１６個のＯＲ回路２２０１〜２２１６とを含む。

図１７に示すように、ＡＮＤ回路２０１の入力端子は、ラッチ信号生成回路５３３の出力端子とＮＯＴ回路２０４の出力端子とに接続され、出力端子は、ＮＯＴ回路２０２の入力端子とフリップフロップ回路２１０１〜２１１６のクロック端子Ｃｌｋ１〜Ｃｌｋ１６とに接続されている。ＮＯＴ回路２０２の入力端子は、ＡＮＤ回路２０１の出力端子に接続され、出力端子は、ＡＮＤ回路２０３の一方の入力端子に接続されている。

ＡＮＤ回路２０３の入力端子は、ＮＯＴ回路２０２の出力端子と遊技制御用マイクロコンピュータ５６０が搭載するＣＰＵ５６とに接続され、出力端子は、ＮＯＴ回路２０４の入力端子に接続されている。ＮＯＴ回路２０４の入力端子は、ＡＮＤ回路２０３の出力端子に接続され、出力端子は、ＡＮＤ回路２０１の一方の入力端子とＯＲ回路２２０１〜２２１６の一方の入力端子とに接続されている。

フリップフロップ回路２１０１〜２１１６の入力端子Ｄ１〜Ｄ１６は、比較器５２２の出力端子に接続されている。フリップフロップ回路２１０１〜２１１６のクロック端子Ｃｌｋ１〜Ｃｌｋ１６は、ＡＮＤ回路２０１の出力端子に接続され、出力端子Ｑ１〜Ｑ１６は、ＯＲ回路２２０１〜２２１６の他方の入力端子に接続されている。

ＯＲ回路２２０１〜２２１６の入力端子は、ＮＯＴ回路２０４の出力端子とフリップフロップ回路２１０１〜２１１６の出力端子とに接続され、出力端子は、遊技制御用マイクロコンピュータ５６０が搭載するＣＰＵ５６に接続されている。

乱数値記憶回路５３１の動作について説明する。図１８は、乱数値記憶回路５３１に各信号が入力されるタイミング、および乱数値記憶回路５３１が各信号を出力するタイミングを示すタイミングチャートである。図１８に示すように、遊技制御用マイクロコンピュータ５６０が搭載するＣＰＵ５６から出力制御信号ＳＣ（本例では、ハイレベル信号）が入力されていない場合（すなわち、ＡＮＤ回路２０３の一方の入力端子への入力がローレベルの場合）、ラッチ信号生成回路５３３からラッチ信号ＳＬが入力されると（図１８に示す例では、タイミングＴ１，Ｔ２，Ｔ７のとき）、ＡＮＤ回路２０１の２つの入力端子への入力はともにハイレベルとなる。そのため、ＡＮＤ回路２０１の出力端子から出力される信号ＳＲはハイレベルとなる。そして、ＡＮＤ回路２０１から出力された信号ＳＲは、フリップフロップ回路２１０１〜２１１６のクロック端子Ｃｌｋ１〜Ｃｌｋ１６に入力される。

フリップフロップ回路２１０１〜２１１６は、クロック端子Ｃｌｋ１〜Ｃｌｋ１６から入力される信号ＳＲの立ち上がりエッヂに応答して、比較器５２２から入力端子Ｄ１〜Ｄ１６を介して入力されるカウント値ＣのビットデータＣ１〜Ｃ１６を乱数値のビットデータＲ１〜Ｒ１６としてラッチして記憶する。また、フリップフロップ回路２１０１〜２１１６は、記憶するランダムＲのビットデータＲ１〜Ｒ１６を出力端子Ｑ１〜Ｑ１６から出力する。

出力制御信号ＳＣが入力されていない場合（図１８に示す例では、タイミングＴ３までの期間およびタイミングＴ６以降の期間）、ＡＮＤ回路２０３の一方の入力端子への入力がローレベルとなるので、ＡＮＤ回路２０３の出力端子から出力される信号ＳＧはローレベルとなる。ＡＮＤ回路２０３が出力する信号ＳＧは、ＮＯＴ回路２０４において反転され、ハイレベルの信号とされる。そして、ＯＲ回路２２０１〜２２１６の一方の入力端子に、ＮＯＴ回路２０４からハイレベルの信号が入力される。

以上のように、ＯＲ回路２２０１〜２２１６の一方の入力端子への入力がハイレベルとなるので、他方の入力端子に入力される信号がハイレベルであるかローレベルであるかに関わらず、ＯＲ回路２２０１〜２２１６はハイレベルの信号を出力する。すなわち、入力されるランダムＲのビットデータＲ１〜Ｒ１６の値が「０」であるか「１」であるかに関わらず、ＯＲ回路２２０１〜２２１６から出力される信号ＳＯ１〜ＳＯ１６は、全てハイレベル（「１」）となる。そのようにすることによって、乱数値記憶回路５３１から出力される値は、常に「６５５３５（＝１１１１１１１１１１１１１１１１ｂ）」となり、乱数値記憶回路５３１からランダムＲを読み出すことができない状態となる。すなわち、乱数値記憶回路５３１から乱数を読み出そうとしても、乱数値記憶回路５３１から常に同じ値「６５５３５」しか読み出せない状態となり、出力制御信号ＳＣが入力されていない場合、乱数値記憶回路５３１は、読出不能（ディセイブル）状態となる。なお、１６ビット乱数回路５０３ｂを用いる場合、乱数値としての値「６５５３５」が用いられる可能性がある。この場合、遊技制御用マイクロコンピュータ５６０は、値「６５５３５」を読み込んだとしても、その値が乱数であるのか読出不能状態であるのかを判断することができない。そのため、図３７に示す各大当り判定用の判定テーブルにおいて、あらかじめランダムＲが「６５５３５」である場合には「ハズレ」と判定するように設定しておけばよい。

ラッチ信号生成回路５３３からラッチ信号ＳＬが入力されていないときに、ＣＰＵ５６から出力制御信号ＳＣが入力されると（図１８に示す例では、タイミングＴ４からタイミングＴ６までの期間）、ＡＮＤ回路２０３の２つの入力端子への入力がともにハイレベルとなるので、ＡＮＤ回路２０３の出力端子から出力される信号ＳＧはハイレベルとなる。ＡＮＤ回路２０３が出力する信号ＳＧは、ＮＯＴ回路２０４において反転され、ローレベルの信号とされる。そして、ＯＲ回路２２０１〜２２１６の一方の入力端子に、ＮＯＴ回路２０４からローレベルの信号が入力される。

以上のように、ＯＲ回路２２０１〜２２１６の一方の入力端子への入力がローレベルとなるので、他方の入力端子に入力される信号がハイレベルの場合、ＯＲ回路２２０１〜２２１６の出力端子からハイレベルの信号が出力される。また、ＯＲ回路２２０１〜２２１６の他方の入力端子に入力される信号がローレベルの場合、ＯＲ回路２２０１〜２２１６からローレベルの信号が出力される。すなわち、ＯＲ回路２２０１〜２２１６の他方の入力端子に入力されるランダムＲのビットデータＲ１〜Ｒ１６の値は、ＯＲ回路２２０１〜２２１６の出力端子からそのまま（すなわち、ビットデータＲ１〜Ｒ１６の値が「１」のときは「１」が、「０」のときは「０」）出力される。そのようにすることによって、乱数値記憶回路５３１からのランダムＲの読出が可能となる。すなわち、出力制御信号ＳＣが入力されている場合、乱数値記憶回路５３１は、読出可能（イネイブル）状態となる。

ただし、ＣＰＵ５６から出力制御信号ＳＣが入力される前に、ラッチ信号生成回路５３３からラッチ信号ＳＬが入力されている場合、ＡＮＤ回路２０３の一方の入力端子への入力がローレベルとなるので、ラッチ信号ＳＬが入力されている状態のままで、出力制御信号ＳＣが入力されても（図１８に示す例では、タイミングＴ３からタイミングＴ４の期間）、ＡＮＤ回路２０３の出力端子から出力される信号ＳＧはローレベルのままとなる。ＡＮＤ回路２０３が出力する信号ＳＧは、ＮＯＴ回路２０４において反転され、ハイレベルの信号とされる。そして、ＯＲ回路２２０１〜２２１６の一方の入力端子に、ＮＯＴ回路２０４からハイレベルの信号が入力される。

以上のように、ＯＲ回路２２０１〜２２１６の一方の入力端子への入力がハイレベルとなるので、他方の入力端子に入力される信号がハイレベルであるかローレベルであるかに関わらず、ＯＲ回路２２０１〜２２１６から出力される信号ＳＯ１〜ＳＯ１６は全てハイレベルとなる。そして、出力制御信号ＳＣが入力されているにも関わらず、乱数値記憶回路５３１からランダムＲを読み出すことができない状態のままとなる。すなわち、ラッチ信号ＳＬが入力されている場合、乱数値記憶回路５３１は、出力制御信号ＳＣを受信不可能な状態となる。なお、１６ビット乱数回路５０３ｂを用いる場合、乱数値としての値「６５５３５」が用いられる可能性がある。この場合、遊技制御用マイクロコンピュータ５６０は、値「６５５３５」を読み込んだとしても、その値が乱数であるのか読出不能状態であるのかを判断することができない。そのため、図２７に示す各大当り判定用の判定テーブルにおいて、あらかじめランダムＲが「６５５３５」である場合には「ハズレ」と判定するように設定しておけばよい。

また、ラッチ信号生成回路５３３からラッチ信号ＳＬが入力される前に、ＣＰＵ５６から出力制御信号ＳＣが入力されている場合、ＡＮＤ回路２０１の一方の入力端子への入力がローレベルとなるので、出力制御信号ＳＣが入力されているままの状態で、ラッチ信号ＳＬが入力されても（図１８に示す例では、タイミングＴ５）、ＡＮＤ回路２０１の出力端子から出力される信号ＳＲはローレベルのままとなる。そのため、フリップフロップ回路２１０１〜２１１６のクロック端子Ｃｌｋ１〜Ｃｌｋ１６に入力される信号ＳＲは、ローレベルからハイレベルに立ち上がらず、フリップフロップ回路２１０１〜２１１６に格納されているランダムＲのビットデータＲ１〜Ｒ１６は、ラッチ信号ＳＬが入力されているにも関わらず、記憶される乱数は更新されない。すなわち、出力制御信号ＳＣが入力されている場合、乱数値記憶回路５３１は、ラッチ信号ＳＬを受信不可能な状態となる。

反転回路５３２は、クロック信号出力回路５２４から入力する乱数発生用クロック信号ＳＩ１における信号レベルを反転させることによって、クロック信号の極性を反転させた反転クロック信号ＳＩ２を生成する。また、反転回路５３２は、生成した反転クロック信号ＳＩ２をラッチ信号生成回路５３３に出力する。

ラッチ信号生成回路５３３は、セレクタおよびフリップフロップ回路等を用いて構成される。ラッチ信号生成回路５３３は、乱数値読取信号出力回路５２６からの乱数値読取信号と反転回路５３２からの反転クロック信号ＳＩ２とを入力し、乱数値記憶回路５３１に乱数値を記憶させるためのラッチ信号ＳＬを出力する。また、ラッチ信号生成回路５３３は、乱数更新方式選択信号出力回路５２７からの乱数更新方式選択信号によって指定された乱数値更新方式に応じて、ラッチ信号ＳＬを出力する。この場合、ラッチ信号生成回路５３３は、乱数更新方式選択信号出力回路５２７から第１の乱数更新方式選択信号が入力された場合、反転回路５３２から出力される反転クロック信号ＳＩ２を選択し、ラッチ信号ＳＬとして乱数値記憶回路５３１に出力する。一方、ラッチ信号生成回路５３３は、乱数更新方式選択信号出力回路５２７から第２の乱数更新方式選択信号が入力された場合、乱数値読取信号出力回路５２６から出力される乱数値読取信号を、反転回路５３２から出力される反転クロック信号ＳＩ２の立ち上がりエッヂに同期させて、ラッチ信号ＳＬとして乱数値記憶回路５３１に出力する。

タイマ回路５３４は、始動口１４への遊技球の入賞を検出した旨の入賞検出信号ＳＳを始動口スイッチ１４ａから入力する。また、タイマ回路５３４は、始動口スイッチ１４ａから入賞検出信号ＳＳが継続して入力されている時間を計測する。そして、タイマ回路５３４は、計測時間が所定期間（例えば、３ｍｓ）になると、乱数値読取信号出力回路５２６の乱数値取込レジスタ５３９に乱数値取込データ「０１ｈ」を書き込む。例えば、タイマ回路５３４は、ハイレベルの信号が入力されたことに応じて起動するアップカウンタまたはダウンカウンタによって構成される。タイマ回路５３４は、始動口スイッチ１４ａからの入力がハイレベルとなっている間（すなわち、入賞検出信号ＳＳが継続して入力されている間）、クロック回路５０１から順次入力する基準クロック信号ＣＬＫをアップカウントまたはダウンカウントする。そして、タイマ回路５３４は、アップカウントまたはダウンカウントするカウント値が３ｍｓに対応する値になると、始動口スイッチ１４ａから入賞検出信号ＳＳが入力されたと判断して、乱数値取込データ「０１ｈ」を乱数値取込レジスタ５３９に書き込む。

次に、シリアル通信回路５０５の構成について説明する。シリアル通信回路５０５は、全二重方式、非同期方式および標準ＮＲＺ（ノンリターンゼロ）符号化を用いたデータフォーマットで、各制御基板（例えば、払出制御基板３７や演出制御基板８０）とシリアル通信を行う。シリアル通信回路５０５は、各制御基板に各種データ（例えば、賞球個数コマンドや演出制御コマンド）を送信する送信部と、各制御基板からの各種データ（例えば、賞球ＡＣＫコマンド）を受信する受信部とを含む。

図１９は、シリアル通信回路５０５の送信部の構成例を示すブロック図である。また、図２０は、シリアル通信回路５０５の受信部の構成例を示すブロック図である。シリアル通信回路５０５は、ボーレートレジスタ７０２、ボーレート生成回路７０３、２つのステータスレジスタ７０５，７０６、３つの制御レジスタ７０７，７０８，７０９、送信データレジスタ７１０、受信データレジスタ７１１、送信用シフトレジスタ７１２、受信用シフトレジスタ７１３、割り込み制御回路７１４、送信フォーマット／パリティ生成回路７１５および受信フォーマット／パリティチェック回路７１６を含む。また、図１９に示すように、シリアル通信回路５０５の送信部は、これらの構成要素のうち、ボーレートレジスタ７０２、ボーレート生成回路７０３、ステータスレジスタＡ７０５、制御レジスタ７０７，７０８，７０９、送信データレジスタ７１０、送信用シフトレジスタ７１２、割り込み制御回路７１４および送信フォーマット／パリティ生成回路７１５によって構成される。また、図２０に示すように、シリアル通信回路５０５の受信部は、これらの構成要素のうち、ボーレートレジスタ７０２、ボーレート生成回路７０３、ステータスレジスタ７０５，７０６、制御レジスタ７０７，７０８，７０９、受信データレジスタ７１１、受信用シフトレジスタ７１３、割り込み制御回路７１４および受信フォーマット／パリティチェック回路７１６によって構成される。

なお、シリアル通信回路５０５において、送信部と受信部とは、実際には、共通の回路を用いて構成される。そして、シリアル通信回路５０５は、上記に示したように、シリアル通信回路５０５の各構成要素を使い分けて用いることによって、送信回路又は受信回路として機能する。

まず、シリアル通信回路５０５が各制御基板と送受信するデータのデータフォーマットを説明する。図２１は、シリアル通信５０５が各制御基板と送受信するデータのデータフォーマットの例を示す説明図である。図２１に示すように、シリアル通信回路５０５が送受信するデータのデータフォーマットは、スタートビット、データおよびストップビットを１フレームとして構成される。また、シリアル通信回路５０５が送受信するデータのデータ長は、後述するシリアル通信回路設定処理において初期設定を行えば、８ビットまたは９ビットのいずれかに設定できる。図２１（ａ）は、データ長を８ビットに設定した場合のデータフォーマットの例である。また、図２１（ｂ）は、データ長を９ビットに設定した場合のデータフォーマットの例である。

図２１に示すように、シリアル通信回路５０５が送受信するデータのデータフォーマットは、ハイレベル（論理「１」）のアイドルラインのあとに、１フレームの始まりであることを示すスタートビット（論理「０」）を含む。また、データフォーマットは、スタートビットのあとに、８ビットまたは９ビットの送受信データを含む。そして、データフォーマットは、送受信データのあとに、１フレームの終わりであることを示すストップビット（論理「１」）を含む。

シリアル通信回路５０５は、図２１に示すデータフォーマットに従って、送受信データの最下位ビット（ビット０）から先にデータを送受信する。また、後述するシリアル通信回路設定処理において初期設定を行えば、送受信データにパリティビットを付加するように設定することもできる。パリティビットを付加するように設定した場合、送受信データの最上位ビットがパリティビット（奇数パリティまたは偶数パリティ）として用いられる。例えば、データ長を８ビットに設定した場合、送受信データのビット７がパリティビットとして用いられる。また、例えば、データ長を９ビットに設定した場合、送受信データのビット８がパリティビットとして用いられる。

ボーレート生成回路７０３は、クロック回路５０１が出力するクロック信号およびボーレートレジスタ７０２に設定されている設定値（ボーレート設定値ともいう）にもとづいて、シリアル通信回路５０５が用いるボーレートを生成する。この場合、ボーレート生成回路７０３は、クロック信号およびボーレート設定値にもとづいて、所定の計算式を用いてボーレートを求める。例えば、ボーレート生成回路７０３は、式（１）を用いて、シリアル通信回路５０５が用いるボーレートを求める。

ボーレート＝クロック周波数／（ボーレート設定値×１６） 式（１）

図２２は、ボーレートレジスタ７０２の例を示す説明図である。ボーレートレジスタ７０２は、ボーレート生成回路７０３が生成するボーレートの値を指定するための所定の設定値を設定するレジスタである。例えば、ボーレートレジスタ７０２が式（１）を用いてボーレートを求めるものとし、クロック周波数が３ＭＨｚであるとする。この場合、所望の目標ボーレートが１２００ｂｐｓであるとすると、ボーレートレジスタ７０２に設定値「１５６」を設定する。すると、ボーレート生成回路７０３は、クロック周波数「３ＭＨｚ」およびボーレート設定値「１５６」にもとづいて、式（１）を用いて、ボーレート「１２０１．９２ｂｐｓ」を生成する。ボーレートレジスタ７０２は、１６ビットレジスタであり、初期値が「０（＝００ｈ）」に設定されている。また、ボーレートレジスタ７０２は、ビット０〜ビット１２が書込および読出ともに可能な状態に構成されている。また、ボーレートレジスタ７０２は、ビット１３〜ビット１５が書込および読出ともに不可能な状態に構成されている。したがって、ボーレートレジスタ７０２のビット１３〜ビット１５に値を書き込む制御を行っても無効とされ、ビット１３〜ビット１５から読み出す値は全て「０（＝００００ｂ）」である。

図２３（Ａ）は、制御レジスタＡ７０７の例を示す説明図である。制御レジスタＡ７０７は、シリアル通信回路５０５の通信フォーマットを設定するレジスタである。この実施の形態では、制御レジスタＡ７０７の各ビットの値が設定されることによって、シリアル通信回路５０５の通信フォーマットが設定される。制御レジスタＡ７０７には、送受信データのデータ形式や各種通信方式等の通信フォーマットを設定するための通信フォーマット設定データが設定される。図２３（Ａ）に示すように、制御レジスタＡ７０７は、８ビットレジスタであり、初期値が「０（＝００ｈ）」に設定されている。また、制御レジスタＡ７０７は、ビット０〜ビット４が書込および読出ともに可能な状態に構成されている。また、制御レジスタＡ７０７は、ビット５〜ビット７が書込および読出ともに不可能な状態に構成されている。したがって、制御レジスタＡ７０７のビット５〜ビット７に値を書き込む制御を行っても無効とされ、ビット５〜ビット７から読み出す値は全て「０（＝００００ｂ）」である。

図２３（Ｂ）は、制御レジスタＡ７０７に設定される通信フォーマット設定データの一例の説明図である。図２３（Ｂ）に示すように、制御レジスタＡ７０７のビット４（ビット名「Ｍ」）には、送受信するデータのデータ長を設定するための設定データが設定される。図２３（Ｂ）に示すように、ビット４を「０」に設定することによって、送受信データのデータ長が８ビットに設定される。また、ビット４を「１」に設定することによって、送受信データのデータ長が９ビットに設定される。

制御レジスタＡ７０７のビット３（ビット名「ＷＡＫＥ」）には、スタンバイ状態の受信回路（シリアル通信回路５０５の受信部）をウエイクアップする（オンライン状態にさせる）ウエイクアップ方式を設定するための設定データが設定される。図２３（Ｂ）に示すように、ビット３を「０」に設定することによって、アイドルラインを認識したときにウエイクアップするアイドルラインウエイクアップ方式が設定される。また、ビット３を「１」に設定することによって、所定のアドレスマークを認識することによってウエイクアップするアドレスマークウエイクアップ方式が設定される。

制御レジスタＡ７０７のビット２（ビット名「ＩＬＴ」）には、受信データのアイドルラインの検出方式を選択するための設定データが設定される。図２３（Ｂ）に示すように、ビット２を「０」に設定することによって、受信データに含まれるスタートビットの後からアイドルラインを検出する検出方式が設定される。また、ビット２を「１」に設定することによって、受信データに含まれるストップビットの後からアイドルラインを検出する検出方式が設定される。

制御レジスタＡ７０７のビット１（ビット名「ＰＥ」）には、パリティ機能を使用するか否かを設定するための設定データが設定される。図２３（Ｂ）に示すように、ビット１を「０」に設定することによって、パリティ機能を使用しないように設定される。また、ビット１を「１」に設定することによって、パリティ機能を使用するように設定される。

制御レジスタＡ７０７のビット０（ビット名「ＰＴ」）には、パリティ機能を使用すると設定した場合のパリティの種類を設定するための設定データが設定される。図２３（Ｂ）に示すように、ビット０を「０」に設定することによって、パリティの種類として偶数パリティが設定される。また、ビット０を「１」に設定することによって、パリティの種類として奇数パリティが設定される。

図２４（Ａ）は、制御レジスタＢ７０８の例を示す説明図である。制御レジスタＢ７０８は、シリアル通信回路５０５の割り込み要求を許可するか否かを設定するレジスタである。この実施の形態では、制御レジスタＢ７０８の各ビットの値が設定されることによって、シリアル通信回路５０５からの割り込み要求を許可するか禁止するかが設定される。制御レジスタＢ７０８には、各種割り込み要求を許可するか否かを示す割り込み要求設定データが主として設定される。なお、制御レジスタＢ７０８には、割り込み要求設定データ以外に、シリアル通信回路５０５の各種設定を行うための設定データも設定される。図２４（Ａ）に示すように、制御レジスタＢ７０８は、８ビットレジスタであり、初期値が「０（＝００ｈ）」に設定されている。また、制御レジスタＢ７０８は、ビット０〜ビット７が書込および読出ともに可能な状態に構成されている。

図２４（Ｂ）は、制御レジスタＢ７０８に設定される割り込み要求設定データの一例を示す説明図である。図２４（Ｂ）に示すように、制御レジスタＢ７０８のビット７（ビット名「ＴＩＥ」）には、データの送信時に行う割り込み要求である送信割り込み要求を許可するか否かを示す設定データが設定される。図２４（Ｂ）に示すように、ビット７を「０」に設定することによって、送信割り込み要求を禁止するように設定される。また、ビット７を「１」に設定することによって、送信割り込み要求を許可するように設定される。

制御レジスタＢ７０８のビット６（ビット名「ＴＣＩＥ」）には、データの送信完了時に行う割り込み要求である送信完了割り込み要求を許可するか否かを示す設定データが設定される。図２４（Ｂ）に示すように、ビット６を「０」に設定することによって、送信完了割り込み要求を禁止するように設定される。また、ビット６を「１」に設定することによって、送信完了割り込み要求を許可するように設定される。

制御レジスタＢ７０８のビット５（ビット名「ＲＩＥ」）には、データの受信時に行う割り込み要求である受信割り込み要求を許可するか否かを示す設定データが設定される。図２４（Ｂ）に示すように、ビット５を「０」に設定することによって、受信割り込み要求を禁止するように設定される。また、ビット５を「１」に設定することによって、受信割り込み要求を許可するように設定される。

制御レジスタＢ７０８のビット４（ビット名「ＩＬＩＥ」）には、受信データのアイドルラインを検出したときに行う割り込み要求であるアイドルライン割り込み要求を許可するか否かを示す設定データが設定される。図２４（Ｂ）に示すように、ビット４を「０」に設定することによって、アイドルライン割り込み要求を禁止するように設定される。また、ビット４を「１」に設定することによって、アイドルライン割り込み要求を許可するように設定される。

制御レジスタＢ７０８のビット３（ビット名「ＴＥ」）には、送信回路（シリアル通信回路５０５の送信部）を使用するか否かを示す設定データが設定される。図２４（Ｂ）に示すように、ビット３を「０」に設定することによって、送信回路を使用しないように設定される。また、ビット３を「１」に設定することによって、送信回路を使用するように設定される。

制御レジスタＢ７０８のビット２（ビット名「ＲＥ」）には、受信回路を使用するか否かを示す設定データが設定される。図２４（Ｂ）に示すように、ビット２を「０」に設定することによって、受信回路を使用しないように設定される。また、ビット２を「１」に設定することによって、受信回路を使用するように設定される。

制御レジスタＢ７０８のビット１（ビット名「ＲＷＵ」）には、受信回路のウエイクアップ機能を使用するか否かを示す設定データが設定される。図２４（Ｂ）に示すように、ビット１を「０」に設定することによって、ウエイクアップ機能を使用しないように設定される。また、ビット１を「１」に設定することによって、ウエイクアップ機能を使用するように設定される。

制御レジスタＢ７０８のビット０（ビット名「ＳＢＫ」）には、所定のブレークコード送信機能を使用するか否かを示す設定データが設定される。図２４（Ｂ）に示すように、ビット１を「０」に設定することによって、ブレークコード送信機能を使用しないように設定される。また、ビット１を「１」に設定することによって、ブレークコード送信機能を使用するように設定される。ビット１を「１」に設定すると、シリアル通信回路５０５は、ブレークコード（例えば、「０」を連続して含む信号）を制御基板（払出制御基板３７や演出制御基板８０）に送信する。

図２５（Ａ）は、ステータスレジスタＡ７０５の例を示す説明図である。ステータスレジスタＡ７０５は、シリアル通信回路５０５の各種ステータスを確認するためのレジスタである。この実施の形態では、ステータスレジスタＡ７０５の各ビットの値を確認することによって、ＣＰＵ５６は、シリアル通信回路５０５の各種ステータスを確認することができる。図２５（Ａ）に示すように、ステータスレジスタＡ７０５は、８ビットレジスタであり、初期値が「０（＝００ｈ）」に設定されている。また、ステータスレジスタＡ７０５は、ビット０〜ビット７が読出のみ可能な状態に構成されている。したがって、ステータスレジスタＡ７０５のビット０〜ビット７に値を書き込む制御を行っても無効とされる。

本実施の形態では、後述するように、送信データレジスタ７１０に送信データが入っていない状態（送信データエンプティ）となったり、送信用シフトレジスタ７１２が格納する送信データの送信を完了すると、割り込み制御回路７１４によって、ステータスレジスタＡ７０５の対応するビットがセットされる。そして、ＣＰＵ５６は、ステータスレジスタＡ７０５にセットされた各ビットの値を読み出す。

図２５（Ｂ）は、ステータスレジスタＡ７０５に格納されるステータス確認データの一例を示す図である。図２５（Ｂ）に示すように、ステータスレジスタＡ７０５のビット７（ビット名「ＴＤＲＥ」）には、送信データレジスタ７１０に送信データが入っていない状態であること（送信データエンプティ）を示す送信データエンプティフラグが格納される。図２５（Ｂ）に示すように、ビット７に「０」が格納されている場合、送信データレジスタ７１０から送信用シフトレジスタ７１２に送信データが未だに転送されておらず、送信データレジスタ７１０に送信データが格納されたままの状態であることを示す。また、ビット７に「１」が格納されている場合、送信データレジスタ７１０から送信用シフトレジスタ７１２に送信データが転送されており、送信データレジスタ７１０に送信データが入っていない状態（送信データエンプティ）であることを示す。

ステータスレジスタＡ７０５のビット６（ビット名「ＴＣ」）には、シリアル通信回路５０５からの送信データの送信を完了した旨を示す送信完了フラグが格納される。図２５（Ｂ）に示すように、ビット６に「０」が格納されている場合、送信用シフトレジスタ７１２が格納する送信データの送信中の状態であり、シリアル通信回路５０５からの送信データの送信が完了していない状態であることを示す。また、ビット６に「１」が格納されている場合、送信用シフトレジスタ７１２が格納する送信データの転送を完了した状態であり、シリアル通信回路５０５からの送信データの送信が完了した状態であることを示す。

なお、送信データの送信を完了した状態となり、ＣＰＵ５６は、送信先の制御基板からの受信確認信号の待ち状態となる。この実施の形態では、後述する送信時割込の設定が行われると、シリアル通信回路５０５は、送信データの送信完了を検出すると、ステータスレジスタＡ７０５のビット６を「１」にするとともに、受信確認信号の待ち状態になったものとしてＣＰＵ５６に割り込み要求（送信時割り込み要求という）を行う。

ステータスレジスタＡ７０５のビット５（ビット名「ＲＤＲＦ」）には、受信データレジスタ７１１に受信データが格納された状態であること（受信データフル）を示す受信データフルフラグが格納される。図２５（Ｂ）に示すように、ビット５に「０」が格納されている場合、受信データレジスタ７１１に受信データが入っていない状態であることを示す。また、ビット５に「１」が格納されている場合、受信用シフトレジスタ７１３の値が受信データレジスタ７１１に転送され、受信データレジスタ７１１に受信データが格納されている状態であること（受信データフル）を示す。

なお、受信データレジスタ７１１に受信データが格納された状態となると、ＣＰＵ５６は、受信データを受信データレジスタ７１１から読み込んで受信処理を行える状態となる。この実施の形態では、シリアル通信回路５０５は、受信データフルを検出すると、ステータスレジスタＡ７０５のビット５を「１」にするとともに、受信処理が可能になったものとしてＣＰＵ５６に割り込み要求（受信時割り込み要求という）を行う。

ステータスレジスタＡ７０５のビット４（ビット名「ＩＤＬＥ」）には、受信回路がアイドルラインを検出したことを示すアイドルライン検出フラグが格納される。図２５（Ｂ）に示すように、ビット４に「０」が格納されている場合、シリアル通信回路５０５の受信部がアイドルラインを検出していない状態であることを示す。また、ビット４に「１」が格納されている場合、シリアル通信回路５０５の受信部がアイドルラインを検出した状態であることを示す。

ステータスレジスタＡ７０５のビット３（ビット名「ＯＲ」）には、ＣＰＵ５６が受信データレジスタ７１１が格納する受信データを読み込む前に、受信用シフトレジスタ７１３が次のデータを受信してしまったこと（オーバーラン）を示すオーバーランフラグが格納される。図２５（Ｂ）に示すように、ビット３に「０」が格納されている場合、受信回路がオーバーランを検出していない状態であることを示す。また、ビット３に「１」が格納されている場合、受信回路がオーバーランを検出した状態であることを示す。

なお、オーバーランが発生すると、受信データレジスタ７１１内の受信データが読み込まれる前に受信用シフトレジスタ７１３に次の受信データが格納されてしまうので、受信データが上書きされてしまいＣＰＵ５６が受信データを正しく読み込めなくなってしまう。そのため、各制御基板と正しく通信を行えなくなり、ＣＰＵ５６が誤動作をする原因となる。この実施の形態では、シリアル通信回路５０５は、オーバーランを検出すると、ステータスレジスタＡ７０５のビット３を「１」にするとともに、通信時にエラーが発生したものとしてＣＰＵ５６に割り込み要求を行う。

ステータスレジスタＡ７０５のビット２（ビット名「ＮＦ」）には、受信データにノイズを検出したことを示すノイズエラーフラグが格納される。図２５（Ｂ）に示すように、ビット２に「０」が格納されている場合、受信回路が受信データにノイズを検出していない状態であることを示す。また、ビット２に「１」が格納されている場合、受信回路が受信データにノイズを検出した状態であることを示す。

例えば、シリアル通信回路５０５は、受信データの各ビットを検出する際に、ボーレート生成回路７０３が生成したボーレートを用いて、所定ビット長の「１」または「０」を検出する。この場合、検出した「１」または「０」の長さが所定ビット長に満たない場合、シリアル通信回路５０５は、受信データにノイズが発生したものとしてノイズエラーを検出する。ノイズエラーが発生すると、ノイズによって正しい受信データを受信できない可能性が高く、ＣＰＵ５６が誤動作をする原因となる。この実施の形態では、シリアル通信回路５０５は、ノイズエラーを検出すると、ステータスレジスタＡ７０５のビット２を「１」にするとともに、通信時にエラーが発生したものとしてＣＰＵ５６に割り込み要求を行う。

ステータスレジスタＡ７０５のビット１（ビット名「ＦＥ」）には、受信データのストップビットの位置が「０」（本来、ストップビットは「１」）であることを検出したこと（フレーミングエラー）を示すフレーミングエラーフラグが格納される。図２５（Ｂ）に示すように、ビット１に「０」が格納されている場合、受信回路が受信データにフレーミングエラーを検出していない状態であることを示す。また、ビット１に「１」が格納されている場合、受信回路がフレーミングエラーを検出した状態であることを示す。

フレーミングエラーが発生すると、受信データのストップビットを正しく受信できなかった状態であるので、正しい受信データを受信できない可能性が高く、ＣＰＵ５６が誤動作をする原因となる。この実施の形態では、シリアル通信回路５０５は、フレーミングエラーを検出すると、ステータスレジスタＡ７０５のビット１を「１」にするとともに、通信時にエラーが発生したものとしてＣＰＵ５６に割り込み要求を行う。

ステータスレジスタＡ７０５のビット０（ビット名「ＰＦ」）には、受信データから求めたパリティの値と、受信データに含まれるパリティの値とが一致しなかったこと（パリティエラー）を示すパリティエラーフラグが格納される。図２５（Ｂ）に示すように、ビット０に「０」が格納されている場合、受信回路が受信データにパリティエラーを検出していない状態であることを示す。また、ビット０に「１」が格納されている場合、受信回路がパリティエラーを検出した状態であることを示す。

パリティエラーが発生すると、受信データの各データビットまたはパリティビットを正しく受信できなかった状態であるので、正しい受信データを受信できない可能性が高く、ＣＰＵ５６が誤動作をする原因となる。この実施の形態では、シリアル通信回路５０５は、パリティエラーを検出すると、ステータスレジスタＡ７０５のビット０を「１」にするとともに、通信時にエラーが発生したものとしてＣＰＵ５６に割り込み要求を行う。

図２６（Ａ）は、ステータスレジスタＢ７０６の例を示す説明図である。ステータスレジスタＢ７０６は、シリアル通信回路５０５の受信状態（受信ステータス）を確認するためのレジスタである。この実施の形態では、ステータスレジスタＢ７０６のビットの値を確認することによって、ＣＰＵ５６は、シリアル通信回路５０５の受信ステータスを確認することができる。図２６（Ｂ）に示すように、ステータスレジスタＢ７０６は、８ビットレジスタであり、初期値が「０（＝００ｈ）」に設定されている。また、ステータスレジスタＢ７０６は、ビット０が読出のみ可能な状態に構成されている。したがって、ステータスレジスタＡ７０５のビット０に値を書き込む制御を行っても無効とされる。また、ステータスレジスタＢ７０６は、ビット１〜ビット７が書込および読出ともに不可能な状態に構成されている。したがって、ステータスレジスタＡ７０５のビット１〜ビット７に値を書き込む制御を行っても無効とされ、ビット１〜ビット７から読み出す値は全て「０（＝００００ｂ）」である。

図２６（Ｂ）は、ステータスレジスタＢ７０６に格納されるステータス確認データの一例を示す図である。図２６（Ｂ）に示すように、ステータスレジスタＢ７０６のビット０（ビット名「ＲＡＦ」）には、受信回路が受信データを受信中であること（受信アクティブ）を示す受信アクティブフラグが格納される。図２６（Ｂ）に示すように、ビット０に「０」が格納されている場合、受信回路が受信データを受信中でないことを示す。また、ビット０に「１」が格納されている場合、受信回路が受信データを受信中であることを示す。なお、シリアル通信回路５０５は、スタートビットを検出すると、受信データの受信が開始されたものとして、ステータスレジスタＢ７０６のビット０を「１」にする。

図２７（Ａ）は、制御レジスタＣ７０９の例を示す説明図である。制御レジスタＣ７０９は、シリアル通信回路５０５の通信エラー時の割り込み要求を許可するか否かを設定するレジスタである。この実施の形態では、制御レジスタＣ７０９の各ビットの値が設定されることによって、シリアル通信回路５０５からの通信時の割り込み要求を許可するか禁止するかが設定される。制御レジスタＣ７０９には、通信エラー時の各種割り込み要求を許可するか否かを示すエラー割り込み要求設定データが主として設定される。なお、制御レジスタＣ７０９には、エラー割り込み要求設定データ以外に、データ長を９ビットに設定した場合の９ビット目のデータが格納される。シリアル通信回路５０５の各種設も設定される。図２７（Ａ）に示すように、制御レジスタＣ７０９は、８ビットレジスタであり、初期値が「０（＝００ｈ）」に設定されている。また、制御レジスタＣ７０９は、ビット０〜ビット３およびビット６，７が書込および読出ともに可能な状態に構成されている。また、制御レジスタＣ７０９は、ビット４，５が書込および読出ともに不可能な状態に構成されている。したがって、制御レジスタＣ７０９のビット４，５に値を書き込む制御を行っても無効とされ、ビット４，５から読み出す値は全て「０（＝００００ｂ）」である。

図２７（Ｂ）は、制御レジスタＣ７０９に設定されるエラー割り込み要求設定データの一例を示す説明図である。図２７（Ｂ）に示すように、制御レジスタＣ７０９のビット７（ビット名「Ｒ８」）には、データ長を９ビットに設定した場合の受信データの９ビット目のデータが格納される。また、制御レジスタＣ７０９のビット６（ビット名「Ｔ８」）には、データ長を９ビットに設定した場合の送信データの９ビット目のデータが格納される。

制御レジスタＣ７０９のビット３（ビット名「ＯＲＩＥ」）には、オーバーランを検出した場合に行う割り込み要求であるオーバーランフラグ割り込み要求を許可するか否かを示す設定データが設定される。図２７（Ｂ）に示すように、ビット３を「０」に設定することによって、オーバーランフラグ割り込み要求を禁止するように設定される。また、ビット３を「１」に設定することによって、オーバーランフラグ割り込み要求を許可するように設定される。

制御レジスタＣ７０９のビット２（ビット名「ＮＥＩＥ」）には、ノイズエラーを検出した場合に行う割り込み要求であるノイズエラーフラグ割り込み要求を許可するか否かを示す設定データが設定される。図２７（Ｂ）に示すように、ビット２を「０」に設定することによって、ノイズエラーフラグ割り込み要求を禁止するように設定される。また、ビット２を「１」に設定することによって、ノイズエラーフラグ割り込み要求を許可するように設定される。

制御レジスタＣ７０９のビット１（ビット名「ＦＥＩＥ」）には、フレーミングエラーを検出した場合に行う割り込み要求であるフレーミングエラーフラグ割り込み要求を許可するか否かを示す設定データが設定される。図２７（Ｂ）に示すように、ビット１を「０」に設定することによって、フレーミングエラーフラグ割り込み要求を禁止するように設定される。また、ビット１を「１」に設定することによって、フレーミングエラーフラグ割り込み要求を許可するように設定される。

制御レジスタＣ７０９のビット０（ビット名「ＰＥＩＥ」）には、パリティエラーを検出した場合に行う割り込み要求であるパリティエラーフラグ割り込み要求を許可するか否かを示す設定データが設定される。図２７（Ｂ）に示すように、ビット０を「０」に設定することによって、パリティエラーフラグ割り込み要求を禁止するように設定される。また、ビット０を「１」に設定することによって、パリティエラーフラグ割り込み要求を許可するように設定される。

図２８は、シリアル通信回路５０５が備えるデータレジスタの例を示す説明図である。データレジスタ７０１は、シリアル通信回路５０５が送受信するデータを格納するレジスタである。図２８に示すように、データレジスタは、８ビットレジスタであり、初期値が「０（＝００ｈ）」に設定されている。また、データレジスタ７０１は、ビット０〜ビット７が書込および読出ともに可能な状態に構成されている。

この実施の形態では、シリアル通信回路５０５が送信データを送信する場合、データレジスタは、送信データレジスタ７１０として用いられる。なお、データ長を９ビットに設定した場合、データレジスタおよび制御レジスタＣ７０９のビット６が送信データレジスタ７１０として用いられる。この場合、データレジスタのビット０〜ビット７が送信データレジスタ７１０のビット０〜ビット７として用いられ、制御レジスタＣ７０９のビット６が送信データレジスタ７１０のビット８として用いられる。

また、シリアル通信回路５０５が受信データを受信する場合、データレジスタは、受信データレジスタ７１１として用いられる。なお、データ長を９ビットに設定した場合、データレジスタおよび制御レジスタＣ７０９のビット７が受信データレジスタ７１１として用いられる。この場合、データレジスタのビット０〜ビット７が受信データレジスタ７１１のビット０〜ビット７として用いられ、制御レジスタＣ７０９のビット７が受信データレジスタ７１１のビット８として用いられる。

割り込み制御回路７１４は、ＣＰＵ５６に各種割り込み要求を行う。この実施の形態では、割り込み制御回路７１４は、制御レジスタＢ７０８のビット６（ＴＣＩＥ）が「１」に設定されている場合、送信データレジスタ７１０に送信データの送信を完了した状態となると、ＣＰＵ５６に割り込み信号を出力して割り込み要求を行う。また、割り込み制御回路７１４は、ステータスレジスタＡ７０５のビット６（ＴＣ）に「１」を設定する。

また、割り込み制御回路７１４は、制御レジスタＢ７０８のビット５（ＲＩＥ）が「１」に設定されている場合、受信データレジスタ７１１に受信データが格納されている状態になると（受信データフルを検出すると）、ＣＰＵ５６に割り込み信号を出力して割り込み要求を行う。また、割り込み制御回路７１４は、ステータスレジスタＡ７０５のビット５（ＲＤＲＦ）に「１」を設定する。

また、割り込み制御回路７１４は、制御レジスタＣ７０９のビット０〜３のいずれかが「１」に設定されている場合、各種通信エラーが発生すると、ＣＰＵ５６に割り込み信号を出力して割り込み要求を行う。また、割り込み制御回路７１４は、通信エラーの種類に応じて、ステータスレジスタＡ７０５のビット０〜ビット３に「１」を設定する。例えば、制御レジスタＣ７０９のビット３（ＯＲＩＥ）が「１」に設定されている場合、オーバーランを検出して割り込み要求を行うときに、ステータスレジスタＡ７０５のビット３（ＯＲ）に「１」を設定する。また、例えば、制御レジスタＣ７０９のビット２（ＮＥＩＥ）が「１」に設定されている場合、ノイズエラーを検出して割り込み要求を行うときに、ステータスレジスタＡ７０５のビット２（ＮＦ）に「１」を設定する。また、例えば、制御レジスタＣ７０９のビット１（ＦＥＩＥ）が「１」に設定されている場合、フレーミングエラーを検出して割り込み要求を行うときに、ステータスレジスタＡ７０５のビット１（ＦＥ）に「１」を設定する。また、例えば、制御レジスタＣ７０９のビット０（ＰＥＩＥ）が「１」に設定されている場合、パリティエラーを検出して割り込み要求を行うときに、ステータスレジスタＡ７０５のビット０（ＰＦ）に「１」を設定する。なお、複数の通信エラーを検出した場合、割り込み制御回路７１４は、複数の通信エラーにもとづいて割り込み要求を行うとともに、ステータスレジスタＡ７０５の該当するビットをそれぞれ「１」に設定する。

送信フォーマット／パリティ生成回路７１５は、送信データのデータフォーマットを生成する。この実施の形態では、送信フォーマット／パリティ生成回路７１５は、送信データレジスタ７１０に格納される送信データにスタートビットおよびストップビットを付加してデータフォーマットを生成し、送信用シフトレジスタ７１２に転送する。また、制御レジスタＡ７０７のビット１（ＰＥ）に「１」が設定され、パリティ機能を使用する旨が設定されている場合、送信フォーマット／パリティ生成回路７１５は、送信データにパリティビットを付加してデータフォーマットを生成する。

受信フォーマット／パリティチェック回路７１６は、受信データのデータフォーマットを検出する。この実施の形態では、受信フォーマット／パリティチェック回路７１６は、受信用シフトレジスタ７１３に格納される受信データからスタートビットおよびストップビットを検出し、受信データに含まれるデータ部分を検出して受信データレジスタ７１１に転送する。また、制御レジスタＡ７０７のビット１（ＰＥ）に「１」が設定され、パリティ機能を使用する旨が設定されている場合、受信フォーマット／パリティチェック回路７１６は、受信データのパリティを求め、受信データに含まれるパリティと一致するか否かを検出する。また、求めた値が受信データに含まれるパリティと一致しない場合、受信フォーマット／パリティチェック回路７１６は、パリティエラーを検出する。なお、後述するシリアル通信回路設定処理において通信エラー時割り込み要求を許可する旨が設定されてる場合、受信フォーマット／パリティチェック回路７１６は、パリティエラーを検出すると、通信エラーの発生を割込原因としてＣＰＵ５６に割り込み要求を行う。

図２９は、遊技制御用マイクロコンピュータ５６０における記憶領域のアドレスマップの一例を示す説明図である。図２９に示すように、遊技制御用マイクロコンピュータ５６０の記憶領域のうち、００００ｈ番地〜１ＦＦＦｈ番地の領域は、ＲＯＭ５４に割り当てられている。また、７Ｅ００ｈ番地〜７ＦＦＦｈ番地の領域は、ＲＡＭ５５に割り当てられている。さらに、ＦＤ００ｈ番地〜ＦＥ００ｈ番地の領域は、乱数最大値設定レジスタ５３５等の内蔵レジスタに割り当てられている。

また、図２９に示すように、ＲＯＭ５４に割り当てられている００００ｈ番地〜１ＦＦＦｈ番地の領域は、ユーザプログラムエリアとユーザプログラム管理エリアとを含む。００００ｈ番地〜１Ｆ７Ｆｈ番地の領域のユーザプログラムエリアには、ユーザ（例えば、遊技機の製作者）により予め作成されたプログラム（ユーザプログラム）５５０が記憶される。また、１Ｆ８０ｈ番地〜１ＦＦＦｈ番地の領域のユーザプログラム管理エリアには、ＣＰＵ５６がユーザプログラム５５０を実行するために必要となるデータ（ユーザプログラム実行データ）が記憶される。また、ＲＡＭ５５に割り当てられている７Ｅ００ｈ番地〜７ＦＦＦｈ番地の領域のうち、７Ｅ００ｈ番地〜７ＥＦＦｈ番地の領域は未使用領域であり、７Ｆ００ｈ番地〜７ＦＦＦｈ番地の領域はワークエリアとして用いられる。

図３０は、ユーザプログラム管理エリアにおけるアドレスマップの一例を示す説明図である。図３０に示すように、１Ｆ９７ｈ番地の領域には、乱数回路５０３のカウンタ５２１に入力される初期値を変更するための方式である初期値変更方式のうち、ユーザによって選択された初期値変更方式を指定するための初期値変更方式設定データが記憶される。また、１Ｆ９８ｈ番地および１Ｆ９９ｈ番地の領域には、ＲＡＭ５５に割り当てられた７Ｆ００ｈ番地〜７ＦＦＦｈ番地のうち、ユーザによって予め指定されたＲＡＭ５５における番地（指定ＲＡＭ番地）を特定するためのＲＡＭ番地データが記憶される。この場合、指定ＲＡＭ番地を示す値のうち、指定ＲＡＭ番地の下位の値が１Ｆ９８ｈ番地に記憶され、指定ＲＡＭ番地の上位の値が１Ｆ９９ｈ番地に記憶される。

図３１は、初期値変更方式設定データの一例を示す説明図である。図３１に示すように、初期値変更データは、８ビットのデータから構成される。初期値変更データ「００ｈ」は、初期値変更方式として、初期値を変更しないことを指定するデータである。この実施の形態では、初期値変更データ「００ｈ」が設定されている場合、乱数回路５０３のカウンタ５２１は、予め定められた初期値「０」から所定の最終値までカウント値を更新することになる。また、初期値変更データ「０１ｈ」は、初期値変更方式として、カウンタ５２１に入力する初期値を、遊技制御用マイクロコンピュータ５６０を識別するためのＩＤナンバにもとづく値に変更することを指定するデータである。この実施の形態では、初期値変更データ「０１ｈ」が設定されている場合、カウンタ５２１が更新するカウンタ値の初期値が「０」からＩＤナンバにもとづく値に変更され、カウンタ５２１は、変更後の初期値から所定の最終値までカウント値を更新することになる。

ユーザプログラムエリアに記憶されるユーザプログラム５５０について説明する。図３２は、ユーザプログラム５５０の構成例を示す説明図である。図３２に示すように、この実施の形態では、ユーザプログラム５５０は、複数種類のプログラムモジュールから構成される乱数回路設定プログラム５５１と、表示結果決定プログラム５５２と、カウント値順列変更プログラム５５４と、乱数値更新プログラム５５５と、シリアル通信回路設定プログラム５５６と、割込優先順位設定プログラム５５７とを含む。

乱数回路設定プログラム５５１は、乱数回路５０３にランダムＲの値を更新させるための初期設定を行う乱数回路設定処理を実行させるためのプログラムである。すなわち、ＣＰＵ５６は、乱数回路設定プログラム５５１に従って処理を実行することにより、乱数回路初期設定手段として機能する。

図３３は、乱数回路設定プログラム５５１の構成例を示す説明図である。図３３に示すように、乱数回路設定プログラム５５１は、複数種類のプログラムモジュールとして、乱数最大値設定モジュール５５１ａと、乱数更新方式選択モジュール５５１ｂと、周期設定モジュール５５１ｃと、乱数回路起動モジュール５５１ｄと、初期値変更モジュール５５１ｅと、乱数回路選択モジュール５５１ｆとを含む。

乱数最大値設定モジュール５５１ａは、ユーザ（例えば、遊技機の製作者）によって予め設定されたランダムＲの最大値を乱数回路５０３に設定させるためのプログラムモジュールである。ＣＰＵ５６は、乱数最大値設定モジュール５５１ａに従って処理を実行することによって、ユーザによって予め設定されたランダムＲの最大値を指定する乱数最大値設定データを、乱数最大値設定レジスタ５３５に書き込む。そのようにすることによって、ＣＰＵ５６は、ユーザによって予め設定されたランダムＲの最大値を乱数回路５０３に設定する。例えば、ユーザによってランダムＲの最大値として予め「２５５」が設定された場合、ＣＰＵ５６は、乱数最大値設定レジスタ５３５に乱数最大値設定データ「００ＦＦｈ」を書き込んで、ランダムＲの最大値「２５５」を乱数回路５０３に設定する。

乱数更新方式選択モジュール５５１ｂは、ユーザによって選択された乱数更新方式（第１の乱数更新方式または第２の乱数更新方式）を乱数回路５０３に設定させるためのプログラムモジュールである。ＣＰＵ５６は、乱数更新方式選択モジュール５５１ｂに従って処理を実行することによって、ユーザによって選択された乱数更新方式を指定する乱数更新方式選択データ「０１ｂ」または「１０ｂ」を乱数更新方式選択レジスタ５４０に書き込む。そのようにすることによって、ＣＰＵ５６は、ユーザによって選択された乱数更新方式を乱数回路５０３に設定する。よって、遊技制御用マイクロコンピュータ５６０は、第１の乱数更新方式又は第２の乱数更新方式のうちのいずれかを、乱数回路５０３が乱数更新に用いる乱数更新方式として選択する機能を備える。

周期設定モジュール５５１ｃは、ユーザによって予め設定された内部クロック信号の周期（すなわち、クロック信号出力回路５２４がセレクタ５２８および反転回路５３２にクロック信号を出力する周期）を乱数回路５０３に設定させるためのプログラムモジュールである。ＣＰＵ５６は、周期設定モジュール５５１ｃに従って処理を実行することによって、ユーザによって予め設定された内部クロック信号の周期を指定するための周期設定データを周期設定レジスタ５３７に書き込む。そのようにすることによって、ＣＰＵ５６は、ユーザによって予め設定された内部クロック信号の周期を乱数回路５０３に設定する。例えば、ユーザによって内部クロック信号の周期が予め「システムクロック信号の周期×１２８×１６」と設定された場合、ＣＰＵ５６は、周期設定レジスタ５３７に周期設定データ「０Ｆｈ」を書き込んで、内部クロック信号の周期「システムクロック信号の周期×１２８×１６」を乱数回路５０３に設定する。

乱数回路起動モジュール５５１ｄは、乱数回路５０３を起動させるためのプログラムモジュールである。ＣＰＵ５６は、乱数回路起動モジュール５５１ｄに従って処理を実行することによって、乱数回路起動データ「８０ｈ」を乱数回路起動レジスタ５４１に書き込むことにより、乱数回路５０３を起動させる。

初期値変更モジュール５５１ｅは、カウンタ５２１が更新するカウント値の初期値を変更させるためのプログラムモジュールである。ＣＰＵ５６は、初期値変更モジュール５５１ｅに従って処理を実行することによって、初期値変更手段として機能する。ＣＰＵ５６は、初期値変更モジュール５５１ｅを実行して、ユーザによって選択された初期値変更方式によって、カウンタ５２１が更新するカウント値の初期値を変更させる。そのようにすることによって、ＣＰＵ５６は、初期値変更方式を選択する機能を備える。

この実施の形態では、ユーザプログラム管理エリアの１Ｆ９７ｈ番地の領域に初期値変更方式設定データ「０１ｈ」が記憶されている場合、ＣＰＵ５６は、カウント値の初期値を、遊技制御用マイクロコンピュータ５６０毎に付与された固有のＩＤナンバにもとづいて算出された値に変更させる。

例えば、遊技制御用マイクロコンピュータ５６０は、ＲＡＭ５５の所定の記憶領域に、遊技制御用マイクロコンピュータ５６０のＩＤナンバと、ＩＤナンバにもとづいて所定の演算を行って求めた演算値とを予め対応付けて記憶している。この場合、例えば、遊技制御用マイクロコンピュータ５６０のＩＤナンバが「１００」であるとすると、ＩＤナンバ「１００」に所定値「５０」を加算して求めた演算値「１５０」を、予めＩＤナンバに対応付けて記憶している。また、例えば、ＩＤナンバ「１００」に所定値「５０」を減算して求めた演算値「５０」を、予めＩＤナンバに対応付けて記憶している。また、例えば、予めＩＤナンバに対応づけて所定値だけを記憶していてもよい。そして、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、予め記憶される所定値（例えば、「５０」）にＩＤナンバ（例えば、「１００」を加算して求めた値「１５０」を、カウント値の初期値としてもよい。また、ＣＰＵ５６は、予め記憶される所定値（例えば、「５０」）をＩＤナンバ（例えば、「１００」）から減算して求めた値「５０」を、カウント値の初期値としてもよい。

そして、初期値変更方式設定データ「０１ｈ」が記憶されている場合、ＣＰＵ５６は、予め記憶するＩＤナンバにもとづく演算値にカウント値の初期値を変更させる。そのようにすれば、乱数回路５０３が発生する乱数のランダム性をより向上させることができ、遊技制御用マイクロコンピュータ５６０のＩＤナンバを見ただけでは乱数の初期値を認識しにくくすることができる。そのため、無線信号を用いた取り込み信号を遊技機に対して発生させるなどの行為によって、大当り状態への移行条件を不正に成立させられてしまうことをより確実に防止することができ、セキュリティ性を向上させることができる。

また、例えば、初期値変更方式設定データ「０１ｈ」が記憶されている場合、ＣＰＵ５６は、遊技制御用マイクロコンピュータ５６０のＩＤナンバと所定値とを演算して（例えば、ＩＤナンバに所定値を加算して）求めた演算値にカウント値の初期値を変更させる。この場合、例えば、ＣＰＵ５６は、乱数を用いてランダムに変化させた値をＩＤナンバと演算することによって、演算に用いる値をランダムに更新し初期値を求めてもよい。そのようにすれば、乱数回路５０３が発生する乱数のランダム性をより向上させることができる。

乱数回路選択モジュール５５１ｆは、遊技制御用マイクロコンピュータ５６０が内蔵する各乱数回路５０３の中から、遊技制御処理を含むタイマ割込処理の実行時に用いる乱数回路を設定するためのプログラムモジュールである。ＣＰＵ５６は、乱数回路選択モジュール５５１ｆに従って処理を実行することによって、遊技制御用マイクロコンピュータ５６０が内蔵する２つの乱数回路（１２ビット乱数回路５０３ａおよび１６ビット乱数回路５０３ｂ）のうち、いずれの乱数回路をタイマ割込処理の実行時に用いるかを設定する。例えば、ＣＰＵ５６は、ＲＯＭ５４の所定の記憶領域に記憶された所定の設定値（ユーザによって予め設定された値）に従って、タイマ割込処理の実行時に用いる乱数回路として、１２ビット乱数回路５０３ａまたは１６ビット乱数回路５０３ｂを設定する。

なお、タイマ割込処理の実行時に用いる乱数回路として、１２ビット乱数回路５０３ａおよび１６ビット乱数回路５０３ｂの両方を設定してもよい。この場合、遊技制御用マイクロコンピュータは、例えば、１２ビット乱数回路５０３ａが発生した乱数にもとづいて確変判定を行い、１６ビット乱数回路５０３ｂが発生した乱数にもとづいて大当り判定を行うようにしてもよい。この実施の形態では、乱数値記憶回路５３１は、１２ビット乱数回路５０３ａと１６ビット乱数回路５０３ｂとにそれぞれ存在する（すなわち、１２ビット用の乱数を記憶する乱数値記憶回路と、１６ビット用の乱数を記憶する乱数値記憶回路とが、別個に存在する）。また、１２ビット乱数回路５０３ａおよび１６ビット乱数回路５０３ｂの両方を設定した場合、遊技制御用マイクロコンピュータ５６０は、１２ビット乱数回路５０３ａから読み出した乱数と、１６ビット乱数回路５０３ｂから読み出した乱数とを、ＲＡＭ５５に設けられた別々のバッファ領域にそれぞれ格納する。そのため、１２ビット乱数回路５０３ａから乱数を読み出すタイミングと、１６ビット乱数回路５０３ｂから乱数を読み出すタイミングとが同じであっても、２つの異なる乱数を抽出し別々のバッファ領域に格納することができる。

乱数値更新プログラム５５５は、乱数更新方式として第１の乱数更新方式が選択されているときに、乱数値記憶回路５３１に格納されているランダムＲの値を更新させるためのプログラムである。ＣＰＵ５６は、乱数値更新プログラム５５５に従って処理を実行することによって、乱数値更新手段として機能する。ＣＰＵ５６は、第１の乱数更新方式が選択されているときに、乱数値更新プログラム５５５を実行して、カウント値更新データ「０１ｈ」をカウント値更新レジスタ５３８に書き込むことにより、カウンタ５２１にカウント値を更新させ、乱数値記憶回路５３１に格納さているランダムＲの値を更新させる。なお、乱数更新方式として第２の乱数更新方式が選択されている場合には、クロック信号出力回路５２４が出力する乱数発生用クロック信号によって、カウンタ５２１にカウント値を更新させ、乱数値記憶回路５３１に格納さているランダムＲの値を更新させることになる。

表示結果決定プログラム５５２は、特別図柄表示装置８における表示結果を大当り図柄とするか否かを決定するためのプログラムである。ＣＰＵ５６は、表示結果決定プログラム５５２に従って処理を実行することによって、表示結果決定手段として機能する。

この実施の形態では、ＣＰＵ５６は、遊技球が可変入賞球装置１５に入賞して特別図柄の可変表示を実行するための条件（実行条件）が成立したことに応じて、表示結果決定プログラム５５２に従って処理を実行する。そして、ＣＰＵ５６は、乱数値記憶回路５３１から更新後のランダムＲの値を読み出して、特別図柄表示装置８における表示結果を大当り図柄とするか否かを決定する。

図３４は、第１の乱数更新方式が選択されている場合に、ＣＰＵ５６がランダムＲの値を更新させたりランダムＲの値を読出したりする動作を示す説明図である。図３４に示すように、第１の乱数更新方式が選択されている場合、ＣＰＵ５６は、カウント値更新データ「０１ｈ」をカウント値更新レジスタ５３８に書き込むことによって、乱数値記憶回路５３１が記憶するランダムＲの値（例えば「２」）を更新させる。そして、ＣＰＵ５６は、遊技球が可変入賞球装置１５に入賞して特別図柄の可変表示を実行するための条件（実行条件）が成立したことに応じて、乱数値記憶回路５３１からランダムＲの値（例えば「２」）を読み出す。

なお、乱数値記憶回路５３１が記憶するランダムＲの値をさらに更新させる場合、前回更新時にランダムＲの値を更新したときから、クロック回路５０１が出力するシステムクロック信号の周期以上の間隔を経過したときに、カウント値更新レジスタ５３８にカウント値更新データ「０１ｈ」を書き込まなければならない。なぜなら、更新後のランダムＲの値を乱数値記憶回路５３１から読み出す時間を確保する必要があるからである。

図３５は、第２の乱数更新方式が選択されている場合に、ＣＰＵ５６がランダムＲの値に更新させたりランダムＲの値を読出したりする動作を示す説明図である。図３５に示すように、第２の乱数更新方式が選択されている場合、ＣＰＵ５６は、乱数値取込データ「０１ｈ」を乱数値取込レジスタ５３９に書き込むことによって、カウンタ５２１が出力するカウント値（例えば「２」）を乱数値記憶回路５３１に取り込ませて、乱数値記憶回路５３１が記憶するランダムＲの値を更新させる。そして、ＣＰＵ５６は、乱数値記憶回路５３１から更新後のランダムＲの値（例えば「２」）を読み出す。

具体的には、第２の乱数更新方式が選択されている場合、カウンタ５２１は、乱数発生用クロック信号ＳＩ１を入力したことをトリガとしてカウント値Ｃを更新する。その後、乱数値取込データ「０１ｈ」が乱数値取込レジスタ５３９に書き込まれると、ラッチ信号生成回路５３３はラッチ信号ＳＬを乱数値記憶回路５３１に出力する。そして、乱数値記憶回路５３１は、ラッチ信号ＳＬを入力したことをトリガとしてカウンタ５２１が出力するカウント値を読み込んで記憶する。そして、ＣＰＵ５６は、乱数値記憶回路５３１が記憶するランダムＲの値を読み出す。

なお、タイマ回路５３４が乱数値取込データ「０１ｈ」を乱数値取込レジスタ５３９に書き込まなければ、カウンタ５２１がカウント値を更新しても、乱数値記憶回路５３１は、カウンタ５２１が更新する乱数値を記憶しない。例えば、タイマ回路５３４が乱数値取込データ「０１ｈ」を乱数値取込レジスタ５３９に書き込み、カウンタ５２１が出力するカウント値「３」を乱数値記憶回路５３１に取り込ませて、乱数値記憶回路５３１が記憶するランダムＲの値「３」を更新させたとする。この場合、タイマ回路５３４が乱数値取込データ「０１ｈ」を再び乱数値取込レジスタ５３９に書き込まなければ、カウンタ５２１が出力するカウント値が「３」から「４」や「５」に更新されても、乱数値記憶回路５３１が記憶する乱数値は更新されず、乱数値記憶回路５３１から読み出される乱数値は「３」のままである。

カウント値順列変更プログラム５５４は、カウント値順列変更レジスタ５３６にカウント値順列変更データ「０１ｈ」を書き込んで、乱数値記憶回路５３１が記憶するカウント値の順列を変更させるカウント値順列変更処理を実行するためのプログラムである。ＣＰＵ５６は、カウント値順列変更プログラム５５４に従って処理を実行することによって、数値データ順列変更手段として機能する。ＣＰＵ５６は、カウント値順列変更プログラム５５４を実行して、カウント値順列変更レジスタ５３６にカウント値順列変更データ「０１ｈ」を書き込むことによって、カウント値順列変更回路５２３が出力し乱数値記憶回路５３１に入力されるカウント値の順列を変更させる。

シリアル通信回路設定プログラム５５６は、シリアル通信回路５０５に各制御基板に搭載されたマイクロコンピュータ（本例では、払出制御用マイクロコンピュータ）とシリアル通信させるための初期設定を行うシリアル通信回路設定処理を実行させるためのプログラムである。すなわち、ＣＰＵ５６は、シリアル通信回路設定プログラム５５６に従って処理を実行することにより、シリアル通信回路設定手段として機能する。

割込優先順位設定プログラム５５７は、シリアル通信回路５０５の割り込み要求に応じて実行する割込処理の優先順位を初期設定するためのプログラムである。すなわち、ＣＰＵ５６は、割込優先順位設定プログラム５５６に従って処理を実行することにより、優先順位初期設定手段として機能する。

また、遊技制御用マイクロコンピュータ５６０は、図３６に示すように、特図保留メモリ５７０と、大当り判定用テーブルメモリ５７１と、フラグメモリ５７２と、始動入賞口スイッチタイマメモリ５７３とを備える。

特図保留メモリ５７０は、遊技球が可変入賞球装置１５に入賞して特別図柄の可変表示の実行条件は成立したが、未だ可変表示の開始条件が成立していない（例えば、特別図柄表示装置８がまだ可変表示を実行中である）可変表示の実行条件の成立回数を含む保留データを記憶するためのメモリ（保存領域）である。特図保留メモリ５７０は、４つのエントリを備え、各エントリには、遊技球が可変入賞球装置１５に入賞した順に、保留番号と、入賞に応じて乱数値記憶回路５３１から読み出したランダムＲの値とが対応付けて格納される。また、特別図柄表示装置８における特別図柄の可変表示が１回終了したり、大当り遊技状態が終了したりするごとに、特図保留メモリ５７０の最上位の情報にもとづいた可変表示の開始条件が成立し、特図保留メモリ５７０最上位の情報にもとづいた可変表示が実行される。この場合、特別図柄の可変表示の開始条件が成立すると、特図保留メモリ５７０の第２位以下に登録されている情報が１位ずつ繰り上がる。また、特別図柄の可変表示中に遊技球が可変入賞球装置１５に新たに入賞した場合には、その新たな入賞にもとづいて乱数値記憶回路５３１から読み出されたランダムＲの値が、特図保留メモリ５７０の空エントリに登録される。

大当り判定用テーブルメモリ５７１は、ＣＰＵ５６が特別図柄表示装置８の表示結果を大当り図柄とするか否かを判定するために用いる複数の大当り判定テーブルを記憶する。具体的には、大当り判定用テーブルメモリ５７１は、図３７（Ａ）に示すように、確変状態以外の遊技状態（通常状態という）において用いられる通常時大当り判定テーブル５７１ａを記憶する。また、大当り判定用テーブルメモリ５７１は、図３７（Ｂ）に示すように、確変状態において用いられる確変時大当り判定テーブル５７１ｂを格納する。なお、図３７に示す判定テーブルを用いて大当り判定を行う場合、乱数最大値設定レジスタ５３５に設定された乱数最大値によって大当りと判定する確率が大きく変化することになる。この場合、例えば、設定される乱数最大値が小さすぎると、通常時大当り判定テーブル５７１ａを用いた場合と、確変時大当り判定テーブル５７１ｂを用いた場合とで、大当りと判定する確率の差が小さくなってしまい、遊技者の遊技に対する興味を減退させてしまうことになる。そのため、乱数回路５０３および乱数最大値に対応づけて、複数の判定テーブル（複数の通常時大当り判定用テーブル５７１ａおよび複数の確変時大当たり判定用テーブル５７１ｂ）を大当り判定用テーブルメモリ５７１に記憶してもよい。そして、遊技制御用マイクロコンピュータ５６０は、大当り判定用テーブルメモリ５７１が記憶する判定テーブルのうち、使用する乱数回路５０３および乱数最大値に対応する判定テーブル５７１ａ，５７１ｂを用いて、表示結果決定プログラム５５２に従って、特別図柄表示装置８の表示結果を大当り図柄とするか否かを判定するようにしてもよい。そのようにすることによって、使用する乱数回路５０３の種類や乱数最大値が異なっても、大当たりと判定する確率がある程度同じになるように制御することができる。

フラグメモリ５７２には、遊技の進行を制御する遊技制御処理において用いられる各種のフラグが設定される。例えば、フラグメモリ５７２には、遊技状態が確変状態であることを示す確変フラグや、大当り状態であることを示す大当りフラグが設定される。

始動口スイッチタイマメモリ５７３は、始動口スイッチ１４ａから入力される入賞検出信号ＳＳに応じて加算またはクリアされるタイマ値を記憶する。

次に遊技機の動作について説明する。図３８および図３９は、遊技機に対して電力供給が開始され遊技制御用マイクロコンピュータ５６０へのリセット信号がハイレベルになったことに応じて遊技制御用マイクロコンピュータ５６０のＣＰＵ５６が実行するメイン処理を示すフローチャートである。リセット信号が入力されるリセット端子の入力レベルがハイレベルになると、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、プログラムの内容が正当か否かを確認するための処理であるセキュリティチェック処理を実行した後、ステップＳ１以降のメイン処理を開始する。メイン処理において、ＣＰＵ５６は、まず、必要な初期設定を行う。

初期設定処理において、ＣＰＵ５６は、まず、割込禁止に設定する（ステップＳ１）。次に、マスク可能割込の割込モードを設定し（ステップＳ２）、スタックポインタにスタックポインタ指定アドレスを設定する（ステップＳ３）。なお、ステップＳ２では、遊技制御用マイクロコンピュータ５６０の特定レジスタ（Ｉレジスタ）の値（１バイト）と内蔵デバイスが出力する割込ベクタ（１バイト：最下位ビット０）から合成されるアドレスが、割込番地を示すモードに設定する。また、マスク可能な割込が発生すると、ＣＰＵ５６は、自動的に割込禁止状態に設定するとともに、プログラムカウンタの内容をスタックにセーブする。

次いで、内蔵デバイスレジスタの設定（初期化）を行う（ステップＳ４）。ステップＳ４の処理によって、内蔵デバイス（内蔵周辺回路）であるＣＴＣ（カウンタ／タイマ）およびＰＩＯ（パラレル入出力ポート）の設定（初期化）がなされる。

この実施の形態で用いられる遊技制御用マイクロコンピュータ５６０は、Ｉ／Ｏポート（ＰＩＯ）およびタイマ／カウンタ回路（ＣＴＣ）５０４も内蔵している。

次に、入力ポート１のビット０の状態によって電源断信号がオフ状態になっているか否か確認する（ステップＳ５）。遊技機に対する電力供給が開始されたときに、＋５Ｖ電源などの各種電源の出力電圧は徐々に規定値に達するのであるが、ステップＳ５の処理によって、すなわち、電源断信号が出力されていない（ハイレベルになっている）ことを確認することにより遊技制御用マイクロコンピュータ５６０は電源電圧が安定したことを確認することができる。

電源断信号がオン状態である場合には、ＣＰＵ５６は、所定期間（例えば、０．１秒）の遅延時間の後に（ステップＳ８０）、再度、電源断信号がオフ状態になっているか否か確認する。電源断信号がオフ状態になっている場合には、ＲＡＭ５５をアクセス可能状態に設定し（ステップＳ６）、クリア信号のチェック処理に移行する。

なお、電源断信号がオフ状態である場合に、遊技の進行を制御する遊技装置制御処理（遊技制御処理）の開始タイミングをソフトウェアで遅らせるためのソフトウェア遅延処理を実行するようにしてもよい。そのようなソフトウェア遅延処理によって、ソフトウェア遅延処理を実行しない場合に比べて、遊技制御処理の開始タイミングを遅延させることができる。遅延処理を実行したときには、他の制御基板（例えば、払出制御基板３７）に対して、遊技制御基板（主基板３１）が送信するコマンドを他の制御基板が受信できないという状況が発生することを防止できる。

次いで、ＣＰＵ５６は、クリアスイッチがオンされているか否か確認する（ステップＳ７）。なお、ＣＰＵ５６は、入力ポート０を介して１回だけクリア信号の状態を確認するようにしてもよいが、複数回クリア信号の状態を確認するようにしてもよい。例えば、クリア信号の状態がオフ状態であることを確認したら、所定時間（例えば、０．１秒）の遅延時間をおいた後、クリア信号の状態を再確認する。そのときにクリア信号の状態がオン状態であることを確認したら、クリア信号がオン状態になっていると判定する。また、このときにクリア信号の状態がオフ状態であることを確認したら、所定時間の遅延時間をおいた後、再度、クリア信号の状態を再確認するようにしてもよい。ここで、再確認の回数は、１回または２回に限られず、３回以上であってもよい。また、２回チェックして、チェック結果が一致していなかったときにもう一度確認するようにしてもよい。

ステップＳ７でクリアスイッチがオンでない場合には、遊技機への電力供給が停止したときにバックアップＲＡＭ領域のデータ保護処理（例えばパリティデータの付加等の電力供給停止時処理）が行われたか否か確認する（ステップＳ８）。この実施の形態では、電力供給の停止が生じた場合には、バックアップＲＡＭ領域のデータを保護するための処理が行われている。そのような電力供給停止時処理が行われていたことを確認した場合には、ＣＰＵ５６は、電力供給停止時処理が行われた、すなわち電力供給停止時の制御状態が保存されていると判定する。電力供給停止時処理が行われていないことを確認した場合には、ＣＰＵ５６は初期化処理を実行する。

電力供給停止時処理が行われていたか否かは、電力供給停止時処理においてバックアップＲＡＭ領域に保存されるバックアップ監視タイマの値が、電力供給停止時処理を実行したことに応じた値（例えば２）になっているか否かによって確認される。なお、そのような確認の仕方は一例であって、例えば、電力供給停止時処理においてバックアップフラグ領域に電力供給停止時処理を実行したことを示すフラグをセットし、ステップＳ８において、そのフラグがセットされていることを確認したら電力供給停止時処理が行われたと判定してもよい。

電力供給停止時の制御状態が保存されていると判定したら、ＣＰＵ５６は、バックアップＲＡＭ領域のデータチェック（この例ではパリティチェック）を行う（ステップＳ９）。この実施の形態では、クリアデータ（００）をチェックサムデータエリアにセットし、チェックサム算出開始アドレスをポインタにセットする。また、チェックサムの対象になるデータ数に対応するチェックサム算出回数をセットする。そして、チェックサムデータエリアの内容とポインタが指すＲＡＭ領域の内容との排他的論理和を演算する。演算結果をチェックサムデータエリアにストアするとともに、ポインタの値を１増やし、チェックサム算出回数の値を１減算する。以上の処理が、チェックサム算出回数の値が０になるまで繰り返される。チェックサム算出回数の値が０になったら、ＣＰＵ５６は、チェックサムデータエリアの内容の各ビットの値を反転し、反転後のデータをチェックサムにする。

電力供給停止時処理において、上記の処理と同様の処理によってチェックサムが算出され、チェックサムはバックアップＲＡＭ領域に保存されている。ステップＳ９では、算出したチェックサムと保存されているチェックサムとを比較する。不測の停電等の電力供給停止が生じた後に復旧した場合には、バックアップＲＡＭ領域のデータは保存されているはずであるから、チェック結果（比較結果）は正常（一致）になる。チェック結果が正常でないということは、バックアップＲＡＭ領域のデータが、電力供給停止時のデータとは異なっている可能性があることを意味する。そのような場合には、内部状態を電力供給停止時の状態に戻すことができないので、電力供給の停止からの復旧時でない電源投入時に実行される初期化処理（ステップＳ１０〜Ｓ１４の処理）を実行する。

チェック結果が正常であれば、ＣＰＵ５６は、遊技制御手段の内部状態と演出制御手段等の電気部品制御手段の制御状態を電力供給停止時の状態に戻すための遊技状態復旧処理を行う。具体的には、ＲＯＭ５４に格納されているバックアップ時設定テーブルの先頭アドレスをポインタに設定し（ステップＳ９１）、バックアップ時設定テーブルの内容を順次作業領域（ＲＡＭ５５内の領域）に設定する（ステップＳ９２）。作業領域はバックアップ電源によって電源バックアップされている。バックアップ時設定テーブルには、作業領域のうち初期化してもよい領域についての初期化データが設定されている。ステップＳ９１およびＳ９２の処理によって、作業領域のうち初期化してはならない部分については、保存されていた内容がそのまま残る。初期化してはならない部分とは、例えば、電力供給停止前の遊技状態を示すデータ（特別図柄プロセスフラグなど）、出力ポートの出力状態が保存されている領域（出力ポートバッファ）、未払出賞球数を示すデータが設定されている部分などである。

また、ＣＰＵ５６は、ＲＯＭ５４に格納されているバックアップ時コマンド送信テーブルの先頭アドレスをポインタに設定し（ステップＳ９３）、ステップＳ１５に移行する。

初期化処理では、ＣＰＵ５６は、まず、ＲＡＭクリア処理を行う（ステップＳ１０）。なお、ＲＡＭ５５の全領域を初期化せず、所定のデータをそのままにしてもよい。また、ＲＯＭ５４に格納されている初期化時設定テーブルの先頭アドレスをポインタに設定し（ステップＳ１１）、初期化時設定テーブルの内容を順次業領域に設定する（ステップＳ１２）。

ステップＳ１１およびＳ１２の処理によって、例えば、普通図柄判定用乱数カウンタ、普通図柄判定用バッファ、特別図柄バッファ、総賞球数格納バッファ、特別図柄プロセスフラグ、賞球中フラグ、球切れフラグなど制御状態に応じて選択的に処理を行うためのフラグに初期値が設定される。また、出力ポートバッファにおける接続確認信号を出力する出力ポートに対応するビットがセット（接続確認信号のオン状態に対応）される。

また、ＣＰＵ５６は、ＲＯＭ５４に格納されている初期化時コマンド送信テーブルの先頭アドレスをポインタに設定し（ステップＳ１３）、その内容に従ってサブ基板を初期化するための初期化コマンドをサブ基板に送信する処理を実行する（ステップＳ１４）。初期化コマンドとして、可変表示装置９に表示される初期図柄を示すコマンドや払出制御基板３７への初期化コマンド等を使用することができる。

また、ＣＰＵ５６は、各乱数回路５０３ａ，５０３ｂを初期設定する乱数回路設定処理を実行する（ステップＳ１５）。この場合、ＣＰＵ５６は、乱数回路設定プログラム５５１に従って処理を実行することによって、各乱数回路５０３ａ，５０３ｂにランダムＲの値を更新させるための設定を行う。

また、ＣＰＵ５６は、シリアル通信回路５０５を初期設定するシリアル通信回路設定処理を実行する（ステップＳ１５ａ）。この場合、ＣＰＵ５６は、シリアル通信回路設定プログラム５５６に従って処理を実行することによって、シリアル通信回路５０５に払出制御用マイクロコンピュータとシリアル通信させるための設定を行う。

シリアル通信回路５０５を初期設定すると、ＣＰＵ５６は、シリアル通信回路５０５の割り込み要求に応じて実行する割込処理の優先順位を初期設定する（ステップＳ１５ｂ）。この場合、ＣＰＵ５６は、割込優先順位設定プログラム５５７に従って処理を実行することによって、割込処理の優先順位を初期設定する。

例えば、ＣＰＵ５６は、各割込処理のデフォルトの優先順位を含む所定の割込処理優先順位テーブルに従って、各割込処理の優先順位を初期設定する。図４０は、割込処理優先順位テーブルの例を示す説明図である。この実施の形態では、ＣＰＵ５６は、図４０に示す割込処理優先順位テーブルに従って、シリアル通信回路５０５において通信エラーが発生したことを割込原因とする割込処理を優先して実行するように初期設定する。この場合、例えば、ＣＰＵ５６は、通信エラーが発生したことを割込原因とする割込処理を優先して実行する旨を示す通信エラー時割込優先実行フラグをセットする。

また、ユーザによって各割込処理のデフォルトの優先順位を変更することもできる。例えば、遊技制御用マイクロコンピュータ５６０は、ユーザ（例えば、遊技機の製作者）によって設定された割込処理を指定する指定情報を、あらかじめＲＯＭ５４の所定の記憶領域に記憶している。そして、ＣＰＵ５６は、ＲＯＭ５４の所定の記憶領域に記憶された指定情報に従って、割込処理の優先順位を設定する。

そして、ＣＰＵ５６は、所定時間（例えば２ｍｓ）ごとに定期的にタイマ割込がかかるように遊技制御用マイクロコンピュータ５６０に内蔵されているＣＴＣのレジスタの設定を行なうタイマ割込設定処理を実行する（ステップＳ１６）。すなわち、初期値として例えば２ｍｓに相当する値が所定のレジスタ（時間定数レジスタ）に設定される。この実施の形態では、２ｍｓごとに定期的にタイマ割込がかかるとする。

タイマ割込の設定が完了すると、ＣＰＵ５６は、表示用乱数更新処理（ステップＳ１８）および初期値用乱数更新処理（ステップＳ１８ａ）を繰り返し実行する。ＣＰＵ５６は、表示用乱数更新処理および初期値用乱数更新処理が実行されるときには割込禁止状態にして（ステップＳ１７）、表示用乱数更新処理および初期値用乱数更新処理の実行が終了すると割込許可状態にする（ステップＳ１９）。

なお、表示用乱数とは、特別図柄表示器８の表示を決定するための乱数（ソフトウェア乱数）である。この実施の形態では、表示用乱数として、特別図柄の変動パターンを決定するための変動パターン決定用乱数や、大当りを発生させない場合にリーチとするか否かを決定するためのリーチ判定用乱数が用いられる。また、表示用乱数更新処理とは、表示用乱数を発生するためのカウンタのカウント値を更新する処理である。

また、初期値用乱数更新処理とは、初期値用乱数を発生するためのカウンタのカウント値を更新する処理である。初期値用乱数とは、大当りの種類を決定するための判定用乱数（例えば、大当りを発生させる特別図柄を決定するための大当り図柄決定用乱数や、確変とするか否かを決定するための確変決定用乱数、普通図柄にもとづく当りを発生させるか否かを決定するための普通図柄当たり判定用乱数）を発生するためのカウンタ（判定用乱数発生カウンタ）等のカウント値の初期値を決定するための乱数（ソフトウェア乱数）である。後述する遊技制御処理（遊技制御用マイクロコンピュータが、遊技機に設けられている可変表示装置９、可変入賞球装置１５、球払出装置９７等の遊技用の装置を、自身で制御する処理、または他のマイクロコンピュータに制御させるために指令信号を送信する処理、遊技装置制御処理ともいう）において、判定用乱数発生カウンタのカウント値が１周すると、そのカウンタに初期値が設定される。

なお、表示用乱数更新処理および初期値用乱数更新処理が実行されるときに割込禁止状態にされるのは、表示用乱数更新処理および初期値用乱数更新処理が後述するタイマ割込処理でも実行される（すなわち、タイマ割込処理のステップＳ２４，Ｓ２５でも同じ処理が実行される）ことから、タイマ割込処理における処理と競合してしまうのを避けるためである。すなわち、ステップＳ１８，Ｓ１８ａの処理中にタイマ割込が発生してタイマ割込処理中で表示用乱数や初期値用乱数を発生するためのカウンタのカウント値を更新してしまったのでは、カウント値の連続性が損なわれる場合がある。しかし、ステップＳ１８，Ｓ１８ａの処理中では割込禁止状態にしておけば、そのような不都合が生ずることはない。

以上のように、遊技店員等は、クリアスイッチ９２１をオン状態してクリア信号が出力される状態にしながら遊技機に対する電力供給を開始する（例えば電源スイッチ９１４をオンする）ことによって、容易に初期化処理を実行させることができる。すなわち、ＲＡＭクリア等を行うことができる。

次に、メイン処理における乱数回路設定処理（ステップＳ１５）を説明する。図４１は、乱数回路設定処理を示すフローチャートである。乱数回路設定処理において、ＣＰＵ５６は、まず、乱数回路設定プログラム５５１に含まれる乱数回路選択モジュール５５１ｆに従って処理を実行し、遊技制御用マイクロコンピュータ５６０が内蔵する各乱数回路５０３ａ，５０３ｂの中から、遊技制御処理を含むタイマ割込処理の実行時に用いる乱数回路を設定する（ステップＳ１５１）。例えば、遊技制御用マイクロコンピュータ５６０は、ユーザ（例えば、遊技機の製作者）によって設定されたタイマ割込処理の実行時に用いる乱数回路５０３を指定する指定情報を、あらかじめＲＯＭ５４の所定の記憶領域に記憶している。そして、ＣＰＵ５６は、ＲＯＭ５４の所定の記憶領域に記憶された指定情報に従って、１２ビット乱数回路５０３ａまたは１６ビット乱数回路５０３ｂのいずれかを選択し、選択した乱数回路をタイマ割込処理の実行時に用いる乱数回路として設定する。なお、タイマ割込処理の実行時に用いる乱数回路として、１２ビット乱数回路５０３ａおよび１６ビット乱数回路５０３ｂの両方を設定してもよい。この場合、遊技制御用マイクロコンピュータは、例えば、１２ビット乱数回路５０３ａが発生した乱数にもとづいて確変判定を行い、１６ビット乱数回路５０３ｂが発生した乱数にもとづいて大当り判定を行うようにしてもよい。

上記のように、ステップＳ１５１において、更新可能な数値データの所定の範囲が異なる複数の乱数回路（１２ビット乱数回路５０３ａと１６ビット乱数回路５０３ｂ）について、それぞれ使用可能とするか否かを設定するので、タイマ割込処理の実行中に不要な乱数を処理することを防止することができ、遊技制御用マイクロコンピュータ５６０の制御負担を軽減することができる。例えば、遊技制御用マイクロコンピュータ５６０が、２つの乱数回路５０３ａ，５０３ｂのうちの一方が発生する乱数のみを用いて遊技制御処理を行う場合、遊技制御処理に用いない方の乱数回路から乱数を読み出す処理等を行わないようにでき、遊技制御用マイクロコンピュータ５６０の制御負担を軽減できる。

ＣＰＵ５６は、ステップＳ１５１で使用する乱数回路５０３を設定すると、例えば、乱数回路起動レジスタ５４１にデータを書き込まない等により、カウンタ５２１やクロック信号出力回路５２４の動作を停止させることで、使用しないように設定した方の乱数回路のカウンタ５２１がカウント値Ｃを更新しないようにする。また、例えば、使用しないように設定した方の乱数回路のカウンタ５２１はカウント値Ｃを更新するが、ＣＰＵ５６は出力制御信号ＳＣを出力しないようにし、乱数値記憶回路５３１から乱数を読み出せないように制御してもよい。また、例えば、ＣＰＵ５６は、タイマ回路５３４に使用しないように設定した方の乱数回路の乱数値取込レジスタ５３９に乱数値取込データ「０１ｈ」を書き込ませないようにし、ラッチ信号生成回路５３３がラッチ信号ＳＬを乱数値記憶回路５３１に出力しないように制御してもよい。

上記のように、使用する乱数回路５０３を設定するようにすることによって、使用する乱数回路５０３だけを設定することによって、生成する乱数の値の範囲を適切に設定することができる。また、タイマ割込処理の実行中に不要な乱数を処理することを防止することができ、遊技制御用マイクロコンピュータ５６０の制御負担を軽減することができる。例えば、大当りとする判定値として離れた値（例えば、「１」と「１００」を含む判定テーブルを用いて大当り判定を行う場合、所定の大当り確率（例えば、１００分の１）で大当りと判定するようにすると、１６ビット乱数回路５０３ｂによる乱数を用いるよりも、１２ビット乱数回路５０３ａによる乱数を用いた方が、処理すべき判定値の種類の数が少なくて済み、遊技制御用マイクロコンピュータ５６０の制御負担が軽減される。

また、ＣＰＵ５６は、乱数回路設定プログラム５５１に含まれる乱数最大値設定モジュール５５１ａに従って処理を実行し、ユーザによって予め設定された乱数最大値を指定する乱数最大値設定データを、乱数最大値設定レジスタ５３５に書き込む（ステップＳ１５２）。そのようにすることによって、ユーザによって予め設定されたランダムＲの乱数最大値を乱数回路５０３に設定する。なお、タイマ割込実行時に用いる乱数回路として１２ビット乱数回路５０３ａを設定した場合、ＣＰＵ５６は、乱数最大値（「０」〜「４０９５」のうちのいずれかの値）を指定する乱数最大値設定データを、１２ビット乱数回路５０３ａの乱数最大値設定レジスタ５３５に書き込む。また、タイマ割込実行時に用いる乱数回路として１６ビット乱数回路５０３ｂを設定した場合、ＣＰＵ５６は、乱数最大値（「０」〜「６５５３５」のうちのいずれかの値）を指定する乱数最大値設定データを、１６ビット乱数回路５０３ｂの乱数最大値設定レジスタ５３５に書き込む。

なお、この実施の形態では、乱数最大値として「０」〜「２５５」が設定された場合には、後述する乱数最大値再設定処理において乱数最大値を所定値に設定しなおすことになる。また、乱数最大値として「２５６」以上の値を書き込む制御を行った場合であっても、データ化けなどの原因によって「０」〜「２５５」の値が乱数最大値設定レジスタ５３５に設定されてしまった場合には、後述する乱数最大値再設定処理において乱数最大値を所定値に設定しなおす。

上記のように、ステップＳ１５２において、生成する乱数の最大値をあらかじめ乱数最大値設定レジスタ５３５に設定するので、タイマ割込処理の実行中に用いる乱数の範囲より大きい値の乱数を生成してしまうことを防止でき、乱数回路５０３および遊技制御用マイクロコンピュータ５６０の処理負担を軽減することができる。

また、ＣＰＵ５６は、ステップＳ１５２で乱数最大値設定レジスタ５３５に設定した乱数最大値が所定の下限値以下でないかを確認し、乱数最大値が下限値以下である場合には、乱数最大値設定レジスタ５３５に設定されている乱数最大値の再設定を行う乱数最大値再設定処理を実行する（ステップＳ１５３）。

また、ＣＰＵ５６は、乱数回路設定プログラム５５１に含まれる初期値変更モジュール５５１ｅに従って処理を実行し、乱数回路５０３のカウンタ５２１が更新するカウント値の初期値を変更させる初期値変更処理を実行する（ステップＳ１５４）。

また、ＣＰＵ５６は、乱数回路設定プログラム５５１に含まれる乱数更新方式選択モジュール５５１ｂに従って処理を実行し、乱数更新方式選択データを乱数更新方式選択レジスタ５４０に書き込む（ステップＳ１５５）。そのようにすることによって、乱数回路５０３の乱数更新方式を設定する。なお、この実施の形態では、ＣＰＵ５６は、乱数更新方式選択データ「１０ｈ」を乱数更新方式選択レジスタ５４０に書き込むものとする。すなわち、この実施の形態では、乱数回路５０３の乱数更新方式として第２の乱数更新方式が設定される。

また、ＣＰＵ５６は、乱数回路設定プログラム５５１に含まれる周期設定モジュール５５１ｃに従って処理を実行し、ユーザによって予め設定された乱数発生用クロック信号ＳＩ１の周期を指定する周期設定データ（基準クロック信号を何分周させるかを設定するためのデータ）を、周期設定レジスタ５３７に書き込む（ステップＳ１５６）。そのようにすることによって、ユーザによって予め設定された乱数発生用クロック信号ＳＩ１の周期を乱数回路５０３に設定する。

また、ＣＰＵ５６は、乱数回路５０３のカウンタ５２１によって所定の最終値までカウント値が更新されたときに、カウンタ５２１に入力する初期値を更新するか否かを設定する（ステップＳ１５７）。例えば、遊技制御用マイクロコンピュータ５６０は、カウンタ５２１によって所定の最終値までカウント値が更新されたときに、カウンタ５２１に入力する初期値を更新するか否かを示す設定値を、予めユーザによって設定されＲＯＭ５４の所定領域に記憶している。そして、ＣＰＵ５６は、ＲＯＭ５４の所定の記憶領域に記憶された所定の設定値に従って、カウンタ５２１によって所定の最終値までカウント値が更新されたときに、カウンタ５２１に入力する初期値を更新するか否かを設定する。この実施の形態では、ＣＰＵ５６は、ステップＳ１５７において、カウンタ５２１に入力する初期値を更新すると判定すると、所定の最終値までカウント値が更新されたとき（カウンタ５２１から通知信号を入力したとき）に初期値を更新する旨を示す初期値更新フラグをセットする。

なお、ＣＰＵ５６によってカウント値の初期値を変更するのでなく、最終値までカウント値を更新したことにもとづいて、乱数回路５０３側でカウント値の初期値を所定値に変更するようにしてもよい。例えば、乱数回路５０３は、初期値を更新する旨を示す初期値更新データを格納する初期値更新データレジスタを備え、ＣＰＵ５６は、ステップＳ１５７において、初期値更新データを初期値更新データレジスタに設定する。この場合、カウンタ５２１は、最終値までカウント値を更新すると、初期値更新データレジスタに初期値更新データが設定されているか否かを確認する。そして、カウンタ５２１は、初期値更新データが設定されていることを確認すると、カウント値の初期値を所定値に変更する。

また、ＣＰＵ５６は、乱数回路５０３のカウンタ５２１によって所定の最終値までカウント値が更新されたときに、カウンタ５２１が更新するカウント値の順列を変更するか否かを設定する（ステップＳ１５８）。例えば、遊技制御用マイクロコンピュータ５６０は、カウンタ５２１によって所定の最終値までカウント値が更新されたときに、カウンタ５２１が出力するカウント値の順列を変更するか否かを示す設定値を、予めユーザによって設定されＲＯＭ５４の所定領域に記憶している。そして、ＣＰＵ５６は、ＲＯＭ５４の所定の記憶領域に記憶された所定の設定値に従って、カウンタ５２１によって所定の最終値までカウント値が更新されたときに、カウンタ５２１が出力するカウント値の順列を変更するか否かを設定する。この実施の形態では、ＣＰＵ５６は、ステップＳ１５８において、カウンタ５２１が出力するカウント値の順列を変更すると判定すると、所定の最終値までカウント値が更新されたときにカウント値の順列を変更する旨を示すカウント値順列変更フラグをセットする。この実施の形態では、ステップＳ１５８において、所定の設定値に従ってカウント値順列変更フラグをセットする場合を説明する。そして、ＣＰＵ５６は、後述するカウント値順列変更処理において、カウント値順列変更フラグがセットされていることにもとづいて、カウンタ５２１が出力するカウント値の順列を変更する。

なお、ＣＰＵ５６の制御によってカウント値の順列を変更するのでなく、最終値までカウント値を更新したことにもとづいて、乱数回路５０３側でカウント値の順列変更するようにしてもよい。例えば、乱数回路５０３は、カウント値の順列を変更する旨を示す順列変更データを格納する順列変更データレジスタを備え、ＣＰＵ５６は、ステップＳ１５８において、順列変更データを順列変更データレジスタに設定する。この場合、カウンタ５２１が最終値までカウント値を更新すると、カウント値順列変更回路５２３は、順列変更データレジスタに順列変更データが設定されているか否かを確認する。そして、カウント値順列変更回路５２３は、順列変更データが設定されていることを確認すると、カウント値の順列を変更する。

そして、ＣＰＵ５６は、乱数回路設定プログラム５５１に含まれる乱数回路起動モジュール５５１ｄに従って処理を実行し、乱数回路起動データ「８０ｈ」を乱数回路起動レジスタ５４１に書き込む（ステップＳ１５９）。そのようにすることによって、ＣＰＵ５６は、乱数回路５０３を起動させる。

次に、乱数回路設定処理における乱数最大値再設定処理（ステップＳ１５３）を説明する。図４２は、乱数最大値再設定処理を示すフローチャートである。乱数最大値再設定処理において、ＣＰＵ５６は、乱数最大値設定レジスタ５３５に設定されている乱数最大値を読み込む（ステップＳ１５３ａ）。なお、タイマ割込処理の実行時に用いる乱数回路として１２ビット乱数回路５０３ａを設定した場合、ＣＰＵ５６は、１２ビット乱数回路５０３ａの乱数最大値設定レジスタ５３５に設定されている乱数最大値を読み込む。また、タイマ割込処理の実行時に用いる乱数回路として１６ビット乱数回路５０３ｂを設定した場合、ＣＰＵ５６は、１６ビット乱数回路５０３ｂの乱数最大値設定レジスタ５３５に設定されている乱数最大値を読み込む。

ＣＰＵ５６は、読み込んだ乱数最大値が所定の下限値以下であるか否かを判定する（ステップＳ１５３ｂ）。１２ビット乱数回路５０３ａを設定した場合、１２ビット乱数回路５０３ａにおいて設定可能な乱数最大値が「２５６」から「４０９５」までであるので、ＣＰＵ５６は、１２ビット乱数回路５０３ａの乱数最大値設定レジスタ５３５から読み込んだ乱数最大値が下限値「２５６」以下であるか否かを判定する。また、１６ビット乱数回路５０３ｂを設定した場合、１６ビット乱数回路５０３ｂにおいて設定可能な乱数最大値が「５１２」から「６５５３５」までであるので、ＣＰＵ５６は、１６ビット乱数回路５０３ｂの乱数最大値設定レジスタ５３５から読み込んだ乱数最大値が下限値「５１２」以下であるか否かを判定する。

読み込んだ乱数最大値が下限値以下である場合、ＣＰＵ５６は、乱数最大値設定レジスタ５３５に設定される乱数最大値を所定値に設定しなおす（ステップＳ１５３ｃ）。１２ビット乱数回路５０３ａを設定した場合、１２ビット乱数回路５０３ａの乱数最大値設定レジスタ５３５から読み込んだ乱数最大値が下限値「２５６」以下であると判定すると、ＣＰＵ５６は、乱数最大値設定レジスタ５３５に設定される乱数最大値を所定値「４０９５」に設定しなおす。また、１６ビット乱数回路５０３ｂを設定した場合、１６ビット乱数回路５０３ｂの乱数最大値設定レジスタ５３５から読み込んだ乱数最大値が下限値「５１２」以下であると判定すると、ＣＰＵ５６は、乱数最大値設定レジスタ５３５に設定される乱数最大値を所定値「６５５３５」に設定しなおす。

以上のように、乱数最大値設定レジスタ５３５に設定した乱数最大値が所定の下限値以下となっている場合には、乱数最大値を所定値に設定しなおす。そのため、遊技制御用マイクロコンピュータ５６０の誤動作や、無線信号を用いた取り込み信号を遊技機に対して発生させるなどの行為によって、過度に小さい値が乱数の最大値として設定されてしまうことを防止することができる。従って、最小値から最大値までの値の範囲が過度に小さい乱数を生成する事態が発生することを防止することができる。

次に、乱数回路設定処理における初期値変更処理（ステップＳ１５４）を説明する。図４３は、初期値変更処理を示すフローチャートである。初期値変更処理において、ＣＰＵ５６は、まず、ユーザプログラム実行データエリアの１Ｆ９７ｈ番地の領域に記憶されている初期値変更方式設定データを読み出し、ユーザによって選択された初期値変更方式を特定する。この場合、ＣＰＵ５６は、読み出した初期値変更方式設定データの値が「０１ｈ」であるか否かを判定することによって（ステップＳ１５４ａ）、ユーザによって選択された初期値変更方式を特定する。

初期値変更方式設定データの値が「０１ｈ」である場合、ＣＰＵ５６は、乱数回路５０３のカウンタ５２１に入力する初期値を、遊技制御用マイクロコンピュータ５６０固有のＩＤナンバにもとづいて設定された値に変更する（ステップＳ１５４ｂ）。例えば、遊技制御用マイクロコンピュータ５６０は、ＲＯＭ５４の所定の記憶領域に、遊技制御用マイクロコンピュータ５６０のＩＤナンバと、ＩＤナンバにもとづいて所定の演算を行って求めた演算値とを予め対応付けて記憶している。そして、ステップＳ１５４ｂにおいて、ＣＰＵ５６は、予め記憶するＩＤナンバにもとづく演算値にカウント値の初期値を変更させる。また、例えば、ステップＳ１５４ｂにおいて、ＣＰＵ５６は、遊技制御用マイクロコンピュータ５６０のＩＤナンバと所定値とを演算して（例えば、ＩＤナンバ（例えば、「１００」）に所定値（例えば、「１００」）を加算して）求めた演算値（例えば、「２００」）にカウント値の初期値を設定する。また、カウンタ５２１に入力する初期値を変更すると、ＣＰＵ５６は、カウント値の初期値を変更した旨を示す初期値変更フラグをセットする（ステップＳ１５４ｃ）。

なお、ＣＰＵ５６は、ステップＳ１５４ｂにおいてカウンタ５２１に入力する初期値を変更する際、乱数回路５０３の比較器５２２の乱数最大値設定レジスタ５３５の値を確認し、ＩＤナンバにもとづいて設定された値が乱数最大値以上であるか否かを判断する。そして、ＩＤナンバにもとづいて設定された値が乱数最大値以上であると判断すると、ＣＰＵ５６は、カウンタ５２１に入力する初期値を変更しない（例えば、初期値を「０」に設定しなおす）。そのようにすることによって、カウント値の初期値が乱数最大値以上の値に設定されてしまう事態を防止することができる。

ステップＳ１５４ａにおいて、初期値変更方式設定データの値が「０１ｈ」でない場合（すなわち、ユーザプログラム実行データエリアの１Ｆ９７ｈ番地の領域に記憶されている初期値変更方式設定データの値が「００ｈ」である場合）、ＣＰＵ５６は、カウント値の初期値の変更を行わず、そのまま初期値変更処理を終了し、ステップＳ１５５に移行する。

乱数回路設定処理が実行されることによって、遊技制御処理を含むタイマ割込処理の実行時に乱数回路５０３に各種信号が入力され、乱数回路５０３内で各種信号が生成される。図４４は、乱数回路５０３に各信号が入力されるタイミング、および乱数回路５０３内で各信号が生成されるタイミングを示すタイミングチャートである。

図４４に示すように、クロック回路５０１は、所定周期ごと（図４４に示すタイミングＴ１１，Ｔ２１，・・・）に、出力端子の信号レベルをローレベルからハイレベルに立ち上げることによって、乱数回路５０３に基準クロック信号ＣＬＫ（図４４（Ａ）参照）を入力する。

クロック信号出力回路５２４は、クロック回路５０１から供給された基準クロック信号ＣＬＫを分周し、乱数発生用クロック信号ＳＩ１（図４４（Ｂ）参照）を生成する。例えば、クロック信号出力回路５２４は、タイミングＴ１１，Ｔ１２，・・・で出力端子の信号レベルをローレベルからハイレベルに立ち上げ、タイミングＴ２１，Ｔ２２，・・・で信号レベルをハイレベルからローレベルに立ち下げることによって、乱数発生用クロック信号ＳＩ１を出力する。

なお、図４４に示す例では、説明を分かりやすくするために、クロック信号出力回路５２４が基準クロック信号ＣＬＫを２分周して乱数発生用クロック信号ＳＩ１を生成する場合を示している。しかし、実際の乱数回路では、周期設定レジスタ５３７に設定可能な周期は「システムクロック信号の周期×１２８×７」から「システムクロック信号の周期×１２８×２５６」まである。従って、実際の乱数回路では、クロック信号出力回路５２４は、「システムクロック信号の周期×１２８×７」から「システムクロック信号の周期×１２８×２５６」までの範囲で周期設定レジスタ５３７に設定される周期設定データ「０７ｈ」〜「ＦＦｈ」に対応した分周比で、基準クロック信号ＣＬＫを分周し乱数発生用クロック信号ＳＩ１を生成する。クロック信号出力回路５２４によって生成された乱数発生用クロック信号ＳＩ１は、セレクタ５２８と反転回路５３２とに出力される。

この実施の形態では、乱数回路設定処理において、第２の乱数更新方式が設定されるので、乱数更新方式選択信号出力回路５２７から第２の乱数更新方式選択信号がセレクタ５２８に入力される。セレクタ５２８は、乱数更新方式選択信号出力回路５２７から第２の乱数更新方式選択信号が入力されると、クロック信号出力回路５２４から入力した乱数発生用クロック信号ＳＩ１を選択してカウンタ５２１に出力する。カウンタ５２１は、セレクタ５２８から供給される乱数発生用クロック信号ＳＩ１の立ち上がりエッヂが入力されるごとに、カウント値Ｃを更新してカウント値順列変更回路５２３に出力する。

反転回路５３２は、クロック信号出力回路５２４から入力した乱数発生用クロック信号ＳＩ１の信号レベルを反転させることによって、反転クロック信号ＳＩ２（図４４（Ｃ）参照）を生成する。例えば、反転回路５３２は、タイミングＴ１１，Ｔ１２，・・・で出力端子の信号レベルをハイレベルからローレベルに立ち下げ、タイミングＴ２１，Ｔ２２，・・・で信号レベルをローレベルからハイレベルに立ち上げることによって、反転クロック信号ＳＩ２を出力する。また、反転回路５３２によって生成された反転クロック信号ＳＩ２は、ラッチ信号生成回路５３３に出力される。

ラッチ信号生成回路５３３には、入賞検出信号ＳＳ（図４４（Ｄ）参照）がタイマ回路５３４に入力されてから所定時間（例えば３ミリ秒）が経過すると、乱数値読取信号出力回路５２６から乱数値読取信号が入力される。例えば、乱数値読取信号出力回路５２６の出力端子の信号レベルがローレベルからハイレベルに立ち上がることによって、ラッチ信号生成回路５３３に乱数値読取信号が入力される。ラッチ信号生成回路５３３は、乱数更新方式選択信号出力回路５２７から第２の乱数更新方式選択信号が入力されたことに応じて、乱数値読取信号出力回路５２６から入力する乱数値読取信号を反転回路５３２から供給される反転クロック信号ＳＩ２の立ち上がりエッヂに同期させて、ラッチ信号ＳＬ（図４４（Ｅ）参照）を出力する。

以上のように、乱数回路５０３は、タイミングＴ１１，Ｔ１２，Ｔ１３・・・においてカウント値Ｃを更新し、タイミングＴ１１，Ｔ１２，Ｔ１３とは異なるタイミングＴ２２においてラッチ信号ＳＬを出力させ、乱数値記憶回路５３１に乱数値を記憶する。

次に、メイン処理におけるシリアル通信回路設定処理（ステップＳ１５ａ）を説明する。図４５は、シリアル通信回路設定処理を示すフローチャートである。シリアル通信回路設定処理において、ＣＰＵ５６は、まず、シリアル通信回路設定プログラム５５６に従って処理を実行し、シリアル通信回路５０５のボーレートを設定する（ステップＳ１５１１）。この場合、ＣＰＵ５６は、シリアル通信回路５０５のボーレートレジスタ７０２に、設定するボーレートに対応する設定値を書き込む。例えば、遊技制御用マイクロコンピュータ５６０は、ユーザ（例えば、遊技機の製作者）によって設定された設定値を指定する指定情報を、あらかじめＲＯＭ５４の所定の記憶領域に記憶している。そして、ＣＰＵ５６は、ＲＯＭ５４の所定の記憶領域に記憶された指定情報に従って、設定値をボーレートレジスタ７０２に書き込む。例えば、ＣＰＵ５６によってボーレート設定値「１５６」が設定された場合、ボーレート生成回路７０３によって、式（１）およびクロック周波数「３ＭＨｚ」を用いてボーレート「１２０１．９２ｂｐｓ」が生成される。

また、ＣＰＵ５６は、シリアル通信回路５０５が送受信するデータのデータフォーマットを設定する（ステップＳ１５１２）。この場合、ＣＰＵ５６は、制御レジスタＡ７０７の各ビットの値を設定することによって、送受信データのデータ長（８ビットまたは９ビット）、パリティ機能の使用の有無を設定する。例えば、遊技制御用マイクロコンピュータ５６０は、ユーザ（例えば、遊技機の製作者）によって設定された制御レジスタＡ７０７の各ビットの値を指定する指定情報を、あらかじめＲＯＭ５４の所定の記憶領域に記憶している。そして、ＣＰＵ５６は、ＲＯＭ５４の所定の記憶領域に記憶された指定情報に従って、制御レジスタＡ７０７の各ビットの値を設定する。

また、ＣＰＵ５６は、シリアル通信回路５０５が発生する各割込要求を許可するか否かを設定する（ステップＳ１５１３）。この場合、ＣＰＵ５６は、制御レジスタＢ７０８のビット５，６，７の値を設定することによって、送信時割り込み要求（データの送信時に行う割り込み要求である送信割り込み要求や、送信完了時に行う送信完了割り込み要求）および受信時割り込み要求を許可するか否かを設定する。なお、ＣＰＵ５６は、送信時割り込み要求と受信時割り込み要求との両方を許可するように設定することも可能であり、送信時割り込み要求と受信時割り込み要求とのいずれか一方のみを許可するように設定することも可能である。また、ＣＰＵ５６は、制御レジスタＣ７０９のビット０〜３の値を設定することによって、各通信エラー時割り込み要求を許可するか否かを設定する。例えば、遊技制御用マイクロコンピュータ５６０は、ユーザ（例えば、遊技機の製作者）によって設定された制御レジスタＢ７０８および制御レジスタＣ７０９の各ビットの値を指定する指定情報を、あらかじめＲＯＭ５４の所定の記憶領域に記憶している。そして、ＣＰＵ５６は、ＲＯＭ５４の所定の記憶領域に記憶された指定情報に従って、制御レジスタＢ７０８および制御レジスタＣ７０９の各ビットの値を設定する。

次に、遊技制御処理について説明する。図４６は、タイマ割込処理を示すフローチャートである。メイン処理の実行中に、具体的には、ステップＳ１７〜Ｓ１９のループ処理の実行中における割込許可になっている期間において、タイマ割込が発生すると、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、タイマ割込の発生に応じて起動されるタイマ割込処理において遊技制御処理を実行する。タイマ割込処理において、ＣＰＵ５６は、まず、電源断信号が出力されたか否か（オン状態になったか否か）を検出する電源断処理（電源断検出処理）を実行する（ステップＳ２０）。次いで、スイッチ回路５８を介して、ゲートスイッチ３２ａ、始動口スイッチ１４ａ、カウントスイッチ２３および入賞口スイッチ２９ａ，３０ａ，３３ａ，３９ａ等のスイッチの検出信号を入力し、それらの状態判定を行う（スイッチ処理：ステップＳ２１）。具体的には、各スイッチの検出信号を入力する入力ポートの状態がオン状態であれば、各スイッチに対応して設けられているスイッチタイマの値を＋１する。

次に、ＣＰＵ５６は、乱数回路設定処理において所定の最終値までカウント値が更新されたときに初期値を更新する旨の設定がされてるか（ステップＳ１５７参照）を確認し、乱数回路５０３のカウンタ５２１に入力する初期値を更新する処理を行う（乱数回路初期値更新処理：ステップＳ２２）。

次に、遊技制御に用いられる各判定用乱数を生成するための各カウンタのカウント値を更新する処理を行う（ステップＳ２３）。判定用乱数とは、大当りの種類を決定するための乱数（ソフトウェア乱数）である。この実施の形態では、判定用乱数として、大当りを発生させる特別図柄を決定するための大当り図柄決定用乱数や、普通図柄にもとづく当りを発生させるか否か決定するための普通図柄当り判定用乱数、確変を終了するか否かを決定するための確変終了判定用乱数、確変とするか否かを決定するための確変決定用乱数、時短とするか否かを決定するための時短決定用乱数、確変状態における特別図柄の変動回数を決定するための確変回数決定用乱数、大当り時における特別可変入賞球装置２０の開放回数（ラウンド数）を決定するためのラウンド数決定用乱数が用いられる。なお、判定用乱数として用いる乱数は、これらの乱数に限られない。例えば、大入賞口が複数（例えば２つ）ある場合には、判定用乱数として、大当り時に複数の大入賞口のうちいずれを開放するかを決定する乱数が用いられてもよい。また、例えば、判定用乱数として、大当り遊技状態において入賞したときに払い出す賞球数を決定するための乱数が用いられてもよい。

また、この実施の形態では、遊技制御手段は、各判定用乱数にもとづいて大当り（特定遊技状態）の種類を決定する。そして、遊技制御手段は、決定した大当りの種類に従って遊技状態を制御する。なお、この実施の形態において、「遊技状態を制御する」とは、例えば、判定用乱数にもとづいて決定した大当りの種類（特別図柄の種類（大当り図柄）やラウンド数、賞球数）に従って、大当り遊技状態を制御する（例えば、特別図柄表示装置８に特別図柄（大当り図柄）を表示させたり、特別可変入賞球装置２０の開放を、決定したラウンド数だけ継続させたり、大当り遊技状態において入賞したときに、決定した賞球数の遊技球を払い出したりする）ことである。また、例えば、判定用乱数にもとづいて決定した大当りの種類（確変とするか否か、時短とするか否か）に従って、大当り終了後に遊技状態を確変状態に移行させたり、時短状態に移行させたりすることである。

また、ＣＰＵ５６は、初期値用乱数を生成するためのカウンタのカウント値を更新する処理を行う（初期値用乱数更新処理：ステップＳ２４）。さらに、ＣＰＵ５６は、表示用乱数を生成するためのカウンタのカウント値を更新する処理を行う（表示用乱数更新処理：ステップＳ２５）。なお、判定用乱数がタイマ割込処理においてのみ更新されるのに対して（ステップＳ２３参照）、初期値用乱数は、タイマ割込処理において更新されるとともに（ステップＳ２４参照）、メイン処理におけるループ処理（ステップＳ１７〜Ｓ１９）においても更新される（ステップＳ１８ａ参照）。従って、判定用乱数と初期値用乱数とは異なる周期で更新されることになる。

図４７は、各乱数（ソフトウェア乱数）を示す説明図である。各乱数は、以下のように使用される。
（１）ランダム１：特別図柄のはずれ図柄決定用
（２）ランダム２：大当りを発生させる特別図柄を決定する（大当り図柄決定用）
（３）ランダム３：特別図柄の変動パターンを決定する（変動パターン決定用）
（４）ランダム４：大当りを発生させない場合にリーチとするか否かを決定する（リーチ判定用）
（５）ランダム５：普通図柄にもとづく当りを発生させるか否か決定する（普通図柄当り判定用）
（６）ランダム６：ランダム２の初期値を決定する（ランダム２初期値決定用）
（７）ランダム７：ランダム５の初期値を決定する（ランダム５初期値決定用）
（８）ランダム８：確変を終了するか否かを決定する（確変終了判定用）。すなわち、ランダム８が、０〜４９の範囲の値をとり、確変状態を終了させるか否か決めるための乱数として用いられる。遊技制御手段は、確変状態において、例えば、ランダム８があらかじめ決められている１つの値と一致した場合には、確変状態を終了させる。従って、確変状態は、１／５０の確率で終了（確変パンク）する。
（９）ランダム９：確変とするか否かを決定する（確変決定用）。すなわち、ランダム９が、０〜１６の範囲の値をとり、遊技状態を確変状態に移行させるか否かを決めるための乱数として用いられる。遊技制御手段は、例えば、ランダム９があらかじめ決められている値と一致した場合には、遊技状態を確変状態に移行させる。
（１０）ランダム１０：時短とするか否かを決定する（時短決定用）。すなわち、ランダム１０が、０〜１６の範囲の値をとり、遊技状態の時短状態に移行させるか否かを決めるための乱数として用いられる。遊技制御手段は、例えば、ランダム１０があらかじめ決められている値と一致した場合には、遊技状態を時短状態に移行させる。
（１１）ランダム１１：ランダム８の初期値を決定する（ランダム８初期値決定用）
（１２）ランダム１２：ランダム９の初期値を決定する（ランダム９初期値決定用）

この実施の形態では、確変状態への移行条件（ランダム９が所定の判定値と一致すること）が成立すると、遊技状態が確変状態に移行される。確変状態では、特別図柄や飾り図柄の変動の結果（最終停止図柄、単に停止図柄ともいう。）が大当り図柄となる確率が、確変状態でない状態（低確率状態）に比べて高められる。このことを、以下、「確変状態では高確率で当り／はずれが判定される」と表現することがある。この実施の形態では、確変状態では大当り図柄となる確率が１０倍に高められているとする。また、この実施の形態では、後述するように、遊技状態が確変状態に制御されている場合、遊技状態が確変状態であることを示す確変フラグがセットされる。

また、この実施の形態では、時短状態への移行条件（ランダム１０が所定の判定値と一致すること）が成立すると、遊技状態が時短状態に移行される。時短状態では、特別図柄や飾り図柄の変動時間（可変表示期間）が、時短状態でない場合に比べて短縮される。なお、短縮の態様（各変動パターンについてどの程度短くするのか、どの変動パターンを短くするのか等）は、確変状態における態様と同一でもよい。時短状態は、所定回の特別図柄の変動が終了するまで、または、大当りが発生するまで継続する。この実施の形態では、所定回は、１００回とするが、所定回を抽選によって複数種類のうちから選択してもよい。時短状態では、特別図柄の変動時間が短縮されるので、特別図柄の変動が開始される頻度が高くなり（換言すれば、保留記憶の消化が速くなる。）、結果として、大当り遊技が行われる可能性が高まる。また、この実施の形態では、後述するように、遊技状態が時短状態に制御されている場合、遊技状態が時短状態であることを示す時短フラグがセットされる。

さらに、この実施の形態では、確変状態への移行条件と時短状態への移行条件との双方が成立した場合、大当り遊技の終了後に、まず、優先的に確変状態に制御され、その後、所定条件の成立により時短状態に制御される。この実施の形態では、確変状態への移行条件と時短状態への移行条件との双方が成立し、優先的に確変状態に制御されている状態を確変時短状態ともいう。また、この実施の形態では、後述するように、遊技状態が確変時短状態に制御されている場合、確変フラグとともに、遊技状態が確変時短状態であることを示す確変時短フラグがセットされる。なお、遊技状態が確変時短状態に制御されている場合、確変フラグとともに、確変時短フラグに代えて、時短フラグがセットされるようにしてもよい。その場合、確変時短フラグは不要となり、確変フラグと時短フラグのみで確変状態や、時短状態、確変時短状態、通常状態を示すことができる。

なお、この実施の形態では、確変決定用乱数（ランダム９）が所定の判定値と一致したときに確変状態への移行条件が成立し、時短決定用乱数（ランダム１０）が所定の判定値と一致したときに時短状態への移行条件が成立する場合を説明するが、確変状態または時短状態への移行条件は、上記に示したものに限られない。例えば、停止時における特別図柄や飾り図柄の組み合わせが所定の大当り図柄（確変図柄）である場合に、確変状態への移行条件が成立し、停止時における特別図柄や飾り図柄の組み合わせが所定の大当り図柄（時短図柄）である場合に、時短状態への移行条件が成立するようにしてもよい。また、例えば、確変中に通常大当り（非確変かつ非時短大当り：確変状態や時短状態の終了条件を満たすこととなる大当り）が発生した場合に、時短状態への移行条件が成立したとして、大当り終了後に時短状態に移行させてもよい。

図４６に示された遊技制御処理におけるステップＳ２３では、ＣＰＵ５６は、（２）の大当り図柄決定用乱数、（５）の普通図柄当り判定用乱数、（８）の確変終了決定用乱数、（９）の確変決定用乱数、および（１０）の時短決定用乱数を生成するためのカウンタのカウントアップ（１加算）を行う。すなわち、それらが判定用乱数であり、それら以外の乱数が表示用乱数または初期値用乱数である。また、遊技効果を高めるために、上記（１）〜（１２）の乱数以外の普通図柄に関する乱数等も用いられていてもよい。

なお、遊技制御処理に用いる判定用乱数は、上記に示したものに限られない。例えば、確変状態を確変終了判定用乱数を用いた抽選により終了させるでなく、所定の確変継続回数に達すると、確変状態を終了させるようにしてもよい。この場合、遊技制御手段は、大当りとすると判定すると、判定用乱数として、確変継続回数（確変状態における特別図柄の変動回数）を決定する確変回数決定用乱数を用いて、確変継続回数を決定する。例えば、遊技制御手段は、確変回数決定用乱数の値に応じて、１００回、２００回、５００回または１０００回に確変継続回数を決定する。そして、遊技制御手段は、例えば、ステップＳ３０８の大当り終了処理において決定された確変継続回数をセットし、変動が実行されるごとにステップＳ３００やステップＳ３０４において回数を減算していき、確変回数決定用乱数を用いて決定した確変継続回数に達すると、確変状態を終了させる。また、確変終了決定用乱数と確変回数決定用乱数とを併用して用いてもよい。この場合、遊技制御手段は、ランダム８（確変終了決定用乱数）があらかじめ決められている１つの値と一致しなくても、確変回数決定用乱数を用いて決定した確変継続回数に達すると、確変状態を終了させる。

また、遊技制御手段は、判定用乱数として、大当り時における特別可変入賞球装置２０の開放回数（ラウンド数）を決定するラウンド数決定用乱数を用いて、ラウンド数を決定するようにしてもよい。例えば、遊技制御手段は、ラウンド数決定用乱数の値に応じて、２回、５回、１０回、または１５回にラウンド数を決定する。そして、遊技制御手段は、例えば、ステップＳ３０４の特別図柄停止処理において決定されたラウンド数をセットし、ステップＳ３０６やステップＳ３０７において、再び大入賞口を開放するか、大当りを終了させるか（ステップＳ３０５に移行させるか、ステップＳ３０８に移行させるか）を判断する際に、セットされたラウンド数と実行したラウンド数とが等しくなたか否かを判定し、等しくなったときにステップＳ３０８に移行させることにより、大当り時において、特別可変入賞球装置２０を、ラウンド数決定用乱数を用いて決定したラウンド数の回数だけ開放させる。

判定用乱数更新処理、初期値更新処理および表示用乱数更新処理を行うと、ＣＰＵ５６は、乱数回路５０３のカウンタ５２１が出力するカウント値の順列をカウント値順列変更回路５２３に変更させるカウント値順列変更処理を行う（ステップＳ２６）。この実施の形態では、乱数回路設定処理のステップＳ１５８でカウント値順列変更フラグがセットされているか否かによって、カウント値順列変更処理を実行するか否かが決定されている。そして、ＣＰＵ５６は、カウント値順列変更フラグがセットされていることにもとづいて、カウント値順列変更処理を実行する。

さらに、ＣＰＵ５６は、特別図柄プロセス処理を行う（ステップＳ２７）。特別図柄プロセス制御では、遊技状態に応じてパチンコ遊技機１を所定の順序で制御するための特別図柄プロセスフラグに従って該当する処理が選び出されて実行される。そして、特別図柄プロセスフラグの値は、遊技状態に応じて各処理中に更新される。また、普通図柄プロセス処理を行う（ステップＳ２８）。普通図柄プロセス処理では、普通図柄表示器１０の表示状態を所定の順序で制御するための普通図柄プロセスフラグに従って該当する処理が選び出されて実行される。そして、普通図柄プロセスフラグの値は、遊技状態に応じて各処理中に更新される。

次いで、ＣＰＵ５６は、特別図柄の変動に同期する飾り図柄に関する演出制御コマンドをＲＡＭ５５の所定の領域に設定して演出制御コマンドを送出する処理を行う（飾り図柄コマンド制御処理：ステップＳ２９）。なお、飾り図柄の変動が特別図柄の変動に同期するとは、変動時間（可変表示期間）が同じであることを意味する。

さらに、ＣＰＵ５６は、例えばホール管理用コンピュータに供給される大当り情報、始動情報、確率変動情報などのデータを出力する情報出力処理を行う（ステップＳ３０）。

また、ＣＰＵ５６は、入賞口スイッチ２９ａ，３０ａ，３３ａ，３９ａ等の検出信号にもとづく賞球個数の設定などを行う賞球処理を実行する（ステップＳ３１）。具体的には、入賞口スイッチ２９ａ，３０ａ，３３ａ，３９ａ等がオンしたことにもとづく入賞検出に応じて、払出制御基板３７に賞球個数を示す賞球個数コマンド等の払出指令コマンドを出力する。払出制御基板３７に搭載されている払出制御用マイクロコンピュータ３７０は、賞球個数を示す賞球個数コマンドの受信に応じて球払出装置９７を駆動する。

そして、ＣＰＵ５６は、保留記憶数の増減をチェックする記憶処理を実行する（ステップＳ３２）。また、遊技機の制御状態を遊技機外部で確認できるようにするための試験信号を出力する処理である試験端子処理を実行する（ステップＳ３３）。また、この実施の形態では、出力ポートの出力状態に対応したＲＡＭ領域（出力ポートバッファ）が設けられているのであるが、ＣＰＵ５６は、出力ポート２のＲＡＭ領域におけるソレノイドに関する内容を出力ポートに出力する（ステップＳ３４：出力処理）。その後、ＣＰＵ５６は、割込許可状態に設定し（ステップＳ３５）、処理を終了する。

この実施の形態では、遊技制御処理は定期的（例えば２ｍｓごと）に起動されることになる。なお、この実施の形態では、タイマ割込処理で遊技制御処理が実行されているが、タイマ割込処理では例えば割込が発生したことを示すフラグのセットのみがなされ、遊技制御処理はフラグがセットされたことにもとづいてメイン処理において実行されるようにしてもよい。

また、例えば、タイマ割込処理では遊技制御処理のうちスイッチ処理（ステップＳ２１参照）、初期値用乱数更新処理（ステップＳ２４参照）、飾り図柄コマンド制御処理（ステップＳ２９参照）、及び後述する割込回数カウント処理（ステップＳ３２０１ａ，Ｓ３２０２参照）のみを実行するようにし、遊技制御処理のうちの他の処理をメイン処理において実行するようにしてもよい。この場合、遊技制御用マイクロコンピュータ５６０は、メイン処理におけるステップＳ１７からステップＳ１９までのループ処理において、遊技制御処理のうち、ステップＳ２２からステップＳ２８（割込回数カウント処理を除く）、及びステップＳ３１からステップＳ３５（ステップＳ３３を除く）の処理を実行する。また、遊技制御用マイクロコンピュータのＣＰＵ５６は、タイマ割込処理において、割込回数をカウントした（ステップＳ３２０１ａ参照）あとに、タイマ割込処理の実行回数が所定回数（例えば、３回）に達したことを検出すると（ステップＳ３２０２参照）、乱数回路５０３から乱数値を読み出す条件が成立したと判断し、乱数値の読み出し条件が成立した旨を示す乱数読出フラグをセットする。また、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、メイン処理において、特別図柄プロセス処理（ステップＳ２７参照）における始動口スイッチ通過処理（ステップＳ３１２参照）の実行の際に、乱数読出フラグがセットされているか否かを判断し、乱数読出フラグがセットされていると判断すると、乱数回路５０３の乱数値記憶回路５３１に出力制御信号ＳＣを出力し（ステップＳ３２０３参照）、乱数値記憶回路５３１から乱数値として記憶されているランダムＲの値を読み出す（ステップＳ３２０４参照）。そして、ＣＰＵ５６は、メイン処理において、特別図柄プロセス処理（ステップＳ２７参照）における特別図柄通常処理（ステップＳ３００参照）の実行の際に、読み出した乱数値にもとづいて大当りとするか否かを決定することになる。なお、この実施の形態において、ステップＳ２１〜Ｓ３５の処理（ステップＳ３０およびＳ３３を除く）が、遊技の進行を制御する遊技制御処理に相当する。

次に、タイマ割込処理における乱数回路初期値更新処理（ステップＳ２２）について説明する。図４８は、乱数回路初期値更新処理を示すフローチャートである。乱数回路初期値更新処理において、ＣＰＵ５６は、乱数回路５０３のカウンタ５２１が出力するカウント値Ｃを最終値まで更新した旨を示す通知信号の状態を確認する（ステップＳ２２０）。通知信号がオン状態になっていることを検出した場合には、ＣＰＵ５６は、初期値更新フラグがセットされているか否かを確認する（ステップＳ２２１）。すなわち、ＣＰＵ５６は、乱数回路設定処理において、所定の最終値までカウント値が更新されたときに初期値を更新する旨の設定がなされたか否か（ステップＳ１５７参照）を確認する。

初期値更新フラグがセットされている場合、ＣＰＵ５６は、乱数回路５０３のカウンタ５２１が所定の最終値までカウント値を更新したときに、カウンタ５２１に入力する初期値を更新すると判断する。また、初期値更新フラグがセットされている場合、ＣＰＵ５６は、初期値変更フラグがセットされているか否かを確認する（ステップＳ２２２）。すなわち、ＣＰＵ５６は、カウント値の初期値が現在変更されているか否か（すなわち、遊技制御用マイクロコンピュータ５６０のＩＤナンバにもとづく値に変更されているか否か）を判断する。

初期値変更フラグがセットされている（すなわち、遊技制御用マイクロコンピュータ５６０のＩＤナンバにもとづく値に初期値が現在変更されている）場合、ＣＰＵ５６は、カウンタ５２１に入力する初期値を、遊技制御用マイクロコンピュータ５６０のＩＤナンバにもとづく値から元の値（例えば、「１」）にもどす（ステップＳ２２３）。そして、ＣＰＵ５６は、初期値変更フラグをリセットし（ステップＳ２２４）、初期値更新処理を終了する。

初期値変更フラグがセットされていない（すなわち、初期値が現在変更されていない）場合、ＣＰＵ５６は、カウンタ５２１に入力する初期値を、遊技制御用マイクロコンピュータ５６０のＩＤナンバにもとづく値に変更する（ステップＳ２２５）。この場合、例えば、遊技制御用マイクロコンピュータ５６０のＩＤナンバが「１００」であるとすると、カウンタ５２１に入力する初期値を、ＩＤナンバ「１００」に所定値「１００」を加算して求めた演算値「２００」に変更する。また、例えば、カウンタ５２１に入力する初期値を、ＩＤナンバ「１００」に所定値「５０」を減算して求めた演算値「５０」に変更する。そして、ＣＰＵ５６は、初期値変更フラグをセットし（ステップＳ２２６）、初期値更新処理を終了する。

なお、１２ビット乱数回路５０３ａおよび１６ビット乱数回路５０３ｂの両方を設定した場合、ステップＳ２２５において、ＣＰＵ５６は、一方の乱数回路（例えば、１２ビット乱数回路５０３ａ）から読み込んだ乱数を所定値としてＩＤナンバに加算して、カウンタ５２１に入力する初期値を求めてもよい。そして、ＣＰＵ５６は、他の一方（例えば、１６ビット乱数回路５０３ｂ）から読み込んだ乱数を、大当り判定用の乱数として用いてもよい。

なお、ＣＰＵ５６は、ステップＳ２２５においてカウンタ５２１に入力する初期値を更新する際、乱数回路５０３の比較器５２２の乱数最大値設定レジスタ５３５の値を確認し、ＩＤナンバにもとづいて設定された値が乱数最大値以上であるか否かを判断する。そして、ＩＤナンバにもとづいて設定された値が乱数最大値以上であると判断すると、ＣＰＵ５６は、カウンタ５２１に入力する初期値を所定値のまま更新しない（例えば、所定値「０」のまま更新しない）。そのようにすることによって、カウント値の初期値が乱数最大値以上の値に設定されてしまう事態を防止することができる。

なお、ステップＳ２２０において通知信号がオフ状態であると判断した場合、およびステップＳ２２１において初期値更新フラグがセットされていないと判断した場合、ＣＰＵ５６は、カウンタ５２１に入力する初期値を更新することなく、そのまま乱数回路初期値更新処理を終了し、ステップＳ２３に移行する。

次に、タイマ割込処理における判定用乱数更新処理（ステップＳ２３）について説明する。図４９および図５０は、判定用乱数更新処理を示すフローチャートである。判定用乱数更新処理において、ＣＰＵ５６は、まず、ランダム２（大当り図柄決定用乱数）を生成するためのカウンタを１加算する（ステップＳ２３０１）。そして、そのカウンタのカウント値が「１０」よりも小さいかどうか判定する（ステップＳ２３０２）。小さくなければ、すなわち、１０に達していればその値を「０」に戻す（ステップＳ２３０３）。さらに、ＣＰＵ５６は、ランダム２を生成するためのカウンタのカウント値が初期値バッファに設定されている値と一致したか否か確認する（ステップＳ２３０４）。一致していたら、ランダム６を生成するためのカウント値を読み出して初期値決定用乱数を抽出し、その乱数値をランダム２を生成するためのカウンタに設定するとともに（ステップＳ２３０５）、初期値バッファにも格納する（ステップＳ２３０６）。

ステップＳ２３０４〜Ｓ２３０６の処理によって、ランダム２を生成するためのカウンタのカウント値は、１周するたびに（１０カウントするたびに）、設定値（初期値）が変更され、ランダム２のランダム性がより向上する。

次いで、ＣＰＵ５６は、ランダム５（普通図柄当り判定用乱数）を生成するためのカウンタを１加算する（ステップＳ２３０７）。そして、そのカウンタのカウント値が「１４」に達しているかどうか判定する（ステップＳ２３０８）。達していれば、その値を「３」に戻す（ステップＳ２３０９）。すなわち、ランダム５を生成するためのカウンタのカウント値がとりうる範囲は、３〜１３である。さらに、ＣＰＵ５６は、ランダム５を生成するためのカウンタのカウント値が初期値バッファに設定されている値と一致したか否か確認する（ステップＳ２３１０）。一致していたら、ランダム７を生成するためのカウント値を読み出して初期値決定用乱数を抽出し、その乱数値をランダム５を生成するためのカウンタに設定するとともに（ステップＳ２３１１）、初期値バッファにも格納する（ステップＳ２３１２）。

ステップＳ２３１０〜Ｓ２３１２の処理によって、ランダム５を生成するためのカウンタのカウント値は、１周するたびに（３から１３まで１１カウントするたびに）、設定値（初期値）が変更され、ランダム５のランダム性がより向上する。

次いで、ＣＰＵ５６は、ランダム８（確変終了判定用乱数）を生成するためのカウンタを１加算する（ステップＳ２３１３）。そして、そのカウンタのカウント値が「５０」に達しているかどうか判定する（ステップＳ２３１４）。達していれば、その値を「０」に戻す（ステップＳ２３１５）。さらに、ＣＰＵ５６は、ランダム８を生成するためのカウンタのカウント値が初期値バッファに設定されている値と一致したか否か確認する（ステップＳ２３１６）。一致していたら、ランダム１１を生成するためのカウント値を読み出して初期値決定用乱数を抽出し、その乱数値をランダム８を生成するためのカウンタに設定するとともに（ステップＳ２３１７）、初期値バッファにも格納する（ステップＳ２３１８）。

ステップＳ２３１６〜Ｓ２３１８の処理によって、ランダム８を生成するためのカウンタのカウント値は、１周するたびに（５１カウントするたびに）、設定値（初期値）が変更され、ランダム８のランダム性がより向上する。

次いで、ＣＰＵ５６は、ランダム９（確変決定用乱数）を生成するためのカウンタを１加算する（ステップＳ２３１９）。そして、そのカウンタのカウント値が「１７」に達しているかどうか判定する（ステップＳ２３２０）。達していれば、その値を「０」に戻す（ステップＳ２３２１）。さらに、ＣＰＵ５６は、ランダム９を生成するためのカウンタのカウント値が初期値バッファに設定されている値と一致したか否か確認する（ステップＳ２３２２）。一致していたら、ランダム１２を生成するためのカウント値を読み出して初期値決定用乱数を抽出し、その乱数値をランダム９を生成するためのカウンタに設定するとともに（ステップＳ２３２３）、初期値バッファにも格納する（ステップＳ２３２４）。

ステップＳ２３２２〜Ｓ２３２４の処理によって、ランダム９を生成するためのカウンタのカウント値は、１周するたびに（１７カウントするたびに）、設定値（初期値）が変更され、ランダム９のランダム性がより向上する。

次いで、ＣＰＵ５６は、ランダム１０（時短決定用乱数）を生成するためのカウンタを１加算する（ステップＳ２３２５）。そして、そのカウンタのカウント値が「１７」に達しているかどうか判定する（ステップＳ２３２６）。達していれば、その値を「０」に戻す（ステップＳ２３２７）。

なお、判定用乱数として、確変回数決定用乱数やラウンド数決定用乱数を用いる場合には、判定用乱数更新処理において、ＣＰＵ５６は、確変回数決定用乱数やラウンド数決定用乱数の更新も行う。この場合、例えば、ＣＰＵ５６は、確変回数決定用乱数を生成するためのカウンタを１加算する。そして、ＣＰＵ５６は、そのカウンタのカウント値が所定値（例えば、「４」）に達しているかどうか判定し、達していれば、その値を「０」に戻す。また、ＣＰＵ５６は、ラウンド数決定用乱数を生成するためのカウンタを１加算する。そして、ＣＰＵ５６は、そのカウンタのカウント値が所定値（例えば、「４」）に達しているかどうか判定し、達していれば、その値を「０」に戻す。さらに、ＣＰＵ５６は、確変回数決定用乱数やラウンド数決定用乱数を生成するためのカウンタのカウント値が初期値バッファに設定されている値と一致したか否か確認する。一致していたら、確変回数決定用乱数やラウンド数決定用乱数の初期値用乱数を生成するためのカウント値を読み出して、その乱数値を確変回数決定用乱数やラウンド数決定用乱数を生成するためのカウンタに設定するとともに、初期値バッファにも格納する。

次に、タイマ割込処理における初期値用乱数更新処理（ステップＳ２４）について説明する。図５１は、初期値決定用乱数更新処理を示すフローチャートである。初期値決定用乱数更新処理において、ＣＰＵ５６は、ランダム６（ランダム２用の初期値決定用乱数）を生成するためのカウンタを１加算する（ステップＳ２４０１）。そして、そのカウンタのカウント値が「１０」に達しているかどうか判定する（ステップＳ２４０２）。達していれば、その値を「０」に戻す（ステップＳ２４０３）。

また、ＣＰＵ５６は、ランダム７（ランダム５用の初期値決定用乱数）を生成するためのカウンタを１加算する（ステップＳ２４０４）。そして、そのカウンタのカウント値が「１４」に達しているかどうか判定する（ステップＳ２４０５）。達していれば、その値を「３」に戻す（ステップＳ２４０６）。すなわち、ランダム７を生成するためのカウンタのカウント値がとりうる範囲は、３〜１３である。

また、ＣＰＵ５６は、ランダム１１（ランダム８用の初期値決定用乱数）を生成するためのカウンタを１加算する（ステップＳ２４０７）。そして、そのカウンタのカウント値が「５０」に達しているかどうか判定する（ステップＳ２４０８）。達していれば、その値を「０」に戻す（ステップＳ２４０９）。

また、ＣＰＵ５６は、ランダム１２（ランダム９用の初期値決定用乱数）を生成するためのカウンタを１加算する（ステップＳ２４１０）。そして、そのカウンタのカウント値が「１７」に達しているかどうか判定する（ステップＳ２４１１）。達していれば、その値を「０」に戻す（ステップＳ２４１２）。

次に、タイマ割込処理におけるカウント値順列変更処理（ステップＳ２６）について説明する。図５２は、カウント値順列変更処理を示すフローチャートである。ＣＰＵ５６は、カウント値順列変更プログラム５５４に従って処理を実行することによって、カウント値順列変更処理を行う。カウント値順列変更処理において、ＣＰＵ５６は、乱数回路５０３のカウンタ５２１が出力するカウント値Ｃを最終値まで更新した旨を示す通知信号の状態を確認する（ステップＳ２４１）。通知信号がオン状態になっていることを検出した場合には、ＣＰＵ５６は、カウント値順列変更フラグがセットされているか否かを確認する（ステップＳ２４２）。すなわち、ＣＰＵ５６は、乱数回路設定処理において、所定の最終値までカウント値が更新されたときにカウンタ５２１が更新するカウント値の順列を変更する旨の設定がなされたか否か（ステップＳ１５８参照）を確認する。

カウント値順列変更フラグがセットされている場合、ＣＰＵ５６は、乱数回路５０３のカウンタ５２１が所定の最終値までカウント値を更新したときに、カウンタ５２１が更新するカウント値の順列を変更すると判断する。そして、ＣＰＵ５６は、カウント値順列変更レジスタ５３６にカウント値順列変更データ「０１ｈ」を書き込む（ステップＳ２４３）。すなわち、ＣＰＵ５６は、カウント値順列変更データ「０１ｈ」を書き込むことによって、乱数値記憶回路５３１に入力されるカウント値Ｃの順列をカウント値順列変更回路５２３に変更させる。

以上のように、カウント値順列変更処理において、乱数を所定の最終値まで更新したときに、カウンタ５２１が更新するカウント値の順列を変更するので、乱数回路５０３が生成する乱数のランダム性をより向上させることができる。

次に、メイン処理における特別図柄プロセス処理（ステップＳ２７）を説明する。図５３は、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６が実行する特別図柄プロセス処理のプログラムの一例を示すフローチャートである。遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、特別図柄プロセス処理を行う際に、変動短縮タイマ減算処理（ステップＳ３１０）を行い、遊技盤６に設けられている始動入賞口１４に遊技球が入賞したことを検出するための始動口スイッチ１４ａがオンしていたら、すなわち遊技球が始動入賞口１４に入賞する始動入賞が発生していたら（ステップＳ３１１）、始動口スイッチ通過処理（ステップＳ３１２）を行った後に、内部状態に応じて、ステップＳ３００〜Ｓ３０８のうちのいずれかの処理を行う。変動短縮タイマは、特別図柄の変動時間が短縮される場合に、変動時間を設定するためのタイマである。

特別図柄通常処理（ステップＳ３００）：特別図柄の可変表示を開始できる状態（例えば、特別図柄表示器８において図柄の変動がなされておらず、特別図柄表示器８における前回の図柄変動が終了してから所定期間が経過しており、かつ、大当り遊技中でもない状態）になるのを待つ。特別図柄の可変表示が開始できる状態になると、特別図柄についての始動入賞記憶数を確認する。始動入賞記憶数が０でなければ、特図保留メモリ５７０に記憶されている乱数回路５０３が発生したランダムＲにもとづいて、特別図柄の可変表示の結果を大当りとするか否か決定する。そして、内部状態（特別図柄プロセスフラグ）をステップＳ３０１に移行するように更新する。

特別図柄停止図柄設定処理（ステップＳ３０１）：特別図柄の可変表示後の停止図柄を決定する。そして、内部状態（特別図柄プロセスフラグ）をステップＳ３０２に移行するように更新する。

変動時間設定処理（ステップＳ３０２）：変動パターンを決定し、その変動パターンにおける変動時間（可変表示時間：可変表示を開始してから表示結果が導出表示（停止表示）するまでの時間）を特別図柄の可変表示の変動時間とすることに決定する。また、決定した特別図柄の変動時間を計測する変動時間タイマをスタートさせる。そして、内部状態（特別図柄プロセスフラグ）をステップＳ３０３に移行するように更新する。

特別図柄変動処理（ステップＳ３０３）：所定時間（ステップＳ３０２の変動時間タイマで示された時間）が経過すると、内部状態（特別図柄プロセスフラグ）をステップＳ３０４に移行するように更新する。

特別図柄停止処理（ステップＳ３０４）：演出制御基板８０に対して、飾り図柄の停止を指示するための飾り図柄停止コマンドを送信する。また、特別図柄表示器８における特別図柄を停止させる。そして、特別図柄の停止図柄が大当り図柄である場合には、内部状態（特別図柄プロセスフラグ）をステップＳ３０５に移行するように更新する。そうでない場合には、内部状態をステップＳ３００に移行するように更新する。なお、飾り図柄停止コマンドを送信しない構成としてもよい。この場合、演出制御基板８０は、主基板３１からの変動パターンコマンドにもとづいて変動時間タイマに変動時間を設定するとともに、その変動時間タイマを更新していくことで飾り図柄の変動時間を独自に監視し、その変動時間が経過したと判定したときに飾り図柄を停止する処理を行うようにすればよい。

大入賞口開放前処理（ステップＳ３０５）：大入賞口を開放する制御を開始する。具体的には、カウンタ（例えば大入賞口に入った遊技球数をカウントするカウンタ）やフラグ（入賞口への入賞を検出する際に用いられるフラグ）を初期化するとともに、ソレノイド２１を駆動して大入賞口を開放する。また、プロセスタイマによって大入賞口開放中処理の実行時間を設定し、大当り中フラグをセットする。そして、内部状態（特別図柄プロセスフラグ）をステップＳ３０６に移行するように更新する。

大入賞口開放中処理（ステップＳ３０６）：大入賞口ラウンド表示の演出制御コマンドを演出制御基板８０に送出する制御や大入賞口の閉成条件（例えば、大入賞口に所定個数（例えば１０個）の遊技球が入賞したこと）の成立を確認する処理等を行う。大入賞口の閉成条件が成立したら、内部状態をステップＳ３０７に移行するように更新する。

特定領域有効時間処理（ステップＳ３０７）：Ｖ入賞スイッチ２２の通過の有無を監視して、大当り遊技状態継続条件の成立を確認する処理を行う。大当り遊技状態継続の条件が成立し、かつ、まだ残りラウンドがある場合には、内部状態をステップＳ３０５に移行するように更新する。また、所定の有効時間内に大当り遊技状態継続条件が成立しなかった場合、または、全てのラウンドを終えた場合には、内部状態をステップＳ３０８に移行するように更新する。

大当り終了処理（ステップＳ３０８）：大当り遊技状態が終了したことを遊技者に報知する表示制御を演出制御手段に行わせるための制御を行う。そして、内部状態をステップＳ３００に移行するように更新する。

図５４は、始動口スイッチ通過処理（ステップＳ３１２）を示すフローチャートである。始動口スイッチ通過処理において、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、始動入賞カウンタが示す始動入賞記憶数（または特図保留メモリ５７０が記憶している始動入賞記憶数）が最大値である４に達しているかどうか確認する（ステップＳ３２０１）。始動入賞記憶数が４に達していなければ、ＣＰＵ５６は、タイマ割込処理を実行した回数を示す割込回数カウンタの値を１加算する（ステップＳ３２０１ａ）。すなわち、ＣＰＵ５６は、タイマ割込処理を実行した回数をカウントする処理を実行する。この実施の形態では、ＣＰＵ５６は、ステップＳ３２０１ａを実行することによって、タイマ割込処理を実行するごとに、タイマ割込処理を実行した回数を示す割込回数カウンタをカウントアップする。割込回数カウンタの値を１加算すると、ＣＰＵ５６は、割込実行回数カウンタに示されるタイマ割込処理の実行回数が所定回数（例えば、３回）に達しているか否かを確認する（ステップＳ３２０２）。なお、タイマ割込処理の実行回数が所定回数に達すると、ステップＳ３２０７で、ＣＰＵ５６は、割込実行回数カウンタをリセットする。そして、ＣＰＵ５６は、遊技球が始動入賞口１４に入賞したあと、割込実行回数カウンタが所定回数に達しているか否かを確認する。

ステップＳ３２０２において所定回数としてあらかじめ設定される値は、以下のように定められる。前述のように、乱数回路５０３のタイマ回路５３４は、始動口スイッチ１４ａから入賞検出信号ＳＳが継続して入力されている時間を計測し、計測時間が所定期間になったことを検出すると、乱数値取り込みデータ「０１ｈ」を書き込む。この実施の形態では、タイマ回路５３４が計測する所定期間（例えば、３ｍｓ）が、所定回数のタイマ割込処理が実行される期間（例えば、２ｍｓごとのタイマ割込処理を３回実行する場合は６ｍｓ）よりも短くなるように、ステップＳ３２０２において用いる所定回数（例えば、３回）が設定される。そのように設定することによって、乱数を読み出してから、乱数値記憶回路５３１に記憶される乱数の値が更新される前に再び乱数を読み出してしまうことを防止することができ、前回乱数値記憶回路５３１から読み出した乱数と同じ値の乱数を再び読み出してしまうことを防止することができる。なお、タイマ回路５３４が入賞検出信号ＳＳの入力時間を計測するのでなく、ＣＰＵ５６が入賞検出信号ＳＳの入力時間を計測し、乱数値取り込みデータ「０１ｈ」を乱数値取込レジスタ５３９に書き込むようにしてもよい。

タイマ割込処理の実行回数が所定回数に達している場合、ＣＰＵ５６は、特定した乱数回路５０３の乱数値記憶回路５３１に出力制御信号ＳＣを出力し、乱数値記憶回路５３１を読出可能（イネイブル）状態に制御する（ステップＳ３２０３）。

ＣＰＵ５６は、乱数回路５０３の乱数値記憶回路５３１から、乱数値として記憶されているランダムＲの値を読み出す（ステップＳ３２０４）。また、ＣＰＵ５６は、読み出したランダムＲの値を、始動入賞記憶数の値に対応した保存領域（特別図柄判定用バッファ（特図保留メモリ５７０））に格納する（ステップＳ３２０５）。また、ＣＰＵ５６は、ランダムＲの値をバッファ領域に格納すると、乱数値記憶回路５３１への出力制御信号ＳＣの出力を停止し、乱数値記憶回路５３１を読出不能（ディセイブル）状態に制御する（ステップＳ３２０６）。また、ＣＰＵ５６は、割込実行回数カウンタをリセットする（ステップＳ３２０７）。そして、ＣＰＵ５６は、所定のバッファ領域に格納したランダムＲの値を特図保留メモリ５７０の空エントリの先頭にセットし（ステップＳ３２０８）、始動入賞カウンタのカウント数を１加算することで始動入賞記憶数を１増やす（ステップＳ３２０９）。

また、ＣＰＵ５６は、判定用乱数や表示用乱数などの各乱数（ソフトウェア乱数）の値を抽出し、それらを始動入賞記憶数の値に対応した保存領域（特別図柄判定用バッファ）に格納する（ステップＳ３２１０）。なお、乱数を抽出するとは、乱数を生成させるためのカウンタからカウント値を読み出して、読み出したカウント値を乱数値とすることである。ステップＳ３２１０では、図４７に示された乱数のうち、ランダム１〜ランダム４，ランダム８〜ランダム１１、ランダム１４が抽出される。

そして、ＣＰＵ５６は、変動時間を短縮するか否かの判定を行うための変動時間短縮判定時間を変動短縮タイマにセットする（ステップＳ３２１１）。なお、上述したように、ここでセットされた変動短縮タイマはステップＳ３１０にて減算される。

ステップＳ３２０１において始動入賞記憶するが最大値である４に達している場合、およびステップＳ３２０２においてタイマ割込処理の実行回数が所定回数に達してない場合、そのまま始動口スイッチ通過処理を終了する。

以上のように、始動口スイッチ通過処理において、乱数値記憶回路５３１からランダムＲを読み出すにあたって、タイマ割込処理が所定回数実行されたこと（すなわち、タイマ割込処理が所定回数実行される間継続して入賞検出信号ＳＳが入力されたこと）を条件に、乱数値記憶回路５３１から乱数を読み出す。そのため、乱数を読み出してから、乱数値記憶回路５３１に記憶される乱数の値が更新される前に再び乱数を読み出してしまうことを防止することができる。また、前回乱数値記憶回路５３１から読み出した乱数と同じ値の乱数を再び読み出してしまうことを防止することができる。

次に、特別図柄プロセス処理における特別図柄通常処理（ステップＳ３００）について説明する。図５５および図５６は、特別図柄通常処理を示すフローチャートである。特別図柄通常処理において、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、特別図柄の変動を開始することができる状態（例えば特別図柄プロセスフラグの値がステップＳ３００を示す値となっている場合）には（ステップＳ３３０１）、始動入賞記憶数（保留記憶数）の値を確認する（ステップＳ３３０２）。具体的には、始動入賞記憶カウンタのカウント値を確認する。なお、特別図柄プロセスフラグの値がステップＳ３００を示す値となっている場合とは、可変表示装置９において図柄の変動がなされていず、かつ、大当り遊技中でもない場合である。また、ステップＳ３３０１で変動開始不可能である場合や、ステップＳ３３０２で保留記憶数が０である場合には、ＣＰＵ５６は、そのまま特別図柄通常処理を終了する。

保留記憶数が０でなければ、保留記憶数＝１に対応する保存領域に格納されている各乱数値（ランダムＲや各判定用乱数、表示用乱数）を読み出してＲＡＭ５５の乱数バッファ領域に格納するとともに（ステップＳ３３０３）、保留記憶数の値を１減らし（始動入賞記憶カウンタの値を１減らし）、かつ、各保存領域の内容をシフトする（ステップＳ３３０４）。すなわち、保留記憶数＝ｎ（ｎ＝２，３，４）に対応する保存領域に格納されている各乱数値を、保留記憶数＝ｎ−１に対応する保存領域に格納する。よって、各保留記憶数に対応するそれぞれの保存領域に格納されている各乱数値が抽出された順番は、常に、保留記憶数＝１，２，３，４の順番と一致するようになっている。すなわち、この例では、ＣＰＵ５６は、可変表示の開始条件が成立する毎に、各保存領域の内容をシフトする処理を実行する。

また、ＣＰＵ５６は、確変終了とするか否かの判定を行う（ステップＳ３３０５〜Ｓ３３０７）。具体的には、確変フラグがセットされている場合（確変時短フラグがセットされている場合を含む）には（ステップＳ３３０５）、ＣＰＵ５６は、確変終了判定用乱数（ランダム８）を保存領域から読み出して（ステップＳ３３０６）、読み出したランダム８の値が、確変終了値と一致するか否か判定し（ステップＳ３３０７）、一致する場合には、確変フラグや確変時短フラグをリセットして確変状態を終了させる（ステップＳ３３１１，Ｓ３３１２）。従って、ランダム８の値にもとづいて確変状態が終了したときに、ステップＳ３３１９の大当り判定において低確率状態にもとづく抽選が実行される。なお、ステップＳ３３０５で確変フラグがセットされていない場合には、ＣＰＵ５６は、そのままステップＳ３３１６に移行し、大当り判定処理を行う。

なお、この実施の形態では、遊技状態が確変状態に制御されている場合には、確変フラグのみがセットされているので、ステップＳ３３１１およびステップＳ３３１２において、ＣＰＵ５６は、確変フラグのみのリセットを行い確変状態を終了させることになる。また、遊技状態が確変時短状態に制御されている場合には、確変フラグと確変時短フラグの双方がセットされているので、ステップＳ３３１１およびステップＳ３３１２において、ＣＰＵ５６は、確変フラグおよび確変時短フラグの双方をリセットすることになる。

確変フラグや確変時短フラグをリセットすると、ＣＰＵ５６は、時短回数カウンタの値が０になっているか否かを確認する（ステップＳ３３１３）。時短回数カウンタの値が０になっている場合には、ＣＰＵ５６は、通常表示指定の演出制御コマンド（通常表示指定コマンド）を演出制御手段（演出制御基板８０）に送信する処理を実行し（ステップＳ３３１５）、ステップＳ３３１６に移行する。なお、時短回数カウンタは、あと何回の特別図柄の変動がなされたら時短状態が終了するのかを示す回数（可変表示可能回数）が設定されているカウンタである。演出制御用ＣＰＵ１０１は、通常表示指定コマンドを受信すると、音、表示、発光体などを用いた演出を停止し、確変状態または時短状態（確変時短状態を含む）である旨の報知を終了する。

時短回数カウンタの値が０になっていない場合には、ＣＰＵ５６は、時短フラグをセットし、遊技状態を時短状態に移行させ（ステップＳ３３１４）、ステップＳ３３１６に移行する。すなわち、確変時短状態において、確変の終了条件が成立したが時短継続回数が残っているので、ＣＰＵ５６は、遊技状態を確変状態から時短状態に移行させる。なお、遊技状態が確変状態に制御されており、ステップＳ３３１１およびステップＳ３３１２において確変フラグのみのリセットを行った場合には、そのままステップＳ３３１５に移行し、ＣＰＵ５６は、通常表示指定コマンドを演出制御手段に送信する処理を実行することになる。

ステップＳ３３０７において、確変終了としないと判定した場合（すなわち、読み出したランダム８の値が確変終了値と一致しなかった場合）、ＣＰＵ５６は、確変時短フラグがセットされているか否かを確認する（ステップＳ３３０８）。確変時短フラグがセットされている場合、ＣＰＵ５６は、時短回数カウンタの値が０になっているか否かを確認する（ステップＳ３３０９）。時短回数カウンタの値が０になっている場合には、ＣＰＵ５６は、通常表示指定コマンドを演出制御手段に送信する処理を実行し（ステップＳ３３１０）、ステップＳ３３１６に移行する。演出制御用ＣＰＵ１０１は、通常表示指定コマンドを受信すると、確変状態または時短状態（確変時短状態を含む）である旨の報知を終了する。なお、ステップＳ３３０９において、時短回数カウンタが０になっている場合、ＣＰＵ５６は、確変時短フラグをリセットし（すなわち、確変フラグのみがセットされている状態にし）、遊技状態を確変時短状態から確変状態に移行する。また、ステップＳ３３０８において確変時短フラグがセットされていなかった場合や、ステップＳ３３０９において、時短回数カウンタが０でない場合、ＣＰＵ５６は、そのままステップＳ３３１６に移行する。

また、ＣＰＵ５６は、確変フラグがセットされているか否かを確認する（ステップＳ３３１６）。すなわち、ＣＰＵ５６は、遊技状態が確変状態に制御されているか否かを確認する。この場合、ステップＳ３３０７で確変状態を終了しないと判定した場合、遊技状態が確変状態に制御されていることになる。また、ステップＳ３３０５で確変フラグがセットされていなかった場合や、ステップＳ３３０７で確変状態を終了すると判定した場合、遊技状態が確変状態以外の通常状態（時短状態を含む）に制御されていることになる。

確変フラグがセットされていない場合、ＣＰＵ５６は、遊技状態が確変状態以外の通常状態であると判断し、特別図柄表示装置８の表示結果を大当り図柄とするか否かを判定するために用いるテーブルとして、通常時大当り判定テーブル５７１ａ（図３７（Ａ）参照）を設定する（ステップＳ３３１７）。また、確変フラグがセットされている場合、ＣＰＵ５６は、遊技状態が確変状態であると判断し、特別図柄表示装置８の表示結果を大当り図柄とするか否かを判定するために用いるテーブルとして、確変時大当り判定テーブル５７１ｂ（図３７（Ｂ）参照）を設定する（ステップＳ３３１８）。

ＣＰＵ５６は、乱数バッファ領域に格納したランダムＲの値にもとづいて、特別図柄表示装置８の表示結果を大当り図柄とするか否かを判定する（ステップＳ３３１９）。この場合、ＣＰＵ５６は、ステップＳ３３１７で設定した通常時大当り判定テーブル５７１ａまたはステップＳ３３１８で設定した確変時大当り判定テーブル５７１ｂを用いて、大当りとするか否かを判定する。また、特別図柄表示装置８の表示結果を大当り図柄とすると決定すると、ＣＰＵ５６は、大当り状態であることを示す大当りフラグをオン状態にする（ステップＳ３３２０）。

なお、判定用乱数としてのラウンド数決定用乱数を用いてラウンド数の決定を行う場合には、例えば、ステップＳ３３２０において、ＣＰＵ５６は、大当りフラグをオン状態にするとともに、ラウンド数決定用乱数を用いてラウンド数を決定してもよい。例えば、ＣＰＵ５６は、ラウンド数決定用乱数の値に応じて、２回、５回、１０回、または１５回にラウンド数を決定する。

また、ＣＰＵ５６は、大当りとすることに決定すると、確変とするか否かを判定する確変判定処理を行う（ステップＳ３３２１〜Ｓ３３２４）。ＣＰＵ５６は、乱数格納バッファから確変決定用乱数を読み出し（ステップＳ３３２１）、確変判定モジュールを実行する（ステップＳ３３２２）。確変とすることに決定した場合には（ステップＳ３３２３）、ＣＰＵ５６は、確変決定フラグをセットする（ステップＳ３３２４）。なお、確変決定フラグは、確変状態への移行条件を成立させることを決定したことを示すフラグである。また、確変判定モジュールは、確変決定用乱数が、あらかじめ決められている確変判定値と一致したら確変状態への移行条件を成立させることに決定するプログラムである。

なお、パンク抽選でなく所定の確変継続回数に達したときに確変状態を終了させる場合には、例えば、ステップＳ３３２４において、ＣＰＵ５６は、確変決定フラグをセットするとともに、判定用乱数としての確変回数決定用乱数を用いて確変継続回数を決定する。例えば、ＣＰＵ５６は、確変回数決定用乱数の値に応じて、１００回、２００回、５００回または１０００回に確変継続回数を決定する。

また、ＣＰＵ５６は、時短とするか否かを判定する時短判定処理を行う（ステップＳ３３２５〜Ｓ３３２８）。ＣＰＵ５６は、乱数格納バッファから時短決定用乱数を読み出し（ステップＳ３３２５）、時短判定モジュールを実行する（ステップＳ３３２６）。時短とすることに決定した場合には（ステップＳ３３２７）、ＣＰＵ５６は、時短決定フラグをセットする（ステップＳ３３２８）。そして、特別図柄プロセスフラグの値を特別図柄停止図柄設定処理に対応した値に更新する（ステップＳ３３２９）。なお、時短決定フラグは、時短状態への移行条件を成立させることを決定したことを示すフラグである。また、時短判定モジュールは、時短決定用乱数が、あらかじめ決められている時短判定値と一致したら時短状態への移行条件を成立させることに決定するプログラムである。

以上のように、ステップＳ３３１９においてランダムＲにもとづいて大当りとすると判定すると、ＣＰＵ５６は、確変決定用乱数を読み出して（ステップＳ３３２１参照）、確変とするか否かを判定する（ステップＳ３３２２，Ｓ３３２３参照）。例えば、大当り判定と確変判定とをともにソフトウェア乱数を用いて行う場合、無線信号などを用いた取り込み信号を遊技機に対して発生させたり入力したりことによって（例えば、不正信号によってソフトウェア乱数の初期値を狙うことによって）、大当りと確変状態への移行条件とを不正に成立させられてしまう可能性がある。この実施の形態では、乱数回路５０３が発生させた乱数を用いて大当りとするか否かの判定を行うので、大当りの判定と確変の判定を両方ともソフトウェア乱数を用いて行う場合と比較して、大当りと確変状態への移行条件とを不正に成立させられてしまう可能性を低減できる。また、大当りと判定したときのみ確変決定用乱数を読み出して確変とするか否かを判定するので、大当りと判定された場合でなければ、不正信号を発生させたり入力したりする行為を行っても意味がないので、確変決定用乱数の初期値を不正信号により狙われたときに生じる被害が少なくて済む。

次に、特別図柄プロセス処理における特別図柄停止処理（ステップＳ３０４）について説明する。図５７は、特別図柄停止処理を示すフローチャートである。特別図柄停止処理において、ＣＰＵ５６は、特別図柄停止を示す演出制御コマンドを送信する処理を行う（ステップＳ３４０１）。

次いで、ＣＰＵ５６は、大当りであることを示す大当りフラグがセットされているか否か確認する（ステップＳ３４０２）。大当りフラグがセットされていれば、ＣＰＵ５６は、確変時短フラグ、確変フラグおよび時短フラグをリセットする（ステップＳ３４０３，Ｓ３４０４，Ｓ３４０５）。また、時短回数カウンタをクリアし（ステップＳ３４０６）、ステップＳ３４１６に移行する。

ステップＳ３４０２において大当りフラグがセットされていなければ、ＣＰＵ５６は、確変状態であることを示す確変フラグがセットされているか否か確認する（ステップＳ３４０８）。セットされていれば、ＣＰＵ５６は、確変時短状態（確変状態と時短状態への移行条件が同時に成立（本例では、乱数を用いた抽選により確変および時短とすることを同時に決定）した後、優先的に確変状態に制御された状態）であることを示す確変時短フラグがセットされているか否か確認する（ステップＳ３４０９）。セットされていれば、時短回数カウンタの値を−１し（ステップＳ３４１０）、ステップＳ３４１６に移行する。ただし、既に０になっている場合には減算しない。また、確変時短フラグがセットされている場合には、実際には遊技状態は確変状態であるが、このように、時短回数カウンタも−１される。なお、ステップＳ３４０９で確変時短フラグがセットされていなかった場合には、そのままステップＳ３４１６に移行する。

ステップＳ３４０８において確変フラグがセットされていないことを確認したら、ＣＰＵ５６は、時短フラグがセットされているか否か確認する（ステップＳ３４１１）。セットされていれば、時短回数カウンタの値を−１する（ステップＳ３４１２）。時短回数カウンタの値が０になった場合には（ステップＳ３４１３）、時短フラグをリセットして時短状態を終了させ（ステップＳ３４１４）、演出制御基板８０に対して、通常状態に戻ったことを通知するために、通常表示指定の演出制御コマンドを送信する処理を行う（ステップＳ３４１５）。

ステップＳ３４１６では、大当りとすることに決定された場合には、内部状態（特別図柄プロセスフラグ）をステップＳ３０５に移行するように更新する。そうでない場合には、内部状態をステップＳ３００に移行するように更新する。

次に、特別図柄プロセス処理における大当り終了処理（ステップＳ３０８）について説明する。図５８は、大当り遊技が終了したときに実行される大当り終了処理を示すフローチャートである。大当り終了処理において、ＣＰＵ５６は、確変決定フラグがセットされているか否かを確認する（ステップＳ３５０１）。確変決定フラグがセットされている場合には、ＣＰＵ５６は、さらに、時短決定フラグがセットされているか否かを確認する（ステップＳ３５０２）。時短決定フラグがセットされていた場合には、確変フラグと確変時短フラグとをセットし（ステップＳ３５０３）、さらに、時短回数カウンタに所定値をセットする（ステップＳ３５０４）。なお、この実施の形態では、時短回数カウンタには所定値として１００が設定される。ステップＳ３５０２で時短決定フラグがセットされていない場合には、ＣＰＵ５６は、確変フラグをセットし（ステップＳ３５０８）、ステップＳ３５０５に移行する。なお、確変時短状態において、確変フラグと確変時短フラグとに代えて、確変フラグと時短フラグとをセットするようにしてもよい。その場合、ステップＳ３５０２において時短決定フラグがセットされていた場合に、ＣＰＵ５６は、確変フラグと時短フラグとをセットする。

ステップＳ３５０１で確変決定フラグがセットされていない場合には、ＣＰＵ５６は、時短決定フラグがセットされているか否かを確認する（ステップＳ３５０９）。時短決定フラグがセットされていた場合には、ＣＰＵ５６は、時短フラグをセットし（ステップＳ３５１０）、さらに、時短回数カウンタに所定値をセットし（ステップＳ３５１１）、ステップＳ３５０５に移行する。なお、この実施の形態では、時短回数カウンタには所定値として１００が設定される。

また、ＣＰＵ５６は、演出制御手段に、大当り遊技状態の終了と、特別遊技状態（確変状態、時短状態または確変時短状態）への移行とを通知するために、特定大当り終了表示指定の演出制御コマンド（特定大当り終了表示コマンド）を送信する処理を行う（ステップＳ３５０５）。演出制御用ＣＰＵ１０１は、特定大当り終了表示コマンドを受信すると、音、表示、発光体などを用いた演出を行い、確変状態または時短状態（確変時短状態を含む）である旨の報知を行う。なお、演出制御用ＣＰＵ１０１は、確変状態と時短状態とで、異なる背景画像を用い、異なる演出態様で各電気部品の制御を行うことによって、確変状態または時短状態であることを報知してもよい。さらに、演出制御用ＣＰＵ１０１は、確変時短状態であることを報知する場合、確変状態および時短状態とは、異なる背景画像を用い、異なる演出態様で各電気部品の制御を行うことによって、確変時短状態であることを報知してもよい。また、演出制御用ＣＰＵ１０１は、確変状態、時短状態または確変時短状態のいずれの状態においても、共通な背景画像を用い、全て共通の演出態様で各電気部品の制御を行うことによって、確変状態または時短状態であることを報知してもよい。ただし、この場合、演出制御用ＣＰＵ１０１は、通常状態とは異なる演出態様で確変状態または時短状態であることを報知する。

特定大当り終了表示コマンドを送信すると、ＣＰＵ５６は、確変決定フラグおよび時短決定フラグをリセットする（ステップＳ３５０６）。そして、ＣＰＵ５６は、特別図柄プロセスフラグの値を、特別図柄通常処理（ステップＳ３００）に応じた値にする（ステップＳ３５０７）。

ステップＳ３５０９において時短決定フラグがセットされていなかった場合（すなわち、確変状態、時短状態および確変時短状態のいずれでもない場合）、ＣＰＵ５６は、大当り遊技状態の終了を通知するために、非特定大当り終了表示指定の演出制御コマンド（非特定大当り終了表示コマンド）を送信する処理を行い（ステップＳ３５１２）、ステップＳ３５０６に移行する。演出制御用ＣＰＵ１０１は、非特定大当り終了表示コマンドを受信すると、音、表示、発光体などを用いた演出を行い、大当り遊技状態の終了を報知する。この場合、演出制御用ＣＰＵ１０１は、ステップＳ３５０５とは異なる演出態様で大当り遊技状態の終了を報知する。

次に、主基板３１と払出制御基板３７との間で送受信される払出制御信号および払出制御コマンドについて説明する。図５９は、遊技制御手段から払出制御手段に対して出力される制御信号の内容の一例を示す説明図である。この実施の形態では、払出制御等に関する各種の制御を行うために、主基板３１と払出制御基板３７との間で制御信号として接続確認信号が送受信される。図５９に示すように、接続確認信号は、主基板３１の立ち上がり時（遊技制御手段が遊技制御処理を開始したとき）に出力され、払出制御基板３７に対して主基板３１が立ち上がったことを通知するための信号（主基板３１の接続確認信号）である。また、接続確認信号は、賞球払出が可能な状態であることを示す。

払出制御用マイクロコンピュータ３７０は、遊技制御用マイクロコンピュータ５６０と同様に、シリアル通信回路３７５を内蔵する。また、遊技制御用マイクロコンピュータ５６０が内蔵するシリアル通信回路５０５と、払出制御用マイクロコンピュータ３７０が内蔵するシリアル通信回路３７５との間で、各種払出制御コマンドが送受信される。なお、払出制御用マイクロコンピュータ３７０が内蔵するシリアル通信回路３７５の構成及び機能は、遊技制御用マイクロコンピュータ５６０が内蔵するシリアル通信回路５０５の構成及び機能と同様である。

図６０は、遊技制御手段と払出制御手段との間で送受信される制御コマンドの内容の一例を示す説明図である。この実施の形態では、払出制御等に関する各種の制御を行うために、主基板３１と払出制御基板３７との間で各種制御コマンドが送受信される。

賞球個数コマンドは、払出要求を行う遊技球の個数（０〜１５個）を指定するために出力されるコマンドである。この実施の形態では、始動口スイッチ１４ａで遊技球が検出されると４個の賞球払出を行い、入賞口スイッチ３３ａ，３９ａ，２９ａ，３０ａのいずれかで遊技球が検出されると７個の賞球払出を行い、カウントスイッチ２３で遊技球が検出されると１５個の賞球払出を行う。よって、始動口スイッチ１４ａで遊技球が検出された場合、賞球数４個を通知するための賞球個数コマンド「０４」が送信され、入賞口スイッチ３３ａ，３９ａ，２９ａ，３０ａのいずれかで遊技球が検出された場合、賞球数７個を通知するための賞球個数コマンド「０７」が送信され、カウントスイッチ２３で遊技球が検出された場合、賞球数１５個を通知するための賞球個数コマンド「０Ｆ」が送信される。なお、賞球個数コマンドを２バイトで構成してもよい。この場合、例えば、ＣＰＵ５６は、まず賞球個数コマンドの下位１バイトのデータを送信データレジスタ７１０に書き込む。そして、送信用シフトレジスタ７１２から賞球個数コマンドの下位１バイトのデータの送信が完了すると、シリアル通信回路５０５からの送信時割り込み要求に応じて、ＣＰＵ５６は、賞球個数コマンドの上位１バイトのデータを送信データレジスタ７１０に書き込み、送信用シフトレジスタ７１２から賞球個数コマンドの上位１バイトのデータが送信される。

賞球ＡＣＫコマンド「Ｄ２」は、払出制御手段が賞球個数コマンドを受信したことを遊技制御手段に通知するためのコマンドである。賞球ＡＣＫコマンドは、賞球個数コマンドを受信したことを示す受信確認信号に相当する。

図６１は、図５９に示す制御信号および図６０に示す制御コマンドの送受信に用いられる信号線等を示すブロック図である。なお、図６１には、電源断信号も示されている。図６１に示すように、接続確認信号は、遊技制御用マイクロコンピュータ５６０によって出力回路６７を介して出力され、入力回路３７３Ａを介して払出制御用マイクロコンピュータ３７０に入力される。また、電源断信号は、出力回路３７３Ｂを介して出力され、入力回路６８を介して遊技制御用マイクロコンピュータ５６０に入力される。また、賞球個数コマンドは、遊技制御用マイクロコンピュータ５６０が内蔵するシリアル回路５０５から出力され、払出制御用マイクロコンピュータ３７０が内蔵するシリアル回路３７５に入力される。また、賞球ＡＣＫコマンドは、払出制御用マイクロコンピュータ３７０が内蔵するシリアル回路３７５から出力され、遊技制御用マイクロコンピュータ５６０が内蔵するシリアル回路５０５に入力される。

接続確認信号および電源断信号は、それぞれ１ビットのデータであり、１本の信号線によって送信される。また、主基板３１と払出制御基板３７との間で、遊技制御用マイクロコンピュータ５６０への電源断信号の信号線と、払出制御に関わる制御信号（接続確認信号）の信号線とをまとめて配線することができる。よって、遊技機において、遊技制御用マイクロコンピュータ５６０への電源断信号に関する配線スペースを節減することができる。

なお、この実施の形態では、遊技制御用マイクロコンピュータ５６０が賞球個数コマンドを払出制御用マイクロコンピュータ３７０にシリアル送信し、払出制御用マイクロコンピュータ３７０が賞球ＡＣＫコマンドを遊技制御用マイクロコンピュータ５６０にシリアル送信する双方向通信を行う場合を説明するが、遊技制御用マイクロコンピュータ５６０と払出制御用マイクロコンピュータ３７０とは一方向のシリアル通信を行ってもよい。例えば、遊技制御用マイクロコンピュータ５６０が賞球個数コマンドを払出制御用マイクロコンピュータ３７０に送信する一方向のシリアル通信を行い、払出制御用マイクロコンピュータ３７０は賞球ＡＣＫコマンドを送信しないようにしてもよい。

図６２は、払出制御信号および払出制御コマンドの出力の仕方の一例を示すタイミング図である。図６２に示すように、入賞検出スイッチが遊技球の入賞を検出すると、遊技制御手段（遊技制御用マイクロコンピュータ５６０）は、入賞に応じて払い出される賞球数に応じた賞球個数コマンドを払出制御手段（払出制御用マイクロコンピュータ３７０）に送信する。なお、具体的には、遊技制御用マイクロコンピュータ５６０は、遊技球が遊技機に設けられている入賞領域に入賞したことを入賞検出スイッチの検出信号によって検知すると、あらかじめ決められた賞球数をバックアップＲＡＭに形成されている総賞球数格納バッファの内容に加算する。そして、総賞球数格納バッファの内容が０でない値になったら、入賞に応じて払い出される賞球数に応じた賞球個数コマンドを払出制御用マイクロコンピュータ３７０に送信する。

また、この実施の形態では、始動口スイッチ１４ａで遊技球が検出されると４個の賞球払出を行い、入賞口スイッチ３３ａ，３９ａ，２９ａ，３０ａのいずれかで遊技球が検出されると７個の賞球払出を行い、カウントスイッチ２３で遊技球が検出されると１５個の賞球払出を行う。具体的には、遊技制御用マイクロコンピュータ５６０は、払い出される賞球数に応じて、賞球数が４個の場合には賞球数が４個であることを示す賞球個数コマンド「０４」を送信し、賞球数が７個の場合には賞球数が７個であることを示す賞球個数コマンド「０７」を送信し、賞球数が１５個の場合には賞球数が１５個であることを示す賞球個数コマンド「０Ｆ」を送信する。

賞球個数コマンドの送信を完了すると、遊技制御用マイクロコンピュータ５６０のシリアル通信回路５０５は、図６２に示すように、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６に対して送信時割り込み要求を行う。送信時割込要求によって、ＣＰＵ５６は、賞球個数コマンドの送信を完了した状態となったことを認識し、払出制御用マイクロコンピュータからの受信確認信号の待ち状態となる。

払出制御用マイクロコンピュータ３７０は、賞球個数コマンドの受信を確認すると、受信した賞球個数コマンドに示される賞球数を、払出制御用マイクロコンピュータ３７０の受信バッファに格納する。また、払出制御用マイクロコンピュータ３７０は、ＲＡＭの所定領域に設けられた賞球未払出個数カウンタに賞球数を加算する。そして、払出制御用マイクロコンピュータ３７０は、賞球ＡＣＫコマンド「Ｄ２」を、遊技制御用マイクロコンピュータ５６０に送信する。なお、払出制御用マイクロコンピュータ３７０は、払出制御用マイクロコンピュータ３７０が内蔵するシリアル通信回路３７５からの受信時割り込み要求にもとづく割込処理において賞球数を受信カウンタに格納するようにしてもよい。この場合、払出制御用マイクロコンピュータ３７０が内蔵するシリアル通信回路３７５は、賞球個数コマンドを受信すると、払出制御用マイクロコンピュータ３７０のＣＰＵに受信時割り込み要求を行う。そして、払出制御用マイクロコンピュータ３７０のＣＰＵは、シリアル通信回路３７５からの割り込み要求に応じて割込処理を実行することによって、賞球数を受信バッファに格納する。

賞球ＡＣＫコマンドを受信し、受信データレジスタ７１１に賞球ＡＣＫコマンドが格納された状態となると、遊技制御用マイクロコンピュータ５６０のシリアル通信回路５０５は、図６２に示すように、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６に対して受信時割り込み要求を行う。受信時割込要求による割込処理を実行することによって、ＣＰＵ５６は、シリアル通信回路５０５がデータを受信したことを認識し、後述する賞球ＡＣＫ待ち処理において受信データレジスタ７１１から賞球ＡＣＫコマンドを読み込む。

図６３は、ステップＳ３１の賞球処理の一例を示すフローチャートである。賞球処理において、遊技制御用マイクロコンピュータ５６０は、賞球個数加算処理（ステップＳ１２０１）と賞球制御処理（ステップＳ１２０２）とを実行する。そして、ＲＡＭ５５に形成されるポート０バッファの内容をポート０に出力する（ステップＳ１２０３）。なお、ポート０バッファの内容は、賞球制御処理において更新される。

遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、メイン処理におけるステップＳ１７からステップＳ１９までのループ処理において、割り込み許可状態である間にシリアル通信回路５０５からの割り込み要求があると、シリアル通信回路５０５が割り込み要求を行った割り込み原因に応じた割り込み処理を実行する。図６４は、シリアル通信回路５０５が割り込み要求に対して行う割り込み処理の一例を示す流れ図である。図６４（ａ）は、シリアル通信回路５０５が通信エラーを割り込み原因として割り込み要求を行った場合に、ＣＰＵ５６が実行する通信エラー割込処理である。図６４（ｂ）は、シリアル通信回路５０５が受信データを受信したことを割り込み原因として割り込み要求を行った場合に、ＣＰＵ５６が実行する受信時割込処理である。図６４（ｃ）は、シリアル通信回路５０５が送信データの送信を完了したことを割り込み原因として割り込み要求を行った場合に、ＣＰＵ５６が実行する送信完了割込処理である。

ＣＰＵ５６は、いずれの割込処理を優先して実行する旨が初期設定されているか否かを判断する。例えば、ＣＰＵ５６は、いずれの割込処理を優先して実行する旨のフラグがセットされているか否かを判断する。この実施の形態では、ＣＰＵ５６は、通信エラー時割込優先実行フラグがセットされていることにもとづいて、シリアル通信回路５０５で通信エラーが発生したことを割込原因とする割込処理を優先して実行する。

シリアル通信回路５０５から割り込み要求があると、ＣＰＵ５６は、シリアル通信回路５０５のステータスレジスタＡ７０５の各ビットを確認し、割り込み原因を特定する。この場合、ＣＰＵ５６は、いずれの割込処理を優先して実行する旨が初期設定されているか否かを判断する。例えば、ＣＰＵ５６は、いずれの割込処理を優先して実行する旨のフラグがセットされているか否かを判断する。この実施の形態では、ＣＰＵ５６は、通信エラー時割込優先実行フラグがセットされていることにもとづいて、シリアル通信回路５０５で通信エラーが発生したことを割込原因とする割込処理を優先して実行する。

ＣＰＵ５６は、通信エラー時割込優先実行フラグがセットされていることにもとづいて、ステータスレジスタＡ７０５のビット０〜ビット３を優先的に確認し、割り込み原因を特定する。すなわち、ＣＰＵ５６は、シリアル通信回路５０５で通信エラー（オーバーラン、ノイズエラー、フレーミングエラーまたはパリティエラー）が発生したことを割り込み原因として割り込み要求したか否かを、他の割り込み原因（受信データの受信または送信データの送信完了）に優先して判断する。ステータスレジスタＡ７０５のビット０〜ビット３のうちいずれか１つまたは複数のビットが「１」であると判断すると、ＣＰＵ５６は、割り込み原因がシリアル通信回路５０５で通信エラーが発生したことであると特定する。

割り込み原因がシリアル通信回路５０５で通信エラーが発生したことであると特定すると、ＣＰＵ５６は、図６４（ａ）に示す通信エラー割込処理を他の割込処理（図６４（ｂ）および図６４（ｃ）に示す割込処理）に優先して実行する。この場合、ＣＰＵ５６は、シリアル通信回路５０５で通信エラーが発生していることを示す通信エラーフラグをセットする（ステップＳ４１）。

なお、通信エラーを検出すると、ＣＰＵ５６は、演出制御手段に、シリアル通信回路５０５で通信エラーが発生したことを通知するために、通信エラー発生表示指定の演出制御コマンド（通信エラー表示コマンド）を送信する処理を行う。演出制御用ＣＰＵは、通信エラー表示コマンドを受信すると、音、表示、発光体などを用いた演出を行い、通信エラーが発生している旨の報知を行う。

割り込み原因がシリアル通信回路５０５で通信エラーが発生したことでなかった場合、ＣＰＵ５６は、ステータスレジスタＡのビット５を確認する。すなわち、ＣＰＵ５６は、シリアル通信回路５０５が受信データを受信したことが割込原因であるか否かを判断する。ステータスレジスタＡのビット５が「１」であると判断すると、ＣＰＵ５６は、割り込み原因がシリアル通信回路５０５が受信データを受信したことであると特定する。

割り込み原因がシリアル通信回路５０５が受信データを受信したことであると特定すると、ＣＰＵ５６は、図６４（ｂ）に示す受信時割込処理を実行する。この場合、ＣＰＵ５６は、シリアル通信回路５０５が受信データを受信していることを示す受信時割込フラグをセットする（ステップＳ４２）。

なお、ステップＳ４２において、ＣＰＵ５６は、受信時割込フラグをセットするとともに、シリアル通信回路５０５の受信データレジスタ７１１からデータを読み込んでもよい。この場合、例えば、ＣＰＵ５６は、読み込んだ受信データが賞球ＡＣＫコマンドであるか否かを判断する。また、賞球ＡＣＫコマンドであると判断すると、ＣＰＵ５６は、賞球ＡＣＫコマンドを受信したことを示す賞球ＡＣＫ受信フラグをセットする。

また、割り込み原因がシリアル通信回路５０５で通信エラーが発生したことでなかった場合、ＣＰＵ５６は、ステータスレジスタＡのビット６を確認する。すなわち、ＣＰＵ５６は、シリアル通信回路５０５が送信データの送信を完了したことが割込原因であるか否かを判断する。ステータスレジスタＡのビット６が「１」であると判断すると、ＣＰＵ５６は、割り込み原因がシリアル通信回路５０５が送信データの送信を完了したことであると特定する。

割り込み原因がシリアル通信回路５０５が送信データの送信を完了したことであると特定すると、ＣＰＵ５６は、図６４（ｃ）に示す送信完了割込処理を実行する。この場合、ＣＰＵ５６は、シリアル通信回路５０５が送信データの送信を完了していることを示す送信時割込フラグをセットする（ステップＳ４３）。

上記に示す処理を実行することによって、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、シリアル通信回路５０５からの割り込み要求があった場合に、割込原因を特定し、特定した割込原因に応じたフラグ（通信エラーフラグ、受信時割込フラグ又は送信時割込フラグ）をセットする。特定した割込原因に応じてフラグがセットされることによって、ＣＰＵ５６によって、シリアル通信回路５０５で通信エラーが発生した旨や、データを受信した旨、又はデータ送信を完了した旨が認識される。

なお、払出制御用マイクロコンピュータ３７０が搭載するＣＰＵも、シリアル通信回路３７５からの割り込み要求があった場合に、図６４に示す処理と同様の処理に従って、割り込み原因を特定し、特定した割込原因に応じたフラグをセットする。

例えば、遊技制御用マイクロコンピュータ５６０から払出制御用マイクロコンピュータ３７０に、一方向通信で賞球個数コマンドを送信する場合を考える。この場合、遊技制御用マイクロコンピュータ５６０が払出制御用マイクロコンピュータ３７０に、例えば２ｍｓ毎にタイマ割込が発生する構成となっていて、賞球個数コマンドを送信した後、次の割込処理を行って２ｍｓ後に再び賞球個数コマンドを送信したとする。また、払出制御用マイクロコンピュータ３７０は、例えば４ｍｓ毎にタイマ割込が発生する構成となっていて、４ｍｓ毎に賞球個数コマンドを受信できるものであるとする。すると、遊技制御用マイクロコンピュータ５６０が最初に送信した賞球個数コマンドを読み込んでいないのに、払出制御用マイクロコンピュータ３７０が次の賞球個数コマンドを受信してしまう事態が発生してしまうが、払出制御用マイクロコンピュータ３７０のＣＰＵがシリアル通信回路３７５からの受信時割り込み要求に応じて賞球個数コマンドを受信するように設定すれば、遊技制御用マイクロコンピュータ５６０からの賞球個数コマンドを確実に受信することができる。

賞球個数加算処理では、図６５に示す賞球個数テーブルが使用される。賞球個数テーブルは、ＲＯＭ５４に設定されている。賞球個数テーブルの先頭アドレスには処理数（この例では「６」）が設定され、その後に、スイッチオンバッファ（２バイトのスイッチオンバッファのうちの入力ポート０に対応する方）の下位アドレス、入賞により賞球を払い出すことになる入賞口の各スイッチについてのスイッチ入力ビット判定値、賞球数が、入賞口の各スイッチのそれぞれに対応して順次設定されている。なお、スイッチ入力ビット判定値は、入力ポート０における各スイッチの検出信号が入力されるビットに対応した値である。また、スイッチオンバッファの上位アドレスは固定的な値（例えば７Ｆ（Ｈ））である。また、賞球個数テーブルにおいて、６つのスイッチオンバッファの下位アドレスのそれぞれには、同じデータが設定されている。なお、この実施の形態では、ＲＯＭ５４およびＲＡＭ５５のアドレスは１６ビットで指定される。

図６６は、賞球個数加算処理を示すフローチャートである。賞球個数加算処理において、ＣＰＵ５６は、賞球個数テーブルの先頭アドレスをポインタにセットする（ステップＳ１２１１）。そして、ポインタが指すアドレスのデータ（この場合には処理数）をロードする（ステップＳ１２１２）。次に、スイッチオンバッファの上位アドレス（８ビット）を２バイトのチェックポインタの上位１バイトにセットする（ステップＳ１２１３）。

そして、ポインタの値を１増やし（ステップＳ１２１４）、ポインタが指す賞球個数テーブルのデータ（この場合にはスイッチオンバッファの下位アドレス）をチェックポインタの下位１バイトにセットした後（ステップＳ１２１５）、ポインタの値を１増やす（ステップＳ１２１６）。次いで、チェックポインタが指すアドレスのデータ、すなわちスイッチオンバッファの内容をレジスタにロードし（ステップＳ１２１７）、ロードした内容と、ポインタが指す賞球個数テーブルのデータ（この場合にはスイッチ入力ビット判定値）との論理積をとる（ステップＳ１２１８）。この結果、スイッチオンバッファの内容がロードされたレジスタには、検査対象としているスイッチの検出信号に対応したビット以外の７ビットが０になる。そして、ポインタの値を１増やす（ステップＳ１２１９）。

ステップＳ１２１８における演算結果が０でなれば、すなわち、検査対象のスイッチの検出信号がオン状態であれば、ポインタが指す賞球個数テーブルのデータ（この場合には賞球個数）を賞球加算値に設定し（ステップＳ１２２０，Ｓ１２２１）、賞球加算値を、ＲＡＭ５５に形成されている１６ビットの総賞球数格納バッファの内容に加算する（ステップＳ１２２２）。加算の結果、桁上げが発生した場合には、総賞球数格納バッファの内容を６５５３５（＝ＦＦＦＦ（Ｈ））に設定する（ステップＳ１２２３，１２２４）。

ステップＳ１２２５では処理数を１減らし、処理数が０であれば処理を終了し、処理数が０でなければステップＳ１２１４に戻る（ステップＳ１２２６）。また、ステップＳ１２２０において、ステップＳ１２１８における演算結果が０であること、すなわち、検査対象のスイッチの検出信号がオフ状態であることを確認したら、ステップＳ１２２５に移行する。

図６７は、ステップＳ１２０２の賞球制御処理を示すフローチャートである。賞球制御処理では、ＣＰＵ５６は、ステップＳ１２３０の賞球異常検出処理を実行した後、賞球プロセスコードの値に応じて、ステップＳ１２３１〜Ｓ１２３５のいずれかの処理を実行する。

図６８は、賞球プロセスコードの値が０の場合に実行される賞球送信待ち処理（ステップＳ１２３１）を示すフローチャートである。ＣＰＵ５６は、賞球送信待ち処理において、通信エラーフラグがセットされているか否か確認する（ステップＳ１２４１）。すなわち、ＣＰＵ５６は、まず、シリアル通信回路５０５で通信エラーが発生しているか否かを確認する。通信エラーフラグがセットされている場合、ＣＰＵ５６は、そのまま処理を終了する。すなわち、シリアル通信回路５０５で通信エラーが発生している状態であるので、ＣＰＵ５６は、払出制御基板３７との通信を禁止するように制御する。

通信エラーフラグがセットされていなければ、ＣＰＵ５６は、総賞球数格納バッファの内容を確認する（ステップＳ１２４２）。その値が０であれば処理を終了し、０でなければ、賞球プロセスコードの値を１にした後（ステップＳ１２４３）、処理を終了する。

図６９は、賞球プロセスコードの値が１の場合に実行される賞球個数コマンド送信処理（ステップＳ１２３２）を示すフローチャートである。ＣＰＵ５６は、賞球送信処理において、通信エラーフラグがセットされているか否か確認する（ステップＳ１２５１）。すなわち、ＣＰＵ５６は、まず、シリアル通信回路５０５で通信エラーが発生しているか否かを確認する。通信エラーフラグがセットされている場合、ＣＰＵ５６は、払出制御基板３７との通信を禁止し、そのまま処理を終了する。すなわち、シリアル通信回路５０５で通信エラーが発生している状態であるので、ＣＰＵ５６は、払出制御基板３７との通信を禁止するように制御する。この場合、ＣＰＵ５６は、例えば、シリアル通信回路５０５の送信部の機能を停止させることによって、払出制御基板３７へのデータ送信を禁止するように制御する。例えば、ＣＰＵ５６は、シリアル通信回路５０５の制御レジスタＢ７０８のビット３を「０」に設定し、送信回路を使用しないように設定することによって、払出制御基板３７へのデータ送信を禁止する。

通信エラーフラグがセットされていなければ、ＣＰＵ５６は、総賞球数格納バッファの内容が賞球コマンド最大値（この例では「１５」）よりも小さいか否か確認する（ステップＳ１２５２）。総賞球数格納バッファの内容が賞球コマンド最大値以上であれば、賞球コマンド最大値を賞球個数バッファに設定する（ステップＳ１２５３）。また、総賞球数格納バッファの内容が賞球コマンド最大値よりも小さい場合には、総賞球数格納バッファの内容を賞球個数バッファに設定する（ステップＳ１２５４）。

その後、ＣＰＵ５６は、賞球個数バッファの内容を賞球個数コマンドとしてシリアル通信回路５０５の送信データレジスタ７１０に書き込み（ステップＳ１２５５）、賞球プロセスコードの値を２にした後（ステップＳ１２５６）、処理を終了する。この実施の形態では、賞球コマンド最大値は「１５」である。従って、最大で「１５」の払出数を指定する賞球個数コマンドが送信データレジスタ７１０に書き込まれる。その後、送信データレジスタ７１０に書き込まれた賞球個数コマンドは、送信用シフトレジスタ７１２に転送され、送信用シフトレジスタ７１２から払出制御用マイクロコンピュータに送信される。

図７０は、賞球プロセスコードの値が２の場合に実行される賞球送信完了待ち処理（ステップＳ１２３３）を示すフローチャートである。ＣＰＵ５６は、賞球送信完了待ち処理において、通信エラーフラグがセットされているか否か確認する（ステップＳ１２６１）。すなわち、ＣＰＵ５６は、まず、シリアル通信回路５０５で通信エラーが発生しているか否かを確認する。通信エラーフラグがセットされている場合、ＣＰＵ５６は、そのまま処理を終了する。すなわち、シリアル通信回路５０５で通信エラーが発生している状態であるので、ＣＰＵ５６は、払出制御基板３７との通信を禁止するように制御する。

通信エラーフラグがセットされていなければ、ＣＰＵ５６は、送信時割込フラグがセットされているか否かを確認する（ステップＳ１２６２）。送信時割込フラグがセットされていれば、ＣＰＵ５６は、ステップＳ１２６３の処理に移行する。また、送信時割込フラグがセットされていなければ、ＣＰＵ５６は、そのまま処理を終了する。すなわち、ＣＰＵ５６は、賞球個数コマンド送信処理において送信データレジスタ７１０に書き込んだ賞球個数コマンドの送信をシリアル通信回路５０５が既に完了したか否かを判断し、賞球個数コマンドの送信を完了したことを確認すると、ステップＳ１２６３以降の処理を実行する。

送信時割込フラグがセットされていれば、ＣＰＵ５６は、送信時割込フラグをリセットする（ステップＳ１２６３）。そして、ＣＰＵ５６は、総賞球数格納バッファの内容から、賞球個数バッファの内容（払出制御手段に指令した賞球払出個数）を減算する（ステップＳ１２６４）。

また、ＣＰＵ５６は、賞球タイマにＡＣＫ受信完了判定時間値をセットする（ステップＳ１２６６）。そして、賞球プロセスコードの値を３にして（ステップＳ１２６７）、処理を終了する。なお、ＡＣＫ受信完了判定時間値は、払出制御手段から賞球ＡＣＫコマンドを受信したか否かを監視するための時間値である。

図７１は、賞球プロセスコードの値が３の場合に実行される賞球ＡＣＫ待ち処理（ステップＳ１２３４）を示すフローチャートである。ＣＰＵ５６は、賞球ＡＣＫ待ち処理において、通信エラーフラグがセットされているか否か確認する（ステップＳ１２７１）。すなわち、ＣＰＵ５６は、まず、シリアル通信回路５０５で通信エラーが発生しているか否かを確認する。通信エラーフラグがセットされている場合、ＣＰＵ５６は、払出制御基板３７との通信を禁止し、そのまま処理を終了する。すなわち、シリアル通信回路５０５で通信エラーが発生している状態であるので、ＣＰＵ５６は、払出制御基板３７との通信を禁止するように制御する。この場合、ＣＰＵ５６は、例えば、シリアル通信回路５０５の受信部の機能を停止させることによって、払出制御基板３７からのデータ受信を禁止するように制御する。例えば、ＣＰＵ５６は、シリアル通信回路５０５の制御レジスタＢ７０８のビット２を「０」に設定し、受信回路を使用しないように設定することによって、払出制御基板３７からのデータ受信を禁止する。

通信エラーフラグがセットされていなければ、ＣＰＵ５６は、受信時割込フラグがセットされているか否かを確認する（ステップＳ１２７２）。すなわち、ＣＰＵ５６は、シリアル通信回路５０５が受信データを受信し、受信データレジスタ７１１にデータが格納されている状態になっているか否かを確認する。受信時割込フラグがセットされていれば、ＣＰＵ５６は、ステップＳ１２７３の処理に移行する。また、受信時割込フラグがセットされていなければ、ＣＰＵ５６は、ステップＳ１２７５の処理に移行する。

受信時割込フラグがセットされていれば、ＣＰＵ５６は、シリアル通信回路５０５の受信データレジスタ７１１からデータを読み込む（ステップＳ１２７３）。また、ＣＰＵ５６は、読み込んだデータが賞球ＡＣＫコマンドであるか否か（コマンド「Ｄ２」であるか否か）を判断する（ステップＳ１２７４）。

なお、図６４（ｂ）に示す受信時割込処理において、受信時割込フラグをセットするとともに既に受信データを受信データレジスタ７１１から読み込んでいる場合、ステップＳ１２７３，Ｓ１２７４において、ＣＰＵ５６は、賞球ＡＣＫ受信フラグがセットされているか否かを判断してもよい。そして、賞球ＡＣＫ受信フラグがセットされている場合、ＣＰＵ５６は、賞球ＡＣＫコマンドを受信したと判断するようにしてもよい。

ステップＳ１２７２で受信時割込フラグがセットされていなかった場合、またはステップＳ１２７４で読み込んだデータが賞球ＡＣＫコマンドでなかった場合、ＣＰＵ５６は、まだ払出制御用マイクロコンピュータ３７０から賞球ＡＣＫコマンドを受信していない状態であると判断する。この場合、ＣＰＵ５６は、賞球タイマの値を１減らし（ステップＳ１２７５）、その値が０でなければ処理を終了する（ステップＳ１２７６）。賞球タイマの値が０になったら、払出制御用マイクロコンピュータ３７０が賞球ＡＣＫコマンドを送信しなかったと判断して、再送信フラグをセットし（ステップＳ１２７７）、賞球プロセスコードの値を４にして（ステップＳ１２７８）、処理を終了する。なお、賞球プロセスコードの値が４になると、賞球再送信処理（ステップＳ１２３５）が実行される状態になる。また、再送信フラグがセットされると、賞球異常検出処理（ステップＳ１２３０）において、払出異常報知開始コマンドが演出制御基板８０に対して送信される。

ステップＳ１２７４において、受信データレジスタ７１１から読み込んだデータが賞球ＡＣＫコマンドであることを確認すると、ＣＰＵ５６は、受信時割込フラグをリセットして（ステップＳ１２７９）、賞球プロセスコードの値を０にする（ステップＳ１２８０）。また、通信が正常に完了したので、再送信フラグがセットされている場合には、再送信フラグをリセットする（ステップＳ１２８１，Ｓ１２８２）。

以上の処理によって、遊技制御手段は、払出条件の成立にもとづいて払い出される賞球としての遊技球の総数を特定可能に総賞球数格納バッファに記憶する。また、遊技制御手段は、総賞球数格納バッファに記憶されている賞球数にもとづいて払出制御手段に対して所定数の賞球の払出数を指定する払出指令コマンド（賞球個数コマンド）を送信する。ここで、所定数は、総賞球数格納バッファに記憶されている賞球数が１５個以上であれば１５であり、１５個未満であれば、総賞球数格納バッファに記憶されている賞球数である。そして、賞球払出を指定する賞球個数コマンドを送信したときに、総賞球数格納バッファに記憶されている賞球数から賞球個数コマンドで指定した払出数を減算する減算処理を行う。なお、払出制御用マイクロコンピュータ３７０は、賞球個数コマンドを受信すると直ちに賞球ＡＣＫコマンドを送信するので、球払出装置９７からの賞球払出に関わりなく賞球個数コマンドに関する通信を完了でき、遊技制御用マイクロコンピュータ５６０は、賞球個数コマンドで指定した払出数の賞球払出が完了する前に、連続的に次の賞球個数コマンドを送信することができる。

なお、この実施の形態では、払出条件の成立にもとづいて払い出される景品遊技媒体の総数を特定可能に記憶するために、総数そのものを記憶する総賞球数格納バッファを用いる場合を例示したが、各入賞領域への入賞数を記憶したり、賞球数が同じである入賞領域毎の入賞数（例えば４個の賞球数に対応した入賞口１４、７個の賞球数に対応した入賞口３３，３９，２９，３０、１５個の賞球数に対応した大入賞口への入賞数であって、未だ賞球払出が終了していない入賞数）を記憶するバッファなどを用いてもよい。その場合には、入賞領域毎の賞球数に応じた数が設定された賞球個数コマンドが遊技制御用マイクロコンピュータ５６０から払出制御用マイクロコンピュータ３７０に送信される。さらには、賞球個数を示す賞球個数コマンドを送信するのではなく、入賞があったことまたは入賞数を示す払出指令コマンドを遊技制御用マイクロコンピュータ５６０から払出制御用マイクロコンピュータ３７０に送信するようにしてもよい。

図７２は、賞球プロセスコードの値が４の場合に実行される賞球再送信処理（ステップＳ１２３５）を示すフローチャートである。ＣＰＵ５６は、賞球再送信処理において、通信エラーフラグがセットされているか否か確認する（ステップＳ１２９１）。すなわち、ＣＰＵ５６は、まず、シリアル通信回路５０５で通信エラーが発生しているか否かを確認する。通信エラーフラグがセットされている場合、ＣＰＵ５６は、払出制御基板３７との通信を禁止し、そのまま処理を終了する。すなわち、シリアル通信回路５０５で通信エラーが発生している状態であるので、ＣＰＵ５６は、払出制御基板３７との通信を禁止するように制御する。この場合、ＣＰＵ５６は、例えば、シリアル通信回路５０５の送信部の機能を停止させることによって、払出制御基板３７へのデータ送信を禁止するように制御する。例えば、ＣＰＵ５６は、シリアル通信回路５０５の制御レジスタＢ７０８のビット３を「０」に設定し、送信回路を使用しないように設定することによって、払出制御基板３７へのデータ送信を禁止する。

通信エラーフラグがセットされていなければ、ＣＰＵ５６は、賞球個数バッファの内容を賞球個数コマンドとしてシリアル通信回路５０５の送信データレジスタ７１０に再度書き込む（ステップＳ１２９２）。また、ＣＰＵ５６は、賞球タイマにＡＣＫ受信完了判定時間値を再びセットする（ステップＳ１２９３）。そして、賞球プロセスコードの値を３にして（ステップＳ１２９４）、処理を終了する。

賞球プロセスコードの値が３に設定されることから、再度、賞球ＡＣＫ待ち処理が実行される。再度実行される賞球ＡＣＫ待ち処理において、再び賞球ＡＣＫコマンドを受信したことを検出できなかった場合には、具体的には、ステップＳ１２７６において賞球タイマがタイムアウトした場合には、再び賞球再送処理が実行されることになる。このように、ＣＰＵ５６は、払出数データを受信したことを示す受信確認信号としての賞球ＡＣＫコマンドが受信できない場合には、賞球ＡＣＫコマンドが受信できるまで、賞球個数コマンドの再送を繰り返す。

図７３は、ステップＳ２３０の賞球異常検出処理を示すフローチャートである。賞球異常検出処理において、ＣＰＵ５６は、再送信フラグがリセット状態からセット状態になったことを検出すると、払出異常報知開始コマンドを演出制御コマンドとして演出制御基板８０に対して（具体的には演出制御用マイクロコンピュータ１００に対して）送信する制御を行う（ステップＳ１３０１，Ｓ１３０２）。なお、ＣＰＵ５６は、賞球再送信処理を実行してから払出異常報知開始コマンドを送信するのでなく、払出異常報知開始コマンドを演出制御基板８０に送信してから賞球再送信処理を実行するようにしてもよい。

なお、演出制御用マイクロコンピュータ１００に演出制御コマンドを送信する際に、ＣＰＵ５６は、演出制御コマンドの種類に応じたコマンド送信テーブル（あらかじめＲＯＭ５４にコマンド毎に設定されている）のアドレスをポインタにセットする。そして、演出制御コマンドに応じたコマンド送信テーブルのアドレスをポインタにセットして、飾り図柄コマンド制御処理（ステップＳ２９）において演出制御コマンドを送信する。

また、ＣＰＵ５６は、再送信フラグがセット状態からリセット状態になったことを検出する（従って、セット状態が継続している場合には最初にリセット状態になったときにのみ検出される。）と、払出異常報知終了コマンドを演出制御基板８０に対して（具体的には演出制御用マイクロコンピュータ１００に対して）送信する制御を行う（ステップＳ１３０３，Ｓ１３０４）。

なお、この実施の形態では、ＣＰＵ５６は、再送信フラグがリセットされると、ステップＳ１３０４で払出異常報知終了コマンドを送信するが、送信しないように構成してもよい。その場合には、遊技制御用マイクロコンピュータ５６０の処理負担が軽減される。また、その場合には、演出制御用マイクロコンピュータ１００が、例えば所定時間後に、独自に払出異常報知を終了するように構成される。

次に、払出制御用マイクロコンピュータ３７０が各種コマンドを送受信する動作を説明する。図６１に示すように、払出制御用マイクロコンピュータ３７０は、遊技制御用マイクロコンピュータ５６０と各種コマンドをシリアル通信するシリアル通信回路３７５を内蔵している。払出制御用マイクロコンピュータ３７０は、シリアル通信回路３７５を用いて、遊技制御用マイクロコンピュータ５６０から図６０に示す賞球個数コマンドを受信する。また、賞球個数コマンドを受信すると、払出制御用マイクロコンピュータ３７０は、シリアル通信回路３７５を用いて、図６０に示す賞球ＡＣＫコマンド「Ｄ２」を受信確認信号として送信する。

また、払出制御用マイクロコンピュータ３７０のＣＰＵは、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６と同様に、割り込み許可状態である間にシリアル通信回路３７５からの割り込み要求があると、シリアル通信回路３７５が割り込み要求を行った割り込み原因に応じた割り込み処理を実行する。この実施の形態では、払出制御用マイクロコンピュータ３７０のＣＰＵは、割り込み原因がシリアル通信回路３７５が受信データを受信したことであると特定すると、図６４（ｂ）と同様の処理に従って受信時割込処理を実行する。この場合、払出制御用マイクロコンピュータ３７０のＣＰＵは、シリアル通信回路３７５が受信データを受信していることを示す受信時割込フラグをセットする。

図７４は、払出制御用マイクロコンピュータ３７０のＣＰＵが、主基板３１の遊技制御手段（遊技制御用マイクロコンピュータ５６０）と通信を行う主制御通信処理を示すフローチャートである。主制御通信処理において、払出制御用マイクロコンピュータ３７０のＣＰＵは、接続確認信号がオン状態であるか否かを確認する（ステップＳ５４１）。なお、接続確認信号がオン状態であるということは、電力供給がなされ遊技制御手段において遊技の進行を制御可能な状態であることを意味し、接続確認信号がオフ状態であるということは、電力供給停止時処理が開始され遊技制御手段において遊技の進行が不能な状態であることを意味する（接続確認信号は、電力供給停止時処理における出力ポートクリア処理でオフ状態にされる。）。

払出制御用マイクロコンピュータ３７０のＣＰＵは、受信時割込フラグがセットされているか否かを確認する（ステップＳ５４２）。すなわち、払出制御用マイクロコンピュータ３７０のＣＰＵは、シリアル通信回路３７５が受信データを受信し、シリアル通信回路３７５の受信データレジスタにデータが格納されている状態になっているか否かを確認する。

受信時割込フラグがセットされていれば、払出制御用マイクロコンピュータ３７０のＣＰＵは、シリアル通信回路３７５の受信データレジスタからデータを読み込む（ステップＳ５４３）。また、払出制御用マイクロコンピュータ３７０のＣＰＵは、読み込んだデータが賞球個数コマンドであるか否か（コマンド「０４」、「０７」または「０Ｆ」のいずれかであるか否か）を判断する（ステップＳ５４４）。

シリアル通信回路３７５の受信データレジスタから読み込んだデータが賞球個数コマンドであることを確認すると、払出制御用マイクロコンピュータ３７０のＣＰＵは、受信時割込フラグをリセットして（ステップＳ５４５）、賞球個数コマンドが示す賞球数を賞球未払出個数カウンタに加算する（ステップＳ５４６）。そして、払出制御用マイクロコンピュータ３７０のＣＰＵは、賞球ＡＣＫコマンドをシリアル通信回路５０５の送信データレジスタ７１０に書き込み（ステップＳ５４７）、処理を終了する。その後、送信データレジスタに書き込まれた賞球ＡＣＫコマンドは、シリアル通信回路３７５の送信用シフトレジスタに転送され、シリアル通信回路３７５の送信用シフトレジスタから遊技制御用マイクロコンピュータ５６０に送信される。なお、賞球受信バッファは、ＲＡＭに形成されている。

以上に説明したように、この実施の形態では、遊技機への電源投入が開始されてからタイマ割込設定を行うまでに乱数回路５０３の初期設定（乱数回路設定処理）を行うとともに、乱数回路設定処理において、遊技制御用マイクロコンピュータ５６０固有のＩＤナンバにもとづく値を乱数の初期値として設定する。そのため、乱数回路５０３が生成する乱数のランダム性を向上させることができる。また、乱数のランダム性を向上させることができるので、乱数生成のタイミングを遊技者や遊技店に認識されにくくすることができ、無線信号を用いた取り込み信号を遊技機に対して発生させることによって、大当り状態などの特定遊技状態への移行条件を不正に成立させられてしまうことを防止することができる。

また、この実施の形態では、遊技制御処理に用いる各乱数のうち、大当りの種類を決定するための各判定用乱数（確変決定用乱数や大当り図柄決定用乱数）として、ソフトウェア乱数を用いる。そして、大当りとするか否かを決定するための大当り判定用乱数のみを乱数回路５０３を用いて発生させる。例えば、大当り判定用乱数に加えて、確変決定用乱数や大当り図柄決定用乱数などの各判定用乱数も乱数回路５０３を用いて発生させるようにすると、乱数回路５０３を用いて複数種類の乱数を発生させることとなり、乱数回路５０３の構成が必要以上に複雑化してしまう。この実施の形態では、大当り判定用乱数のみを乱数回路５０３を用いて発生させるので、乱数回路５０３の回路構成が複雑化することを防止することができる。

また、この実施の形態では、乱数回路５０３が発生した乱数にもとづいて大当りとすると判定すると、確変決定用乱数を読み出して確変とするか否かを判定する。例えば、大当りとするか否かの判定と確変とするか否かの判定とをともにソフトウェア乱数を用いて行う場合、無線信号などを用いた取り込み信号を遊技機に対して発生させたり入力したりことによって（例えば、不正信号によってソフトウェア乱数の初期値を狙うことによって）、大当りと確変状態への移行条件とを不正に成立させられてしまう可能性がある。この実施の形態では、乱数回路５０３が発生させた乱数を用いて大当りとするか否かの判定を行うので、大当りの判定と確変の判定を両方ともソフトウェア乱数を用いて行う場合と比較して、大当りと確変状態への移行条件とを不正に成立させられてしまう可能性を低減できる。また、大当りと判定したときのみ確変決定用乱数を読み出して確変とするか否かを判定するので、大当りと判定された場合でなければ、不正信号を発生させたり入力したりする行為を行っても意味がないので、確変決定用乱数の初期値を不正信号により狙われたときに生じる被害が少なくて済む。

なお、全ての判定用乱数を乱数回路５０３を用いて発生させるようにすれば、大当り判定用乱数だけを乱数回路５０３を用いて発生させる場合と比較して、不正に大当りや確変状態への移行条件を不正に成立させられてしまう可能性をより効果的に低減できるが、乱数回路５０３の回路構成が複雑になってしまう。この実施の形態では、大当り判定用乱数のみを乱数回路５０３を用いて発生させることによって、乱数回路５０３の回路構成が必要以上に複雑化することを防止している。

また、この実施の形態では、シリアル通信回路５０５が割り込み要求を行った場合に、通信エラーを割込原因とする場合の割込処理を優先的に実行し、通信を禁止状態に制御する。そのため、通信エラーが発生した状態で遊技機に搭載されている払出制御基板３７と通信を行うことを防止できる。よって、通信エラーによる誤動作を防止することができる。

例えば、シリアル通信回路５０５においてオーバーランが発生すると、受信データレジスタ７１１内の受信データが読み込まれる前に受信用シフトレジスタ７１３に次の受信データが格納されてしまうので、受信データレジスタ７１１の内容が上書きされてしまいＣＰＵ５６が受信データを正しく読み込めなくなってしまう。そのため、各制御基板と正しく通信を行えなくなり、遊技制御用マイクロコンピュータ５６０が誤動作をする原因となる。この実施の形態では、オーバーランが発生すると、シリアル通信回路５０５が通信エラー時割込要求を行い、ＣＰＵ５６が通信を禁止状態に制御する。そのため、オーバーランの発生によって遊技制御用マイクロコンピュータ５６０が誤動作することを防止することができる。

また、例えば、シリアル通信回路５０５においてノイズエラーが発生すると、ノイズによって正しい受信データを受信できない可能性が高く、ＣＰＵ５６が誤動作をする原因となる。この実施の形態では、ノイズエラーが発生すると、シリアル通信回路５０５が通信エラー時割込要求を行い、ＣＰＵ５６が通信を禁止状態に制御する。そのため、ノイズエラーの発生によってＣＰＵ５６が誤動作することを防止することができる。

また、例えば、シリアル通信回路５０５においてフレーミングエラーが発生すると、受信データのストップビットを正しく受信できなかった状態であるので、正しい受信データを受信できない可能性が高く、ＣＰＵ５６が誤動作をする原因となる。この実施の形態では、フレーミングエラーが発生すると、シリアル通信回路５０５が通信エラー時割込要求を行い、ＣＰＵ５６が通信を禁止状態に制御する。そのため、フレーミングエラーの発生によってＣＰＵ５６が誤動作することを防止することができる。

また、例えば、シリアル通信回路５０５においてパリティエラーが発生すると、受信データの各データビットまたはパリティビットを正しく受信できなかった状態であるので、正しい受信データを受信できない可能性が高く、ＣＰＵ５６が誤動作をする原因となる。この実施の形態では、パリティエラーが発生すると、シリアル通信回路５０５が通信エラー時割込要求を行い、ＣＰＵ５６が通信を禁止状態に制御する。そのため、パリティエラーの発生によってＣＰＵ５６が誤動作することを防止することができる。

また、この実施の形態では、シリアル通信回路５０５において通信エラーが発生すると、払出制御基板３７への賞球個数コマンドの送信と、払出制御基板３７からの賞球ＡＣＫコマンドの受信とを禁止するように制御する。例えば、通信エラーの発生時に賞球個数コマンドを払出制御基板３７に送信してしまうと、誤った賞球個数コマンドが送信されてしまう可能性がある。そのため、誤った賞球個数コマンドに示される賞球数にもとづいて誤った数の遊技球が払い出されてしまう可能性があり、遊技結果に影響を及ぼす虞がある。この実施の形態では、通信エラーが発生すると、払出制御基板３７への賞球個数コマンドの送信を禁止するように制御するので、誤った賞球コマンドにもとづいて誤った数の遊技球の払出が行われ、遊技結果に影響を及ぼしてしまうことを防止することができる。

なお、シリアル通信回路５０５において通信エラーが発生すると、各制御基板からのデータの受信のみを防止するようにしてもよい。例えば、遊技制御手段と演出制御手段との間でシリアル通信を行う場合を考える。この場合、遊技制御用マイクロコンピュータ５６０と演出制御用マイクロコンピュータとの間で行われる通信は、遊技制御用マイクロコンピュータ５６０から演出制御用マイクロコンピュータへの演出制御コマンドの送信だけであり、演出制御用マイクロコンピュータから遊技制御用マイクロコンピュータ５６０へのコマンドの送信はない。すなわち、遊技制御用マイクロコンピュータ５６０と演出制御用マイクロコンピュータとの間では、一方向だけの通信が行われる。また、遊技制御用マイクロコンピュータ５６０から演出制御基板８０に誤った演出制御コマンドが送信されたとしても、可変表示装置９に誤った演出用の表示が行われるだけであり、誤った払出処理を実行してしまう場合と比較して、遊技結果に与える影響が小さい。そのため、遊技制御手段と演出制御手段との間でシリアル通信を行う場合、シリアル通信回路５０５において通信エラーが発生すると、遊技制御用マイクロコンピュータ５６０は、データの受信のみを禁止するように制御してもよい。

また、この実施の形態では、乱数回路５０３の反転回路５３２が極性を反転させた反転クロック信号ＳＩ２を生成し、反転クロック信号ＳＩ２に同期して乱数の記憶を指示するためのラッチ信号を出力する。そのため、乱数を更新するタイミングと乱数値記憶回路５３１に乱数を記憶させるタイミングとをずらすことができ、生成した乱数を安定して確実に記憶させることができる。

また、この実施の形態では、初期値決定用乱数（ランダム６やランダム７、ランダム１２、ランダム１３）にもとづいて、確変決定用乱数や大当り図柄決定用乱数などの各判定用乱数の所定の初期値を設定する。また、各判定用乱数を生成するためのカウンタのカウント値は、１周するたびに設定値（初期値）が変更される。そのため、特定遊技状態の種類を決定するために用いる判定用乱数のランダム性を向上させることができる。

実施の形態２．
第１の実施の形態では、特別図柄プロセス処理において、確変とするか否かを決定するための確変決定用乱数と、大当り図柄を決定するための大当り図柄決定用乱数として、別々の乱数を用いる場合を説明したが、共通の乱数を用いてもよい。以下、特別図柄プロセス処理において、共通の乱数を用いて、確変とするか否かを決定し、大当り図柄を決定する第２の実施の形態を説明する。

なお、本実施の形態において、第１の実施の形態と同様の構成および処理をなす部分についてはその詳細な説明を省略し、主として第１の実施の形態と異なる部分について説明する。

図７５は、第２の実施の形態における各乱数（ソフトウェア乱数）を示す説明図である。この実施の形態において、各乱数は、以下のように使用される。
（１）ランダム１：特別図柄のはずれ図柄決定用
（２）ランダム２：大当りを発生させる特別図柄（大当り図柄）を決定し、確変とするか否かを決定する（大当り図柄決定／確変決定用）。すなわち、ランダム２が、０〜９の範囲の値をとり、大当り図柄と、遊技状態を確変状態に移行させるか否かを決定するための共通の乱数として用いられる。この実施の形態では、遊技制御手段は、ランダム２と後述する大当り図柄設定用テーブルとにもとづいて、大当り図柄を決定するとともに、確変とするか否かを決定する。
（３）ランダム３：特別図柄の変動パターンを決定する（変動パターン決定用）
（４）ランダム４：大当りを発生させない場合にリーチとするか否かを決定する（リーチ判定用）
（５）ランダム５：普通図柄にもとづく当りを発生させるか否か決定する（普通図柄当り判定用）
（６）ランダム６：ランダム２の初期値を決定する（ランダム２初期値決定用）
（７）ランダム７：ランダム５の初期値を決定する（ランダム５初期値決定用）
（８）ランダム８：確変を終了するか否かを決定する（確変終了判定用）。すなわち、ランダム８が、０〜４９の範囲の値をとり、確変状態を終了させるか否か決めるための乱数として用いられる。遊技制御手段は、確変状態において、例えば、ランダム８があらかじめ決められている１つの値と一致した場合には、確変状態を終了させる。従って、確変状態は、１／５０の確率で終了（確変パンク）する。
（９）ランダム１０：時短とするか否かを決定する（時短決定用）。すなわち、ランダム１０が、０〜１６の範囲の値をとり、遊技状態の時短状態に移行させるか否かを決めるための乱数として用いられる。遊技制御手段は、例えば、ランダム１０があらかじめ決められている値と一致した場合には、遊技状態を時短状態に移行させる。
（１０）ランダム１１：ランダム８の初期値を決定する（ランダム８初期値決定用）

なお、この実施の形態では、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、第１の実施の形態と同様に、図５４に示した始動口スイッチ通過処理において、図７５に示す判定用乱数や表示用乱数などの各乱数の値を抽出し、それらを始動入賞記憶数の値に対応した保存領域（特別図柄判定用バッファ）に格納する（ステップＳ３２１０参照）。また、この実施の形態では、図７５に示された乱数のうち、ランダム１〜ランダム４，ランダム８、ランダム１０が抽出される。なお、遊技制御処理に用いる判定用乱数は、上記に示したものに限られない。例えば、遊技制御手段は、判定用乱数として、確変回数決定用乱数やラウンド数決定用乱数を用いてもよい。

また、この実施の形態では、遊技制御用マイクロコンピュータ５６０は、大当り図柄および確変とするか否かを決定するための大当り図柄設定用テーブルを備える。この実施の形態では、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、大当り図柄決定／確変決定用乱数（ランダム２）と、大当り図柄設定用テーブルとにもとづいて、特別図柄の大当り図柄を決定するとともに、確変とするか否かを決定する。

図７６は、遊技制御用マイクロコンピュータ５６０が備える大当り図柄設定用テーブルの例を示す説明図である。この実施の形態では、特別図柄表示装置８には、「左」、「右」の２つの可変表示部（図柄表示エリア）がある。そして、遊技制御用マイクロコンピュータ５６０は、ランダム２に対応する「左」および「右」の特別図柄を、図７６に示す大当り図柄設定用テーブルから抽出する。例えば、ランダム２の値が「０」である場合、遊技制御用マイクロコンピュータ５６０は、図７６に示す大当り図柄設定用テーブルから、「左」の可変表示部の特別図柄として「０」を抽出するとともに、「右」の可変表示部の特別図柄として「０」を抽出する。また、図７６に示す例では、ランダム２の値が１、３、５、７または９である場合に、大当り遊技終了後に、遊技状態（遊技機の制御状態）が確変状態に移行する。

図７７は、第２の実施の形態で用いられる特別図柄および飾り図柄の変動パターン（変動時間）を示す説明図である。図７７に示すＥＸＴとは、それぞれの変動パターンに対応した演出制御コマンド（２バイト構成）の２バイト目のデータである。

この実施の形態では、図７７に示すように、特別図柄や飾り図柄の変動開始前に大当りとすると決定した場合において、変動パターン＃１〜＃４が用いられる。また、この実施の形態では、図７７に示すように、特別図柄や飾り図柄の変動開始前に大当りとしないと決定した場合において、変動パターン＃５〜＃８が用いられる。また、変動パターン＃１〜＃８のそれぞれを示すデータが、ランダム３のとりうる値に対応させて変動パターンテーブルとしてＲＯＭ５４に記憶されている。つまり、遊技制御用マイクロコンピュータ５６０は、抽出されたランダム３の値に応じて、変動パターンテーブルを参照することによって、１つの変動パターンを決定する。なお、この実施の形態では、変動パターン＃１〜＃４を示すデータを大当り決定時変動パターンテーブルともいい、変動パターン＃５〜＃６を示すデータを非大当り決定時変動パターンテーブルともいう。

次に、第２の実施の形態における判定用乱数更新処理（ステップＳ２３）について説明する。図７８および図７９は、第２の実施の形態における判定用乱数更新処理を示すフローチャートである。第１の実施の形態では、図４９に示すように、判定用乱数更新処理において、ＣＰＵ５６は、まず、大当り図柄決定用乱数であるランダム２を更新する処理（ステップＳ２３０１〜Ｓ２３０６参照）を実行したが、この実施の形態では、大当り図柄決定／確変決定用乱数であるランダム２を更新する。

ＣＰＵ５６は、ランダム２（大当り図柄決定／確変決定用乱数）を生成するためのカウンタを１加算する（ステップＳ２３０１ａ）。そして、そのカウンタのカウント値が「１０」よりも小さいかどうか判定する（ステップＳ２３０２ａ）。小さくなければ、すなわち、１０に達していればその値を「０」に戻す（ステップＳ２３０３ａ）。さらに、ＣＰＵ５６は、ランダム２を生成するためのカウンタのカウント値が初期値バッファに設定されている値と一致したか否か確認する（ステップＳ２３０４ａ）。一致していたら、ランダム６を生成するためのカウント値を読み出して初期値決定用乱数を抽出し、その乱数値をランダム２を生成するためのカウンタに設定するとともに（ステップＳ２３０５ａ）、初期値バッファにも格納する（ステップＳ２３０６ａ）。

また、この実施の形態では、第１の実施の形態で示したランダム９（確変決定用乱数）を用いないので、ＣＰＵ５６は、図７９に示すように、判定用乱数更新処理において、ランダム９（確変決定用乱数）を更新する処理（ステップＳ２３１９〜Ｓ２３２４参照）は行わない。なお、判定用乱数更新処理のその他の処理は、第１の実施の形態における処理と同じである。

次に、第２の実施の形態における初期値用乱数更新処理（ステップＳ２４）について説明する。図８０は、第２の実施の形態における初期値用乱数更新処理を示すフローチャートである。初期値決定用乱数更新処理において、ＣＰＵ５６は、ランダム６（大当り図柄決定／確変決定用乱数であるランダム２用の初期値決定用乱数）を生成するためのカウンタを１加算する（ステップＳ２４０１ａ）。そして、そのカウンタのカウント値が「１０」に達しているかどうか判定する（ステップＳ２４０２ａ）。達していれば、その値を「０」に戻す（ステップＳ２４０３ａ）。また、この実施の形態では、第１の実施の形態で示したランダム１２（ランダム９用の初期値決定用乱数）を用いないので、ＣＰＵ５６は、図８０に示すように、初期値用乱数更新処理において、ランダム１２を更新する処理（ステップＳ２４１０〜Ｓ２４１２参照）は行わない。なお、初期値用乱数更新処理のその他の処理は、第１の実施の形態における処理と同じである。

次に、第２の実施の形態における特別図柄通常処理（ステップＳ３００）について説明する。図８１は、第２の実施の形態における特別図柄通常処理を示すフローチャートである。この実施の形態において、ステップＳ３３０１からステップＳ３３０４までの処理は、第１の実施の形態における処理（図５５および図５６参照）と同様である。

保留記憶数の値を１減らし、かつ、各保存領域の内容をシフトすると（ステップＳ３３０４）、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、特別図柄表示装置８の表示結果を大当り図柄とするか否かを判定する特別図柄大当り判定処理を実行する（ステップＳ３６０）。次いで、ＣＰＵ５６は、特別図柄表示装置８に表示させる特別図柄を決定する特別図柄情報設定処理を実行する（ステップＳ３７０）。なお、この実施の形態では、特別図柄大当り判定処理において大当りとすることに決定した場合には、ＣＰＵ５６は、特別図柄情報設定処理において、確変とするか否かも決定することになる。そして、ＣＰＵ５６は、第１の実施の形態と同様に、特別図柄プロセスフラグの値を特別図柄停止図柄設定処理に対応した値に更新する（ステップＳ３３２９）。

次に、特別図柄通常処理における特別図柄大当り判定処理（ステップＳ３６０）について説明する。図８２および図８３は、特別図柄大当り判定処理を示すフローチャートである。特別図柄大当り判定処理において、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、まず、確変終了とするか否かの判定を行う（ステップＳ３３０５ａ〜Ｓ３３０７ａ）。具体的には、確変フラグがセットされている場合（確変時短フラグがセットされている場合を含む）には（ステップＳ３３０５ａ）、ＣＰＵ５６は、確変終了判定用乱数（ランダム８）を保存領域から読み出して（ステップＳ３３０６ａ）、読み出したランダム８の値が、確変終了値と一致するか否か判定し（ステップＳ３３０７ａ）、一致する場合には、確変フラグや確変時短フラグをリセットして確変状態を終了させる（ステップＳ３３１１ａ，Ｓ３３１２ａ）。従って、ランダム８の値にもとづいて確変状態が終了したときに、ステップＳ３３１９ａの大当り判定において低確率状態にもとづく抽選が実行される。なお、ステップＳ３３０５ａで確変フラグがセットされていない場合には、ＣＰＵ５６は、そのままステップＳ３３１６ａに移行し、大当り判定処理を行う。

なお、この実施の形態では、遊技状態が確変状態に制御されている場合には、確変フラグのみがセットされているので、ステップＳ３３１１ａおよびステップＳ３３１２ａにおいて、ＣＰＵ５６は、確変フラグのみのリセットを行い確変状態を終了させることになる。また、遊技状態が確変時短状態に制御されている場合には、確変フラグと確変時短フラグの双方がセットされているので、ステップＳ３３１１ａおよびステップＳ３３１２ａにおいて、ＣＰＵ５６は、確変フラグおよび確変時短フラグの双方をリセットすることになる。

確変フラグや確変時短フラグをリセットすると、ＣＰＵ５６は、時短回数カウンタの値が０になっているか否かを確認する（ステップＳ３３１３ａ）。時短回数カウンタの値が０になっている場合には、ＣＰＵ５６は、通常表示指定の演出制御コマンド（通常表示指定コマンド）を演出制御手段（演出制御基板８０）に送信する処理を実行し（ステップＳ３３１５ａ）、ステップＳ３３１６ａに移行する。演出制御用ＣＰＵ１０１は、通常表示指定コマンドを受信すると、音、表示、発光体などを用いた演出を停止し、確変状態または時短状態（確変時短状態を含む）である旨の報知を終了する。

時短回数カウンタの値が０になっていない場合には、ＣＰＵ５６は、時短フラグをセットし、遊技状態を時短状態に移行させ（ステップＳ３３１４ａ）、ステップＳ３３１６ａに移行する。すなわち、確変時短状態において、確変の終了条件が成立したが時短継続回数が残っているので、ＣＰＵ５６は、遊技状態を確変状態から時短状態に移行させる。なお、遊技状態が確変状態に制御されており、ステップＳ３３１１ａおよびステップＳ３３１２ａにおいて確変フラグのみのリセットを行った場合には、そのままステップＳ３３１５ａに移行し、ＣＰＵ５６は、通常表示指定コマンドを演出制御手段に送信する処理を実行することになる。

ステップＳ３３０７ａにおいて、確変終了としないと判定した場合（すなわち、読み出したランダム８の値が確変終了値と一致しなかった場合）、ＣＰＵ５６は、確変時短フラグがセットされているか否かを確認する（ステップＳ３３０８ａ）。確変時短フラグがセットされている場合、ＣＰＵ５６は、時短回数カウンタの値が０になっているか否かを確認する（ステップＳ３３０９ａ）。時短回数カウンタの値が０になっている場合には、ＣＰＵ５６は、通常表示指定コマンドを演出制御手段に送信する処理を実行し（ステップＳ３３１０ａ）、ステップＳ３３１６ａに移行する。演出制御用ＣＰＵ１０１は、通常表示指定コマンドを受信すると、確変状態または時短状態（確変時短状態を含む）である旨の報知を終了する。なお、ステップＳ３３０９にａおいて、時短回数カウンタが０になっている場合、ＣＰＵ５６は、確変時短フラグをリセットし（すなわち、確変フラグのみがセットされている状態にし）、遊技状態を確変時短状態から確変状態に移行する。また、ステップＳ３３０８ａにおいて確変時短フラグがセットされていなかった場合や、ステップＳ３３０９ａにおいて、時短回数カウンタが０でない場合、ＣＰＵ５６は、そのままステップＳ３３１６ａに移行する。

また、ＣＰＵ５６は、確変フラグがセットされているか否かを確認する（ステップＳ３３１６ａ）。すなわち、ＣＰＵ５６は、遊技状態が確変状態に制御されているか否かを確認する。この場合、ステップＳ３３０７ａで確変状態を終了しないと判定した場合、遊技状態が確変状態に制御されていることになる。また、ステップＳ３３０５ａで確変フラグがセットされていなかった場合や、ステップＳ３３０７ａで確変状態を終了すると判定した場合、遊技状態が確変状態以外の通常状態（時短状態を含む）に制御されていることになる。

確変フラグがセットされていない場合、ＣＰＵ５６は、遊技状態が確変状態以外の通常状態であると判断し、特別図柄表示装置８の表示結果を大当り図柄とするか否かを判定するために用いるテーブルとして、通常時大当り判定テーブル５７１ａ（図３７（Ａ）参照）を設定する（ステップＳ３３１７ａ）。また、確変フラグがセットされている場合、ＣＰＵ５６は、遊技状態が確変状態であると判断し、特別図柄表示装置８の表示結果を大当り図柄とするか否かを判定するために用いるテーブルとして、確変時大当り判定テーブル５７１ｂ（図３７（Ｂ）参照）を設定する（ステップＳ３３１８ａ）。

ＣＰＵ５６は、乱数バッファ領域に格納したランダムＲの値にもとづいて、特別図柄表示装置８の表示結果を大当り図柄とするか否かを判定する（ステップＳ３３１９ａ）。この場合、ＣＰＵ５６は、ステップＳ３３１７ａで設定した通常時大当り判定テーブル５７１ａまたはステップＳ３３１８ａで設定した確変時大当り判定テーブル５７１ｂを用いて、大当りとするか否かを判定する。また、特別図柄表示装置８の表示結果を大当り図柄とすると決定すると、ＣＰＵ５６は、大当り状態であることを示す大当りフラグをオン状態にする（ステップＳ３３２０ａ）。

なお、判定用乱数としてのラウンド数決定用乱数を用いてラウンド数の決定を行う場合には、例えば、ステップＳ３３２０ａにおいて、ＣＰＵ５６は、大当りフラグをオン状態にするとともに、ラウンド数決定用乱数を用いてラウンド数を決定してもよい。例えば、ＣＰＵ５６は、ラウンド数決定用乱数の値に応じて、２回、５回、１０回、または１５回にラウンド数を決定する。

また、ＣＰＵ５６は、大当りとすることに決定すると、時短とするか否かを判定する時短判定処理を行う（ステップＳ３３２５ａ〜Ｓ３３２８ａ）。ＣＰＵ５６は、乱数格納バッファから時短決定用乱数を読み出し（ステップＳ３３２５ａ）、時短判定モジュールを実行する（ステップＳ３３２６ａ）。時短とすることに決定した場合には（ステップＳ３３２７ａ）、ＣＰＵ５６は、時短決定フラグをセットする（ステップＳ３３２８ａ）し、ステップＳ３７０の特別図柄情報設定処理に移行する。

次に、特別図柄通常処理における特別図柄情報設定処理（ステップＳ３７０）について説明する。図８４は、特別図柄情報設定処理を示すフローチャートである。特別図柄情報設定処理において、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、大当りフラグがセットされているか否か確認する（ステップＳ３７１）。すなわち、ＣＰＵ５６は、ステップＳ３６０の特別図柄大当り判定処理において大当りとすると判定されたか否かを確認する。

大当りフラグがセットされている場合（大当りとすると判定された場合）、ＣＰＵ５６は、乱数格納バッファから大当り図柄決定／確変決定用乱数（ランダム２）を読み出す（ステップＳ３７２）。そして、ＣＰＵ５６は、読み出した大当り図柄決定／確変決定用乱数および大当り図柄設定用テーブル（図７６参照）にもとづいて、特別図柄表示装置８に表示させる特別図柄（大当り図柄）を決定する。具体的には、ＣＰＵ５６は、読み出した大当り図柄決定／確変決定用乱数に対応する特別図柄（左）データを、図７６に示す大当り図柄設定用テーブルから抽出する。そして、ＣＰＵ５６は、抽出した特別図柄（左）データに示される図柄を、特別図柄表示装置８の左の図柄表示エリアに表示させる特別図柄として決定する（ステップＳ３７３）。また、ＣＰＵ５６は、読み出した大当り図柄決定／確変決定用乱数に対応する特別図柄（右）データを、図７６に示す大当り図柄設定用テーブルから抽出する。そして、ＣＰＵ５６は、抽出した特別図柄（右）データに示される図柄を、特別図柄表示装置８の右の図柄表示エリアに表示させる特別図柄として決定する（ステップＳ３７４）。

次いで、ＣＰＵ５６は、読み出した大当り図柄決定／確変決定用乱数および大当り図柄設定用テーブル（図７６参照）にもとづいて、確変とするか否かを決定する。具体的には、ＣＰＵ５６は、読み出した大当り図柄決定／確変決定用乱数に対応する遊技状態の情報（確変または通常）を、図７６に示す大当り図柄設定用テーブルから抽出する。そして、ＣＰＵ５６は、抽出した遊技状態の情報の内容が「確変」であるか否かに従って、確変とするか否かを決定する（ステップＳ３７５）。この実施の形態では、読み出した大当り図柄決定／確変決定用乱数の値が１、３、５、７または９である場合、ＣＰＵ５６は、図７６に示す大当り図柄設定用テーブルにもとづいて、確変とすると決定することになる。確変とすることに決定した場合には（ステップＳ３７６）、ＣＰＵ５６は、確変決定フラグをセットする（ステップＳ３７７）。

なお、パンク抽選でなく所定の確変継続回数に達したときに確変状態を終了させる場合には、例えば、ステップＳ３７７において、ＣＰＵ５６は、確変決定フラグをセットするとともに、判定用乱数としての確変回数決定用乱数を用いて確変継続回数を決定する。例えば、ＣＰＵ５６は、確変回数決定用乱数の値に応じて、１００回、２００回、５００回または１０００回に確変継続回数を決定する。

ステップＳ３７１で大当りフラグがセットされていなかった場合（大当りとしないと判定された場合）、ＣＰＵ５６は、乱数格納バッファからはずれ図柄決定用乱数（ランダム１）を読み出す（ステップＳ３７８）。そして、ＣＰＵ５６は、読み出したはずれ図柄決定用乱数にもとづいて、特別図柄表示装置８に表示させる特別図柄（はずれ図柄）を決定する（ステップＳ３７９）。なお、大当りとしないと判定された場合に特別図柄表示装置８に表示させる特別図柄（はずれ図柄）は、１種類（例えば、「左」および「右」の特別図柄とも「−」を表示）だけであってもよい。そのようにすれば、特別図柄情報設定処理において、はずれ図柄を決定する処理（ステップＳ３７８，Ｓ３７９）を行わなくて済むことになる。

図８５は、特別図柄プロセス処理における変動時間設定処理（ステップＳ３０２）を示すフローチャートである。変動時間設定処理において、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、まず、大当りフラグがセットされているか否か確認する（ステップＳ３９１）。すなわち、ＣＰＵ５６は、ステップＳ３６０の特別図柄大当り判定処理において大当りとすると判定されたか否かを確認する。

大当りフラグがセットされている場合（大当りとすると判定された場合）、ＣＰＵ５６は、変動パターンの決定に用いる変動パターンテーブルとして、大当り決定時変動パターンテーブル（図７７に示す変動パターン＃１〜＃４を示すデータ）を設定する（ステップＳ３９２）。また、当りフラグがセットされていない場合（大当りとしないと判定された場合）、ＣＰＵ５６は、変動パターンの決定に用いる変動パターンテーブルとして、非大当り決定時変動パターンテーブル（図７７に示す変動パターン＃５〜＃８を示すデータ）を設定する（ステップＳ３９３）。

変動パターンテーブルを設定すると、ＣＰＵ５６は、乱数格納バッファから変動パターン決定用乱数を読み出し、読み出した変動パターン決定用乱数の値にもとづいて、変動パターンテーブルを用いて特別図柄の変動パターンを決定する（ステップＳ３９４）。具体的には、変動パターン決定用乱数値と一致する判定値に対応した変動パターンが特別図柄表示装置８にて実行される特別図柄の変動パターンと決定される。

次いで、ＣＰＵ５６は、決定された変動パターン（変動時間）に応じた変動パターン指定の演出制御コマンド（変動パターンコマンド）を送信する制御を行う（ステップＳ３９５）。

そして、ＣＰＵ５６は、特別図柄プロセスタイマに変動時間をセットする（ステップＳ３９６）。そして、内部状態（特別図柄プロセスフラグ）をステップＳ３０３に応じた値に更新する（ステップＳ３９７）。

以上のように、この実施の形態では、大当り図柄の決定と確変とするか否かの判定に用いる乱数として、共通のソフトウェア乱数（ランダム２）を用いる。そして、始動口スイッチ通過処理において、共通のソフトウェア乱数として抽出し、始動入賞記憶数の値に対応した保存領域に格納する。そのため、遊技制御において用いる乱数の種類が少なくて済み、保存領域に保存させるべき乱数のデータ容量を低減することができる。

なお、この実施の形態では、共通のソフトウェア乱数を用いて、大当り図柄の決定と確変とするか否かの判定とを行う場合を説明したが、共通の乱数（ランダム２）を用いて他の判定を行ってもよい。例えば、共通の乱数（ランダム２）を用いて、時短とするか否かを決定したり、確変終了とするか否かを決定したり（パンク抽選）、確変継続回数を決定したり、ラウンド数を決定したりしてもよい。この場合、例えば、共通の乱数であるランダム２が１〜３５までの値をとるようにし、ＣＰＵ５６は、ランダム２の値が１〜１０であれば通常大当りと判定し、１１〜２０であれば時短と判定し、２１〜３０であれば確変と判定し、３１〜３５であれば突然確変と判定するようにしてもよい。なお、突然確変とは、確変状態が発生する大当りで、大当り遊技状態が短期間（例えば、大入賞口の開放回数が２回）だけ継続し、大入賞口が短時間だけ開放する場合の大当り遊技のことである。

実施の形態３．
上記に示した各実施の形態では、ラッチ信号生成回路５３３に入力するクロック信号を反転させて、乱数を更新するタイミングと乱数値記憶回路５３１に乱数を記憶させるタイミングとをずらすようにしたが、ラッチ信号生成回路５３３に入力するクロック信号を遅延させるようにしてもよい。以下、ラッチ信号生成回路５３３に入力するクロック信号を遅延させる第３の実施の形態を説明する。

なお、本実施の形態において、第１の実施の形態と同様の構成および処理をなす部分についてはその詳細な説明を省略し、主として第１の実施の形態と異なる部分について説明する。

図８６は、乱数回路５０３の他の構成例を示すブロック図である。なお、この実施の形態において、１２ビット乱数回路５０３ａと１６ビット乱数回路５０３ｂとの基本的な構成は同じである。図８６に示すように、この実施の形態では、乱数回路５０３が、図６で示した反転回路５３２に代えて遅延回路５３２Ａを含む点で、第１の実施の形態と異なる。

遅延回路５３２Ａは、クロック信号出力回路５２４から入力する乱数発生用クロック信号ＳＩ１を遅延させることによって、クロック信号を遅延させた遅延クロック信号ＳＩ４を生成する。また、遅延回路５３２Ａは、生成した遅延クロック信号ＳＩ４をラッチ信号生成回路５３３に出力する。従って、この実施の形態では、ラッチ信号生成回路５３３は、乱数発生用クロック信号ＳＩ１を遅延させた遅延クロック信号ＳＩ４に同期して、乱数値記憶回路５３１にラッチ信号を出力することになる。

なお、遅延回路５３２Ａ以外の乱数回路５０３の各構成要素の基本的な機能は、第１の実施の形態で示したそれらの機能と同様である。

以上に説明したように、この実施の形態では、乱数回路５０３の遅延回路５３２Ａが遅延クロック信号ＳＩ４を生成し、遅延クロック信号ＳＩ４に同期して乱数の記憶を指示するためのラッチ信号を出力する。そのため、乱数を更新するタイミングと乱数値記憶回路５３１に乱数を記憶させるタイミングとをずらすことができ、生成した乱数を安定して確実に記憶させることができる。

実施の形態４．
上記に示した各実施の形態では、ＣＰＵ５６が通信エラー時の割込処理を他の割込処理に優先して実行する場合を説明したが、通信エラー時の割込処理以外の割込処理（例えば、受信時の割込処理）を優先して実行するようにしてもよい。以下、受信時の割込処理を優先して実行する第４の実施の形態を説明する。

なお、本実施の形態において、第１の実施の形態と同様の構成および処理をなす部分についてはその詳細な説明を省略し、主として第１の実施の形態と異なる部分について説明する。

この実施の形態では、ＣＰＵ５６は、図３８および図３９と同様の処理に従ってメイン処理を実行する。メイン処理において、ステップＳ１からステップＳ１５ａまでの処理（ステップＳ８０の処理、ステップＳ９１からステップＳ９３までの処理を含む）は、第１の実施の形態で示したそれらの処理と同様である。また、ステップＳ１６からステップＳ１９までの処理は、第１の実施の形態で示したそれらの処理と同様である。

ステップＳ１５ａのシリアル通信回路設定処理を実行し、シリアル通信回路５０５を初期設定すると、ＣＰＵ５６は、シリアル通信回路５０５の割り込み要求に応じて実行する割込処理の優先順位を初期設定する（ステップＳ１５ｂ）。この実施の形態では、あらかじめ指定情報においてシリアル通信回路５０５が受信データを受信したことを割込原因とする割込処理が指定されている。そして、ＣＰＵ５６は、指定情報にもとづいて、受信データを受信したことを割込原因とする割込処理を優先して実行するように初期設定する。すなわち、この実施の形態では、図４０に示す割込処理優先順位テーブルにおいて、シリアル通信回路５０５において通信エラーが発生したことを割込原因とする割込処理を優先して実行するようにデフォルトで設定されているが、ＣＰＵ５６は、ユーザによって設定された指定情報にもとづいて、受信データを受信したことを割込原因とする割込処理を優先して実行するように割込処理の優先順位を変更する。この場合、例えば、ＣＰＵ５６は、受信データを受信したことを割込原因とする割込処理を優先して実行する旨を示す受信時割込優先実行フラグをセットする。

遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、メイン処理におけるステップＳ１７からステップＳ１９までのループ処理において、割り込み許可状態である間にシリアル通信回路５０５からの割り込み要求があると、図６４に示す処理に従って、シリアル通信回路５０５が割り込み要求を行った割り込み原因に応じた割り込み処理を実行する。

ＣＰＵ５６は、いずれの割込処理を優先して実行する旨が初期設定されているか否かを判断する。例えば、ＣＰＵ５６は、いずれの割込処理を優先して実行する旨のフラグがセットされているか否かを判断する。この実施の形態では、ＣＰＵ５６は、受信時割込優先実行フラグがセットされていることにもとづいて、受信データを受信したことを割込原因とする割込処理を優先して実行する。

シリアル通信回路５０５から割り込み要求があると、ＣＰＵ５６は、シリアル通信回路５０５のステータスレジスタＡ７０５の各ビットを確認し、割り込み原因を特定する。この実施の形態では、ＣＰＵ５６は、ステータスレジスタＡ７０５のビット５を優先的に確認し、割り込み原因を特定する。すなわち、ＣＰＵ５６は、シリアル通信回路５０５が受信データを受信したことを割り込み原因として割り込み要求したか否かを、他の割り込み原因（通信エラーの発生または送信データの送信完了）に優先して判断する。ステータスレジスタＡのビット５が「１」であると判断すると、ＣＰＵ５６は、割り込み原因がシリアル通信回路５０５が受信データを受信したことであると特定する。

割り込み原因がシリアル通信回路５０５が受信データを受信したことであると特定すると、ＣＰＵ５６は、図６４（ｂ）に示す受信時割込処理を優先して実行する。この場合、ＣＰＵ５６は、シリアル通信回路５０５が受信データを受信していることを示す受信時割込フラグをセットする（ステップＳ４２）。

以上に説明したように、この実施の形態では、遊技制御用マイクロコンピュータ５６０は、メイン処理において、割込許可状態に設定する前に、割込処理の優先順位を初期設定する。そのため、複数種類の割込原因に対応する割込処理のうち、優先して実行させるべき割込処理を確実に実行することができる。また、優先して実行させる割込処理を初期設定できるので、遊技制御用マイクロコンピュータ５６０に実行させるプログラムの自由度を向上させることができる。

例えば、賞球処理における受信処理（例えば、ステップＳ１２３４の賞球ＡＣＫ待ち処理）において、ステータスレジスタＡ７０５の各ビットを確認し、シリアル通信回路５０５で通信エラーが発生しているか否かを判断するようなプログラムを組んでいる場合、通信エラーの発生を割込原因とする割込処理を実行しなくても、通信エラーの発生時にコマンドを受信しないように制御できる。従って、受信処理において通信エラーの発生を確認するようなプログラムを組んでいる場合には、データを受信したことを割込原因とする割込処理を優先して実行することによって、遊技制御用マイクロコンピュータ５６０に実行させるプログラムの自由度を向上させることができる。

実施の形態５．
上記に示した各実施の形態では、ＣＰＵ５６が、シリアル通信回路５０５からの割り込み要求に対応する割込処理のうちいずれの割込処理を優先して実行するかを設定または変更する場合を説明したが、さらにタイマ割込とシリアル通信回路５０５からの割り込み要求とが同時に発生した場合に、いずれの割込処理を優先して実行するかを設定または変更できるようにしてもよい。以下、タイマ割込とシリアル通信回路５０５からの割り込み要求とのいずれを優先して割込処理を実行するかを設定または変更する第５の実施の形態を説明する。

なお、本実施の形態において、第１の実施の形態と同様の構成および処理をなす部分についてはその詳細な説明を省略し、主として第１の実施の形態と異なる部分について説明する。

まず、第５の実施の形態におけるメイン処理について説明する。図８７は、第５の実施の形態におけるメイン処理を示すフローチャートである。なお、メイン処理のうち、ステップＳ１からステップＳ６まで（ステップＳ８０を含む）の処理は、第１の実施の形態で示した処理と同様である（図３８参照）。また、図８７に示すメイン処理において、ステップＳ７からステップＳ１５ａまでの処理（ステップＳ９１からステップＳ９３までの処理を含む）は、第１の実施の形態で示したそれらの処理と同様である。また、ステップＳ１６からステップＳ１９までの処理は、第１の実施の形態で示したそれらの処理と同様である。

ステップＳ１５ａのシリアル通信回路設定処理を実行し、シリアル通信回路５０５を初期設定すると、ＣＰＵ５６は、タイマ割込の発生時に実行するタイマ割込処理、およびシリアル通信回路５０５の割り込み要求に応じて実行する割込処理の優先順位を初期設定する（ステップＳ１５ｃ）。

例えば、ＣＰＵ５６は、各割込処理のデフォルトの優先順位を含む所定の割込処理優先順位テーブルに従って、各割込処理の優先順位を初期設定する。図８８は、第５の実施の形態における割込処理優先順位テーブルの例を示す説明図である。この実施の形態では、ＣＰＵ５６は、図８８に示す割込処理優先順位テーブルに従って、シリアル通信回路５０５において通信エラーが発生したことを割込原因とする割込処理を優先して実行するように初期設定する。この場合、例えば、ＣＰＵ５６は、通信エラーが発生したことを割込原因とする割込処理を優先して実行する旨を示す通信エラー時割込優先実行フラグをセットする。

また、ユーザによって各割込処理のデフォルトの優先順位を変更することもできる。例えば、遊技制御用マイクロコンピュータ５６０は、ユーザ（例えば、遊技機の製作者）によって設定された割込処理を指定する指定情報を、あらかじめＲＯＭ５４の所定の記憶領域に記憶している。そして、ＣＰＵ５６は、ＲＯＭ５４の所定の記憶領域に記憶された指定情報に従って、割込処理の優先順位を設定する。

例えば、あらかじめ記憶された指定情報においてタイマ割込処理が指定されている場合を説明する。この場合、ＣＰＵ５６は、指定情報にもとづいて、タイマ割込処理を、シリアル通信回路５０５からの割り込み要求に対する各割込処理（通信エラー時割込処理、受信時割込処理および送信完了割込処理）に優先して実行するように初期設定する。すなわち、図８８に示す割込処理優先順位テーブルにおいて、シリアル通信回路５０５において通信エラーが発生したことを割込原因とする割込処理を優先して実行するようにデフォルトで設定されているが、ＣＰＵ５６は、ユーザによって設定された指定情報にもとづいて、タイマ割込処理を優先して実行するように割込処理の優先順位を変更する。この場合、例えば、ＣＰＵ５６は、タイマ割込処理を優先して実行する旨を示すタイマ割込優先実行フラグをセットする。

遊技制御用マイクロコンピュータ５６０のＣＰＵ５６は、メイン処理におけるステップＳ１７からステップＳ１９までのループ処理において、割り込み許可状態である間にシリアル通信回路５０５からの割り込み要求があると、図６４に示す処理に従って、シリアル通信回路５０５が割り込み要求を行った割り込み原因に応じた割り込み処理を実行する。また、ＣＰＵ５６は、メイン処理におけるステップＳ１７からステップＳ１９までのループ処理において、タイマ割込が発生すると、図４６に示す処理に従ってタイマ割込処理を実行する。

この実施の形態では、タイマ割込とシリアル通信回路５０５からの割り込み要求が同時に発生した場合、ＣＰＵ５６は、いずれの割込処理を優先して実行する旨が初期設定されているか否かを判断する。例えば、ＣＰＵ５６は、いずれの割込処理を優先して実行する旨のフラグがセットされているか否かを判断する。例えば、ＣＰＵ５６は、タイマ割込優先実行フラグがセットされていることにもとづいて、タイマ割込処理を優先して実行する。

以上に説明したように、この実施の形態では、ＣＰＵ５６は、メイン処理において、割込許可状態に設定する前に、タイマ割込処理、およびシリアル通信回路５０５からの割り込み要求に対応する各割込処理の優先順位を初期設定する。そのため、タイマ割込処理や複数種類の割込原因に対応する割込処理のうち、優先して実行させるべき割込処理を確実に実行することができる。また、優先して実行させる割込処理を初期設定できるので、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６に実行させるプログラムの自由度を向上させることができる。

次に、上記に示した各実施の形態における遊技機の他の一例であるスロット機（スロットマシン）の全体の構成について説明する。図８７はスロット機を正面からみた正面図である。

図８９に示すように、スロット機６００は、中央付近に遊技パネル６０１が着脱可能に取り付けられている。また、遊技パネル６０１の前面の中央付近には、複数種類の図柄が可変表示される可変表示装置６０２が設けられている。この実施の形態では、可変表示装置６０２には、「左」、「中」、「右」の３つの図柄表示エリアがあり、各図柄表示エリアに対応してそれぞれ図柄表示リール６０２ａ，６０２ｂ，６０２ｃが設けられている。

遊技パネル６０１の下部には、遊技者が各種の操作を行うための各種入力スイッチ等が配される操作テーブル６２０が設けられている。操作テーブル６２０の奥側には、コインを１枚ずつＢＥＴする（かける）ためのＢＥＴスイッチ６２１、１ゲームでかけることのできる最高枚数（本例では３枚）ずつコインをＢＥＴするためのＭＡＸＢＥＴスイッチ６２２、精算スイッチ６２３、およびコイン投入口６２４が設けられている。コイン投入口６２４に投入されたコインは、図示しない投入コインセンサによって検知される。

操作テーブル６２０の手前側には、スタートスイッチ６２５、左リールストップスイッチ６２６ａ、中リールストップスイッチ６２６ｂ、右リールストップスイッチ６２６ｃおよびコイン詰まり解消スイッチ６２７が設けられている。操作テーブル６２０の手前左右には、それぞれランプ６２８ａ，６２８ｂが設けられている。操作テーブル６２０の下部には、効果音等を出力するスピーカ６３０が設けられている。

遊技パネル６０１の上部には、遊技者に遊技方法や遊技状態等を報知する画像表示装置（ＬＣＤ：液晶表示装置）６４０が設けられている。例えば、入賞発生時に、キャラクタが所定動作を行う画像を画像表示装置６４０に表示することで、後述する当選フラグが設定されていることを遊技者に報知する。また、画像表示装置６４０の左右には、効果音を発する２つのスピーカ６４１Ｌ，６４１Ｒが設けられている。

なお、スロット機６００で発生する入賞役には、小役入賞と、リプレイ入賞と、ビッグボーナス入賞と、レギュラーボーナス入賞とがある。スロット機６００では、スタートスイッチ６２５を操作したタイミングで乱数が抽出され、上記いずれかの入賞役による入賞の発生を許容するか否かを決定する。入賞の発生が許容されていることを、「内部当選している」という。内部当選した場合、その旨を示す当選フラグがスロット機６００の内部で設定される。当選フラグが設定された状態でのゲームでは、その当選フラグに対応する入賞役を引き込むことが可能なようにリール６０２ａ〜６０２ｃが制御される。一方、当選フラグが設定されていない状態でのゲームでは、入賞が発生しないようにリール６０２ａ〜６０２ｃが制御される。

なお、スロット機６００の遊技の進行を制御する遊技制御用マイクロコンピュータは、乱数を発生する乱数回路（１２ビット乱数回路および１６ビット乱数回路）を内蔵する。また、遊技制御用マイクロコンピュータのＣＰＵは、スタートスイッチ６２５を操作したタイミングで、乱数回路が発生した乱数（ランダムＲ）を抽出する。例えば、スタートスイッチ６２５が押下されると、遊技制御用マイクロコンピュータのＣＰＵは、スタートスイッチ６２５から検出信号ＳＳを入力する。また、乱数回路のタイマ回路５３４は、所定時間継続して検出信号ＳＳが入力されたことを検出すると、乱数値取込レジスタ５３９に乱数値取込データ「０１ｈ」を書き込み、ラッチ信号生成回路５３３がラッチ信号ＳＬを乱数値記憶回路５３１に出力する。ラッチ信号ＳＬを入力すると、乱数値記憶回路５３１は、カウンタ５２１が更新したカウント値を読み込んで記憶する。また、遊技制御用マイクロコンピュータのＣＰＵは、所定回数（例えば、３回）継続して検出信号ＳＳが入力されたことを検出すると、出力制御用信号ＳＣを乱数回路の乱数値記憶回路に出力し、乱数回路から乱数値（ランダムＲ）を抽出する。そして、遊技制御用マイクロコンピュータのＣＰＵは、抽出したランダムＲにもとづいて入賞の発生を許容するか否かを決定する。

また、スロット機６００の遊技制御用マイクロコンピュータは、シリアル通信回路を内蔵し、スロット機６００の各制御基板（払出制御基板や演出制御基板）と各種コマンドをシリアル通信する。

次に、スロット機により提供されるゲームの概要について説明する。
例えば、コイン投入口６２４からコインが投入されＢＥＴスイッチ６２１又はＭＡＸＢＥＴスイッチ６２２が押下される等してかけ数が設定されると、スタートスイッチ６２５の操作が有効となる。そして、遊技者によってスタートスイッチ６２５が操作されると、可変表示装置６０２に設けられている各図柄表示リール６０２ａ〜６０２ｃが回転を始める。また、スタートスイッチ６２５を操作したタイミングで、レギュラーボーナス入賞又はビッグボーナス入賞が内部当選した場合には、例えば、画像表示装置６４０に所定のキャラクタが所定の動作を行っている画面を表示する等して、内部当選した旨が遊技者等に報知される。

各図柄表示リール６０２ａ〜６０２ｃが回転を始めてから所定時間が経過すると、各リールストップスイッチ６２６ａ〜６２６ｃの操作が有効となる。この状態で、遊技者が各リールストップスイッチ６２６ａ〜６２６ｃのいずれかを押下すれば、操作されたストップスイッチに対応するリールの回転が停止する。なお、各図柄表示リール６０２ａ〜６０２ｃを停止させずに、所定期間以上放置した場合には、各図柄表示リール６０２ａ〜６０２ｃが自動的に停止する。

すべての図柄表示リール６０２ａ〜６０２ｃが停止した時点で、可変表示装置６０２に表示されている各図柄表示リール６０２ａ〜６０２ｃの上段、中段、下段の３段の図柄中、かけ数に応じて定められる有効な入賞ライン上に位置する図柄の組合せによって入賞したか否かが定められる。かけ数が１の場合には、可変表示装置６０２における中段の横１列の入賞ラインのみが有効となる。かけ数が２の場合には、可変表示装置６０２における上段、中段、下段の横３列の入賞ラインが有効となる。かけ数が３の場合には、可変表示装置６０２における横３列と斜め対角線上２列の合計５本の入賞ラインが有効ラインとなる。

有効ライン上の図柄の組合せが、予め定められた特定の表示態様となって入賞が発生した場合には、音、光、画像表示装置６４０の表示等によって所定の遊技演出がなされ、入賞の発生に応じたゲームが開始される。

スロット機６００では、スロット機６００に搭載されている演出制御手段が、スロット機６００に設けられている画像表示装置６４０の表示制御を行う。画像表示装置６４０には、演出制御手段の制御によって、飾り図柄の変動表示や、遊技状態や遊技方法を報知するための表示等の様々な情報が表示される。そのような、飾り図柄の変動表示や、遊技状態や遊技方法を報知するための表示等の様々な情報の表示をムービー画像により行い、そのムービー画像の表示制御を画像処理装置６４０によって行うようにすればよい。

なお、上述した実施の形態では、以下の（１）〜（４）に示すような遊技機の特徴的構成も示されている。

（１）判定用乱数更新手段は、通常状態であるときに比べて識別情報の可変表示の可変表示期間を短縮する状態である時間短縮状態（例えば、時短状態）に移行させる所定の移行条件（例えば、時短決定用乱数（ランダム１０）が所定値と一致すること）を成立させるか否かを判定するための判定用乱数（例えば、時短決定用乱数（ランダム１０））を更新し、特定遊技種類決定手段は、判定用乱数更新手段によって更新された判定用乱数にもとづいて、所定の移行条件が成立したか否かを判定する移行条件判定手段（例えば、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６におけるステップＳ３３２６を実行する部分）を含み、遊技状態制御手段は、移行条件判定手段によって所定の移行条件が成立したと判定されると、遊技状態を時間短縮状態に移行させる（例えば、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６が、大当り終了後に遊技状態を時短状態に移行させる部分）ように構成されていてもよい。そのような構成によれば、大当り判定用乱数のみを乱数回路を用いて発生させ、時間短縮状態への移行条件が成立したか否かを判定するための乱数としてソフトウェア乱数を用いるので、乱数回路の構成が複雑化することを防止することができる。

（２）判定用乱数更新手段は、識別情報の可変表示の表示結果を特定の表示結果とする確率を向上させた状態である特定有利状態（例えば、確変状態）に移行させる所定の特定移行条件（例えば、確変決定用乱数（ランダム９）が所定値と一致すること）を成立させるか否かを判定するための判定用乱数（例えば、確変決定用乱数（ランダム９））を更新し、特定遊技種類決定手段は、判定用乱数更新手段によって更新された判定用乱数にもとづいて、所定の特定移行条件が成立したか否かを判定する特定移行条件判定手段（例えば、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６におけるステップＳ３３２２を実行する部分）を含み、遊技状態制御手段は、特定移行条件判定手段によって所定の特定移行条件が成立したと判定されると、遊技状態を特定有利状態に移行させる（例えば、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６が、大当り終了後に遊技状態を確変状態に移行させる部分）ように構成されていてもよい。そのような構成によれば、大当り判定用乱数のみを乱数回路を用いて発生させ、特定有利状態への特定移行条件が成立したか否かを判定するための乱数としてソフトウェア乱数を用いるので、乱数回路の構成が複雑化することを防止することができる。

（３）判定用乱数更新手段は、特定遊技状態の継続回数（例えば、ラウンド数）を決定するための判定用乱数（例えば、ラウンド数決定用乱数（ランダム１４））を更新し、特定遊技種類決定手段は、判定用乱数更新手段によって更新された判定用乱数にもとづいて、特定遊技状態の継続回数を決定する継続回数決定手段（例えば、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６が、ランダム１４にもとづいてラウンド数を決定する部分）を含み、遊技状態制御手段は、継続回数決定手段によって決定された継続回数に従って特定遊技状態を継続させる（例えば、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６が、決定されたラウンド数に従って、特別可変入賞球装置２０を開放を継続する部分）ように構成されていてもよい。そのような構成によれば、大当り判定用乱数のみを乱数回路を用いて発生させ、特定遊技状態の継続回数を決定するための乱数としてソフトウェア乱数を用いるので、乱数回路の構成が複雑化することを防止することができる。

（４）判定用乱数更新手段は、特定有利状態を終了する所定の終了条件（例えば、確変終了判定用乱数（ランダム８）が所定値と一致すること）を成立させるか否かを判定するための判定用乱数（例えば、確変終了判定用乱数（ランダム８））を更新し、特定遊技種類決定手段は、判定用乱数更新手段によって更新された判定用乱数にもとづいて、所定の終了条件が成立したか否かを判定する終了条件判定手段（例えば、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６におけるステップＳ３３０７を実行する部分）を含み、遊技状態制御手段は、終了条件判定手段によって所定終了条件が成立したと判定されると、特定有利状態を終了させる（例えば、遊技制御用マイクロコンピュータ５６０のＣＰＵ５６におけるステップＳ３３１１，Ｓ３３１２を実行する部分）ように構成されていてもよい。そのような構成によれば、大当り判定用乱数のみを乱数回路を用いて発生させ、特定有利状態の終了条件が成立したか否かを判定するための乱数としてソフトウェア乱数を用いるので、乱数回路の構成が複雑化することを防止することができる。

本発明は、パチンコ遊技機およびスロット機などの遊技機に適用可能であり、特に、乱数回路およびシリアル通信回路を内蔵する遊技制御用マイクロコンピュータを備えた遊技機に好適に適用できる。

パチンコ遊技機を正面からみた正面図である。 ガラス扉枠を取り外した状態での遊技盤の前面を示す正面図である。 遊技機を裏面から見た背面図である。 遊技制御基板（主基板）の構成例を示すブロック図である。 主基板における回路構成および主基板から演出制御基板に送信される演出制御コマンドの信号線を示すブロック図である。 乱数回路の構成例を示すブロック図である。 更新規則選択レジスタの例を示す説明図である。 更新規則メモリの例を示す説明図である。 カウント値順列変更回路が、カウンタが出力するカウント値の順列を変更する場合の例を示す説明図である。 カウント値順列変更レジスタの例を示す説明図である。 乱数最大値設定レジスタの例を示す説明図である。 周期設定レジスタの例を示す説明図である。 カウント値更新レジスタの例を示す説明図である。 乱数値取込レジスタの例を示す説明図である。 乱数更新方式選択レジスタ、および乱数更新方式選択レジスタに書き込まれる乱数更新方式選択データの一例の説明図である。 乱数回路起動レジスタの例を示す説明図である。 乱数値記憶回路の一構成例を示す回路図である。 乱数値記憶回路に各信号が入力されるタイミング、および乱数値記憶回路が各信号を出力するタイミングを示すタイミングチャートである。 シリアル通信回路の送信部の構成例を示すブロック図である。 シリアル通信回路の受信部の構成例を示すブロック図である。 シリアル通信が各制御基板と送受信するデータのデータフォーマットの例を示す説明図である。 ボーレートレジスタの例を示す説明図である。 制御レジスタＡおよび通信フォーマット設定データの例を示す説明図である。 制御レジスタＢおよび割り込み要求設定データの例を示す説明図である。 ステータスレジスタＡおよびステータス確認データの例を示す図である。 ステータスレジスタＢおよびステータス確認データの例を示す図である。 制御レジスタＣおよびエラー割り込み要求設定データの例を示す説明図である。 シリアル通信回路が備えるデータレジスタの例を示す説明図である。 遊技制御用マイクロコンピュータにおける記憶領域のアドレスマップの一例を示す説明図である。 ユーザプログラム管理エリアにおけるアドレスマップの一例を示す説明図である。 初期値変更方式設定データの一例を示す説明図である。 ユーザプログラムの構成例を示す説明図である。 乱数回路設定プログラムの構成例を示す説明図である。 第１の乱数更新方式が選択されている場合に、ランダムＲの値を更新させたりランダムＲの値を読出したりする動作を示す説明図である。 第２の乱数更新方式が選択されている場合に、ランダムＲの値の更新させたりランダムＲの値を読出したりする動作を示す説明図である。 遊技制御用マイクロコンピュータが備える各メモリを示す説明図である。 大当り判定用テーブルメモリの例を示す説明図である。 遊技制御用マイクロコンピュータが実行するメイン処理を示すフローチャートである。 遊技制御用マイクロコンピュータが実行するメイン処理を示すフローチャートである。 割込処理優先順位テーブルの例を示す説明図である。 乱数回路設定処理を示すフローチャートである。 乱数最大値再設定処理を示すフローチャートである。 初期値変更処理を示すフローチャートである。 乱数回路に各信号が入力されるタイミング、および乱数回路内で各信号が生成されるタイミングを示すタイミングチャートである。 シリアル通信回路設定処理を示すフローチャートである。 タイマ割込処理を示すフローチャートである。 各乱数（ソフトウェア乱数）を示す説明図である。 乱数回路初期値更新処理を示すフローチャートである。 判定用乱数更新処理を示すフローチャートである。 判定用乱数更新処理を示すフローチャートである。 初期値決定用乱数更新処理を示すフローチャートである。 カウント値順列変更処理を示すフローチャートである。 特別図柄プロセス処理の一例を示すフローチャートである。 始動口スイッチ通過処理を示すフローチャートである。 特別図柄通常処理の一例を示すフローチャートである。 特別図柄通常処理の一例を示すフローチャートである。 特別図柄停止処理の一例を示すフローチャートである。 大当り終了処理の一例を示すフローチャートである。 遊技制御手段から払出制御手段に対して出力される制御信号の内容の一例を示す説明図である。 遊技制御手段と払出制御手段との間で送受信される制御コマンドの内容の一例を示す説明図である。 制御信号および制御コマンドの送受信に用いられる信号線等を示すブロック図である。 払出制御信号および払出制御コマンドの出力の仕方の一例を示すタイミング図である。 賞球処理の一例を示すフローチャートである。 シリアル通信回路が割り込み要求に対して行う割り込み処理の一例を示す流れ図である。 賞球個数テーブルの例を示す説明図である。 賞球個数加算処理を示すフローチャートである。 賞球制御処理を示すフローチャートである。 賞球送信待ち処理を示すフローチャートである。 賞球個数コマンド送信処理を示すフローチャートである。 賞球送信完了待ち処理を示すフローチャートである。 賞球ＡＣＫ待ち処理を示すフローチャートである。 賞球再送信処理を示すフローチャートである。 賞球異常検出処理を示すフローチャートである。 主制御通信処理を示すフローチャートである。 第２の実施の形態における各乱数（ソフトウェア乱数）を示す説明図である。 大当り図柄設定用テーブルの例を示す説明図である。 特別図柄および飾り図柄の変動パターン（変動時間）を示す説明図である。 第２の実施の形態における判定用乱数更新処理を示すフローチャートである。 第２の実施の形態における判定用乱数更新処理を示すフローチャートである。 第２の実施の形態における初期値用乱数更新処理を示すフローチャートである。 第２の実施の形態における特別図柄通常処理を示すフローチャートである。 特別図柄大当り判定処理を示すフローチャートである。 特別図柄大当り判定処理を示すフローチャートである。 特別図柄情報設定処理を示すフローチャートである。 変動時間設定処理を示すフローチャートである。 乱数回路の他の構成例を示すブロック図である。 第５の実施の形態におけるメイン処理を示すフローチャートである。 第５の実施の形態における割込処理優先順位テーブルの例を示す説明図である。 スロット機を正面からみた正面図である。

符号の説明

１ パチンコ遊技機
３１ 遊技制御基板（主基板）
３７ 払出制御基板
５６ ＣＰＵ
５０３ａ １２ビット乱数回路
５０３ｂ １６ビット乱数回路
５０５ シリアル通信回路
５２１ カウンタ
５２２ 比較器
５２３ カウンタ値順列変更回路
５２８ セレクタ
５３１ 乱数値記憶回路
５３２ 反転回路
５３２Ａ 遅延回路
５３３ ラッチ信号生成回路
５６０ 遊技制御用マイクロコンピュータ
７１４ 割り込み制御回路
９１０ 電源基板

Claims (10)

1. 各々を識別可能な複数種類の識別情報を可変表示可能な可変表示手段を備え、あらかじめ定められている可変表示の実行条件が成立した後、可変表示の開始条件の成立にもとづいて識別情報の可変表示を開始し、識別情報の可変表示の表示結果が特定の表示結果となったときに遊技者にとって有利な特定遊技状態に移行させる遊技機であって、
   乱数を発生する乱数回路を内蔵し、遊技の進行を制御する遊技制御処理を実行する遊技制御用マイクロコンピュータを備え、
   前記乱数回路は、
   所定の信号の入力にもとづいて、数値データを更新可能な所定の範囲において、所定の初期値から所定の最終値まで予め定められた順序に従って数値データを更新する数値更新手段と、
   前記数値更新手段によって更新された数値データを乱数値として記憶する乱数記憶手段とを含み、
   前記遊技制御用マイクロコンピュータは、
   遊技機への電力供給が開始されたときに、前記乱数回路の初期設定を行う乱数回路初期設定手段と、
   前記乱数回路初期設定手段が前記乱数回路の初期設定を行ったあとに、所定時間毎にタイマ割込を発生させるための設定をするタイマ割込設定手段と、
   前記タイマ割込が発生したときに、前記遊技制御処理を含むタイマ割込処理を実行するタイマ割込処理実行手段と、
   前記タイマ割込処理実行手段によるタイマ割込処理において、前記特定遊技状態の種類を決定するための決定用乱数を、更新可能な所定の範囲において、所定の更新初期値から所定の更新最終値まで循環的に更新する決定用乱数更新手段と、
   前記タイマ割込処理実行手段によるタイマ割込処理において、可変表示の実行条件が成立したか否かを判定する実行条件判定手段と、
   前記実行条件判定手段により可変表示の実行条件が成立したと判定されたときに、前記乱数記憶手段が記憶する乱数値を読み出す乱数読出手段と、
   可変表示の開始条件が成立したときに、前記乱数読出手段によって読み出された乱数値が所定の判定値と合致するか否かを判定することによって、前記識別情報の可変表示の表示結果を特定の表示結果とするか否かを決定する表示結果決定手段と、
   前記表示結果決定手段が前記識別情報の可変表示の表示結果を特定の表示結果とすると決定したときに、前記決定用乱数更新手段によって更新された前記決定用乱数にもとづいて、前記特定遊技状態の種類を決定する特定遊技種類決定手段と、
   前記特定遊技種類決定手段によって決定された前記特定遊技状態の種類に従って、遊技状態を制御する遊技状態制御手段とを含み、
   前記乱数回路初期設定手段は、前記初期設定において、前記数値更新手段が更新する数値データの前記所定の初期値を、前記遊技制御用マイクロコンピュータ毎に付与された前記遊技制御用マイクロコンピュータを識別するためのマイコン識別情報にもとづいて設定する
   ことを特徴とする遊技機。
2. 遊技制御用マイクロコンピュータは、
   決定用乱数の所定の更新初期値を決定するための初期値決定用乱数を更新する初期値用乱数更新手段と、
   決定用乱数更新手段によって前記決定用乱数が前記所定の更新初期値から所定の更新最終値まで更新されたときに、前記初期値用乱数更新手段によって更新された初期値決定用乱数の値を、前記決定用乱数の前記所定の更新初期値として設定する決定用乱数初期値設定手段とを含み、
   前記決定用乱数更新手段は、前記決定用乱数初期値設定手段によって前記決定用乱数の前記所定の更新初期値が設定されたときには、設定された前記所定の更新初期値から前記決定用乱数の更新を再び開始する
   請求項１記載の遊技機。
3. 遊技制御用マイクロコンピュータは、数値更新手段が更新可能な数値データの所定の範囲が異なる乱数回路を複数内蔵し、
   乱数回路初期設定手段は、初期設定において、前記遊技制御用マイクロコンピュータが内蔵する複数の乱数回路の中から使用可能な乱数回路を設定し、
   前記乱数回路初期設定手段により使用可能と設定された乱数回路以外の乱数回路の機能を停止させる乱数回路停止手段を備えた
   請求項１又は請求項２記載の遊技機。
4. 乱数回路初期設定手段は、初期設定において、数値データが更新される所定の範囲の最大値としての値が設定される数値最大値レジスタに、数値更新手段により更新可能な数値データの範囲内において所定の最大値を設定し、
   数値更新手段は、
   前記乱数回路初期設定手段により設定された前記所定の最大値が、所定の下限値以下であるか否かを判定する設定値判定手段と、
   前記設定値判定手段によって前記数値最大値レジスタに設定された前記所定の最大値が前記所定の下限値以下であると判定されたときに、前記数値最大値レジスタに、前記数値更新手段により更新可能な数値データの範囲内の所定値を設定しなおす最大値再設定手段とを含む
   請求項１から請求項３のうちいずれかに記載の遊技機。
5. 所定周期のクロック信号を生成し、乱数回路に出力するクロック信号生成手段を備え、
   数値更新手段は、前記クロック信号を所定回数入力したことを条件に、数値データを更新し、
   乱数回路初期設定手段は、初期設定において、前記数値更新手段が数値データを更新する条件であるクロック信号の入力回数を設定する
   請求項１から請求項４のうちいずれかに記載の遊技機。
6. 遊技制御用マイクロコンピュータは、乱数回路初期設定手段によって設定される数値データの所定の初期値を、マイコン識別情報を用いて演算する数値演算手段を含み、
   前記乱数回路初期設定手段は、前記数値演算手段による演算によって算出された値にもとづいて初期値を設定する
   請求項１から請求項５のうちいずれかに記載の遊技機。
7. 遊技領域における入賞領域に遊技媒体が入賞したことを検出して入賞検出信号を出力する入賞検出手段を備え、
   乱数回路は、前記入賞検出手段からの入賞検出信号が入力されたことにもとづいて、数値更新手段が更新する数値データを乱数記憶手段に記憶させるためのラッチ信号を出力するラッチ信号出力手段を含み、
   前記ラッチ信号出力手段は、前記入賞検出手段から入賞検出信号が所定期間継続して入力されたことを条件に、前記ラッチ信号を出力する
   請求項１から請求項６のうちいずれかに記載の遊技機。
8. 実行条件判定手段は、入賞検出手段からの入賞検出信号が所定回数のタイマ割込処理が実行されるに亘って入力されたことを条件に、可変表示の実行条件が成立したと判定し、
   所定期間は前記所定回数の前記タイマ割込処理が実行される期間よりも短い
   請求項７記載の遊技機。
9. 乱数回路初期設定手段は、初期設定において、数値更新手段によって所定の最終値まで数値データが更新されたときに、前記乱数回路初期設定手段が設定した所定の初期値を変更するか否かを設定し、
   乱数回路は、前記数値更新手段によって前記所定の最終値まで数値データが更新されたきに、数値データが前記所定の最終値まで更新された旨を示す通知信号を出力する通知信号出力手段と、
   前記通知信号が出力されたことにもとづいて、前記乱数回路初期設定手段によって初期値を変更する設定がされているときに、前記所定の初期値の値を変更する初期値変更手段とを含む
   請求項１から請求項８のうちいずれかに記載の遊技機。
10. 乱数回路初期設定手段は、初期設定において、前記数値更新手段が更新する数値データの所定の初期値から所定の最終値までの値の並び順を変更するか否かを設定する数値順設定手段を含み、
    乱数回路は、
    前記数値更新手段によって所定の最終値まで数値データが更新されたときに、数値データが前記所定の最終値まで更新された旨を示す通知信号を出力する通知信号出力手段と、
    前記通知信号が出力されたことにもとづいて、前記乱数回路初期設定手段によって、数値データの前記所定の初期値から前記所定の最終値までの並び順を変更する設定がされているときに、前記数値更新手段が更新する数値データの前記所定の初期値から前記所定の最終値までの並び順を変更する数値順変更手段とを含む
    請求項１から請求項９のいずれかに記載の遊技機。

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