JP2006211681A - 優先待ち行列を伴うフィルタベースのイーサネット・パケット・ルータを備えた高速イーサネットmacとphy装置および単一もしくは多数のトランスポート・ストリーム・インターフェース - Google Patents
優先待ち行列を伴うフィルタベースのイーサネット・パケット・ルータを備えた高速イーサネットmacとphy装置および単一もしくは多数のトランスポート・ストリーム・インターフェース Download PDFInfo
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Abstract
【解決手段】セットトップボックスなどのような音声映像コンテンツ配信システムがLANとインターフェースする。このシステムのパケット処理回路はLANから特定のポートや待ち行列へ受信されるイーサネット・パケット・データをホスト・プロセッサの介入なしでフィルタ処理し、経路指定する。パケット処理回路は様々なインターネットIETFのネットワーク化トランスポート・プロトコルを解釈するためにハードウェアによるフィルタ処理と経路指定用メカニズムのセットを利用し、各々がデコーダへと連結される多様な民生用サブシステムによって識別されるフォーマットでパケット・データを転送する。
【選択図】図4
Description
EN 50083−9:1998「Cable networks for television signals,sound signals and interactive services――Part9:Interfaces for CATV/SMATV head ends and similar professional equipment for DVB/MPEG−2 transport stream」 EN 50083−9:2002「Cable networks for television signals,sound signals and interactive services――Part9:Interfaces for CATV/SMATV head ends and similar professional equipment for DVB/MPEG−2 transport stream」
Claims (21)
- セントラル・コントローラへ目標を定められたイーサネット・パケットを受信することと、
前記イーサネット・パケットを、そのイーサネット・パケットに対応する経路指定情報を識別することを含むフィルタ処理することと、
前記経路指定情報に従ってトランスポート・ストリーム・インターフェース(TSI)を経由して前記イーサネット・パケットの少なくとも第1の部分を前記セントラル・コントローラへ経路指定することとを含み、
前記イーサネット・パケットがイーサネット・プロトコルに従った1つまたは複数のカプセル化ヘッダを含み、前記経路指定情報を識別することが前記1つまたは複数のカプセル化ヘッダから得られる情報を使用して行われ、
前記TSIがリアルタイムのデータおよび/または非リアルタイムのデータを転送するように構成されることを特徴とするデータを配信する方法。 - 前記TSIが、
エラー信号と、
データ有効信号と、
パケット・クロック信号と、
トランスポート・ストリーム・データ・バスと、さらに
オクテット・クロック信号、
ニブル・クロック信号、
ビット・クロック信号のうちの1つを含む専用のインターフェースであって、
前記トランスポート・ストリーム・データ・バスが、
8ビットのトランスポート・ストリーム、
4ビットのトランスポート・ストリーム、
シリアル・トランスポート・ストリームのうちの1つまたは複数を転送するように構成される、請求項1に記載の方法。 - 前記経路指定情報を識別する前記が第1の行き先ポートを識別することを含み、前記TSIを経由して前記イーサネット・パケットの少なくとも第1の部分を前記セントラル・コントローラへ経路指定することが、前記TSIを経由して前記イーサネット・パケットの少なくとも前記第1の部分を前記第1の行き先ポートへ経路指定することを含む、請求項1に記載の方法。
- 前記カプセル化ヘッダが、
MACヘッダと、
IPヘッダ情報と、
TCPヘッダ情報、UDPヘッダ情報のうちの1つまたは複数を含むトランスポート層ヘッダと、
HTTPヘッダ情報、RTPヘッダ情報、RTSPヘッダ情報、FTPヘッダ情報、TFTPヘッダ情報のうちの1つまたは複数を含むアプリケーション層ヘッダと
とを有する、請求項1に記載の方法。 - 前記受信、前記フィルタ処理、前記経路指定が複数のイーサネット・パケットに関して遂行される、請求項1に記載の方法。
- ホスト・コントローラへ目標を定められたデータ・パケットを受信するように構成されたコントローラ回路と、
前記コントローラ回路の出力部に連結されるように構成された入力部を備えたルータ回路とを有し、前記ルータ回路が各々のデータ・パケットをフィルタ処理し、かつ前記データ・パケットに対応するそれぞれの経路指定情報を得るように動作可能であり、さらに第1のインターフェースを介して、前記データ・パケットに対応する前記それぞれの経路指定情報に従って各々のデータ・パケットの少なくとも第1の部分を前記ホスト・コントローラへ経路指定するように動作可能であり、
各々のデータ・パケットがそれぞれのヘッダ情報を含み、前記それぞれの経路指定情報が前記それぞれのヘッダ情報から得られ、
前記第1のインターフェースがリアルタイムのデータおよび/または非リアルタイムのデータを転送するように構成されることを特徴とするデータを配信するシステム。 - 行き先ポートの第1のセットに対応する前記第1のインターフェースが、出力部と、前記ルータ回路の出力部に結合するように構成された入力部とを有し、
前記システムが、前記ルータ回路のI/O接続部に結合するように構成された第1のI/O接続部を有する、行き先ポートの第2のセットに対応する第2のインターフェースをさらに有し、
前記ルータ回路がさらに、
前記それぞれの経路指定情報が行き先ポートの前記第1のセットを示していれば、前記第1のインターフェースを経由して各々のデータ・パケットの少なくとも前記第1の部分を前記ホスト・コントローラへ経路指定し、かつ
前記それぞれの経路指定情報が行き先ポートの前記第2のセットを示していれば、前記第2のインターフェースを経由して前記データ・パケットの少なくとも前記第1の部分を前記ホスト・コントローラへ経路指定するように動作可能である、請求項6に記載のシステム。 - 前記ルータ回路の前記出力部に結合するように構成された入力部と前記第1のインターフェースの前記入力部に結合するように構成された出力部とを各々が有する1つまたは複数の第1のバッファであって、前記ルータ回路がさらに各々のデータ・パケットを1つまたは複数の前記第1のバッファの中に保存し、かつ前記第1のインターフェースを介して前記データ・パケットを保持する前記1つまたは複数の前記第1のバッファから前記ホスト・コントローラへ各々のデータ・パケットの前記第1の部分を経路指定するように動作可能である第1のバッファ、および
前記ルータ回路の前記I/O接続部に結合するように構成された第1のI/O接続部と前記第2のインターフェースのI/O接続部に結合するように構成された第2のI/O接続部を有する1つまたは複数の第2のバッファであって、前記ルータ回路がさらに各々のデータ・パケットを1つまたは複数の前記第2のバッファの中に保存し、かつ前記第2のインターフェースを介して前記データ・パケットを保持する前記1つまたは複数の前記第2のバッファから前記ホスト・コントローラへと各々のデータ・パケットの前記第1の部分を経路指定するように動作可能である第2のバッファ
の1つまたは複数をさらに有する、請求項7に記載のシステム。 - 前記経路指定情報が第1の行き先ポートを示し、
前記第1のインターフェースを経由して各々のデータ・パケットの少なくとも前記第1の部分を前記ホスト・コントローラへ経路指定する過程で、前記第1のポートが行き先ポートの前記第1のセットの中に含まれ、
前記第2のインターフェースを経由して各々のデータ・パケットの少なくとも前記第1の部分を前記ホスト・コントローラへ経路指定する過程で、前記第1のポートが行き先ポートの前記第2のセットの中に含まれる、請求項7に記載のシステム。 - 前記経路指定情報がさらに第2の行き先ポートを示し、前記ルータ回路がさらに、
前記第2の行き先ポートがポートの前記第1のセットに含まれる場合に前記第1のインターフェースを経由して前記データ・パケットの少なくとも第2の部分を前記ホスト・コントローラへ経路指定し、
前記第2の行き先ポートがポートのポートの前記第2のセットに含まれる場合に前記第2のインターフェースを経由して前記データ・パケットの少なくとも第2の部分を前記ホスト・コントローラへ経路指定するように動作可能である、請求項9に記載のシステム。 - 前記コントローラ回路が、前記第2のインターフェースの第2のI/O接続部に結合された第2のI/O接続部をさらに有し、それにより、前記コントローラ回路と前記第2のインターフェースの間にI/O経路を確立し、前記コントローラ回路がさらに前記I/O経路上で前記第2のインターフェースを経由して、各々のデータ・パケットに対応するそれぞれのリアルタイムの状態/制御情報を前記ホスト・コントローラへ経路指定するように動作可能である、請求項7に記載のシステム。
- 前記コントローラ回路がイーサネット制御装置を有し、前記データ・パケットがイーサネット・パケットを含み、前記イーサネット・パケットが、
多数の転送速度をサポートする単一で有線のイーサネット接続と、
多数の転送速度をサポートする単一で無線のイーサネット接続のいずれか一方で前記イーサネット制御装置によって受信される、請求項6に記載のシステム。 - 前記第2のインターフェースが、
PCI、VCI、PVCI、AHBインターフェース、ASBインターフェース、APBインターフェース、カード・バス・インターフェース、ローカル・バス・インターフェース、CPUホスト・バス・インターフェースのうちの1つを含む共用システム・インターフェースと、
DDRインターフェース、DDR2インターフェース、SDRAMインターフェース、SRAMインターフェース、Flash RAMインターフェースのうちの1つを含むメモリ・インターフェースと
のいずれか一方を有する、請求項12に記載のシステム。 - 各々のデータ・パケットがさらにペイロード・データを含む、請求項6に記載のシステム。
- 前記ペイロード・データが音声コンテンツおよび/または映像のコンテンツを含み、前記データ・パケットの前記第1の部分が前記ペイロード・データである、請求項14に記載のシステム。
- 前記ルータ回路がさらに、前記それぞれのヘッダ情報を含む前記データ・パケットがリアルタイムの接続で前記コントローラ回路によって受信されれば、前記それぞれのヘッダ情報にタイムスタンプ・データを追加するように動作可能である、請求項14に記載のシステム。
- 前記リアルタイムの接続が、
RTPと、
RTCPのうちの一方を利用する、請求項16に記載のシステム。 - 前記ルータ回路がさらに、前記経路指定情報が得られるとすぐに、かつ前記データ・パケットが全部受信され終わる前に、前記データ・パケットの前記第1の部分の経路指定を開始するように動作可能である、請求項6に記載のシステム。
- 集積回路である、請求項6に記載のシステム。
- 入力部、出力部、およびI/O接続部を有するシステム・オン・チップ(SOC)コントローラをさらに含み、
前記コントローラ回路が、第1のI/O接続部と出力部を有し、かつ前記第1のI/O接続部で前記データ・パケットを受信するように動作可能であるイーサネット制御装置を含み、各々のデータ・パケットが前記SOCコントローラへ目標を定められたイーサネット・パケットを含み、
前記ルータが、各々のイーサネット・パケットに対応するそれぞれの第1の行き先ポートを識別するように動作可能であり、前記ルータ回路が出力部とI/O接続部をさらに有し、
前記システムがさらに、
前記ルータ回路の前記出力部に結合した入力部を含み、かつ前記SOCコントローラの前記入力部のうちの第1の入力部に結合した出力部をさらに含む専用のTSIであって、行き先ポートの第1のセットに対応するTSIと、
前記ルータ回路の前記I/O接続部に結合した第1のI/O接続部を含み、かつ前記SOCコントローラの前記I/O接続部の第1の接続部に結合した第2のI/O接続部をさらに含む第2のインターフェースであって、行き先ポートの第2のセットに対応する第2のインターフェースを含み、
前記ルータ回路がさらに、
前記第1の行き先ポートがポートの前記第1のセットに含まれる場合に前記TSIを経由して各々のイーサネット・パケットの少なくとも前記第1の部分を前記SOCコントローラへ経路指定し、
前記第1の行き先ポートがポートの前記第2のセットに含まれる場合に前記第2のインターフェースを経由して各々のイーサネット・パケットの少なくとも前記第2の部分を前記SOCコントローラへ経路指定するように動作可能であり、
前記SOCコントローラが、各々のイーサネット・パケットの前記経路指定された第1の部分を処理し、それによって目標のデータを入手し、前記目標のデータを1つまたは複数の目標のデバイスへと供給するように動作可能である、請求項6に記載のシステム。 - 前記1つまたは複数の目標のデバイスが、
1つまたは複数の音声用デジタル/アナログ変換器(DAC)と、
1つまたは複数の映像用DACのうちの1つまたは複数とを有する、請求項20に記載のシステム。
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