CN204361080U - 电路系统及其芯片封装 - Google Patents
电路系统及其芯片封装 Download PDFInfo
- Publication number
- CN204361080U CN204361080U CN201520071156.9U CN201520071156U CN204361080U CN 204361080 U CN204361080 U CN 204361080U CN 201520071156 U CN201520071156 U CN 201520071156U CN 204361080 U CN204361080 U CN 204361080U
- Authority
- CN
- China
- Prior art keywords
- pin
- chip package
- pcb
- circuit board
- printed circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48245—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
- H01L2224/48247—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
Landscapes
- Lead Frames For Integrated Circuits (AREA)
Abstract
本实用新型提供一种电路系统及其芯片封装,其中,芯片封装包括:托盘部;多个金属引线;晶片,其具有第一表面和第二表面,晶片的第一表面粘结于托盘部上,其第二表面上形成有多个压焊区;多个第一引脚,每个第一引脚与晶片上的一个压焊区通过一个金属引线相连;多个第二引脚,每个第二引脚与所述晶片上的一个压焊区通过一个金属引线相连;塑封体,包裹托盘部、金属引线、晶片、第一引脚的部分和第二引脚的部分,其中第一引脚暴露于所述塑封体外形成第一安装面,第二引脚暴露于所述塑封体外形成第二安装面,第一安装面与第二安装面平行并相隔。这样,该芯片封装可以同时与两个印刷电路板电性相连,从而实现更高密度的器件和电气连接。
Description
【技术领域】
本实用新型涉及半导体领域,特别涉及一种电路系统及其芯片封装。
【背景技术】
现有技术中,一般封装的管脚都位于芯片的底部,这样可以方便的安装在印刷电路板(PCB:Printed Circuit Board)的表面上。图1是现有技术的一种芯片封装的仰视图(Bottom View,即从底部看)。该封装有8个管脚,每边有2个管脚,如斜线填充图形所示。通过焊接可以将这些管脚与印刷电路板相连接。图2是现有技术的芯片封装的俯视图(Top view),在该芯片的上表面没有任何管脚。但随着电子设备小型化发展,希望能在更小的面积下安装更多器件,所以有必要进行进一步改进。
因此,有必要提出一种改进的芯片封装方案来克服上述问题。
【实用新型内容】
本实用新型的目的之一在于提供一种芯片封装,其能够与两个印刷电路板相连,可以实现更高密度的器件和电气连接。为了解决该问题,本实用新型提供一种芯片封装,其包括:托盘部;多个金属引线;晶片,其具有第一表面和第二表面,所述晶片的第一表面粘结于所述托盘部上,其第二表面上形成有多个压焊区;多个第一引脚,每个第一引脚与所述晶片上的一个压焊区通过一个金属引线相连;多个第二引脚,每个第二引脚与所述晶片上的一个压焊区通过一个金属引线相连;塑封体,包裹所述托盘部、金属引线、晶片、第一引脚的部分和第二引脚的部分,其中第一引脚暴露于所述塑封体外形成第一安装面,第二引脚暴露于所述塑封体外形成第二安装面,第一安装面与第二安装面平行并相隔。
进一步的,所述晶片位于第一安装面和第二安装面之间。
进一步的,所述晶片的部分压焊区与第一引脚相连,部分压焊区与第二引脚相连,所述晶片内包括与第一引脚相连的第一功能区电路和与第二引脚相连的第二功能区电路。
进一步的,所述芯片封装的第一引脚电性连接至第一印刷电路板上,第二引脚电性连接至第二印刷电路板上。
进一步的,所述晶片上的至少部分压焊区既通过金属引线与第一引脚相连,又通过金属引线与第二引脚相连,所述晶片内包括有第三功能区电路,该第三功能区电路与第一印刷电路板上的器件以及第二印刷电路板上的器件联合共同实现一个功能。
进一步的,芯片封装还包括:金属散热区,其与多个第二引脚位于同一个平面上,所述金属散热区的一个表面暴露于所述塑封体外,并与第二印刷电路板上的散热区相连。
进一步的,所述托盘部的一个表面暴露于所述塑封体外,并与第一印刷电路板上的散热区相连,晶片的第一表面紧贴所述托盘部。
进一步的,所述托盘部、第一引脚、第二引脚或金属散热区均由同一个引线框分割形成。
本实用新型的目的之二在于提供一种电路系统,其可以实现更高密度的器件和电气连接。为了解决该问题,本实用新型提供一种电路系统,其包括:第一印刷电路板,第二印刷电路板和芯片封装,所述芯片封装的第一引脚电性连接至第一印刷电路板上,第二引脚电性连接至第二印刷电路板上,第一印刷电路板与第二印刷电路板平行。所述芯片封装,其包括:托盘部;多个金属引线;晶片,其具有第一表面和第二表面,所述晶片的第一表面粘结于所述托盘部上,其第二表面上形成有多个压焊区;多个第一引脚,每个第一引脚与所述晶片上的一个压焊区通过一个金属引线相连;多个第二引脚,每个第二引脚与所述晶片上的一个压焊区通过一个金属引线相连;塑封体,包裹所述托盘部、金属引线、晶片、第一引脚的部分和第二引脚的部分,其中第一引脚暴露于所述塑封体外形成第一安装面,第二引脚暴露于所述塑封体外形成第二安装面,第一安装面与第二安装面平行并相隔。
与现有技术相比,本实用新型中的芯片封装具有两组引脚,每组引脚形成一个安装面,这样该芯片封装可以同时与两个印刷电路板电性相连,从而实现更高密度的器件和电气连接。
【附图说明】
为了更清楚地说明本实用新型实施例的技术方案,下面将对实施例描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本实用新型的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动性的前提下,还可以根据这些附图获得其它的附图。其中:
图1是现有芯片封装的仰视示意图;
图2是现有芯片封装的俯视示意图;
图3是本实用新型中的芯片封装的仰视示意图;
图4是本实用新型中的芯片封装的俯视示意图;
图5是本实用新型中的芯片封装的横向剖视示意图;
图6是本实用新型中的引线框条带在一个实施例中的俯视示意图;
图7是本实用新型中的芯片封装与两个印刷电路板安装在一起的结构示意图;
图8是本实用新型中的引线框的第二引脚所在平面的结构示意图。
【具体实施方式】
为使本实用新型的上述目的、特征和优点能够更加明显易懂,下面结合附图和具体实施方式对本实用新型作进一步详细的说明。
此处所称的“一个实施例”或“实施例”是指可包含于本实用新型至少一个实现方式中的特定特征、结构或特性。在本说明书中不同地方出现的“在一个实施例中”并非均指同一个实施例,也不是单独的或选择性的与其他实施例互相排斥的实施例。除非特别说明,本文中的连接、相连、相接的表示电性连接的词均表示直接或间接电性相连。
图3是本实用新型中的芯片封装300的仰视示意图;图4是本实用新型中的芯片封装300的俯视示意图;图5是本实用新型中的芯片封装300的横向剖视示意图。
结合图3-图5所示,所述芯片封装包括多个第一引脚310、多个第二引脚320、晶片330、托盘部340、多个金属引线350和塑封体(未图示)。
所述晶片330具有第一表面和第二表面,所述晶片330的第一表面粘结于所述托盘部340上,其第二表面上形成有多个压焊区(PAD,未图示)。每个第一引脚310与所述晶片330上的一个压焊区通过一个金属引线350相连。每个第二引脚320与所述晶片330上的一个压焊区通过一个金属引线350相连。所述塑封体包裹所述托盘部340、金属引线350、晶片330、第一引脚310的部分和第二引脚320的部分,其中第一引脚310暴露于所述塑封体外形成第一安装面,第二引脚320暴露于所述塑封体外形成第二安装面,第一安装面与第二安装面平行并相隔。
所述晶片330位于第一安装面和第二安装面之间。所述金属引线350可以为铜线或金线或铝线。
如图7所示,所述芯片封装300的形成第一安装面的第一引脚电性连接至第一印刷电路板710上,形成第二安装面的第二引脚电性连接至第二印刷电路板720上,所述芯片封装300位于第一印刷电路板710和第二印刷电路板720之间。第一块印刷电路板710可以与第二块印刷电路板720存在电气连接;也可以彼此独立,无电气连接。通过本实用新型的实现方式,可以实现在有限的面积中,芯片封装与两个印刷电路板堆叠,从而实现更高密度的器件和电气连接。在另一个优选的实施例中,可以包括有多个印刷电路板和多个芯片封装300,多个印刷电路板平行方式,每两个相邻的印刷电路板之间安装一个芯片封装300,这样可以实现更高密度的器件和电气连接。
在一个实施例中,所述晶片330的部分压焊区与第一引脚相连,部分压焊区域第二引脚相连,所述晶片330内包括与第一引脚相连的第一功能区电路和与第二引脚相连的第二功能区电路。所述晶片330的第一功能区电路(也可以被称为第一电路)能够通过第一引脚与第一印刷电路板进行信号交互以实现一定的逻辑功能,所述晶片330的第二功能区电路(也可以被称为第二电路)能够通过第二引脚与第二印刷电路板进行信号交互以实现一定的逻辑功能。第一功能区电路和第二功能区电路之间可以进行数据或信号交互,也可以不进行数据或信号交互。
在另一个实施例中,所述晶片330上的至少部分压焊区既通过金属引线与第一引脚310相连,又通过金属引线与第二引脚320相连,所述晶片330内包括有第三功能区电路,该第三功能区与第一印刷电路板710上的器件以及第二印刷电路板720上的器件联合共同实现一个功能。
在一种实现方式中,第一印刷电路板710或第二印刷电路板720为便携式电子设备的外壳,可以利用金属外壳或塑料外壳的金属镀层来进行芯片电气连接。在一个优选的实施例中,如图8所示的,所述芯片封装300还包括金属散热区360。该金属散热区360与多个第二引脚320位于同一个平面上,所述金属散热区的一个表面暴露于所述塑封体外,并与第二印刷电路板上的散热区(即金属外壳或塑料外壳的金属镀层)相连,起到增强散热的作用。
在另一个优选的实施例中,可以将所述托盘部340的一个表面暴露于所述塑封体外,并与第一印刷电路板710上的散热区相连,且晶片330的第一表面(即下表面)紧贴所述托盘部340,这样,托盘部340也可作为金属散热区使用,方便晶片330通过其第一表面散热,起到增强散热的作用。
需要知道的是,所述托盘部340、第一引脚310、第二引脚320或/或金属散热区360均由同一个引线框分割形成。
根据本实用新型的一个方面,本实用新型还提供一种芯片封装的封装方法,可以用于制造得到上文中提到的芯片封装300。所述方法包括如下步骤。
步骤一、提供一个引线框条带600,如图5所示,该引线框条带包括有连接部620以及连接至所述连接部620的多个引线框610A,610B,610C,610D,这里示出了四个引线框作为示例,还可以有更多个引线框。每个引线框包括连接至所述连接部上的第一引脚310、第二引脚320和托盘部340,其中第一引脚310和托盘部340位于第一平面,第二引脚320位于第二平面,第一平面和第二平面相互平行并相互间隔。
步骤二、将多个晶片330的第一表面粘结至对应的引线框的托盘部340上,每个晶片的第二表面上形成有多个压焊区。
步骤三、引线焊接(wire bonding)以使得每个引线框的第一引脚310与对应的晶片330上的一个压焊区通过一个金属引线350相连,每个引线框的每个第二引脚320与所述晶片330上的一个压焊区通过一个金属引线350相连。
步骤四、塑封(molding)以形成多个塑封体,每个塑封体包裹对应的托盘部340、金属引线350、晶片330、第一引脚310的部分和第二引脚320的部分,其中第一引脚310暴露于所述塑封体外形成第一安装面,第二引脚320暴露于所述塑封体外形成第二安装面,第一安装面与第二安装面平行并相隔。
步骤五、去溢料、切筋以形成上文中的芯片封装。此步骤属于所属领域内的普通技术人员所熟知的内容,这里就不在重复了。
在本实用新型中,“连接”、“相连”、“连”、“接”等表示电性连接的词语,如无特别说明,则表示直接或间接的电性连接。
需要指出的是,熟悉该领域的技术人员对本实用新型的具体实施方式所做的任何改动均不脱离本实用新型的权利要求书的范围。相应地,本实用新型的权利要求的范围也并不仅仅局限于前述具体实施方式。
Claims (9)
1.一种芯片封装,其特征在于,其包括:
托盘部;
多个金属引线;
晶片,其具有第一表面和第二表面,所述晶片的第一表面粘结于所述托盘部上,其第二表面上形成有多个压焊区;
多个第一引脚,每个第一引脚与所述晶片上的一个压焊区通过一个金属引线相连;
多个第二引脚,每个第二引脚与所述晶片上的一个压焊区通过一个金属引线相连;
塑封体,包裹所述托盘部、金属引线、晶片、第一引脚的部分和第二引脚的部分,其中第一引脚暴露于所述塑封体外形成第一安装面,第二引脚暴露于所述塑封体外形成第二安装面,第一安装面与第二安装面平行并相隔。
2.根据权利要求1所述的芯片封装,其特征在于,所述晶片位于第一安装面和第二安装面之间。
3.根据权利要求1所述的芯片封装,其特征在于,所述晶片的部分压焊区与第一引脚相连,部分压焊区与第二引脚相连,所述晶片内包括与第一引脚相连的第一功能区电路和与第二引脚相连的第二功能区电路。
4.根据权利要求1所述的芯片封装,其特征在于,所述芯片封装的第一引脚电性连接至第一印刷电路板上,第二引脚电性连接至第二印刷电路板上。
5.根据权利要求4所述的芯片封装,其特征在于,所述晶片上的至少部分压焊区既通过金属引线与第一引脚相连,又通过金属引线与第二引脚相连,所述晶片内包括有第三功能区电路,该第三功能区电路与第一印刷电路板上的器件以及第二印刷电路板上的器件联合共同实现一个功能。
6.根据权利要求4所述的芯片封装,其特征在于,其还包括:
金属散热区,其与多个第二引脚位于同一个平面上,所述金属散热区的一个表面暴露于所述塑封体外,并与第二印刷电路板上的散热区相连。
7.根据权利要求5或者6所述的芯片封装,其特征在于,
所述托盘部的一个表面暴露于所述塑封体外,并与第一印刷电路板上的散热区相连,晶片的第一表面紧贴所述托盘部。
8.根据权利要求7所述的芯片封装,其特征在于,所述托盘部、第一引脚、第二引脚或金属散热区均由同一个引线框分割形成。
9.一种电路系统,其特征在于,其包括:
第一印刷电路板,
第二印刷电路板,
如权利要求1-7任一所述的芯片封装,
所述芯片封装的第一引脚电性连接至第一印刷电路板上,第二引脚电性连接至第二印刷电路板上,第一印刷电路板与第二印刷电路板平行。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201520071156.9U CN204361080U (zh) | 2015-01-30 | 2015-01-30 | 电路系统及其芯片封装 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201520071156.9U CN204361080U (zh) | 2015-01-30 | 2015-01-30 | 电路系统及其芯片封装 |
Publications (1)
Publication Number | Publication Date |
---|---|
CN204361080U true CN204361080U (zh) | 2015-05-27 |
Family
ID=53262533
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201520071156.9U Active CN204361080U (zh) | 2015-01-30 | 2015-01-30 | 电路系统及其芯片封装 |
Country Status (1)
Country | Link |
---|---|
CN (1) | CN204361080U (zh) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN104600045A (zh) * | 2015-01-30 | 2015-05-06 | 无锡中星微电子有限公司 | 电路系统、芯片封装及其封装方法 |
-
2015
- 2015-01-30 CN CN201520071156.9U patent/CN204361080U/zh active Active
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN104600045A (zh) * | 2015-01-30 | 2015-05-06 | 无锡中星微电子有限公司 | 电路系统、芯片封装及其封装方法 |
CN104600045B (zh) * | 2015-01-30 | 2017-06-06 | 无锡中感微电子股份有限公司 | 电路系统、芯片封装及其封装方法 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
CN104520987B (zh) | 具有引线键合互连且基板少的堆叠封装 | |
US7598599B2 (en) | Semiconductor package system with substrate having different bondable heights at lead finger tips | |
US8125063B2 (en) | COL package having small chip hidden between leads | |
US10373894B2 (en) | Package structure and the method to fabricate thereof | |
CN105977220B (zh) | 半导体封装组件 | |
CN106898591A (zh) | 一种散热的多芯片框架封装结构及其制备方法 | |
US10636735B2 (en) | Package structure and the method to fabricate thereof | |
US6627990B1 (en) | Thermally enhanced stacked die package | |
KR100800475B1 (ko) | 적층형 반도체 패키지 및 그 제조방법 | |
CN204361080U (zh) | 电路系统及其芯片封装 | |
KR101685068B1 (ko) | 시스템 인 패키지 및 이의 제조방법 | |
KR20140045461A (ko) | 집적회로 패키지 | |
CN203871315U (zh) | 电子设备 | |
US8791007B2 (en) | Device having multiple wire bonds for a bond area and methods thereof | |
CN205211727U (zh) | 一种指纹识别多芯片封装结构 | |
US20130075881A1 (en) | Memory card package with a small substrate | |
CN108630626A (zh) | 无基板封装结构 | |
CN105590904A (zh) | 一种指纹识别多芯片封装结构及其制备方法 | |
TWI429351B (zh) | 小基板記憶卡封裝構造 | |
CN104600045A (zh) | 电路系统、芯片封装及其封装方法 | |
CN112908984A (zh) | 一种带有散热片的ssd堆叠封装结构及其制作方法 | |
KR101096440B1 (ko) | 듀얼 다이 패키지 | |
KR20080103934A (ko) | 양각을 갖는 집적회로 패키징 시스템 | |
KR20080067891A (ko) | 멀티 칩 패키지 | |
CN204732390U (zh) | 载板级半导体芯片嵌入式封装结构 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
C14 | Grant of patent or utility model | ||
GR01 | Patent grant | ||
C56 | Change in the name or address of the patentee | ||
CP01 | Change in the name or title of a patent holder |
Address after: A 530 Taihu international science and Technology Park building 214028 Qingyuan Road in Jiangsu province Wuxi City District 10 layer Patentee after: WUXI ZHONGGAN MICROELECTRONIC CO., LTD. Address before: A 530 Taihu international science and Technology Park building 214028 Qingyuan Road in Jiangsu province Wuxi City District 10 layer Patentee before: Wuxi Vimicro Co., Ltd. |