CN201887543U - 采样值时间标定装置 - Google Patents
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Abstract
本实用新型属于智能变电站检测领域,具体涉及一种采样值时间标定装置。该装置包括CPU微处理器、FPGA单元、精确计时器、网卡接收器和网卡发送器,所述CPU微处理器分别与网卡接收器、FPGA单元及网卡发送器相连,所述FPGA单元分别与网卡接收器、CPU微处理器和精确计时器相连,所述精确计时器连接有一GPS时钟。该采样值时间标定装置是由硬件装置记录通信报文的时标,实现高精度的测量传输延时的设备,精度可达到10us,具有结构简单、使用操作方便等优点,通常用于测试合并单元或只能操作箱的传输时延。
Description
技术领域
本实用新型属于智能变电站检测领域,具体涉及一种采样值时间标定装置。
背景技术
随着智能变电站及数字化变电站的发展,出现了一些新的被测设备,例如合并单元;用以对来自二次转换器的电流和/或电压数据进行时间相干组合的物理单元,它可以是现场互感器的一个组件,也可以是一个独立单元。合并单元(Merging Unit)是针对电子互感器,为智能电子设备提供一组时间同步(相关)的电流和电压采样值,而在GB/T 20840.8中首次定义的。其主要功能是通过一台合并单元(MU),汇集/或合并多个电子式互感器的数据,取得电力系统电流和电压瞬时值后以确定的数据品质(如IEC61850-9-1、IEC61850-9-2或者GOOSE信息的格式)传输到电力系统电气测量仪器和继电保护装置;其每个数据通道可以承载一台和/或多台的电子式电流和/或电子式电压互感器的采样值数据。由于合并单元会出现传输延时的现象,所以各个合并单元在投入电力系统使用之前,通常需要利用一种可以测试传输延时误差的测量装置,如果不预先进行测量则直接使用,轻则使电力系统发生故障,不能正常使用;重则造成电力系统的大面积停电,影响人们的正常工作和生活。
传输延时是指从电压电流模拟量输入合并单元至IEC61850-9-1或者IEC61850-9-2信息发出之间的延时,由于合并单元是在智能电网、和智能变电站后出现的新设备,所以现有技术中并没有合并单元的测量设备。按照电力系统的标准,通常要求被测设备的传输延时误差不能超过10us,如果该被测设备的传输误差超过该标准,则该设备不能使用。为了克服上述缺陷,迫切的需要本领域的技术人员开发出一款能够测试合并单元传输延时的高精度设备。
实用新型内容
为了解决现有技术的上述缺陷,本实用新型的目的在于提出一种能够测量传输延时的高精度的采样值时间标定装置。
本实用新型是通过下述技术方案实现的:
一种采样值时间标定装置,其特征在于:该装置包括CPU微处理器、FPGA单元、精确计时器、网卡接收器和网卡发送器,所述CPU微处理器分别与网卡接收器、FPGA单元及网卡发 送器相连,所述FPGA单元分别与网卡接收器、CPU微处理器和精确计时器相连,所述精确计时器连接有一GPS时钟。
本实用新型较优选的技术方案为,所述网卡接收器接收来自于被测合并单元的报文信息。
本实用新型更优选的技术方案为,所述网卡接收器所接收的报文信息有三种:即IEC61850-9-1格式的信息、IEC61850-9-2格式的信息和GOOSE信息。
本实用新型的有益效果是:该采样值时间标定装置是由硬件装置记录通信报文的时标,实现高精度的测量传输延时的设备,精度可达到10us,具有结构简单、使用操作方便等优点。
附图说明
图1是本实用新型标定装置的整体结构示意图;
图2是标定装置测量传输延时的原理图。
具体实施方式
下面结合附图对本实用新型的采样值时间标定装置做进一步的详细说明。
如图1所示,该装置包括CPU微处理器、FPGA(Field-Programmable Gate Array,即现场可编程门阵列)单元、精确计时器、网卡接收器和网卡发送器,所述CPU微处理器分别与网卡接收器、FPGA单元及网卡发送器相连,所述FPGA单元分别与网卡接收器、CPU微处理器和精确计时器相连,精确计时器还连接有一外部GPS时钟。
下面简述各部件的功能和原理:
CPU微处理器的功能是:1)向网卡接收器发出控制信号,控制网卡接收器接收网络报文;2)控制FPGA单元为数据加上时间标记;3)向网卡发送器发送数据,控制网卡发送器将数据输出。
FPGA单元的功能是:为数据加上时间标记。
精确计时器的功能是:向FPGA单元提供时间标记。
网卡接收器的功能是:接收网络报文并将对其进行FCS解码。
网卡发送器的功能是:对数据进行FCS编码后输出数据。
本实用新型的工作原理是:电子互感器通过被测合并单元向本实用新型的标定装置发出报文信息,在网卡接收器接收到该报文信息后立刻记录下其接收时刻并记入到以太网帧的四个保留字节中,然后将该以太网帧发送到外部PC机中进行延时分析计算。同时,该装置中的网卡接收器接收到该报文信息后对其进行FCS解码,网卡接收器将解码后的报文信息传给 FPGA单元;每当FPGA单元接收到报文信息时,通过一外部GPS时钟向精确计时器发出精确时间秒脉冲,使精确计时器为FPGA单元提供一个时间标记;CPU控制FPGA单元为该报文信息加上时间标记后,FPGA单元将加有时间标记的报文信息传给CPU微处理器,CPU微处理器再将该报文信息传给网卡发送器进行FCS编码,最后输出至外部PC机中进行延时分析计算,计算的方法为:将接收时刻与报文信息中含有的时间标记做差值计算,该差值即为被测合并单元的传输延时。
本实用新型的采样值时间标定装置所接收的报文信息有三种,分别为:
(1)IEC61850-9-1格式的信息;
(2)IEC61850-9-2格式的信息;
(3)GOOSE信息;
如图2所示,该标定装置收到被测合并单元发出的报文信息(该信息可以为IEC61850-9-1格式信息、IEC61850-9-2格式信息或GOOSE信息)时,即记录下接收时刻T2并记入到以太网帧的四个保留字节中,然后尽快将该以太网帧发送到外部PC机中存储;通过标定装置对该信息添加时间标记T1,该标定装置将加有时间标记T1的报文信息传给外部PC机,并将T2与T1相比较,二者的差值T2-T1即为被测合并单元的传输时延T。如果经过时间标记的比较,差值均小于10μs,便说明被测合并单元的传输时延误差小于10μs,该被测合并单元便满足电力系统的要求,可投入使用。
该标定装置的精度高、结构简单,整个判断过程无须专业人士进行监控,操作简单,通常用于测试合并单元或只能操作箱的传输时延。
最后应当说明的是:以上实施例仅用以说明本实用新型的技术方案而非对其限制,尽管参照上述实施例对本实用新型进行了详细的说明,所属领域的普通技术人员应当理解:依然可以对本实用新型的具体实施方式进行修改或者等同替换,而未脱离本实用新型精神和范围的任何修改或者等同替换,其均应涵盖在本实用新型的权利要求范围当中。
Claims (2)
1.一种采样值时间标定装置,其特征在于:该装置包括CPU微处理器、FPGA单元、精确计时器、网卡接收器和网卡发送器,所述CPU微处理器分别与网卡接收器、FPGA单元及网卡发送器相连,所述FPGA单元分别与网卡接收器、CPU微处理器和精确计时器相连,所述精确计时器连接有一GPS时钟。
2.如权利要求1所示的采样值时间标定装置,其特征在于:所述网卡接收器接收来自于被测合并单元的报文信息。
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Publications (1)
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Publication number | Priority date | Publication date | Assignee | Title |
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CN102621512A (zh) * | 2011-11-09 | 2012-08-01 | 中国电力科学研究院 | 一种合并单元守时性能的动态模拟测试方法 |
CN102710012A (zh) * | 2012-04-09 | 2012-10-03 | 浙江省电力公司 | 一种用于智能变电站故障波形分析的数据再同步方法 |
CN108318846A (zh) * | 2018-01-18 | 2018-07-24 | 国网浙江省电力有限公司电力科学研究院 | 智能变电站合并单元绝对延时的测试装置 |
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2010
- 2010-09-01 CN CN2010205123984U patent/CN201887543U/zh not_active Expired - Lifetime
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