CN117711322A - 显示面板及显示装置 - Google Patents

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Abstract

本公开提供一种显示面板及显示装置，属于显示技术领域。本公开的显示面板包括呈阵列排布的多个像素单元；其中，位于同一行的像素单元由同一条栅线提供栅极驱动信号；位于同一列的像素单元由至少两条数据线提供数据信号，且各数据线所连接的像素单元不同。

Description

显示面板及显示装置
技术领域
本公开属于显示技术领域，具体涉及一种显示面板及显示装置。
背景技术
现有有机发光器件(OLED，Organic Light-Emitting Diode)技术可以制作高频、高分辨率的产品，但若想继续提高频率和分辨率，阵列基板上栅极驱动电路(GOA，GateDriven on Array)的充电时间、复位时间和降噪时间等参数会成为限制，因此增加GOA电路每行的时间成为关键问题。
发明内容
本公开旨在至少解决现有技术中存在的技术问题之一，提供一种显示面板及显示装置。
第一方面，本公开提供了一种显示面板，其包括呈阵列排布的多个像素单元；其中，位于同一行的所述像素单元由同一条栅线提供栅极驱动信号；位于同一列的所述像素单元由至少两条所述数据线提供数据信号，且各所述数据线所连接的所述像素单元不同。
优选的是，位于同一列的所述像素单元由两条所述数据线提供所述数据信号。
优选的是，连接同一列所述像素单元的两条所述数据线中的一者连接该列像素单元中的第奇数个所述像素单元，另一者连接所述该列像素单元中的第偶数个所述像素单元。
优选的是，所述连接同一列所述像素单元的两条数据线分别位于该列所述像素单元沿行方向上的两相对侧。
优选的是，呈阵列排布的像素单元划分为第一像素阵列和第二像素阵列；所述第一像素阵列包括各奇数行所述像素单元；所述第二像素阵列包括各偶数行所述像素单元；
所述显示面板还包括第一栅极驱动器和第二栅极驱动器；驱动所述第一像素阵列的各栅线均连接所述第一栅极驱动器；驱动所述第二像素阵列的各所述栅线均连接所述第二栅极驱动器。
优选的是，还包括多个像素驱动电路；所述像素单元包括至少一个发光器件；所述像素驱动电路与所述发光器件一一对应连接；
所述像素驱动电路包括数据写入子电路、第一发光控制子电路、驱动子电路、阈值补偿子电路、第一复位子电路、第二发光控制子电路和第二复位子电路；
所述数据写入子电路，被配置为响应于第一扫描信号，将数据信号传输至第一节点；所述第一节点为所述数据写入子电路、所述驱动子电路和所述第一发光控制子电路的连接节点；
所述第一发光控制子电路，被配置为响应于发光控制信号，将第一电平信号写入所述第一节点；
所述驱动子电路，被配置为响应于第二节点的电压，控制所述第一节点的电压能否传输至第三节点；所述第二节点为所述驱动子电路、所述阈值补偿子电路和所述第一复位子电路的连接节点；所述第三节点为所述驱动子电路、所述阈值补偿子电路和所述第二发光控制子电路的连接节点；
所述阈值补偿子电路，被配置为响应于所述第一扫描信号，将所述第三节点的电压传输至所述第二节点；
所述第一复位子电路，被配置为响应于第二扫描信号，通过初始化信号对所述第二节点的电压进行复位；
所述第二复位子电路，被配置为响应于复位信号，通过所述初始化信号对第四节点进行复位；所述第四节点为所述第二复位子电路、所述第二发光控制子电路和所述发光器件的连接节点；
所述第二发光控制子电路，被配置为响应于所述发光控制信号，将所述第三节点的电压传输至发光器件。
优选的是，所述数据写入子电路包括第四晶体管；
所述第四晶体管的控制极连接所述第一扫描信号端，第一极连接所述数据信号端，第二极连接所述第一节点。
优选的是，所述第一发光控制子电路包括第五晶体管；
所述第五晶体管的控制极连接所述发光控制信号端，第一极连接所述第一节点，第二极连接所述第一电平信号端。
优选的是，所述驱动子电路包括第三晶体管；所述第三晶体管的控制极连接所述第二节点，第一极连接所述第一节点，第二极连接所述第三节点。
优选的是，所述阈值补偿子电路包括第二晶体管；所述第二晶体管的控制极连接所述第一扫描信号端，第一极连接所述第三节点，第二极连接所述第二节点。
优选的是，所述第一复位子电路包括第一晶体管；
所述第一晶体管的控制极连接所述第二扫描信号端，第一极连接所述第二节点，第二极连接所述初始信号端。
优选的是，所述第二发光控制子电路包括第六晶体管；
所述第六晶体管的控制极连接所述发光控制信号端，第一极连接得到第三节点，第二极连接所述第四节点。
优选的是，所述第二复位子电路包括第七晶体管；
所述第七晶体管的控制极连接所述复位信号端，第一极连接所述初始信号端，第二极连接所述第四节点。
第二方面，本公开提供了一种显示装置，其包括上述的显示面板。
附图说明
图1为本公开提供的一种显示面板的结构示意图；
图2a为本公开提供的一种示例的显示面板的结构示意图；
图2b为图2a中显示面板的一种变形；
图3a为本公开提供的图2a中显示面板中的第一像素阵列的结构示意图；
图3b为本公开提供的图2中显示面板中的第二像素阵列的结构示意图；
图4为现有的一种像素驱动电路；
图5为图4中现有的像素驱动电路的仿真结果图；
图6为本公开的像素驱动电路的仿真结果图；
图7a为图3中显示面板单独驱动第一像素阵列的显示效果图；
图7b为图3中显示面板单独驱动第二像素阵列的显示效果图；
图7c为图3中显示面板同时驱动第一像素阵列和第二像素阵列的显示效果图；
图8为显示面板连接两个发光控制信号端时，两个发光控制信号的时序图。
具体实施方式
为使本领域技术人员更好地理解本发明的技术方案，下面结合附图和具体实施方式对本发明作进一步详细描述。
除非另外定义，本公开使用的技术术语或者科学术语应当为本公开所属领域内具有一般技能的人士所理解的通常意义。本公开中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。同样，“一个”、“一”或者“该”等类似词语也不表示数量限制，而是表示存在至少一个。“包括”或者“包含”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“连接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性的连接，不管是直接的还是间接的。“上”、“下”、“左”、“右”等仅用于表示相对位置关系，当被描述对象的绝对位置改变后，则该相对位置关系也可能相应地改变。
需要说明的是，本公开实施例中的所采用的晶体管可以为薄膜晶体管或场效应管或其他特性的相同器件，由于采用的晶体管的源极和漏极是对称的，所以其源极、漏极是没有区别的。在本公开实施例中，为区分晶体管的源极和漏极，将其中一极称为第一极，另一极称为第二极。此外按照晶体管的特性区分可以将晶体管分为N型和P型，当采用P型晶体管时，第一极为P型晶体管的源极，第二极为P型晶体管的漏极，栅极输入低电平时，源漏极导通；当采用N型晶体管时，第一极为N型晶体管的源极，第二极为N型晶体管的漏极，栅极输入高电平时，源漏极导通。
在此需要说明的是，本公开实施例中以所有晶体管均为采用P型晶体管为例，则工作电平是指使得P型晶体管开启工作的有效电平，即为低电平，非工作电平则指高电平。
发光器件可以是微型无机发光二极管，进一步地，可以为电流型发光二极管，如微型发光二极管(Micro Light Emitting Diode，Micro LED)或者迷你发光二极管(MiniLight Emitting Diode，Mini LED)，当然，在发明实施例中的发光器件是以有机电致发光二极管(Organic Light Emitting Diode，OLED)为例进行说明。
第一方面，如图1所示，本公开提供了一种显示面板，其包括呈阵列排布的多个像素单元。显示面板还包括交叉设置的多条栅线和多条数据线。其中，位于同一行的像素单元由同一条栅线提供栅极驱动信号，位于同一列的像素单元由至少两条数据线提供数据信号，且各数据线所连接的像素单元不同。本公开的显示面板中位于不同行的像素单元连接不同的栅线和数据线，不具有关联性，均可以独立驱动，从而增加每个信号的驱动时间。其中，信号可以包括发光控制信号、复位信号、降噪信号等。
在一些示例中，位于同一行的像素单元由一条栅线提供栅极驱动信号，参照图2a，第一行像素单元连接第一条栅线G1，第二行像素单元连接第二条栅线G2，第三行像素单元连接第一条栅线G3。其他行栅线也是如此连接。
在一些示例中，位于同一列的像素单元由两条数据线提供数据信号，如图2a所示。其中，连接同一列像素单元的两条数据线中的一者连接该列像素单元中的第奇数个像素单元，另一者连接该列像素单元中的第偶数个像素单元。也就是说，结合图2a，对于第一列中各个第奇数个像素单元(也就是第一列像素单元中的第1、3、5、、、个像素单元)连接同一数据线S1-1,对于第一列中各个第偶数个像素单元(也就是第一列像素单元中的第2、4、6、、、个像素单元)连接同一数据线S1-2；对于第二列中各个第奇数个像素单元(也就是第二列像素单元中的第1、3、5、、、个像素单元)连接同一数据线S2-1,对于第二列中各个第偶数个像素单元(也就是第二列像素单元中的第2、4、6、、、个像素单元)连接同一数据线S2-2。按照该规律，其它数据线也是如此连接。
这样一来，呈阵列排布的像素单元可以划分为第一像素阵列10和第二像素阵列20，如图3所示。其中，第一像素阵列10包括各第奇数行像素单元，如图3a所示，第二像素阵列20包括各第偶数行像素单元，如图3b所示。也就是说，第一像素阵列10中的每一行像素单元连接同一栅线，每一列像素单元连接同一数据线，参照图3a，第一行像素单元连接栅线G1，第二行像素单元连接栅线G3，第三行像素连接栅线G5，第一列像素单元连接数据线S1-1，第二列像素单元连接数据线S2-1，第三列像素单元连接数据线S3-1，第四列像素单元连接数据线S4-1。类似的，第二像素阵列20中的每一行像素单元连接同一栅线，每一列像素单元连接同一数据线，参照图3b，第一行像素单元连接栅线G2,第二行像素单元连接栅线G4，第三行像素连接栅线G6，第一列像素单元连接数据线S1-2，第二列像素单元连接数据线S2-2，第三列像素单元连接数据线S3-2，第四列像素单元连接数据线S4-2。那么，第一像素阵列10和第二像素阵列20就不具有关联性，可以独立驱动。对于整个显示面板来说，执行每个信号的时间就可以翻倍。这里，第一像素阵列10可以包括各第偶数行像素单元，相应的，第二像素阵列20包括第奇数行像素单元。
可选地，继续参照图2a，连接同一列像素单元的两条数据线可以设置在该列像素单元的两相对侧，也可以设置在该列像素单元的同一侧，如图2b所示。优选的，设置在两相对侧，可以使布线更均匀，便于后续维修检查。
在一些示例中，显示面板还包括第一栅极驱动器和第二栅极驱动器。参照图3，与第一像素阵列10连接的各栅线连接第一栅极驱动器，与第二像素阵列20连接的各栅线连接第二栅极驱动器，此时，第一像素阵列10和第二像素阵列20由第一栅极驱动器和第二栅极驱动器分别驱动，可以独立运行。可选地，第一像素阵列10和第二像素阵列20可以连接同一栅极驱动器，虽然二者被同一栅极驱动信号控制，但其连接的数据信号不同，因此也不会发生干扰。在此种情况下，可以设置第一像素阵列10和第二像素阵列20中的像素单元连接不同的发光控制信号，来优化整体的显示效果。
示例性的，显示面板还包括多个像素驱动电路。像素单元包括至少一个发光器件oled，像素驱动电路与发光器件oled一一对应连接。其中，像素驱动电路包括数据写入子电路1、第一发光控制子电路2、驱动子电路3、阈值补偿子电路4、第一复位子电路5、第二发光控制子电路6和第二复位子电路7。
具体的，数据写入子电路1被配置为响应于第一扫描信号Gate n，将数据信号VData传输至第一节点N1。第一发光控制子电路2被配置为响应于发光控制信号EM，将第一电平信号VDD写入第一节点N1。驱动子电路3被配置为响应于第二节点N2的电压，控制第一节点N1的电压能否传输至第三节点N3。阈值补偿子电路4被配置为响应于第一扫描信号Gate n，将第三节点N3的电压传输至第二节点N2。第一复位子电路5被配置为响应于第二扫描信号Gate n-1，通过初始化信号Vinit对第二节点N2的电压进行复位。第二复位子电路7被配置为响应于复位信号Reset，通过初始化信号Vinit对第四节点N4进行复位。第二发光控制子电路6被配置为响应于发光控制信号EM，将第三节点N3的电压传输至发光器件oled。
在此需要说明的是，第一节点N1为数据写入子电路1、驱动子电路3和第一发光控制子电路2的连接节点。第二节点N2为驱动子电路3、阈值补偿子电路4和第一复位子电路5的连接节点。第三节点N3为驱动子电路3、阈值补偿子电路4和第二发光控制子电路6的连接节点。第四节点N4为第二复位子电路7、第二发光控制子电路6和发光器件oled的连接节点。
在一些示例中，数据写入子电路1包括第四晶体管T4，第四晶体管T4的栅极连接第一扫描信号Gate n端，源极连接数据信号VData端，漏极连接第一节点N1。第四晶体管T4被配置为在第一扫描信号Gate n的控制下，将数据信号VData传输至第一节电。
在一些示例中，第一发光控制子电路2包括第五晶体管T5，第五晶体管T5的栅极连接发光控制信号EM端，源极连接第一节点N1，漏极连接第一电平信号VDD端。第五晶体管T5被配置为在发光控制信号EM的控制下，将第一电平信号VDD写入第一节点N1。
在一些示例中，驱动子电路3包括第三晶体管T3，第三晶体管T3的栅极连接第二节点N2，源极连接第一节点N1，漏极连接第三节点N3。第三晶体管T3被配置为在第二节点N2电压的控制下，控制第一节点N1的电压能否传输至第三节点N3。
在一些示例中，阈值补偿子电路4包括第二晶体管T2，第二晶体管T2的栅极连接第一扫描信号Gate n端，源极连接第三节点N3，漏极连接第二节点N2。第二晶体管T2被配置为在第一扫描信号Gate n的控制下，将第三节点N3的电压补偿至第二节点N2。
在一些示例中，第一复位子电路5包括第一晶体管T1，第一晶体管T1的栅极连接第二扫描信号Gate n-1端，源极连接第二节点N2，漏极连接初始化信号Vinit端。第一晶体管T1被配置为在第二扫描信号Gate n-1的控制下，通过初始化信号Vinit对第二节点N2的电压进行复位。
在一些示例中，第二发光控制子电路6包括第六晶体管T6，第六晶体管T6的栅极连接发光控制信号EM端，源极连接得到第三节点N3，漏极连接第四节点N4。第六晶体管T6被配置为在发光控制信号EM的控制下，将第三节点N3的电压传输至发光器件oled。
在一些示例中，第二复位子电路7包括第七晶体管T7，第七晶体管T7的栅极连接复位信号Reset端，源极连接初始信号端，漏极连接第四节点N4。第七晶体管T7被配置为在复位信号Reset的控制下，通过初始化信号Vinit对第四节点N4进行复位。
下面结合一个具体实施例对上述像素驱动电路进行说明。
如图4所示，像素驱动电路包括数据写入子电路1、第一发光控制子电路2、驱动子电路3、阈值补偿子电路4、第一复位子电路5、第二发光控制子电路6和第二复位子电路7。其中，数据写入子电路1包括第四晶体管T4；第一发光控制子电路2包括第五晶体管T5；驱动子电路3包括第三晶体管T3；阈值补偿子电路4包括第二晶体管T2；第一复位子电路5包括第一晶体管T1；第二发光控制子电路6包括第六晶体管T6；第二复位子电路7包括第七晶体管T7。
具体的，第四晶体管T4的栅极连接第一扫描信号Gate n端，源极连接数据信号端，漏极连接第一节点N1。第五晶体管T5的栅极连接发光控制信号端，源极连接第一节点N1，漏极连接第一电平信号端ELVDD。第三晶体管T3的栅极连接第二节点N2，源极连接第一节点N1，漏极连接第三节点N3。第二晶体管T2的栅极连接第一扫描信号Gate n端，源极连接第三节点N3，漏极连接第二节点N2。第一晶体管T1的栅极连接第二扫描信号Gate n-1端，源极连接第二节点N2，漏极连接初始化信号端。第六晶体管T6的栅极连接发光控制信号端，源极连接得到第三节点N3，漏极连接第四节点N4。第七晶体管T7的栅极连接复位信号端，源极连接初始化信号端，漏极连接第四节点N4，发光器件oled的阳极连接第四节点N4，发光器件oled的阴极连接第二电平信号端ELVSS。
其中，第一扫描信号Gate n端提供第一扫描信号Gate n，第二扫描信号Gate n-1端提供第二扫描信号Gate n-1，数据信号VData端提供数据信号VData，发光控制信号EM端提供发光控制信号EM，初始化信号Vinit端提供初始化信号Vinit，复位信号Reset端提供复位信号Reset，第一电平信号端ELVDD提供第一电平信号VDD,第二电平信号端ELVSS提供第二电平信号VSS。第一扫描信号Gate n为上一行级联的像素驱动电路的输出信号。
基于上述电路结构，本公开提供了一种该像素驱动电路的工作过程，仿真结果如图5所示。
在初始化阶段t1，第一扫描信号Gate n和发光控制信号EM均写入高电平信号，第二扫描信号Gate n-1和复位信号Reset均写入低电平信号，为工作电平信号，第一晶体管T1和第七晶体管T7打开，初始化信号Vinit分别对第二节点N2和第四节点N4的电压进行复位。
在数据写入阶段t2，复位信号Reset、第二扫描信号Gate n-1和发光控制信号EM均写入高电平信号，第一扫描信号Gate n写入低电平信号，为工作电平信号，将数据信号VData写入的高电平信号传输至第一节点N1，即第三晶体管T3的第一极，并将第三晶体管T3的阈值电压补偿至第二节点N2。
在发光阶段t3，发光控制信号EM写入低电平信号，打开第五晶体管T5和第六晶体管T6，第一电平信号VDD通过第五晶体管T5、第三晶体管T3和第六晶体管T6传输至发光器件oled使其发光。
在此需要说明的是，本公开的像素驱动电路中的晶体管均为P型晶体管，因此低电平信号为工作电平信号，高电平信号为非工作电平信号。
可选地，上述工作过程是一个像素驱动电路驱动一个发光器件的工作过程。对于本公开的显示面板来说，其划分为第一像素阵列10和第二像素阵列20。其中，当驱动第一像素阵列10的各栅线连接第一栅极驱动器，驱动第二像素阵列20的各栅线连接第二栅极驱动器时，第一像素阵列10和第二像素阵列20可单独驱动，从而使整个显示面板在各个阶段的驱动时间均翻倍，优化显示效果。当驱动第一像素阵列10的各栅线和驱动第二像素阵列20的各栅线连接同一栅极驱动器时，可以增加一个发光控制信号端，即第一像素阵列10连接第一发光控制信号端EM1,第二像素阵列20连接第二发光控制信号端EM2，这样可以独立控制发光效果，优化显示效果。如图6所示，本公开的显示面板中各信号的驱动时间翻倍，从原来的1H变为了2H。图7a-7c为分别驱动第一像素阵列10、第二像素阵列20以及同时驱动二者的显示面板的显示结果。
第二方面，本公开提供了一种显示装置，其包括上述示例中的显示面板。该显示装置可以为：手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。当然，本实施例的显示装置中还可以包括其他常规结构，如电源单元、显示驱动单元等。
可以理解的是，以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式，然而本发明并不局限于此。对于本领域内的普通技术人员而言，在不脱离本发明的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本发明的保护范围。

Claims (14)

1.一种显示面板，其包括呈阵列排布的多个像素单元；其中，位于同一行的所述像素单元由同一条栅线提供栅极驱动信号；位于同一列的所述像素单元由至少两条所述数据线提供数据信号，且各所述数据线所连接的所述像素单元不同。
2.根据权利要求1所述的显示面板，其中，位于同一列的所述像素单元由两条所述数据线提供所述数据信号。
3.根据权利要求2所述的显示面板，其中，连接同一列所述像素单元的两条所述数据线中的一者连接该列像素单元中的第奇数个所述像素单元，另一者连接所述该列像素单元中的第偶数个所述像素单元。
4.根据权利要求3所述的显示面板，其中，所述连接同一列所述像素单元的两条数据线分别位于该列所述像素单元沿行方向上的两相对侧。
5.根据权利要求2-4中任一项所述的显示面板，其中，呈阵列排布的像素单元划分为第一像素阵列和第二像素阵列；所述第一像素阵列包括各奇数行所述像素单元；所述第二像素阵列包括各偶数行所述像素单元；
所述显示面板还包括第一栅极驱动器和第二栅极驱动器；驱动所述第一像素阵列的各栅线均连接所述第一栅极驱动器；驱动所述第二像素阵列的各所述栅线均连接所述第二栅极驱动器。
6.根据权利要求1所述的显示面板，其中，还包括多个像素驱动电路；所述像素单元包括至少一个发光器件；所述像素驱动电路与所述发光器件一一对应连接；
所述像素驱动电路包括数据写入子电路、第一发光控制子电路、驱动子电路、阈值补偿子电路、第一复位子电路、第二发光控制子电路和第二复位子电路；
所述数据写入子电路，被配置为响应于第一扫描信号，将数据信号传输至第一节点；所述第一节点为所述数据写入子电路、所述驱动子电路和所述第一发光控制子电路的连接节点；
所述第一发光控制子电路，被配置为响应于发光控制信号，将第一电平信号写入所述第一节点；
所述驱动子电路，被配置为响应于第二节点的电压，控制所述第一节点的电压能否传输至第三节点；所述第二节点为所述驱动子电路、所述阈值补偿子电路和所述第一复位子电路的连接节点；所述第三节点为所述驱动子电路、所述阈值补偿子电路和所述第二发光控制子电路的连接节点；
所述阈值补偿子电路，被配置为响应于所述第一扫描信号，将所述第三节点的电压传输至所述第二节点；
所述第一复位子电路，被配置为响应于第二扫描信号，通过初始化信号对所述第二节点的电压进行复位；
所述第二复位子电路，被配置为响应于复位信号，通过所述初始化信号对第四节点进行复位；所述第四节点为所述第二复位子电路、所述第二发光控制子电路和所述发光器件的连接节点；
所述第二发光控制子电路，被配置为响应于所述发光控制信号，将所述第三节点的电压传输至发光器件。
7.根据权利要求6所述的显示面板，其中，所述数据写入子电路包括第四晶体管；
所述第四晶体管的控制极连接所述第一扫描信号端，第一极连接所述数据信号端，第二极连接所述第一节点。
8.根据权利要求6所述的显示面板，其中，所述第一发光控制子电路包括第五晶体管；
所述第五晶体管的控制极连接所述发光控制信号端，第一极连接所述第一节点，第二极连接所述第一电平信号端。
9.根据权利要求6所述的显示面板，其中，所述驱动子电路包括第三晶体管；所述第三晶体管的控制极连接所述第二节点，第一极连接所述第一节点，第二极连接所述第三节点。
10.根据权利要求6所述的显示面板，其中，所述阈值补偿子电路包括第二晶体管；所述第二晶体管的控制极连接所述第一扫描信号端，第一极连接所述第三节点，第二极连接所述第二节点。
11.根据权利要求6所述的显示面板，其中，所述第一复位子电路包括第一晶体管；
所述第一晶体管的控制极连接所述第二扫描信号端，第一极连接所述第二节点，第二极连接所述初始信号端。
12.根据权利要求6所述的显示面板，其中，所述第二发光控制子电路包括第六晶体管；
所述第六晶体管的控制极连接所述发光控制信号端，第一极连接得到第三节点，第二极连接所述第四节点。
13.根据权利要求6所述的显示面板，其中，所述第二复位子电路包括第七晶体管；
所述第七晶体管的控制极连接所述复位信号端，第一极连接所述初始信号端，第二极连接所述第四节点。
14.一种显示装置，其包括如权利要求1-13中任一项所述的显示面板。
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