CN112712773A - 像素电路和具有像素电路的显示装置 - Google Patents

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徐荣完
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Abstract

本发明涉及像素电路和具有像素电路的显示装置。该像素电路包括：第一开关元件，包括连接到第一节点的控制电极、接收第一电力电压的输入电极和连接到第三节点的输出电极；第二开关元件，包括接收补偿栅极信号的控制电极、连接到第二节点的输入电极和连接到第三节点的输出电极；第三开关元件，包括接收写入栅极信号的控制电极、连接到第一节点的输入电极和连接到第二节点的输出电极；存储电容器，包括接收初始化电压的第一电极和连接到第一节点的第二电极；编程电容器，接收数据电压并且连接到第二节点；以及有机发光元件，连接到第三节点并且接收第二电力电压。

Description

像素电路和具有像素电路的显示装置
技术领域
本发明的示例性实施方式涉及像素电路和包括该像素电路的显示装置。更具体地，本发明的示例性实施方式涉及用于高分辨率的像素电路和包括该像素电路的显示装置。
背景技术
通常，显示装置包括显示面板和显示面板驱动器。显示面板典型地包括多个栅极线、多个数据线和多个像素。显示面板驱动器典型地包括栅极驱动器、数据驱动器和驱动控制器。栅极驱动器向栅极线输出栅极信号。数据驱动器向数据线输出数据电压。驱动控制器控制栅极驱动器和数据驱动器。
发明内容
传统的像素电路典型地包括许多个晶体管，以使得由于晶体管的数目过多，传统的像素电路可能未有效地用于高分辨率显示面板。此外，当晶体管的数目为了高分辨率而减少时，可能出现上部和下部之间的色差以及串扰。
本发明的示例性实施方式提供了一种像素电路，该像素电路包括数目经减少的晶体管并且用于增强显示面板的图像品质。
本发明的示例性实施方式还提供了一种显示装置，该显示装置包括该像素电路。
在根据本发明的示例性实施方式中，一种像素电路包括：第一开关元件，包括连接到第一节点的控制电极、接收第一电力电压的输入电极和连接到第三节点的输出电极；第二开关元件，包括接收补偿栅极信号的控制电极、连接到第二节点的输入电极和连接到第三节点的输出电极；第三开关元件，包括接收写入栅极信号的控制电极、连接到第一节点的输入电极和连接到第二节点的输出电极；存储电容器，包括接收初始化电压的第一电极和连接到第一节点的第二电极；编程电容器，包括接收数据电压的第一电极和连接到第二节点的第二电极；以及有机发光元件，包括连接到第三节点的第一电极和接收第二电力电压的第二电极。
在示例性实施方式中，第一开关元件、第二开关元件和第三开关元件可以是P型晶体管。
在示例性实施方式中，在导通偏置时段期间，第一开关元件可以导通，第二开关元件可以关断，第三开关元件可以关断，第一电力电压可以具有高电平，第二电力电压可以具有高电平，并且初始化电压可以具有低电平。
在示例性实施方式中，在导通偏置时段之后的初始化时段期间，第一开关元件可以导通，第二开关元件可以导通，第三开关元件可以导通，第一电力电压可以具有低电平，第二电力电压可以具有高电平，并且初始化电压可以具有低电平。
在示例性实施方式中，在初始化时段之后的阈值电压补偿时段期间，第一开关元件可以导通，第二开关元件可以导通，第三开关元件可以导通，第一电力电压可以具有高电平，第二电力电压可以具有高电平，并且初始化电压可以具有高电平。
在示例性实施方式中，在阈值电压补偿时段之后的编程时段期间，第一开关元件可以导通，第二开关元件可以关断，第三开关元件可以导通，第一电力电压可以具有低电平，第二电力电压可以具有高电平，并且初始化电压可以具有高电平。
在示例性实施方式中，在编程时段之后的预发射阳极初始化时段期间，第一开关元件可以导通，第二开关元件可以关断，第三开关元件可以关断，第一电力电压可以具有低电平，第二电力电压可以具有高电平，并且初始化电压可以具有低电平。
在示例性实施方式中，在预发射阳极初始化时段之后的发射时段期间，第一开关元件可以导通，第二开关元件可以关断，第三开关元件可以关断，第一电力电压可以具有高电平，第二电力电压可以具有低电平，并且初始化电压可以具有高电平。
在示例性实施方式中，在导通偏置时段之后的第一初始化时段期间，第一开关元件可以导通，第二开关元件可以导通，第三开关元件可以关断，第一电力电压可以具有低电平，第二电力电压可以具有高电平，并且初始化电压可以具有低电平。在这样的实施方式中，在第一初始化时段之后的第二初始化时段期间，第一开关元件可以导通，第二开关元件可以导通，第三开关元件可以导通，第一电力电压可以具有低电平，第二电力电压可以具有高电平，并且初始化电压可以具有低电平。
在示例性实施方式中，在导通偏置时段之后的初始化时段期间，第一开关元件可以导通，第二开关元件可以导通，第三开关元件可以导通，第一电力电压可以具有低电平，第二电力电压可以具有高电平，并且初始化电压可以具有低电平。在这样的实施方式中，初始化电压可以在导通偏置时段和初始化时段之间的边界处临时具有高电平。
在示例性实施方式中，在导通偏置时段之后的第一初始化时段期间，第一开关元件可以导通，第二开关元件可以导通，第三开关元件可以关断，第一电力电压可以具有低电平，第二电力电压可以具有高电平，并且初始化电压可以具有低电平。在这样的实施方式中，在第一初始化时段之后的第二初始化时段期间，第一开关元件可以导通，第二开关元件可以导通，第三开关元件可以导通，第一电力电压可以具有低电平，第二电力电压可以具有高电平，并且初始化电压可以具有低电平。在这样的实施方式中，初始化电压可以在导通偏置时段和第一初始化时段之间的边界处临时具有高电平。
在示例性实施方式中，补偿栅极信号可以是不同像素的写入栅极信号。
在示例性实施方式中，第一开关元件、第二开关元件和第三开关元件可以是N型晶体管。
在示例性实施方式中，在初始化时段期间，第一开关元件可以导通，第二开关元件可以导通，第三开关元件可以导通，并且第一电力电压可以具有高电平和低电平之间的中间电平。
在示例性实施方式中，在初始化时段之后的阈值电压补偿时段期间，第一开关元件可以导通，第二开关元件可以导通，第三开关元件可以导通，第一电力电压可以具有低电平，并且初始化电压可以具有低电平。
在示例性实施方式中，在阈值电压补偿时段之后的编程时段期间，第一开关元件可以导通，第二开关元件可以关断，第三开关元件可以导通，第一电力电压可以具有高电平，并且初始化电压可以具有低电平。
在示例性实施方式中，在编程时段之后的发射时段期间，第一开关元件可以导通，第二开关元件可以关断，第三开关元件可以关断，第一电力电压可以具有高电平，并且初始化电压可以具有高电平。
在示例性实施方式中，补偿栅极信号可以是不同像素的写入栅极信号。
在示例性实施方式中，第一开关元件可以是P型晶体管，并且第二开关元件和第三开关元件可以是N型晶体管。
在根据本发明的显示装置的示例性实施方式中，该显示装置包括：显示面板、栅极驱动器和数据驱动器。在这样的实施方式中，显示面板包括多个像素。在这样的实施方式中，栅极驱动器向多个像素输出写入栅极信号。在这样的实施方式中，数据驱动器向多个像素输出数据电压。在这样的实施方式中，多个像素中的每个像素包括：第一开关元件，包括连接到第一节点的控制电极、接收第一电力电压的输入电极和连接到第三节点的输出电极；第二开关元件，包括接收补偿栅极信号的控制电极、连接到第二节点的输入电极和连接到第三节点的输出电极；第三开关元件，包括接收写入栅极信号的控制电极、连接到第一节点的输入电极和连接到第二节点的输出电极；存储电容器，包括接收初始化电压的第一电极和连接到第一节点的第二电极；编程电容器，包括接收数据电压的第一电极和连接到第二节点的第二电极；以及有机发光元件，包括连接到第三节点的第一电极和接收第二电力电压的第二电极。
根据像素电路的示例性实施方式，显示装置包括具有三个晶体管和两个电容器的像素电路，以使得显示面板可以具有高分辨率。
在这些实施方式中，包括三个晶体管和两个电容器的像素电路的驱动信号可以被控制，以使得可以减小或防止上部和下部之间的色差以及串扰，而不增加像素电路中的晶体管的数目。因此，可以增强显示面板的显示品质。
附图说明
通过参照附图详细描述本发明的示例性实施方式，本发明的以上和其他特征将变得更为显而易见，在附图中：
图1是示出根据本发明的示例性实施方式的显示装置的框图；
图2是示出图1的显示面板的像素的电路图；
图3是示出施加到图2的像素的输入信号的时序图；
图4是示出在图3的初始化时段中的图2的像素的电路图；
图5是示出在图3的阈值电压补偿时段中的图2的像素的电路图；
图6是示出在图3的编程时段中的图2的像素的电路图；
图7是示出在图3的阳极初始化时段中的图2的像素的电路图；
图8是示出在图3的发射时段中的图2的像素的电路图；
图9是示出施加到根据本发明的替选示例性实施方式的显示装置的像素的输入信号的时序图；
图10是示出施加到根据本发明的另一替选示例性实施方式的显示装置的像素的输入信号的时序图；
图11是示出施加到根据本发明的另一替选示例性实施方式的显示装置的像素的输入信号的时序图；
图12是示出根据本发明的替选示例性实施方式的显示面板的像素的电路图；
图13是示出施加到图12的像素的输入信号的时序图；
图14是示出在图13的初始化时段和阈值电压补偿时段中的图12的像素的电路图；
图15是示出在图13的编程时段中的图12的像素的电路图；
图16是示出在图13的发射时段中的图12的像素的电路图；
图17是示出根据本发明的另一替选示例性实施方式的显示面板的像素的电路图；
图18是示出根据本发明的另一替选示例性实施方式的显示面板的像素的电路图；以及
图19是示出根据本发明的另一替选示例性实施方式的显示面板的像素的电路图。
具体实施方式
现将参照其中示出了各实施方式的附图在下文中更全面地描述本发明。然而，本发明可以许多不同的形式实施，并且不应被解释为限于本文中阐述的实施方式。相反，这些实施方式被提供以使得本公开内容将是详尽的和完整的，并且将向本领域技术人员全面传达本发明的范围。通篇相似的附图标记表示相似的元件。
将理解的是，当元件被称为在另一元件“上”，该元件可以直接在另一元件上或者可以在它们之间存在居间的元件。相反，当元件被称为“直接”在另一元件“上”时，则不存在居间的元件。
将理解的是，尽管本文中可以使用术语“第一”、“第二”、“第三”等描述各种元件、部件、区域、层和/或区段，但是这些元件、部件、区域、层和/或区段不应受这些术语限制。这些术语仅用于使一个元件、部件、区域、层或区段区别于另一元件、部件、区域、层或区段。因此，在不偏离本文中教导的情况下，下文讨论的第一“元件”、“部件”、“区域”、“层”或“区段”可被称为第二“元件”、“部件”、“区域”、“层”或“区段”。
本文中使用的术语仅用于描述具体实施方式的目的，而非旨在成为限制。如本文中使用的，除非上下文清楚地另有指示，否则单数形式“一”和“该”旨在包括复数形式，而该复数形式包括“至少一个”。“或者”意味着“和/或”。如本文中使用的，术语“和/或”包括相关联的列出项中的一个或多个的任何和所有组合。还将理解的是，术语“包括”，当在本说明书中使用时，指明所陈述的特征、区域、整数、步骤、操作、元件和/或部件的存在，但是并未排除一个或多个其他特征、区域、整数、步骤、操作、元件、部件和/或它们的组的存在或添加。
此外，诸如“下”或“底”和“上”或“顶”的关系术语在本文中可用于描述如图中所示的一个元件与另一元件的关系。将理解的是，除了图中示出的取向之外，关系术语还旨在涵盖设备的不同取向。例如，如果一个图中的设备翻转，则被描述为在其他元件“下”侧的元件将被取向为在其他元件“上”侧。因此，依据图的具体取向，示例性术语“下”能涵盖“下”和“上”这两者的取向。相似地，如果一个图中的设备翻转，则被描述为在其他元件“下方”或“之下”的元件将被取向为在其他元件“上方”。因此，示例性术语“下方”或“之下”能涵盖上方和下方这两者的取向。
除非另有限定，否则本文中使用的所有术语(包括技术术语和科学术语)具有与本公开所属领域的普通技术人员通常理解的含义相同的含义。还将理解的是，术语，诸如常用词典中限定的那些，应被解释为具有与它们在相关领域和本公开的上下文中的含义相一致的含义，而非在理想化的或者过于正式的意义上进行解释，除非在本文中明确地这样限定。
本文中参照作为理想化实施方式的示意性图示的截面描述了示例性实施方式。就其本身而言，将预见到作为例如制造技术和/或公差的结果的图示的形状的变化。因此，本文中描述的实施方式不应被解释为限于如本文中所示的区域的具体形状，而是将包括因例如制造而导致的形状偏差。例如，典型地，被示出或描述为平坦的区域可以具有粗糙的和/或非线性的特征。此外，示出的尖角可以被圆化。因此，图中所示的区域在本质上是示意性的并且它们的形状并非旨在说明区域的准确形状并且并非旨在限制权利要求书的范围。
在下文中，将参照附图详细解释本发明的示例性实施方式。
图1是示出根据本发明的示例性实施方式的显示装置的框图。
参照图1，显示装置的示例性实施方式包括显示面板100和显示面板驱动器。显示面板驱动器包括驱动控制器200、栅极驱动器300、伽马基准电压生成器400和数据驱动器500。
显示面板100具有其上显示图像的显示区域以及与显示区域相邻的外围区域。
显示面板100包括多组栅极线GWL和GCL、多个数据线DL以及电连接到多组栅极线GWL和GCL以及多个数据线DL的多个像素。多组栅极线GWL和GCL在第一方向D1上延伸，并且多个数据线DL在与第一方向D1交叉的第二方向D2上延伸。
驱动控制器200从外部装置(未示出)接收输入图像数据IMG和输入控制信号CONT。在一个示例性实施方式中，例如，输入图像数据IMG可以包括红色图像数据、绿色图像数据和蓝色图像数据。输入图像数据IMG可以包括白色图像数据。输入图像数据IMG可以包括品红色图像数据、青色图像数据和黄色图像数据。输入控制信号CONT可以包括主时钟信号和数据使能信号。输入控制信号CONT还可以包括竖直同步信号和水平同步信号。
驱动控制器200基于输入图像数据IMG和输入控制信号CONT生成第一控制信号CONT1、第二控制信号CONT2、第三控制信号CONT3和数据信号DATA。
驱动控制器200基于输入控制信号CONT生成用于控制栅极驱动器300的操作的第一控制信号CONT1，并且将第一控制信号CONT1输出到栅极驱动器300。第一控制信号CONT1可以包括竖直起动信号和栅极时钟信号。
驱动控制器200基于输入控制信号CONT生成用于控制数据驱动器500的操作的第二控制信号CONT2，并且将第二控制信号CONT2输出到数据驱动器500。第二控制信号CONT2可以包括水平起动信号和负载信号。
驱动控制器200基于输入图像数据IMG生成数据信号DATA。驱动控制器200将数据信号DATA输出到数据驱动器500。
驱动控制器200基于输入控制信号CONT生成用于控制伽马基准电压生成器400的操作的第三控制信号CONT3，并且将第三控制信号CONT3输出到伽马基准电压生成器400。
栅极驱动器300响应于从驱动控制器200接收到的第一控制信号CONT1生成驱动多组栅极线GWL和GCL的栅极信号。栅极驱动器300可以向多组栅极线GWL和GCL依次输出栅极信号。在一个示例性实施方式中，例如，栅极驱动器300可以集成在显示面板100上。在一个示例性实施方式中，例如，栅极驱动器300可以安装在显示面板100上。
伽马基准电压生成器400响应于从驱动控制器200接收到的第三控制信号CONT3生成伽马基准电压VGREF。伽马基准电压生成器400将伽马基准电压VGREF提供给数据驱动器500。伽马基准电压VGREF具有与数据信号DATA的电平对应的值。
在示例性实施方式中，伽马基准电压生成器400可以设置在驱动控制器200中，或者数据驱动器500中。
数据驱动器500从驱动控制器200接收第二控制信号CONT2和数据信号DATA，并且从伽马基准电压生成器400接收伽马基准电压VGREF。数据驱动器500通过使用伽马基准电压VGREF将数据信号DATA转换成具有模拟类型的数据电压。数据驱动器500将数据电压输出到数据线DL。
图2是示出图1的显示面板100的像素的电路图。图3是示出施加到图2的像素的输入信号的时序图。图4是示出在图3的初始化时段INITIAL中的图2的像素的电路图。图5是示出在图3的阈值电压补偿时段VTH COMP中的图2的像素的电路图。图6是示出在图3的编程时段PROGRAMMING中的图2的像素的电路图。图7是示出在图3的阳极初始化时段BCB中的图2的像素的电路图。图8是示出在图3的发射时段EMISSION中的图2的像素的电路图。
参照图1至图8，显示面板100包括多个像素。每个像素包括有机发光元件OLED。
像素接收写入栅极信号GW[n]、补偿栅极信号GC、数据电压VDATA以及初始化电压VINIT、第一电力电压ELVDD和第二电力电压ELVSS，并且像素的有机发光元件OLED发射与数据电压VDATA的电平对应的光，以显示图像。
在这样的实施方式中，写入栅极信号GW[n]可以是针对相应的像素行(例如，第n像素行)具有预定相位的局部信号。这里，n是自然数。在这样的实施方式中，补偿栅极信号GC可以是公共地施加到所有像素行的公共信号。
在示例性实施方式中，如上文所描述的，多个像素中的每个像素，例如，第n行中的像素，可以包括第一开关元件T1、第二开关元件T2和第三开关元件T3、存储电容器CST、编程电容器CPR和有机发光元件OLED。
在示例性实施方式中，如图2中所示，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是P型晶体管。在一个示例性实施方式中，例如，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是多晶硅薄膜晶体管。
第一开关元件T1可以包括连接到第一节点N1的控制电极、接收第一电力电压ELVDD的输入电极和连接到第三节点N3的输出电极。第一开关元件T1的控制电极可以是栅极电极，第一开关元件T1的输入电极可以是源极电极，并且第一开关元件T1的输出电极可以是漏极电极。
第二开关元件T2可以包括接收补偿栅极信号GC的控制电极、连接到第二节点N2的输入电极和连接到第三节点N3的输出电极。第二开关元件T2的控制电极可以是栅极电极，第二开关元件T2的输入电极可以是源极电极，并且第二开关元件T2的输出电极可以是漏极电极。
第三开关元件T3可以包括接收写入栅极信号GW[n]的控制电极、连接到第一节点N1的输入电极和连接到第二节点N2的输出电极。第三开关元件T3的控制电极可以是栅极电极，第三开关元件T3的输入电极可以是源极电极，并且第三开关元件T3的输出电极可以是漏极电极。
存储电容器CST可以包括接收初始化电压VINIT的第一电极和连接到第一节点N1的第二电极。
编程电容器CPR可以包括接收数据电压VDATA的第一电极和连接到第二节点N2的第二电极。
有机发光元件OLED可以包括连接到第三节点N3的第一电极和接收第二电力电压ELVSS的第二电极。有机发光元件OLED的第一电极可以是阳极电极。有机发光元件OLED的第二电极可以是阴极电极。
在示例性实施方式中，如图2和图3中所示，在导通偏置时段ON BIAS期间，第一开关元件T1可以导通，第二开关元件T2可以关断，第三开关元件T3可以关断，第一电力电压ELVDD可以具有高电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有低电平。
在导通偏置时段ON BIAS期间，写入栅极信号GW[n]可以具有高电平并且补偿栅极信号GC可以具有高电平。
在导通偏置时段ON BIAS期间，导通偏置可被施加到第一开关元件T1以增强滞后。此外，在导通偏置时段ON BIAS期间，第二电力电压ELVSS可以具有高电平以防止由于第一开关元件T1的导通而引起的有机发光元件OLED的发射。
在示例性实施方式中，如图3和图4中所示，在导通偏置时段ON BIAS之后的初始化时段INITIAL期间，第一开关元件T1可以导通，第二开关元件T2可以导通，第三开关元件T3可以导通，第一电力电压ELVDD可以具有低电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有低电平。
在初始化时段INITIAL期间，写入栅极信号GW[n]可以具有低电平并且补偿栅极信号GC可以具有低电平。
在初始化时段INITIAL期间，可以通过使用初始化电压VINIT将连接到第一开关元件T1的控制电极的第一节点N1初始化。在初始化时段INITIAL期间，第一节点N1处的电压可以是ELVDD_L+a，其中ELVDD_L表示第一电力电压ELVDD的低电平，并且a表示当写入栅极信号GW[n]以低电平被激活时通过电荷共享而生成的电压。
在示例性实施方式中，如图3和图5中所示，在初始化时段INITIAL之后的阈值电压补偿时段VTH COMP期间，第一开关元件T1可以导通，第二开关元件T2可以导通，第三开关元件T3可以导通，第一电力电压ELVDD可以具有高电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有高电平。
在阈值电压补偿时段VTH COMP期间，写入栅极信号GW[n]可以具有低电平并且补偿栅极信号GC可以具有低电平。
在阈值电压补偿时段VTH COMP期间，第一电力电压ELVDD具有高电平，以使得可以通过使用第一开关元件T1的二极管连接来补偿第一开关元件T1的阈值电压(由|VTH|表示)。在阈值电压补偿时段VTH COMP期间，第一节点N1处的电压可以是ELVDD_H-|VTH|。这里，ELVDD_H表示第一电力电压ELVDD的高电平。
在示例性实施方式中，如图3和图6中所示，在阈值电压补偿时段VTH COMP之后的编程时段PROGRAMMING期间，第一开关元件T1可以导通，第二开关元件T2可以关断，第三开关元件T3可以导通，第一电力电压ELVDD可以具有低电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有高电平。
在编程时段PROGRAMMING期间，写入栅极信号GW[n]可以根据显示面板100中的像素行中的像素的扫描而依次具有低电平并且补偿栅极信号GC可以具有高电平。在图3中，写入栅极信号GW[n]被表示为第n像素行的扫描信号SCAN<n>。
在编程时段PROGRAMMING期间，数据电压VDATA通过数据线DL被施加到像素。在图3中，像素行的数目可以是m(这里，m是大于1的自然数)，以使得数据电压VDATA可以包括第一灰度电压DATA<1>至第m灰度电压DATA<m>。
在编程时段PROGRAMMING期间，第三开关元件T3可以导通，以使得由于第一节点N1和第二节点N2之间的电荷共享以及编程电容器CPR的耦合，第一节点N1处的电压可以是ELVDD_L-|VTH|+a’*VDATA。这里，a’是CPR/(CST+CPR)，其中CPR和CST分别表示编程电容器和存储电容器的电容。
在示例性实施方式中，如图3和图7中所示，在编程时段PROGRAMMING之后的预发射阳极初始化时段BCB期间，第一开关元件T1可以导通，第二开关元件T2可以关断，第三开关元件T3可以关断，第一电力电压ELVDD可以具有低电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有低电平。
在预发射阳极初始化时段BCB期间，写入栅极信号GW[n]可以具有高电平并且补偿栅极信号GC可以具有高电平。
在预发射阳极初始化时段BCB期间，有机发光元件OLED的阳极电极可以在发射之前被初始化，以使得具有低灰度值的显示图像的余像可被增强。此外，在预发射阳极初始化时段BCB期间，第一电力电压ELVDD具有低电平，以使得有机发光元件OLED的阳极电极可以被稳定地初始化。
在示例性实施方式中，如图3和图8中所示，在预发射阳极初始化时段BCB之后的发射时段EMISSION期间，第一开关元件T1可以导通，第二开关元件T2可以关断，第三开关元件T3可以关断，第一电力电压ELVDD可以具有高电平，第二电力电压ELVSS可以具有低电平，并且初始化电压VINIT可以具有高电平。
在发射时段EMISSION期间，写入栅极信号GW[n]可以具有高电平并且补偿栅极信号GC可以具有高电平。
在发射时段EMISSION期间，第一开关元件T1导通，第一电力电压ELVDD具有高电平并且第二电力电压ELVSS具有低电平，以使得可以生成通过第一开关元件T1的电流路径。在发射时段EMISSION期间，有机发光元件OLED可以由于流过第一开关元件T1的电流而发射光。
根据示例性实施方式，如上文提及的，像素电路包括三个晶体管T1、T2和T3以及两个电容器CST和CPR，以使得包括该像素电路的显示面板100可以具有高分辨率。
在这样的实施方式中，包括三个晶体管T1、T2和T3以及两个电容器CST和CPR的像素电路的驱动信号可以被控制，以使得可以减小或者有效地防止上部和下部之间的色差以及串扰，而不增加像素电路中的晶体管的数目。因此，可以增强显示面板100的显示品质。
图9是示出施加到根据本发明的替选示例性实施方式的显示装置的像素的输入信号的时序图。
除了写入栅极信号GW[n]的时序之外，图9的像素电路和显示装置的示例性实施方式与上文参照图1至图8描述的像素电路和显示装置的示例性实施方式基本上相同。因此，将使用相同或相似的附图标记来表示与图1至图8的实施方式相同的或相似的元件，并且将省略其任何重复性的详细描述。
参照图1、图2以及图4至图9，显示面板100的示例性实施方式包括多个像素。每个像素包括有机发光元件OLED。
在这样的实施方式中，如上文所描述的，多个像素中的每个像素可以包括第一开关元件T1、第二开关元件T2和第三开关元件T3、存储电容器CST、编程电容器CPR和有机发光元件OLED，如图2中所示的那样。
在示例性实施方式中，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是P型晶体管。在一个示例性实施方式中，例如，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是多晶硅薄膜晶体管。
在这样的实施方式中，如图9中所示，在导通偏置时段ON BIAS期间，第一开关元件T1可以导通，第二开关元件T2可以关断，第三开关元件T3可以关断，第一电力电压ELVDD可以具有高电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有低电平。
在导通偏置时段ON BIAS之后的第一初始化时段(INITIAL的前部分)期间，第一开关元件T1可以导通，第二开关元件T2可以导通，第三开关元件T3可以关断，第一电力电压ELVDD可以具有低电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有低电平。
在第一初始化时段之后的第二初始化时段(INITIAL的后部分)期间，第一开关元件T1可以导通，第二开关元件T2可以导通，第三开关元件T3可以导通，第一电力电压ELVDD可以具有低电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有低电平。
在示例性实施方式中，如图9中所示，在第一初始化时段(INITIAL的前部分)期间，写入栅极信号GW[n]可以具有高电平并且补偿栅极信号GC可以具有低电平。在这样的实施方式中，在第二初始化时段(INITIAL的后部分)期间，写入栅极信号GW[n]可以具有低电平并且补偿栅极信号GC可以具有低电平。
在第一初始化时段(INITIAL的前部分)期间，第一开关元件T1导通并且第二开关元件T2导通，以使得第二节点N2和第三节点N3可以被初始化。在第二初始化时段(INITIAL的后部分)期间，第一开关元件T1导通，第二开关元件T2导通并且第三开关元件T3导通，以使得第一节点N1、第二节点N2、第三节点N3和存储电容器CST可以被初始化。
根据示例性实施方式，像素电路包括三个晶体管T1、T2和T3以及两个电容器CST和CPR，以使得包括该像素电路的显示面板100可以具有高分辨率。
在这样的实施方式中，包括三个晶体管T1、T2和T3以及两个电容器CST和CPR的像素电路的驱动信号可以被控制，以使得可以减小或者有效地防止上部和下部之间的色差以及串扰，而不增加像素电路中的晶体管的数目。因此，可以增强显示面板100的显示品质。
图10是示出施加到根据本发明的示例性实施方式的显示装置的像素的输入信号的时序图。
除了初始化电压VINIT的时序之外，图10的像素电路和显示装置的示例性实施方式与上文参照图1至图8描述的像素电路和显示装置的示例性实施方式基本上相同。因此，将使用相同或相似的附图标记来表示与图1至图8的实施方式相同的或相似的元件，并且将省略其任何重复性的详细描述。
参照图1、图2、图4至图8和图10，显示面板100的示例性实施方式包括多个像素。每个像素包括有机发光元件OLED。
在这样的实施方式中，如上文所描述的，多个像素中的每个像素可以包括第一开关元件T1、第二开关元件T2和第三开关元件T3、存储电容器CST、编程电容器CPR和有机发光元件OLED。
在示例性实施方式中，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是P型晶体管。在一个示例性实施方式中，例如，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是多晶硅薄膜晶体管。
在这样的实施方式中，如图10中所示，在导通偏置时段ON BIAS期间，第一开关元件T1可以导通，第二开关元件T2可以关断，第三开关元件T3可以关断，第一电力电压ELVDD可以具有高电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有低电平。
在导通偏置时段ON BIAS之后的初始化时段INITIAL期间，第一开关元件T1可以导通，第二开关元件T2可以导通，第三开关元件T3可以导通，第一电力电压ELVDD可以具有低电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有低电平。
在示例性实施方式中，如图10中所示，初始化电压VINIT可以在导通偏置时段ONBIAS和初始化时段INITIAL之间的边界处临时具有高电平。
因此，在这样的实施方式中，第一节点N1处的电压可以进一步瞬时减小。因此，第一节点N1可以被进一步稳定地初始化。
根据示例性实施方式，如上文所描述的，像素电路包括三个晶体管T1、T2和T3以及两个电容器CST和CPR，以使得包括该像素电路的显示面板100可以具有高分辨率。
在这样的实施方式中，包括三个晶体管T1、T2和T3以及两个电容器CST和CPR的像素电路的驱动信号可以被控制，以使得可以减小或者有效地防止上部和下部之间的色差以及串扰，而不增加晶体管的数目。因此，可以增强显示面板100的显示品质。
图11是示出施加到根据本发明的示例性实施方式的显示装置的像素的输入信号的时序图。
除了写入栅极信号GW[n]的时序之外，图11的像素电路和显示装置的示例性实施方式与上文参照图10描述的像素电路和显示装置的示例性实施方式基本上相同。因此，将使用相同或相似的附图标记来表示与图10的实施方式相同的或相似的元件，并且将省略其任何重复性的详细描述。
参照图1、图2、图4至图8和图11，显示面板100的示例性实施方式包括多个像素。每个像素包括有机发光元件OLED。
在这样的实施方式中，如上文所描述的，多个像素中的每个像素可以包括第一开关元件T1、第二开关元件T2和第三开关元件T3、存储电容器CST、编程电容器CPR和有机发光元件OLED。
在示例性实施方式中，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是P型晶体管。在一个示例性实施方式中，例如，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是多晶硅薄膜晶体管。
在这样的实施方式中，如图11中所示，在导通偏置时段ON BIAS期间，第一开关元件T1可以导通，第二开关元件T2可以关断，第三开关元件T3可以关断，第一电力电压ELVDD可以具有高电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有低电平。
在导通偏置时段ON BIAS之后的第一初始化时段(INITIAL的前部分)期间，第一开关元件T1可以导通，第二开关元件T2可以导通，第三开关元件T3可以关断，第一电力电压ELVDD可以具有低电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有低电平。
在第一初始化时段之后的第二初始化时段(INITIAL的后部分)期间，第一开关元件T1可以导通，第二开关元件T2可以导通，第三开关元件T3可以导通，第一电力电压ELVDD可以具有低电平，第二电力电压ELVSS可以具有高电平，并且初始化电压VINIT可以具有低电平。
在示例性实施方式中，如图11中所示，在第一初始化时段(INITIAL的前部分)期间，写入栅极信号GW[n]可以具有高电平并且补偿栅极信号GC可以具有低电平。在这样的实施方式中，在第二初始化时段(INITIAL的后部分)期间，写入栅极信号GW[n]可以具有低电平并且补偿栅极信号GC可以具有低电平。
在第一初始化时段(INITIAL的前部分)期间，第一开关元件T1导通并且第二开关元件T2导通，以使得第二节点N2和第三节点N3可以被初始化。在第二初始化时段(INITIAL的后部分)期间，第一开关元件T1导通，第二开关元件T2导通并且第三开关元件T3导通，以使得第一节点N1、第二节点N2、第三节点N3和存储电容器CST可以被初始化。
在示例性实施方式中，如上文所描述的，初始化电压VINIT可以在导通偏置时段ONBIAS和第一初始化时段(INITIAL的前部分)之间的边界处临时具有高电平。
因此，在这样的实施方式中，第一节点N1处的电压可以进一步瞬时减小。因此，第一节点N1可以被进一步稳定地初始化。
根据示例性实施方式，像素电路包括三个晶体管T1、T2和T3以及两个电容器CST和CPR，以使得包括该像素电路的显示面板100可以具有高分辨率。
在这样的实施方式中，包括三个晶体管T1、T2和T3以及两个电容器CST和CPR的像素电路的驱动信号可以被控制，以使得可以减小或者有效地防止上部和下部之间的色差以及串扰，而不增加晶体管的数目。因此，可以增强显示面板100的显示品质。
图12是示出根据本发明的替选示例性实施方式的显示面板100的像素的电路图。图13是示出施加到图12的像素的输入信号的时序图。图14是示出在图13的初始化时段INITIAL和阈值电压补偿时段COMP中的图12的像素的电路图。图15是示出在图13的编程时段PROGRAMMING中的图12的像素的电路图。图16是示出在图13的发射时段EMISSION中的图12的像素的电路图。
除了第一开关元件T1至第三开关元件T3是N型晶体管之外并且除了输入信号的时序之外，图12至图16的像素电路和显示装置的示例性实施方式与上文参照图1至图8描述的像素电路和显示装置的示例性实施方式基本上相同。因此，将使用相同或相似的附图标记来表示与图1至图8的实施方式相同的或相似的元件，并且将省略其任何重复性的详细描述。
参照图1和图12至图16，显示面板100的示例性实施方式包括多个像素。每个像素包括有机发光元件OLED。
在这样的实施方式中，如图12和图13中所示，像素接收写入栅极信号GW[n]、补偿栅极信号GC、数据电压VDATA和初始化电压VEM、第一电力电压ELVDD和第二电力电压ELVSS，并且像素的有机发光元件OLED发射与数据电压VDATA的电平对应的光，以显示图像。
在示例性实施方式中，写入栅极信号GW[n]可以是针对相应的像素行(例如，第n像素行)具有预定相位的局部信号。在这样的实施方式中，补偿栅极信号GC可以是公共地施加到所有像素行的公共信号。
在这样的实施方式中，如上文所描述的，多个像素中的每个像素可以包括第一开关元件T1、第二开关元件T2和第三开关元件T3、存储电容器CST、编程电容器CPR和有机发光元件OLED。
在本示例性实施方式中，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是N型晶体管。在一个示例性实施方式中，例如，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是氧化物薄膜晶体管。
第一开关元件T1可以包括连接到第一节点N1的控制电极、接收第一电力电压ELVDD输入电极和连接到第三节点N3的输出电极。第一开关元件T1的控制电极可以是栅极电极、第一开关元件T1的输入电极可以是源极电极，并且第一开关元件T1的输出电极可以是漏极电极。
第二开关元件T2可以包括接收补偿栅极信号GC的控制电极、连接到第二节点N2的输入电极和连接到第三节点N3的输出电极。第二开关元件T2的控制电极可以是栅极电极，第二开关元件T2的输入电极可以是源极电极，并且第二开关元件T2的输出电极可以是漏极电极。
第三开关元件T3可以包括接收写入栅极信号GW[n]的控制电极、连接到第一节点N1的输入电极和连接到第二节点N2的输出电极。第三开关元件T3的控制电极可以是栅极电极，第三开关元件T3的输入电极可以是源极电极，并且第三开关元件T3的输出电极可以是漏极电极。
存储电容器CST可以包括接收初始化电压VEM的第一电极和连接到第一节点N1的第二电极。
编程电容器CPR可以包括接收数据电压VDATA的第一电极和连接到第二节点N2的第二电极。
有机发光元件OLED可以包括连接到第三节点N3的第一电极和接收第二电力电压ELVSS的第二电极。有机发光元件OLED的第一电极可以是阳极电极。有机发光元件OLED的第二电极可以是阴极电极。
在示例性实施方式中，第二电力电压ELVSS可以是直流(DC)电压。在一个示例性实施方式中，例如，第二电力电压ELVSS可以具有低电平。
在这样的实施方式中，如图13和图14中所示，在初始化时段INITIAL期间，第一开关元件T1可以导通，第二开关元件T2可以导通，第三开关元件T3可以导通，并且第一电力电压ELVDD可以具有高电平和低电平之间的中间电平。
在初始化时段INITIAL期间，初始化电压VEM可以从高电平下降到低电平。在初始化时段INITIAL期间，写入栅极信号GW[n]可以具有高电平并且补偿栅极信号GC可以具有高电平。
在初始化时段INITIAL期间，可以通过使用第一电力电压ELVDD的中间电平来将连接到第一开关元件T1的控制电极的第一节点N1初始化。在初始化时段INITIAL期间，第一节点N1处的电压可以是ELVDD_INT+|VTH|。这里，ELVDD_INT表示第一电力电压ELVDD的中间电平。
在这样的实施方式中，如图13和图14中所示，在初始化时段INITIAL之后的阈值电压补偿时段COMP期间，第一开关元件T1可以导通，第二开关元件T2可以导通，第三开关元件T3可以导通，第一电力电压ELVDD可以具有低电平，并且初始化电压VEM可以具有低电平。
在阈值电压补偿时段COMP期间，写入栅极信号GW[n]可以具有高电平并且补偿栅极信号GC可以具有高电平。
在阈值电压补偿时段COMP期间，第一电力电压ELVDD从中间电平下降到低电平，以使得可以通过使用第一开关元件T1的二极管连接来补偿第一开关元件T1的阈值电压(由|VTH|表示)。在阈值电压补偿时段COMP期间，第一节点N1处的电压可以是ELVDD_L+|VTH|。这里，ELVDD_L表示第一电力电压ELVDD的低电平。
在这样的实施方式中，如图13和图15中所示，在阈值电压补偿时段COMP之后的编程时段PROGRAMMING期间，第一开关元件T1可以导通，第二开关元件T2可以关断，第三开关元件T3可以导通，第一电力电压ELVDD可以具有高电平，并且初始化电压VEM可以具有低电平。
在编程时段PROGRAMMING期间，写入栅极信号GW[n]可以根据显示面板100中的像素行中的像素的扫描而依次具有高电平并且补偿栅极信号GC可以具有低电平。
在编程时段PROGRAMMING期间，数据电压VDATA通过数据线DL被施加到像素。
在编程时段PROGRAMMING期间，第三开关元件T3可以导通，以使得由于第一节点N1和第二节点N2之间的电荷共享以及编程电容器CPR的耦合，第一节点N1处的电压可以是ELVDD_L+|VTH|+a’*VDATA，其中a’是CPR/(CST+CPR)。
保持时段HOLD可以设置在阈值电压补偿时段COMP和编程时段PROGRAMMING之间。
在保持时段HOLD期间，第一电力电压ELVDD可以具有高电平，并且初始化电压VEM可以具有低电平。
在保持时段HOLD期间，写入栅极信号GW[n]可以具有低电平，并且补偿栅极信号GC可以具有低电平。
在这样的实施方式中，如图13和图16中所示，在编程时段PROGRAMMING之后的发射时段EMISSION期间，第一开关元件T1可以导通，第二开关元件T2可以关断，第三开关元件T3可以关断，第一电力电压ELVDD可以具有高电平，并且初始化电压VEM可以具有高电平。
在发射时段EMISSION期间，写入栅极信号GW[n]可以具有低电平并且补偿栅极信号GC可以具有低电平。
在发射时段EMISSION期间，第一开关元件T1导通，第一电力电压ELVDD具有高电平并且第二电力电压ELVSS具有低电平，以使得可以生成通过第一开关元件T1的电流路径。在发射时段EMISSION期间，有机发光元件OLED可以由于流过第一开关元件T1的电流而发射光。
根据示例性实施方式，如上文所描述的，像素电路包括三个晶体管T1、T2和T3以及两个电容器CST和CPR，以使得包括该像素电路的显示面板100可以具有高分辨率。
在这样的实施方式中，包括三个晶体管T1、T2和T3以及两个电容器CST和CPR的像素电路的驱动信号可以被控制，以使得可以减小或者有效地防止上部和下部之间的色差以及串扰，而不增加像素电路中的晶体管的数目。因此，可以增强显示面板100的显示品质。
图17是示出根据本发明的示例性实施方式的显示装置的像素的电路图。
除了第一开关元件T1至第三开关元件T3是N型晶体管之外，图17的像素电路和显示装置的示例性实施方式与上文参照图1至图8描述的像素电路和显示装置的示例性实施方式基本上相同。因此，将使用相同或相似的附图标记来表示与图1至图8的实施方式相同的或相似的元件，并且将省略其任何重复性的详细描述。
参照图1、图3至图8和图17，显示面板100的示例性实施方式包括多个像素。每个像素包括有机发光元件OLED。
像素接收写入栅极信号GW[n]、补偿栅极信号GC、数据电压VDATA和初始化电压VEM、第一电力电压ELVDD和第二电力电压ELVSS，并且像素的有机发光元件OLED发射与数据电压VDATA的电平对应的光以显示图像。
在示例性实施方式中，写入栅极信号GW[n]可以是针对相应的像素行(例如，第n像素行)具有预定相位的局部信号。在这样的实施方式中，补偿栅极信号GC可以是公共地施加到所有像素行的公共信号。
在这样的实施方式中，如上文所描述的，多个像素中的每个像素可以包括第一开关元件T1、第二开关元件T2和第三开关元件T3、存储电容器CST、编程电容器CPR和有机发光元件OLED。
在示例性实施方式中，第一开关元件T1可以是P型晶体管。在一个示例性实施方式中，例如，第一开关元件T1可以是多晶硅薄膜晶体管。在本示例性实施方式中，第二开关元件T2和第三开关元件T3可以是N型晶体管。在一个示例性实施方式中，例如，第二开关元件T2和第三开关元件T3可以是氧化物薄膜晶体管。
第一开关元件T1是P型晶体管，以使得可以操作预发射阳极初始化，并且可以有效地防止高温下的亮度变化。
第二开关元件T2和第三开关元件T3是N型晶体管，以使得可以有效地防止第二开关元件T2和第三开关元件T3处的电流泄漏。
根据示例性实施方式，像素电路包括三个晶体管T1、T2和T3以及两个电容器CST和CPR，以使得包括该像素电路的显示面板100可以具有高分辨率。
在这样的实施方式中，包括三个晶体管T1、T2和T3以及两个电容器CST和CPR的像素电路的驱动信号可以被控制，以使得可以减小或者有效地防止上部和下部之间的色差以及串扰，而不增加像素电路中的晶体管的数目。因此，可以增强显示面板100的显示品质。
图18是示出根据本发明的示例性实施方式的显示装置的像素的电路图。
除了补偿栅极信号GC之外，图18的像素电路和显示装置的示例性实施方式与上文参照图1至图8描述的像素电路和显示装置的示例性实施方式基本上相同。因此，将使用相同或相似的附图标记来表示与图1至图8的实施方式相同的或相似的元件，并且将省略其任何重复性的详细描述。
参照图1、图3至图8和图18，显示面板100的示例性实施方式包括多个像素。每个像素包括有机发光元件OLED。
像素接收写入栅极信号GW[n]、补偿栅极信号GC、数据电压VDATA和初始化电压VINIT、第一电力电压ELVDD和第二电力电压ELVSS，并且像素的有机发光元件OLED发射与数据电压VDATA的电平对应的光以显示图像。
在示例性实施方式中，写入栅极信号GW[n]可以是针对相应的像素行(例如，第n像素行)具有预定相位的局部信号。在这样的实施方式中，补偿栅极信号GC可以是针对相应的像素行(例如，第n像素行)具有预定相位的局部信号。
在一个示例性实施方式中，补偿栅极信号GC可以是不同像素或另一像素的写入栅极信号。在一个示例性实施方式中，例如，设置在第(n+1)像素行中的像素的写入栅极信号GW[n+1]可被用作设置在第n像素行中的像素的补偿栅极信号GC。替选地，设置在第n像素行中的像素的写入栅极信号GW[n]可被用作设置在第n像素行中的像素的补偿栅极信号GC。替选地，像素的多个写入栅极信号GW中的一个可被用作设置在第n像素行中的像素的补偿栅极信号GC。
在这样的实施方式中，如上文所描述的，多个像素中的每个像素可以包括第一开关元件T1、第二开关元件T2和第三开关元件T3、存储电容器CST、编程电容器CPR和有机发光元件OLED。
在示例性实施方式中，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是P型晶体管。在一个示例性实施方式中，例如，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是多晶硅薄膜晶体管。
根据示例性实施方式，如上文提及的，像素电路包括三个晶体管T1、T2和T3以及两个电容器CST和CPR，以使得包括该像素电路的显示面板100可以具有高分辨率。
在这样的实施方式中，包括三个晶体管T1、T2和T3以及两个电容器CST和CPR的像素电路的驱动信号可以被控制，以使得可以减小或者有效地防止上部和下部之间的色差以及串扰，而不增加像素电路中的晶体管的数目。因此，可以增强显示面板100的显示品质。
图19是示出根据本发明的示例性实施方式的显示装置的像素的电路图。
除了补偿栅极信号GC之外，图19的像素电路和显示装置的示例性实施方式与上文参照图12至图16描述的像素电路和显示装置的示例性实施方式基本上相同。因此，将使用相同或相似的附图标记来表示与图12至图16的实施方式相同的或相似的元件，并且将省略其任何重复性的详细描述。
参照图1、图13至图16和图19，显示面板100的示例性实施方式包括多个像素。每个像素包括有机发光元件OLED。
像素接收写入栅极信号GW[n]、补偿栅极信号GC、数据电压VDATA和初始化电压VEM、第一电力电压ELVDD和第二电力电压ELVSS，并且像素的有机发光元件OLED发射与数据电压VDATA的电平对应的光以显示图像。
在示例性实施方式中，写入栅极信号GW[n]可以是针对相应的像素行(例如，第n像素行)具有预定相位的局部信号。在这样的实施方式中，补偿栅极信号GC可以是针对相应的像素行(例如，第n像素行)具有预定相位的局部信号。
在一个示例性实施方式中，补偿栅极信号GC可以是不同像素或另一像素的写入栅极信号。在一个示例性实施方式中，例如，设置在第(n+1)像素行中的像素的写入栅极信号GW[n+1]可被用作设置在第n像素行中的像素的补偿栅极信号GC。替选地，设置在第n像素行中的像素的写入栅极信号GW[n]可被用作设置在第n像素行中的像素的补偿栅极信号GC。替选地，像素的多个写入栅极信号GW中的一个可被用作设置在第n像素行中的像素的补偿栅极信号GC。
在这样的实施方式中，如上文所描述的，多个像素中的每个像素可以包括第一开关元件T1、第二开关元件T2和第三开关元件T3、存储电容器CST、编程电容器CPR和有机发光元件OLED。
在示例性实施方式中，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是N型晶体管。在一个示例性实施方式中，例如，第一开关元件T1、第二开关元件T2和第三开关元件T3可以是氧化物薄膜晶体管。
根据示例性实施方式，如上文提及的，像素电路包括三个晶体管T1、T2和T3以及两个电容器CST和CPR，以使得包括该像素电路的显示面板100可以具有高分辨率。
在这样的实施方式中，包括三个晶体管T1、T2和T3以及两个电容器CST和CPR的像素电路的驱动信号可以被控制，以使得可以减小或者有效地防止上部和下部之间的色差以及串扰，而不增加像素电路中的晶体管的数目。因此，可以增强显示面板100的显示品质。
根据如本文中描述的本发明的示例性实施方式，其中像素电路包括三个晶体管和两个电容器的显示面板可以具有高分辨率，并且可以增强显示面板的显示品质。
本发明不应被解释为限于本文中所阐述的示例性实施方式。相反，这些示例性实施方式被提供以使得本公开内容将是详尽的和完整的，并且将向本领域技术人员全面传达本发明的范围。
尽管参照本发明的示例性实施方式已具体地示出和描述了本发明，但是本领域普通技术人员将理解的是，在不偏离如所附权利要求书所限定的本发明的精神或范围的情况下，其中可以进行形式和细节上的各种修改。

Claims (19)

1.一种像素电路，包括：
第一开关元件，包括连接到第一节点的控制电极、接收第一电力电压的输入电极和连接到第三节点的输出电极；
第二开关元件，包括接收补偿栅极信号的控制电极、连接到第二节点的输入电极和连接到所述第三节点的输出电极；
第三开关元件，包括接收写入栅极信号的控制电极、连接到所述第一节点的输入电极和连接到所述第二节点的输出电极；
存储电容器，包括接收初始化电压的第一电极和连接到所述第一节点的第二电极；
编程电容器，包括接收数据电压的第一电极和连接到所述第二节点的第二电极；以及
有机发光元件，包括连接到所述第三节点的第一电极和接收第二电力电压的第二电极。
2.根据权利要求1所述的像素电路，其中，所述第一开关元件、所述第二开关元件和所述第三开关元件是P型晶体管。
3.根据权利要求2所述的像素电路，其中，在导通偏置时段期间，所述第一开关元件导通，所述第二开关元件关断，所述第三开关元件关断，所述第一电力电压具有高电平，所述第二电力电压具有低电平，并且所述初始化电压具有低电平。
4.根据权利要求3所述的像素电路，其中，在所述导通偏置时段之后的初始化时段期间，所述第一开关元件导通，所述第二开关元件导通，所述第三开关元件导通，所述第一电力电压具有低电平，所述第二电力电压具有高电平，并且所述初始化电压具有低电平。
5.根据权利要求4所述的像素电路，其中，在所述初始化时段之后的阈值电压补偿时段期间，所述第一开关元件导通，所述第二开关元件导通，所述第三开关元件导通，所述第一电力电压具有高电平，所述第二电力电压具有高电平，并且所述初始化电压具有高电平。
6.根据权利要求5所述的像素电路，其中，在所述阈值电压补偿时段之后的编程时段期间，所述第一开关元件导通，所述第二开关元件关断，所述第三开关元件导通，所述第一电力电压具有低电平，所述第二电力电压具有高电平，并且所述初始化电压具有高电平。
7.根据权利要求6所述的像素电路，其中，在所述编程时段之后的预发射阳极初始化时段期间，所述第一开关元件导通，所述第二开关元件关断，所述第三开关元件关断，所述第一电力电压具有低电平，所述第二电力电压具有高电平，并且所述初始化电压具有低电平。
8.根据权利要求7所述的像素电路，其中，在所述预发射阳极初始化时段之后的发射时段期间，所述第一开关元件导通，所述第二开关元件关断，所述第三开关元件关断，所述第一电力电压具有高电平，所述第二电力电压具有低电平，并且所述初始化电压具有高电平。
9.根据权利要求3所述的像素电路，其中，在所述导通偏置时段之后的第一初始化时段期间，所述第一开关元件导通，所述第二开关元件导通，所述第三开关元件关断，所述第一电力电压具有低电平，所述第二电力电压具有高电平，并且所述初始化电压具有低电平，并且
其中，在所述第一初始化时段之后的第二初始化时段期间，所述第一开关元件导通，所述第二开关元件导通，所述第三开关元件导通，所述第一电力电压具有低电平，所述第二电力电压具有高电平，并且所述初始化电压具有低电平。
10.根据权利要求3所述的像素电路，其中，在所述导通偏置时段之后的初始化时段期间，所述第一开关元件导通，所述第二开关元件导通，所述第三开关元件导通，所述第一电力电压具有低电平，所述第二电力电压具有高电平，并且所述初始化电压具有低电平，并且
其中，所述初始化电压在所述导通偏置时段和所述初始化时段之间的边界处临时具有高电平。
11.根据权利要求3所述的像素电路，其中，在所述导通偏置时段之后的第一初始化时段期间，所述第一开关元件导通，所述第二开关元件导通，所述第三开关元件关断，所述第一电力电压具有低电平，所述第二电力电压具有高电平，并且所述初始化电压具有低电平，
其中，在所述第一初始化时段之后的第二初始化时段期间，所述第一开关元件导通，所述第二开关元件导通，所述第三开关元件导通，所述第一电力电压具有低电平，所述第二电力电压具有高电平，并且所述初始化电压具有低电平，并且
其中，所述初始化电压在所述导通偏置时段和所述第一初始化时段之间的边界处临时具有高电平。
12.根据权利要求1所述的像素电路，其中，所述第一开关元件、所述第二开关元件和所述第三开关元件是N型晶体管。
13.根据权利要求12所述的像素电路，其中，在初始化时段期间，所述第一开关元件导通，所述第二开关元件导通，所述第三开关元件导通，并且所述第一电力电压具有高电平和低电平之间的中间电平。
14.根据权利要求13所述的像素电路，其中，在所述初始化时段之后的阈值电压补偿时段期间，所述第一开关元件导通，所述第二开关元件导通，所述第三开关元件导通，所述第一电力电压具有低电平，并且所述初始化电压具有低电平。
15.根据权利要求14所述的像素电路，其中，在所述阈值电压补偿时段之后的编程时段期间，所述第一开关元件导通，所述第二开关元件关断，所述第三开关元件导通，所述第一电力电压具有高电平，并且所述初始化电压具有低电平。
16.根据权利要求15所述的像素电路，其中，在所述编程时段之后的发射时段期间，所述第一开关元件导通，所述第二开关元件关断，所述第三开关元件关断，所述第一电力电压具有高电平，并且所述初始化电压具有高电平。
17.根据权利要求2或12所述的像素电路，其中，所述补偿栅极信号是不同像素的写入栅极信号。
18.根据权利要求1所述的像素电路，其中，所述第一开关元件是P型晶体管，并且
其中，所述第二开关元件和所述第三开关元件是N型晶体管。
19.一种显示装置，包括：
显示面板，包括多个像素；
栅极驱动器，向所述多个像素输出写入栅极信号；以及
数据驱动器，向所述多个像素输出数据电压，
其中，所述多个像素中的每个包括：
第一开关元件，包括连接到第一节点的控制电极、接收第一电力电压的输入电极和连接到第三节点的输出电极；
第二开关元件，包括接收补偿栅极信号的控制电极、连接到第二节点的输入电极和连接到所述第三节点的输出电极；
第三开关元件，包括接收所述写入栅极信号的控制电极、连接到所述第一节点的输入电极和连接到所述第二节点的输出电极；
存储电容器，包括接收初始化电压的第一电极和连接到所述第一节点的第二电极；
编程电容器，包括接收所述数据电压的第一电极和连接到所述第二节点的第二电极；以及
有机发光元件，包括连接到所述第三节点的第一电极和接收第二电力电压的第二电极。
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