CN107644937A - 电子组件封装体 - Google Patents

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张国彦
叶佳俊
郑国兴
吴幸怡
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Abstract

本发明提供一种电子组件封装体,包括承载板、电子组件、第一绝缘层以及阻隔层。承载板包括中心区、内边缘区以及外边缘区,其中内边缘区位于中心区与外边缘区之间。电子组件配置于承载板上且位于中心区。第一绝缘层配置于承载板上并重叠于电子组件,且第一绝缘层由中心区延伸至内边缘区。阻隔层设置于承载板上,且阻隔层露出中央区,其中阻隔层包括侧壁接触部以及延伸部。侧壁接触部围绕第一绝缘层的侧表面,且延伸部由侧壁接触部以远离第一绝缘层的方向延伸至外边缘区。本发明的电子组件封装体可降低电子组件受到从侧面来的水气而破坏的机率。

Description

电子组件封装体

技术领域

[0001] 本发明涉及一种封装体,尤其涉及一种电子组件封装体。

背景技术

[0002] 随着电子产品中电子组件的设计日趋精密,一些电子组件对于水气较为敏感。以 有机薄膜晶体管数组为例,水气的渗入容易造成有机薄膜晶体管的老化而无法正常运作。 一般来说,有机薄膜晶体管数组是由依序堆叠的多个膜层构成。这些膜层有一部分可以由 数组的中央连续地延伸至边缘。水气及氧气可能通过延伸到边缘的膜层的侧边渗入至内 部,从而加速有机薄膜晶体管的老化,这将造成电子产品寿命的减短,以致无法符合市场的 需求。

发明内容

[0003] 本发明提供一种电子组件封装体,可降低电子组件受到从侧面来的水气而破坏的 机率。

[0004] 本发明是针对一种电子组件封装体,电子组件封装体包括承载板、电子组件、第一 绝缘层以及阻隔层。承载板包括中心区、内边缘区以及外边缘区,其中内边缘区位于中心区 与外边缘区之间。电子组件配置于承载板上且位于中心区。第一绝缘层配置于承载板上并 重叠于电子组件,且第一绝缘层由中心区延伸至内边缘区。阻隔层设置于承载板上,且阻隔 层露出中央区,其中阻隔层包括侧壁接触部以及延伸部。侧壁接触部围绕第一绝缘层的侧 表面,且延伸部由侧壁接触部以远离第一绝缘层的方向延伸至外边缘区。

[0005] 根据本发明的一实施例中,上述的阻隔层还包括覆盖部,其由侧壁接触部以远离 延伸部的方向延伸而覆盖于第一绝缘层上方,且覆盖部暴露出中心区。

[0006] 根据本发明的一实施例中,上述的电子组件包括有机薄膜晶体管,其中有机薄膜 晶体管包括栅极、源极、漏极以及有机半导体有源层。栅极的面积重叠于有机半导体有源层 的面积。第一绝缘层位于栅极与有机半导体有源层之间。源极与漏极连接有机半导体有源 层。

[0007] 根据本发明的一实施例中,上述的侧壁接触部覆盖第一绝缘层的侧表面。

[0008] 根据本发明的一实施例中,上述的电子组件封装体还包括第二绝缘层,第一绝缘 层配置于第二绝缘层与承载板之间。

[0009] 根据本发明的一实施例中,上述的第二绝缘层的面积超出第一绝缘层的侧表面而 具有一侧壁部分,侧壁部分位于第一绝缘层的侧表面与侧壁接触部之间。

[0010] 根据本发明的一实施例中,上述的电子组件封装体还包括侧壁阻挡结构,设置在 内边缘区中,且贯穿第一绝缘层并构成挡墙状。

[0011] 根据本发明的一实施例中,上述的侧壁阻挡结构包括在垂直该承载板的方向上堆 叠的多个子阻挡结构。子阻挡结构的材质包括金属。

[0012] 根据本发明的一实施例中,上述的阻隔层的延伸部在远离承载板的上侧具有凹凸 表面。其中凹凸表面为锯齿状、微杯状、阶梯状或以上任选一种以上的组合。

[0013] 根据本发明的一实施例中,上述的阻隔层的材料为氮化硅(SiNx)、氧化娃(Si〇x) 或多层氮化硅/氧化硅(SiNx/Si0x)薄膜。

[0014] 根据本发明的一实施例中,上述的电子组件封装体还包括有机缓冲层、底阻隔层、 显示介质层以及保护层。有机缓冲层配置于电子组件与承载板之间。底阻隔层配置于有机 缓冲层与承载板之间。显示介质层配置于电子组件上,其中显示介质层与电子组件电性相 连接并用以显示影像。保护层配置于显示介质层上。

[0015] 根据本发明的一实施例中,上述的阻隔层的延伸部接触底阻隔层。

[0016] 根据本发明的一实施例中,上述的阻隔层的侧壁接触部覆盖有机缓冲层的侧表 面。

[0017] 本发明是针对另一种电子组件封装体,电子组件封装体包括承载板、电子组件、多 个绝缘层以及侧壁阻挡结构。承载板包括中心区以及边缘区。电子组件配置于承载板上并 位于中心区。多个绝缘层配置于承载板上并重叠于电子组件,其中多个绝缘层分别由中心 区延伸至边缘区中。侧壁阻挡结构设置在边缘区中,其中侧壁阻挡结构贯穿多个绝缘层并 构成挡墙状。

[0018] 根据本发明的一实施例中,上述的侧壁阻挡结构包括在垂直承载板的方向上堆叠 的多个子阻挡结构。

[0019] 根据本发明的一实施例中,上述多个子阻挡结构的其中一者电性连接电子组件。 各子阻挡结构的材质包括金属。

[0020] 根据本发明的一实施例中,上述的侧壁阻挡结构电性浮置。

[0021]根据本发明的一实施例中,上述的电子组件包括有机薄膜晶体管。多个绝缘层包 括第一绝缘层与第二绝缘层。有机薄膜晶体管包括栅极、源极、漏极以及有机半导体有源 层。栅极的面积重叠于有机半导体有源层的面积。第一绝缘层位于栅极与有机半导体有源 层之间。源极与漏极连接有机半导体有源层,且第一绝缘层配置于第二绝缘层与承载板之 间。

[0022]根据本发明的一实施例中,上述的电子组件封装体还包括有机缓冲层、底阻隔层、 显示介质层以及保护层。有机缓冲层设置于电子组件与承载板之间。底阻隔层设置于有机 缓冲层与承载板之间。显示介质层设置于电子组件上,其中显示介质层与电子组件电性相 连接并用以显示影像。保护层设置于显示介质层上。

[〇〇231基于上述,本发明电子组件封装体中,阻挡结构在垂直于承载板所在平面上具有 一定高度,而可在电子组件封装体的周围形成挡墙一般的结构。如此一来,可降低电子组件 封装体中电子组件受到从侧面来的水气而破坏的机率。

附图说明

[0024]图1为本发明第一实施例的电子组件封装体的剖面示意图;

[0025]图2为本发明第二实施例的电子组件封装体的剖面示意图;

[00261图3为本发明第三实施例的电子组件封装体的剖面示意图;

[00271图4为第三实施例的电子组件封装体10c的上视示意图;

[00281图5为本发明第四实施例的电子组件封装体的剖面示意图;

[0029]图6为本发明第五实施例电子组件封装体的局部构件放大图; [0030]图7为本发明第六实施例电子组件封装体的局部构件放大图; [0031]图8为本发明第七实施例电子组件封装体的局部构件放大图; [0032]图9为本发明第八实施例电子组件封装体的局部构件放大图。

[0033] 附图标记:

[0034] 10&、1013、1(^、10(1、106、101'、108、1011:电子组件封装体;

[0035] 100:承载板;

[0036] 102A:软性基板;

[0037] 102B:支撑基板;

[0038] 104:底阻隔层;

[0039] 106:有机缓冲层;

[0040] 110:电子组件;

[0041] 112:有机薄膜晶体管;

[0042] 122:第一绝缘层;

[0043] 124:第二绝缘层;

[0044] 126:侧壁部分;

[0045] 130、130a 〜130d:阻隔层;

[0046] 132、132a 〜132c:侧壁接触部;

[0047] 134、134a 〜134c:延伸部;

[0048] 136:覆盖部;

[0049] 138a、138b、138c:凹凸表面;

[0050] 140、142、144:接口;

[0051 ] l5〇a、l5〇b:侧壁阻挡结构;

[0052] IMa'IMb'lMc:子阻挡结构;

[0053] AA:中心区;

[0054] CG:封装板;

[0055] CH:有机半导体有源层;

[0056] D:漏极;

[0057] EPL:显示介质层;

[0058] G:栅极;

[0059] IB:内边缘区;

[0060] IN:绝缘层;

[0061 ] Ml:走线;

[0062] M2:导电层;

[0063] 0B:外边缘区;

[0064] PT:凸块;

[0065] PV:保护层;

[0066] S:源极;

[0067] S1、S2、S3:侧表面;

[0068] SE:框胶。

具体实施方式

[0069] 现将详细地参考本发明的示范性实施例,示范性实施例的实例说明于附图中。只 要有可能,相同组件符号在附图和描述中用来表示相同或相似部分。

[0070] 图1为本发第一实施例的电子组件封装体的剖面示意图。请参照图1,电子组件封 装体10a包括承载板100、电子组件110、第一绝缘层122以及阻隔层130。承载板100包括中心 区AA以及在中心区AA周边的边缘区。边缘区可以划分成内边缘区IB以及外边缘区0B。内边 缘区IB位于中心区AA与外边缘区0B之间。在本实施例中,承载板100可为硬质基板,例如为 玻璃基板或是其他具备良好机械强度的基板,但不以此为限。承载板100用以提供电子组件 封装体10a合适的支撑。

[0071] 电子组件110设置于承载板100上且位于承载板1〇〇的中心区AA。第一绝缘层122配 置于承载板1〇〇上并重叠于电子组件110,且第一绝缘层丨22由承载板100的中心区AA延伸至 内边缘区IB。阻隔层130设置于承载板1〇〇上,且阻隔层130包括侧壁接触部132及延伸部 134。侧壁接触部132围绕第一绝缘层122的侧表面S1,且延伸部134由侧壁接触部I32以远离 第一绝缘层122的方向延伸至外边缘区OB。

[0072] 此外,电子组件封装体10a可依需求还包括一条或多条走线Ml,设置于承载板100 上,其中走线Ml可设置于内边缘区IB中并电性连接于电子组件110以作为提供电子组件110 与驱动电路的电传输路径,但本发明不以此为限。具体来说,在走线Ml电性连接于电子组件 110的状况下,走线Ml可用以传递信号。不过,在走线Ml不电性连接于电子组件110的状况 下,走线Ml可以作为静电防护线路或是提供电性屏蔽的功能。此外,在其他实施例中,电子 组件封装体l〇a的内边缘区IB中可选择性地省略走线Ml,本发明不以此为限。

[0073] 为了清楚说明,本说明书中的“外侧”是指在承载板100中中心区AA朝向外边缘区 B0的一侧。反之,“内侧”是指在承载板1〇〇中外边缘区B0朝向中心区AA的一侧。

[0074] 参照图1,为了方便电子组件封装体10a在制作过程中可受到稳定的支撑且在制作 完成后可具备可挠性。在本实施例中,电子组件封装体10a的承载板100可包括一软性基板 102A与一支撑基板102B,软性基板102A设置于电子组件110与支撑基板102B之间。具体来 说,软性基板102A的材质可例如为聚亚酰胺(polyimide,PI)、聚碳酸酯(polycarbonate, 卩〇、聚醚砜(?〇1}^1:11613111€〇116,?£3)、聚丙稀酸酯化〇178(^713七6,?六)、聚原冰稀 (polynorbornene,PNB)、聚乙稀对苯二甲酸醋(polyethylene terephthalate,PET)、聚醚 醚酮(polyetheretherketone,PEEK)、聚萘二甲酸乙二醇酯(polyethylene naphthalate, PEN)或聚醚亚酰胺(polyether imide,PEI)等可烧性材料。在电子组件封装体l〇a制作完成 后,可选择性地将软性基板102A与支撑基板102B分离。此时,承载板100可仅由软性基板 102A构成。

[0075] 为了增进软性基板102A的阻水气特性。在本实施例中,电子组件封装体l〇a可还包 括底阻隔层104,配置于电子组件110与软性基板102A之间,且位于第一绝缘层122与软性基 板102A之间。底阻隔层104可为单层薄膜或是由多层薄膜所构成的叠层,本实施例不限定底 阻隔层104的层数与构成材质。承上述,当底阻隔层104是由多层薄膜所构成的叠层时,底阻 隔层104例如是由有机薄膜与无机薄膜交替堆叠所构成的叠层,或者,底阻隔层1〇4也可以 是由多层无机薄膜堆叠所构成的叠层。当底阻隔层104是由多层无机薄膜堆叠所构成的萱 层时,底阻隔层104可为氮化硅与氧化硅交替堆叠的叠层。底阻隔层1〇4的水气穿^率 (vapor water transmission rate,VWTR)不高于10-2g/m2 • Day(克/米2 •天),较佳不尚于 l〇-6g/m2 • Day。

[0076]为了释放电子组件110与底阻隔层104之间的应力且提升电子组件11〇的附着力, 本实施例可以选择性地于电子组件110与底阻隔层104之间设置有机缓冲层1〇6,以增进电 子组件110的信赖性。在本实施例中,有机缓冲层106配置于电子组件110与承载板1〇〇之间 且底阻隔层104位于有机缓冲层106与承载板100之间。

[0077] 电子组件110可包括薄膜晶体管(Thin Film Transistor,TFT)。详细来说,薄I旲晶 体管可包括非晶硅薄膜晶体管(a-Si TFT)、微晶硅薄膜晶体管(mic:r〇-Si TFT)、多晶硅薄 膜晶体管(P-Si TFT)或有机薄膜晶体管(0TFT)等晶体管。在本实施例中,电子组件110包括 有机薄膜晶体管112但不以此为限,在其他实施例中电子组件110可还包括有电容结构、二 极管或是其他构件等。有机薄膜晶体管112由多个图案化的薄膜所构成且这些薄膜可藉由 喷墨(ink-jet)、旋涂(spin coat)、柔版印刷、沉积等方法而成膜并藉由微影蚀刻法图案化 成所要的图案。具体来说,有机薄膜晶体管112包括栅极G、源极S、漏极D以及有机半导体有 源层CH。栅极G的面积重叠于有机半导体有源层CH的面积。第一绝缘层122位于栅极G与有机 半导体有源层CH之间。源极S与漏极D连接该有机半导体有源层CH。在操作上,栅极G可以控 制有机薄膜晶体管U2的开启(导通)与关闭(断路)。当有机薄膜晶体管112为开启(导通)的 情形下,有机薄膜晶体管112可以允许源极S藉由有机半导体有源层CH电性导通至漏极D。 [0078]在本实施例中,电子组件封装体10a还包括第二绝缘层124。第一绝缘层122配置于 第二绝缘层124与承载板100之间。此外,在本实施例中,电子组件封装体l〇a可还包括配置 于第二绝缘层124上的导电层M2,且导电层M2可以电性连接到漏极D。以在电子组件110开启 时,让电子组件110藉由导电层M2电性导通至其他构件。在本实施例中,电子组件封装体l〇a 实际上是由堆叠在承载板100上的多个膜层所构成。首先,在承载板100上依序设置底阻隔 层104以及有机缓冲层106。此时,作为有机薄膜晶体管112的源极S以及漏极D可与走线Ml同 为第一导电层,可同时形成在有机缓冲层106上。换言之,源极S、漏极D以及走线Ml可并入同 样的工艺当中。接下来,可依序形成有机半导体有源层CH、第一绝缘层122、栅极G、第二绝缘 层124以及走线M2。在栅极G与走线M2形成前,可分别对第一绝缘层122与第二绝缘层124做 适当的图案化以在漏极D上形成一开口。如此一来,走线M2可藉由上述开口与漏极D电性相 连接。

[0079]在其他实施例中,电子组件封装体10a可还包括其他绝缘层,本发明不限制绝缘层 的数目。举例来说,电子组件封装体l〇a可还包括第三绝缘层、第四绝缘层等等。另外,第一 绝缘层122与第二绝缘层124可为有机绝缘材料,其例如为聚对二甲苯基(Paryiene)、六甲 基硅氧烷(HMDS0)或其他具有绝缘性质的有机材料。上述有机绝缘材料的水气穿透率约可 达到10-2g/m2 • Day。不过,在工艺中,无论第一绝缘层122与第二绝缘层124是利用化学气 相层积、物理气相层积或是经由湿膜加热固化成膜,第一绝缘层122或第二绝缘层124中的 缺陷无法避免地会聚集而产生针孔(pin-hloe)。以图1来说明,第一绝缘层122的侧表面S1 与第二绝缘层124的侧表面S2若外露出来,水气便可能由第一绝缘层122的侧表面S1与第二 绝缘层124的侧表面S2进入,进一步藉由第一绝缘层122或第二绝缘层124中的针孔快速扩 散而接触电子组件110,这可能造成电子组件110的损坏。

[0080] 在本实施例中,有机缓冲层106的一侧表面S3外露也可能导致水气由侧表面S3进 入而损坏电子组件110。因此,阻隔层130的侧壁接触部132围绕且覆盖上述的侧表面S1、侧 表面S2以及侧表面S3,且阻隔层130的延伸部134由侧壁接触部132以远离第一绝缘层122的 方向延伸至外边缘层OB,并接触底阻隔层104。此时,侧壁接触部132与延伸部134为一L型结 构并设置承载板100的外边缘区0B。阻隔层130的材料可选用无机材料,例如氮化硅(SiNx)、 氧化硅(SiOx)等。此外,阻隔层130可选择由多层氮化硅/氧化硅(SiNx/SiOx)薄膜堆叠而 成。上述材料的水气穿透率为小于10-4g/m2 • Day。阻隔层130的水气穿透率越小越可阻隔 水气从电子组件封装体l〇a的外侧进入阻隔层130中,因此可确保电子组件110不受水气的 影响。不过,本发明中阻隔层130的材料不以此为限,材料可依据所要求的水气穿透率来调 整。

[0081] 此外,在本实施例中,阻隔层130的侧壁接触部132覆盖有机缓冲层106的侧表面S3 以及第一绝缘层122的侧表面S1,侧壁接触部132接触于侧表面S1、侧表面S2以及侧表面S3 处形成一接口 140。此接口 140有助于阻隔水气从侧壁接触部132扩散至内侧的第一绝缘层 122、第二绝缘层124以及有机缓冲层106中而接触电子组件110,因此可确保电子组件110的 质量。详细来说,接口 140可以使得第一绝缘层122、第二绝缘层124以及有机缓冲层106中的 针孔(pin-hloe)不与侧壁接触部132中的针孔连续。如此一来,水气无法藉由针孔从电子组 件封装体1 〇a的外侧快速扩散进入内侧而影响电子组件11 〇,因此可以确保电子组件1 i〇不 受水气的影响。

[0082]在本实施例中,阻隔层130还包括覆盖部136,覆盖部136由侧壁接触部132以远离 延伸部134的方向延伸而覆盖于第一绝缘层122上方,且覆盖部136露出中心区AA。换言之, 在本实施例中,中心区M上并没有设置阻隔层130的覆盖部136,或是阻隔层130没有延伸到 中心区AA或是没有完全覆盖住中心区AA。一般来说,无机材料相较于有机材料有较易碎的 特性。所以,阻隔层130相较地比第一绝缘层122与第二绝缘层124硬脆。以电子组件封装体 l〇a来说明,当电子组件封装体l〇a进行落球测试时,若阻隔层130布满中心区AA,则相对容 易碎裂,而影响其他组件,甚至造成电子组件封装体l〇a无法正常运作。因此,本实施例的阻 隔层130露出中心区AA,可降低阻隔层130碎裂的机率,因此可确保电子组件封装体l〇a承受 外力的能力。

[0083]在本实施例中,电子组件封装体l〇a可还包括一显示介质层EPL以及一保护层PV。 显示介质层EPL包覆于保护层PV与承载板100之间。显示介质层EPL配置于电子组件110上, 其中显示介质层EPL与电子组件11〇可藉由导电层M2电性相连接并用以显示影像。显示介质 层EPL中的显不介质可为液晶、介电溶剂(dielectric sol vent)与多个掺杂于介电溶剂中 的带电荷粒子所组成的显示介质或是其他合适的显示介质,本发明并不限定显示介质层的 类型与材料。换言之,电子组件封装体l〇a可以用于显示画面而作为显示器,但在另一实施 例中,电子组件110上可不设置有显示介质层EPL而是设置有感应材料(例如可以将光能转 换为电能的光电转换材料),而使得电子组件封装体l〇a用以作为传感器。

[0084]图2为本发明第二实施例的电子组件封装体的剖面示意图。请参照图2,电子组件 封装体10b包括图1中的承载板1〇〇、底阻隔层1〇4、有机缓冲层106、电子组件11〇、第一绝缘 层122、第二绝缘层124、阻隔层130、显示介质层EPL、保护层PV、导电层M2以及走线Ml。电子 组件封装体10b类似于图1的实施例,上述组成构件的特性以及组成构件彼此的连接关系可 以参照电子组件封装体10a的相关描述,此处不再赘述。在本实施例中,电子组件封装体l〇b 与电子组件封装体10a不同的是,第二绝缘层124的面积超出第一绝缘层122的侧表面S1而 具有一侧壁部分126。侧壁部分126位于第一绝缘层122的侧表面S1与侧壁接触部132之间, 且第二绝缘层124可将第一绝缘层122包覆在内。此外,侧壁接触部132围绕侧表面S1、侧壁 部分126远离侧表面S1的侧表面S2以及有机缓冲层106的侧表面S3,且覆盖上述的侧表面S2 以及侧表面S3。

[0085]在本实施例中,侧壁部分126可增加电子组件封装体10b由内侧朝向外侧堆叠的膜 层数量,且相互堆叠的两膜层间会形成一接口。具体来说,电子组件封装体l〇b的侧壁由内 侧至外侧堆叠的膜层依序为第一绝缘层122、第二绝缘层124的侧壁部分126以及侧壁接触 部132。侧壁部分126的侧表面S2以及有机缓冲层106的侧表面S3与侧壁接触部132会形成一 接口 142。另外,侧壁部分126与第一绝缘层122的侧表面S1会形成另一接口 144。如此一来, 类似于图1中的接口 140,上述的两个接口 142与接口 144有助于阻隔水气从电子组件封装体 l〇b的外侧快速扩散进入内侧而避免电子组件110受到水气影响,因此可确保电子组件110 的质量。

[0086]值得注意的是,本发明并不限定绝缘层堆叠的数量,其数量可依需要进行调整。在 另一实施例中,电子组件封装体10b的有机缓冲层106的面积可以小于第二绝缘层124,使侧 壁部分126包覆有机缓冲层106的侧表面S3。另外,电子组件封装体10b可还包括第三绝缘层 (未显示),第三绝缘层的面积超出第二绝缘层124的侧表面S2而具有另一侧壁部分。在电子 组件封装体l〇b的侧壁由内侧至外侧堆叠的膜层依序为第一绝缘层122、第二绝缘层124、第 三绝缘层与侧壁接触部132,且形成总共三个不同的接口。如此一来,三个不同的接口可有 效的阻隔水气从电子组件封装体10b的外侧扩散至内侧,因此可确保电子组件110的质量。 [0087]图3为本发明第三实施例的电子组件封装体的剖面示意图。图4为图3实施例的电 子组件封装体l〇c的上视示意图。首先请参照图3,电子组件封装体10c包括图2中的承载板 100、底阻隔层104、有机缓冲层106、电子组件110、第一绝缘层122、第二绝缘层124、阻隔层 130、显示介质层EPL、一保护层PV、导电层M2以及走线Ml。在电子组件封装体l〇c中,类似于 图2,上述组成构件的特性以及组成构件彼此的连接关系可以参照电子组件封装体丨0a以及 电子组件封装体10b的相关描述,此处不再赘述。

[0088] 在本实施例中,电子组件封装体l〇c与电子组件封装体l〇b不同的是,电子组件封 装体10c还包括一个或多个侧壁阻挡结构150a,设置在内边缘区IB中,且贯穿第一绝缘层 1M与第二绝缘层1M并构成档墙状。侧壁阻挡结构150a配置于有机缓冲层106上且被阻隔 层130的覆盖部I36覆盖。具体来说,侧壁阻挡结构150a可包括多条走线Ml、多个子阻挡结构 15¾以及多个子阻挡结构152b,其中一个子阻挡结构152a以及其中一个子阻挡结构152b依 序在垂直承载板100的方向上堆叠在其中一条走线Ml上而构成其中一个侧壁阻挡结构 150a。也就是说,走线Ml实质上也可以作为构成侧壁阻挡结构150a的其中一个子阻挡结构。 [0089]在本实施例中,多个侧壁阻挡结构150a的至少其中一者的走线Ml可以电性连接电 子组件110。换言之,侧壁阻挡结构l5〇a可以用以传递电子组件11〇的信号。另一实施例中, 多个侧壁阻挡结构150a的走线Ml可全部都不电性连接电子组件11〇。如此,侧壁阻挡结构 150a可以为电性浮置的状态,也可以是作为静电防护用的结构。

[0090]接下来请同时参照图3以及图4,由图3及图4可知多层堆叠的侧壁阻挡结构150a实 质上为一薄片状,且在电子组件封装体l〇c的周边围绕电子组件110。换言之,侧壁阻挡结构 150a可使电子组件封装体l〇c具有多个垂直于承载板100平面的文件墙状结构,此结构可阻 隔水气从电子组件封装体10c的外侧扩散至中心区AA而影响电子组件110的运作。更详细来 说,多个挡墙状的侧壁阻挡结构150a可使电子组件封装体10c从内侧到外侧具有多个垂直 于承载板100平面的接口。如此一来,类似于图1中的接口 140,上述多个接口会防止水气从 外侧藉由膜层中的针孔扩散进入内侧。此外,虽然图3中显示有3个侧壁阻挡结构150a,但侧 壁阻挡结构150a的数量不以此为限。举例来说,电子组件封装体l〇c可包括i个、2个、4个等 的侧壁阻挡结构l5〇a。进一步来说,在部分实施例中,由于侧壁阻挡结构150a具备阻隔水气 的作用,设置有侧壁阻挡结构150a的电子组件封装体可选择性的不需设置阻隔层130,或是 阻隔层130可选择性地不具有侧壁接触部132与延伸部134。

[0091]图5为本发明第四实施例的电子组件封装体的剖面示意图。请参照图5,类似于图 4,在本实施例中电子组件封装体10d包括电子组件封装体10c的承载板100、底阻隔层104、 有机缓冲层106、电子组件110、第一绝缘层122、第二绝缘层124、阻隔层130、显示介质层 EPL、保护层PV、导电层M2以及走线Ml。在电子组件封装体10d中,类似于图3,上述组成构件 的特性以及组成构件彼此的连接关系可以参照电子组件封装体10c的相关描述,此处不再 赘述。

[0092] 在本实施例中,类似于图3,电子组件封装体10d还包括一侧壁阻挡结构150b,设置 于内边缘区IB中,且贯穿第一绝缘层122与第二绝缘层124并构成档墙状。侧壁阻挡结构150 配置于有机缓冲层106上且被阻隔层130的覆盖部136覆盖。在图5的实施例中,侧壁阻挡结 构150b包括子阻挡结构152a、子阻挡结构152b以及子阻挡结构152c,其中子阻挡结构152a 以及子阻挡结构152b依序在垂直承载板100的方向上堆叠在子阻挡结构152c上。子阻挡结 构152a可与走线Ml由相同膜层构成。

[0093] 但与图3的实施例不同的是,在本实施例中,多层结构的侧壁阻挡结构150b与单层 结构的走线Ml独立设置,使得多层结构的侧壁阻挡结构150b位于单层的走线Ml外侧。不过, 类似于图3的侧壁阻挡结构150a,侧壁阻挡结构150b可使电子组件封装体10d从外侧到内侧 具有多个垂直于承载板100平面的接口,因此侧壁阻挡结构150b可阻隔水气从电子组件封 装体10d的扩散,进而影响电子组件110的运作。另外,在本实施例中,侧壁阻挡结构150b也 类似侧壁阻挡结构150a可选择电性连接至电子组件110或电性浮置或作为静电保护的构 件。除此之外,虽然在本实施例中,侧壁阻挡结构150b设置于走线Ml的外侧,但本发明不以 此为限。举例来说,侧壁阻挡结构150b也可设置在相较走线Ml更接近电子组件110的一侧。 进一步来说,在部分实施例中,由于侧壁阻挡结构150b具备阻隔水气的作用,设置有侧壁阻 挡结构150b的电子组件封装体可选择性的不需设置阻隔层130,或是阻隔层130可选择性地 不具有侧壁接触部132与延伸部134。

[0094]在图3以及图5的实施例中,电子组件封装体l〇c以及电子组件封装体10d实质上是 由堆叠于承载板100上的多个膜层所构成。首先,源极S、漏极D、走线Ml以及子阻挡结构152c 可为同一第一导电层,可同时形成在有机缓冲层106上。接下来,依序形成有机半导体有源 层CH以及第一绝缘层122。此时,栅极G以及子阻挡结构152a可为同一第二导电层,可同时形 成第一绝缘层丨22上且子阻挡结构152a贯穿第一绝缘层122而接触走线Ml或子阻挡结构 152c。接着,在第一绝缘层122上形成第二绝缘层124。导电层M2与子阻挡结构15¾可为同一 第三导电层,可同时形成于第二绝缘层124上且子阻挡结构152b贯穿第二绝缘层124而接触 子阻挡结构152a。换言之,在图3以及图5的实施例中,侧壁阻挡结构150a以及侧壁阻挡结构 150b的制作可整合至原有的工艺当中,因此并不会增加额外的工艺造成成本的提高。

[0095]在本实施例中,第一导电层、第二导电层、第三导电层的材料可以是金属、金属合 金、导电氧化物、有机导电材料或是上述材料的组合,且第一导电层、第二导电层与第三导 电层各自可以是多层导电材料层构成的叠层。一般来说,金属材料的水气穿透率会低于有 机材料。若侧壁阻挡结构150a与侧壁阻挡结构150b的材质包括金属,可进一步阻挡水气从 外侧进入,提升防止水气破坏电子组件110的封装效果。不过,上述材质仅是举例说明之用, 并非用以限定本发明。

[0096]图6为本发明第五实施例电子组件封装体的局部构件放大图,其中图6仅显示了电 子组件封装体的承载板、底阻隔层、第一绝缘层、显示介质层、保护层以及阻隔层。请参照图 6,电子组件封装体10e包括承载板1〇〇、底阻隔层104、绝缘层IN、显示介质层EPL、阻隔层 130a、封装板CG以及框胶SE,其中阻隔层130a包括侧壁接触部132a以及延伸部134a。电子组 件封装体l〇e中各个构件的特性及配置关系可以参照上述实施例的任一者,此处不再赘述。 绝缘层IN可以包括前述实施例中记载的第一绝缘层122、第二绝缘层124或其组合。另外,图 6中虽未显示电子组件,但可以参照前述实施例而理解,电子组件、绝缘层IN与阻隔层130a 之间的配置关系。

[0097]在本实施例中,阻隔层130a并无覆盖绝缘层IN,且阻隔层130a与前述阻隔层130的 不同处在于,延伸部134a由多个凸块PT构成而在阻隔层130a远离承载板100的一侧构成一 凹凸表面138a,其中凸块PT彼此分隔设置且凹凸表面138a为锯齿状。具体来说,在阻隔层 130a形成后,可进一步对阻隔层130a的延伸部134进行图案化,使延伸部134a图案化出凸块 PT而形成锯齿状的凹凸表面138a。接下来,会将显示介质层EPL封装于承载板100与封装板 CG之间。在一实施例中,可利用框胶SE围绕显示介质层EPL而将附加电路板1〇〇与封装板CG 组立在一起。由凹凸表面138a与框胶SE彼此形成的接口可有效的阻隔水气从框胶SE的外侧 扩散至绝缘层IN中的第一绝缘层122中并接触电子组件110(未显示,可参照图1〜3与图5), 进而能维持电子组件110 (未显示,可参照图1〜3与图5)的正常运作。

[0098]图7为本发明第六实施例电子组件封装体的局部构件放大图,其中图7仅显示了电 子组件封装体的承载板、底阻隔层、第一绝缘层、显示介质层、保护层以及阻隔层。请参照图 7,电子组件封装体10f包括承载板100、底阻隔层104、绝缘层IN、显示介质层EPL、阻隔层 l3〇b、封装板CG以及框胶SE,其中阻隔层130b包括侧壁接触部132b以及延伸部134b。电子组 件封装体l〇f中各个构件的特性及配置关系可以参照图6实施例的相关叙述,此处不再赘 述。在本实施例中,类似于图6的电子组件封装体10e,阻隔层130b的延伸部134b在阻隔层 130b远离承载板100的一上侧形成一凹凸表面138b。本实施例中的延伸部134b连续地向外 延伸,且所形成的凹凸表面138b为微杯状。即,凹凸表面138b是由延伸部134b中设置有多个 较厚的区段与多个较薄的区段且较厚区段与较薄区段交替分布而构成的。此外,显示介质 层EPL封装于附加电路板1〇〇与封装板CG之间。在一实施例中,可利用框胶SE围绕显示介质 层EPL而将承载板1〇〇与封装板CG组立在一起。由凹凸表面138b与框胶SE彼此形成的接口可 有效的阻隔水气从框胶SE的外侧扩散至绝缘层IN中的第一绝缘层122中并接触电子组件 110(未显示,可参照图1〜3与图5),进而能维持电子组件110(未显示,可参照图1〜3与图5) 的正常运作。

[0099]图8为本发明第七实施例电子组件封装体的局部构件放大图,其中图8仅显示了电 子组件封装体的承载板、底阻隔层、第一绝缘层、显示介质层、保护层以及阻隔层。请参照图 8,电子组件封装体l〇g包括承载板100、底阻隔层104、绝缘层IN、显示介质层EPL、阻隔层 130c、封装板CG以及框胶SE,其中阻隔层130c包括侧壁接触部132c以及延伸部134c。显示介 质层EPL封装于承载板100与封装板CG之间。框胶SE围绕显示介质层EPL而将承载板100与封 装板CG组立在一起。电子组件封装体10g中各个构件的特性及配置关系可以参照上述实施 例,此处不再赘述。在本实施例中,类似于图6的电子组件封装体10e,阻隔层130的延伸部 134c在远离承载板100的一上侧具有一凹凸表面138c。凹凸表面138c具体的形成方式可参 照图6实施例的相关叙述,此处不再赘述。与电子组件封装体10e的凹凸表面138a不同的是, 凹凸表面138c为阶梯状。凹凸表面138c也可阻隔水气从框胶SE的外侧扩散至绝缘层IN中的 第一绝缘层122中并接触电子组件110,进而能维持电子组件110的正常运作。

[0100] 值得注意的是,图6、图7以及图8中延伸部134a〜134c的凹凸表面138a、凹凸表面 138b以及凹凸表面138c皆可应用于图1、图2、图3以及图5的电子组件封装体中,以更降低电 子组件封装体中电子组件受水气破坏的机率。此外,本发明并不限定凹凸表面具体的凹凸 形状,上述凹凸表面138a、凹凸表面138b以及凹凸表面138c的形状仅为示范例但不受此限 制。举例来说,凹凸表面的形状除为锯齿状、微杯状或阶梯状外,也可具有爱心状、三角状或 同时结合上述任一种以上的形状。

[0101]图9为本发明第八实施例电子组件封装体的局部构件放大图。请参照图9,电子组 件封装体l〇h包括承载板100、底阻隔层104、绝缘层IN、显示介质层EPL以及阻隔层130d。电 子组件封装体l〇g中承载板100、底阻隔层104、绝缘层IN以及显示介质层EPL的特性及配置 关系可以参照上述实施例,此处不再赘述。另外,阻隔层130d可采用前述实施例中阻隔层 130来实施。另外,电子组件封装体10h可以包括有前述实施例记载的电子组件110以和/或 侧壁阻挡结构150a或侧壁阻挡结构150b,但不以此为限。具体而言,在本实施例中,显示介 质层EPL封装于承载板100与封装板CG之间,且框胶SE围绕显示介质层EPL而用来将承载板 100与封装板CG组立在一起。本实施例的封装板CG与框胶SE的设置方式可以用来取代前述 实施例任一者中的保护层PV。换言之,本发明实施例并不限定以薄膜状的保护层PV来封装 显示介质层EPL,而可以采用封装板CG搭配框胶SE的方式来封装显示介质层EPL。

[0102]综上所述,本发明的电子组件封装体中,阻隔层以及侧壁阻挡结构的设置可增加 电子组件封装体中垂直于承载板平面的接口数量,其中上述的接口位于电子组件封装体的 周围并围绕电子组件。如此一来,可有效的阻隔水气从外侧扩散进入内侧,降低电子组件封 装体中电子组件受到从侧面来的水气而破坏的机率。此外,侧壁阻挡结构可以整合至原有 的工艺当中,并不会增加额外的成本。

[0103]最后应说明的是:以上各实施例仅用以说明本发明的技术方案,而非对其限制;尽 管参照前述各实施例对本发明进行了详细的说明,本领域的普通技术人员应当理解:其依 然可以对前述各实施例所记载的技术方案进行修改,或者对其中部分或者全部技术特征进 行等同替换;而这些修改或者替换,并不使相应技术方案的本质脱离本发明各实施例技术 方案的范围。

Claims (22)

1. 一种电子组件封装体,其特征在于,包括: 承载板,所述承载板包括中心区、内边缘区以及外边缘区,所述内边缘区位于所述中心 区与所述外边缘区之间; 电子组件,配置于所述承载板上且位于所述中心区; 第一绝缘层,配置于所述承载板上,重叠于所述电子组件且所述第一绝缘层由所述中 心区延伸至所述内边缘区;以及 阻隔层,设置于所述承载板上,且所述阻隔层露出所述中央区,其中所述阻隔层包括侧 壁接触部以及延伸部,所述侧壁接触部围绕所述第一绝缘层的侧表面,且所述延伸部由所 述侧壁接触部以远离所述第一绝缘层的方向延伸至所述外边缘区。
2. 根据权利要求1所述的电子组件封装体,其特征在于,所述阻隔层还包括覆盖部,所 述覆盖部由所述侧壁接触部以远离所述延伸部的方向延伸而覆盖于所述第一绝缘层上方 且所述覆盖部暴露出所述中心区。
3. 根据权利要求1所述的电子组件封装体,其特征在于,所述电子组件包括一有机薄膜 晶体管,其中所述有机薄膜晶体管包括栅极、源极、漏极以及有机半导体有源层,所述栅极 的面积重叠于所述有机半导体有源层的面积,所述第一绝缘层位于所述栅极与所述有机半 导体有源层之间,所述源极与所述漏极连接所述有机半导体有源层。
4. 根据权利要求1所述的电子组件封装体,其特征在于,所述侧壁接触部覆盖所述第一 绝缘层的所述侧表面。
5. 根据权利要求1所述的电子组件封装体,其特征在于,所述电子组件封装体还包括第 二绝缘层,所述第一绝缘层配置于所述第二绝缘层与所述附加电路板之间。
6. 根据权利要求1所述的电子组件封装体,其特征在于,所述第二绝缘层的面积超出所 述第一绝缘层的所述侧表面而具有侧壁部分,所述侧壁部分位于所述第一绝缘层的所述侧 表面与所述侧壁接触部之间。
7. 根据权利要求1所述的电子组件封装体,其特征在于,所述电子组件封装体,还包括 侧壁阻挡结构,设置在所述内边缘区中,且贯穿所述第一绝缘层并构成挡墙状。
8. 根据权利要求7所述的电子组件封装体,其特征在于,所述侧壁阻挡结构包括在垂直 所述附加电路板的方向上堆叠的多个子阻挡结构。
9. 根据权利要求1所述的电子组件封装体,其特征在于,各所述子阻挡结构的材质包括 金属。
10. 根据权利要求1所述的电子组件封装体,其特征在于,所述阻隔层的所述延伸部在 远离所述附加电路板的上侧形成凹凸表面。
11. 根据权利要求10所述的电子组件封装体,其特征在于,所述凹凸表面为锯齿状、微 杯状、阶梯状或以上任选一种以上的组合。
12. 根据权利要求1所述的电子组件封装体,其特征在于,所述阻隔层的材料为SiNx、 SiOx或多层SiNx/SiOx薄膜。
13. 根据权利要求1所述的电子组件封装体,其特征在于,所述电子组件封装体,还包 括: 有机缓冲层,配置于所述电子组件与所述承载板之间; 底阻隔层,配置于所述有机缓冲层与所述承载板之间; 显示介质层,配置于所述电子组件上,其中所述显示介质层与所述电子组件电性相连 接并用以显示影像;以及 保护层,配置于所述显示介质层上。
14. 根据权利要求13所述的电子组件封装体,其特征在于,所述阻隔层的所述延伸部接 触所述底阻隔层。
15. 根据权利要求13所述的电子组件封装体,其特征在于,所述阻隔层的所述侧壁接触 部覆盖所述有机缓冲层的侧表面。
16. —种电子组件封装体,其特征在于,包括: 承载板,所述承载板包括中心区以及边缘区; 电子组件,配置于所述承载板上并位于所述中心区; 多个绝缘层,配置于所述承载板上并重叠于所述电子组件,所述绝缘层分别由所述中 心区延伸至所述边缘区中; 侧壁阻挡结构,设置在所述边缘区中,其中所述侧壁阻挡结构贯穿所述绝缘层并构成 挡墙状。
17. 根据权利要求16所述的电子组件封装体,其特征在于,所述侧壁阻挡结构包括在垂 直所述附加电路板的方向上堆叠的多个子阻挡结构。
18. 根据权利要求17所述的电子组件封装体,其特征在于,所述子阻挡结构其中一者电 性连接所述电子组件。
19. 根据权利要求17所述的电子组件封装体,其特征在于,各所述子阻挡结构的材质包 括金属〇
20. 根据权利要求19所述的电子组件封装体,其特征在于,所述侧壁阻挡结构电性浮 置。
21. 根据权利要求16所述的电子组件封装体,其特征在于,所述电子组件包括有机薄膜 晶体管,所述绝缘层包括第一绝缘层与第二绝缘层,其中所述有机薄膜晶体管包括栅极、源 极、漏极以及有机半导体有源层,所述栅极的面积重叠于所述有机半导体有源层的面积,所 述第一绝缘层位于所述栅极与所述有机半导体有源层之间,所述源极与所述漏极连接所述 有机半导体有源层,且所述第一绝缘层配置于所述第二绝缘层与所述附加电路板之间。
22. 根据权利要求16所述的电子组件封装体,其特征在于,所述电子组件封装体还包 括: 1 有机缓冲层,设置于所述电子组件与所述承载板之间; 底阻隔层,设置于所述有机缓冲层与所述承载板之间; 显示介质层,设置于所述电子组件上,其中所述显示介质层与所述电子组件电性相连 接并用以显示影像;以及 保护层,设置于所述显示介质层上。
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