CN106896957B - 触控式电子设备、触控显示装置及阵列基板栅极驱动电路 - Google Patents

触控式电子设备、触控显示装置及阵列基板栅极驱动电路 Download PDF

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Abstract

本发明公开了阵列基板栅极驱动电路，包括：第一电容，第一电容的一端作为上拉节点，第一电容的另一端作为输出端；充电通路，充电通路分别连接信号输入端和信号控制端；充放电通路，充放电通路分别连接信号输入端、信号控制端和时钟信号输入端，充电通路在信号输入端提供的输入信号和信号控制端提供的控制信号的共同作用下开通以给第一电容充电，同时充放电通路在信号输入端提供的输入信号、信号控制端提供的控制信号和时钟信号输入端提供的时钟信号的共同作用下开通以给第一电容充电，以提高上拉节点的电平，可以有效提高Touch结束后需要启动的那一级的GOA的PU点电平，从而解决TFT的充电不足问题。本发明公开了一种触控显示装置和一种触控式电子设备。

Description

触控式电子设备、触控显示装置及阵列基板栅极驱动电路
技术领域
本发明涉及显示控制技术领域，特别涉及一种阵列基板栅极驱动电路、一种触控显示装置和一种触控式电子设备。
背景技术
具有Touch(触控)功能的显示面板，Display(显示)和Touch分时复用。Touch结束后，需要启动的那一级的GOA(Gate Driver on Array，阵列基板栅极驱动)在Touch阶段PU(Pull Up，上拉)节点一直保持高电平，由于PU节点会漏电，导致Touch结束后需要启动的那一级的GOA的PU节点电平较低，因此像素区TFT(Thin Film Transistor，薄膜晶体管)存在充电不足的问题，影响显示触控效果。
发明内容
本申请是基于发明人对以下问题的认识和研究做出的：
相关技术中的8T2C的GOA电路如图1所示，该8T2C的GOA电路应用于显示触控面板时，Touch结束后，需要启动的那一级的GOA在Touch阶段PU节点只通过一个TFT进行充电变为高电平，但是由于PU节点会漏电，从而会导致Touch结束后需要启动的那一级的GOA的PU节点电平变得较低，导致像素区TFT存在充电不足问题。
本发明旨在至少从一定程度上解决上述技术中的技术问题之一。为此，本发明的第一个目的在于提出一种阵列基板栅极驱动电路，可以有效提高具有Touch功能的显示面板在Touch结束后需要启动的那一级的GOA的PU节点电平，从而解决像素区TFT的充电不足问题。
本发明的第二目的在于提出一种触控显示装置。本发明的第三个目的在于提出一种触控式电子设备。
为达到上述目的，本发明第一方面实施例提出的一种阵列基板栅极驱动电路，包括：第一电容，所述第一电容的一端作为上拉节点，所述第一电容的另一端作为所述阵列基板栅极驱动电路的输出端；充电通路，所述充电通路分别连接信号输入端和信号控制端；充放电通路，所述充放电通路分别连接所述信号输入端、信号控制端和时钟信号输入端，其中，所述充电通路在所述信号输入端提供的输入信号和所述信号控制端提供的控制信号的共同作用下开通以给所述第一电容充电，同时所述充放电通路在所述信号输入端提供的输入信号、所述信号控制端提供的控制信号和所述时钟信号输入端提供的时钟信号的共同作用下开通以给所述第一电容充电，以提高所述上拉节点的电平。
根据本发明实施例的阵列基板栅极驱动电路，通过增加一个充放电通路，来对第一电容C1进行充电，使得上拉节点PU点电平变得更高，有效地提高具有Touch功能的显示面板在Touch结束后需要启动的那一级的GOA的PU节点电平，避免因PU节点漏电而导致Touch结束后需要启动的那一级的GOA的PU节点电平较低的问题，防止PU节点电平变得较低而导致像素区TFT存在充电不足的问题，保证具有Touch功能的显示面板的触控显示效果，充分满足用户的需要。
根据本发明的一个实施例，所述充电通路包括第一薄膜晶体管，所述第一薄膜晶体管的栅极与第一信号输入端相连，所述第一薄膜晶体管的漏极与第一信号控制端相连，所述第一薄膜晶体管的源极与所述上拉节点相连，所述充放电通路包括第二薄膜晶体管和第三薄膜晶体管，所述第二薄膜晶体管的栅极分别与所述第一薄膜晶体管的漏极和所述第一信号控制端相连，所述第二薄膜晶体管的漏极分别与所述第一薄膜晶体管的栅极和所述第一信号输入端相连，所述第三薄膜晶体管的漏极与所述第二薄膜晶体管的源极相连，所述第三薄膜晶体管的源极与所述上拉节点相连，所述第三薄膜晶体管的栅极连接第一时钟信号输入端，其中，当所述第一信号输入端提供的输入信号为高电平、所述第一信号控制端提供的控制信号为高电平且所述第一时钟信号输入端提供的时钟信号为高电平时，所述第一薄膜晶体管打开，且所述第二薄膜晶体管和所述第三薄膜晶体管打开，所述第一信号控制端提供的高电平通过所述第一薄膜晶体管给所述第一电容充电，并通过所述第二薄膜晶体管和所述第三薄膜晶体管给所述第一电容充电。
根据本发明的一个实施例，所述充电通路还包括第四薄膜晶体管，所述第四薄膜晶体管的栅极与第二信号输入端相连，所述第四薄膜晶体管的源极与第二信号控制端相连，所述第四薄膜晶体管的漏极与所述上拉节点相连，所述充放电通路还包括第五薄膜晶体管和第六薄膜晶体管，所述第五薄膜晶体管的栅极分别与所述第四薄膜晶体管的源极和所述第二信号控制端相连，所述第五薄膜晶体管的源极分别与所述第四薄膜晶体管的栅极和所述第二信号输入端相连，所述第六薄膜晶体管的源极与所述第五薄膜晶体管的漏极相连，所述第六薄膜晶体管的漏极与所述上拉节点相连，所述第六薄膜晶体管的栅极连接第一时钟信号输入端，其中，
当所述第二信号输入端提供的输入信号为高电平且第一信号输入端提供的输入信号为低电平、所述第二信号控制端提供的控制信号为高电平且第一信号控制端提供的控制信号为低电平、所述第一时钟信号输入端提供的时钟信号为高电平时，所述第四薄膜晶体管打开，且所述第五薄膜晶体管和所述第六薄膜晶体管打开，所述第二信号控制端提供的高电平通过所述第四薄膜晶体管给所述第一电容充电，并通过所述第五薄膜晶体管和所述第六薄膜晶体管给所述第一电容充电。
其中，当所述第一信号控制端提供的控制信号为高电平且所述第二信号控制端提供的控制信号为低电平时，所述阵列基板栅极驱动电路进行正扫；当所述第一信号控制端提供的控制信号为低电平且所述第二信号控制端提供的控制信号为高电平时，所述阵列基板栅极驱动电路进行反扫。
根据本发明的一个实施例，当所述第二信号输入端提供的输入信号为高电平且第一信号输入端提供的输入信号为低电平、所述第二信号控制端提供的控制信号为低电平且第一信号控制端提供的控制信号为高电平、所述第一时钟信号输入端提供的时钟信号为高电平时，所述第四薄膜晶体管打开，且所述第二薄膜晶体管和所述第三薄膜晶体管打开，所述上拉节点通过所述第四薄膜晶体管拉低到低电平，并通过所述第二薄膜晶体管和所述第三薄膜晶体管拉低到低电平以进行加速放电；当所述第二信号输入端提供的输入信号为低电平且第一信号输入端提供的输入信号为高电平、所述第二信号控制端提供的控制信号为高电平且第一信号控制端提供的控制信号为低电平、所述第一时钟信号输入端提供的时钟信号为高电平时，所述第一薄膜晶体管打开，且所述第五薄膜晶体管和所述第六薄膜晶体管打开，所述上拉节点通过所述第一薄膜晶体管拉低到低电平，并通过所述第五薄膜晶体管和所述第六薄膜晶体管拉低到低电平以进行加速放电。
根据本发明的一个实施例，所述的阵列基板栅极驱动电路，还包括：第七薄膜晶体管，所述第七薄膜晶体管的栅极与漏极相连后连接到所述第一时钟信号输入端；第八薄膜晶体管，所述第八薄膜晶体管的漏极与所述上拉节点相连，所述第八薄膜晶体管的栅极与所述第七薄膜晶体管的源极相连，所述第八薄膜晶体管的栅极与所述第七薄膜晶体管的源极之间的节点作为下拉节点；第九薄膜晶体管，所述第九薄膜晶体管的栅极与所述上拉节点相连，所述第九薄膜晶体管的漏极与所述下拉节点相连；第十薄膜晶体管，所述第十薄膜晶体管的栅极与所述第一电容的另一端相连，所述第十薄膜晶体管的漏极与所述下拉节点相连；第十一薄膜晶体管，所述第十一薄膜晶体管的漏极与所述第一电容的另一端相连，所述第十一薄膜晶体管的栅极与所述下拉节点相连；第十二薄膜晶体管，所述第十二薄膜晶体管的漏极与第二时钟信号输入端相连，所述第十二薄膜晶体管的栅极与所述上拉节点相连，所述第十二薄膜晶体管的源极与所述第一电容的另一端相连；其中，所述第八薄膜晶体管的源极、所述第九薄膜晶体管的源极、所述第十薄膜晶体管的源极和所述第十一薄膜晶体管的源极共同连接到直流低电平信号端，所述下拉节点与所述直流低电平信号端之间连接有第二电容。
其中，当所述第一时钟信号输入端提供的时钟信号为高电平时，所述第二时钟信号输入端提供的时钟信号为低电平；当所述第二时钟信号输入端提供的时钟信号为高电平时，所述第一时钟信号输入端提供的时钟信号为低电平。
根据本发明的一个实施例，当所述第一信号控制端提供的控制信号为高电平且所述第二信号控制端提供的控制信号为低电平时，其中，在所述第一信号输入端提供的输入信号为高电平、所述第一时钟信号输入端提供的时钟信号为高电平且所述第二时钟信号输入端提供的时钟信号为低电平时，所述上拉节点变为高电平，所述第十二薄膜晶体管打开，所述阵列基板栅极驱动电路的输出端输出低电平；在所述第一时钟信号输入端提供的时钟信号为低电平且所述第二时钟信号输入端提供的时钟信号为高电平时，所述第一电容对所述上拉节点进行电压自举以使所述上拉节点保持高电平，所述第十二薄膜晶体管打开，所述阵列基板栅极驱动电路的输出端输出高电平；在所述第一时钟信号输入端提供的时钟信号为低电平且所述第二时钟信号输入端提供的时钟信号为低电平时，所述上拉节点保持高电平，所述第十二薄膜晶体管打开，所述阵列基板栅极驱动电路的输出端输出低电平；在所述第二信号输入端提供的输入信号为高电平、所述第一时钟信号输入端提供的时钟信号为高电平且所述第二时钟信号输入端提供的时钟信号为低电平时，所述第四薄膜晶体管打开，所述第七薄膜晶体管打开，所述上拉节点拉低到低电平，所述第九薄膜晶体管关闭，所述下拉节点变为高电平，所述第十一薄膜晶体管打开，所述阵列基板栅极驱动电路的输出端输出低电平。
为达到上述目的，本发明第二方面实施例还提出了一种触控显示装置，其包括上述的阵列基板栅极驱动电路。
根据本发明实施例的触控显示装置，通过上述的阵列基板栅极驱动电路，能够有效地提高Touch结束后需要启动的那一级的GOA的PU节点电平，避免因PU节点漏电而导致Touch结束后需要启动的那一级的GOA的PU节点电平较低的问题，防止PU节点电平变得较低而导致像素区TFT存在充电不足的问题，保证了触控显示效果，充分满足用户的需要。
此外，本发明实施例还提出了一种触控式电子设备，其包括上述的触控显示装置。
本发明实施例的触控式电子设备，采用上述的触控显示装置，触控显示效果佳，响应快速，提高了用户体验。
附图说明
图1为相关技术中的一种8T2C的GOA电路示意图；
图2为根据本发明一个实施例的12T2C的GOA电路示意图；
图3为根据本发明一个实施例的12T2C的GOA电路的对应时序图；
图4为根据本发明实施例的触控显示装置的方框示意图；以及
图5为根据本发明实施例的触控式电子设备的方框示意图。
具体实施方式
下面详细描述本发明的实施例，所述实施例的示例在附图中示出，其中自始至终相同或类似的标号表示相同或类似的元件或具有相同或类似功能的元件。下面通过参考附图描述的实施例是示例性的，旨在用于解释本发明，而不能理解为对本发明的限制。
下面参照附图来描述根据本发明实施例提出的阵列基板栅极驱动电路、触控显示装置和触控式电子设备。
结合附图所示，本发明实施例提出的阵列基板栅极驱动电路包括：第一电容C1、充电通路10和充放电通路20。
如图2所示，第一电容C1的一端作为上拉节点PU点，第一电容C1的另一端作为阵列基板栅极驱动电路的输出端OUTPUT，即可以是触控显示装置例如带有Touch功能的显示面板中任意一级的GOA电路的输出端。充电通路10分别连接信号输入端和信号控制端，例如连接第一信号输入端STV和第一信号控制端CN。充放电通路20分别连接信号输入端、信号控制端和时钟信号输入端，例如连接第一信号输入端STV、第一信号控制端CN和第一时钟信号输入端CKB。
其中，充电通路10在信号输入端提供的输入信号和信号控制端提供的控制信号的共同作用下开通以给第一电容C1充电，同时充放电通路20在信号输入端提供的输入信号、信号控制端提供的控制信号和时钟信号输入端提供的时钟信号的共同作用下开通以给第一电容C1充电，以提高上拉节点PU点的电平。
也就是说，在本发明的实施例中，可以通过两个通路对第一电容C1进行充电，使得PU点电平变得更高，这样可以有效提高触控显示装置例如具有Touch功能的显示面板在Touch结束后需要启动的那一级的GOA的PU节点电平，从而解决像素区TFT存在的充电不足问题。
根据本发明的一个实施例，如图2所示，充电通路10包括第一薄膜晶体管T1，第一薄膜晶体管T1的栅极与第一信号输入端STV相连，第一薄膜晶体管T1的漏极与第一信号控制端CN相连，第一薄膜晶体管T1的源极与上拉节点PU点相连，充放电通路20包括第二薄膜晶体管T2和第三薄膜晶体管T3，第二薄膜晶体管T2的栅极分别与第一薄膜晶体管T1的漏极和第一信号控制端CN相连，第二薄膜晶体管T2的漏极分别与第一薄膜晶体管T1的栅极和第一信号输入端STV相连，第三薄膜晶体管T3的漏极与第二薄膜晶体管T2的源极相连，第三薄膜晶体管T3的源极与上拉节点PU点相连，第三薄膜晶体管T3的栅极连接第一时钟信号输入端CKB。其中，当第一信号输入端STV提供的输入信号为高电平、第一信号控制端CN提供的控制信号为高电平且第一时钟信号输入端CKB提供的时钟信号为高电平时，第一薄膜晶体管T1打开，且第二薄膜晶体管T2和第三薄膜晶体管T3打开，第一信号控制端CN提供的高电平通过第一薄膜晶体管T1给第一电容C1充电，并通过第二薄膜晶体管T2和第三薄膜晶体管T3给第一电容C1充电，从而通过两条通路给电容C1充电，使得PU点电平变得更高。
并且，如图2所示，充电通路10还包括第四薄膜晶体管T4，第四薄膜晶体管的栅极T4与第二信号输入端RESET相连，第四薄膜晶体管T4的源极与第二信号控制端CNB相连，第四薄膜晶体管T4的漏极与上拉节点PU点相连，充放电通路20还包括第五薄膜晶体管T5和第六薄膜晶体管T6，第五薄膜晶体管T5的栅极分别与第四薄膜晶体管T4的源极和第二信号控制端CNB相连，第五薄膜晶体管T5的源极分别与第四薄膜晶体管T4的栅极和第二信号输入端RESET相连，第六薄膜晶体管T6的源极与第五薄膜晶体管T5的漏极相连，第六薄膜晶体管T6的漏极与上拉节点PU点相连，第六薄膜晶体管T6的栅极连接第一时钟信号输入端CKB。其中，当第二信号输入端RESET提供的输入信号为高电平且第一信号输入端STV提供的输入信号为低电平、第二信号控制端CNB提供的控制信号为高电平且第一信号控制端CN提供的控制信号为低电平、第一时钟信号输入端CKB提供的时钟信号为高电平时，第四薄膜晶体管T4打开，且第五薄膜晶体管T5和第六薄膜晶体管T6打开，第二信号控制端CNB提供的高电平通过第四薄膜晶体管T4给第一电容C1充电，并通过第五薄膜晶体管T5和第六薄膜晶体管T6给第一电容C1充电，从而也是通过两条通路给电容C1充电，使得PU点电平变得更高。
在本发明的一个实施例中，当第一信号控制端CN提供的控制信号为高电平且第二信号控制端CNB提供的控制信号为低电平时，阵列基板栅极驱动电路进行正扫；当第一信号控制端CN提供的控制信号为低电平且第二信号控制端CNB提供的控制信号为高电平时，阵列基板栅极驱动电路进行反扫。通过第一信号控制端和第二信号控制端提供的高低电平来控制正反扫的方式，使得阵列基板栅极驱动电路更具普适性，应用范围广。
也就是说，如图2所示，两个时钟信号输入端为第一时钟信号输入端CKB和第二时钟信号输入端CK，两个输入信号端为第一信号输入端STV和第二信号输入端RESET，两个控制信号输入端为第一控制信号输入端CN和第二控制信号输入端CNB。其中第一控制信号输入端CN提供的控制信号与第二控制信号输入端CNB提供的控制信号为控制正反扫的高低电平，若CN为高电平，CNB为低电平则为正扫，反之则为反扫，STV与RESET为正、反扫的输入信号。
可以理解的是，触控显示装置例如具有Touch功能的显示面板，Touch结束后，需要启动的那一级的GOA在Touch阶段PU点一直保持高电平，但是由于PU点会漏电，则在Touch开始前需要PU点电平越高越好，因此，本发明通过增加T2、T3和T5、T6后，正扫时，通过T1和T2、T3给电容C1充电，使PU点电平升高，反扫时，通过T4和T5、T6给电容C1充电，使PU点电平升高，与只通过一个TFT充电相比，PU点电平更高，从而解决像素区TFT存在的充电不足问题。
根据本发明的一个实施例，当第二信号输入端RESET提供的输入信号为高电平且第一信号输入端STV提供的输入信号为低电平、第二信号控制端CNB提供的控制信号为低电平且第一信号控制端CN提供的控制信号为高电平、第一时钟信号输入端CKB提供的时钟信号为高电平时，第四薄膜晶体管T4打开，且第二薄膜晶体管T2和第三薄膜晶体管T3打开，上拉节点PU点通过第四薄膜晶体管T4拉低到低电平，并通过第二薄膜晶体管T2和第三薄膜晶体管T3拉低到低电平以进行加速放电；当第二信号输入端RESET提供的输入信号为低电平且第一信号输入端STV提供的输入信号为高电平、第二信号控制端CNB提供的控制信号为高电平且第一信号控制端CN提供的控制信号为低电平、第一时钟信号输入端CKB提供的时钟信号为高电平时，第一薄膜晶体管T1打开，且第五薄膜晶体管T5和第六薄膜晶体管T6打开，上拉节点PU点通过第一薄膜晶体管T1拉低到低电平，并通过第五薄膜晶体管T5和第六薄膜晶体管T6拉低到低电平以进行加速放电。
即言，如图2所示，当阵列基板栅极驱动电路无输出时，正扫时，PU点可以通过增加的放电通路T2和T3拉低到低电平，加速PU点的放电，反扫时，PU点可以通过增加的放电通路T5和T6拉低到低电平，加速PU点的放电。因此，通过加速PU点的放电，可以实现具有Touch功能的显示面板的快速响应。
根据本发明的一个实施例，如图2所示，上述的阵列基板栅极驱动电路还包括：第七薄膜晶体管T7、第八薄膜晶体管T8、第九薄膜晶体管T9、第十薄膜晶体管T10、第十一薄膜晶体管T11、第十二薄膜晶体管T12。第七薄膜晶体管T7的栅极与漏极相连后连接到第一时钟信号输入端CKB；第八薄膜晶体管T8的漏极与上拉节点PU点相连，第八薄膜晶体管T8的栅极与第七薄膜晶体管T7的源极相连，第八薄膜晶体管T8的栅极与第七薄膜晶体管T7的源极之间的节点作为下拉节点PD(Pull Down)点，第九薄膜晶体管T9的栅极与上拉节点PU点相连，第九薄膜晶体管T9的漏极与下拉节点PD点相连；第十薄膜晶体管T10的栅极与第一电容C1的另一端相连，第十薄膜晶体管T10的漏极与下拉节点PD点相连；第十一薄膜晶体管T11的漏极与第一电容C1的另一端相连，第十一薄膜晶体管T11的栅极与下拉节点PD点相连；第十二薄膜晶体管T12的漏极与第二时钟信号输入端CK相连，第十二薄膜晶体管T12的栅极与上拉节点PU点相连，第十二薄膜晶体管T12的源极与第一电容C1的另一端相连。其中，第八薄膜晶体管T8的源极、第九薄膜晶体管T9的源极、第十薄膜晶体管T10的源极和第十一薄膜晶体管T11的源极共同连接到直流低电平信号端VSS，下拉节点PD点与直流低电平信号端VSS之间连接有第二电容C2。
也就是说，本实施例的阵列基板栅极驱动电路包括12个TFT和2个电容，即构成了12T2C的GOA电路，与相关技术中的8T2C的GOA电路相比，通过增加T2、T3和T5、T6后，正扫时，通过T1和T2、T3给电容C1充电，使PU点电平升高，反扫时，通过T4和T5、T6给电容C1充电，使PU点电平升高。本实施例的GOA电路，是对相关技术中的8T2C的GOA电路进一步改进，可以有效提高具有Touch功能的显示面板在Touch结束后需要启动的那一级的GOA的PU点电平，从而更好地解决像素区TFT存在的充电问题。
具体地，在本发明的一个实施例中，结合图2和图3所示，当第一信号控制端CN提供的控制信号为高电平且第二信号控制端CNB提供的控制信号为低电平时，进行正扫。下面就以正扫为例进行说明，图3为12T2C的GOA电路对应时序，此时第一信号控制端CN提供的控制信号为高电平，第二信号控制端CNB提供的控制信号为低电平，第一信号输入端STV提供上级输入信号，第二信号输入端RESET提供下级输入信号。
其中，在t1时刻，在第一信号输入端STV提供的输入信号为高电平、第一时钟信号输入端CKB提供的时钟信号为高电平且第二时钟信号输入端CK提供的时钟信号为低电平时，第一薄膜晶体管T1打开，且第二薄膜晶体管T2和第三薄膜晶体管T3打开，第一信号控制端CN提供的高电平通过第一薄膜晶体管T1给第一电容C1充电，同时通过第二薄膜晶体管T2和第三薄膜晶体管T3给第一电容C1充电，T3打开，上拉节点PU点变为高电平，第十二薄膜晶体管T12打开，此时第二时钟信号输入端CK提供的时钟信号为低电平，阵列基板栅极驱动电路的输出端OUTPUT输出低电平。
在t2时刻，在第一时钟信号输入端CKB提供的时钟信号为低电平且第二时钟信号输入端CK提供的时钟信号为高电平时，CK为高电平，由于自举作用PU点电平进一步提高，即第一电容C1对上拉节点PU点进行电压自举以使上拉节点PU点保持高电平，第十二薄膜晶体管T12打开，阵列基板栅极驱动电路的输出端OUTPUT输出高电平。
在t3时刻，在第一时钟信号输入端CKB提供的时钟信号为低电平且第二时钟信号输入端CK提供的时钟信号为低电平时，PU点由于自举作用电平降低，但还是处于较高电平，即上拉节点PU点保持高电平，第十二薄膜晶体管T12打开，此时CK为低电平，阵列基板栅极驱动电路的输出端OUTPUT输出低电平。
在t4时刻，在第二信号输入端RESET提供的输入信号为高电平、第一时钟信号输入端CKB提供的时钟信号为高电平且第二时钟信号输入端CK提供的时钟信号为低电平时，由于第二信号输入端RESET提供的输入信号为高电平，第四薄膜晶体管T4打开，第七薄膜晶体管T7打开，上拉节点PU点拉低到低电平，第九薄膜晶体管T9关闭，下拉节点PD点变为高电平，第十一薄膜晶体管T11打开，阵列基板栅极驱动电路的输出端OUTPUT输出低电平。
在本发明的实施例中，第一电容C1是起到PU点电压自举的作用，第二电容C2是起到稳定PD点电压及降低PD点噪声的作用。并且，本发明实施例的阵列基板栅极驱动电路增加了T2、T3和T5、T6后，当本级有输出时，正扫时，通过T1和T2、T3给电容C1充电，使PU点电平升高，反扫时，通过T4和T5、T6给电容C1充电，使PU点电平升高，与只通过一个TFT充电相比，PU点电平更高，从而解决像素区TFT存在的充电不足问题。当阵列基板栅极驱动电路无输出时，正扫时，PU点可以通过增加的放电通路T2和T3拉低到低电平，加速PU点的放电，反扫时，PU点可以通过增加的放电通路T5和T6拉低到低电平，加速PU点的放电，可以实现具有Touch功能的显示面板的快速响应。
需要说明的是，本发明实施例的阵列基板栅极驱动电路是具有Touch功能的显示面板的驱动电路中的一级，而具有Touch功能的显示面板的驱动电路可以有多级GOA电路，多级GOA电路级联在一起。
根据本发明的一个实施例，如图3所示，当第一时钟信号输入端CKB提供的时钟信号为高电平时，第二时钟信号输入端CK提供的时钟信号为低电平；当第二时钟信号输入端CK提供的时钟信号为高电平时，第一时钟信号输入端CKB提供的时钟信号为低电平。
根据本发明实施例的阵列基板栅极驱动电路，通过增加一个充放电通路，来对第一电容C1进行充电，使得上拉节点PU点电平变得更高，有效地提高具有Touch功能的显示面板在Touch结束后需要启动的那一级的GOA的PU节点电平，避免因PU节点漏电而导致Touch结束后需要启动的那一级的GOA的PU节点电平较低的问题，防止PU节点电平变得较低而导致像素区TFT存在充电不足的问题，保证具有Touch功能的显示面板的触控显示效果，充分满足用户的需要。
如图4所示，本发明的实施例还提出了一种触控显示装置100，其包括上述实施例描述的阵列基板栅极驱动电路200。
其中，该触控显示装置100可以是带有Touch功能的显示面板，或者其他具有触控显示功能的装置。
根据本发明实施例的触控显示装置，通过上述的阵列基板栅极驱动电路，能够有效地提高Touch结束后需要启动的那一级的GOA的PU节点电平，避免因PU节点漏电而导致Touch结束后需要启动的那一级的GOA的PU节点电平较低的问题，防止PU节点电平变得较低而导致像素区TFT存在充电不足的问题，保证了触控显示效果，充分满足用户的需要。
此外，如图5所示，本发明的实施例还提出了一种触控式电子设备300，其包括上述的触控显示装置100。其中，该触控式电子设备300可以是带有触控显示屏的手机、平板等。
本发明实施例的触控式电子设备，采用上述的触控显示装置，触控显示效果佳，响应快速，提高了用户体验。
在本发明的描述中，需要理解的是，术语“中心”、“纵向”、“横向”、“长度”、“宽度”、“厚度”、“上”、“下”、“前”、“后”、“左”、“右”、“竖直”、“水平”、“顶”、“底”“内”、“外”、“顺时针”、“逆时针”、“轴向”、“径向”、“周向”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本发明和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本发明的限制。
此外，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括至少一个该特征。在本发明的描述中，“多个”的含义是至少两个，例如两个，三个等，除非另有明确具体的限定。
在本发明中，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”、“固定”等术语应做广义理解，例如，可以是固定连接，也可以是可拆卸连接，或成一体；可以是机械连接，也可以是电连接；可以是直接相连，也可以通过中间媒介间接相连，可以是两个元件内部的连通或两个元件的相互作用关系，除非另有明确的限定。对于本领域的普通技术人员而言，可以根据具体情况理解上述术语在本发明中的具体含义。
在本发明中，除非另有明确的规定和限定，第一特征在第二特征“上”或“下”可以是第一和第二特征直接接触，或第一和第二特征通过中间媒介间接接触。而且，第一特征在第二特征“之上”、“上方”和“上面”可是第一特征在第二特征正上方或斜上方，或仅仅表示第一特征水平高度高于第二特征。第一特征在第二特征“之下”、“下方”和“下面”可以是第一特征在第二特征正下方或斜下方，或仅仅表示第一特征水平高度小于第二特征。
在本说明书的描述中，参考术语“一个实施例”、“一些实施例”、“示例”、“具体示例”、或“一些示例”等的描述意指结合该实施例或示例描述的具体特征、结构、材料或者特点包含于本发明的至少一个实施例或示例中。在本说明书中，对上述术语的示意性表述不必须针对的是相同的实施例或示例。而且，描述的具体特征、结构、材料或者特点可以在任一个或多个实施例或示例中以合适的方式结合。此外，在不相互矛盾的情况下，本领域的技术人员可以将本说明书中描述的不同实施例或示例以及不同实施例或示例的特征进行结合和组合。
尽管上面已经示出和描述了本发明的实施例，可以理解的是，上述实施例是示例性的，不能理解为对本发明的限制，本领域的普通技术人员在本发明的范围内可以对上述实施例进行变化、修改、替换和变型。

Claims (10)

1.一种阵列基板栅极驱动电路，其特征在于，包括：
第一电容，所述第一电容的一端作为上拉节点，所述第一电容的另一端作为所述阵列基板栅极驱动电路的输出端；
充电通路，所述充电通路分别连接信号输入端和信号控制端；
充放电通路，所述充放电通路分别连接所述信号输入端、信号控制端和时钟信号输入端，其中，
所述充电通路在所述信号输入端提供的输入信号和所述信号控制端提供的控制信号的共同作用下开通以给所述第一电容充电，同时所述充放电通路在所述信号输入端提供的输入信号、所述信号控制端提供的控制信号和所述时钟信号输入端提供的时钟信号的共同作用下开通以给所述第一电容充电，以提高所述上拉节点的电平。
2.如权利要求1所述的阵列基板栅极驱动电路，其特征在于，所述充电通路包括第一薄膜晶体管，所述第一薄膜晶体管的栅极与第一信号输入端相连，所述第一薄膜晶体管的漏极与第一信号控制端相连，所述第一薄膜晶体管的源极与所述上拉节点相连，所述充放电通路包括第二薄膜晶体管和第三薄膜晶体管，所述第二薄膜晶体管的栅极分别与所述第一薄膜晶体管的漏极和所述第一信号控制端相连，所述第二薄膜晶体管的漏极分别与所述第一薄膜晶体管的栅极和所述第一信号输入端相连，所述第三薄膜晶体管的漏极与所述第二薄膜晶体管的源极相连，所述第三薄膜晶体管的源极与所述上拉节点相连，所述第三薄膜晶体管的栅极连接第一时钟信号输入端，其中，
当所述第一信号输入端提供的输入信号为高电平、所述第一信号控制端提供的控制信号为高电平且所述第一时钟信号输入端提供的时钟信号为高电平时，所述第一薄膜晶体管打开，且所述第二薄膜晶体管和所述第三薄膜晶体管打开，所述第一信号控制端提供的高电平通过所述第一薄膜晶体管给所述第一电容充电，并通过所述第二薄膜晶体管和所述第三薄膜晶体管给所述第一电容充电。
3.如权利要求2所述的阵列基板栅极驱动电路，其特征在于，所述充电通路还包括第四薄膜晶体管，所述第四薄膜晶体管的栅极与第二信号输入端相连，所述第四薄膜晶体管的源极与第二信号控制端相连，所述第四薄膜晶体管的漏极与所述上拉节点相连，所述充放电通路还包括第五薄膜晶体管和第六薄膜晶体管，所述第五薄膜晶体管的栅极分别与所述第四薄膜晶体管的源极和所述第二信号控制端相连，所述第五薄膜晶体管的源极分别与所述第四薄膜晶体管的栅极和所述第二信号输入端相连，所述第六薄膜晶体管的源极与所述第五薄膜晶体管的漏极相连，所述第六薄膜晶体管的漏极与所述上拉节点相连，所述第六薄膜晶体管的栅极连接第一时钟信号输入端，其中，
当所述第二信号输入端提供的输入信号为高电平且第一信号输入端提供的输入信号为低电平、所述第二信号控制端提供的控制信号为高电平且第一信号控制端提供的控制信号为低电平、所述第一时钟信号输入端提供的时钟信号为高电平时，所述第四薄膜晶体管打开，且所述第五薄膜晶体管和所述第六薄膜晶体管打开，所述第二信号控制端提供的高电平通过所述第四薄膜晶体管给所述第一电容充电，并通过所述第五薄膜晶体管和所述第六薄膜晶体管给所述第一电容充电。
4.如权利要求3所述的阵列基板栅极驱动电路，其特征在于，其中，
当所述第一信号控制端提供的控制信号为高电平且所述第二信号控制端提供的控制信号为低电平时，所述阵列基板栅极驱动电路进行正扫；
当所述第一信号控制端提供的控制信号为低电平且所述第二信号控制端提供的控制信号为高电平时，所述阵列基板栅极驱动电路进行反扫。
5.如权利要求3所述的阵列基板栅极驱动电路，其特征在于，其中，
当所述第二信号输入端提供的输入信号为高电平且第一信号输入端提供的输入信号为低电平、所述第二信号控制端提供的控制信号为低电平且第一信号控制端提供的控制信号为高电平、所述第一时钟信号输入端提供的时钟信号为高电平时，所述第四薄膜晶体管打开，且所述第二薄膜晶体管和所述第三薄膜晶体管打开，所述上拉节点通过所述第四薄膜晶体管拉低到低电平，并通过所述第二薄膜晶体管和所述第三薄膜晶体管拉低到低电平以进行加速放电；
当所述第二信号输入端提供的输入信号为低电平且第一信号输入端提供的输入信号为高电平、所述第二信号控制端提供的控制信号为高电平且第一信号控制端提供的控制信号为低电平、所述第一时钟信号输入端提供的时钟信号为高电平时，所述第一薄膜晶体管打开，且所述第五薄膜晶体管和所述第六薄膜晶体管打开，所述上拉节点通过所述第一薄膜晶体管拉低到低电平，并通过所述第五薄膜晶体管和所述第六薄膜晶体管拉低到低电平以进行加速放电。
6.如权利要求3所述的阵列基板栅极驱动电路，其特征在于，还包括：
第七薄膜晶体管，所述第七薄膜晶体管的栅极与漏极相连后连接到所述第一时钟信号输入端；
第八薄膜晶体管，所述第八薄膜晶体管的漏极与所述上拉节点相连，所述第八薄膜晶体管的栅极与所述第七薄膜晶体管的源极相连，所述第八薄膜晶体管的栅极与所述第七薄膜晶体管的源极之间的节点作为下拉节点；
第九薄膜晶体管，所述第九薄膜晶体管的栅极与所述上拉节点相连，所述第九薄膜晶体管的漏极与所述下拉节点相连；
第十薄膜晶体管，所述第十薄膜晶体管的栅极与所述第一电容的另一端相连，所述第十薄膜晶体管的漏极与所述下拉节点相连；
第十一薄膜晶体管，所述第十一薄膜晶体管的漏极与所述第一电容的另一端相连，所述第十一薄膜晶体管的栅极与所述下拉节点相连；
第十二薄膜晶体管，所述第十二薄膜晶体管的漏极与第二时钟信号输入端相连，所述第十二薄膜晶体管的栅极与所述上拉节点相连，所述第十二薄膜晶体管的源极与所述第一电容的另一端相连；
其中，所述第八薄膜晶体管的源极、所述第九薄膜晶体管的源极、所述第十薄膜晶体管的源极和所述第十一薄膜晶体管的源极共同连接到直流低电平信号端，所述下拉节点与所述直流低电平信号端之间连接有第二电容。
7.如权利要求6所述的阵列基板栅极驱动电路，其特征在于，其中，
当所述第一时钟信号输入端提供的时钟信号为高电平时，所述第二时钟信号输入端提供的时钟信号为低电平；
当所述第二时钟信号输入端提供的时钟信号为高电平时，所述第一时钟信号输入端提供的时钟信号为低电平。
8.如权利要求6所述的阵列基板栅极驱动电路，其特征在于，当所述第一信号控制端提供的控制信号为高电平且所述第二信号控制端提供的控制信号为低电平时，其中，
在所述第一信号输入端提供的输入信号为高电平、所述第一时钟信号输入端提供的时钟信号为高电平且所述第二时钟信号输入端提供的时钟信号为低电平时，所述上拉节点变为高电平，所述第十二薄膜晶体管打开，所述阵列基板栅极驱动电路的输出端输出低电平；
在所述第一时钟信号输入端提供的时钟信号为低电平且所述第二时钟信号输入端提供的时钟信号为高电平时，所述第一电容对所述上拉节点进行电压自举以使所述上拉节点保持高电平，所述第十二薄膜晶体管打开，所述阵列基板栅极驱动电路的输出端输出高电平；
在所述第一时钟信号输入端提供的时钟信号为低电平且所述第二时钟信号输入端提供的时钟信号为低电平时，所述上拉节点保持高电平，所述第十二薄膜晶体管打开，所述阵列基板栅极驱动电路的输出端输出低电平；
在所述第二信号输入端提供的输入信号为高电平、所述第一时钟信号输入端提供的时钟信号为高电平且所述第二时钟信号输入端提供的时钟信号为低电平时，所述第四薄膜晶体管打开，所述第七薄膜晶体管打开，所述上拉节点拉低到低电平，所述第九薄膜晶体管关闭，所述下拉节点变为高电平，所述第十一薄膜晶体管打开，所述阵列基板栅极驱动电路的输出端输出低电平。
9.一种触控显示装置，其特征在于，包括如权利要求1-8中任一项所述的阵列基板栅极驱动电路。
10.一种触控式电子设备，其特征在于，包括如权利要求9所述的触控显示装置。
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