CN103632633B - 发射控制驱动器和具有其的有机发光显示装置 - Google Patents

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Abstract

一种发射控制驱动器和具有其的有机发光显示装置。所述发射控制驱动器包括通过发射控制线顺序输出发射控制信号的级。每个级包括：第一信号处理器，接收第一电压并响应于第一子控制信号和第二子控制信号而产生第一信号和第二信号；第二信号处理器，接收第二电压并响应于第三子控制信号、第一信号和第二信号而产生第三信号和第四信号，第二电压的电平高于第一电压的电平；第三信号处理器，接收第一电压和第二电压并响应于第三信号和第四信号产生发射控制信号。每个级的第一信号处理器接收从前一级输出的发射控制信号作为第一子控制信号，多个级中的第一级的第一信号处理器接收开始信号作为第一子控制信号。

Description

发射控制驱动器和具有其的有机发光显示装置
本专利申请要求2012年8月21日在韩国知识产权局提交的第10-2012-0091442号、名称为“发射控制驱动器和具有该发射控制驱动器的有机发光显示装置”的韩国专利申请的优先权，该申请通过引用完全包含于此。
技术领域
本公开涉及一种发射控制驱动器和一种具有该发射控制驱动器的有机发光显示装置。更具体地讲，本公开涉及一种能够简化其构造的发射控制驱动器以及一种具有该发射控制驱动器的有机发光显示装置。
背景技术
近年来，已经开发了诸如液晶显示装置、有机发光显示装置、电润湿显示装置、等离子体显示面板、电泳显示装置等的各种显示装置。有机发光显示装置利用与电子和空穴之间的复合相关联地产生光的有机发光二极管来显示图像。有机发光显示装置具有例如快的响应速度、低功耗等的大量优势。
有机发光显示装置包括：多个像素，显示图像；扫描驱动器，将扫描信号顺序施加到像素；数据驱动器，将数据电压施加到像素；发射控制驱动器，将发射控制信号施加到像素。像素响应于扫描信号而接收数据电压。像素产生具有与数据电压对应的预定亮度的光以显示图像。像素的发射时间段由发射控制信号控制。发射控制驱动器响应于初始控制信号被初始化，并产生发射控制信号。然而，期望简化发射控制驱动器的构造。
发明内容
本发明构思的实施例提供了一种包括多个级的发射控制驱动器，所述多个级通过发射控制线顺序地输出发射控制信号。每个级可包括：第一信号处理器，接收第一电压并响应于第一子控制信号和第二子控制信号而产生第一信号和第二信号；第二信号处理器，接收第二电压并响应于第三子控制信号、第一信号和第二信号而产生第三信号和第四信号，第二电压的电平高于第一电压的电平；第三信号处理器，接收第一电压和第二电压并响应于第三信号和第四信号产生发射控制信号。每个级的第一信号处理器接收从前一级输出的发射控制信号作为第一子控制信号，所述多个级中的第一级的第一信号处理器接收开始信号作为第一子控制信号。
所述多个级中的奇数级中的每个级的第一信号处理器接收第一时钟信号作为第二子控制信号，所述多个级中的奇数级中的每个级的第二信号处理器接收第二时钟信号作为第三子控制信号，所述多个级中的偶数级中的每个级的第一信号处理器接收第二时钟信号作为第二子控制信号，所述多个级中的偶数级中的每个级的第二信号处理器接收第一时钟信号作为第三子控制信号。
第一时钟信号和第二时钟信号具有相同的频率，并且第二时钟信号是通过使第一时钟信号移位与第一时钟信号的周期的一半对应的第一持续时间而获得的。
在第一时钟信号从第一电平变成比第一电平小的第二电平的时间点激活开始信号，并且在与四倍的第一持续时间对应的第二持续时间内保持开始信号的激活。
发光控制信号中的每个可在第三持续时间内具有第二电压的电平，并且发射控制信号被顺序地移位第一持续时间，第三持续时间是第一持续时间的三倍。
第一信号处理器可包括第一晶体管、第二晶体管和第三晶体管。第一晶体管具有施加有第二子控制信号的栅极端和施加有第一子控制信号的源极端。第二晶体管具有连接到第一晶体管的漏极端的栅极端和施加有第二子控制信号的漏极端。第三晶体管具有施加有第二子控制信号的栅极端、连接到第二晶体管的源极端的源极端和施加有第一电压的漏极端。从相互连接的第二晶体管和第三晶体管的源极端输出第一信号，从第一晶体管的漏极端输出第二信号。
第二信号处理器可包括第四晶体管、第五晶体管、第六晶体管和第七晶体管以及第一电容器和第二电容器。第四晶体管具有施加有第三子控制信号的栅极端和连接到第一节点和第一晶体管的漏极端的漏极端。第一电容器具有施加有第三子控制信号的第一电极和连接到第四晶体管的漏极端的第二电极。第五晶体管具有连接到第三晶体管的源极端和第二节点的栅极端、施加有第二电压的源极端以及连接到第四晶体管的源极端的漏极端。第六晶体管具有连接到第二节点的栅极端和施加有第三子控制信号的漏极端。第二电容器具有连接到第六晶体管的栅极端的第一电极和连接到第六晶体管的源极端的第二电极。第七晶体管具有施加有第三子控制信号的栅极端、连接到第三节点的源极端和连接到第六晶体管的源极端的漏极端。第三信号被施加到第三节点并且第四信号被施加到第一节点。
第三信号处理器可包括第八晶体管、第九晶体管、第十晶体管和第三电容器。第八晶体管具有连接到第一节点的栅极端、施加有第二电压的源极端和连接到第三节点的漏极端。第三电容器具有施加有第二电压的第一电极和连接到第三节点的第二电极。第九晶体管具有连接到第三节点的栅极端、施加有第二电压的源极端和连接到对应的发射控制线的漏极端。第十晶体管具有连接到第一节点的栅极端、连接到对应的发射控制线的源极端和施加有第一电压的漏极端。第九晶体管的漏极端和第十晶体管的源极端连接到下一级的第一信号处理器的第一晶体管的源极端。
本发明构思的实施例提供了一种有机发光显示设备，所述有机发光显示设备包括：显示面板，包括多个像素，每个像素连接到扫描线中的对应扫描线、数据线中的对应数据线和发射控制线中的对应发射控制线；扫描驱动器，通过扫描线将扫描信号顺序地施加到像素；数据驱动器，通过数据线将数据电压施加到像素；发射控制驱动器，包括多个级，所述多个级通过发射控制线将发射控制信号顺序地施加到像素。每个级可包括：第一信号处理器，接收第一电压并响应于第一子控制信号和第二子控制信号而产生第一信号和第二信号；第二信号处理器，接收第二电压并响应于第三子控制信号、第一信号和第二信号而产生第三信号和第四信号，第二电压的电平高于第一电压的电平；第三信号处理器，接收第一电压和第二电压并响应于第三信号和第四信号而产生发射控制信号。每个级的第一信号处理器接收从前一级输出的发射控制信号作为第一子控制信号，所述多个级中的第一级的第一信号处理器接收开始信号作为第一子控制信号。
本发明构思的实施例提供了一种发射控制驱动器，所述发射控制驱动器包括通过发射控制线顺序输出发射控制信号的多个级。每个级可包括：双向驱动器，响应于第一方向控制信号和第二方向控制信号而输出第一输入信号或第二输入信号作为第一子控制信号；第一信号处理器，接收第一电压并响应第一子控制信号和第二子控制信号而产生第一信号和第二信号；第二信号处理器，接收第二电压并响应于第三子控制信号、第一信号和第二信号产生第三信号和第四信号，第二电压的电平高于第一电压的电平；第三信号处理器，接收第一电压和第二电压并响应于第三信号和第四信号产生发射控制信号。双向驱动器接收从前一级输出的发射控制信号作为第一输入信号和从下一级输出的发射控制信号作为第二输入信号，所述多个级中的第一级的双向驱动器接收开始信号作为第一输入信号，所述多个级中的最后一级的双向驱动器接收开始信号作为第二输入信号。
本发明构思的实施例提供了一种发射控制驱动器，所述发射控制驱动器包括通过发射控制线顺序输出发射控制信号的多个级。每个级可包括：双向驱动器，响应于第一方向控制信号和第二方向控制信号而输出第一输入信号或第二输入信号作为第一子控制信号；第一信号处理器，接收第一电压并响应于第一子控制信号和第二子控制信号而产生第一信号和第二信号；第二信号处理器，接收第二电压并响应于第三子控制信号、第一信号和第二信号产生第三信号、第四信号和进位信号，第二电压的电平高于第一电压的电平；第三信号处理器，接收第一电压和第二电压并响应于第三信号和第四信号而产生发射控制信号。双向驱动器接收从前一级输出的进位信号作为第一输入信号和从下一级输出的进位信号作为第二输入信号，所述多个级中的第一级的双向驱动器接收开始信号作为第一输入信号，所述多个级中的最后一级的双向驱动器接收启动信号作为第二输入信号。
附图说明
通过参照附图详细描述示例性实施例，特征对于本领域普通技术人员而言将变得清楚，在附图中：
图1示出根据实施例的有机发光显示装置的框图；
图2示出表示图1中示出的像素中的一个像素的示例的等效电路图；
图3示出图1中示出的发射控制驱动器的框图；
图4示出根据第一示例性实施例的有机发光显示装置的发射控制驱动器的级的电路图；
图5示出图4中示出的第一级的操作的时序图；
图6和图7示出根据第二示例性实施例的有机发光显示装置的发射控制驱动器的级的电路图；
图8示出根据第三示例性实施例的有机发光显示装置的发射控制驱动器的级的电路图；
图9示出图8中示出的第一级的操作的时序图；
图10示出图8中示出的第二级的操作的时序图。
具体实施方式
现在在下文中将参照附图更充分地描述示例实施例，然而，示例实施例可以以不同的形式来实施，并不应该被解释为限于在此阐述的实施例。相反，提供这些实施例是为了使这公开将是彻底的和完整的，并将把示例性实施方式充分地传达给本领域技术人员。
将理解的是，当元件或层被称作“在”另一元件或层“上”、“连接到”或“结合到”另一元件或层时，它可以直接在另一元件或层上、直接连接到或直接结合到另一元件或层，或者可存在中间元件或中间层。相反，当元件被称作“直接在”另一元件或层上、“直接连接到”或“直接结合到”另一元件或层时，不存在中间元件或中间层。相同的标号始终表示相同的元件。如这里所使用的，术语“和/或”包括相关所列项目中的一个或多个的任意组合和全部组合。
将理解的是，尽管在这里可使用术语第一、第二等来描述不同的元件、组件、区域、层和/或部分，但是这些元件、组件、区域、层和/或部分并不受这些术语的限制。这些术语仅是用来将一个元件、组件、区域、层和/或部分与另一个元件、组件、区域、层和/或部分区分开来。因此，在不脱离本发明的教导的情况下，下面讨论的第一元件、组件、区域、层或部分可被命名为第二元件、组件、区域、层或部分。
在这里可使用空间相对术语，如“在…下方”、“在…下面”、“下面的”、“在…上方”、“上面的”等，用来轻松地描述如图中所示的一个元件或特征与其它元件或特征的关系。应该理解的是，空间相对术语意在包含除了在附图中描述的方位之外的装置在使用或操作中的不同方位。例如，如果在附图中装置被翻转，则描述为“在”其它元件或特征“下面”或“下方”的元件随后将被定位为其它元件或特征“上面的”或“在”其它元件或特征“上方”的元件或特征。因此，示例性术语“在…下方”可包括“在…上方”和“在…下方”两种方位。所述装置可被另外定位(旋转90度或者在其它方位)，相应地解释这里使用的空间相对描述符。
这里使用的术语仅为了描述特定实施例的目的，而不意图限制实施例。如这里所使用的，除非上下文另外明确指出，否则单数形式也意图包括复数形式。还将理解的是，当在本说明书中使用术语“包含”和/或“包括”时，说明存在所述特征、整体、步骤、操作、元件和/或组件，但不排除存在或附加一个或多个其它特征、整体、步骤、操作、元件、组件和/或其组合。
除非另有定义，否则这里使用的所有术语(包括技术术语和科技术语)具有与本发明所属领域的普通技术人员所通常理解的意思相同的意思。将进一步理解，除非这里明确定义，否则术语例如在通用的字典中定义的术语应该被解释为具有与相关领域的上下文中它们的意思相同的意思，而不是理想地或者过于正式地解释它们的意思。
在下文中，将参照附图详细解释实施例。
图1示出根据实施例的有机发光显示装置的框图。参照图1，有机发光显示装置100包括显示面板110、时序控制器120、扫描驱动器130、数据驱动器140和发射控制驱动器150。
显示面板110可包括以矩阵形式布置的多个像素PX11至PXnm。像素PX11至PXnm中的每个像素连接到在行方向上延伸的扫描线S1至Sn中的对应的扫描线和与扫描线S1至Sn交叉的数据线D1至Dm中的对应的数据线。另外，像素PX11至PXnm中的每个像素连接到发射控制线E1至En中的对应的发射控制线，其中，发射控制线E1至En大致平行于扫描线S1至Sn延伸。
扫描线S1至Sn连接到扫描驱动器130以接收扫描信号。数据线D1至Dm连接到数据驱动器140以接收数据电压。发射控制线E1至En连接到发射控制驱动器150，以接收发射控制信号。在本示例性实施例中，“n”和“m”中的每个为大于零(0)的整数。
时序控制器120可接收诸如R、G和B的图像信号和来自外部源(未示出)(例如，系统板)的控制信号。控制信号可包括水平同步信号Hsync、垂直同步信号Vsync和主时钟信号MCLK。
时序控制器120将图像信号R、G和B的数据格式转换成适合于数据驱动器140和时序控制器120之间的接口的数据格式。时序控制器120将转换的图像信号R’、G’和B’提供给数据驱动器140。
时序控制器120响应于控制信号而产生第一控制信号CONT1、第二控制信号CONT2和第三控制信号CONT3。第一控制信号CONT1、第二控制信号CONT2和第三控制信号CONT3分别用于控制扫描驱动器130、数据驱动器140和发射控制驱动器150的操作时序。时序控制器120将第一控制信号CONT1、第二控制信号CONT2和第三控制信号CONT3分别施加到扫描驱动器130、数据驱动器140和发射控制驱动器150。
扫描驱动器130响应于第一控制信号CONT1而产生扫描信号。扫描信号通过扫描线S1至Sn以行为单位被顺序地施加到像素PX11至PXnm。因此，像素PX11至PXnm以行为单位被顺序地选择。
数据驱动器140响应于第二控制信号CONT2而产生与图像信号R’、G’和B’对应的数据电压。数据电压通过数据线D1至Dm被分别施加到像素PX11至PXnm。
用于控制发射控制驱动器150的第三控制信号CONT3包括多个子控制信号。子控制信号可包括开始信号FLM、第一时钟信号CLK1和第二时钟信号CLK2。
发射控制驱动器150被施加有第一电压VGL和第二电压VGH，其中，第二电压VGH的电压电平高于第一电压VGL的电压电平。发射控制驱动器150响应于第三控制信号CONT3而产生发射控制信号。具体地讲，发射控制驱动器150利用开始信号FLM、第一时钟信号CLK1、第二时钟信号CLK2、第一电压VGL和第二电压VGH产生发射控制信号。后面将详细地描述发射控制驱动器150的操作。发射控制信号通过发射控制线E1至En被施加到像素PX11至PXnm。
像素PX11至PXnm被施加有第一发射电压ELVDD和第二发射电压ELVSS。像素PX11至PXnm中的每个像素响应于通过扫描线S1至Sn中的对应的扫描线提供的对应的扫描信号，通过数据线D1至Dn中的对应的数据线被施加有数据电压中的对应的数据电压。像素PX11至PXnm中的每个像素通过利用第一发射电压ELVDD和第二发射电压ELVSS以对应于数据电压的亮度发射光。后面将对此进行详细描述。像素PX11至PXnm中的每个像素的发射时间段由发射控制信号控制。
发射控制驱动器150可仅利用开始信号FLM、第一时钟信号CLK1、第二时钟信号CLK2、第一电压VGL和第二电压VGH产生发射控制信号。换言之，不需要其它控制信号来初始化发射控制驱动器150。因此，发射控制驱动器150的构造可被简化。
图2示出表示图1中示出的像素中的一个像素的示例的等效电路图。由于像素PX11至PXnm具有相同的构造和功能，所以在图2中仅示出一个像素PXij。因此，在下文中，将详细描述一个像素PXij的操作。
参照图2，像素PXij可包括有机发光二极管OLED、驱动晶体管T1、电容器Cst、开关晶体管T2和发射控制晶体管T3。驱动晶体管T1具有施加有第一发射电压ELVDD的源极端、连接到发射控制晶体管T3的源极端的漏极端以及连接到开关晶体管T2的漏极端的栅极端。开关晶体管T2具有连接到对应的扫描线Si的栅极端和连接到对应的数据线Dj的源极端。
开关晶体管T2响应于通过扫描线Si提供的扫描信号而导通。导通的开关晶体管T2通过数据线Dj接收数据电压并将数据电压施加到驱动晶体管T1的栅极端。
电容器Cst具有连接到驱动晶体管T1的源极端的第一电极和连接到驱动晶体管T1的栅极端的第二电极。电容器Cst被充入施加到驱动晶体管T1的栅极端的数据电压，并在开关晶体管T2截止之后保持充入的数据电压。
发射控制晶体管T3具有连接到对应的发射控制线Ei的栅极端和连接到有机发光二极管OLED的阳极电极(anode electrode)的漏极端。发射控制晶体管T3响应于通过发射控制线Ei提供的发射控制信号而导通。导通的发射控制晶体管T3将流过驱动晶体管T1的电流IOLED传送到有机发光二极管OLED。
有机发光二极管OLED通过其阴极电极被施加有第二发射电压ELVSS。有机发光二极管OLED根据通过发射控制晶体管T3从驱动晶体管T1提供的电流IOLED的量发射不同强度的光。
图3示出表示图1中示出的发射控制驱动器的框图。参照图3，发射控制驱动器150包括依次连接的多个级STAGE1至STAGEn，以顺序地输出发射控制信号。级STAGE1至STAGEn分别连接到发射控制线E1至En，并顺序地输出发射控制信号。在预定时间段内，发射控制信号相互重叠。在下文中，通过发射控制线E1至En输出的发射控制信号被称作第一发射控制信号至第n发射控制信号。
级STAGE1至STAGEn中的每个级接收第一电压VGL和第二电压VGH，其中，第二电压VGH的电压电平高于第一电压VGL的电压电平。另外，级STAGE1至STAGEn中的每个级接收第一时钟信号CLK1和第二时钟信号CLK2。
在级STAGE1至STAGEn中，第一级STAGE1响应开始信号FLM被驱动。具体地讲，第一级STAGE1接收第一电压VGL和第二电压VGH，并响应于开始信号FLM、第一时钟信号CLK1和第二时钟信号CLK2而产生第一发射控制信号。第一发射控制信号通过第一发射控制线E1被施加到布置在对应的行中的像素。
级STAGE1至STAGEn依次连接并被顺序地驱动。具体地讲，当前级连接到前一级的输出端并接收从前一级输出的发射控制信号。当前级响应于从前一级提供的发射控制信号而被驱动。
例如，第二级STAGE2可接收从第一级STAGE1输出的第一发射控制信号并响应于第一发射控制信号被驱动。具体地讲，第二级STAGE2可接收第一电压VGL和第二电压VGH，并响应于第一发射控制信号、第一时钟信号CLK1和第二时钟信号CLK2而产生第二发射控制信号。第二发射控制信号通过第二发射控制线E2被施加到布置在对应的行中的像素。其它级STAGE3至STAGEn以与第二级STAGE2的方式相同的方式被驱动，因此将不再重复对它们的详细描述。
图4示出根据第一示例性实施例的有机发光显示装置的发射控制驱动器的级的电路图。图4示出第一级STAGE1和第二级STAGE2的电路图，但是级STAGE1至STAGEn具有相同的电路构造和功能。因此，在下文中，将详细描述第一级STAGE1的电路构造和操作，并且为了避免冗余，将不再重复描述其它级STAGE2至STAGEn的电路构造和操作。参照图4，级STAGE1至STAGEn中的每个级可包括第一信号处理器151、第二信号处理器152和第三信号处理器153。
级STAGE1至STAGEn中的每个级的第一信号处理器151被施加有第一子控制信号和第二子控制信号。具体地讲，级STAGE2至STAGEn中的每个级的第一信号处理器151接收从前一级输出的发射控制信号作为第一子控制信号。第一级STAGE1的第一信号处理器151接收开始信号FLM作为第一子控制信号。
另外，奇数级STAGE1、STAGE3、…、和STAGEn-1中的每个级的第一信号处理器151接收第一时钟信号CLK1作为第二子控制信号。偶数级STAGE2、STAGE4、…、和STAGEn中的每个级的第一信号处理器151接收第二时钟信号CLK2作为第二子控制信号。
因此，第一信号处理器151接收第一电压VGL，并响应于第一子控制信号和第二子控制信号产生第一信号CS1和第二信号CS2。第一信号CS1和第二信号CS2被施加到第二信号处理器152。
第一级STAGE1的第一信号处理器151接收第一电压VGL，并响应于开始信号FLM和第一时钟信号CLK1产生第一信号CS1和第二信号CS2。第一信号处理器151将第一信号CS1和第二信号CS2施加到第二信号处理器152。
第一信号处理器151可包括第一晶体管M1、第二晶体管M2和第三晶体管M3。第一晶体管M1、第二晶体管M2和第三晶体管M3可为PMOS晶体管。
第一晶体管M1具有：源极端，施加有开始信号FLM；栅极端，施加有第一时钟信号CLK1；漏极端，连接到第二晶体管M2的栅极端。
第二晶体管M2具有：栅极端，连接到第一晶体管M1的漏极端；源极端，连接到第三晶体管M3的源极端；漏极端，施加有第一时钟信号CLK1。
第三晶体管M3具有：栅极端，施加有第一时钟信号CLK1并连接到第二晶体管M2的漏极端；源极端，连接到第二晶体管M2的源极端；漏极端，施加有第一电压VGL。
第一信号CS1是从相互连接的第二晶体管M2和第三晶体管M3的源极端输出的。第二信号CS2是从第一晶体管M1的漏极端输出的。
级STAGE1至STAGEn中的每个级的第二信号处理器152施加有第三子控制信号。具体地讲，奇数级STAGE1、STAGE3、…、和STAGEn-1中的每个级的第二信号处理器152接收第二时钟信号CLK2作为第三子控制信号。偶数级STAGE2、STAGE4、…、和STAGEn中的每级的第二信号处理器152接收第一时钟信号CLK1作为第三子控制信号。
第二信号处理器152接收第二电压VGH，并响应于第三子控制信号、第一信号CS1和第二信号CS2而产生第三信号CS3和第四信号CS4。第三信号CS3和第四信号CS4被施加到第三信号处理器153。
第一级STAGE1的第二信号处理器152接收第二电压VGH，并响应于第二时钟信号CLK2及来自第一信号处理器151的第一信号CS1和第二信号CS2而产生第三信号CS3和第四信号CS4。第二信号处理器152将第三信号CS3和第四信号CS4施加到第三信号处理器153。
第二信号处理器152可包括第四晶体管M4、第五晶体管M5、第六晶体管M6和第七晶体管M7以及第一电容器C1和第二电容器C2。第四晶体管M4、第五晶体管M5、第六晶体管M6和第七晶体管M7可为PMOS晶体管。
第四晶体管M4具有：栅极端，施加有第二时钟信号CLK2；漏极端，连接到第一节点N1和第二晶体管M2的栅极端；源极端，连接到第五晶体管M5的漏极端。
第一电容器C1具有施加有第二时钟信号CLK2的第一电极和连接到第四晶体管M4的漏极端和第一节点N1的第二电极。
第五晶体管M5具有：栅极端，连接到第三晶体管M3的源极端和第二节点N2；源极端，施加有第二电压VGH；漏极端，连接到第四晶体管M4的源极端。
第六晶体管M6具有：栅极端，连接到第二节点N2；源极端，连接到第七晶体管M7的漏极端；漏极端，施加有第二时钟信号CLK2。
第二电容器C2具有连接到第六晶体管M6的栅极端的第一电极和连接到第六晶体管M6的源极端的第二电极。
第七晶体管M7具有：栅极端，施加有第二时钟信号CLK2；源极端，连接到第三节点N3；漏极端，连接到第六晶体管M6的源极端。
第三信号CS3被施加到第三节点N3，并且第四信号CS4被施加到第一节点N1。
第一级STAGE1的第三信号处理器153接收第一电压VGL和第二电压VGH，并响应于从第二信号处理器152提供的第三信号CS3和第四信号CS4产生第一发射控制信号。第一发射控制信号通过第一发射控制线E1被施加到像素。第一发射控制信号被施加到第二级STAGE2的第一信号处理器151。
第三处理器153包括第八晶体管M8、第九晶体管M9和第十晶体管M10以及第三电容器C3。第八晶体管M8、第九晶体管M9和第十晶体管M10为PMOS晶体管。
第八晶体管M8具有：栅极端，连接到第一节点N1；源极端，施加有第二电压VGH；漏极端，连接到第三节点N3。
第三电容器C3具有施加有第二电压VGH的第一电极和连接到第三节点N3的第二电极。
第九晶体管M9具有：栅极端，连接到第三节点N3；源极端，施加有第二电压VGH；漏极端，连接到第一发射控制线E1。
第十晶体管M10具有：栅极端，连接到第一节点N1；源极端，连接到第一发射控制线E1；漏极端，施加有第一电压VGL。
第九晶体管M9的漏极端和第十晶体管M10的源极端连接到第二级STAGE2的第一信号处理器151的第一晶体管M1的源极端。
将参照图5详细描述通过开始信号FLM、第一时钟信号CLK1和第二时钟信号CLK2的第一晶体管M1至第十晶体管M10的操作。
图5示出表示图4中示出的第一级的操作的时序图。参照图5，第一时钟信号CLK1和第二时钟信号CLK2具有相同的频率。即，第一时钟信号CLK1和第二时钟信号CLK2具有相同的第一周期T1。第二时钟信号CLK2是通过使第一时钟信号CLK1移位第一时钟信号CLK1的第一周期T1的一半而获得的。第一时钟信号CLK1和第二时钟信号CLK2之间的移位时间段被称作第一持续时间1H。
开始信号FLM仅被施加到第一级STAGE1，并且开始信号FLM的高电平持续时间被称作第二持续时间4H。第二持续时间4H是第一时钟信号CLK1和第二时钟信号CLK2的第一周期T1的两倍。也就是说，第二持续时间4H是第一持续时间1H的四倍。
当第一时钟信号CLK1从高电平变为低电平时，开始信号FLM从低电平变成高电平。如上所述，开始信号FLM在从低电平变成高电平之后，在第二持续时间4H内保持高电平。即，当第一时钟信号CLK1从高电平变成低电平时开始信号FLM被激活，并且开始信号FLM的激活状态在第二持续时间4H内维持。
在下文中，每个信号的高电平被称作第一电平，每个信号的比高电平低的低电平被称作第二电平。另外，第一电压VGL具有第二电平，第二电压VGH具有第一电平。
开始信号FLM和第一时钟信号CLK1在第一时间点t1具有第二电平，第二时钟信号CLK2在第一时间段t1具有第一电平。
具有第二电平的第一时钟信号CLK1被施加到第一晶体管M1的栅极端和第三晶体管M3的栅极端。因此，第一晶体管M1和第三晶体管M3导通。
具有第二电平的开始信号FLM通过导通的第一晶体管M1被施加到第二晶体管M2的栅极端和第一节点N1。因此，第二晶体管M2导通，并且第一节点N1处的电压具有第二电平。
具有第二电平的第一时钟信号CLK1和第一电压VGL分别通过导通的第二晶体管M2和导通的第三晶体管M3被施加第二节点N2。因此，第二节点N2处的电压具有第二电平。
具有第一电平的第二时钟信号CLK2被施加到第四晶体管M4和第七晶体管M7。因此，第四晶体管M4和第七晶体管M7截止。
由于第一节点N1处的电压具有第二电平，所以第八晶体管M8导通。第二电压VGH通过导通的第八晶体管M8被施加到第三节点N3。因此，第三节点N3处的电压具有第一电平。第三电容器CS3被充有第二电压VGH。换言之，第三电容器C3被充有具有第一电平的电压。由于第三节点N3处的电压具有第一电平，所以第九晶体管M9截止。
由于第一节点N1处的电压具有第二电平，所以第十晶体管M10导通。由于导通的第十晶体管M10，第一电压VGL被施加到第一发射控制线E1。因此，第一发射控制线具有第二电平。
在第二时间点t2，开始信号FLM具有第二电平，第一时钟信号CLK1和第二时钟信号CLK2具有第一电平。第一晶体管M1和第三晶体管M3通过具有第一电平的第一时钟信号CLK1截止。
由于第一节点N1处的电压保持第二电平，所以第二晶体管M2导通。具有第一电平的第一时钟信号CLK1通过导通的第二晶体管M2被施加到第二节点N2。因此，第二节点N2处的电压具有第一电平。
第一节点N1处的电压具有第二电平，因此，第八晶体管M8和第十晶体管M10导通。第二电压VGH通过导通的第八晶体管M8被施加到第三节点N3，从而第三节点N3处的电压保持在第一电平。
由于第三节点N3处的电压具有第一电平并且第一节点N1处的电压具有第二电平，所以第九晶体管M9截止并且第十晶体管M10导通。因此，第一发射控制信号保持在第二电平。
在第三时间点t3，第二时钟信号CLK2从第一电平转变为第二电平，然后从第二电平再次转变成第一电平。因此，由于第一电容器C1的耦合，第一节点N1处的电势通过第二时钟信号CLK2的电势的变化而被自举(boot-strapped)。即，在第二时间点t2具有第二电平的电压的第一节点N1由于第一电容器C1的耦合在第二时钟信号CLK2的第二电平时间段具有低于第二电平的第三电平的电压。当施加到PMOS晶体管的电压的电平变低时，传统的PMOS晶体管具有良好的驱动特性。由于第一节点N1处的电压在时钟信号CLK2的第二电平时间段内具有低于第二电平的第三电平，所以可提高第八晶体管M8至第十晶体管M10的驱动特性。第一发射控制信号保持在第二电平。
在第四时间点段t4，开始信号FLM和第二时钟信号CLK2具有第一电平，第一时钟信号CLK1具有第二电平。
第一晶体管M1被具有第二电平的第一时钟信号CLK1导通，并且具有第一电平的开始信号FLM被施加到第一节点N1。第一节点N1处的电压具有第一电平，因此，第二晶体管M2和第十晶体管M10截止。
第三晶体管M3响应于具有第二电平的第一时钟信号CLK1而被导通，并且第一电压VGL被施加到第二节点N2。因此，第二节点N2处的电压具有第二电平。
第七晶体管M7响应于具有第一电平的第二时钟信号CLK2而被截止。由于第一节点N1处的电压具有第一电平，所以第八晶体管M8截止。第三节点N3处的电压通过第三电容器C3被保持在第一电平。第三节点N3处的电压保持在第一电平，因此，第九晶体管M9截止。因此，第一发射控制信号被保持在第二电平。
在第五时间点t5，开始信号FLM和第一时钟信号CLK1具有第一电平，并且第二时钟信号CLK2具有第二电平。
第一晶体管M1和第三晶体管M3通过具有第一电平的第一时钟信号CLK1截止。由于第一节点N1处的电压保持在第一电平，所以第二晶体管M2、第八晶体管M8和第十晶体管M10截止。
第四晶体管M4和第七晶体管M7响应于具有第二电平的第二时钟信号CLK2而被导通。另外，第二节点N2处的电压具有第二电平，从而第五晶体管M5和第六晶体管M6导通。
如上所述的自举，由于第二电容器C2的耦合，第二节点N2的电势通过第二时钟信号CLK2的电势的变化被自举。即，第二节点N2处的电压在第二时钟信号CLK2的第二电平时间段内具有低于第二电平的第三电平。
具有第二电平的第二时钟信号CLK2通过导通的第六晶体管M6和第七晶体管M7被施加到第三节点N3。因此，第三节点N3处的电压在第五时间点t5具有第二电平。由于第三节点N3处的电压具有第二电平，所以第九晶体管M9导通。
由于第九晶体管M9导通且第十晶体管M10截止，所以第一发射控制信号被保持在第一电平。
在第六时间点t6，开始信号FLM和第一时钟信号CLK1具有第二电平，并且第二时钟信号CLK2具有第一电平。根据第一时间点t1处的操作，第一发射控制信号在第六时间点t6具有第二电平。
第一发射控制信号具有第一电平的持续时间被称作第三持续时间3H。第三持续时间3H是第一持续时间1H的三倍。
第一发射控制信号通过第二级STAGE2和第一发射控制线E1被施加到像素。第二级STAGE2响应于第一发射控制信号、第一时钟信号CLK1和第二时钟信号CLK2产生第二发射控制信号。
第二发射控制信号在相对于第一发射控制信号被移位第一持续时间1H之后被输出。换言之，从级STAGE1至STAGEn输出的发射控制信号被顺序地移位第一持续时间1H。具体地讲，从当前级输出的发射控制信号通过使从先前级输出的发射控制信号移位第一持续时间1H而获得。
因此，根据第一示例性实施例的有机发光显示装置的发射控制驱动器150接收第一电压VGL和第二电压VGH，并响应于开始信号FLM、第一时钟信号CLK1和第二时钟信号CLK2产生发射控制信号。因此，可简化发射控制驱动器150的构造。
图6和图7示出根据第二示例性实施例的有机发光显示装置的发射控制驱动器的级的电路图。
图6示出第一级STAGE1和第二级STAGE2，图7示出第(n-1)级STAGEn-1和第n级STAGEn。然而，级STAGE1至STAGEn具有相同的电路构造和功能。除了图6和图7中示出的级包括双向驱动器之外，图6和图7中示出的级以与图4中示出的级的方式相同的方式被驱动。因此，在下文中，将描述与图4中示出的级的电路构造不同的电路构造。
参照图6和图7，级STAGE1至STAGEn中的每个级的双向驱动器154接收第一方向控制信号BI_CTL和第二方向控制信号BI_CTLB。双向驱动器154响应于第一方向控制信号BI_CTL和第二方向控制信号BI_CTLB而输出第一输出信号或第二输出信号作为第一子控制信号。
具体地讲，当前级的双向驱动器154接收从前一级级输出的发射控制信号作为第一输入信号，并接收从下一级输出的发射控制信号作为第二输入信号。另外，第一级STAGE1的双向驱动器154接收开始信号FLM作为第一输入信号，并且第n级STAGEn接收开始信号FLM作为第二输入信号。
例如，由于第一级STAGE1没有前一级，所以从第一级STAGE1输出的第一发射控制信号被施加到下一级(即，第二级STAGE2)。从第二级STAGE2输出的第二发射控制信号被施加到下一级(即，第三级STAGE3)和前一级(即，第一级STAGE1)。由于第n级STAGEn没有下一级，所以从第n级STAGEn输出的第n发射控制信号被施加到前一级(即，第(n-1)级STAGEn-1)。从第(n-1)级STAGEn-1输出的第(n-1)发射控制信号被施加到下一级(即，第n级STAGEn)和前一级(即，第(n-2)级STAGEn-2)。
双向驱动器154包括第十一晶体管M11和第十二晶体管M12。
第十一晶体管M11包括施加有第一方向控制信号BI_CTL的栅极端和施加有第一输入信号的源极端。第十二晶体管M12包括施加有第二方向控制信号BI_CTLB的栅极端和施加有第二输入信号的源极端。第十一晶体管M11和第十二晶体管M12的漏极端连接到第一信号处理器151的第一晶体管M1的源极端。
在第一级STAGE1中，双向驱动器154的第十一晶体管M11的栅极端接收第一方向控制信号BI_CTL，并且双向驱动器154的第十一晶体管M11的源极端接收开始信号FLM。第十二晶体管M12的栅极端接收第二方向控制信号BI_CTLB，并且第十二晶体管M12的源极端接收从第二级STAGE2输出的第二发射控制信号。第十一晶体管M11和第十二晶体管M12的漏极端连接到第一晶体管M1的源极端。
在第n级STAGEn中，双向驱动器154的第十一晶体管M11的栅极端接收第一方向控制信号BI_CTL，并且双向驱动器154的第十一晶体管M11的源极端接收从第(n-1)级STAGEn-1输出的第(n-1)发射控制信号。第十二晶体管M12的栅极端接收第二方向控制信号BI_CTLB，并且第十二晶体管M12的源极端接收开始信号FLM。第十一晶体管M11和第十二晶体管M12的漏极端连接到第一晶体管M1的源极端。
在其它级STAGE2至STAGEn-1中，双向驱动器154的第十一晶体管M11的栅极端接收第一方向控制信号BI_CTL，并且双向驱动器154的第十一晶体管M11的源极端接收从前一级输出的发射控制信号。第十二晶体管M12的栅极端接收第二方向控制信号BI_CTLB，并且第十二晶体管M12的源极端接收从下一级输出的发射控制信号。第十一晶体管M11和第十二晶体管M12的漏极端连接到第一晶体管M1的源极端。
第一方向控制信号BI_CTL和第二方向控制信号BI_CTLB相互具有不同的电平。例如，当第一方向控制信号BI_CTL具有第一电平(或高平)时，第二方向控制信号BI_CTLB具有低于第一电平的第二电平(或低电平)。
当第一方向控制信号BI_CTL具有第二电平时，级STAGE1至STAGEn中的每个级的双向驱动器154的第十一晶体管M11导通，并且级STAGE1至STAGEn中的每个级的双向驱动器154的第十二晶体管M12截止。因此，开始信号FLM被施加到第一级STAGE1的双向驱动器154。另外，从第一级STAGE1输出的第二发射控制信号被施加到第二级STAGE2。即，根据第二示例性实施例的发射控制驱动器的级STAGE1至STAGEn以与图4中示出的级的方式相同的方式被驱动。从级STAGE1至STAGEn输出的发射控制信号按照从第一发射控制信号至第n发射控制信号的顺序被顺序地施加到像素。因此，按照从显示面板110的上部到显示面板110的下部的顺序驱动像素。
在第二方向控制信号BI_CTLB具有第二电平的情况下，级STAGE1至STAGEn中的每个级的双向驱动器154的第十一晶体管M11截止，并且级STAGE1至STAGEn中的每个级的双向驱动器154的第十二晶体管M12导通。因此，开始信号FLM被施加到第n级STAGEn的双向驱动器154。另外，从第n级STAGEn输出的第n发射控制信号被施加到第(n-1)级STAGEn-1。因此，从级STAGE1至STAGEn输出的发射控制信号按照从第n发射控制信号至第一发射控制信号的顺序被顺序地施加到像素。因此，按照从显示面板110的下部到显示面板110的上部的顺序驱动像素。
根据第二示例性实施例的有机发光显示装置的发射控制驱动器接收第一电压VGL和第二电压VGH，并响应于开始信号FLM、第一时钟信号CLK1和第二时钟信号CLK2而产生发射控制信号。因此，可简化发射控制驱动器的构造。
图8示出根据第三示例性实施例的有机发光显示装置的发射控制驱动器的级的电路图。图8示出发射控制驱动器的第一级STAGE1和第二级STAGE2。然而，级STAGE1至STAGEn具有相同的电路构造和功能。因此，在下文中，将详细描述第一级STAGE1并省略对其它级STAGE2至STAGEn的详细描述。
除了第二信号处理器152a之外，以与图6和图7中示出的级的驱动方式相同的方式驱动图8中示出的级。因此，在下文中，将描述与图6和图7中示出的级的电路构造不同的电路构造。
参照图8，级STAGE1至STAGEn中的每个级的双向驱动器154接收从前一级输出的进位信号CA作为第一输入信号，并接收从下一级输出的进位信号CA作为第二输入信号。另外，第一级STAGE1的双向驱动器154接收开始信号FLM作为第一输入信号，并且第n级STAGEn的双向驱动器154接收开始信号FLM作为第二输入信号。
从级STAGE1至STAGEn中的每个级的第二信号处理器152a输出进位信号CA。为了输出进位信号CA，级STAGE1至STAGEn中的每个级的第二信号处理器152a包括第四晶体管M4至第七晶体管M7、第一电容器C1和第二电容器C2以及第十三晶体管M13和第十四晶体管M14。除了第一电容器C1、第十三晶体管M13和第十四晶体管M14之外，第二信号处理器152a的电路构造与图4中示出的第二信号处理器152的电路构造相同。因此，将详细描述第一级STAGE1的第二信号处理器152a的第一电容器C1、第十三晶体管M13和第十四晶体管M14之间的连接。
第十三晶体管M13具有：栅极端，连接到第五晶体管M5的栅极端和第二节点N2；源极端，施加有第二电压VGH；漏极端，连接到第四节点N4。
第十四晶体管M14具有：栅极端，连接到第四晶体管M4的栅极端；源极端，连接到第四节点N4；漏极端，施加有第二时钟信号CLK2。
第一电容器C1具有：第一电极，连接到第四晶体管M4的漏极端和第十四晶体管M14的栅极端；第二电极，连接到第四节点N4。
从第四节点N4输出的信号被定义为进位信号CA，并被施加到第二级STAGE2的双向驱动器154。
级STAGE1至STAGEn中的每个级的进位信号CA被施加到前一级和下一级中的每个级的双向驱动器154。例如，由于第一级STAGE1的前一级不存在，所以从第一级STAGE1输出的进位信号CA被施加到下一级(即，第二级STAGE2)的双向驱动器154。从第二级STAGE2输出的进位信号CA被施加到下一级(即，第三级STAGE3)的双向驱动器154和前一级(即，第一级STAGE1)的双向驱动器154。
由于第n级STAGEn的下一级不存在，所以从第n级STAGEn输出的进位信号被施加到第(n-1)级STAGEn-1的双向驱动器154。从第(n-1)级STAGEn-1输出的进位信号CA被施加到第n级STAGEn和第(n-2)级STAGEn-2中的每个级的双向驱动器154。
即，代替图6和图7中示出的级中使用的发射控制信号，图8中示出的级中的每个级将进位信号CA施加到其前一级和下一级。因此，可通过使用进位信号而不是发射控制信号来驱动级STAGE1至STAGEn。
下面将参照图9详细描述通过第十三晶体管M13和第十四晶体管M14从第一级STAGE1输出进位信号CA。另外，将在后面参照图10详细描述响应于来自第一级STAGE1的进位信号CA驱动的第二级STAGE2。
图9示出表示图8中示出的第一级的操作的时序图。尽管图9中未示出，但是第一方向控制信号BI_CTL具有第二电平，并且第二方向控制信号BI_CTLB具有第一电平。即，按照从显示面板110的上部到显示面板110的下部的顺序驱动级STAGE1至STAGEn。
除了第四节点N4处的电压被添加作为进位信号CA之外，图9中示出的信号具有与图5中示出的信号的波形相同的波形。换言之，除了图8中示出的第一级STAGE1输出进位信号CA之外，以与图4中示出的第一级STAGE1的驱动方式相同的方式驱动图8中示出的第一级STAGE1。
在除了第一节点N1具有第一电平的时间段N1_H之外的时间段内，第一节点N1具有第二电平或第三电平。当第一节点N1具有第二电平或第三电平时，第十四晶体管M14导通。即，在除了第一节点N1具有第一电平的时间段N1_H之外的时间段内，第二时钟信号CLK2被施加到第四节点N4。因此，在除了第一节点N1具有第一电平的时间段N1_H之外的时间段内，第四节点N4具有与第二时钟信号CLK2的波形相同的波形。
当第一节点N1处的电压具有第一电平时，第十四晶体管M14截止。当第一节点N1处的电压从第二电平变为第一电平时，第二节点N2处的电压从第一电平改变为第二电平。当第二节点N2处的电压具有第二电平时，第十三晶体管M13导通。第二电压VGH通过导通的第十三晶体管M13被施加到第四节点N4。因此，第四节点N4处的电压具有第一电平并在第十三晶体管M13导通时保持在第一电平。也就是说，在第二节点N2具有第二电平的时间段N2_L内，第四节点N4处的电压保持在第一电平。
当第十四晶体管M14不存在时，第二时钟信号CLK2被连续地施加到第一电容器C1。因此，第一电容器C1被交替地且重复地充入第一电平和第二电平。在这种情况下，由于第一电容器C1的负载，第二时钟信号CLK2可被延迟。即，异常的第二时钟信号CLK2被施加到第二信号处理器152。
当第一节点N1处的电压具有第一电平时，第十四晶体管M14截止。当第十四晶体管M14截止时，第二时钟信号CLK2不受第三电容器C3的影响，因此，可防止第二时钟信号CLK2的延迟。
当第十四晶体管M14截止时，第十三晶体管M13使第四节点N4均匀地保持。换言之，当第十四晶体管M14截止时，第十三晶体管M13导通，从而第四节点N4处的电压保持在第一电平。
根据第三示例性实施例的有机发光显示装置的发射控制驱动器仅利用开始信号FLM、进位信号CA、第一时钟信号CLK1、第二时钟信号CLK2和第二电压VGH产生发射控制信号。即，不需要额外的控制信号来初始化发射控制驱动器150。因此，可简化发射控制驱动器150的构造。
图10示出表示图8中示出的第二级的操作的时序图。参照图10，第一级STAGE1的第四节点N4处的电压作为进位信号CA被施加到第二级STAGE2。在第一时间点t1，进位信号CA和第二时钟信号CLK2具有第二电平，第一时钟信号CLK1具有第一电平。
具有第二电平的第二时钟信号CLK2被施加到第一晶体管M1的栅极端和第三晶体管M3的栅极端。因此，第一晶体管M1和第三晶体管M3被导通。
具有第二电平的进位信号CA通过导通的第一晶体管M1被施加到第二晶体管M2的栅极端和第一节点N1。因此，第二晶体管M2导通并且第一节点N1处的电压具有第二电平。
具有第一电平的第一时钟信号CLK1被施加到第四晶体管M4和第七晶体管M7。因此，第四晶体管M4和第七晶体管M7截止。
由于第一节点N1处的电压具有第二电平，所以第八晶体管M8导通。第二电压VGH通过导通的第八晶体管M8被施加到第三节点N3。因此，第三节点N3处的电压具有第一电平，第九晶体管M9截止。
第一节点N1处的电压具有第二电平，从而第十晶体管M10导通。由于导通的第十晶体管M10，第一电压VGL被施加到第二发射控制线E2。因此，第二发射控制信号具有第二电平。
在第二时间点t2，进位信号CA、第一时钟信号CLK1和第二时钟信号CLK2具有第一电平。第一晶体管M1和第三晶体管M3响应于具有第一电平的第二时钟信号CLK2而被截止。
由于第一节点N1处的电压保持在第二电平，因此第二晶体管M2导通。具有第一电平的第一时钟信号CLK1通过导通的第二晶体管M2被施加到第二节点N2。因此，第二节点N2处的电压具有第一电平。
由于第一节点N1处的电压具有第二电平，所以第八晶体管M8和第十晶体管M10导通。因此，第二电压VGH通过导通的第八晶体管M8被施加到第三节点N3，从而第三节点N3处的电压保持在第一电平。
当第三节点N3处的电压具有第一电平并且第一节点N1处的电压具有第二电平时，第九晶体管M9截止并且第十晶体管M10导通。因此，第二发射控制信号保持在第二电平。
在第三时间点t3，通过第一电容器C1的耦合而导致的第一节点N1的电势的改变与图5中描述的变化相同。
在第四时间点t4，进位信号CA和第一时钟信号CLK1具有第一电平，第二时钟信号CLK2具有第二电平。
第一晶体管M1通过具有第二电平的第二时钟信号CLK2导通，并且具有第一电平的进位信号CA被施加到第一节点N1。第一节点N1处的电压具有第一电平。由于第一节点N1处的电压具有第一电平，所以第二晶体管M2和第十晶体管M10截止。
第三晶体管M3响应于具有第二电平的第二时钟信号CLK2而被导通，并且第一电压VGL被施加到第二节点N2。因此，第二节点N2处的电压具有第二电平。
第七晶体管M7响应于具有第一电平的第一时钟信号CLK1而被截止。由于第一节点N1处的电压具有第一电平，所以第八晶体管M8截止。第三节点N3处的电压通过第三电容器C3保持在第一电平，因此第九晶体管M9截止。结果，第二发射控制信号保持在第二电平。
在第五时间点t5，进位信号CA和第二时钟信号CLK2具有第一电平，并且第一时钟信号CLK1具有第二电平。
第一晶体管M1和第三晶体管M3响应于具有第一电平的第二时钟信号CLK2而被截止。第一节点N1处的电压保持在第一电平。因此，第二晶体管M2、第八晶体管M8和第十晶体管M10截止。
第四晶体管M4和第七晶体管M7响应于具有第二电平的第一时钟信号CLK1而被导通。另外，由于第二节点N2处的电压具有第二电平，所以第五晶体管M5和第六晶体管M6导通。
具有第二电平的第二时钟信号CLK2通过导通的第六晶体管M6和第七晶体管M7被施加到第三节点N3。因此，第三节点N3处的电压在第五时间点t5具有第二电平，从而第九晶体管M9导通。当第九晶体管M9导通并且第十晶体管M10截止时，第二发射控制信号具有第一电平。
在第六时间点t6，进位信号CA和第二时钟信号CLK2具有第一电平，并且第一时钟信号CLK1具有第一电平。根据如上所述的在第一时间点t1的操作，第一发射控制信号在第六时间点t6具有第二电平。
如上所述，当前级响应于第一时钟信号CLK1、第二时钟信号CLK2和从前一级提供的进位信号CA产生发射控制信号。另外，从级STAGE1至STAGEn输出的发射控制信号被顺序地移位第一持续时间1H。由于不需要额外的控制信号来初始化发射控制驱动器，所以可简化发射控制驱动器的构造。
已经在此公开了示例实施例，尽管采用了特定术语，但是仅以一般且描述性的意义使用并解释这些特定术语，而不是出于限制的目的。在一些情况下，如截止至提交本申请时本领域普通技术人员将清楚的是，除非另外明确指出，否则结合具体实施例描述的特征、特性和/或元件可被单独使用或与结合其它实施例描述的特征、特性和/或元件组合使用。因此，本领域技术人员将理解的是，在不脱离如权利要求所阐述的本发明的精神和范围的情况下，可以在形式和细节上做出各种改变。

Claims (30)

1.一种发射控制驱动器，所述发射控制驱动器包括：
多个级，通过发射控制线顺序输出发射控制信号，每个级包括：
第一信号处理器，接收第一电压并响应于第一子控制信号和第二子控制信号而产生第一信号和第二信号；
第二信号处理器，接收第二电压并响应于第三子控制信号、第一信号和第二信号而产生第三信号和第四信号，第二电压的电平高于第一电压的电平；
第三信号处理器，接收第一电压和第二电压并响应于第三信号和第四信号而产生发射控制信号，
其中，所述多个级中的除第一级之外的每个级的第一信号处理器接收从前一级输出的发射控制信号作为第一子控制信号，所述多个级中的第一级的第一信号处理器接收开始信号作为第一子控制信号，
其中，第四信号通过第三子控制信号的电势的变化而被自举，第三子控制信号具有第一电平和比第一电平低的第二电平，第四信号具有比第二电平低的第三电平。
2.根据权利要求1所述的发射控制驱动器，其中：
所述多个级中的奇数级中的每个级的第一信号处理器接收第一时钟信号作为第二子控制信号，
所述多个级中的奇数级中的每个级的第二信号处理器接收第二时钟信号作为第三子控制信号，
所述多个级中的偶数级中的每个级的第一信号处理器接收第二时钟信号作为第二子控制信号，和
所述多个级中的偶数级中的每个级的第二信号处理器接收第一时钟信号作为第三子控制信号。
3.根据权利要求2所述的发射控制驱动器，其中，第一时钟信号和第二时钟信号具有相同的频率，并且第二时钟信号是通过使第一时钟信号移位与第一时钟信号的周期的一半对应的第一持续时间而获得的。
4.根据权利要求3所述的发射控制驱动器，其中，在第一时钟信号从第一电平变成比第一电平小的第二电平的时间点激活开始信号，并且在与四倍的第一持续时间对应的第二持续时间内保持开始信号的激活。
5.根据权利要求3所述的发射控制驱动器，其中，发射控制信号中的每个在第三持续时间内具有第二电压的电平，并且发射控制信号被顺序地移位第一持续时间，第三持续时间是第一持续时间的三倍。
6.根据权利要求2所述的发射控制驱动器，其中，第一信号处理器包括：
第一晶体管，具有施加有第二子控制信号的栅极端和施加有第一子控制信号的源极端；
第二晶体管，具有连接到第一晶体管的漏极端的栅极端和施加有第二子控制信号的漏极端；
第三晶体管，具有施加有第二子控制信号的栅极端、连接到第二晶体管的源极端的源极端和施加有第一电压的漏极端，
其中，从相互连接的第二晶体管和第三晶体管的源极端输出第一信号，从第一晶体管的漏极端输出第二信号。
7.根据权利要求6所述的发射控制驱动器，其中，第二信号处理器包括：
第四晶体管，具有施加有第三子控制信号的栅极端和连接到第一节点和第一晶体管的漏极端的漏极端；
第一电容器，具有施加有第三子控制信号的第一电极和连接到第四晶体管的漏极端的第二电极；
第五晶体管，具有连接到第三晶体管的源极端和第二节点的栅极端、施加有第二电压的源极端以及连接到第四晶体管的源极端的漏极端；
第六晶体管，具有连接到第二节点的栅极端和施加有第三子控制信号的漏极端；
第二电容器，具有连接到第六晶体管的栅极端的第一电极和连接到第六晶体管的源极端的第二电极；
第七晶体管，具有施加有第三子控制信号的栅极端、连接到第三节点的源极端和连接到第六晶体管的源极端的漏极端，其中，第三节点处的电压被输出作为第三信号并且第一节点处的电压被输出作为第四信号。
8.根据权利要求7所述的发射控制驱动器，其中，第三信号处理器包括：
第八晶体管，具有连接到第一节点的栅极端、施加有第二电压的源极端和连接到第三节点的漏极端；
第三电容器，具有施加有第二电压的第一电极和连接到第三节点的第二电极；
第九晶体管，具有连接到第三节点的栅极端、施加有第二电压的源极端和连接到对应的发射控制线的漏极端；和
第十晶体管，具有连接到第一节点的栅极端、连接到对应的发射控制线的源极端和施加有第一电压的漏极端。
9.一种有机发光显示装置，所述有机发光显示装置包括：
显示面板，包括多个像素，每个像素连接到扫描线中的对应扫描线、数据线中的对应数据线和发射控制线中的对应发射控制线；
扫描驱动器，通过扫描线将扫描信号顺序地施加到像素；
数据驱动器，通过数据线将数据电压施加到像素；
发射控制驱动器，包括多个级，所述多个级通过发射控制线将发射控制信号顺序地施加到像素，所述多个级中的每个级包括：
第一信号处理器，接收第一电压并响应于第一子控制信号和第二子控制信号而产生第一信号和第二信号；
第二信号处理器，接收第二电压并响应于第三子控制信号、第一信号和第二信号而产生第三信号和第四信号，第二电压的电平高于第一电压的电平；
第三信号处理器，接收第一电压和第二电压并响应于第三信号和第四信号而产生发射控制信号，
其中，所述多个级中的除第一级之外的每个级的第一信号处理器接收从前一级输出的发射控制信号作为第一子控制信号，所述多个级中的第一级的第一信号处理器接收开始信号作为第一子控制信号，
其中，第四信号通过第三子控制信号的电势的变化而被自举，第三子控制信号具有第一电平和比第一电平低的第二电平，第四信号具有比第二电平低的第三电平。
10.根据权利要求9所述的有机发光显示装置，其中：
所述多个级中的奇数级中的每个级的第一信号处理器接收第一时钟信号作为第二子控制信号，
所述多个级中的奇数级中的每个级的第二信号处理器接收第二时钟信号作为第三子控制信号，
所述多个级中的偶数级中的每个级的第一信号处理器接收第二时钟信号作为第二子控制信号，和
所述多个级中的偶数级中的每个级的第二信号处理器接收第一时钟信号作为第三子控制信号。
11.根据权利要求10所述的有机发光显示装置，其中：
第一时钟信号和第二时钟信号具有相同的频率，
第二时钟信号是通过使第一时钟信号移位与第一时钟信号的周期的一半对应的第一持续时间而获得的，
在第一时钟信号从第一电平变成比第一电平小的第二电平的时间点激活开始信号，
在四倍第一持续时间的第二持续时间内保持开始信号的激活。
12.根据权利要求11所述的有机发光显示装置，其中，第一信号处理器包括：
第一晶体管，具有施加有第二子控制信号的栅极端和施加有第一子控制信号的源极端；
第二晶体管，具有连接到第一晶体管的漏极端的栅极端和施加有第二子控制信号的漏极端；
第三晶体管，具有施加有第二子控制信号的栅极端、连接到第二晶体管的源极端的源极端和施加有第一电压的漏极端，
其中，从相互连接的第二晶体管和第三晶体管的源极端输出第一信号，从第一晶体管的漏极端输出第二信号。
13.根据权利要求12所述的有机发光显示装置，其中，第二信号处理器包括：
第四晶体管，具有施加有第三子控制信号的栅极端和连接到第一节点和第一晶体管的漏极端的漏极端；
第一电容器，具有施加有第三子控制信号的第一电极和连接到第四晶体管的漏极端的第二电极；
第五晶体管，具有连接到第三晶体管的源极端和第二节点的栅极端、施加有第二电压的源极端以及连接到第四晶体管的源极端的漏极端；
第六晶体管，具有连接到第二节点的栅极端和施加有第三子控制信号的漏极端；
第二电容器，具有连接到第六晶体管的栅极端的第一电极和连接到第六晶体管的源极端的第二电极；
第七晶体管，具有施加有第三子控制信号的栅极端、连接到第三节点的源极端和连接到第六晶体管的源极端的漏极端，其中，第三节点处的电压被输出作为第三信号并且第一节点处的电压被输出作为第四信号。
14.根据权利要求13所述的有机发光显示装置，其中，第三信号处理器包括：
第八晶体管，具有连接到第一节点的栅极端、施加有第二电压的源极端和连接到第三节点的漏极端；
第三电容器，具有施加有第二电压的第一电极和连接到第三节点的第二电极；
第九晶体管，具有连接到第三节点的栅极端、施加有第二电压的源极端和连接到对应的发射控制线的漏极端；和
第十晶体管，具有连接到第一节点的栅极端、连接到对应的发射控制线的源极端和施加有第一电压的漏极端。
15.一种发射控制驱动器，所述发射控制驱动器包括：
多个级，通过发射控制线顺序输出发射控制信号，每个级包括：
双向驱动器，响应于第一方向控制信号和第二方向控制信号而输出第一输入信号或第二输入信号作为第一子控制信号；
第一信号处理器，接收第一电压并响应于第一子控制信号和第二子控制信号而产生第一信号和第二信号；
第二信号处理器，接收第二电压并响应于第三子控制信号、第一信号和第二信号而产生第三信号和第四信号，第二电压的电平高于第一电压的电平；和
第三信号处理器，接收第一电压和第二电压并响应于第三信号和第四信号而产生发射控制信号，
其中，所述多个级中的除第一级和最后一级之外的每个级的双向驱动器接收从前一级输出的发射控制信号作为第一输入信号和从下一级输出的发射控制信号作为第二输入信号，所述多个级中的第一级的双向驱动器接收开始信号作为第一输入信号和从下一级输出的发射控制信号作为第二输入信号，所述多个级中的最后一级的双向驱动器接收从前一级输出的发射控制信号作为第一输入信号并接收开始信号作为第二输入信号，
其中，第四信号通过第三子控制信号的电势的变化而被自举，第三子控制信号具有第一电平和比第一电平低的第二电平，第四信号具有比第二电平低的第三电平。
16.根据权利要求15所述的发射控制驱动器，其中，双向驱动器响应于被激活的第一方向控制信号将第一输入信号施加到第一信号处理器，响应于被激活的第二方向控制信号将第二输入信号施加到第一信号处理器。
17.根据权利要求16所述的发射控制驱动器，其中，双向驱动器包括：
第十一晶体管，具有施加有第一方向控制信号的栅极端和施加有第一输入信号的源极端；和
第十二晶体管，具有施加有第二方向控制信号的栅极端、施加有第二输入信号的源极端和连接到第十一晶体管的漏极端的漏极端，其中，第一子控制信号通过第十一晶体管和第十二晶体管的漏极被施加到第一信号处理器。
18.根据权利要求15所述的发射控制驱动器，其中，
所述多个级中的奇数级中的每级的第一信号处理器接收第一时钟信号作为第二子控制信号，
所述多个级中的奇数级中的每级的第二信号处理器接收第二时钟信号作为第三子控制信号，
所述多个级中的偶数级中的每级的第一信号处理器接收第二时钟信号作为第二子控制信号，和
所述多个级中的偶数级中的每级的第二信号处理器接收第一时钟信号作为第三子控制信号。
19.根据权利要求18所述的发射控制驱动器，其中，
第一时钟信号和第二时钟信号具有相同的频率，
第二时钟信号是通过使第一时钟信号移位与第一时钟信号的周期的一半对应的第一持续时间而获得的，
在第一时钟信号从第一电平变成比第一电平小的第二电平的时间点激活开始信号，和
在与四倍的第一持续时间对应的第二持续时间内保持开始信号的激活。
20.根据权利要求18所述的发射控制驱动器，其中，第一信号处理器包括：
第一晶体管，具有施加有第二子控制信号的栅极端和施加有第一子控制信号的源极端；
第二晶体管，具有连接到第一晶体管的漏极端的栅极端和施加有第二子控制信号的漏极端；
第三晶体管，具有施加有第二子控制信号的栅极端、连接到第二晶体管的源极端的源极端和施加有第一电压的漏极端，其中，从相互连接的第二晶体管和第三晶体管的源极端输出第一信号，从第一晶体管的漏极端输出第二信号。
21.根据权利要求20所述的发射控制驱动器，其中，第二信号处理器包括：
第四晶体管，具有施加有第三子控制信号的栅极端和连接到第一节点和第一晶体管的漏极端的漏极端；
第一电容器，具有施加有第三子控制信号的第一电极和连接到第四晶体管的漏极端的第二电极；
第五晶体管，具有连接到第三晶体管的源极端和第二节点的栅极端、施加有第二电压的源极端以及连接到第四晶体管的源极端的漏极端；
第六晶体管，具有连接到第二节点的栅极端和施加有第三子控制信号的漏极端；
第二电容器，具有连接到第六晶体管的栅极端的第一电极和连接到第六晶体管的源极端的第二电极；和
第七晶体管，具有施加有第三子控制信号的栅极端、连接到第三节点的源极端和连接到第六晶体管的源极端的漏极端，其中，第三节点处的电压被输出作为第三信号并且第一节点处的电压被输出作为第四信号。
22.根据权利要求21所述的发射控制驱动器，其中，第三信号处理器包括：
第八晶体管，具有连接到第一节点的栅极端、施加有第二电压的源极端和连接到第三节点的漏极端；
第三电容器，具有施加有第二电压的第一电极和连接到第三节点的第二电极；
第九晶体管，具有连接到第三节点的栅极端、施加有第二电压的源极端和连接到对应的发射控制线的漏极端；和
第十晶体管，具有连接到第一节点的栅极端、连接到对应的发射控制线的源极端和施加有第一电压的漏极端。
23.一种发射控制驱动器，所述发射控制驱动器包括：
多个级，通过发射控制线顺序输出发射控制信号，每个级包括：
双向驱动器，响应于第一方向控制信号和第二方向控制信号而输出第一输入信号或第二输入信号作为第一子控制信号；
第一信号处理器，接收第一电压并响应于第一子控制信号和第二子控制信号产生第一信号和第二信号；
第二信号处理器，接收第二电压并响应于第三子控制信号、第一信号和第二信号而产生第三信号、第四信号和进位信号，第二电压的电平高于第一电压的电平；和
第三信号处理器，接收第一电压和第二电压并响应于第三信号和第四信号产生发射控制信号，
其中，除所述多个级中的第一级和最后一级之外的双向驱动器接收从前一级输出的进位信号作为第一输入信号并接收从下一级输出的进位信号作为第二输入信号，所述多个级中的第一级的双向驱动器接收开始信号作为第一输入信号并接收从下一级输出的进位信号作为第二输入信号，所述多个级中的最后一级的双向驱动器接收从前一级输出的进位信号作为第一输入信号并接收开始信号作为第二输入信号，
其中，第四信号通过第三子控制信号的电势的变化而被自举，第三子控制信号具有第一电平和比第一电平低的第二电平，第四信号具有比第二电平低的第三电平。
24.根据权利要求23所述的发射控制驱动器，其中，双向驱动器响应于被激活的第一方向控制信号将第一输入信号施加到第一信号处理器，并响应于被激活的第二方向控制信号将第二输入信号施加到第一信号处理器。
25.根据权利要求24所述的发射控制驱动器，其中，双向驱动器包括：
第十一晶体管，具有施加有第一方向控制信号的栅极端和施加有第一输入信号的源极端；和
第十二晶体管，具有施加有第二方向控制信号的栅极端、施加有第二输入信号的源极端和连接到第十一晶体管的漏极端的漏极端，其中，第一子控制信号通过第十一晶体管和第十二晶体管的漏极被施加到第一信号处理器。
26.根据权利要求23所述的发射控制驱动器，其中：
所述多个级中的奇数级中的每个级的第一信号处理器接收第一时钟信号作为第二子控制信号，
所述多个级中的奇数级中的每个级的第二信号处理器接收第二时钟信号作为第三子控制信号，
所述多个级中的偶数级中的每个级的第一信号处理器接收第二时钟信号作为第二子控制信号，和
所述多个级中的偶数级中的每个级的第二信号处理器接收第一时钟信号作为第三子控制信号。
27.根据权利要求26所述的发射控制驱动器，其中：
第一时钟信号和第二时钟信号具有相同的频率，
第二时钟信号是通过使第一时钟信号移位与第一时钟信号的周期的一半对应的第一持续时间而获得的，
在第一时钟信号从第一电平变成比第一电平小的第二电平的时间点激活开始信号，和
在与四倍的第一持续时间对应的第二持续时间内保持开始信号的激活。
28.根据权利要求26所述的发射控制驱动器，其中，第一信号处理器包括：
第一晶体管，具有施加有第二子控制信号的栅极端和施加有第一子控制信号的源极端；
第二晶体管，具有连接到第一晶体管的漏极端的栅极端和施加有第二子控制信号的漏极端；
第三晶体管，具有施加有第二子控制信号的栅极端、连接到第二晶体管的源极端的源极端和施加有第一电压的漏极端，其中，从相互连接的第二晶体管和第三晶体管的源极端输出第一信号，从第一晶体管的漏极端输出第二信号。
29.根据权利要求28所述的发射控制驱动器，其中，第二信号处理器包括：
第四晶体管，具有施加有第三子控制信号的栅极端和连接到第一节点和第一晶体管的漏极端的漏极端；
第一电容器，具有施加有第三子控制信号的第一电极和连接到第四晶体管的漏极端的第二电极；
第五晶体管，具有连接到第三晶体管的源极端和第二节点的栅极端、施加有第二电压的源极端以及连接到第四晶体管的源极端的漏极端；
第六晶体管，具有连接到第二节点的栅极端和施加有第三子控制信号的漏极端；
第二电容器，具有连接到第六晶体管的栅极端的第一电极和连接到第六晶体管的源极端的第二电极；
第七晶体管，具有施加有第三子控制信号的栅极端、连接到第三节点的源极端和连接到第六晶体管的源极端的漏极端；
第十三晶体管，具有连接到第二节点的栅极端、施加有第二电压的源极端和连接到第四节点的漏极端；和
第十四晶体管，具有连接到第一电容器的第二电极的栅极端、连接到第四节点的源极端和施加有第一时钟信号的漏极端，其中，第三节点处的电压被输出作为第三信号，第一节点处的电压被输出作为第四信号，第四节点处的电压被输出作为进位信号。
30.根据权利要求29所述的发射控制驱动器，其中，第三信号处理器包括：
第八晶体管，具有连接到第一节点的栅极端、施加有第二电压的源极端和连接到第三节点的漏极端；
第三电容器，具有施加有第二电压的第一电极和连接到第三节点的第二电极；
第九晶体管，具有连接到第三节点的栅极端、施加有第二电压的源极端和连接到对应的发射控制线的漏极端；和
第十晶体管，具有连接到第一节点的栅极端、连接到对应的发射控制线的源极端和施加有第一电压的漏极端。
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